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KR20080041160A - 플라즈마 디스플레이 패널의 구동 방법 - Google Patents

플라즈마 디스플레이 패널의 구동 방법 Download PDF

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KR20080041160A
KR20080041160A KR1020080034805A KR20080034805A KR20080041160A KR 20080041160 A KR20080041160 A KR 20080041160A KR 1020080034805 A KR1020080034805 A KR 1020080034805A KR 20080034805 A KR20080034805 A KR 20080034805A KR 20080041160 A KR20080041160 A KR 20080041160A
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야수시 요네다
겐지 아와모또
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가부시끼가이샤 히다치 세이사꾸쇼
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Abstract

본 발명은 소요 시간의 연장을 피하면서 어드레싱의 신뢰성을 높이는 것을 목적으로 한다.
본 발명은 화면을 구성하는 종횡으로 나란한 셀에 대하여, 각 셀의 상태를 설정하는 선 순차의 어드레싱을 할 때에, 각 행 선택시마다 선택한 행에 속하는 모든 셀에 각각에 해당하는 표시 데이터에 따른 강도의 방전을 일으켜, 그것에 의해 이후의 방전에서의 프라이밍 효과를 생기게 한다.
가스 방전 패널, 어드레싱

Description

플라즈마 디스플레이 패널의 구동 방법{METHOD FOR DRIVING A PLASMA DISPLAY PANEL}
본 발명은, PDP(Plasma Display Panel: 플라즈마 디스플레이 패널), PALC(Plasma 어드레스ed Liquid Crystal: 플라즈마 어드레스 액정)로 대표되는 가스 방전 패널의 구동 방법 및 그것을 이용한 표시 장치에 관한 것이다.
PDP는 컬러 표시의 실용화를 계기로 대화면의 텔레비전 표시 디바이스로서 보급되고 있다. 시장이 확대됨에 따라서, 동작의 신뢰성에 대한 요구도 엄격하게 되고 있다.
컬러 표시 디바이스로서 3전극 면방전 구조의 AC형 PDP가 상품화되어 있다. 이것은 매트릭스 표시의 행(라인)마다 점등 유지를 위한 1쌍의 주전극이 배치되고, 열마다 어드레스 전극이 배치된 것이다. 셀간의 방전 간섭을 방지하는 격벽은 스트라이프 형상으로 형성되어 있고, 각 열의 전체 길이에 걸쳐 방전 공간은 연속하고 있다. AC형이므로, 표시할 때에는 주전극을 덮는 유전체층으로 대전하는 벽 전하에 의한 메모리 기능이 이용된다. 즉, 1쌍의 주전극의 한쪽을 스캔 전극과 어드레스 전극을 데이터 전극으로 하는 선 순차 형식으로 표시 내용에 따른 각 셀의 대전 상 태를 제어하는 어드레싱을 행하고, 그 후에 모든 주전극 쌍에 대하여 일제히 교번 극성의 점등 유지 전압(Vs)을 인가한다. 이것에 의해서, 소정량 이상의 벽 전하가 존재하는 셀에서만 벽 전압(Vw)과 인가 전압을 합친 셀 전압(Vc)이 방전 개시 전압(Vf)을 넘어, 그것에 의해 점등 유지 전압의 인가시마다 기판면에 따른 면방전이 생긴다. 점등 유지 전압의 인가 주기를 짧게 하면 외관상 연속한 점등 상태가 얻어진다.
텔레비전 영상 같은 시계열의 화상 표시를 할 때에는, 어드레싱과 점등 유지가 반복된다. 통상, 표시의 교란을 방지하기 위해서, 어떤 화상의 점등 유지의 종료 후에 다음 화상의 어드레싱에 앞서 화면 전체의 대전 상태를 균일화하는 어드레싱 준비를 한다.
종래의 어드레싱은 점등시키는 셀 또는 점등시키지 않는 셀의 어느 쪽에서만 어드레스 방전을 일으켜서 벽 전하의 대전량(벽 전압)을 변화시키는 것이었다. 기입 어드레스 형식에서는, 어드레싱 준비로서 화면 내에 잔류하고 있는 벽 전하를 소거하고, 점등시키는 셀에서만 어드레스 방전을 일으켜서 해당 셀에 적량의 벽 전하를 형성한다. 소거 어드레스 형식에서는, 어드레싱 준비로서 모든 셀에 적량의 벽 전하를 형성하고, 점등시키지 않는 셀에서만 어드레스 방전을 일으켜서 해당 셀의 벽 전하를 소거한다.
상술한 선 순차의 어드레싱에서는, 어드레스 방전을 일어나기 쉽게 하는 프라이밍(priming) 효과에 기여하는 전하는 어드레싱 준비의 방전으로 생겨서 잔류하고 있는 공간 전하, 및 행 선택(주사)의 상류측의 셀에서의 어드레스 방전으로 생긴 공간 전하이다. 그런데, 상류측의 셀이 어드레스 방전을 일으킬 필요가 없는 셀(예를 들면 기입 어드레스 형식에서의 점등시키지 않는 셀)의 경우에는, 상류측에서 어드레스 방전이 생기지 않기 때문에, 어드레싱 준비 단계에서 생겨서 잔류하고 있는 공간 전하만이 프라이밍 효과에 기여하게 된다. 공간 전하는 시간의 경과와 함께 감소하므로, 어드레싱의 종료에 가까워짐에 따라 공간 전하의 잔류량이 적게 되어 방전 늦음이 현저해진다. 이 때문에, 비교적 늦은 시기에 선택되는 행의 셀에서 스캔 펄스 폭으로 규정되는 행 선택 기간(1행 분의 주사시간) 내에 어드레스 방전이 일어나지 않고, 표시 결함이 생겨 버린다는 중대한 문제가 있었다. 표시 결함의 일 예로서는, 화면의 위에서 아래로 주사하는 경우에, 화면의 하단 부근만을 띠 형상으로 점등시키는 표시를 할 때에 그 띠의 상단 테두리의 일부 또는 전부가 점등되지 않는 "흑 노이즈"가 있다. 특히, 스트라이프 패턴의 격벽에 의해 방전 공간이 열마다로 구획되어 있는 구조에서는, 각 열 내에서밖에 프라이밍 효과를 낳는 공간 전하의 이동이 일어나지 않기 때문에 표시 결함이 생기기 쉽다.
이 문제의 회피 수단으로서, 행을 선택하는 스캔 펄스의 인가 직전에 선택 대상의 행에서 공간 전하를 형성하기 위한 프라이밍 방전을 일으키게 하는 방법이 제안되고 있다(특개평9-6280호). 프라이밍 방전은 표시 내용에 관계되지 않고 행 내의 모든 셀에서 생기고, 어드레스 방전은 거의 확실하게 일어난다.
그러나, 종래의 구동 방법에서는, 선택 행에 대한 스캔 펄스의 인가와 병행하여 다음 선택 행에 대하여 프라이밍 방전을 일으키는 프라이밍 펄스를 인가하므로, 펄스 폭이나 파고값의 최적화가 어렵고 제어가 복잡했다. 또, 프라이밍 방전을 확실하게 일으키는데는 펄스 폭을 길쭉하게 설정할 필요가 있으므로, 행마다 프라이밍 펄스를 인가함으로써 어드레싱의 소요 시간이 길어져 버린다. 또한, 행끼리 사이에서 펄스 인가의 시기가 어긋나도록 한 경우에는, 행 선택 기간은 프라이밍 펄스 폭과 스캔 펄스 폭의 합이 되고, 어드레싱의 소요 시간은 더욱 길어진다.
본 발명은 소요 시간의 연장을 피하면서 어드레싱의 신뢰성을 높이는 것을 목적으로 하고 있다.
본 발명에서는, 화면 표시에서의 표시 데이터라고 한 상태 설정 데이터에 따라서 셀의 상태를 제어하는 어드레싱에서, 어드레스 방전의 유무가 아니라 어드레스 방전의 강약(전하 이동량의 대소)을 선택한다. 즉, 어드레싱 대상의 모든 셀에 대하여, 표시 내용에 관계없이 최저한의 강도 이상의 어드레스 방전을 일으키기 위한 전압을 인가한다. 방전의 강도는 인가 전압에 의존한다.
예를 들면 선 순차의 어드레싱의 경우, 선택 행에 속한 모든 셀에서 다음에 선택되는 행에서의 프라이밍 효과에 기여하는 공간 전하가 생긴다. 따라서, 어드레스 방전에 의한 공간 전하가 유효하게 되도록 n번째와 (n+l)번째 선택 행끼리의 거 리가 소정 범위 내가 되는 순서로 행 선택을 행하면, 어떠한 표시 패턴이라도 어드레스 방전을 확실하게 일으킬 수 있다. 어드레스 방전의 확률이 높아지는 만큼 스캔 펄스 폭을 짧게 하여 표시를 고속화할 수 있다.
각 셀에 벽 전하가 대전되는 구조의 가스 표시 패널의 어드레싱에서는, 어드레스 방전에 의해 벽 전압이 변화된다. 따라서, 변화 후의 벽 전압이 소망 값이 되도록, 변화량을 어림잡아 변화 이전의 벽 전압(목표치)을 설정한다.
도1a 및 도1b은 본 발명을 적용한 AC형 PDP의 어드레싱에서의 벽 전압의 변화를 나타내는 도면이다.
방전의 강도 설정에 의해 벽 전압의 변화량을 조정할 수 있다. 단, 전극 전위의 변화는 고전위로부터 저전위로 또는 그 반대의 어느 한 쪽이 되므로, 점등의 여부와 방전의 강약의 조합은 다음 2 종류가 된다.
기입 어드레스 형식의 경우에는, 어드레스 과정의 전 처리로서 주전극 사이의 벽 전압 Vw를 점등 유지 방전이 일어나지 않는 비점등 범위 내의 값 Vw1으로 해 둔다. 비점등 범위란 벽 전압 Vw와 같은 극성의 점등 유지 전압을 인가하여도 셀 전압이 방전 개시 전압을 넘어가지 않는 범위이고, 그 하한치는 부극성의 임계치 Vth2이고 상한치는 정극성 측의 임계치 Vth1이다. 어드레스 과정에서는 선택 셀(점등시키는 셀)에서 강한 어드레스 방전을 일으켜, 벽 전압 Vw를 이전과 반대 극성으로 점등 유지 방전이 일어나는 점등 범위 내의 값으로 변화시킨다. 한편, 비선택 셀(점등시키지 않는 셀)에서는 프라이밍을 위한 약한 어드레스 방전을 일으킨다. 이 때, 벽 전압 Vw는 값 Vw1로부터 그것보다 낮은 값(도면에서는 0)으로 변화한다.
소거 어드레스 형식의 경우에는, 어드레스 과정의 전 처리로서 주전극 사이의 벽 전압 Vw를 점등 유지 방전이 일어나는 점등 범위 내의 값 Vw2로 해 둔다. 어드레스 과정에서는 비선택 셀에서 강한 어드레스 방전을 일으켜, 벽 전압 Vw를 값 Vw2로부터 비점등 범위 내의 값(도면에서는 0)으로 변화시킨다. 한편, 선택 셀에서는 프라이밍을 위한 약한 어드레스 방전을 일으킨다. 이 때, 벽 전압 Vw는 값 Vw2로부터 그것보다 점등 범위 내의 값 Vw2'으로 변화한다.
본 발명의 방법은 종횡으로 나란한 셀이 행 선택을 위한 스캔 전극과 열 선택을 위한 데이터 전극의 교차부에 규정되고, 각 셀의 점등 또는 비점등 상태를 설정하는 어드레싱이 상기 스캔 전극의 행마다의 선택 순위에 대응한 데이터 전극의 선택 구동에 의해 선 순차로 행해지는 가스 방전 패널의 구동 방법으로서, 어드레싱에서의 각 행 선택시마다, 선택한 행에 속하는 모든 셀에서 각각에 해당하는 상태 설정 데이터에 따른 강도의 방전을 일으키는 것이다.
본 발명의 방법은 화면을 구성하는 종횡으로 나란한 셀이 행 선택을 위한 스캔 전극과 열 선택을 위한 데이터 전극의 교차부에 규정되고, 각 셀의 점등 또는 비점등 상태를 설정하는 어드레싱이 상기 스캔 전극의 행마다의 선택 순위에 대응한 데이터 전극의 선택 구동에 의해 선 순차로 행해지는 가스 방전 패널의 구동 방법으로서, 어드레싱에서의 각 행 선택시마다, 선택한 행에 속하는 모든 셀에서 각각에 해당하는 표시 데이터에 따른 강도의 방전을 일으키는 것이다.
본 발명의 방법은 종횡으로 나란한 셀로 이루어진 화면을 가지고, 각 셀에서 행 선택을 위한 스캔 전극과 열 선택을 위한 데이터 전극이 교차하고, 상기 스캔 전극 및 데이터 전극의 적어도 한쪽이 벽 전압을 일으키기 위한 유전체층으로 덮이고, 각 열에서 전체 길이에 걸쳐 방전 공간이 연속된 구조의 가스 방전 패널의 구동 방법으로서, 상기 화면의 모든 셀의 벽 전압을 상기 스캔 전극의 행마다의 선택 순위에 대응하여 상기 데이터 전극에 선택적으로 가해지는 2치(値) 표시 데이터에 따라서 점등 또는 비점등의 상태로 제어하는 선 순차의 어드레싱 및 모든 셀에 교류 전압을 인가하는 점등 유지를 반복해서 행하고, 상기 어드레싱으로서 각 행 선택시마다 선택한 행에 속하는 모든 셀에서 각각에 해당하는 표시 데이터에 따른 제1 강도 또는 제2 강도의 방전을 일으키는 것이다.
본 발명의 구동 방법은 상기 어드레싱을 행하기 전에, 선택 행의 모든 셀에 준비 펄스를 인가하여 상기 각 셀의 벽 전압을 소정의 레벨로 설정하는 어드레싱 준비를 행하고, 상기 어드레싱에서 표시해야 할 셀에 대해서는 제1 강도의 방전을 일으켜서 상기 어드레싱 준비에서 설정된 벽 전압의 레벨을 계속되는 점등 유지 동작에서 방전을 재기하는데 충분한 레벨로 증대시키고, 표시하지 않는 셀에 대해서는 제2 강도의 방전을 일으켜서 상기 어드레싱 준비에서 설정된 벽 전압의 레벨을 계속되는 점등 유지 동작에서 방전이 재기 불능으로 되는 레벨로 저감시키는 것이다.
본 발명의 구동 방법은 상기 어드레싱을 행하기 전에, 선택 행의 모든 셀에 준비 펄스를 인가하여 상기 각 셀의 벽 전압을 소정의 레벨로 설정하는 어드레싱 준비를 행하고, 상기 어드레싱에서 표시해야 할 셀에 대해서는 제1 강도의 방전을 일으켜서 상기 어드레싱 준비에서 설정된 벽 전압의 레벨을 계속되는 점등 유지 동 작에서 방전을 재기하는데 충분한 레벨로 유지시키고, 표시하지 않는 셀에 대해서는 제2 강도의 방전을 일으켜서 상기 어드레싱 준비에서 설정된 벽 전압의 레벨을 계속되는 점등 유지 동작에서 방전이 재기 불능으로 되는 레벨로 저감시키는 것이다.
본 발명의 구동 방법은 상기 스캔 전극에 대한 개별의 전위 제어에 의한 행 선택에 동기하여, 상기 데이터 전극의 각각을 1행 분의 표시 데이터에 따라서 제1 전위 또는 제2 전위로 바이어스하는 것이다.
본 발명의 구동 방법은 상기 어드레싱에서의 각 행 선택시마다, 선택한 행에 속하는 모든 셀에서 1회씩 방전을 일으키는 것이다.
본 발명의 구동 방법은 두 번째 이후의 행 선택에서 그 이전의 행 선택에서의 방전이 프라이밍 방전으로서 유효해지는 순서로 행 선택을 행하는 것이다.
본 발명의 구동 방법은 상기 화면의 행을 홀수 번째 조와 짝수 번째 조로 나누어, 조마다 시분할로 어드레싱을 행하고, 그 때에 앞의 조의 어드레싱과 뒤의 조의 어드레싱 사이에 상기 뒤의 조에 속한 모든 셀에 대하여 프라이밍 방전을 일으키기 위한 전압을 인가하는 것이다.
본 발명의 구동 방법은 상기 화면의 열 방향의 외측에 상기 스캔 전극과 동등한 1이상의 보조 전극을 설치하고, 상기 어드레싱에서 첫 번째 행 선택의 이전에 상기 보조 전극에 대하여 프라이밍 방전을 일으키기 위한 전압을 인가하는 것이다.
본 발명의 구동 방법은 상기 화면의 행을 홀수 번째 조와 짝수 번째 조로 나누어, 조마다 시분할로 어드레싱을 행하고, 그 때에 앞의 조의 어드레싱과 뒤의 조 의 어드레싱 사이에 상기 뒤의 조의 최초에 선택하는 행에 가까운 상기 보조 전극에 대하여 프라이밍 방전을 일으키기 위한 전압을 인가하는 것이다.
본 발명의 장치는 종횡으로 나란한 셀로 이루어진 화면을 가지고, 각 셀에서 행 선택을 위한 스캔 전극과 열 선택을 위한 데이터 전극이 교차하고, 상기 스캔 전극 및 데이터 전극의 적어도 한쪽이 벽 전압을 일으키기 위한 유전체층으로 덮이고, 각 열에서 전체 길이에 걸쳐 방전 공간이 연속된 구조의 가스 방전 패널과, 상기 화면의 모든 셀의 벽 전압을 2치 표시 데이터에 따라서 제어하는 선 순차의 어드레싱, 및 모든 셀에 교류 전압을 인가하는 점등 유지를 반복해서 행하는 구동 회로를 구비하고, 상기 구동 회로가 상기 어드레싱으로서, 각 행 선택시마다 선택한 행에 속하는 모든 셀에서 각각에 해당하는 표시 데이터에 따른 제1 강도 또는 제2 강도의 방전을 일으키는 것이다.
본 발명의 표시 장치는 어드레싱에 앞서는 어드레싱 준비에서, 어드레싱에서 방전이 생기는 셀의 전극간에, 제1 설정치로부터 제2 설정치까지 단조롭게 상승하는 전압을 인가하는 구동 회로를 구비하고, 상기 구동 회로는 상기 어드레싱 준비로서, 상기 전압의 상승 기간 내에 상기 셀에서 복수 회의 방전 또는 연속적인 방전을 일으켜서 전극 사이의 벽 전압을 조정하는 것이다.
본 발명의 구동 방법은 어드레싱에 앞서는 어드레싱 준비에서, 어드레싱에서 방전이 생기는 셀의 전극간에, 제1설정치로부터 제2 설정치까지 단조롭게 상승하는 전압을 인가함으로써, 상기 전압의 상승 기간 내에 상기 셀에서 복수 회의 방전 또는 연속적인 방전을 일으켜서 전극 사이의 벽 전압을 조정하는 것이다.
본 발명의 구동 방법은 종횡으로 나란한 셀에 대하여 각 셀의 상태를 설정하는 점(点) 순차 어드레싱을 행하는 가스 방전 패널의 구동 방법으로서, 어드레싱에서의 각 셀 선택시마다, 선택한 셀에서 그것에 해당하는 상태 설정 데이터에 따른 강도의 방전을 일으키는 것이다.
본 발명의 구동 방법은 벽 전하에 의한 메모리 기능을 가지는 복수의 방전 셀이 매트릭스 형상으로 배열된 가스 방전 패널의 구동 방법으로서, 매트릭스 배열된 모든 방전 셀에 소정의 준비 펄스를 동시에 인가하여 상기 각 방전 셀의 벽 전하를 소정의 레벨로 설정하는 어드레스 준비 스텝과, 상기 벽 전하가 형성된 모든 방전 셀에 선 순차의 어드레스 방전을 행하게 하는 어드레스 스텝과, 매트릭스 배열된 모든 방전 셀에 소정의 서스테인 펄스를 공통으로 인가하여 상기 어드레스된 방전 셀에 유지 방전을 행하게 하는 표시 스텝을 가지고, 상기 어드레스 스텝에서 어드레스해야 할 방전 셀에 대해서는 계속되는 표시 스텝에서 방전을 재기하는데 충분한 벽 전하를 축적할 수 있는 레벨의 방전용 전압을 인가함으로써 제1 강도의 방전을 일으키고, 어드레스하지 않는 방전 셀에 대해서는 상기 어드레스 준비 스텝에 설정된 벽 전하의 레벨을 계속되는 표시 스텝에서 방전이 재기 불능으로 되는 레벨로 저감시키는 제2 강도의 방전을 일으키는 것이다.
본 발명에 의하면, 소요 시간의 연장을 피하면서 어드레싱의 신뢰성을 높일 수 있다.
본 발명에 의하면, 어드레싱의 소요 시간을 가장 짧게 할 수 있다.
본 발명에 의하면, 화면 내의 각 행의 동작 조건을 갖추어서, 표시 품질을 높일 수 있다.
본 발명에 의하면, 어드레스 방전시의 선택 행에 인접하는 비선택 행의 주전극의 전위의 자유도가 증가하고, 어드레스 방전의 제어성이 높아진다.
본 발명에 의하면, 어드레스 방전을 일으키기 전의 벽 전압의 조정을 용이하게 할 수 있고, 어드레스 방전의 제어성이 높아진다.
도2는 본 발명에 관계되는 플라즈마 표시 장치(100)의 구성도이다.
플라즈마 표시 장치(100)는 매트릭스 형식의 박형 컬러 표시 디바이스인 AC형 PDP(1)와, m열 n행의 화면(ES)을 구성하는 종횡으로 나란한 다수의 셀(C)을 선택적으로 점등시키기 위한 구동 유닛(80)으로 구성되어 있고, 벽걸이식 텔레비전 수상기, 컴퓨터 시스템의 모니터 등으로서 사용된다.
PDP(1)는 점등 유지 방전(표시 방전이라고도 한다)을 일으키기 위한 전극 쌍을 이루는 주전극(X, Y)이 평행 배치되고, 각 셀(C)에서 주전극(X, Y)과 어드레스 전극(A)이 교차하는 3전극 면방전 구조를 이룬다. 주전극(X, Y)은 화면(ES)의 행 방향(수평 방향)으로 뻗어있고, 주전극(Y)은 어드레싱을 할 때에 행 단위로 셀(C)을 선택하기 위한 스캔 전극으로서 사용된다. 어드레스 전극(A)은 열 방향(수직 방향)으로 뻗어 있고, 열 단위로 셀(C)을 선택하기 위한 데이터 전극으로서 사용된다. 기판면 중의 주전극군과 어드레스 전극군이 교차하는 범위가 표시 영역(즉 화면(ES))이 된다.
구동 유닛(80)은 제어기(81), 데이터 처리 회로(83), 전원 회로(84), X 드라이버(85), 스캔 드라이버(86), Y 공통 드라이버(87), 및 어드레스 드라이버(89)를 가지고 있다. 또한, 구동 유닛(80)은 PDP(1)의 배후측에 배치되고, 각 드라이버와 PDP(1)의 전극이 도시하지 않는 플랙시블 케이블로 전기적으로 접속된다. 구동 유닛(80)에는 TV 튜너, 컴퓨터 등의 외부 장치로부터 R, G, B의 각색의 휘도 레벨(계조 레벨)을 나타내는 화소 단위의 필드 데이터(DF)가, 각종의 동기 신호와 함께 입력된다.
필드 데이터(DF)는 데이터 처리 회로(83)에서의 프레임 메모리(830)에 일단 저장된 뒤, 서브 필드 데이터(Dsf)로 변환된다. 서브 필드 데이터(Dsf)는 프레임 메모리(830)에 저장되고, 적시에 어드레스 드라이버(89)에 전송된다. 서브 필드 데이터(Dsf)의 각 비트의 값은 후술하는 계조 재현을 위한 서브 필드에서의 셀의 점등의 여부를 나타내는 정보, 엄밀하게는 어드레스 방전의 여부를 나타내는 정보이다.
X 드라이버(85)는 모든 주전극(X)에 일괄적으로 구동 전압을 인가한다. 주전극(X)의 전기적인 공통화는 도시한 바와 같은 패널상의 연결에 한정되지 않고, X 드라이버(85)의 내부 배선, 또는 접속용 케이블상에서의 배선에 의해 할 수 있다. 스캔 드라이버(86)는 어드레싱에서 선택 행의 주전극(Y)에 구동 전압을 인가한다. Y 공통 드라이버(87)는 점등 유지를 할 때에 모든 주전극(Y)에 일괄적으로 구동 전압을 인가한다. 또, 어드레스 드라이버(89)는 서브 필드 데이터(Dsf)에 따라서 총 m개의 어드레스 전극(A)에 제1 또는 제2 강도의 어드레스 방전을 일으키기 위한 구 동 전압을 인가한다. 이들 드라이버에는 전원 회로(84)로부터 도시하지 않는 배선 도체를 개재하여 소정의 전력이 공급된다.
도3은 PDP(1)의 내부 구조를 나타내는 사시도이다.
PDP(1)에서는 전면측 기판 구조체의 기재인 유리 기판(11)의 내면에, 행마다 1쌍씩 주전극(X, Y)이 배열되어 있다. 행은 화면에서의 수평 방향의 셀 열이다. 주전극(X, Y)은 각각 투명 도전막(41)과 금속막(버스 도체)(42)으로 되고, 저융점 유리로 되는 두께 30㎛ 정도의 유전체층(17)으로 피복되어 있다. 유전체층(17)의 표면에는 마그네시아(MgO)로 되는 두께 수천 옹스트롬의 보호막(18)이 형성되어 있다. 어드레스 전극(A)은 배면측 기판 구조체의 기재인 유리 기판(21)의 내면에 배열되어 있고, 두께 10㎛ 정도의 유전체층(24)에 의해 피복되어 있다. 유전체층(24)의 위에는 높이 150㎛의 평면에서 보았을 때 직선 띠 형상의 격벽(29)이 각 어드레스 전극(A) 사이에 1개씩 형성되어 있다. 이들 격벽(29)에 의해 방전 공간(30)이 행 방향으로 서브 픽셀(단위 발광 영역)마다 구획되고, 또한 방전 공간(30)의 간극 치수가 규정되어 있다. 그리고, 어드레스 전극(A)의 위쪽 및 격벽(29)의 측면을 포함해 배면측의 내면을 피복하도록, 컬러 표시를 위한 R, G, B의 3색의 형광체층(28R, 28G, 28B)이 형성되어 있다. 방전 공간(30)에는 주성분인 네온에 키세논을 혼합한 방전 가스가 충전되어 있고, 형광체층(28R, 28G, 28B)은 방전시에 키세논이 발하는 자외선에 의해 국부적으로 여기하여 발광한다. 표시의 1픽셀(화소)은 행 방향으로 나란한 3개의 서브 픽셀로 구성된다. 각 서브 픽셀 내의 구조체가 셀(표시 소자)(C)이다. 격벽(29)의 배치 패턴이 스트라이프 패턴이므로, 방전 공간(30) 중 의 각 열에 대응한 부분은 모든 행에 걸쳐서 열 방향으로 연속하고 있다.
이하, 플라즈마 표시 장치(100)에서의 PDP(1)의 구동 방법을 설명한다. 최초에 계조 재현의 개요를 설명하고, 그 후에 본 발명에 특유한 구동 시퀀스에 대하여 상술한다.
도4는 필드 구성을 나타내는 도면이다.
텔레비전 영상의 표시에서는, 2치 점등 제어에 의해 계조 재현을 하기 위해서, 입력 화상인 시계열의 각 필드(f)(부호의 첨자는 표시 순위를 나타낸다)를 예를 들면 8개의 서브 프레임 sf1, sf2, sf3, sf4, sf5, sf6, sf7, sf8으로 분할한다. 바꾸어서 말하자면, 프레임을 구성하는 각 필드(f)를 8개의 서브 프레임(sf1 ~ sf8)의 집합으로 바꾼다. 또한, 컴퓨터 출력 등의 논인터레이스 형식의 화상을 재생하는 경우에는 각 프레임을 8분할한다. 그리고, 이들 서브 필드(sf1 ~ sf8)에서의 휘도의 상대 비율이 대략 1:2:4:8:16:32:64:128이 되도록 웨이트를 주어 각 서브 필드(sf1 ~ sf8)의 점등 유지 방전의 회수를 설정한다. 서브 필드 단위의 점등/비점등의 조합으로 RGB의 각 색마다 256단계의 휘도 설정을 할 수 있으므로, 표시 가능한 색의 수는 2563이 된다. 단, 서브 필드(sf1 ~ sf8)를 휘도의 웨이트 순서로 표시할 필요는 없다. 예를 들면 웨이트가 큰 서브 필드(sf8)를 필드 기간(Tf)의 중간에 배치하는 최적화를 할 수 있다.
각 서브 필드(sfj)(j=1 ~ 8)에 할당된 서브 필드 기간(Tsfj)은 램프 전압에 의한 전하 조정을 하는 준비 기간(TR), 표시 내용에 따른 대전 분포를 형성하는 어 드레스 기간(TA), 및 계조 레벨에 따른 휘도를 확보하기 위해서 점등 상태를 유지하는 서스테인 기간(TS)으로 된다. 각 서브 필드 기간(Tsfj)에서 준비 기간(TR) 및 어드레스 기간(TA)의 길이는 휘도의 웨이트에 관계없이 일정하지만, 서스테인 기간(TS)의 길이는 휘도의 웨이트가 클수록 길다. 즉, 1개의 필드(f)에 대응하는 8개의 서브 필드 기간(Tsfj)의 길이는 서로 다르다.
도5는 구동 시퀀스의 제1예를 나타내는 전압 파형도이다. 이도면에서는, 주전극(X, Y)의 부호에는 대응하는 행의 배열 순위를 나타내는 문자(1, 2 …n)를 더하고, 어드레스 전극(A)의 부호에는 대응하는 열의 배열 순위를 나타내는 문자(1 ~ m)를 더하고 있다. 이하에 설명하는 다른 도면에서도 같다.
서브 필드마다 반복되는 구동 시퀀스의 개요는 다음과 같다.
준비 기간(TR)에서는 모든 어드레스 전극(A1~Am)에 대하여 펄스(Pra1)와 그것의 반대 극성의 펄스(Pra2)를 차례로 인가하고, 모든 주전극(X1 ~ Xn)에 대하여 펄스(Prx1)와 그것의 반대 극성인 펄스(Prx2)를 차례로 인가하고, 모든 주전극(Y1 ~ Yn)에 대하여 펄스(Pry1)와 그것의 반대 극성인 펄스(Pry2)를 차례로 인가한다. 여기서 말하는 펄스의 인가란 일시적으로 전극을 기준 전위(예를 들면 접지 전위)와 다른 전위로 바이어스하는 것이다. 본 예에서 펄스(Pra1, Pra2, Prx1, Prx2, Pry1, Pry2)는 미소 방전이 생기는 변화율의 램프 전압 펄스이다. 또, 펄스(Pra1, Prx1)는 부극성이고, 펄스(Pry1)는 정극성이다. 램프 파형의 펄스(Pra2, Prx2, Pry2)의 인가에 의해서, 벽 전압을 방전 개시 전압과 펄스 진폭과의 차에 상당하는 값으로 조정할 수 있다. 펄스(Pra1, Prx1, Pry1)는 1개 전의 서브 필드에서 점등한 "전회 점등 셀" 및 점등하지 않았던 "전회 비점등 셀"에 적당한 벽 전압을 일으키기 위해 인가된다.
어드레스 기간(TA)에서는 주전극(Y1 ~ Yn)에 배열 순서로 스캔 펄스(Py)를 인가한다. 이 행 선택과 동시에, 어드레스 전극(A1 ~ Am)에 대하여 스캔 펄스(Py)와 반대 극성으로 선택 행의 서브 필드 데이터(Dsf)에 따른 파고값의 어드레스 펄스(Pa)를 인가한다. 즉, 선택 셀에서 강한 방전을 일으키고, 비선택 셀에서 약한 방전을 일으킨다. 스캔 펄스(Py)와 어드레스 펄스(Pa)의 인가에 의해서, 어드레스 전극(A)과 주전극(Y)의 사이에서 방전이 일어나고, 그것이 트리거가 되어 주전극(X, Y) 사이에서도 방전이 일어난다. 이들 일련의 방전인 어드레스 방전에는 어드레스 전극(A)과 주전극(Y) 사이(이하, 전극 간극(AY)이라 한다)의 방전 개시 전압(VfAY)과, 주전극(X, Y) 사이(이하, 전극 간극(XY)이라 한다)의 방전 개시 전압(VfXY)과 관계된다. 따라서, 상술한 준비 기간(TR)에서는 전극 간극(XY)과 전극 간극(AY)의 쌍방에 대하여 벽 전압의 조정을 하는 것이다. AY간의 벽 전압은 주전극(Y)에 스캔 펄스(Py)을 인가하기 이전에 방전이 일어나지 않을 정도의 값이면 좋다.
서스테인 기간(TS)에서는 최초에 모든 주전극(Y1 ~ Yn)에 대하여 소정 극성(예시에서는 정극성)의 서스테인 펄스(Ps)를 인가한다. 그 후, 주전극(X1 ~ Xn)과 주전극(Y1 ~ Yn)에 대하여 교호로 서스테인 펄스(Ps)를 인가한다. 본 예에서는 최 종 서스테인 펄스(Ps)는 주전극(X1 ~ Xn)에 인가된다. 서스테인 펄스(Ps)의 인가에 의해서, 어드레스 기간(TA)에서 벽 전하가 남겨진 이번 점등 셀에서 면방전이 생긴다. 그리고, 면방전이 생길 때마다 전극 사이의 벽 전압의 극성이 반전된다. 또한, 서스테인 기간(TS)에 걸쳐 불필요한 방전을 방지하기 위해서 모든 어드레스 전극(A1 ~ Am)을 서스테인 펄스(Ps)와 같은 극성으로 바이어스한다.
여기서, 준비 기간(TR)의 종료시의 전극 간극(XY)의 벽 전압을 Vw1(X측을 정)이라 하고, 서스테인 기간(TS)에서 셀이 점등하는 전극 간극(XY)의 벽 전압의 최소값을 VTH(절대치)라 한다. PDP(1)에서는 주전극(X, Y)은 면방전 갭에 대하여 대칭 배치되어 있으므로, 도1에 나타낸 임계치(Vth1, Vth2)에 대하여 Vth1 = VTH, Vth2 = -VTH의 관계가 있다. 선택 셀에 대해서는 강한 어드레스 방전에 의해서, 전극 간극(XY)의 벽 전압을 VW1로부터 -VTH 이하로 변화시킨다. 비선택 셀에 대해서는 약한 어드레스 방전에 의해서, 전극 간극(XY)의 벽 전압을 -VTH보다도 높고, VTH보다도 낮은 값(바람직하게는 0 또는 그것에 가까운 값)으로 변화시킨다.
어드레스 방전의 제어를 위해서는 준비 처리에서 특원평10-157107호의 수법으로 벽 전압을 조정해 두는 것이 바람직하다. 준비 처리에 램프파를 이용하면, 벽 전압의 조정이 쉽다. 램프파 전압을 인가하여 복수의 미소 방전이 연속적으로 일어나는 상태 또는 연속적인 방전이 일어나는 상태가 되면, 방전 중의 인가 전압과 벽 전압의 합이 방전 개시 전압 근방으로 유지된다. 따라서, 방전 개시 전압과 램프파 의 피크 전압(펄스 진폭)과의 차가 램프파 인가 후의 벽 전압이 된다. 또, 구형파에 비해서 램프파 쪽이 발광량이 적고, 배경 휘도의 저감의 관점에서도 유리하다.
또, 준비 처리에 사용하는 전압 파형은 램프파에 한정되지 않고, 전극간의 전압이 제1설정치로부터 제2 설정치까지 단조롭게 상승하고, 이 상승 기간 내에 복수의 미소 방전이 연속적으로 일어나는 상태 또는 연속적인 방전이 일어나는 상태를 실현할 수 있으면 좋다. 예를 들면 램프 파형 외에 도12에 나타낸 둔파 파형 또는 계단 파형이어도 좋고, 램프 파형, 둔파 파형 및 계단 파형 중의 복수를 조합한 파형이어도 좋다.
인가 전압의 구체적 예는 다음과 같다. 전극 간극(XY)의 방전 개시 전압은 220볼트이고, 전극 간극(AY)의 방전 개시 전압은 170볼트이다. 또한, 이하에서는, 인가 전압 및 벽 전압의 극성에 대하여, 전극 간극(XY)에서는 X측을 정으로 하고, 전극 간극(AY)에서는 A측을 정으로 한다.
준비 기간(TR)에서 펄스(Pra1, Prx1, Pry1)의 펄스 폭은 70 ㎲, 전극 간극(XY)의 전위 변화율은 -4.2V/㎲이며 도달 전압은 -300V, 전극 간극(AY)의 전위 변화율은 -2.8V/㎲이며 도달 전압은 -200V이다. 펄스 인가 종료 시점의 벽 전압은 전극 간극(XY)이 80V, 전극 간극(AY)이 30V이다. 펄스(Pra2, Prx2, Pry2)의 펄스 폭은 25 ㎲, 전극 간극(XY)의 전위 변화율은 6.8V/㎲이며 도달 전압은 170V이다. 전극 간극(AY)의 전위 변화율은 6.8V/㎲이며 도달 전압은 170V이다. 준비 기간 종료 시점의 벽 전압은 전극 간극(XY)이 50V, 전극 간극(AY)이 0V이다.
어드레스 기간(TA)에서 강한 어드레스 방전에 관한 어드레스 전극 전위는 80V, 약한 어드레스 방전에 관한 어드레스 전극 전위는 0V, 주전극(X)의 전위는 80V이다. 스캔 펄스 인가시의 주전극(Y)의 전위는 -140V이다. 강한 어드레스 방전 종료 시점의 전극 간극(XY)의 벽 전압은 -120V, 약한 어드레스 방전 종료 시점의 전극 간극(XY)의 벽 전압은 0V이다.
서스테인 기간(TS)에서 서스테인 펄스(Ps)의 진폭은 170V, 어드레스 전극 전위는 85V이다. 이 때, 점등 유지 방전이 일어나기 위한 벽 전압의 최소값은 70V이다.
종래에는 1행의 어드레싱에 3 ㎲를 필요로 하였지만, 본 예에서는 행 선택의 상류측에서의 어드레스 방전이 하류측에서의 프라이밍에 기여하므로, 펄스 폭 1 ㎲의 어드레스 펄스(Pa)로 안정된 어드레싱이 가능해졌다.
도6은 구동 시퀀스의 제2 예를 나타내는 전압 파형도이다. 본 예는 소거 어드레스 형식으로서 비선택 셀에서 강한 방전을 일으키는 것이다.
준비 기간(TR)에서는 도5의 예와 같이 램프 파형의 펄스를 인가하여 전극 간극(XY)의 벽 전압을 준비 과정의 목표치로 제어한다.
어드레스 기간(TR)에서는 스캔 펄스 인가시에, 선택 셀에서 약한 어드레스 방전을 일으킨다. 방전의 강도는 어드레스 방전 후의 전극 간극(XY)의 벽 전압이 점등 범위 내에 머무는 값으로 한다. 비선택 셀에서는 스캔 펄스 인가시에 강한 어드레스 방전을 일으켜서, 전극 간극(XY)의 벽 전압을 비점등 범위 내의 값으로 변화시킨다. 스캔 펄스 인가시의 방전의 강약을 어드레스 전극의 전위에 의해 제어하는 것은 도5의 예와 같다.
준비 기간 종료시의 전극 간극(XY)의 벽 전압을 Vw2(X측이 정)라 하고, 서스테인 기간(TS)에서 셀이 점등하는 전극 간극(XY)의 벽 전압의 최소값을 VTH(절대치)로 한다. 선택 셀에 대해서는 약한 어드레스 방전에 의해 전극 간극(XY)의 벽 전압을 Vw2로부터 Vth 이상에 머무는 범위로 변화시킨다. 비선택 셀에 대해서는 강한 어드레스 방전에 의해 전극 간극(XY)의 벽 전압을 -VTH보다도 높고, VTH보다도 낮은 값(바람직하게는 0또는 그것에 가까운 값)으로 변화시킨다.
인가 전압의 구체적 예는 다음과 같다. 전극 간극(XY)의 방전 개시 전압은 220볼트이고, 전극 간극(AY)의 방전 개시 전압은 170볼트이다. 또한, 이하에서는, 인가 전압 및 벽 전압의 극성에 대하여, 전극 간극(XY)에서는 X측을 정으로 하고, 전극 간극(AY)에서는 A측을 정으로 한다.
준비 기간(TR)에서 펄스(Pra1, Prx1, Pry1)의 펄스 폭은 70 ㎲, 전극 간극(XY)의 전위 변화율은 -6.0V/㎲이며 도달 전압은 -420V, 전극 간극(AY)의 전위 변화율은 -3.6V/㎲이며 도달 전압은 -250V이다. 펄스 인가 종료 시점의 벽 전압은 전극 간극(XY)이 200V, 전극 간극(AY)이 80V이다. 펄스(Pra2, Prx2, Pry2)의 펄스 폭은 25 ㎲, 전극 간극(XY)의 전위 변화율은 2.0V/㎲이며 도달 전압은 50V이다. 전극 간극(AY)의 전위 변화율은 5.2V/㎲이며 도달 전압은 130V이다. 준비 기간 종료 시점의 벽 전압은 전극 간극(XY)이 170V, 전극 간극(AY)이 40V이다.
어드레스 기간(TA)에서 강한 어드레스 방전에 관한 어드레스 전극 전위는 40V, 약한 어드레스 방전에 관한 어드레스 전극 전위는 0V, 주전극(X)의 전위는 0V 이다. 스캔 펄스 인가시의 주전극(Y)의 전위는 -100V이다. 약한 어드레스 방전 종료 시점의 전극 간극(XY)의 벽 전압은 120V, 강한 어드레스 방전 종료 시점의 전극 간극(XY)의 벽 전압은 0V이다.
서스테인 기간(TS)에서 서스테인 펄스(Ps)의 진폭은 170V, 어드레스 전극 전위는 85V이다. 이 때, 점등 유지 방전이 일어나기 위한 벽 전압의 최소값은 70V이다.
본 예에서도 행 선택의 상류측에서의 어드레스 방전이 하류측에서의 프라이밍에 기여하므로, 펄스 폭 1 ㎲의 어드레스 펄스(Pa)로 안정한 어드레싱이 가능하다.
도7은 구동 시퀀스의 제3 예를 나타내는 전압 파형도이다.
어드레싱에서 행 선택을 배열 순으로 할 필요는 없다. 즉, 어떤 행에서의 어드레스 방전에 의해 공급되는 공간 전하가 그 후의 어드레스 방전에 대한 프라이밍 효과에 기여하는 거리 범위이라면 좋다. 도7에서는 짝수행과 홀수행이 교호로 선택되고, 짝수 및 홀수의 각 군에 대해서는 위에서 아래로의 배열 순으로 주사되고 있다. 홀수행으로부터 짝수행으로의 선택의 전환에서는 2행을 건너서 행 선택을 한다. 25인치 사이즈의 SXGA 방식의 화면 구성에서 2행 간격의 행 선택으로도 충분한 프라이밍 효과가 얻어졌다.
도8은 구동 시퀀스의 제4 예를 나타내는 전압 파형도이다.
화면을 구성하는 행을 홀수행의 조와 짝수행의 조로 나누고, 각 조마다 준비 기간(TR1, TR2) 및 어드레스 기간(TA1, TA2)을 할당한다. 서스테인 기간(TS)은 양 조에 공통으로 한다.
어드레스 과정을 2분할함으로써, 선택 행의 주전극(X)의 전위와 선택 행에 인접하는 비선택 행의 주전극(X)의 전위를 다르게 할 수 있고, 어드레스 방전으로 생긴 공간 전하의 열 방향의 전파를 제어할 수 있다.
두 번째 준비 기간(TR2)을 준비한 이유는 홀수행의 어드레스 방전(제1 어드레스 과정)에 의해서 약간이지만 짝수행의 벽 전하의 상태가 교란되므로, 다시 짝수행의 전위 조정을 하기 위함이며 또한, 짝수행(제2 어드레스 과정)의 선두의 어드레스 방전에 대한 프라이밍 입자의 공급을 하기 위함이다.
준비 기간(TR2)에서는 홀수행의 벽 전하의 상태를 교란하지 않고, 짝수행만의 전하 제어를 한다. 그 때문에, 준비 기간(TR2)에서의 짝수행에 인가하는 펄스는 첫 번째 준비 기간(TR1)과 동일하지만, 준비 기간(TR2)에서의 홀수행의 주전극(X, Y)에 인가하는 펄스를 어드레스 전극(A1 ~ Am)에 인가하는 펄스(Pra1, Pra2)와 동일한 것으로 한다. 이렇게 함으로써, 준비 기간(TR2)에서의 홀수행의 셀 내에서 전극 간극(AY) 및 전극 간극(XY)의 인가 전압이 0이 되어 벽 전하 상태를 교란하지 않는다.
도9는 제2 실시 형태에 관계되는 주전극 배치의 모식도, 도10은 구동 시퀀스의 제5 예를 나타내는 전압 파형도이다.
상술한 제1 예 ~ 제4 예에서는 서브 필드에서의 최초의 어드레스 방전에 대한 프라이밍 입자의 공급을 준비 과정에서의 방전으로 하고 있었다. 보다 확실하게 프라이밍 입자를 공급함에는, 준비 과정의 후, 어드레싱의 개시에 앞서 프라이밍 방전을 일으키는 것이 유효하다. 예를 들면 화면(ES)의 열 방향의 외측에 주전극(X, Y)과 동등한 보조 주전극(프라이밍용 전극)을 형성하고, 보조 주전극 쌍으로 프라이밍 방전을 일으킨다. 도9의 예에서는 선두 행의 주전극(Y1, X1)의 외측에 보조 주전극(DY1, DX1)이 배열되고, 최종 행의 주전극(Yn, Xn)의 외측에 보조 주전극(DY2, DX2)이 배열되어 있다. 도10과 같이 보조 주전극(DY1)에 펄스(Pp)를 인가하여 프라이밍을 일으키고, 그것에 계속하여 화면 내로 보조 주전극(DY1)에 가장 가까운 주전극(Y1)으로부터 주사를 시작한다. 펄스(Pp)의 파고값은 스캔 펄스(Py)와 같지만, 펄스 폭이 방전 확률을 높이기 위해서 스캔 펄스(P)보다 길게 설정되어 있다. 또한, 보조 주전극 쌍을 배열함으로써, 선두 행 및 최종 행의 주전극 쌍에서도 다른 주전극 쌍과 같이 양측에 주전극이 인접되므로, 방전 조건이 균등화되어 표시 품질이 높아지는 효과도 생긴다.
도11은 구동 시퀀스의 제6 예를 나타내는 전압 파형도이다.
상술한 제4 예에서는 제2 준비 기간(TR2)을 준비했지만, 홀수행의 어드레스 과정에 의한 짝수행의 대전 상태의 교란이 충분히 작은 경우에는, 제2 준비 기간(TR2)을 생략할 수도 있다. 단, 후반의 어드레스 과정의 선두의 어드레스 방전에 대한 프라이밍 입자를 공급하기 위해서, 보조 주전극 쌍을 사용해 후반의 어드레스 과정 전에 프라이밍 방전을 일으키는 것이 바람직하다. 홀수행의 어드레스 과정의 직전에도 프라이밍 방전을 일으켜도 좋다.
제4 예 및 제6 예와 같이 홀수행과 짝수행으로 나누어 어드레싱을 행하는 경우에는, 홀수행의 주전극(X)을 공통화하여 제1 드라이버로 제어하고, 짝수행의 주 전극(X)을 공통화해 제2 드라이버로 제어하면 좋다.
이상의 실시 형태는 주전극(X, Y) 및 어드레스 전극(A)이 유전체로 피복된 구조의 PDP(1)를 구동 대상으로 한 것이었다. 그러나, 쌍을 이루는 전극의 한쪽만이 유전체로 피복된 구조에도 본 발명을 적용할 수 있다. 예를 들면 어드레스 전극(A)을 덮는 유전체가 없는 구조, 또는 주전극(X, Y)의 한편이 방전 공간(30)에 노출한 구조에서도 전극 간극(XY, AY)에 적당한 벽 전압을 일으킬 수 있다. 인가 전압의 극성, 값, 인가 시간, 상승의 변화율은 예시한 것에 한정되지 않는다. 또, 본 발명은 PDP, PALC를 포함하는 표시 디바이스뿐만 아니라, 벽 전하에 의한 메모리 기능을 이용하지 않는 구조의 다른 가스 방전 디바이스에 적용 가능하다. 가스 방전이 표시를 위해 사용될 필요는 없다.
도 1은 본 발명을 적용한 AC형 PDP의 어드레싱에서의 벽 전압의 변화를 나타내는 도면.
도 2는 본 발명에 관한 플라즈마 표시 장치의 구성도.
도 3은 PDP의 내부 구조를 나타내는 사시도.
도 4는 필드 구성을 나타내는 도면.
도 5는 구동 시퀀스의 제1 예를 나타내는 전압 파형도.
도 6은 구동 시퀀스의 제2 예를 나타내는 전압 파형도.
도 7은 구동 시퀀스의 제3 예를 나타내는 전압 파형도.
도 8은 구동 시퀀스의 제4 예를 나타내는 전압 파형도.
도 9는 제2 실시 형태에 관계되는 주전극 배치의 모식도.
도 10은 구동 시퀀스의 제5 예를 나타내는 전압 파형도.
도 11은 구동 시퀀스의 제6 예를 나타내는 전압 파형도.
도 12는 어드레싱 준비 기간의 전압 파형도.
[부호의 설명]
1 PDP(가스 방전 패널)
C 셀
Dsf 서브 필드 데이터(상태 설정 데이터, 표시 데이터)
ES 화면
Y 주전극(스캔 전극)
A 어드레스 전극(데이터 전극)
17 유전체층
30 방전 공간
TA 어드레스 기간(어드레싱을 하는 기간)
TS 서스테인 기간(점등 유지를 하는 기간)
80 구동 유닛(구동 회로)
100 플라즈마 표시 장치

Claims (13)

  1. 행 방향으로 배치된 주(主) 전극 쌍과 열 방향으로 배치된 어드레스 전극을 갖고, 어드레스 준비기간 및 어드레스 기간을 포함하는 서브 필드를 이용하여 영상 표시를 행하는 플라스마 디스플레이 패널의 구동 방법으로서,
    상기 어드레스 준비기간에서, 상기 주 전극 쌍 사이에 스캔 전극이 되는 주 전극이 정(正)이 되는 방향으로 시간과 함께 변화하는 제 1의 펄스를 인가하고, 그 후, 상기 주 전극 쌍 사이에 스캔 전극이 되는 주 전극이 마이너스가 되는 방향으로 시간과 함께 변화하는 제 2 펄스를 인가하고,
    상기 어드레스 기간에서, 상기 스캔 전극에 스캔 펄스를 인가함으로써 행이 선택되고, 선택된 행에서의 상기 주 전극 사이의 전위차가 상기 제 2 펄스의 인가시의 상기 주 전극 사이의 전위차의 최대값보다도 크고, 적어도 1행 이상의 행을 뛰어넘어서 행이 선택되는 것을 특징으로 하는 플라스마 디스플레이 패널의 구동 방법.
  2. 행 방향으로 배치된 주 전극 쌍과 열 방향으로 배치된 어드레스 전극을 갖고, 어드레스 준비기간 및 어드레스 기간을 포함하는 서브 필드를 이용하여 영상 표시를 행하는 플라스마 디스플레이 패널의 구동 방법으로서,
    상기 어드레스 준비기간에서, 스캔 전극이 되는 주 전극과 상기 어드레스 전극과의 사이에 상기 스캔 전극이 정이 되는 방향으로 시간과 함께 변화하는 제 1 펄스를 인가하고, 그 후 상기 스캔 전극이 되는 주 전극과 상기 어드레스 전극과의 사이에 상기 스캔 전극이 마이너스가 되는 방향으로 시간과 함께 변화되는 제 2 펄스를 인가하고,
    상기 어드레스 기간에서, 상기 스캔 전극에 스캔 펄스를 인가함으로써 행이 선택되고, 상기 어드레스 전극에 어드레스 펄스를 인가하지 않는 상태에서, 선택된 행에서의 상기 스캔 전극과 상기 어드레스 전극 사이의 전위차가 상기 제 2 펄스 인가시의 상기 스캔 전극과 상기 어드레스 전극 사이의 전위차의 최대값보다도 크고, 적어도 1행 이상의 행을 뛰어넘어서 행이 선택되는 것을 특징으로 하는 플라스마 디스플레이 패널의 구동 방법.
  3. 제 1 항 또는 제 2 항에 있어서,
    상기 어드레스 기간에서, 스캔 전극이 행을 선택하는 사이, 상기 주 전극 쌍에서의 다른 방향의 주 전극에는 상기 스캔 전극에 대하여 정이 되는 전위가 인가되는 것을 특징으로 하는 플라스마 디스플레이 패널의 구동 방법.
  4. 제 1 항 또는 제 2 항에 있어서,
    상기 어드레스 기간에서, 상기 스캔 전극에 의해 표시에 사용되는 모든 행이 선택되는 것을 특징으로 하는 플라스마 디스플레이 패널의 구동 방법.
  5. 제 1 항 또는 제 2 항에 있어서,
    상기 스캔 전극에 의해 홀수 행 및 짝수 행으로 나누어서 행이 선택되는 것을 특징으로 하는 플라스마 디스플레이 패널의 구동 방법.
  6. 제 3 항에 있어서,
    상기 어드레스 기간에서 상기 주 전극에 있어서의 다른 방향의 주 전극에 인가되는 전위는, GND 전위보다 큰 서스테인 전압보다도 작은 것을 특징으로 하는 플라스마 디스플레이 패널의 구동 방법.
  7. 행 방향으로 배치된 X전극과 Y전극을 포함하는 주 전극 쌍과 열 방향으로 배치된 어드레스 전극을 갖고, 어드레스 준비기간 및 어드레스 기간을 포함하는 서브 필드를 이용하여 영상 표시를 행하는 플라스마 디스플레이 장치로서,
    상기 Y전극에 전압을 인가하는 Y전극의 드라이버와,
    상기 X전극에 전압을 인가하는 X전극의 드라이버와,
    상기 어드레스 전극에 전압을 인가하는 어드레스 전극의 드라이버와,
    상기 Y전극의 드라이버와 상기 X전극의 드라이버와 상기 어드레스 전극의 드라이버를 제어하는 컨트롤러를 구비하고,
    상기 어드레스 준비기간에서, 상기 컨트롤러는 상기 Y전극과 상기 X전극과의 사이에 상기 Y전극이 정이 되는 방향으로 시간과 함께 변화하는 제 1 펄스를 인가하고, 그 후 상기 Y전극과 상기 X전극과의 사이에 상기 Y전극이 마이너스가 되는 방향으로 시간과 함께 변화하는 제 2 펄스를 인가하도록 상기 Y전극의 드라이버와 상기 X전극의 드라이버를 제어하고,
    상기 어드레스 기간에서, 상기 컨트롤러는 상기 Y전극에 마이너스 극성의 스캔 펄스를 인가함으로써 행을 선택하고, 선택된 행에서의 상기 Y전극과 상기 X전극 사이에 인가되는 전위차가 상기 제 2 펄스의 인가시의 전위차의 최대값보다도 크고, 적어도 1행 이상의 행을 뛰어넘어서 스캔 펄스를 인가하도록, 상기 Y전극의 드라이버와 상기 X전극의 드라이버를 제어하는 것을 특징으로 하는 플라스마 디스플레이 장치.
  8. 행 방향으로 배치된 X전극과 Y전극을 포함하는 주 전극 쌍과 열 방향으로 배치된 어드레스 전극을 갖고, 어드레스 준비기간 및 어드레스 기간을 포함하는 서브 필드를 이용하여 영상 표시를 행하는 플라스마 디스플레이 장치이며,
    상기 Y전극에 전압을 인가하는 Y전극의 드라이버와,
    상기 X전극에 전압을 인가하는 X전극의 드라이버와,
    상기 어드레스 전극에 전압을 인가하는 어드레스 전극의 드라이버와,
    상기 Y전극의 드라이버와 상기 X전극의 드라이버와 상기 어드레스 전극의 드라이버를 제어하는 컨트롤러를 구비하고,
    상기 어드레스 준비기간에서, 상기 컨트롤러는 상기 Y전극과 상기 어드레스 전극과의 사이에 상기 Y전극이 정이 되는 방향으로 시간과 함께 변화하는 제 1 펄스를 인가하고, 그 후 상기 Y전극과 상기 어드레스 전극과의 사이에 상기 Y전극이 마이너스가 되는 방향으로 시간과 함께 변화하는 제 2 펄스를 인가하도록, 상기 Y 전극의 드라이버와 상기 어드레스 전극의 드라이버를 제어하고,
    상기 어드레스 기간에서, 전기 컨트롤러는 상기 Y전극에 마이너스 극성의 스캔 펄스를 인가함으로써 행을 선택하고, 상기 어드레스 드라이버가 어드레스 전극에 정 극성의 어드레스 펄스를 인가하지 않는 상태에서, 선택된 행에서의 상기 Y전극과 상기 어드레스 전극 사이의 전위차가 상기 제 2 펄스의 인가시의 전위차의 최대값보다도 크고, 적어도 1행 이상의 행을 뛰어넘어서 스캔 펄스를 인가하도록 상기 Y전극의 드라이버와 상기 어드레스 전극의 드라이버를 특징으로 하는 플라스마 디스플레이 장치.
  9. 제 7 항 또는 제 8 항에 있어서,
    상기 어드레스 기간에서, 상기 컨트롤러는 상기 Y전극의 드라이버가 행을 선택하는 사이, 상기 X전극의 드라이버는 상기 Y전극에 대하여 정이 되는 전위를 X전극에 인가하도록 제어하는 것을 특징으로 하는 플라스마 디스플레이 장치.
  10. 제 7 항 또는 제 8 항에 있어서,
    상기 어드레스 기간에서, 상기 컨트롤러는 상기 Y전극의 드라이버는 표시에 사용되는 모든 행에 스캔 펄스를 인가하도록 제어하는 것을 특징으로 하는 플라스마 디스플레이 장치.
  11. 제 7 항 또는 제 8 항에 있어서,
    상기 컨트롤러는 홀수 행 및 짝수 행으로 나누어서 스캔 펄스를 인가하도록 상기 Y전극의 드라이버를 제어하는 것을 특징으로 하는 플라스마 디스플레이 장치.
  12. 제 9 항에 있어서,
    상기 어드레스 기간에서 상기 X전극에 인가되는 전위는 GND전위보다 큰 서스테인 전압보다도 작은 것을 특징으로 하는 플라스마 디스플레이 장치.
  13. 행 방향으로 배치된 주 전극 쌍과 열 방향으로 배치된 어드레스 전극을 갖고, 어드레스 준비기간 및 어드레스 기간을 포함하는 서브 필드를 이용하여 영상 표시를 행하는 플라스마 디스플레이 패널의 구동 방법으로서,
    상기 어드레스 준비기간에서 상기 주 전극 쌍의 스캔 전극에 시간과 함께 변화하는 펄스를 인가하고,
    상기 어드레스 준비기간에 계속되는 상기 어드레스 기간에서, 상기 스캔 전극에 스캔 펄스를 인가함으로써 행이 선택되고, 적어도 1행 이상의 행을 뛰어넘어서 행이 선택되는 것을 특징으로 하는 플라스마 디스플레이 패널의 구동 방법.
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