JPH11242460A - プラズマディスプレイパネルの駆動方法 - Google Patents
プラズマディスプレイパネルの駆動方法Info
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- JPH11242460A JPH11242460A JP10060557A JP6055798A JPH11242460A JP H11242460 A JPH11242460 A JP H11242460A JP 10060557 A JP10060557 A JP 10060557A JP 6055798 A JP6055798 A JP 6055798A JP H11242460 A JPH11242460 A JP H11242460A
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- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
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Abstract
(57)【要約】
【課題】 プラズマディスプレイパネルの駆動方法にお
いて、誤放電を防止し、表示特性を向上させることを目
的とする。 【解決手段】 一斉リセット期間、アドレス期間、維持
放電期間を用いて画像表示を行うプラズマディスプレイ
パネルの駆動方法であって、アドレス期間において印加
される走査パルスの電圧値を走査されるラインに応じて
異ならせたことを特徴とする。
いて、誤放電を防止し、表示特性を向上させることを目
的とする。 【解決手段】 一斉リセット期間、アドレス期間、維持
放電期間を用いて画像表示を行うプラズマディスプレイ
パネルの駆動方法であって、アドレス期間において印加
される走査パルスの電圧値を走査されるラインに応じて
異ならせたことを特徴とする。
Description
【０００１】
【発明の属する技術分野】本発明は、プラズマディスプ
レイパネル（ＰＤＰ）の駆動方法に関する。
レイパネル（ＰＤＰ）の駆動方法に関する。
【０００２】
【従来の技術】近年、表示装置の大型化に伴い、薄型の
表示装置が要求され、各種の薄型の表示装置が提供され
ている。その１つにＡＣＰＤＰが知られている。係るＡ
ＣＰＤＰは、列電極（アドレス電極）及び列電極と直交
し一対にて１行（１走査ライン）を構成する行電極（維
持電極）を備えており、これら列電極及び行電極対各々
は放電空間に対して誘電体層で覆われており、列電極及
び行電極対の各交点に放電セル（画素）が形成されてい
る。なお、行電極は、透明電極とそれに積層されたバス
電極とから構成されている。
表示装置が要求され、各種の薄型の表示装置が提供され
ている。その１つにＡＣＰＤＰが知られている。係るＡ
ＣＰＤＰは、列電極（アドレス電極）及び列電極と直交
し一対にて１行（１走査ライン）を構成する行電極（維
持電極）を備えており、これら列電極及び行電極対各々
は放電空間に対して誘電体層で覆われており、列電極及
び行電極対の各交点に放電セル（画素）が形成されてい
る。なお、行電極は、透明電極とそれに積層されたバス
電極とから構成されている。
【０００３】図４は、係るＡＣＰＤＰの選択書込みアド
レス法による各種駆動パルスの印加タイミングを示す図
である。図４において、先ず、正極性のリセットパルス
ＲＰｘを全ての行電極Ｘ（Ｘ１〜Ｘｎ）に印加すると同
時に、負極性のリセットパルスＲＰｙを行電極Ｙ１〜Ｙ
ｎの各々に印加することにより、全画素を同時に放電さ
せ壁電荷を一旦形成した後、行電極Ｘに消去パルスＥＰ
を印加するにより壁電荷を消去して全画素を初期化して
いる（一斉リセット期間）。
レス法による各種駆動パルスの印加タイミングを示す図
である。図４において、先ず、正極性のリセットパルス
ＲＰｘを全ての行電極Ｘ（Ｘ１〜Ｘｎ）に印加すると同
時に、負極性のリセットパルスＲＰｙを行電極Ｙ１〜Ｙ
ｎの各々に印加することにより、全画素を同時に放電さ
せ壁電荷を一旦形成した後、行電極Ｘに消去パルスＥＰ
を印加するにより壁電荷を消去して全画素を初期化して
いる（一斉リセット期間）。
【０００４】次に、走査パルス（選択書込みパルス）Ｓ
Ｐを行電極Ｙ１〜Ｙｎに順次印加すると共に走査パルス
ＳＰの印加タイミングに同期して各走査ラインの画素デ
ータに応じた画素データパルスＤＰ１〜ＤＰｎを順次、
列電極Ｄ１〜Ｄｍに印加する。画素データパルスＤＰ１
〜ＤＰｎ は、それぞれ各行（走査ライン）の第１列〜
第ｍ列の各々の対応する画素データに基づいて生成され
た複数のパルスで構成されている。走査パルスＳＰの印
加に同期して画素データパルスが印加された画素は、放
電し壁電荷が形成され点灯画素となり、一方画素データ
パルスが印加されない画素は、放電が生じないので壁電
荷が形成されず消灯画素となる（アドレス期間）。
Ｐを行電極Ｙ１〜Ｙｎに順次印加すると共に走査パルス
ＳＰの印加タイミングに同期して各走査ラインの画素デ
ータに応じた画素データパルスＤＰ１〜ＤＰｎを順次、
列電極Ｄ１〜Ｄｍに印加する。画素データパルスＤＰ１
〜ＤＰｎ は、それぞれ各行（走査ライン）の第１列〜
第ｍ列の各々の対応する画素データに基づいて生成され
た複数のパルスで構成されている。走査パルスＳＰの印
加に同期して画素データパルスが印加された画素は、放
電し壁電荷が形成され点灯画素となり、一方画素データ
パルスが印加されない画素は、放電が生じないので壁電
荷が形成されず消灯画素となる（アドレス期間）。
【０００５】次に、全ライン同時に行電極Ｘ１〜Ｘｎ及
び行電極Ｙ１〜Ｙｎに対しての維持パルスＩＰｘ及び維
持パルスＩＰｙを交互に印加する。この時、壁電荷が蓄
積されている点灯画素のみが維持パルスＩＰｘ及びＩＰ
ｙが印加される度に放電発光する（維持放電期間）。
び行電極Ｙ１〜Ｙｎに対しての維持パルスＩＰｘ及び維
持パルスＩＰｙを交互に印加する。この時、壁電荷が蓄
積されている点灯画素のみが維持パルスＩＰｘ及びＩＰ
ｙが印加される度に放電発光する（維持放電期間）。
【０００６】次に、消去パルスＥＰを行電極Ｙ１〜Ｙｎ
のそれぞれに印加することにより、壁電荷を消滅させ
て、全画素の壁電荷状態を初期化する（壁電荷消去期
間）。
のそれぞれに印加することにより、壁電荷を消滅させ
て、全画素の壁電荷状態を初期化する（壁電荷消去期
間）。
【０００７】以上のように、一斉リセット期間、アドレ
ス期間、維持放電期間、壁電荷消去期間（メイン消去期
間）を１つの表示サイクルとして、これを繰り返し行う
ことにより画像表示が行われる。
ス期間、維持放電期間、壁電荷消去期間（メイン消去期
間）を１つの表示サイクルとして、これを繰り返し行う
ことにより画像表示が行われる。
【０００８】
【発明が解決しようとする課題】ところで、アドレス期
間に要する時間は、１ラインを走査するのにかかる時間
とライン数との積で決定され、パネルの規模が大きくな
る程長くなる。そして、アドレス期間が長くなる程、一
斉リセット期間で生じたプライミング粒子（放電空間内
に存在する荷電粒子、励起粒子）の数が減少する。この
ようにアドレス期間において時間の経過と共にプライミ
ング粒子が減少すると、最初に走査されるラインにおけ
る選択放電に比して最後の方で走査されるラインにおけ
る選択放電が生じにくく、アドレス動作が不安定とな
る。
間に要する時間は、１ラインを走査するのにかかる時間
とライン数との積で決定され、パネルの規模が大きくな
る程長くなる。そして、アドレス期間が長くなる程、一
斉リセット期間で生じたプライミング粒子（放電空間内
に存在する荷電粒子、励起粒子）の数が減少する。この
ようにアドレス期間において時間の経過と共にプライミ
ング粒子が減少すると、最初に走査されるラインにおけ
る選択放電に比して最後の方で走査されるラインにおけ
る選択放電が生じにくく、アドレス動作が不安定とな
る。
【０００９】本発明は、上記の問題を解決するためにな
されたものであり、誤放電を防止し、表示特性を向上さ
せることを目的とする。
されたものであり、誤放電を防止し、表示特性を向上さ
せることを目的とする。
【００１０】
【課題を解決するための手段】請求項１記載の発明は、
マトリクス表示のラインに対応しかつ誘電体層で覆われ
た行電極と、行電極と直交する方向に配列され各交差部
にて画素を形成する列電極とを有し、複数のライン上の
全画素の壁電荷状態を同時に初期化するリセット期間
と、複数のラインに対応する行電極に順次走査パルスを
印加すると共に画素データパルスを列電極に印加して画
素データに応じて点灯及び消灯画素を選択するアドレス
期間と、アドレス期間において選択された全てのライン
に対応する行電極に同時に放電維持パルスを印加して点
灯及び消灯画素を維持する維持放電期間とを用いて表示
を行うプラズマディスプレイパネルの駆動方法であっ
て、走査パルスの電圧値を走査されるラインに応じて異
ならせたことを特徴とする。
マトリクス表示のラインに対応しかつ誘電体層で覆われ
た行電極と、行電極と直交する方向に配列され各交差部
にて画素を形成する列電極とを有し、複数のライン上の
全画素の壁電荷状態を同時に初期化するリセット期間
と、複数のラインに対応する行電極に順次走査パルスを
印加すると共に画素データパルスを列電極に印加して画
素データに応じて点灯及び消灯画素を選択するアドレス
期間と、アドレス期間において選択された全てのライン
に対応する行電極に同時に放電維持パルスを印加して点
灯及び消灯画素を維持する維持放電期間とを用いて表示
を行うプラズマディスプレイパネルの駆動方法であっ
て、走査パルスの電圧値を走査されるラインに応じて異
ならせたことを特徴とする。
【００１１】また、請求項２記載の発明は、請求項１記
載のプラズマディスプレイパネルの駆動方法において、
アドレス期間において最初に走査されるラインに対応す
る行電極に印加される走査パルスの電圧値に比してその
後に走査されるラインに対応する行電極に印加される走
査パルスの電圧値を大きくしたことを特徴とする。
載のプラズマディスプレイパネルの駆動方法において、
アドレス期間において最初に走査されるラインに対応す
る行電極に印加される走査パルスの電圧値に比してその
後に走査されるラインに対応する行電極に印加される走
査パルスの電圧値を大きくしたことを特徴とする。
【００１２】
【作用】本発明では、アドレス期間において印加される
走査パルスの電圧値を走査されるラインに応じて異なら
せたので、一斉リセット期間で生じたプライミング粒子
が減少しても安定した選択放電を行うことができる。
走査パルスの電圧値を走査されるラインに応じて異なら
せたので、一斉リセット期間で生じたプライミング粒子
が減少しても安定した選択放電を行うことができる。
【００１３】
【発明の実施の形態】次に、本発明に好適な実施形態に
ついて説明する。図１は本発明におけるプラズマディス
プレイパネルの駆動方法で駆動される面放電型ＰＤＰの
構造を示す斜視図である。図１に示されるように、ＰＤ
Ｐ１１の放電空間７を介して対向配置された一対のガラ
ス基板１、２の表示面側のガラス基板１の内面には、互
いに平行に隣接配置された一対の行電極Ｘ，Ｙ、行電極
Ｘ，Ｙを覆う壁電荷形成用の誘電体層５、誘電体層５を
覆うＭｇＯからなる保護層６がそれぞれ設けられてい
る。なお、行電極Ｘ，Ｙは、それぞれ幅の広い帯状の透
明導電膜からなる透明電極４とその導電性を補うために
積層された幅の狭い帯状の金属膜からなるバス電極（金
属膜）３とから構成されている。
ついて説明する。図１は本発明におけるプラズマディス
プレイパネルの駆動方法で駆動される面放電型ＰＤＰの
構造を示す斜視図である。図１に示されるように、ＰＤ
Ｐ１１の放電空間７を介して対向配置された一対のガラ
ス基板１、２の表示面側のガラス基板１の内面には、互
いに平行に隣接配置された一対の行電極Ｘ，Ｙ、行電極
Ｘ，Ｙを覆う壁電荷形成用の誘電体層５、誘電体層５を
覆うＭｇＯからなる保護層６がそれぞれ設けられてい
る。なお、行電極Ｘ，Ｙは、それぞれ幅の広い帯状の透
明導電膜からなる透明電極４とその導電性を補うために
積層された幅の狭い帯状の金属膜からなるバス電極（金
属膜）３とから構成されている。
【００１４】一方、背面側のガラス基板２の内面上に
は、行電極Ｘ、Ｙと直交する方向に複数のアドレス電極
Ａが配置され、それぞれのアドレス電極Ａの間にストラ
イプ状の隔壁（リブ）１０が設けられ、アドレス電極Ａ
を被覆して蛍光体層８が形成されている。放電空間７に
は、希ガスが注入し、封入されている。
は、行電極Ｘ、Ｙと直交する方向に複数のアドレス電極
Ａが配置され、それぞれのアドレス電極Ａの間にストラ
イプ状の隔壁（リブ）１０が設けられ、アドレス電極Ａ
を被覆して蛍光体層８が形成されている。放電空間７に
は、希ガスが注入し、封入されている。
【００１５】行電極Ｘ、Ｙとアドレス電極Ａの各交点を
中心として画素セル（放電セル）が形成され、マトリク
ス表示が可能となる。
中心として画素セル（放電セル）が形成され、マトリク
ス表示が可能となる。
【００１６】次に、本発明の第１の実施形態によるＰＤ
Ｐの駆動方法を説明する。図２は、図１のＰＤＰを駆動
する第１の実施形態による駆動方法にかかる駆動波形の
一例（選択書込みアドレス法に適用した例）を示す図で
ある。図２において、先ず、正極性のリセットパルスＲ
Ｐｘを全ての行電極Ｘ（Ｘ１〜Ｘｎ）に印加すると同時
に、負極性のリセットパルスＲＰｙを行電極Ｙ１〜Ｙｎ
に印加することにより、全画素を放電させて壁電荷を一
旦形成した後、行電極Ｘに消去パルスＥＰを印加するこ
とにより壁電荷を消去して全画素を初期化する。この状
態では、放電空間にプライミング粒子が数多く存在す
る。（一斉リセット期間）
Ｐの駆動方法を説明する。図２は、図１のＰＤＰを駆動
する第１の実施形態による駆動方法にかかる駆動波形の
一例（選択書込みアドレス法に適用した例）を示す図で
ある。図２において、先ず、正極性のリセットパルスＲ
Ｐｘを全ての行電極Ｘ（Ｘ１〜Ｘｎ）に印加すると同時
に、負極性のリセットパルスＲＰｙを行電極Ｙ１〜Ｙｎ
に印加することにより、全画素を放電させて壁電荷を一
旦形成した後、行電極Ｘに消去パルスＥＰを印加するこ
とにより壁電荷を消去して全画素を初期化する。この状
態では、放電空間にプライミング粒子が数多く存在す
る。（一斉リセット期間）
【００１７】次に、走査パルス（選択書込みパルス）Ｓ
Ｐを行電極Ｙ１〜Ｙｎに順次印加すると共に走査パルス
ＳＰの印加タイミングに同期して各走査ラインの画素デ
ータに応じた画素データパルスＤＰ１〜ＤＰｎを順次、
列電極Ｄ１〜Ｄｍに印加する。画素データパルスＤＰ１
〜ＤＰｎ は、それぞれ各行（走査ライン）の第１列〜
第ｍ列の各々の対応する画素データに基づいて生成され
た複数のパルスで構成されている。走査パルスＳＰの印
加に同期して画素データパルスが印加された画素は、放
電し壁電荷が形成されて点灯画素となり、一方画素デー
タパルスが印加されない画素は、放電が生じないので壁
電荷が形成されずに消灯画素となる。このように、画素
データの応じて選択的に書込み放電を生じさせることに
より、点灯及び消灯画素が選択される（アドレス期
間）。
Ｐを行電極Ｙ１〜Ｙｎに順次印加すると共に走査パルス
ＳＰの印加タイミングに同期して各走査ラインの画素デ
ータに応じた画素データパルスＤＰ１〜ＤＰｎを順次、
列電極Ｄ１〜Ｄｍに印加する。画素データパルスＤＰ１
〜ＤＰｎ は、それぞれ各行（走査ライン）の第１列〜
第ｍ列の各々の対応する画素データに基づいて生成され
た複数のパルスで構成されている。走査パルスＳＰの印
加に同期して画素データパルスが印加された画素は、放
電し壁電荷が形成されて点灯画素となり、一方画素デー
タパルスが印加されない画素は、放電が生じないので壁
電荷が形成されずに消灯画素となる。このように、画素
データの応じて選択的に書込み放電を生じさせることに
より、点灯及び消灯画素が選択される（アドレス期
間）。
【００１８】ここで、走査パルス（選択書込みパルス）
ＳＰの電圧値は、走査されるラインに応じて異ならせて
いる。すなわち、最初に走査されるライン（例えば第１
行）に対応する行電極Ｙ１に印加される走査パルスＳＰ
の電圧値に比してその後に走査されるライン（例えば第
２行以降）に対応する行電極Ｙ２〜Ｙｎに印加される走
査パルスの電圧値を大きくしている。
ＳＰの電圧値は、走査されるラインに応じて異ならせて
いる。すなわち、最初に走査されるライン（例えば第１
行）に対応する行電極Ｙ１に印加される走査パルスＳＰ
の電圧値に比してその後に走査されるライン（例えば第
２行以降）に対応する行電極Ｙ２〜Ｙｎに印加される走
査パルスの電圧値を大きくしている。
【００１９】一斉リセット期間で生じたプライミング粒
子（放電空間内に存在する荷電粒子、励起粒子）の数
は、アドレス期間において時間の経過と共に減少する
が、プライミング粒子が減少した時点で走査されるライ
ン（最初に走査されるラインに比してその後に走査され
るライン）に印加される走査パルスＳＰの電圧値を大き
くすることにより、誤放電が防止され、安定した選択放
電が行われる。
子（放電空間内に存在する荷電粒子、励起粒子）の数
は、アドレス期間において時間の経過と共に減少する
が、プライミング粒子が減少した時点で走査されるライ
ン（最初に走査されるラインに比してその後に走査され
るライン）に印加される走査パルスＳＰの電圧値を大き
くすることにより、誤放電が防止され、安定した選択放
電が行われる。
【００２０】次に、全ライン同時に行電極Ｘ１〜Ｘｎ及
び行電極Ｙ１〜Ｙｎに対しての維持パルスＩＰｘ及び維
持パルスＩＰｙを交互に印加する。この時、壁電荷が蓄
積されている点灯画素のみが維持パルスＩＰｘ及びＩＰ
ｙが印加される度に放電発光する（維持放電期間）。
び行電極Ｙ１〜Ｙｎに対しての維持パルスＩＰｘ及び維
持パルスＩＰｙを交互に印加する。この時、壁電荷が蓄
積されている点灯画素のみが維持パルスＩＰｘ及びＩＰ
ｙが印加される度に放電発光する（維持放電期間）。
【００２１】次に、消去パルスＥＰを行電極Ｙ１〜Ｙｎ
のそれぞれに印加することにより、壁電荷を消滅させ
て、全画素の壁電荷状態を初期化する（壁電荷消去期
間）。
のそれぞれに印加することにより、壁電荷を消滅させ
て、全画素の壁電荷状態を初期化する（壁電荷消去期
間）。
【００２２】以上のように、第１の実施形態では、一斉
リセット期間、アドレス期間、維持放電期間、壁電荷消
去期間（メイン消去期間）を１つの表示サイクルとし
て、これを繰り返し行うことにより表示特性の優れた画
像表示が行われる。
リセット期間、アドレス期間、維持放電期間、壁電荷消
去期間（メイン消去期間）を１つの表示サイクルとし
て、これを繰り返し行うことにより表示特性の優れた画
像表示が行われる。
【００２３】次に、本発明の第２の実施形態によるＰＤ
Ｐの駆動方法を説明する。図３は、図１のＰＤＰを駆動
する第２の実施形態による駆動方法にかかる駆動波形の
一例（選択消去アドレス法に適用した例）を示す図であ
る。図３の場合は、先ず、負極性のリセットパルスＲＰ
ｘを全ての維持電極である行電極Ｘ（Ｘ１〜Ｘｎ）に印
加すると同時に、正極性のリセットパルスＲＰｙを行電
極Ｙ１〜Ｙｎの各々に印加する。かかるリセットパルス
の印加により全ての行電極対間に放電が生じる。かかる
放電により、各画素セル内において荷電粒子が発生し、
その放電終息後に全画素に壁電荷が蓄積形成される。こ
の状態では、放電空間にプライミング粒子が数多く存在
する（一斉リセット期間）。
Ｐの駆動方法を説明する。図３は、図１のＰＤＰを駆動
する第２の実施形態による駆動方法にかかる駆動波形の
一例（選択消去アドレス法に適用した例）を示す図であ
る。図３の場合は、先ず、負極性のリセットパルスＲＰ
ｘを全ての維持電極である行電極Ｘ（Ｘ１〜Ｘｎ）に印
加すると同時に、正極性のリセットパルスＲＰｙを行電
極Ｙ１〜Ｙｎの各々に印加する。かかるリセットパルス
の印加により全ての行電極対間に放電が生じる。かかる
放電により、各画素セル内において荷電粒子が発生し、
その放電終息後に全画素に壁電荷が蓄積形成される。こ
の状態では、放電空間にプライミング粒子が数多く存在
する（一斉リセット期間）。
【００２４】次に、走査パルス（選択消去パルス）ＳＰ
を行電極Ｙ１〜Ｙｎに順次印加すると共に走査パルスＳ
Ｐの印加タイミングに同期して各走査ラインの画素デー
タに応じた画素データパルスＤＰ１〜ＤＰｎを順次、列
電極Ｄ１〜Ｄｍに印加する。画素データパルスＤＰ１〜
ＤＰｎ は、それぞれ各行（走査ライン）の第１列〜第
ｍ列の各々の対応する画素データに基づいて生成された
複数のパルスで構成されている。走査パルスＳＰの印加
に同期して画素データパルスが印加された画素は、放電
して一斉リセット期間で形成された壁電荷が消去されて
点灯画素となり、一方画素データパルスが印加されない
画素は、放電が生じないので一斉リセット期間で形成さ
れた壁電荷がそのまま残り消灯画素となる。このよう
に、画素データの応じて選択的に消去放電を生じさせる
ことにより、点灯及び消灯画素が選択される（アドレス
期間）。
を行電極Ｙ１〜Ｙｎに順次印加すると共に走査パルスＳ
Ｐの印加タイミングに同期して各走査ラインの画素デー
タに応じた画素データパルスＤＰ１〜ＤＰｎを順次、列
電極Ｄ１〜Ｄｍに印加する。画素データパルスＤＰ１〜
ＤＰｎ は、それぞれ各行（走査ライン）の第１列〜第
ｍ列の各々の対応する画素データに基づいて生成された
複数のパルスで構成されている。走査パルスＳＰの印加
に同期して画素データパルスが印加された画素は、放電
して一斉リセット期間で形成された壁電荷が消去されて
点灯画素となり、一方画素データパルスが印加されない
画素は、放電が生じないので一斉リセット期間で形成さ
れた壁電荷がそのまま残り消灯画素となる。このよう
に、画素データの応じて選択的に消去放電を生じさせる
ことにより、点灯及び消灯画素が選択される（アドレス
期間）。
【００２５】ここで、走査パルス（選択消去パルス）Ｓ
Ｐの電圧値は、上述の第１の実施形態と同様に走査され
るラインに応じて異ならせている。すなわち、最初に走
査されるライン（例えば第１行）に対応する行電極Ｙ１
に印加される走査パルスＳＰの電圧値に比してその後に
走査されるライン（例えば第２行以降）に対応する行電
極Ｙ２〜Ｙｎに印加される走査パルスの電圧値を大きく
している。
Ｐの電圧値は、上述の第１の実施形態と同様に走査され
るラインに応じて異ならせている。すなわち、最初に走
査されるライン（例えば第１行）に対応する行電極Ｙ１
に印加される走査パルスＳＰの電圧値に比してその後に
走査されるライン（例えば第２行以降）に対応する行電
極Ｙ２〜Ｙｎに印加される走査パルスの電圧値を大きく
している。
【００２６】一斉リセット期間で生じたプライミング粒
子（放電空間内に存在する荷電粒子、励起粒子）の数
は、アドレス期間において時間の経過と共に減少する
が、プライミング粒子が減少した時点で走査されるライ
ン（最初に走査されるラインに比してその後に走査され
るライン）に印加される走査パルスＳＰの電圧値を大き
くすることにより、誤放電が防止され、安定した選択放
電が行われる。
子（放電空間内に存在する荷電粒子、励起粒子）の数
は、アドレス期間において時間の経過と共に減少する
が、プライミング粒子が減少した時点で走査されるライ
ン（最初に走査されるラインに比してその後に走査され
るライン）に印加される走査パルスＳＰの電圧値を大き
くすることにより、誤放電が防止され、安定した選択放
電が行われる。
【００２７】以降は、上述した第１の実施形態と同様
に、維持放電期間及び壁電荷消去期間における各種駆動
動作が行われるが説明が重複するのでここでは記述を省
略する。
に、維持放電期間及び壁電荷消去期間における各種駆動
動作が行われるが説明が重複するのでここでは記述を省
略する。
【００２８】上述の各実施形態において、アドレス期間
において印加される走査パルスの電圧値は、走査される
順に徐々に大きくしていくように設定しても良く、ま
た、複数ライン毎に段階的に大きくしていくように設定
しても良い。
において印加される走査パルスの電圧値は、走査される
順に徐々に大きくしていくように設定しても良く、ま
た、複数ライン毎に段階的に大きくしていくように設定
しても良い。
【００２９】
【発明の効果】本発明では、一斉リセット期間で生じた
プライミング粒子が減少した時点で走査されるラインに
対して印加される走査パルスの電圧値を大きくすること
により安定した選択放電を行うことができ、表示特性を
向上することができる。
プライミング粒子が減少した時点で走査されるラインに
対して印加される走査パルスの電圧値を大きくすること
により安定した選択放電を行うことができ、表示特性を
向上することができる。
【図１】本発明におけるプラズマディスプレイパネルの
駆動方法で駆動される面放電型ＰＤＰの構造を示す斜視
図である。
駆動方法で駆動される面放電型ＰＤＰの構造を示す斜視
図である。
【図２】本発明における第１の実施形態による駆動方法
にかかる駆動波形の一例（選択書込みアドレス法に適用
した例）を示す図である。
にかかる駆動波形の一例（選択書込みアドレス法に適用
した例）を示す図である。
【図３】本発明における第２の実施形態による駆動方法
にかかる駆動波形の一例（選択消去アドレス法に適用し
た例）を示す図である。
にかかる駆動波形の一例（選択消去アドレス法に適用し
た例）を示す図である。
【図４】従来のＡＣＰＤＰの選択書込みアドレス法によ
る各種駆動パルスの印加タイミングを示す図である。
る各種駆動パルスの印加タイミングを示す図である。
１、２・・・ガラス基板 ３・・・・・バス電極（金属膜） ４・・・・・透明電極 ５・・・・・誘電体層 ６・・・・・保護層 ７・・・・・放電空間 ８・・・・・蛍光体層 １０・・・・隔壁 １１・・・・ＰＤＰ
Claims (2)
- 【請求項１】 マトリクス表示のラインに対応しかつ誘
電体層で覆われた行電極と、前記行電極と直交する方向
に配列され各交差部にて画素を形成する列電極とを有
し、複数のライン上の全画素の壁電荷状態を同時に初期
化するリセット期間と、前記複数のラインに対応する行
電極に順次走査パルスを印加すると共に画素データパル
スを前記列電極に印加して画素データに応じて点灯及び
消灯画素を選択するアドレス期間と、前記アドレス期間
において選択された全てのラインに対応する行電極に同
時に放電維持パルスを印加して前記点灯及び消灯画素を
維持する維持放電期間とを用いて表示を行うプラズマデ
ィスプレイパネルの駆動方法であって、 前記走査パルスの電圧値を走査されるラインに応じて異
ならせたことを特徴とするプラズマディスプレイパネル
の駆動方法。 - 【請求項２】 前記アドレス期間において最初に走査さ
れるラインに対応する行電極に印加される走査パルスの
電圧値に比してその後に走査されるラインに対応する行
電極に印加される走査パルスの電圧値を大きくしたこと
を特徴とする請求項１記載のプラズマディスプレイパネ
ルの駆動方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10060557A JPH11242460A (ja) | 1998-02-25 | 1998-02-25 | プラズマディスプレイパネルの駆動方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10060557A JPH11242460A (ja) | 1998-02-25 | 1998-02-25 | プラズマディスプレイパネルの駆動方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11242460A true JPH11242460A (ja) | 1999-09-07 |
Family
ID=13145711
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10060557A Pending JPH11242460A (ja) | 1998-02-25 | 1998-02-25 | プラズマディスプレイパネルの駆動方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11242460A (ja) |
Cited By (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| KR20030014884A (ko) * | 2001-08-13 | 2003-02-20 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널의 구동방법 |
| KR100482324B1 (ko) * | 2002-03-06 | 2005-04-13 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널의 구동방법 및 장치 |
| KR100578816B1 (ko) | 2004-07-21 | 2006-05-11 | 삼성에스디아이 주식회사 | 플라즈마 표시 장치와 그의 구동방법 |
| KR100602276B1 (ko) | 2005-01-04 | 2006-07-19 | 엘지전자 주식회사 | 플라즈마 디스플레이 패널의 구동장치 및 방법 |
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| KR100627337B1 (ko) | 2004-05-31 | 2006-09-25 | 삼성에스디아이 주식회사 | 플라즈마 표시 장치 및 그의 구동 방법 |
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| US7642993B2 (en) | 2004-06-30 | 2010-01-05 | Samsung Sdi Co., Ltd. | Driving method of plasma display panel |
| US8054248B2 (en) | 2002-03-06 | 2011-11-08 | Lg Electronics Inc. | Method and apparatus for driving plasma display panel |
-
1998
- 1998-02-25 JP JP10060557A patent/JPH11242460A/ja active Pending
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