JP3307486B2 - 平面表示装置及びその制御方法 - Google Patents
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Description
【０００１】
【産業上の利用分野】本発明は平面表示装置に関するも
のであり、特に詳しくは、平面表示装置に於いてフレー
ム開始信号が入力してからすぐに表示データが有効とな
る場合に対応しえる高速動作が可能な平面表示装置に関
するものでる。
のであり、特に詳しくは、平面表示装置に於いてフレー
ム開始信号が入力してからすぐに表示データが有効とな
る場合に対応しえる高速動作が可能な平面表示装置に関
するものでる。
【０００２】
【従来の技術】近年、薄形の利点からＣＲＴに代わりＰ
ＤＰ（プラズマディスプレイ），ＬＣＤ（液晶ディスプ
レイ），ＥＬ（エレクトロルミネッセンス）等の平面マ
トリクス形表示装置の要求が増加しているが、特に最近
ではカラー表示の要求が高まっている。
ＤＰ（プラズマディスプレイ），ＬＣＤ（液晶ディスプ
レイ），ＥＬ（エレクトロルミネッセンス）等の平面マ
トリクス形表示装置の要求が増加しているが、特に最近
ではカラー表示の要求が高まっている。
【０００３】従来から、プラズマディスプレイ装置やエ
レクトロルミネセンスディスプレイ（ＥＬ）装置等が代
表的とされている、平面表示装置、即ちフラット形表示
装置は、奥行きが小さく、且つ大型の表示画面が実現さ
れて来ている事から、急速にその用途が拡大され、生産
規模も増大して来ている。処で、係る平面表示装置は、
一般的には、電極間に堆積された電荷を所定の電圧下で
放電発光させて表示するものであり、その一般的な表示
原理を、プラズマディスプレイ装置を例に採って、その
構造と作動を以下に概略的に説明する。
レクトロルミネセンスディスプレイ（ＥＬ）装置等が代
表的とされている、平面表示装置、即ちフラット形表示
装置は、奥行きが小さく、且つ大型の表示画面が実現さ
れて来ている事から、急速にその用途が拡大され、生産
規模も増大して来ている。処で、係る平面表示装置は、
一般的には、電極間に堆積された電荷を所定の電圧下で
放電発光させて表示するものであり、その一般的な表示
原理を、プラズマディスプレイ装置を例に採って、その
構造と作動を以下に概略的に説明する。
【０００４】即ち、従来から良く知られているプラズマ
ディスプレイ装置（ＡＣ型ＰＤＰ）には、２本の電極で
選択放電（アドレス放電）および維持放電を行う２電極
型と、第３の電極を利用してアドレス放電を行う３電極
型とがある。一方、カラー表示を行うプラズマディスプ
レイ装置（ＰＤＰ）では、放電により発生する紫外線に
よって放電セル内に形成した蛍光体を励起しているが、
この蛍光体は、放電により同時に発生する正電荷である
イオンの衝撃に弱いという欠点がある。 上記の２電極
型では、当該蛍光体がイオンに直接当たるような構成に
なっているため、蛍光体の寿命低下を招く恐れがある。
ディスプレイ装置（ＡＣ型ＰＤＰ）には、２本の電極で
選択放電（アドレス放電）および維持放電を行う２電極
型と、第３の電極を利用してアドレス放電を行う３電極
型とがある。一方、カラー表示を行うプラズマディスプ
レイ装置（ＰＤＰ）では、放電により発生する紫外線に
よって放電セル内に形成した蛍光体を励起しているが、
この蛍光体は、放電により同時に発生する正電荷である
イオンの衝撃に弱いという欠点がある。 上記の２電極
型では、当該蛍光体がイオンに直接当たるような構成に
なっているため、蛍光体の寿命低下を招く恐れがある。
【０００５】これを回避するために、カラープラズマデ
ィスプレイ装置では、面放電を利用した３電極構造が一
般に用いられている。さらに、この３電極型において
も、第３の電極の維持放電を行う第１と第２の電極が配
置されている基板に当該第３の電極を形成する場合と、
対向するもう一つの基板に当該第３の電極を配置する場
合がある。
ィスプレイ装置では、面放電を利用した３電極構造が一
般に用いられている。さらに、この３電極型において
も、第３の電極の維持放電を行う第１と第２の電極が配
置されている基板に当該第３の電極を形成する場合と、
対向するもう一つの基板に当該第３の電極を配置する場
合がある。
【０００６】また、同一基板に前記の３種の電極を形成
する場合でも、維持放電を行う２本の電極の上に第３の
電極を配置する場合と、その下に第３の電極を配置する
場合がある。さらに、蛍光体から発せられた可視光を、
その蛍光体を透過して見る場合と、蛍光体からの反射を
見る場合がある。
する場合でも、維持放電を行う２本の電極の上に第３の
電極を配置する場合と、その下に第３の電極を配置する
場合がある。さらに、蛍光体から発せられた可視光を、
その蛍光体を透過して見る場合と、蛍光体からの反射を
見る場合がある。
【０００７】上記した各タイプのプラズマディスプレイ
装置は、何れも原理は、互いに同一であるので、以下で
は、維持放電を行う第１と第２の電極を設けた第１の基
板と、これとは別で、当該第１の基板と対向する第２の
基板に第３の電極を形成して構成された平面表示装置に
付いてその具体例を説明する。即ち、図６（Ａ）は、上
記した３電極方式のプラズマディスプレイ装置（ＰＤ
Ｐ）の構成の概略を示す概略的平面図であり、又、図６
（Ｂ）は、図６（Ａ）のプラズマディスプレイ装置に形
成される、一つの放電セル１０における概略的断面図で
ある。
装置は、何れも原理は、互いに同一であるので、以下で
は、維持放電を行う第１と第２の電極を設けた第１の基
板と、これとは別で、当該第１の基板と対向する第２の
基板に第３の電極を形成して構成された平面表示装置に
付いてその具体例を説明する。即ち、図６（Ａ）は、上
記した３電極方式のプラズマディスプレイ装置（ＰＤ
Ｐ）の構成の概略を示す概略的平面図であり、又、図６
（Ｂ）は、図６（Ａ）のプラズマディスプレイ装置に形
成される、一つの放電セル１０における概略的断面図で
ある。
【０００８】即ち、当該プラズマディスプレイ装置は、
図６（Ａ）及び図６（Ｂ）から判る様に、２枚のガラス
基板１２、１３によって構成されている。第１の基板１
３には、互いに平行して配置された維持電極として作動
する第１の電極（Ｘ電極）１４、および第２の電極（Ｙ
電極）１５を備え、それらは、誘電体層１８で被覆され
ている。
図６（Ａ）及び図６（Ｂ）から判る様に、２枚のガラス
基板１２、１３によって構成されている。第１の基板１
３には、互いに平行して配置された維持電極として作動
する第１の電極（Ｘ電極）１４、および第２の電極（Ｙ
電極）１５を備え、それらは、誘電体層１８で被覆され
ている。
【０００９】更に、該誘電体層１８からなる放電面には
保護膜としてＭｇＯ（酸化マグネシューム）膜等で構成
された被膜２１が形成されている。一方、前記第１のガ
ラス基板１３と向かい合う第２の基板１２の表面には、
第３の電極即ちアドレス電極として作動する電極１６
が、該維持電極１４、１５と直交する形で形成されてい
る。
保護膜としてＭｇＯ（酸化マグネシューム）膜等で構成
された被膜２１が形成されている。一方、前記第１のガ
ラス基板１３と向かい合う第２の基板１２の表面には、
第３の電極即ちアドレス電極として作動する電極１６
が、該維持電極１４、１５と直交する形で形成されてい
る。
【００１０】また、アドレス電極１６上には、赤、緑、
青の発光特性の一つを持つ蛍光体１９が、該第２の基板
１２の該アドレス電極が配置されている面と同一の面に
形成されている壁部１７によって規定される放電空間２
０内に、配置されている。つまり、該プラズマディスプ
レイ装置に於ける各放電セル１０は壁（障壁）によって
仕切られている。
青の発光特性の一つを持つ蛍光体１９が、該第２の基板
１２の該アドレス電極が配置されている面と同一の面に
形成されている壁部１７によって規定される放電空間２
０内に、配置されている。つまり、該プラズマディスプ
レイ装置に於ける各放電セル１０は壁（障壁）によって
仕切られている。
【００１１】また、上記具体例に於ける該プラズマディ
スプレイ装置１に於いては、第１の電極（Ｘ電極）１４
と該第２の電極（Ｙ電極）１５とは、互いに平行に配置
され、それぞれ対を構成しており、該第２の電極（Ｙ電
極）１５は、それぞれ個別に駆動されるが、該第１の電
極（Ｘ電極）１４は、共通電極を構成しており、１個の
ドライバで駆動される構成と成っている。
スプレイ装置１に於いては、第１の電極（Ｘ電極）１４
と該第２の電極（Ｙ電極）１５とは、互いに平行に配置
され、それぞれ対を構成しており、該第２の電極（Ｙ電
極）１５は、それぞれ個別に駆動されるが、該第１の電
極（Ｘ電極）１４は、共通電極を構成しており、１個の
ドライバで駆動される構成と成っている。
【００１２】又、図７は、図６（Ａ）および図６（Ｂ）
に示したプラズマディスプレイ装置を駆動するための周
辺回路を示した概略的ブロック図であって、アドレス電
極１６は１本毎にアドレスドライバ３１に接続され、そ
のアドレスドライバ３１によってアドレス放電時のアド
レスパルスが各アドレス電極に印加される。また、Ｙ電
極１５は、個別にＹスキャンドライバ３４に接続されて
いる。
に示したプラズマディスプレイ装置を駆動するための周
辺回路を示した概略的ブロック図であって、アドレス電
極１６は１本毎にアドレスドライバ３１に接続され、そ
のアドレスドライバ３１によってアドレス放電時のアド
レスパルスが各アドレス電極に印加される。また、Ｙ電
極１５は、個別にＹスキャンドライバ３４に接続されて
いる。
【００１３】該スキャンドライバ３４は更にＹ側共通ド
ライバ３３に接続されており、アドレス放電時のパルス
はスキャンドライバ３４から発生されるが、維持放電パ
ルス等はＹ側共通ドライバ３３で発生し、Ｙスキャンド
ライバ３４を経由して、Ｙ電極１５に印加される。一
方、Ｘ電極１４は当該平面表示装置に於けるパネルの全
表示ラインに亘って共通に接続され取り出されている。
ライバ３３に接続されており、アドレス放電時のパルス
はスキャンドライバ３４から発生されるが、維持放電パ
ルス等はＹ側共通ドライバ３３で発生し、Ｙスキャンド
ライバ３４を経由して、Ｙ電極１５に印加される。一
方、Ｘ電極１４は当該平面表示装置に於けるパネルの全
表示ラインに亘って共通に接続され取り出されている。
【００１４】つまり、Ｘ電極側の共通ドライバ３２は、
書き込みパルス、維持パルス等を発生し、これらを同時
平行的に各Ｙ電極１５に印加する。 これらのドライバ
回路は、制御回路によって制御され、その制御回路は、
装置の外部より入力される、同期信号や表示データ信号
によって制御される。つまり、図７から明らかな様に、
該アドレスドライバ３１は、制御回路３５に設けた表示
データ制御部３６と接続されており、該表示データ制御
部３６は、外部から入力される、表示データを示すドッ
トクロック信号（CLOCK)及び表示データ信号（DATA) か
ら、１水平同期信号（ＨSYNC）によって１ライン毎に選
択されるべきアドレス電極のアドレスデータを出力す
る。
書き込みパルス、維持パルス等を発生し、これらを同時
平行的に各Ｙ電極１５に印加する。 これらのドライバ
回路は、制御回路によって制御され、その制御回路は、
装置の外部より入力される、同期信号や表示データ信号
によって制御される。つまり、図７から明らかな様に、
該アドレスドライバ３１は、制御回路３５に設けた表示
データ制御部３６と接続されており、該表示データ制御
部３６は、外部から入力される、表示データを示すドッ
トクロック信号（CLOCK)及び表示データ信号（DATA) か
ら、１水平同期信号（ＨSYNC）によって１ライン毎に選
択されるべきアドレス電極のアドレスデータを出力す
る。
【００１５】又、該Ｙスキャンドライバ３４は、該制御
回路３５に設けられているパネル駆動制御部３８のスキ
ャンドライバ制御部３９と接続されており、外部から入
力される１フレームの開始を指示する信号である垂直同
期信号ＶSYNCと１ラインの走査開始を指示する信号であ
る水平同期信号ＨSYNCに応答して、該Ｙスキャンドライ
バ３４を駆動して、該平面表示装置１に於ける複数本の
Ｙ電極１５を１本ずつ順次に選択して、１フレームの画
像を表示する事になる。
回路３５に設けられているパネル駆動制御部３８のスキ
ャンドライバ制御部３９と接続されており、外部から入
力される１フレームの開始を指示する信号である垂直同
期信号ＶSYNCと１ラインの走査開始を指示する信号であ
る水平同期信号ＨSYNCに応答して、該Ｙスキャンドライ
バ３４を駆動して、該平面表示装置１に於ける複数本の
Ｙ電極１５を１本ずつ順次に選択して、１フレームの画
像を表示する事になる。
【００１６】図７に於いて、当該スキャンドライバ制御
部３９から出力されるY-DATAは、当該Ｙスキャンドライ
バを１ビット毎にＯＮさせる為のスキャンデータであ
り、又Y-CLOCK は、該Ｙスキャンドライバを１ビット毎
にＯＮさせる為の転送クロックである。尚、Y-STB1は、
該ＹスキャンドライバをＯＮさせる為のタイミング信号
であり、又Y-STB2は、該ＹスキャンドライバをＯＦＦさ
せる為のタイミング信号である。
部３９から出力されるY-DATAは、当該Ｙスキャンドライ
バを１ビット毎にＯＮさせる為のスキャンデータであ
り、又Y-CLOCK は、該Ｙスキャンドライバを１ビット毎
にＯＮさせる為の転送クロックである。尚、Y-STB1は、
該ＹスキャンドライバをＯＮさせる為のタイミング信号
であり、又Y-STB2は、該ＹスキャンドライバをＯＦＦさ
せる為のタイミング信号である。
【００１７】一方、本具体例に於けるＸ電極側の共通ド
ライバ３２とＹ電極側の共通ドライバ３３は何れも該制
御回路３５に設けられた共通ドライバ制御部４０に接続
されており、該Ｘ電極１４と該Ｙ電極１５とを交互に印
加される電圧の極性を反転させながら一斉に駆動して、
上記した維持放電を実行させるものである。図７に於い
て該共通ドライバ制御部４０から出力されるX-UDは、Ｘ
側共通ドライバのＯＮ／ＯＦＦを制御する為にＶｓ及び
Ｖｗを出力するもので有り、又図中、該共通ドライバ制
御部４０から出力されるX-DDは、Ｘ側共通ドライバのＯ
Ｎ／ＯＦＦを制御する為にGND を出力するものである。
ライバ３２とＹ電極側の共通ドライバ３３は何れも該制
御回路３５に設けられた共通ドライバ制御部４０に接続
されており、該Ｘ電極１４と該Ｙ電極１５とを交互に印
加される電圧の極性を反転させながら一斉に駆動して、
上記した維持放電を実行させるものである。図７に於い
て該共通ドライバ制御部４０から出力されるX-UDは、Ｘ
側共通ドライバのＯＮ／ＯＦＦを制御する為にＶｓ及び
Ｖｗを出力するもので有り、又図中、該共通ドライバ制
御部４０から出力されるX-DDは、Ｘ側共通ドライバのＯ
Ｎ／ＯＦＦを制御する為にGND を出力するものである。
【００１８】又、同様に、該共通ドライバ制御部４０か
ら出力されるY-UDは、Ｙ側共通ドライバのＯＮ／ＯＦＦ
を制御する為にＶｓ及びＶｗを出力するもので有り、又
図中、該共通ドライバ制御部４０から出力されるY-DD
は、Ｙ側共通ドライバのＯＮ／ＯＦＦを制御する為にGN
D を出力するものである。ここで、従来の三電極型カラ
ー単階調表示のＰＤＰを例に採って、画像表示駆動方法
の例を図８のタイミング波形図を参照しながら説明す
る。
ら出力されるY-UDは、Ｙ側共通ドライバのＯＮ／ＯＦＦ
を制御する為にＶｓ及びＶｗを出力するもので有り、又
図中、該共通ドライバ制御部４０から出力されるY-DD
は、Ｙ側共通ドライバのＯＮ／ＯＦＦを制御する為にGN
D を出力するものである。ここで、従来の三電極型カラ
ー単階調表示のＰＤＰを例に採って、画像表示駆動方法
の例を図８のタイミング波形図を参照しながら説明す
る。
【００１９】即ち、従来に於いては、図８に示すタイミ
ングの線順次・自己消去アドレス方式により駆動してい
た。この方式によれば、表示画面の初期化，データの書
込み，表示を行うサステインの一連の動作は、１ライン
の走査期間を規定する信号（ＨSYNC）期間内に行われる
が、そのうち選択されたラインのみに対しデータの書込
みが有効となる。
ングの線順次・自己消去アドレス方式により駆動してい
た。この方式によれば、表示画面の初期化，データの書
込み，表示を行うサステインの一連の動作は、１ライン
の走査期間を規定する信号（ＨSYNC）期間内に行われる
が、そのうち選択されたラインのみに対しデータの書込
みが有効となる。
【００２０】図８から明らかな様に、１ＨSYNC期間は、
選択ライン書き込み期間Ｓ１と自己消去アドレス期間Ｓ
２及び維持放電期間であるサステイン期間Ｓ３に分割さ
れ、それぞれのＨSYNC期間に於いて、選択ラインはま
ず、選択ライン書き込み期間Ｓ１に於いて、Ｘ，Ｙ電極
間でＸからＹ方向の電界が印加されサステインを行う。
従って、前のフレームで点灯していたセルはこのサステ
インで放電し、逆に点灯していないセルはここでは点灯
しない。次に、再びＸ，Ｙ電極間でＸからＹ方向にサス
テインより大きな電界を印加し、１ライン上の全てのセ
ルが点灯するように書込みを行う。ここで、１ラインの
全てのセルが点灯し、セル内部に壁電荷による内部電界
を保有するようになり、全面が一様に初期化される。そ
して、今度はＸ，Ｙ電極間でＹからＸ方向の電界が印加
され、サステインを行い再び全面が点灯する。
選択ライン書き込み期間Ｓ１と自己消去アドレス期間Ｓ
２及び維持放電期間であるサステイン期間Ｓ３に分割さ
れ、それぞれのＨSYNC期間に於いて、選択ラインはま
ず、選択ライン書き込み期間Ｓ１に於いて、Ｘ，Ｙ電極
間でＸからＹ方向の電界が印加されサステインを行う。
従って、前のフレームで点灯していたセルはこのサステ
インで放電し、逆に点灯していないセルはここでは点灯
しない。次に、再びＸ，Ｙ電極間でＸからＹ方向にサス
テインより大きな電界を印加し、１ライン上の全てのセ
ルが点灯するように書込みを行う。ここで、１ラインの
全てのセルが点灯し、セル内部に壁電荷による内部電界
を保有するようになり、全面が一様に初期化される。そ
して、今度はＸ，Ｙ電極間でＹからＸ方向の電界が印加
され、サステインを行い再び全面が点灯する。
【００２１】次に、自己消去アドレス期間Ｓ２に於いて
は、アドレス電極からアドレスパルスを印加することに
より表示データの書込みが行われるが、これは表示しな
いセルの内部電界を自己消去させる形式によって実行さ
れるものである。即ち、Ｘ，Ｙ間のサステインとアドレ
スパルスの印加を同時に止め、Ｘ，Ｙ間は同電位にして
外部電界を除き、アドレス電極とＹ電極間には逆の電界
が発生するように電位を与えると内部電界により自己消
去放電が起こり、書き込みが行われなかったセルは以降
の期間、即ち維持放電期間Ｓ３に於いては点灯はしなく
なる。
は、アドレス電極からアドレスパルスを印加することに
より表示データの書込みが行われるが、これは表示しな
いセルの内部電界を自己消去させる形式によって実行さ
れるものである。即ち、Ｘ，Ｙ間のサステインとアドレ
スパルスの印加を同時に止め、Ｘ，Ｙ間は同電位にして
外部電界を除き、アドレス電極とＹ電極間には逆の電界
が発生するように電位を与えると内部電界により自己消
去放電が起こり、書き込みが行われなかったセルは以降
の期間、即ち維持放電期間Ｓ３に於いては点灯はしなく
なる。
【００２２】そして、次のフレームに於いて、再び選択
ラインとなるまでは、Ｘ，Ｙ間のサステインをを繰り返
し、表示したいセルはサステインの度に点灯を続け、表
示しないセルが点灯することはない。
ラインとなるまでは、Ｘ，Ｙ間のサステインをを繰り返
し、表示したいセルはサステインの度に点灯を続け、表
示しないセルが点灯することはない。
【００２３】
【発明が解決しようとする課題】ところが、上記した従
来に於ける自己消去の発生メカニズムは、セル内部に発
生する自身の内部電界を利用するため、その内部電界の
大きさにある程度の精度が要求される。内部電界の大き
さ、すなわち壁電荷の量は放電発光する際のセルの状態
に大きく作用されるが、表示パネルを完全に均一に作る
ことは非常に困難で、特に面積が大きくなるほど難しく
なる。
来に於ける自己消去の発生メカニズムは、セル内部に発
生する自身の内部電界を利用するため、その内部電界の
大きさにある程度の精度が要求される。内部電界の大き
さ、すなわち壁電荷の量は放電発光する際のセルの状態
に大きく作用されるが、表示パネルを完全に均一に作る
ことは非常に困難で、特に面積が大きくなるほど難しく
なる。
【００２４】また、初期化の１ライン書込みの際，前の
フレームで点灯していたセルとそうでないセルとの間に
は保有する壁電荷に差があり、また書込み時にセルにか
かる電界（外部印加電界−内部電界）も違う。それらを
全て考慮した場合、内部電界による自己消去において、
十分な消去が行われない消去ミスによる書込みミスが発
生してしまい、安定な表示品質を損なうという問題を生
じていた。
フレームで点灯していたセルとそうでないセルとの間に
は保有する壁電荷に差があり、また書込み時にセルにか
かる電界（外部印加電界−内部電界）も違う。それらを
全て考慮した場合、内部電界による自己消去において、
十分な消去が行われない消去ミスによる書込みミスが発
生してしまい、安定な表示品質を損なうという問題を生
じていた。
【００２５】その問題を改善するために、一括書込み・
一括消去・線順次アドレス方式の駆動が本願出願人より
提案されている。当該一括書込み・一括消去・線順次ア
ドレス方式の駆動方式の概略を図９に示し、これを簡単
に説明する。即ち、図９においては、１画面の表示をフ
レーム単位で構成し、全ライン一括書込み・一括消去を
行う期間Ｓ１’と、１ラインずつデータ書込み走査を行
って、全ラインに対して、線順次に書込み操作を実行す
るアドレス期間Ｓ２と全面の表示を行うサステイン期間
Ｓ３とに分けて駆動する様に構成されており、係る方式
により、安定したアドレス書込みが出来るとしている。
一括消去・線順次アドレス方式の駆動が本願出願人より
提案されている。当該一括書込み・一括消去・線順次ア
ドレス方式の駆動方式の概略を図９に示し、これを簡単
に説明する。即ち、図９においては、１画面の表示をフ
レーム単位で構成し、全ライン一括書込み・一括消去を
行う期間Ｓ１’と、１ラインずつデータ書込み走査を行
って、全ラインに対して、線順次に書込み操作を実行す
るアドレス期間Ｓ２と全面の表示を行うサステイン期間
Ｓ３とに分けて駆動する様に構成されており、係る方式
により、安定したアドレス書込みが出来るとしている。
【００２６】ところが、この方式に於いても、フレーム
開始の制御信号を受けた後、表示データを書込んで行く
までの間に全ライン一括書込み・一括消去を行うための
期間が必要になり、ホストから送出される信号と送出デ
ータとの間に十分な時間がない場合に適用できないとい
った問題を生じていた。つまり、従来に於いては、フレ
ーム開始の制御信号ＶSYNCを受けた後、上記した初期化
に要する時間が例えば数個の水平同期信号ＨSYNCが入力
される期間が必要とされている。
開始の制御信号を受けた後、表示データを書込んで行く
までの間に全ライン一括書込み・一括消去を行うための
期間が必要になり、ホストから送出される信号と送出デ
ータとの間に十分な時間がない場合に適用できないとい
った問題を生じていた。つまり、従来に於いては、フレ
ーム開始の制御信号ＶSYNCを受けた後、上記した初期化
に要する時間が例えば数個の水平同期信号ＨSYNCが入力
される期間が必要とされている。
【００２７】従って、フレーム開始の制御信号ＶSYNCを
受けた直後から１ライン目のデータ信号が送られてくる
様な場合には、フレームメモリ等のデータ格納手段を持
たないとそのデータ処理が出来ないと言う問題があっ
た。そのため、従来に於いては、仕様規格を設定し、所
定のフレーム表示開始信号ＶSYNCが入力された後、所定
の期間即ち、例えば数個の水平同期信号ＨSYNCが入力さ
れる期間に相当する期間は、表示データ信号の入力を禁
止する様に規定されていたので、データを送出するホス
ト側での信号に汎用性を持てない状態に有った。
受けた直後から１ライン目のデータ信号が送られてくる
様な場合には、フレームメモリ等のデータ格納手段を持
たないとそのデータ処理が出来ないと言う問題があっ
た。そのため、従来に於いては、仕様規格を設定し、所
定のフレーム表示開始信号ＶSYNCが入力された後、所定
の期間即ち、例えば数個の水平同期信号ＨSYNCが入力さ
れる期間に相当する期間は、表示データ信号の入力を禁
止する様に規定されていたので、データを送出するホス
ト側での信号に汎用性を持てない状態に有った。
【００２８】従って、本発明の目的は、係る従来の問題
を解決し、フレーム開始の信号を受けてすぐに１ライン
目のデータ信号が送られてくる様な場合でも、即時に安
定した表示品質の画像表示を行いうる高速演算処理機能
を有する平面表示装置を提供することを目的とする。
を解決し、フレーム開始の信号を受けてすぐに１ライン
目のデータ信号が送られてくる様な場合でも、即時に安
定した表示品質の画像表示を行いうる高速演算処理機能
を有する平面表示装置を提供することを目的とする。
【００２９】
【課題を解決するための手段】本発明は上記した目的を
達成するため、以下に記載されたような技術構成を採用
するものである。即ち、複数の表示セル部を備え、該複
数の表示セル部により表示される１つのフレームを複数
のサブフレームに時間的に分割して表示するものであ
り、該分割された各サブフレームは、表示画面の初期化
を行う初期化期間、表示を行うセル部の選択を実行する
アドレス期間及び、該選択されたセル部を所定の期間、
放電発光させる維持放電期間とを含んでなる平面表示装
置であって、１フレームの表示開始信号（Ｖ SYNC ）の入
力を検出して、当該初期化期間の初期化操作開始時点
を、該表示開始信号（Ｖ SYNC ）の入力時点より、予め定
められた所定の個数の水平同期信号（Ｈ SYNC ）分に相当
する時間だけ、早くなる様に調整する初期化操作開始時
点制御手段を有する平面表示装置である。 また、複数の
表示セル部を備え、該複数の表示セル部により表示され
る１つのフレームを複数のサブフレームに時間的に分割
して表示するものであり、該分割された各サブフレーム
は、表示画面の初期化を行う初期化期間、表示を行うセ
ル部の選択を実行するアドレス期間及び、該選択された
セル部を所定の期間、放電発光させる維持放電期間とを
含んでなる平面表示装置の制御方法であって、 該初期化
期間の初期化操作を、１フレームの表示開始信号（Ｖ
SYNC ）の入力時点より、予め定められた所定の個数の水
平同期信号（Ｈ SYNC ）分に相当する時間だけ早く開始す
る平面表示装置の制御方法である。
達成するため、以下に記載されたような技術構成を採用
するものである。即ち、複数の表示セル部を備え、該複
数の表示セル部により表示される１つのフレームを複数
のサブフレームに時間的に分割して表示するものであ
り、該分割された各サブフレームは、表示画面の初期化
を行う初期化期間、表示を行うセル部の選択を実行する
アドレス期間及び、該選択されたセル部を所定の期間、
放電発光させる維持放電期間とを含んでなる平面表示装
置であって、１フレームの表示開始信号（Ｖ SYNC ）の入
力を検出して、当該初期化期間の初期化操作開始時点
を、該表示開始信号（Ｖ SYNC ）の入力時点より、予め定
められた所定の個数の水平同期信号（Ｈ SYNC ）分に相当
する時間だけ、早くなる様に調整する初期化操作開始時
点制御手段を有する平面表示装置である。 また、複数の
表示セル部を備え、該複数の表示セル部により表示され
る１つのフレームを複数のサブフレームに時間的に分割
して表示するものであり、該分割された各サブフレーム
は、表示画面の初期化を行う初期化期間、表示を行うセ
ル部の選択を実行するアドレス期間及び、該選択された
セル部を所定の期間、放電発光させる維持放電期間とを
含んでなる平面表示装置の制御方法であって、 該初期化
期間の初期化操作を、１フレームの表示開始信号（Ｖ
SYNC ）の入力時点より、予め定められた所定の個数の水
平同期信号（Ｈ SYNC ）分に相当する時間だけ早く開始す
る平面表示装置の制御方法である。
【００３０】
【作用】本発明に係る該平面表示装置に於いては、上記
した従来に於ける問題点を解決する為に、前記した様な
技術構成を採用しているので、外部より当該フレーム開
始の制御信号ＶSYNCを受けてから、再び外部より次のフ
レーム開始制御信号ＨSY NCを受けるまでの間に、当該平
面表示装置内部で、積極的に初期化期間を確保する為
に、必要なフレーム制御信号ＶsNEWを生成することによ
り、独自に初期化を行う期間を設定することが出来ると
同時に、当該フレーム制御信号ＶsNEWを、当該フレーム
開始制御信号ＶSYNCよりも前の任意の時点に、設定する
事が出来るので、当該フレームに於ける該初期化開始操
作を従来に比べて早期に実行できるので、フレーム開始
の信号を受けてすぐに１ライン目のデータ信号が送られ
てくる様な場合でも、即時に安定した表示品質の画像表
示を行いうる平面表示装置を得る事が出来ると共に、任
意のホスト装置からでも画像入力信号を受ける事が可能
となる。
した従来に於ける問題点を解決する為に、前記した様な
技術構成を採用しているので、外部より当該フレーム開
始の制御信号ＶSYNCを受けてから、再び外部より次のフ
レーム開始制御信号ＨSY NCを受けるまでの間に、当該平
面表示装置内部で、積極的に初期化期間を確保する為
に、必要なフレーム制御信号ＶsNEWを生成することによ
り、独自に初期化を行う期間を設定することが出来ると
同時に、当該フレーム制御信号ＶsNEWを、当該フレーム
開始制御信号ＶSYNCよりも前の任意の時点に、設定する
事が出来るので、当該フレームに於ける該初期化開始操
作を従来に比べて早期に実行できるので、フレーム開始
の信号を受けてすぐに１ライン目のデータ信号が送られ
てくる様な場合でも、即時に安定した表示品質の画像表
示を行いうる平面表示装置を得る事が出来ると共に、任
意のホスト装置からでも画像入力信号を受ける事が可能
となる。
【００３１】
【実施例】以下に、本発明に係る平面表示装置に関する
具体例（実施例１）を図面を参照しながら詳細に説明す
る。即ち、図１（Ａ）は、本発明に係る平面表示装置の
主たる構成部分である初期化操作開始時点制御手段１０
０の一具体例の構成を示すブロックダイアグラムであっ
て、具体的には、図６に示される、表面に電極が配置さ
れている少なくとも２枚の基板１２、１３が、当該電極
部が、互いに直交して対向する様に、隣接して配置さ
れ、且つ当該基板間１２、１３に適宜の蛍光体１９が挿
入されており、更に当該電極間に構成される複数個の直
交部が、それぞれ画素を構成するセル部１０を形成して
おり、当該セル部１０は、当該電極に印加される適宜の
電圧に従って、所定量の電荷を蓄積しうるメモリー機能
と放電発光機能とを有している平面表示装置を使用する
事を前提とするものであって、該表示装置は、表示され
る１つのフレームを走査ライン毎に構成される複数のサ
ブフレームに時間的に分割して表示すると共に、前記し
た平面表示装置に於ける駆動制御系の中に、該分割され
た各サブフレームを、更に少なくとも表示画面の初期化
を行う初期化期間Ｓ１、当該複数個のセル部を選択して
適宜の表示データの書き込み操作を実行するアドレス期
間Ｓ２及び、該表示データが書き込まれたセル部を所定
の期間、放電発光させる維持放電期間Ｓ３とで構成せし
めたものであって、係る構成の平面表示装置に於いて、
図１（Ａ）に示す様な、１フレームの表示開始信号Ｖ
SYNCの入力を検出して、当該初期化期間Ｓ１’の初期化
操作開始時点ＳＴを、当該フレーム開始信号ＶSYNCの入
力時点以前となる様に調整する初期化操作開始時点制御
手段１００が設けられているものである。
具体例（実施例１）を図面を参照しながら詳細に説明す
る。即ち、図１（Ａ）は、本発明に係る平面表示装置の
主たる構成部分である初期化操作開始時点制御手段１０
０の一具体例の構成を示すブロックダイアグラムであっ
て、具体的には、図６に示される、表面に電極が配置さ
れている少なくとも２枚の基板１２、１３が、当該電極
部が、互いに直交して対向する様に、隣接して配置さ
れ、且つ当該基板間１２、１３に適宜の蛍光体１９が挿
入されており、更に当該電極間に構成される複数個の直
交部が、それぞれ画素を構成するセル部１０を形成して
おり、当該セル部１０は、当該電極に印加される適宜の
電圧に従って、所定量の電荷を蓄積しうるメモリー機能
と放電発光機能とを有している平面表示装置を使用する
事を前提とするものであって、該表示装置は、表示され
る１つのフレームを走査ライン毎に構成される複数のサ
ブフレームに時間的に分割して表示すると共に、前記し
た平面表示装置に於ける駆動制御系の中に、該分割され
た各サブフレームを、更に少なくとも表示画面の初期化
を行う初期化期間Ｓ１、当該複数個のセル部を選択して
適宜の表示データの書き込み操作を実行するアドレス期
間Ｓ２及び、該表示データが書き込まれたセル部を所定
の期間、放電発光させる維持放電期間Ｓ３とで構成せし
めたものであって、係る構成の平面表示装置に於いて、
図１（Ａ）に示す様な、１フレームの表示開始信号Ｖ
SYNCの入力を検出して、当該初期化期間Ｓ１’の初期化
操作開始時点ＳＴを、当該フレーム開始信号ＶSYNCの入
力時点以前となる様に調整する初期化操作開始時点制御
手段１００が設けられているものである。
【００３２】本発明に係る当該平面表示装置としては、
３電極を使用して画像の表示駆動を実行するものであっ
てもよく、又当該平面表示装置は、３電極型カラー表示
装置で有っても良い。尚、本発明に係る当該平面表示装
置に於いては、前記した様に、当該１フレーム期間内に
於ける該初期化期間Ｓ１’は、表示画面の初期化を行う
為に、当該各セルに対して、所定のデータを一括書込み
／一括消去する期間である事が望ましい。
３電極を使用して画像の表示駆動を実行するものであっ
てもよく、又当該平面表示装置は、３電極型カラー表示
装置で有っても良い。尚、本発明に係る当該平面表示装
置に於いては、前記した様に、当該１フレーム期間内に
於ける該初期化期間Ｓ１’は、表示画面の初期化を行う
為に、当該各セルに対して、所定のデータを一括書込み
／一括消去する期間である事が望ましい。
【００３３】又、本発明に於ける該平面表示装置に於い
ては、当該初期化操作開始時点制御手段１００は、１フ
レームの表示開始信号ＶSYNCの入力を検出して、最初の
サブフレームとなる初期化期間Ｓ１’の初期化操作開始
時点ＳＴを、当該フレーム開始信号ＶSYNCの入力時点よ
り、予め定められた所定の個数の水平同期信号ＨSYNCパ
ルス分に相当する時間だけ、早くなる様に、操作が行わ
れる様に構成されている事が望ましい。
ては、当該初期化操作開始時点制御手段１００は、１フ
レームの表示開始信号ＶSYNCの入力を検出して、最初の
サブフレームとなる初期化期間Ｓ１’の初期化操作開始
時点ＳＴを、当該フレーム開始信号ＶSYNCの入力時点よ
り、予め定められた所定の個数の水平同期信号ＨSYNCパ
ルス分に相当する時間だけ、早くなる様に、操作が行わ
れる様に構成されている事が望ましい。
【００３４】次に、図１（Ａ）に示される本発明に於け
る当該初期化操作開始時点制御手段１００の構成の一例
とその作動に付いて、図１（Ｂ）を参照しながら以下に
説明する。即ち、該初期化操作開始時点制御手段１００
の主たる機能としては、１フレームの表示開始指示信号
ＶSYNCの間隔を演算する手段１０１と当該各フレームの
表示開始指示信号ＶSYNC間隔から該予め定められた所定
の個数のＨSYNCパルス分に相当する時間を減算する減算
手段１０２と、該１フレームの表示開始指示信号発生時
点から該減算手段により出力される時間が経過した時点
を、当該サブフレームに於ける初期化操作開始時点と決
定する手段１０３とを有している事が望ましい。
る当該初期化操作開始時点制御手段１００の構成の一例
とその作動に付いて、図１（Ｂ）を参照しながら以下に
説明する。即ち、該初期化操作開始時点制御手段１００
の主たる機能としては、１フレームの表示開始指示信号
ＶSYNCの間隔を演算する手段１０１と当該各フレームの
表示開始指示信号ＶSYNC間隔から該予め定められた所定
の個数のＨSYNCパルス分に相当する時間を減算する減算
手段１０２と、該１フレームの表示開始指示信号発生時
点から該減算手段により出力される時間が経過した時点
を、当該サブフレームに於ける初期化操作開始時点と決
定する手段１０３とを有している事が望ましい。
【００３５】即ち、図１（Ｂ）は、本発明に係る平面表
示装置の初期化操作開始時点制御手段１００に於ける原
理構成を示すブロック図であり、１１０はホスト装置よ
り入力されるフレーム制御信号（ＶSYNC）期間内の水平
走査ライン数（ＨSYNC）を数えるライン・カウンタ、１
１１は前記したライン・カウンタ１１０で数えたデータ
を、次のＶSYNC期間中保持しておくためのラッチ回路で
あり、１１２は当該ラッチ回路に保持したデータから、
初期化に必要な期間（＝ここでは３ＨSYNCとしている）
を引く減算回路であり、１１３は比較回路であって、該
減算回路１１２の出力ＳＵＢと該ライン・カウンタ１１
０の出力ＬＩＮが入力され、当該減算回路１１２の出力
と該ライン・カウンタ１１０の出力とが一致した場合、
即ち、ＳＵＢ＝ＬＩＮで“Ｌ”レベルの信号を出力す
る。
示装置の初期化操作開始時点制御手段１００に於ける原
理構成を示すブロック図であり、１１０はホスト装置よ
り入力されるフレーム制御信号（ＶSYNC）期間内の水平
走査ライン数（ＨSYNC）を数えるライン・カウンタ、１
１１は前記したライン・カウンタ１１０で数えたデータ
を、次のＶSYNC期間中保持しておくためのラッチ回路で
あり、１１２は当該ラッチ回路に保持したデータから、
初期化に必要な期間（＝ここでは３ＨSYNCとしている）
を引く減算回路であり、１１３は比較回路であって、該
減算回路１１２の出力ＳＵＢと該ライン・カウンタ１１
０の出力ＬＩＮが入力され、当該減算回路１１２の出力
と該ライン・カウンタ１１０の出力とが一致した場合、
即ち、ＳＵＢ＝ＬＩＮで“Ｌ”レベルの信号を出力す
る。
【００３６】又、１１４はラッチ回路であって、当該比
較回路１１３の出力をＨSYNC期間ごとに保持するラッチ
であり、クロックＣＬＫ信号のタイミングに応答して、
アドレス開始前に初期化を行うために新たなＶSNEWを生
成するものである。そして、そのＶSNEWを基準として内
部の回路動作が制御される。係る本発明に於ける該平面
表示装置の初期化操作開始時点制御手段１００に於いて
は、先ず該ライン・カウンタ１１０に前記した様にＶ
SYNC信号とＨSYNC信号とが同時に入力される様になって
おり、該ＶSYNCをクリア信号として使用して、該ＶSYNC
が入力した場合には、該ライン・カウンタ１１０内のカ
ウント値を０にレセットし、次のＶSYNCが入力される迄
の間に、該ＨSYNCが何回入力されるかをカウントする。
較回路１１３の出力をＨSYNC期間ごとに保持するラッチ
であり、クロックＣＬＫ信号のタイミングに応答して、
アドレス開始前に初期化を行うために新たなＶSNEWを生
成するものである。そして、そのＶSNEWを基準として内
部の回路動作が制御される。係る本発明に於ける該平面
表示装置の初期化操作開始時点制御手段１００に於いて
は、先ず該ライン・カウンタ１１０に前記した様にＶ
SYNC信号とＨSYNC信号とが同時に入力される様になって
おり、該ＶSYNCをクリア信号として使用して、該ＶSYNC
が入力した場合には、該ライン・カウンタ１１０内のカ
ウント値を０にレセットし、次のＶSYNCが入力される迄
の間に、該ＨSYNCが何回入力されるかをカウントする。
【００３７】該カウント値は、前記したＶSYNCのクリア
信号の出力に応答して、前記ラッチ回路１１１に当該Ｈ
SYNC信号の数Ｎのカウント値が記憶される。ホスト側に
於けるＶSYNCとＨSYNCの出力状態は、一定であるから、
１フレーム分のＨSYNCが一旦記憶されると当該ＶSYNC内
に於けるＨSYNCの数Ｎは、変化する事がないので一定で
ある。
信号の出力に応答して、前記ラッチ回路１１１に当該Ｈ
SYNC信号の数Ｎのカウント値が記憶される。ホスト側に
於けるＶSYNCとＨSYNCの出力状態は、一定であるから、
１フレーム分のＨSYNCが一旦記憶されると当該ＶSYNC内
に於けるＨSYNCの数Ｎは、変化する事がないので一定で
ある。
【００３８】つまり、図１（Ｂ）に於ける該ライン・カ
ウンタ１１０と該ラッチ回路１１１によって、図１
（Ａ）に於ける１フレームの表示開始指示信号ＶSYNCの
間隔を演算する手段１０１に相当するものである。次
に、減算回路１１２に於いては、当該ラッチ回路１１１
に格納されたＶSYNC間隔期間、即ちカウント値Ｎから予
め定められた所定の数、例えばＨSYNCの発生回数を減算
するものであって、図１（Ｂ）の例では、当該所定の数
を３と設定し、つまり該ＨSYNC３回分発生する時間に相
当する時間を該カウント値Ｎから減算する（Ｎ−３）減
算処理を実行するものである。
ウンタ１１０と該ラッチ回路１１１によって、図１
（Ａ）に於ける１フレームの表示開始指示信号ＶSYNCの
間隔を演算する手段１０１に相当するものである。次
に、減算回路１１２に於いては、当該ラッチ回路１１１
に格納されたＶSYNC間隔期間、即ちカウント値Ｎから予
め定められた所定の数、例えばＨSYNCの発生回数を減算
するものであって、図１（Ｂ）の例では、当該所定の数
を３と設定し、つまり該ＨSYNC３回分発生する時間に相
当する時間を該カウント値Ｎから減算する（Ｎ−３）減
算処理を実行するものである。
【００３９】即ち、該減算回路１１２は、図１（Ａ）に
於ける減算手段１０２に相当するものである。又、該比
較回路１１３は、当該減算回路１１３の（Ｎ−３）の出
力と、該ライン・カウンタ１１０から出力される、Ｈ
SYNCの回数とを比較して、両者が一致した場合には、当
該比較回路から例えば“Ｌ”レベルの出力信号を出力
し、当該“Ｌ”レベルの出力信号を第２のラッチ回路１
１４に入力させ、該ＨSYNCの出力タイミングに応答し
て、前記した１フレームの表示開始指示信号ＶSNEWを出
力させるものである。
於ける減算手段１０２に相当するものである。又、該比
較回路１１３は、当該減算回路１１３の（Ｎ−３）の出
力と、該ライン・カウンタ１１０から出力される、Ｈ
SYNCの回数とを比較して、両者が一致した場合には、当
該比較回路から例えば“Ｌ”レベルの出力信号を出力
し、当該“Ｌ”レベルの出力信号を第２のラッチ回路１
１４に入力させ、該ＨSYNCの出力タイミングに応答し
て、前記した１フレームの表示開始指示信号ＶSNEWを出
力させるものである。
【００４０】勿論、本発明に於ける当該平面表示装置に
於いては、減算回路１１２に於ける減算値は、３に限定
されるものではなく、それ以外の数値を採用する事が可
能である。又、本発明に於ける平面表示装置に於いて
は、アドレス電極、Ｘ電極、Ｙ電極の駆動波形は適宜の
ＲＯＭに格納されているので、初期化の期間、アドレス
書込みの期間、およびサステインの期間それぞれに応じ
てＲＯＭのアドレスを設定しておき、必要な時にそれを
読み込むことにより、各ドライバーへの制御信号をコン
トロールすることができる。
於いては、減算回路１１２に於ける減算値は、３に限定
されるものではなく、それ以外の数値を採用する事が可
能である。又、本発明に於ける平面表示装置に於いて
は、アドレス電極、Ｘ電極、Ｙ電極の駆動波形は適宜の
ＲＯＭに格納されているので、初期化の期間、アドレス
書込みの期間、およびサステインの期間それぞれに応じ
てＲＯＭのアドレスを設定しておき、必要な時にそれを
読み込むことにより、各ドライバーへの制御信号をコン
トロールすることができる。
【００４１】更に、本発明に於いては、当該１フレーム
に於ける一括初期化操作に於いて、当該初期化操作開始
時点を、ＶSYNC信号の入力する以前の所定の時点から遡
って実行させるもので有り、具体的には、最初の１工程
では、単に隣接するＶSYNC信号間の時間間隔を測定する
操作を行い、当該時点に於ける該隣接するＶSYNC信号間
の時間間隔を確認、決定するものである。
に於ける一括初期化操作に於いて、当該初期化操作開始
時点を、ＶSYNC信号の入力する以前の所定の時点から遡
って実行させるもので有り、具体的には、最初の１工程
では、単に隣接するＶSYNC信号間の時間間隔を測定する
操作を行い、当該時点に於ける該隣接するＶSYNC信号間
の時間間隔を確認、決定するものである。
【００４２】その後、次の工程からは、前記に於いて求
められた、隣接するＶSYNC信号間の時間間隔から所定の
数のＨSYNCが発生する期間を減算して求めた期間（例え
ばＮ−３）が、前記した、ＶSYNCの発生時点に先立っ
て、当該一括初期化操作を前倒し的に実行させる時点と
して決定するものである。図２は、上記した様な構成を
有する平面表示装置に於いて、該ＶSNEWを出力させる本
発明の駆動タイミングを示す図である。
められた、隣接するＶSYNC信号間の時間間隔から所定の
数のＨSYNCが発生する期間を減算して求めた期間（例え
ばＮ−３）が、前記した、ＶSYNCの発生時点に先立っ
て、当該一括初期化操作を前倒し的に実行させる時点と
して決定するものである。図２は、上記した様な構成を
有する平面表示装置に於いて、該ＶSNEWを出力させる本
発明の駆動タイミングを示す図である。
【００４３】図中、Ｓ１’は初期化のための一括消去・
書込みＷ／Ｅ期間、Ｓ２は表示データを書込むアドレス
期間、Ｓ３は書込まれたデータに応じて表示を行うサス
テイン期間である。また、Ｖsyncはフレーム開始を規定
する制御信号で、その立ち下がりエッジでフレーム開始
となるものである。図２から明らかな様に、本発明に於
ける平面表示装置に於いては、１つのフレームを走査ラ
イン単位で構成される複数のサブフレームに時間的に分
割して表示すると共に、該分割された各サブフレーム
を、更に少なくとも当該複数個のセル部１０を一括して
選択し且つ書込み操作を実行する全面初期化期間Ｓ１’
と、所定の選択されたラインに於ける所定のセル部に適
宜の表示データの書き込み操作を実行するアドレス期間
Ｓ２と、該表示データが書き込まれたセル部１０を所定
の期間、放電発光させる維持放電期間Ｓ３とで構成せし
める。
書込みＷ／Ｅ期間、Ｓ２は表示データを書込むアドレス
期間、Ｓ３は書込まれたデータに応じて表示を行うサス
テイン期間である。また、Ｖsyncはフレーム開始を規定
する制御信号で、その立ち下がりエッジでフレーム開始
となるものである。図２から明らかな様に、本発明に於
ける平面表示装置に於いては、１つのフレームを走査ラ
イン単位で構成される複数のサブフレームに時間的に分
割して表示すると共に、該分割された各サブフレーム
を、更に少なくとも当該複数個のセル部１０を一括して
選択し且つ書込み操作を実行する全面初期化期間Ｓ１’
と、所定の選択されたラインに於ける所定のセル部に適
宜の表示データの書き込み操作を実行するアドレス期間
Ｓ２と、該表示データが書き込まれたセル部１０を所定
の期間、放電発光させる維持放電期間Ｓ３とで構成せし
める。
【００４４】図２に於いて、ホスト側から、所定のフレ
ーム表示操作開始信号であるＶSYNCが時刻ｔ１、ｔ２と
言うタイミングで入力されている場合、従来では、該Ｖ
SYNCが入力された時点から該一括消去・書込みＷ／Ｅ期
間Ｓ１’を開始させ、仕様で規定された所定の時間ｔ’
を遅延させた時点ＳＴ’から表示データの送出を開始し
ているのに対して、本発明に於いては、図示の様に、隣
接するＶSYNC間の間隔Ｎから、例えば３を減算したＮ−
３の時点ＳＴに於いて、当該ＶSYNCに先立って当該一括
消去・書込みＷ／Ｅ操作を開始させる様にしたものであ
る。
ーム表示操作開始信号であるＶSYNCが時刻ｔ１、ｔ２と
言うタイミングで入力されている場合、従来では、該Ｖ
SYNCが入力された時点から該一括消去・書込みＷ／Ｅ期
間Ｓ１’を開始させ、仕様で規定された所定の時間ｔ’
を遅延させた時点ＳＴ’から表示データの送出を開始し
ているのに対して、本発明に於いては、図示の様に、隣
接するＶSYNC間の間隔Ｎから、例えば３を減算したＮ−
３の時点ＳＴに於いて、当該ＶSYNCに先立って当該一括
消去・書込みＷ／Ｅ操作を開始させる様にしたものであ
る。
【００４５】尚、本発明に於ける該一括消去・書込みＷ
／Ｅ操作期間Ｓ１’に於いて、全てのセルに対して同時
に書込みパルスＷＰを印加後、Ｙ電極に対して一括消去
パルスを印加するものであるが、係る一括消去パルスＥ
Ｐが、図示されている様に、急峻なダウンエッジパルス
形状を有せずに裾拡大状の鈍りパルスを使用している
が、これは、複数のセル部分には、消去動作速度にばら
つきが存在しているので、急峻なダウンエッジパルス形
状を有する一括消去パルスＥＰを使用すると、消去動作
が早いセルは、早く放電が終了してしまい、当該放電が
終了していないセル部分が、放電を完了しきれないで残
留してしまうおそれがあり、従って、完全な初期化を計
る事が不可能となるので、図示の様なダウンエッジパル
ス形状のパルスを利用するものである。
／Ｅ操作期間Ｓ１’に於いて、全てのセルに対して同時
に書込みパルスＷＰを印加後、Ｙ電極に対して一括消去
パルスを印加するものであるが、係る一括消去パルスＥ
Ｐが、図示されている様に、急峻なダウンエッジパルス
形状を有せずに裾拡大状の鈍りパルスを使用している
が、これは、複数のセル部分には、消去動作速度にばら
つきが存在しているので、急峻なダウンエッジパルス形
状を有する一括消去パルスＥＰを使用すると、消去動作
が早いセルは、早く放電が終了してしまい、当該放電が
終了していないセル部分が、放電を完了しきれないで残
留してしまうおそれがあり、従って、完全な初期化を計
る事が不可能となるので、図示の様なダウンエッジパル
ス形状のパルスを利用するものである。
【００４６】この様にして、本発明に於いては、前記し
た様な方法で、ＶSNEWを発生させた後は、従来と同様の
一括消去・書込みＷ／Ｅ操作期間Ｓ１’が実行され、そ
の後に、アドレス期間Ｓ２及び維持放電期間Ｓ３がそれ
ぞれのライン毎に実行される事になる。図３は、本発明
に係る平面表示装置に於いて使用される減算手段１０
２、１１２の一具体例の構成を示すブロックダイアグラ
ムであり、基本的には、ＯＲゲート回路の組み合わせに
より構成されている例を示してある。
た様な方法で、ＶSNEWを発生させた後は、従来と同様の
一括消去・書込みＷ／Ｅ操作期間Ｓ１’が実行され、そ
の後に、アドレス期間Ｓ２及び維持放電期間Ｓ３がそれ
ぞれのライン毎に実行される事になる。図３は、本発明
に係る平面表示装置に於いて使用される減算手段１０
２、１１２の一具体例の構成を示すブロックダイアグラ
ムであり、基本的には、ＯＲゲート回路の組み合わせに
より構成されている例を示してある。
【００４７】即ち、図３に於いて、ラッチカウンタ１１
０とラッチ回路１１１とを含む演算器１３１の入力端部
Ｄ０〜Ｄ７のそれぞれにカウント値Ｎ０からＮ７が入力
されると同時に、他の入力端部ＣＫＥＮ及びＣＬＫにそ
れぞれＶSYNCとＨSYNCが入力される様に設定されてい
る。一方、該演算器１３１の出力端部側には、ＡＮＤゲ
ート回路１３２、２端子入力ＯＲゲート回路１３３、１
３６、３端子ＯＲゲート回路１３４、１３７、４端子Ｏ
Ｒゲート回路１３５、エクスクルッシブＯＲゲート回路
１３８、エクスクルッシブＮＯＲゲート回路１３９〜１
４４、及びインバータ１４５とが、図示のような配線接
合関係を有して配置構成されたものであり、係る回路構
成によって、前記した様に、ＶSYNC間に於けるＨSYNC信
号の総発生回数Ｎから、所定のＨSYNC信号の発生回数分
例えば ３回分を減算するＮ−３の演算処理を実行する
回路が構成されている。
０とラッチ回路１１１とを含む演算器１３１の入力端部
Ｄ０〜Ｄ７のそれぞれにカウント値Ｎ０からＮ７が入力
されると同時に、他の入力端部ＣＫＥＮ及びＣＬＫにそ
れぞれＶSYNCとＨSYNCが入力される様に設定されてい
る。一方、該演算器１３１の出力端部側には、ＡＮＤゲ
ート回路１３２、２端子入力ＯＲゲート回路１３３、１
３６、３端子ＯＲゲート回路１３４、１３７、４端子Ｏ
Ｒゲート回路１３５、エクスクルッシブＯＲゲート回路
１３８、エクスクルッシブＮＯＲゲート回路１３９〜１
４４、及びインバータ１４５とが、図示のような配線接
合関係を有して配置構成されたものであり、係る回路構
成によって、前記した様に、ＶSYNC間に於けるＨSYNC信
号の総発生回数Ｎから、所定のＨSYNC信号の発生回数分
例えば ３回分を減算するＮ−３の演算処理を実行する
回路が構成されている。
【００４８】上記減算回路の出力Ｓ０からＳ７は、比較
手段１１３の入力に接続されているものである。図４
は、上記した減算回路を用いて構成された平面表示装置
の駆動制御回路の一例を示すブロックダイアグラムであ
る。即ち、図４は本発明の一実施例である、三電極型カ
ラーＰＤＰ装置のタイミング制御部を示したものであっ
て、図中、図１で示したものと同一のものは同一の記号
で示してある。
手段１１３の入力に接続されているものである。図４
は、上記した減算回路を用いて構成された平面表示装置
の駆動制御回路の一例を示すブロックダイアグラムであ
る。即ち、図４は本発明の一実施例である、三電極型カ
ラーＰＤＰ装置のタイミング制御部を示したものであっ
て、図中、図１で示したものと同一のものは同一の記号
で示してある。
【００４９】図中、４ａはホスト装置より入力される外
部信号であるＶsyncとＨsyncより内部駆動用のフレーム
制御信号ＶsNEWを生成する回路であり、当該回路の動作
は、前述した通りである。一方、４ｂはアドレスカウン
タ１４０で構成され、Ｈsyncの周期で波形ＲＯＭへアド
レスをする信号を生成する回路であり、基準となるXCLK
をクロックとするカウンタでアドレス数をカウントして
出力するものであり、当該カウント値は、ＨSYNC毎にク
リアされる様に構成される。
部信号であるＶsyncとＨsyncより内部駆動用のフレーム
制御信号ＶsNEWを生成する回路であり、当該回路の動作
は、前述した通りである。一方、４ｂはアドレスカウン
タ１４０で構成され、Ｈsyncの周期で波形ＲＯＭへアド
レスをする信号を生成する回路であり、基準となるXCLK
をクロックとするカウンタでアドレス数をカウントして
出力するものであり、当該カウント値は、ＨSYNC毎にク
リアされる様に構成される。
【００５０】つまり、該アドレスカウンタ１４０では、
ＨSYNCの範囲内で基本パルス数をカウントしてそのカウ
ント値に相当するアドレス信号ＡＤ００〜ＡＤ０８を出
力する。係るアドレス信号によって、１フレームを構成
する複数本のラインが順次に選択され、書込み操作が実
行される。
ＨSYNCの範囲内で基本パルス数をカウントしてそのカウ
ント値に相当するアドレス信号ＡＤ００〜ＡＤ０８を出
力する。係るアドレス信号によって、１フレームを構成
する複数本のラインが順次に選択され、書込み操作が実
行される。
【００５１】又、４ｃは、前記した回路４ａで生成され
た内部信号であるＶsNEWの周期で駆動波形のモードを制
御するためのアドレス信号を生成するラインカウンタ回
路１４１で、Ｈsyncの数を計数するカウンタと必要なタ
イミングをデコードするためのゲートにより構成され、
当該カウント値はＶsNEWでクリアされる。又、本制御回
路４ａには、更にモード切り換え回路１４２が設けられ
ており、当該ラインカウンタ１４１のカウント値に応じ
て、所定のモードに切り換える操作を行うものである。
た内部信号であるＶsNEWの周期で駆動波形のモードを制
御するためのアドレス信号を生成するラインカウンタ回
路１４１で、Ｈsyncの数を計数するカウンタと必要なタ
イミングをデコードするためのゲートにより構成され、
当該カウント値はＶsNEWでクリアされる。又、本制御回
路４ａには、更にモード切り換え回路１４２が設けられ
ており、当該ラインカウンタ１４１のカウント値に応じ
て、所定のモードに切り換える操作を行うものである。
【００５２】例えば、図示されている様に、当該モード
切り換え回路１４２には、当該ＨSY NCのカウント値Ｎが
３となった場合に、アドレス期間Ｓ２に入る様に指示す
る制御信号ＡＤ０９を出力させる様に構成されている。
即ち、本発明に於ける平面表示装置に於いては、該Ｖ
SNEWが内部的に発生されると直ちに一括書込み消去期間
Ｓ１’が開始され、当該ＨSYNCのカウント数が３と成っ
た場合に、アドレス期間Ｓ２に入る様に設定されてい
る。
切り換え回路１４２には、当該ＨSY NCのカウント値Ｎが
３となった場合に、アドレス期間Ｓ２に入る様に指示す
る制御信号ＡＤ０９を出力させる様に構成されている。
即ち、本発明に於ける平面表示装置に於いては、該Ｖ
SNEWが内部的に発生されると直ちに一括書込み消去期間
Ｓ１’が開始され、当該ＨSYNCのカウント数が３と成っ
た場合に、アドレス期間Ｓ２に入る様に設定されてい
る。
【００５３】更に、当該ＨSYNCのカウント値Ｎが１７８
となった場合に、アドレス期間Ｓ２を終了する事を指示
する制御信号ＡＤ１０を出力させる様に構成されてい
る。本具体例に於いては、１フレームを構成するライン
数を１７６に設定してあるが、先に一括書込み消去期間
Ｓ１’で３ＨSYNC分のパルスに相当する時間を使用する
のでアドレス操作終了時点は、１７９となる。
となった場合に、アドレス期間Ｓ２を終了する事を指示
する制御信号ＡＤ１０を出力させる様に構成されてい
る。本具体例に於いては、１フレームを構成するライン
数を１７６に設定してあるが、先に一括書込み消去期間
Ｓ１’で３ＨSYNC分のパルスに相当する時間を使用する
のでアドレス操作終了時点は、１７９となる。
【００５４】然しながら、本発明に係る平面表示装置に
於いては、ＨSYNCのカウント数が、例えばノイズによっ
て変動した場合に、未だ演算回路がアドレス期間Ｓ２の
処理を実行しているにも係わらず維持放電期間（サステ
イン期間）Ｓ３に入ってしまったり、逆に維持放電期間
Ｓ３に入っているのに、未だアドレス期間Ｓ２の演算を
実行していると言うような問題が発生していたが、本発
明に於ける該具体例に於いては、係る状況に於いて、そ
れぞれの演算処理に於いて誤動作の発生を防止する為、
当該ＨSYNCの数のカウントに際して、チエックポイント
を設け、例えば当該ＨSYNCのカウント数Ｎが１７９とな
った場合には、制御信号ＡＤ１１を出力して、次のカウ
ントに於いては、アドレス期間を延長することなく、必
ず維持放電期間Ｓ３に入る様なモード設定にしておく事
も望ましい。
於いては、ＨSYNCのカウント数が、例えばノイズによっ
て変動した場合に、未だ演算回路がアドレス期間Ｓ２の
処理を実行しているにも係わらず維持放電期間（サステ
イン期間）Ｓ３に入ってしまったり、逆に維持放電期間
Ｓ３に入っているのに、未だアドレス期間Ｓ２の演算を
実行していると言うような問題が発生していたが、本発
明に於ける該具体例に於いては、係る状況に於いて、そ
れぞれの演算処理に於いて誤動作の発生を防止する為、
当該ＨSYNCの数のカウントに際して、チエックポイント
を設け、例えば当該ＨSYNCのカウント数Ｎが１７９とな
った場合には、制御信号ＡＤ１１を出力して、次のカウ
ントに於いては、アドレス期間を延長することなく、必
ず維持放電期間Ｓ３に入る様なモード設定にしておく事
も望ましい。
【００５５】尚、本発明に於ける上記具体例に於いて
は、更に後述する様に、維持放電期間（サステイン期
間）Ｓ３に於ける維持放電回数を変化させて、画像表示
輝度を調整するモードを付加する事も出来る。次に、本
発明に於ける上記平面表示装置による動作タイミングを
図５に示す。ホスト装置より入力されるＶsyncから、例
えばプラズマディスプレイ装置ＰＤＰの様な平面表示装
置の初期化に必要な期間、例えば３Ｈsync分前のタイミ
ングで内部回路の制御信号ＶsNEWを作り、ここから駆動
が開始される。
は、更に後述する様に、維持放電期間（サステイン期
間）Ｓ３に於ける維持放電回数を変化させて、画像表示
輝度を調整するモードを付加する事も出来る。次に、本
発明に於ける上記平面表示装置による動作タイミングを
図５に示す。ホスト装置より入力されるＶsyncから、例
えばプラズマディスプレイ装置ＰＤＰの様な平面表示装
置の初期化に必要な期間、例えば３Ｈsync分前のタイミ
ングで内部回路の制御信号ＶsNEWを作り、ここから駆動
が開始される。
【００５６】そして、ＶsNEWが入ってからＨsyncを３つ
数えると初期化を終え、ホスト装置より入力される表示
データを順次各ラインの所定のセル部分に所定の状態を
書き込むために、ＲＯＭアドレス信号ＡＤ０９を“Ｈ”
として、アドレス期間の波形を格納している場所へアド
レスを飛ばし、書込みアドレス−１期間Ｓ１’−１とな
る。
数えると初期化を終え、ホスト装置より入力される表示
データを順次各ラインの所定のセル部分に所定の状態を
書き込むために、ＲＯＭアドレス信号ＡＤ０９を“Ｈ”
として、アドレス期間の波形を格納している場所へアド
レスを飛ばし、書込みアドレス−１期間Ｓ１’−１とな
る。
【００５７】本具体例では、表示ライン数が１７６本の
平面表示装置、例えばプラズマディスプレイ装置ＰＤＰ
を駆動するタイミングを与えており、従ってこのアドレ
ス期間は１７６回繰り返される。しかし、最後のアドレ
ス期間はＲＯＭへのアドレス信号が必要以上に多く入っ
てしまう可能性をなくすため、基準のクロックXCLKが多
く入ってもあるアドレスで停止するという機能をいれる
ため別のデータ格納場所へのアドレスを入れるようにし
ており、そのための信号がＡＤ１０となる。そして、ア
ドレス期間が終了する時点で次のサステイン期間に移行
するために、それまでアドレス電極とＹ電極に書き込ん
だデータをＸ，Ｙ電極間に移すため、Ｘ，Ｙ間でのサス
テインを行う。これが書込みアドレス−３の期間（Ｓ
１’−３）である。そして、全画面に書き込まれたデー
タを表示するため、ＡＤ１１をアドレスしてサステイン
期間の波形が格納される場所へアクセスしてサステイン
期間に移る。このサステイン期間は次のＶsNEWが入るま
で持続され、再び初期化の期間に戻る。
平面表示装置、例えばプラズマディスプレイ装置ＰＤＰ
を駆動するタイミングを与えており、従ってこのアドレ
ス期間は１７６回繰り返される。しかし、最後のアドレ
ス期間はＲＯＭへのアドレス信号が必要以上に多く入っ
てしまう可能性をなくすため、基準のクロックXCLKが多
く入ってもあるアドレスで停止するという機能をいれる
ため別のデータ格納場所へのアドレスを入れるようにし
ており、そのための信号がＡＤ１０となる。そして、ア
ドレス期間が終了する時点で次のサステイン期間に移行
するために、それまでアドレス電極とＹ電極に書き込ん
だデータをＸ，Ｙ電極間に移すため、Ｘ，Ｙ間でのサス
テインを行う。これが書込みアドレス−３の期間（Ｓ
１’−３）である。そして、全画面に書き込まれたデー
タを表示するため、ＡＤ１１をアドレスしてサステイン
期間の波形が格納される場所へアクセスしてサステイン
期間に移る。このサステイン期間は次のＶsNEWが入るま
で持続され、再び初期化の期間に戻る。
【００５８】次に、本発明に係る平面表示装置の他の具
体例（実施例２）に付いて図１１及び図１２を参照しな
がら説明する。即ち、本具体例は、基本的構成は、前記
した実施例１と同一であるが、更に、該維持放電期間
（サステイン期間）に於ける維持放電回数をライン毎或
いはフレーム毎に変化させる事によって、画面の表示輝
度を変化させる様にするモードを追加したものである。
体例（実施例２）に付いて図１１及び図１２を参照しな
がら説明する。即ち、本具体例は、基本的構成は、前記
した実施例１と同一であるが、更に、該維持放電期間
（サステイン期間）に於ける維持放電回数をライン毎或
いはフレーム毎に変化させる事によって、画面の表示輝
度を変化させる様にするモードを追加したものである。
【００５９】つまり、上述の実施例１において、維持放
電期間（サステイン期間）はアドレス書込み期間が終了
後、次のＶsNEWが入るまで繰り返されるが、このサステ
イン期間に行われるサステイン回数を制御することによ
りプラズマディスプレイ装置ＰＤＰ等の平面表示装置に
於ける表示画面の表示輝度を変えることができる。その
ために、輝度設定用の適宜のスイッチ等を更に設け、外
部よりスイッチの選択が出来るようにしておく。駆動波
形の最小単位はＨsyncで構成されるので、１Ｈsyncに行
なわれるサステインの回数を例えば４通り準備し、サス
テイン期間の中で４つの格納場所に格納しておき、これ
を外部設定される輝度スイッチに従って図１１に示す様
な２本のアドレス信号（例えばBD00,BD01 ）をＲＯＭア
ドレスに追加することによって、表示輝度を可変できる
階調変更可能な平面表示装置を実現することが可能であ
る。
電期間（サステイン期間）はアドレス書込み期間が終了
後、次のＶsNEWが入るまで繰り返されるが、このサステ
イン期間に行われるサステイン回数を制御することによ
りプラズマディスプレイ装置ＰＤＰ等の平面表示装置に
於ける表示画面の表示輝度を変えることができる。その
ために、輝度設定用の適宜のスイッチ等を更に設け、外
部よりスイッチの選択が出来るようにしておく。駆動波
形の最小単位はＨsyncで構成されるので、１Ｈsyncに行
なわれるサステインの回数を例えば４通り準備し、サス
テイン期間の中で４つの格納場所に格納しておき、これ
を外部設定される輝度スイッチに従って図１１に示す様
な２本のアドレス信号（例えばBD00,BD01 ）をＲＯＭア
ドレスに追加することによって、表示輝度を可変できる
階調変更可能な平面表示装置を実現することが可能であ
る。
【００６０】更に具体的に上記輝度変更方法に付いて説
明すると、各ライン、つまり１ＨSY NCに於ける維持放電
の回数を変更する指示データとして、図１０に例示する
様に異なる重み付け信号を有する４種の波形データＳＵ
Ｓ−１からＳＵＳ−４を用意しておき、適宜の選択信号
に基づいて、当該波形データＳＵＳ−１からＳＵＳ−４
の何れかを選択して当該維持放電操作を実行するもので
あり、その選択操作をアドレス信号ＢＤ００からＢＤ０
１の２ビット信号を組み合わせて４種の選択信号を作成
して選択するものである。
明すると、各ライン、つまり１ＨSY NCに於ける維持放電
の回数を変更する指示データとして、図１０に例示する
様に異なる重み付け信号を有する４種の波形データＳＵ
Ｓ−１からＳＵＳ−４を用意しておき、適宜の選択信号
に基づいて、当該波形データＳＵＳ−１からＳＵＳ−４
の何れかを選択して当該維持放電操作を実行するもので
あり、その選択操作をアドレス信号ＢＤ００からＢＤ０
１の２ビット信号を組み合わせて４種の選択信号を作成
して選択するものである。
【００６１】もっとも、該波形データの種類は４種に限
定されるものではなく、８種類にしても良く、またそれ
以上の種類に設定するもので有っても良い。上記例に於
ける該４種の波形データＳＵＳ−１からＳＵＳ−４のそ
れぞれに於ける当該維持放電回数を１：２：４：８とな
る様に設定したものであっても良く、又１ＨSYNC当たり
当該維持放電回数をＳＵＳ−１で５回、ＳＵＳ−２で４
回、ＳＵＳ−３で３回、ＳＵＳ−４で２回と言う様に設
定するもので有っても良い。
定されるものではなく、８種類にしても良く、またそれ
以上の種類に設定するもので有っても良い。上記例に於
ける該４種の波形データＳＵＳ−１からＳＵＳ−４のそ
れぞれに於ける当該維持放電回数を１：２：４：８とな
る様に設定したものであっても良く、又１ＨSYNC当たり
当該維持放電回数をＳＵＳ−１で５回、ＳＵＳ−２で４
回、ＳＵＳ−３で３回、ＳＵＳ−４で２回と言う様に設
定するもので有っても良い。
【００６２】この様に、選択される波形データＳＵＳに
従って個々に変化させる事により、当該平面表示装置に
表示される１フレームの輝度を変化させる事が可能とな
る。図１１は、上記の操作を実行する場合のＲＯＭに於
ける各制御信号の動きを説明する図であって、アドレス
信号ＡＤ００からＡＤ０８の各信号は、初期化領域とア
ドレス領域に供給されると同時に、維持放電期間に於い
ては、維持放電を行う為の交互パルスを発生させる信号
となる。
従って個々に変化させる事により、当該平面表示装置に
表示される１フレームの輝度を変化させる事が可能とな
る。図１１は、上記の操作を実行する場合のＲＯＭに於
ける各制御信号の動きを説明する図であって、アドレス
信号ＡＤ００からＡＤ０８の各信号は、初期化領域とア
ドレス領域に供給されると同時に、維持放電期間に於い
ては、維持放電を行う為の交互パルスを発生させる信号
となる。
【００６３】一方、アドレス信号ＡＤ０９〜ＡＤ１１
は、前記した様に、モード切り換えを実行する制御信号
であって、アドレス信号ＡＤ１１が、当該維持放電期間
を指示する事から、残りのアドレス信号ＡＤ０９とＡＤ
１０を利用して、前記した波形データＳＵＳ１〜ＳＵＳ
−４の何れかを選択する信号の供給に利用するものであ
る。
は、前記した様に、モード切り換えを実行する制御信号
であって、アドレス信号ＡＤ１１が、当該維持放電期間
を指示する事から、残りのアドレス信号ＡＤ０９とＡＤ
１０を利用して、前記した波形データＳＵＳ１〜ＳＵＳ
−４の何れかを選択する信号の供給に利用するものであ
る。
【００６４】具体的には、図１１に於けるスイッチ手段
１５０に於いて、外部信号であるＢＤ００〜ＢＤ０１の
信号を該アドレス信号ＡＤ０９とＡＤ１０と切り換えて
使用し、ＢＤ００／ＢＤ０１が、Ｌ／Ｌである場合に
は、該ＳＵＳ−１を選択し、ＢＤ００／ＢＤ０１が、Ｌ
／Ｈである場合には、該ＳＵＳ−２を選択し、ＢＤ００
／ＢＤ０１が、Ｈ／Ｌである場合には、該ＳＵＳ−３を
選択し、ＢＤ００／ＢＤ０１が、Ｈ／Ｈである場合に
は、該ＳＵＳ−４を選択すると言うようにアルゴリズム
を設定しておき、当該表示操作を実行する時点で、各ラ
イン毎、あるいは各フレーム毎に、当該波形データ選択
信号を指定して、表示させる事により、表示画面の輝度
を適宜変更させる事が可能となる。
１５０に於いて、外部信号であるＢＤ００〜ＢＤ０１の
信号を該アドレス信号ＡＤ０９とＡＤ１０と切り換えて
使用し、ＢＤ００／ＢＤ０１が、Ｌ／Ｌである場合に
は、該ＳＵＳ−１を選択し、ＢＤ００／ＢＤ０１が、Ｌ
／Ｈである場合には、該ＳＵＳ−２を選択し、ＢＤ００
／ＢＤ０１が、Ｈ／Ｌである場合には、該ＳＵＳ−３を
選択し、ＢＤ００／ＢＤ０１が、Ｈ／Ｈである場合に
は、該ＳＵＳ−４を選択すると言うようにアルゴリズム
を設定しておき、当該表示操作を実行する時点で、各ラ
イン毎、あるいは各フレーム毎に、当該波形データ選択
信号を指定して、表示させる事により、表示画面の輝度
を適宜変更させる事が可能となる。
【００６５】図１２は、上記で説明した外部信号である
ＢＤ００〜ＢＤ０１の信号と該アドレス信号ＡＤ０９と
ＡＤ１０とを切り換えて使用しする際に使用される切り
換え回路１５０の一具体例の構成を示すブロックダイア
グラムである。該切り換え手段１５０に於いては、ＡＮ
Ｄゲート回路１６１〜１６７、ＯＲゲート回路１６９〜
１７１が、図示の様な配線接続により配置構成されてお
り、入力端部のＤＡ０からＤＡ２はアドレス信号に相当
するものであり又ＤＢ０〜ＤＢ１は、外部信号ＢＤ００
とＢＤ０１にそれぞれ相当するものである。
ＢＤ００〜ＢＤ０１の信号と該アドレス信号ＡＤ０９と
ＡＤ１０とを切り換えて使用しする際に使用される切り
換え回路１５０の一具体例の構成を示すブロックダイア
グラムである。該切り換え手段１５０に於いては、ＡＮ
Ｄゲート回路１６１〜１６７、ＯＲゲート回路１６９〜
１７１が、図示の様な配線接続により配置構成されてお
り、入力端部のＤＡ０からＤＡ２はアドレス信号に相当
するものであり又ＤＢ０〜ＤＢ１は、外部信号ＢＤ００
とＢＤ０１にそれぞれ相当するものである。
【００６６】一方、出力端部のＡ０は、前記したＡＤ０
９に相当し、Ａ１はＡＤ１０に相当し、又Ａ２は前記し
たＡＤ１１に相当するものである。次に、本発明に於け
る平面表示装置の別の具体例を実施例３として図１３を
参照しながら以下に説明する。本発明に係る平面表示装
置に於いて、所定の画像を表示するに際して、図１３に
示す様に、当該平面表示装置を流れる電流は、初期化期
間Ｓ１’とアドレス期間Ｓ２に於いては、それ程大きな
電流は流れないので実用上特に問題とはならないが、維
持放電期間Ｓ３に入ると当該電流は急激に増大する事が
理解される。
９に相当し、Ａ１はＡＤ１０に相当し、又Ａ２は前記し
たＡＤ１１に相当するものである。次に、本発明に於け
る平面表示装置の別の具体例を実施例３として図１３を
参照しながら以下に説明する。本発明に係る平面表示装
置に於いて、所定の画像を表示するに際して、図１３に
示す様に、当該平面表示装置を流れる電流は、初期化期
間Ｓ１’とアドレス期間Ｓ２に於いては、それ程大きな
電流は流れないので実用上特に問題とはならないが、維
持放電期間Ｓ３に入ると当該電流は急激に増大する事が
理解される。
【００６７】従って、かかる電流をそのままにしておく
事は、消費電力を増加させる事になるため経済的とは言
えなくなる。その為、本具体例に於いては、係る平面表
示装置を流れる電流を適宜の電流検知手段を設けて検出
し、当該電流値が、予め定められた基準値を超えた場合
に、当該維持放電操作を中止させる様にするものであ
る。
事は、消費電力を増加させる事になるため経済的とは言
えなくなる。その為、本具体例に於いては、係る平面表
示装置を流れる電流を適宜の電流検知手段を設けて検出
し、当該電流値が、予め定められた基準値を超えた場合
に、当該維持放電操作を中止させる様にするものであ
る。
【００６８】即ち、本発明に係る平面表示装置の制御手
段の一部に表示用電源の電力を低減する自動電力制御回
路ＡＰＣ（＝Automatic Power Control ）を設けるもの
である。本具体例に於いて使用される電流検知手段は特
に限定されるものではなく、従来公知の電流検知手段が
使用可能である。
段の一部に表示用電源の電力を低減する自動電力制御回
路ＡＰＣ（＝Automatic Power Control ）を設けるもの
である。本具体例に於いて使用される電流検知手段は特
に限定されるものではなく、従来公知の電流検知手段が
使用可能である。
【００６９】要は、本具体例に於いて、当該電流検知手
段が、当該電流値が所定の基準値を超えたと判断した場
合には、図１３に示す様な維持放電操作禁止パルスを出
力させ、当該ラインに於ける維持放電操作を中断し、維
持放電による発光を停止させるものである。次に、本発
明に於ける平面表示装置の更に他の具体例を実施例４と
して以下に説明する。
段が、当該電流値が所定の基準値を超えたと判断した場
合には、図１３に示す様な維持放電操作禁止パルスを出
力させ、当該ラインに於ける維持放電操作を中断し、維
持放電による発光を停止させるものである。次に、本発
明に於ける平面表示装置の更に他の具体例を実施例４と
して以下に説明する。
【００７０】即ち、本発明に係る上記した平面表示装置
に於いて、基本的には、外部から入力されるＶSYNCとＨ
SYNCを検出し、当該ＶSYNCよりも、例えばＨSYNC信号３
個分だけ前倒し的に早めた時刻に一括書込み消去操作を
実行し、該ＶSYNCの入力直後に表示データが入力されて
も十分余裕を以て表示しえる様に構成したものである
が、本具体例に於いては、その技術思想を更に拡大する
もので有って、任意のホスト装置より入力される表示デ
ータ送出信号に応答して、当該入力信号から データ書
込み前に初期化の期間を自動的に設定することにより、
任意のホスト装置からの制御タイミングに対応した駆動
波形を生成する機能を有する様に構成したので有る。
に於いて、基本的には、外部から入力されるＶSYNCとＨ
SYNCを検出し、当該ＶSYNCよりも、例えばＨSYNC信号３
個分だけ前倒し的に早めた時刻に一括書込み消去操作を
実行し、該ＶSYNCの入力直後に表示データが入力されて
も十分余裕を以て表示しえる様に構成したものである
が、本具体例に於いては、その技術思想を更に拡大する
もので有って、任意のホスト装置より入力される表示デ
ータ送出信号に応答して、当該入力信号から データ書
込み前に初期化の期間を自動的に設定することにより、
任意のホスト装置からの制御タイミングに対応した駆動
波形を生成する機能を有する様に構成したので有る。
【００７１】つまり、上記の様にＶSYNCを基準として判
断する構成となってはいるが、該Ｖ SYNCが入力するタイ
ミイングは、ホスト装置により種々の異なっている。従
って、ホストの自由度を拡げる為に、此処からデータが
開始されると言う信号を別に貰って、その開始位置から
のＨSYNCの数をカウントすれば、その開始位置から、前
記したのと同様の方法で、前倒し的な所定の位置からア
ドレス操作を開始させる信号を作成する事が出来、それ
によって、特に何個目のＨSYNCから開始させると言う限
定をしなくても良くなると言う効果がある。
断する構成となってはいるが、該Ｖ SYNCが入力するタイ
ミイングは、ホスト装置により種々の異なっている。従
って、ホストの自由度を拡げる為に、此処からデータが
開始されると言う信号を別に貰って、その開始位置から
のＨSYNCの数をカウントすれば、その開始位置から、前
記したのと同様の方法で、前倒し的な所定の位置からア
ドレス操作を開始させる信号を作成する事が出来、それ
によって、特に何個目のＨSYNCから開始させると言う限
定をしなくても良くなると言う効果がある。
【００７２】例えば、ディスプレイタイミング信号等が
この具体例に於いて使用出来る。
この具体例に於いて使用出来る。
【００７３】
【発明の効果】以上説明した様に、本発明によればフレ
ーム開始の制御信号Ｖsyncを受けてすぐにデータ送出が
開始されるホスト装置に対しても、内部制御用のＶsNEW
を独自に生成し、他の回路を制御するため、一括書込み
・消去形の初期化操作を有し且つアドレス／維持放電分
離型・書込みアドレス方式による駆動が使用可能となる
効果を奏し、安定した表示品質を実現することが出来、
係る三電極型カラーＰＤＰ装置の性能向上に寄与すると
ころが大きい。
ーム開始の制御信号Ｖsyncを受けてすぐにデータ送出が
開始されるホスト装置に対しても、内部制御用のＶsNEW
を独自に生成し、他の回路を制御するため、一括書込み
・消去形の初期化操作を有し且つアドレス／維持放電分
離型・書込みアドレス方式による駆動が使用可能となる
効果を奏し、安定した表示品質を実現することが出来、
係る三電極型カラーＰＤＰ装置の性能向上に寄与すると
ころが大きい。
【００７４】又、本発明に於いては、外部より当該フレ
ーム開始の制御信号ＶSYNCを受けてから、再び外部より
次のフレーム開始制御信号ＶSYNCを受けるまでの間に、
当該平面表示装置内部で、積極的に当該フレーム開始制
御信号ＶSYNCに相当する、必要なフレーム制御信号Ｖ
sNEWを生成することにより、独自に初期化を行う期間を
設定することが出来ると同時に、当該フレーム制御信号
ＶsNEWを、当該フレーム開始制御信号ＶSYNCよりも前の
任意の時点に、設定する事が出来るので、当該フレーム
に於ける該初期化開始操作を従来に比べて早期に実行で
きるので、フレーム開始の信号を受けてすぐに１ライン
目のデータ信号が送られてくる様な場合でも、即時に安
定した表示品質の画像表示を行いうる平面表示装置を得
る事が出来ると共に、任意のホスト装置からでも画像入
力信号を受ける事が可能となる。
ーム開始の制御信号ＶSYNCを受けてから、再び外部より
次のフレーム開始制御信号ＶSYNCを受けるまでの間に、
当該平面表示装置内部で、積極的に当該フレーム開始制
御信号ＶSYNCに相当する、必要なフレーム制御信号Ｖ
sNEWを生成することにより、独自に初期化を行う期間を
設定することが出来ると同時に、当該フレーム制御信号
ＶsNEWを、当該フレーム開始制御信号ＶSYNCよりも前の
任意の時点に、設定する事が出来るので、当該フレーム
に於ける該初期化開始操作を従来に比べて早期に実行で
きるので、フレーム開始の信号を受けてすぐに１ライン
目のデータ信号が送られてくる様な場合でも、即時に安
定した表示品質の画像表示を行いうる平面表示装置を得
る事が出来ると共に、任意のホスト装置からでも画像入
力信号を受ける事が可能となる。
【図１】図１は、本発明に係る平面表示装置の制御手段
の構成例を説明するブロックダイアグラムであり、図１
（Ａ）は、該制御手段の原理を説明するブロックダイア
グラムであり、図１（Ｂ）は、図１（Ａ）の構成をより
具体的に説明するブロックダイアグラムである。
の構成例を説明するブロックダイアグラムであり、図１
（Ａ）は、該制御手段の原理を説明するブロックダイア
グラムであり、図１（Ｂ）は、図１（Ａ）の構成をより
具体的に説明するブロックダイアグラムである。
【図２】図２は、本発明に係る平面表示装置に於ける動
作タイミングを説明するタイミングチャートである。
作タイミングを説明するタイミングチャートである。
【図３】図３は、本発明に於ける減算回路の一具体例の
構成を説明するブロックダイアグラムである。
構成を説明するブロックダイアグラムである。
【図４】図４は、本発明に係る平面表示装置の一具体例
の構成を説明するブロックダイアグラムである。
の構成を説明するブロックダイアグラムである。
【図５】図５は、図４に於ける平面表示装置の駆動波形
を示すタイミングチャートである。
を示すタイミングチャートである。
【図６】図６（Ａ）は、平面表示装置の構成の一例を説
明する平面図であり、図６（Ｂ）は、平面表示装置のセ
ル部分の構成の一例を示す断面図である。
明する平面図であり、図６（Ｂ）は、平面表示装置のセ
ル部分の構成の一例を示す断面図である。
【図７】図７は、従来に於ける平面表示装置の駆動手段
の構成例を示すブロックダイアグラムである。
の構成例を示すブロックダイアグラムである。
【図８】図８は、従来の平面表示装置に於ける駆動タイ
ミングを示すタイミングチャートである。
ミングを示すタイミングチャートである。
【図９】図９は、従来の平面表示装置に於ける駆動タイ
ミングを示すタイミングチャートである。
ミングを示すタイミングチャートである。
【図１０】図１０は、本発明に係る平面表示装置に於い
て使用される波形データの一部構成例を示す図である。
て使用される波形データの一部構成例を示す図である。
【図１１】図１１は、本発明に係る平面表示装置の他の
具体例の駆動原理を説明する図である。
具体例の駆動原理を説明する図である。
【図１２】図１２は、図１１に於ける平面表示装置に於
いて使用されるデータ切り換え手段の構成例を説明する
ブロックダイアグラムである。
いて使用されるデータ切り換え手段の構成例を説明する
ブロックダイアグラムである。
【図１３】図１３は、本発明に係る平面表示装置の別の
具体例の駆動タイミングを説明するタイミングチャート
である。
具体例の駆動タイミングを説明するタイミングチャート
である。
【符号の説明】 １００…平面表示装置 １０１…ＶSYNC間隔測定手段 １０２…減算手段 １０３…初期化操作開始信号生成手段 １１０…ラインカウンタ １１１…ラッチ手段 １１２…減算手段 １１３…比較手段 １１４…ラッチ手段 Ｓ１、Ｓ１’…初期化操作期間 Ｓ２…アドレス操作期間 Ｓ３…維持放電操作期間
───────────────────────────────────────────────────── フロントページの続き (72)発明者 山本 晃 神奈川県川崎市中原区上小田中1015番地 富士通株式会社内 (58)調査した分野(Int.Cl.7，ＤＢ名) G09G 3/28 G09G 3/20
Claims (5)
- 【請求項１】 複数の表示セル部を備え、該複数の表示
セル部により表示される１つのフレームを複数のサブフ
レームに時間的に分割して表示するものであり、該分割
された各サブフレームは、表示画面の初期化を行う初期
化期間、表示を行うセル部の選択を実行するアドレス期
間及び、該選択されたセル部を所定の期間、放電発光さ
せる維持放電期間とを含んでなる平面表示装置であっ
て、 １フレームの表示開始信号（Ｖ SYNC ）の入力を検出し
て、当該初期化期間の初期化操作開始時点を、該表示開
始信号（Ｖ SYNC ）の入力時点より、予め定められた所定
の個数の水平同期信号（Ｈ SYNC ）分に相当する時間だ
け、早くなる様に調整する初期化操作開始時点制御手段
を有している事を特徴とする平面表示装置。 - 【請求項２】 当該初期化操作開始時点制御手段は、表
示開始信号（Ｖ SYNC ）の入力前に該初期化期間が終了す
るよう当該初期化期間の初期化操作開始時点を調整する
ものである事を特徴とする請求項１記載の平面表示装
置。 - 【請求項３】 当該初期化操作開始時点制御手段は、１
フレームの表示開始信号（Ｖ SYNC ）間隔を演算する手段
と、該１フレームの表示開始信号（Ｖ SYNC ）間隔から該
予め定められた所定の個数の水平同期信号（Ｈ SYNC ）に
相当する時間を減算する減算手段と、該１フレームの表
示開始信号（Ｖ SYNC ）発生時点から該減算手段により出
力される時間が経過した時点を、当該１フレームに於け
る初期化操作開始時点と決定する手段とを有している事
を特徴とする請求項１記載の平面表示装置。 - 【請求項４】 任意のホスト装置より入力される表示デ
ータ送出信号に応答して、当該入力信号からデータ書込
み前に初期化の期間を自動的に設定することにより、任
意のホスト装置からの制御タイミングに対応した駆動波
形を生成する機能を有する事を特徴とする請求項１記載
の平面表示装置。 - 【請求項５】 複数の表示セル部を備え、該複数の表示
セル部により表示される１つのフレームを複数のサブフ
レームに時間的に分割して表示するものであり、該分割
された各サブフレームは、表示画面の初期化を行う初期
化期間、表示を行うセル部の選択を実行するアドレス期
間及び、該選択されたセル部を所定の期間、放電発光さ
せる維持放電期間とを含んでなる平面表示装置の制御方
法であ って、 該初期化期間の初期化操作を、１フレームの表示開始信
号（Ｖ SYNC ）の入力時点より、予め定められた所定の個
数の水平同期信号（Ｈ SYNC ）分に相当する時間だけ早く
開始する事を特徴とする平面表示装置の制御方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29088193A JP3307486B2 (ja) | 1993-11-19 | 1993-11-19 | 平面表示装置及びその制御方法 |
| US08/624,054 US6023258A (en) | 1993-11-19 | 1996-03-29 | Flat display |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29088193A JP3307486B2 (ja) | 1993-11-19 | 1993-11-19 | 平面表示装置及びその制御方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07140927A JPH07140927A (ja) | 1995-06-02 |
| JP3307486B2 true JP3307486B2 (ja) | 2002-07-24 |
Family
ID=17761722
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29088193A Expired - Fee Related JP3307486B2 (ja) | 1993-11-19 | 1993-11-19 | 平面表示装置及びその制御方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US6023258A (ja) |
| JP (1) | JP3307486B2 (ja) |
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| Publication number | Priority date | Publication date | Assignee | Title |
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| SG64446A1 (en) * | 1996-10-08 | 1999-04-27 | Hitachi Ltd | Plasma display driving apparatus of plasma display panel and driving method thereof |
| US6426732B1 (en) * | 1997-05-30 | 2002-07-30 | Nec Corporation | Method of energizing plasma display panel |
| EP0893916B1 (en) | 1997-07-24 | 2004-04-07 | Matsushita Electric Industrial Co., Ltd. | Image display apparatus and image evaluation apparatus |
| TW408293B (en) * | 1997-09-29 | 2000-10-11 | Hitachi Ltd | Display device and driving method thereof |
| JPH11119747A (ja) * | 1997-10-20 | 1999-04-30 | Fujitsu Ltd | マトリクス型パネルの駆動回路及び駆動方法並びに液晶表示装置 |
| EP1018722A1 (en) * | 1998-04-13 | 2000-07-12 | Mitsubishi Denki Kabushiki Kaisha | Device and method for driving address electrode of surface discharge type plasma display panel |
| JP3420938B2 (ja) * | 1998-05-27 | 2003-06-30 | 富士通株式会社 | プラズマディスプレイパネル駆動方法および駆動装置 |
| JP3424587B2 (ja) * | 1998-06-18 | 2003-07-07 | 富士通株式会社 | プラズマディスプレイパネルの駆動方法 |
| KR100374100B1 (ko) * | 1998-09-11 | 2003-04-21 | 엘지전자 주식회사 | 플라즈마표시패널의구동방법 |
| JP3399853B2 (ja) * | 1998-09-30 | 2003-04-21 | 三菱電機株式会社 | 表示パネルの表示制御回路 |
| JP3399852B2 (ja) | 1998-09-30 | 2003-04-21 | 三菱電機株式会社 | 表示パネルの駆動回路 |
| JP3642689B2 (ja) * | 1998-12-08 | 2005-04-27 | 富士通株式会社 | プラズマディスプレイパネル装置 |
| JP3262093B2 (ja) * | 1999-01-12 | 2002-03-04 | 日本電気株式会社 | プラズマディスプレイパネルの維持パルス駆動方法及び駆動回路 |
| US6320326B1 (en) * | 1999-04-08 | 2001-11-20 | Matsushita Electric Industrial Co., Ltd. | AC plasma display apparatus |
| JP3459890B2 (ja) | 1999-09-22 | 2003-10-27 | Ｎｅｃ液晶テクノロジー株式会社 | 疑似中間処理回路の初期化方法 |
| CN1143255C (zh) | 2000-05-15 | 2004-03-24 | 三菱电机株式会社 | 显示面板的驱动方法 |
| JP2002215088A (ja) * | 2001-01-19 | 2002-07-31 | Fujitsu Hitachi Plasma Display Ltd | プラズマディスプレイ及びその駆動方法 |
| JP4689078B2 (ja) * | 2001-05-31 | 2011-05-25 | パナソニック株式会社 | プラズマディスプレイ装置 |
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