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JP2003255899A - 表示装置 - Google Patents

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JP2003255899A
JP2003255899A JP2002345019A JP2002345019A JP2003255899A JP 2003255899 A JP2003255899 A JP 2003255899A JP 2002345019 A JP2002345019 A JP 2002345019A JP 2002345019 A JP2002345019 A JP 2002345019A JP 2003255899 A JP2003255899 A JP 2003255899A
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transistor
circuit
signal
control signal
optical element
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Application number
JP2002345019A
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English (en)
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Hiroshi Tsuchiya
博 土屋
Yukihiro Noguchi
幸宏 野口
Shoichiro Matsumoto
昭一郎 松本
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Sanyo Electric Co Ltd
Original Assignee
Sanyo Electric Co Ltd
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Publication date
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Priority to KR1020020084951A priority patent/KR20030057441A/ko
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Abstract

(57)【要約】 【課題】 アクティブマトリックス型ディスプレイにお
いては、動きの速い動画を表示する際に映像物の一部が
尾を引くように映ったり、にじみが生じてしまうことも
あった。 【解決手段】 走査線ＳＬ１の信号がハイになるとトラ
ンジスタＴｒ１０がオンされ、トランジスタＴｒ１１の
ゲート電極に輝度データが設定され、ＯＬＥＤ１０が発
光する。制御信号線ＣＴＬ１の信号がハイになるとトラ
ンジスタＴｒ１２がオフされて、ＯＬＥＤ１０と電源供
給線Ｖｄｄの間が遮断されて消灯する。制御回路１００
は、制御信号線ＣＴＬ１の信号を出力する。この信号に
基づいてＯＬＥＤ１０のオンオフを制御することにより
間欠的な発光が実現される。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、表示装置に関す
る。本発明は特に、アクティブマトリックス型表示装置
の視認性を改善する技術に関する。
【０００２】
【従来の技術】ノート型パーソナルコンピュータや携帯
端末の普及が急激に進んでいる。現在、これらの表示装
置に主に使用されているのが液晶ディスプレイであり、
次世代平面表示パネルとして期待されているのが有機Ｅ
Ｌ（Electro Luminescence）ディスプレイである。これ
らディスプレイの表示方法として中心に位置するのがア
クティブマトリックス駆動方式である。この方式を用い
たディスプレイは、アクティブマトリックス型ディスプ
レイと呼ばれ、画素は縦横に多数配置されマトリックス
形状を示し、各画素にはスイッチ素子が配置される。映
像データはスイッチ素子によって走査ラインごとに順次
書き込まれる。
【０００３】有機ＥＬディスプレイの実用化設計は草創
期にあり、様々な画素回路が提案されている。そのよう
な回路の一例として、特開平１１−２１９１４６号公報
に開示されている画素回路について図１７をもとに簡単
に説明する。
【０００４】この回路は、２個のｎチャネルトランジス
タである第１、２のトランジスタＴｒ５０、Ｔｒ５１
と、光学素子であるＯＬＥＤ５０と、保持容量Ｃ５０
と、走査信号を送る走査線ＳＬ５０と、電源供給線Ｖｄ
ｄ５０と、輝度データを送るデータ線ＤＬ５０を備え
る。
【０００５】この回路の動作は、ＯＬＥＤ５０の輝度デ
ータの書込のために、走査線ＳＬ５０の走査信号がハイ
になり、第１のトランジスタＴｒ５０がオンとなり、デ
ータ線ＤＬ５０に流された輝度データが第２のトランジ
スタＴｒ５１および保持容量Ｃ５０に設定され、その輝
度データに応じた電流が流れてＯＬＥＤ５０が発光す
る。走査線ＳＬ５０の走査信号がローになると第１のト
ランジスタＴｒ５０がオフとなるが、第２のトランジス
タＴｒ５１のゲート電圧が維持され、設定された輝度デ
ータに応じて発光を継続する。
【０００６】
【発明が解決しようとする課題】ここで、アクティブマ
トリックス型ディスプレイにおいては、駆動素子に書き
込まれる輝度データが１フレーム分走査する間ずっと保
持されて光学素子の発光が持続するため、ＣＲＴ（Cath
ode Ray Tube）ディスプレイに見られるような光強度の
減衰が少ない分、動きの速い動画を表示する際に映像物
の一部が尾を引くように映ったり、にじみが生じてしま
うこともあった。
【０００７】本発明はこうした状況に鑑みなされたもの
であり、その目的は視認性が改善された新たな回路を提
案することにある。本発明の別の目的は、残像現象を低
減させる新たな回路を提案することにある。本発明のさ
らに別の目的は、光学素子ごとの特性の違いに応じて制
御される新たな回路を提案することにある。
【０００８】
【課題を解決するための手段】本発明のある実施の形態
は表示装置である。この装置は、電流駆動型の光学素子
と電源の間に遮断回路を設け、この遮断回路をその光学
素子に対する輝度データ設定タイミングとは別の独立し
たタイミングで制御することにより前記光学素子の間欠
的な発光を実現する。その遮断回路を光学素子への輝度
データ設定タイミングを制御する走査信号とは別の経路
で与えられる制御信号によって制御してもよい。
【０００９】「光学素子」として、有機発光ダイオード
（Organic Light Emitting Diode。以下、単に「ＯＬＥ
Ｄ」と表記する。）が想定できるがこれに限る趣旨では
ない。「輝度データ」は光学素子を駆動する駆動素子に
設定される輝度情報に関するデータであって、光学素子
が放つ光強度とは区別する。「光学素子に対する輝度デ
ータ設定タイミング」は、例えば走査信号によって動作
するスイッチ素子のオンオフで制御される。なお、「駆
動素子」や「スイッチ素子」として、金属酸化膜（ＭＯ
Ｓ：Metal Oxide Semiconductor ）トランジスタや薄膜
トランジスタ（ＴＦＴ：Thin Film Transistor）が想定
できるが、これに限る趣旨ではない。ここでいう「走査
信号」は、輝度データ設定タイミングを制御する信号を
想定するがこれに限る趣旨ではなく、例えばその信号線
から分岐する形で得られる信号であってもよい。走査信
号の信号線は画素ラインごとに個別に設けられる。
【００１０】本発明の別の実施の形態もまた表示装置で
ある。この装置は、電流駆動型の光学素子と電源の間を
遮断する遮断回路と、この遮断回路を制御する制御回路
と、を含み、その制御回路は、光学素子に対する輝度デ
ータ設定タイミングとは別の独立したタイミングで遮断
回路を制御することにより前記光学素子の間欠的な発光
を実現する。一画素を構成する光学素子は、複数の色と
の対応で複数設けられてもよい。「複数の色」は、例え
ばＲＧＢの３色であり、それぞれの発色を実現するため
に光学素子として異なる材料が用いられる。制御回路
は、複数の光学素子のそれぞれに対するオンとオフのデ
ューティー比を個別に設定してもよい。遮断回路は、駆
動素子と、その駆動素子に設定される輝度データの保持
状態を安定させる容量と、を含んでもよく、その容量を
介して輝度データの状態を変動させることによって光学
素子をオフ状態にしてもよい。
【００１１】なお、以上の構成要素の任意の組合せや組
み替えもまた、本発明の態様として有効である。
【００１２】
【発明の実施の形態】実施の形態においては、表示装置
としてアクティブマトリックス型有機ＥＬディスプレイ
を想定する。以下、視認性を改善させた新しい回路を提
案する。
【００１３】（第１実施形態）本実施形態においては、
光学素子と電源との間を遮断回路によって切り離して光
学素子を一時的に消灯することにより間欠的な発光を実
現する。アクティブマトリックス型表示装置において動
きの速い動画を表示させたときに映像が尾を引いたり、
にじみが生じたりする現象を改善するために、光学素子
の間欠的な発光が有効であることが「Requirements for
LCD to Gain High Moving Image Quality 〜 Improvem
ent of Quality Degraded by Hold-Type Display 〜」
（Taiichiro Kurita, AM-LCD2000）において紹介されて
いる。本実施形態の表示装置は間欠表示によって視認性
を改善する。
【００１４】図１は、本実施形態における表示装置の１
画素分の回路構成を示す。この画素は、スイッチ素子と
しての第１のトランジスタＴｒ１０、駆動素子としての
第２のトランジスタＴｒ１１、遮断回路としての第３の
トランジスタＴｒ１２、保持容量としてのコンデンサＣ
１０、および光学素子としてのＯＬＥＤ１０を含む。
【００１５】第１のトランジスタＴｒ１０は、ＯＬＥＤ
１０の輝度データ書込のタイミングを制御するスイッチ
として動作する。第２のトランジスタＴｒ１１は、ＯＬ
ＥＤ１０を駆動する素子として動作する。第３のトラン
ジスタＴｒ１２は、ＯＬＥＤ１０と電源供給線Ｖｄｄの
間を遮断するスイッチとして動作する。
【００１６】電源供給線Ｖｄｄは、ＯＬＥＤ１０を発光
させるための電圧を供給する。データ線ＤＬ１は、第２
のトランジスタＴｒ１１に設定すべき輝度データの信号
を流す。走査線ＳＬ１は、ＯＬＥＤ１０の輝度データ書
込のタイミングで第１のトランジスタＴｒ１０を活性化
させる走査信号を流す。制御信号線ＣＴＬ１は、ＯＬＥ
Ｄ１０を電源供給線Ｖｄｄから遮断するタイミングで第
３のトランジスタＴｒ１２を活性化させる制御信号を流
す。制御回路１００は、走査線ＳＬ１とは別の経路であ
る制御信号線ＣＴＬ１に制御信号を出力する。制御回路
１００の詳細な構成は後述する。
【００１７】第１〜３のトランジスタＴｒ１０、Ｔｒ１
１、Ｔｒ１２は、それぞれｎチャネルトランジスタであ
る。第１のトランジスタＴｒ１０は、ゲート電極が走査
線ＳＬ１に接続され、ドレイン電極（またはソース電
極）がデータ線ＤＬ１に接続され、ソース電極（または
ドレイン電極）が第２のトランジスタＴｒ１１のゲート
電極に接続される。コンデンサＣ１０は、一端が第１の
トランジスタＴｒ１０のソース電極（またはドレイン電
極）と第２のトランジスタＴｒ１１のゲート電極の間の
経路に接続され、他端が接地電位と同電位にされる。
【００１８】第２のトランジスタＴｒ１１のドレイン電
極は第３のトランジスタＴｒ１２のソース電極に接続さ
れ、第２のトランジスタＴｒ１１のソース電極はＯＬＥ
Ｄ１０のアノード電極に接続される。第３のトランジス
タＴｒ１２は、ゲート電極が制御信号線ＣＴＬ１に接続
され、ドレイン電極が電源供給線Ｖｄｄに接続される。
ＯＬＥＤ１０のカソード電極は接地電位と同電位にされ
る。
【００１９】以上の構成によってなされる動作手順を以
下説明する。まず、走査線ＳＬ１の走査信号がハイにな
ると第１のトランジスタＴｒ１０がオンになり、制御信
号線ＣＴＬ１の制御信号がハイにされて第３のトランジ
スタＴｒ１２がオンになると、第２のトランジスタＴｒ
１１のソース電極が電源供給線Ｖｄｄに導通する。デー
タ線ＤＬ１の電位と第２のトランジスタＴｒ１１のゲー
ト電位が同電位になり、データ線ＤＬ１に流れる輝度デ
ータが第２のトランジスタＴｒ１１のゲート電極に設定
される。これにより、第２のトランジスタＴｒ１１のゲ
ートソース電圧に応じた電流が電源供給線ＶｄｄとＯＬ
ＥＤ１０のアノード電極の間に流れ、その電流量に応じ
た光強度でＯＬＥＤ１０が発光する。
【００２０】走査線ＳＬ１の走査信号がローの状態とな
って第１のトランジスタＴｒ１０がオフになっても、そ
の輝度データが第１のトランジスタＴｒ１０のソース電
極（またはドレイン電極）と第２のトランジスタＴｒ１
１のゲート電極の間にフローティング状態で保持される
ので、その輝度データに応じたＯＬＥＤ１０の発光が維
持される。なお、コンデンサＣ１０は輝度データの保持
状態を安定させる。
【００２１】制御信号線ＣＴＬ１の制御信号がローにな
ると、第３のトランジスタＴｒ１２がオフになり、ＯＬ
ＥＤ１０と電源供給線Ｖｄｄの間が遮断される。したが
って、第２のトランジスタＴｒ１１のゲート電極に設定
された輝度データとは無関係に、ＯＬＥＤ１０は消灯す
る。次の走査タイミングにおいて走査線ＳＬ１の走査信
号および制御信号線ＣＴＬ１の制御信号がハイになるま
でＯＬＥＤ１０の消灯は持続する。
【００２２】図２は、制御回路の詳細な回路構成を示
す。制御回路１００は、制御信号をローからハイに切り
替えるタイミングを決定づけるためのスタート用否定論
理積回路およびスタート用シフトレジスタのセットと、
制御信号をハイからローに切り替えるタイミングを決定
づけるためのストップ用否定論理積回路およびストップ
用シフトレジスタのセットを、画素領域２００に含まれ
る画素のライン数に対応する数だけ有する。本実施形態
における画素ライン数は２４０であり、第１〜２４０の
スタート用否定論理積回路ＳＴＲＮＡＮＤ１〜ＳＴＲＮ
ＡＮＤ２４０と、第０〜２４０のスタート用シフトレジ
スタＳＴＲＳＲ０〜ＳＴＲＳＲ２４０と、第１〜２４０
のストップ用否定論理積回路ＳＴＰＮＡＮＤ１〜ＳＴＰ
ＮＡＮＤ２４０と、第０〜２４０のストップ用シフトレ
ジスタＳＴＰＳＲ０〜ＳＴＰＳＲ２４０が制御回路１０
０に含まれる。
【００２３】制御回路１００は、スタート用否定論理積
回路およびストップ用否定論理積回路からそれぞれ入力
される信号を利用して制御信号を生成して出力する第１
〜２４０のトグル回路Ｔ１〜Ｔ２４０をさらに含む。第
１〜２４０のトグル回路Ｔ１〜Ｔ２４０は、それぞれ第
１〜２４０の制御信号線ＣＴＬ１〜ＣＴＬ２４０に制御
信号を出力する。第０のスタート用シフトレジスタＳＴ
ＲＳＲ０にはスタート信号ＶＳＴＡＲＴが入力され、第
０のストップ用シフトレジスタにはストップ信号ＶＳＴ
ＯＰが入力される。各シフトレジスタには、クロック信
号ＣＫが入力される。
【００２４】以上の構成による制御回路１００の動作を
以下説明する。まず、スタート信号ＶＳＴＡＲＴおよび
ストップ信号ＶＳＴＯＰは、２４０クロックに１回の割
合でクロック２周期にわたってハイにされるものとす
る。スタート信号ＶＳＴＡＲＴがハイになった後、第０
のスタート用シフトレジスタＳＴＲＳＲ０から出力され
る信号はクロックのタイミングでハイになる。この信号
は第１のスタート用シフトレジスタＳＴＲＳＲ１および
第１のスタート用否定論理積回路ＳＴＲＮＡＮＤ１に入
力される。ハイの信号が入力された第１のスタート用シ
フトレジスタＳＴＲＳＲ１から出力される信号はクロッ
クのタイミングでハイになる。この信号は、第１、第２
のスタート用否定論理積回路ＳＴＲＮＡＮＤ１、２と、
第２のスタート用シフトレジスタＳＴＲＳＲ２に入力さ
れる。
【００２５】ここで、各シフトレジスタからの出力パル
スは２クロック分の周期を有するため、第１のスタート
用否定論理積回路ＳＴＲＮＡＮＤ１は、第１、第２のス
タート用シフトレジスタＳＴＲＳＲ１、２からの出力の
双方ともがハイになったときにローとなるようなパルス
を出力する。なお、他の形態として、スタート用否定論
理積回路の代わりに論理積回路を用いる構成としてもよ
い。さらに他の形態として、スタート用シフトレジスタ
からの出力パルスの周期が短ければ否定論理積回路およ
び論理積回路のいずれも用いずにスタート用シフトレジ
スタからの出力信号をそのままトグル回路に入力する構
成としてもよい。
【００２６】ストップ信号ＶＳＴＯＰがハイになった
後、第０のストップ用シフトレジスタＳＴＰＳＲ０から
出力される信号はクロックのタイミングでハイになる。
この信号は第１のストップ用シフトレジスタＳＴＰＳＲ
１および第１のストップ用否定論理積回路ＳＴＰＮＡＮ
Ｄ１に入力される。ハイの信号が入力された第１のスト
ップ用シフトレジスタＳＴＰＳＲ１から出力される信号
は次のクロックのタイミングでハイになる。この信号
は、第１、第２のストップ用否定論理積回路ＳＴＰＮＡ
ＮＤ１、２と、第２のストップ用シフトレジスタＳＴＰ
ＳＲ２に入力される。第１のストップ用否定論理積回路
ＳＴＰＮＡＮＤ１は、第１、第２のストップ用シフトレ
ジスタＳＴＰＳＲ１、２からの出力の双方ともがハイに
なったときにローとなるようなパルスを出力する。他の
形態においては、ストップ用否定論理積回路ＳＴＰＮＡ
ＮＤの代わりに論理積回路を用いる構成としてもよい。
さらに他の形態においては、ストップ用シフトレジスタ
からの出力パルスの周期が短ければ否定論理積回路およ
び論理積回路のいずれも用いずにストップ用シフトレジ
スタからの出力信号をそのままトグル回路に入力する構
成としてもよい。
【００２７】第１のトグル回路Ｔ１が出力する制御信号
は、第１のスタート用否定論理積回路ＳＴＲＮＡＮＤ１
から入力される信号がローになったときにハイに切り替
わり、その後、第１のストップ用否定論理積回路ＳＴＰ
ＮＡＮＤ１から入力される信号がローになったときにロ
ーに切り替わる。
【００２８】第２〜２４０のスタート用シフトレジスタ
ＳＴＲＳＲ２〜ＳＴＲＳＲ２４０は第１のシフトレジス
タと同様に動作する。第２〜２４０のスタート用否定論
理積回路ＳＴＲＮＡＮＤ２〜ＳＴＲＮＡＮＤ２４０は、
第１のスタート用否定論理積回路ＳＴＲＮＡＮＤ１と同
様に動作する。第２〜２４０のストップ用シフトレジス
タＳＴＰＳＲ２〜ＳＴＰＳＲ２４０は第１のストップ用
シフトレジスタＳＴＰＳＲ１と同様に動作する。第２〜
２４０のストップ用否定論理積回路ＳＴＰＮＡＮＤ２〜
ＳＴＰＮＡＮＤ２４０は、第１のストップ用否定論理積
回路ＳＴＲＮＡＮＤ１と同様に動作する。第２〜２４０
のトグル回路Ｔ２〜Ｔ２４０は、第１のトグル回路Ｔ１
と同様に動作する。以上の動作により、各画素ラインご
とに異なるタイミングでハイになる制御信号が第１〜２
４０の制御信号線ＣＴＬ１〜ＣＴＬ２４０に出力され
る。
【００２９】図３は、制御回路の動作を示すタイミング
チャートである。本図においては、スタート信号ＶＳＴ
ＡＲＴ、ストップ信号ＶＳＴＯＰ、制御信号線ＣＴＬ１
の制御信号、走査信号線ＳＬ１の走査信号の各状態と、
ＯＬＥＤ１０の発光状態を時間を横軸にしてハイとロー
で示す。なお、ＯＬＥＤ１０は輝度データに応じた度合
いで発光するが、図においてはその発光と消灯を単純に
ハイとローで示す。走査信号線ＳＬ１の走査信号の立ち
上がり間隔が１フレーム分の走査時間である。
【００３０】走査信号線ＳＬ１の走査信号がハイになる
と、第１のトランジスタＴｒ１０がオンになり、輝度デ
ータが第２のトランジスタＴｒ１１に設定される。スタ
ート信号ＶＳＴＡＲＴがハイになると、制御信号線ＣＴ
Ｌ１の制御信号もハイになり、第３のトランジスタＴｒ
１２がオンになる。ＯＬＥＤ１０は、電源供給線Ｖｄｄ
と導通して輝度データに応じた光強度で発光する。スト
ップ信号ＶＳＴＯＰがハイになると、制御信号線ＣＴＬ
１の制御信号はローになり、ＯＬＥＤ１０が消灯する。
走査信号線ＳＬ１の走査信号が次にハイになった後で、
さらにスタート信号ＶＳＴＡＲＴもまたハイになるまで
ＯＬＥＤ１０の消灯が維持される。
【００３１】本図に示される通り、スタート信号ＶＳＴ
ＡＲＴが立ち上がってからストップ信号ＶＳＴＯＰが立
ち上がるまでの期間、すなわち制御信号線ＣＴＬ１の制
御信号がハイになっている期間がＯＬＥＤ１０の発光期
間であり、ストップ信号ＶＳＴＯＰが立ち上がってから
スタート信号ＶＳＴＡＲＴが立ち上がるまでの期間、す
なわち制御信号線ＣＴＬ１の制御信号がローになってい
る期間がＯＬＥＤ１０の消灯期間となる。制御信号線Ｃ
ＴＬ１の制御信号は、輝度データ設定タイミングとは別
の独立したタイミングで制御され、ＯＬＥＤ１０の間欠
的な発光が実現される。
【００３２】以上の構成により、電流駆動型の光学素子
を用いたアクティブマトリックス表示装置で動画を表示
する際の映像が尾を引く現象やにじみが低減され、視認
性が改善される。また、光学素子への電荷残りが解消さ
れ、残像現象が低減される。
【００３３】（第２実施形態）本実施形態は、制御回路
１００が走査信号をさらに出力する点で第１実施形態と
異なる。以下、制御回路１００における第１実施形態と
の相違点を中心に説明する。
【００３４】図４は、本実施形態における制御回路の詳
細な構成を示す。第１〜２４０のスタート用否定論理積
回路ＳＴＲＮＡＮＤ１〜ＳＴＲＮＡＮＤ２４０は、第１
〜２４０のトグル回路Ｔ１〜Ｔ２４０へ出力する信号と
同じ信号を第１〜２４０の走査信号として第１〜２４０
の走査信号線ＳＬ１〜ＳＬ２４０へ出力する。この走査
信号は、第１の走査線ＳＬ１の走査信号は図示しない第
１のトランジスタＴｒ１０のゲート電極へ入力されて輝
度データ設定のためのオンオフ制御に利用される。同様
に、第２〜２４０の走査線ＳＬ２〜ＳＬ２４０の走査信
号は、それぞれ対応する他の画素ラインにおいて輝度デ
ータ設定のオンオフ制御に利用される。
【００３５】図５は、本実施形態における制御回路の動
作を示すタイミングチャートである。スタート信号ＶＳ
ＴＡＲＴがハイになるときに、第１の走査信号線ＳＬ１
の走査信号もハイになるととともに、第１の制御信号線
ＣＴＬ１の制御信号もハイになる。これにより、第１の
トランジスタＴｒ１０がオンになって第２のトランジス
タＴｒ１１に輝度データが設定され、さらに第３のトラ
ンジスタＴｒ１２がオンになり、ＯＬＥＤ１０が電源供
給線Ｖｄｄと導通し、輝度データに応じた光強度で発光
する。
【００３６】ストップ信号ＶＳＴＯＰがオンになって第
１の制御信号線ＣＴＬ１の制御信号がローになると、第
３のトランジスタＴｒ１２がオフになり、ＯＬＥＤ１０
が消灯する。第１の走査信号線ＳＬ１の走査信号とスタ
ート信号ＶＳＴＡＲＴがハイになるまでＯＬＥＤ１０の
消灯が維持される。
【００３７】（第３実施形態）図６は、本実施形態にお
ける表示装置の１画素分の回路構成を示す。本実施形態
は、第３のトランジスタＴｒ１２が第２のトランジスタ
Ｔｒ１１とＯＬＥＤ１０の間に位置する点で第１実施形
態と異なる。すなわち、第３のトランジスタＴｒ１２
は、ソース電極がＯＬＥＤのアノード電極に接続され、
ドレイン電極が第２のトランジスタＴｒ１１のソース電
極に接続される。第３のトランジスタＴｒ１２は、第１
実施形態と同様に、制御信号線ＣＴＬ１の制御信号がハ
イになったときにオンとなり、制御信号線ＣＴＬ１の制
御信号がローとなったときにオフになる。これらの動作
およびそのタイミングは第１実施形態と同様である。
【００３８】（第４実施形態）本実施形態は、ひとつの
画素ラインにつき３本の制御信号線を設けてそれぞれを
ＲＧＢ（赤、緑、青）の各画素に対応させた点で第１実
施形態と異なる。この構成によれば、Ｒ、Ｇ、Ｂでそれ
ぞれ個別のタイミングでＯＬＥＤと電源供給線を遮断で
きるので、ＯＬＥＤのオンとオフに関して個別のデュー
ティー比を設定できる。これにより、ＲＧＢの色バラン
スを調整できる。また、ＲＧＢのそれぞれに利用される
ＯＬＥＤの材料の相違に起因する劣化速度の相違にも対
応できる。
【００３９】図７は、本実施形態における表示装置の４
画素分の回路構成を示す。本図には、画素Ｐｉｘ１〜Ｐ
ｉｘ４の４画素分の回路が示される。画素Ｐｉｘ１、Ｐ
ｉｘ４が赤色に発光させる画素であり、画素Ｐｉｘ２が
緑色に発光させる画素であり、画素Ｐｉｘ３が青色に発
光させる画素である。第１〜４の電源供給線Ｖｄｄ１〜
Ｖｄｄ４は、それぞれ画素Ｐｉｘ１〜Ｐｉｘ４に電圧を
供給し、第１〜４のデータ線ＤＬ１〜ＤＬ４は、それぞ
れ画素Ｐｉｘ１〜Ｐｉｘ４に輝度データを入力する。第
１の走査線ＳＬ１は、画素Ｐｉｘ１〜Ｐｉｘ４に走査信
号を入力する。
【００４０】赤色制御信号線ＲＣＴＬ１は、画素Ｐｉｘ
１、Ｐｉｘ４に赤色制御信号を入力し、緑色制御信号線
ＧＣＴＬ１は、画素Ｐｉｘ２に緑色制御信号を入力し、
青色制御信号線ＢＣＴＬ１は、画素Ｐｉｘ３に青色制御
信号を入力する。画素Ｐｉｘ１に含まれる第１〜３のト
ランジスタＴｒ１０、Ｔｒ１１、Ｔｒ１２と、第１のコ
ンデンサＣ１０と、第１のＯＬＥＤ１０は、それぞれ第
１実施形態における同じ符号が付された構成と同様に機
能する。画素Ｐｉｘ２に含まれる第４〜６のトランジス
タＴｒ１３、Ｔｒ１４、Ｔｒ１５と、第２のコンデンサ
Ｃ１１と、第２のＯＬＥＤ１１は、それぞれ第１〜３の
トランジスタＴｒ１０、Ｔｒ１１、Ｔｒ１２、第１のコ
ンデンサＣ１０、第１のＯＬＥＤ１０に対応する同様の
構成である。
【００４１】画素Ｐｉｘ３に含まれる第７〜９のトラン
ジスタＴｒ１６、Ｔｒ１７、Ｔｒ１８と、第３のコンデ
ンサＣ１２と、第３のＯＬＥＤ１２もまた、それぞれ第
１〜３のトランジスタＴｒ１０、Ｔｒ１１、Ｔｒ１２、
第１のコンデンサＣ１０、第１のＯＬＥＤ１０に対応す
る同様の構成である。画素Ｐｉｘ４に含まれる第１０〜
１２のトランジスタＴｒ１９、Ｔｒ２０、Ｔｒ２１と、
第４のコンデンサＣ１２と、第４のＯＬＥＤ１３もま
た、それぞれ第１〜３のトランジスタＴｒ１０、Ｔｒ１
１、Ｔｒ１２、第１のコンデンサＣ１０、第１のＯＬＥ
Ｄ１０に対応する同様の構成である。
【００４２】制御回路１００は、赤色制御信号線ＲＣＴ
Ｌ１、緑色制御信号線ＧＣＴＬ１、青色制御信号線ＢＣ
ＴＬ１のそれぞれにおいて、赤色制御信号、緑色制御信
号、青色制御信号のそれぞれを個別のタイミングでハイ
にすることにより、画素Ｐｉｘ１とＰｉｘ４、画素Ｐｉ
ｘ２、画素Ｐｉｘ３をそれぞれ個別のタイミングで消灯
させる。
【００４３】図８は、本実施形態における制御回路の詳
細な構成を示す。本図の制御回路１００は、１本のスタ
ート信号と３本のストップ信号を利用してＲＧＢ別の制
御信号を出力する点で第１実施形態と異なる。制御回路
１００は、第０〜２４０のスタート用シフトレジスタＳ
ＴＲＳＲ０〜ＳＴＲＳＲ２４０と、第１〜２４０のスタ
ート用否定論理積回路ＳＴＲＮＡＮＤ１〜ＳＴＲＮＡＮ
Ｄ２４０と、第０〜２４０の赤色ストップ用シフトレジ
スタＳＴＰＲＳＲ０〜ＳＴＰＲＳＲ２４０と、第１〜２
４０の赤色ストップ用否定論理積回路ＳＴＰＲＮＡＮＤ
１〜ＳＴＰＲＮＡＮＤ２４０と、第０〜２４０の緑色ス
トップ用シフトレジスタＳＴＰＧＳＲ０〜ＳＴＰＧＳＲ
２４０と、第１〜２４０の緑色ストップ用否定論理積回
路ＳＴＰＧＮＡＮＤ１〜ＳＴＰＧＮＡＮＤ２４０と、第
０〜２４０の青色ストップ用シフトレジスタＳＴＰＢＳ
Ｒ０〜ＳＴＰＢＳＲ２４０と、第１〜２４０の青色スト
ップ用否定論理積回路ＳＴＰＢＮＡＮＤ１〜ＳＴＰＢＮ
ＡＮＤ２４０と、第１〜２４０の赤色用トグル回路ＲＴ
１〜ＲＴ２４０と、緑色用トグル回路ＧＴ１〜ＧＴ２４
０と、青色用トグル回路ＢＴ１〜ＢＴ２４０と、を含
む。
【００４４】第０のスタート用シフトレジスタＳＴＲＳ
Ｒ０にはスタート信号ＶＳＴＡＲＴが入力され、第０の
赤色ストップ用シフトレジスタＳＴＰＲＳＲ０には赤色
ストップ信号ＶＲＳＴＯＰが入力され、第０の緑色スト
ップ用シフトレジスタＳＴＰＧＳＲ０には緑色ストップ
信号ＶＧＳＴＯＰが入力され、第０の青色ストップ用シ
フトレジスタＳＴＰＢＳＲ０には青色ストップ信号ＶＢ
ＳＴＯＰが入力される。各シフトレジスタには、クロッ
ク信号ＣＫが入力される。スタート信号ＶＳＴＡＲＴ、
赤色ストップ信号ＶＲＳＴＯＰ、緑色ストップ信号ＶＧ
ＳＴＯＰ、および青色ストップ信号ＶＢＳＴＯＰは、そ
れぞれ個別のタイミングで２４０クロックに１回ハイに
される。
【００４５】以上の構成による制御回路１００の動作を
以下説明する。第０〜２４０のスタート用シフトレジス
タＳＴＲＳＲ０〜ＳＴＲＳＲ２４０と、第１〜２４０の
スタート用否定論理積回路ＳＴＲＮＡＮＤ１〜ＳＴＲＮ
ＡＮＤ２４０は、それぞれ第１実施形態において同じ符
号が付された構成と同様に動作する。すなわち、スター
ト信号ＶＳＴＡＲＴがハイになると、クロックのタイミ
ングで第１のスタート用否定論理積回路ＳＴＲＮＡＮＤ
１から出力される信号がローになり、次のクロックのタ
イミングで第２のスタート用否定論理積回路ＳＴＲＮＡ
ＮＤ２から出力される信号がローになり、これを第２４
０のスタート用否定論理積回路ＳＴＲＮＡＮＤ２４０ま
で順次続ける。
【００４６】第１のスタート用否定論理積回路ＳＴＲＮ
ＡＮＤ１が出力する信号は、第１の赤色用トグル回路Ｒ
Ｔ１、第１の緑色用トグル回路ＧＴ１、第１の青色用ト
グル回路ＢＴ１のそれぞれに入力される。同様に、第２
〜２４０のスタート用否定論理積回路ＳＴＲＮＡＮＤ２
〜ＳＴＲＮＡＮＤ２４０が出力する信号は、対応する第
２〜２４０の赤色用トグル回路ＲＴ２〜ＲＴ２４０、第
２〜２４０の緑色用トグル回路ＧＴ２〜ＧＴ２４０、第
２〜２４０の青色用トグル回路ＢＴ２〜ＢＴ２４０にそ
れぞれ入力される。
【００４７】第０〜２４０の赤色ストップ用シフトレジ
スタＳＴＰＲＳＲ０〜ＳＴＰＲＳＲ２４０と、第１〜２
４０の赤色ストップ用否定論理積回路ＳＴＰＲＮＡＮＤ
１〜ＳＴＰＲＮＡＮＤ２４０は、それぞれ第１実施形態
における第０〜２４０のストップ用シフトレジスタＳＴ
ＰＳＲ０〜ＳＴＰＳＲ２４０と、第１〜２４０のストッ
プ用否定論理積回路ＳＴＰＮＡＮＤ１〜ＳＴＰＮＡＮＤ
２４０と同様に動作する。すなわち、赤色ストップ信号
ＶＲＳＴＯＰがハイになると、クロックのタイミングで
第１の赤色ストップ用否定論理積回路ＳＴＰＲＮＡＮＤ
１から出力される信号がローになり、次のクロックのタ
イミングで第２の赤色ストップ用否定論理積回路ＳＴＰ
ＲＮＡＮＤ２から出力される信号がローになり、これを
第２４０の赤色ストップ用否定論理積回路ＳＴＰＲＮＡ
ＮＤ２４０まで順次続ける。
【００４８】第１〜２４０の赤色ストップ用否定論理積
回路ＳＴＰＲＮＡＮＤ１〜ＳＴＰＲＮＡＮＤ２４０が出
力する信号は、それぞれ第１〜２４０の赤色用トグル回
路ＲＴ１〜ＲＴ２４０に入力される。第１の赤色用トグ
ル回路ＲＴ１が出力する赤色制御信号は、第１のスター
ト用否定論理積回路ＳＴＲＮＡＮＤ１から入力される信
号がローになったときにハイに切り替わり、その後、第
１の赤色ストップ用否定論理積回路ＳＴＰＲＮＡＮＤ１
から入力される信号がローになったときにローに切り替
わる。すなわち、スタート信号ＶＳＴＡＲＴがハイにな
ったときに赤色制御信号もハイになり、その後、赤色ス
トップ信号ＶＲＳＴＯＰがハイになったときに赤色制御
信号はローになる。順次、第２〜２４０の赤色制御信号
もオンとオフが切り替えられる。第１〜２４０の赤色制
御信号は、それぞれ第１〜２４０の赤色制御信号線ＲＣ
ＴＬ１〜ＲＣＴＬ２４０に出力される。
【００４９】第０〜２４０の緑色ストップ用シフトレジ
スタＳＴＰＧＳＲ０〜ＳＴＰＧＳＲ２４０、第０〜２４
０の青色ストップ用シフトレジスタＳＴＰＢＳＲ０〜Ｓ
ＴＰＢＳＲ２４０は、それぞれ個別のタイミングにおい
て第０〜２４０の赤色ストップ用シフトレジスタＳＴＰ
ＲＳＲ０〜ＳＴＰＲＳＲ２４０と同様に動作する。第１
〜２４０の緑色ストップ用否定論理積回路ＳＴＰＧＮＡ
ＮＤ１〜ＳＴＰＧＮＡＮＤ２４０、第１〜２４０の青色
ストップ用否定論理積回路ＳＴＰＢＮＡＮＤ１〜ＳＴＰ
ＢＮＡＮＤ２４０は、それぞれ個別のタイミングにおい
て第１〜２４０の赤色ストップ用否定論理積回路ＳＴＰ
ＲＮＡＮＤ１〜ＳＴＰＲＮＡＮＤ２４０と同様に動作す
る。第１〜２４０の緑色用トグル回路ＧＴ１〜ＧＴ２４
０、第１〜２４０の青色用トグル回路ＢＴ１〜ＢＴ２４
０は、それぞれ個別のタイミングにおいて第１〜２４０
の赤色用トグル回路ＲＴ１〜ＲＴ２４０と同様に動作す
る。
【００５０】第１〜２４０の緑色用トグル回路ＧＴ１〜
ＧＴ２４０は、第１〜２４０の緑色制御信号線ＧＣＴＬ
１〜ＧＣＴＬ２４０にそれぞれ緑色制御信号を出力す
る。第１〜２４０の青色用トグル回路ＢＴ１〜ＢＴ２４
０は、第１〜２４０の青色制御信号線ＢＣＴＬ１〜ＢＣ
ＴＬ２４０にそれぞれ青色制御信号を出力する。
【００５１】第１の赤色制御信号、第１の緑色制御信
号、第１の青色制御信号は、それぞれスタート信号ＶＳ
ＴＡＲＴがハイになったときに同じタイミングでハイに
なるとともに、それぞれ赤色ストップ信号ＶＲＳＴＯ
Ｐ、緑色ストップ信号ＶＧＳＴＯＰ、青色ストップ信号
ＶＧＳＴＯＰが個別のタイミングでハイになったときに
ローになる。第２〜２４０の赤色制御信号、第２〜２４
０の緑色制御信号、第２〜２４０の青色制御信号もまた
同じタイミングでハイになり、個別のタイミングでロー
に切り替えられる。すなわち、ＲＧＢ別のデューティー
比に応じて制御信号のハイとローが切り替えられる。
【００５２】図９は、本実施形態における制御回路の動
作を示すタイムチャートである。ストップ信号がＲＧＢ
ごとに個別のタイミングでハイになり、制御信号がＲＧ
Ｂごとに個別のタイミングでハイとローが切り替わり、
有機発光ダイオードの発光期間と消灯期間がＲＧＢごと
に個別に設定される点で図３と異なる。
【００５３】スタート信号ＶＳＴＡＲＴがハイになる
と、赤色制御信号線ＲＣＴＬ１、緑色制御信号線ＧＣＴ
Ｌ１、青色制御信号線ＢＣＴＬ１の各制御信号がほぼ同
時にハイになり、赤色ＯＬＥＤ１０、緑色ＯＬＥＤ１
１、青色ＯＬＥＤ１２がそれぞれ発光する。緑色ストッ
プ信号ＶＧＳＴＯＰと青色ストップ信号ＶＢＳＴＯＰが
同じタイミングでハイになると、緑色制御信号線ＧＣＴ
Ｌ１と青色制御信号線ＢＣＴＬ１の各制御信号がほぼ同
時にローに切り替わり、緑色ＯＬＥＤ１１と青色ＯＬＥ
Ｄ１２が消灯する。赤色ストップ信号ＶＲＳＴＯＰがハ
イになると、赤色制御信号線ＲＣＴＬ１の制御信号がロ
ーに切り替わり、赤色ＯＬＥＤ１０が消灯する。
【００５４】（第５実施形態）本実施形態は、有機発光
ダイオードと電源供給線の間の遮断回路を、トランジス
タとコンデンサの組合せで構成する点で第１実施形態と
異なる。
【００５５】図１０は、本実施形態における表示装置の
１画素分の回路構成を示す。この画素には、スイッチ素
子としての第１のトランジスタＴｒ１０と、駆動素子と
しての第２のトランジスタＴｒ１１と、保持容量として
のコンデンサＣ１０と、光学素子としてのＯＬＥＤ１０
が含まれる。第１のトランジスタＴｒ１０はｎチャネル
トランジスタであり、第２のトランジスタＴｒ１１はＰ
チャネルトランジスタである。
【００５６】第１のトランジスタＴｒ１０は、ゲート電
極が走査線ＳＬ１に接続され、ソース電極（またはドレ
イン電極）がデータ線ＤＬ１に接続され、ドレイン電極
（またはソース電極）が第２のトランジスタＴｒ１１の
ゲート電極に接続される。第２のトランジスタＴｒ１１
は、ソース電極が電源供給線Ｖｄｄに接続され、ドレイ
ン電極がＯＬＥＤ１０のアノード電極に接続される。Ｏ
ＬＥＤ１０のカソード電極は接地電位と同電位にされ
る。コンデンサＣ１０は、一端が第１のトランジスタＴ
ｒ１０のドレイン電極（またはソース電極）と第２のト
ランジスタＴｒ１１のゲート電極の間の経路に接続さ
れ、他端が制御信号線ＣＴＬ１に接続される。
【００５７】走査線ＳＬ１の走査信号がハイになると第
１のトランジスタＴｒ１０がオンになり、データ線ＤＬ
１の電位と第２のトランジスタＴｒ１１のゲート電位が
同電位となり、データ線ＤＬ１に流れる輝度データが第
２のトランジスタＴｒ１１のゲート電極に設定される。
第２のトランジスタＴｒ１１のゲートソース電圧に応じ
た電流が電源供給線ＶｄｄからＯＬＥＤ１０へ流れるこ
とにより、輝度データに応じた光強度でＯＬＥＤ１０が
発光する。
【００５８】走査線ＳＬ１の走査信号がローになって第
１のトランジスタＴｒ１０がオフになっても、輝度デー
タが第２のトランジスタＴｒ１１のゲート電極に保持さ
れるのでＯＬＥＤ１０の発光状態が維持される。ここ
で、制御信号線ＣＴＬ１の制御信号がハイになると、第
１のトランジスタＴｒ１０のドレイン電極（またはソー
ス電極）と第２のトランジスタＴｒ１１のゲート電極の
間がフローティングしているので、第２のトランジスタ
Ｔｒ１１のゲート電位がコンデンサＣ１０を介してたた
き上げられる。その結果、第２のトランジスタＴｒ１１
のゲートソース電圧が小さくなることによりＯＬＥＤ１
０と電源供給線Ｖｄｄの間の経路が遮断される。すなわ
ち、コンデンサＣ１０と第２のトランジスタＴｒ１１と
が、遮断回路として機能してＯＬＥＤ１０を消灯させ
る。
【００５９】走査線ＳＬ１の走査信号と制御信号線ＣＴ
Ｌ１の制御信号を通じてＯＬＥＤの発光と消灯のタイミ
ングを制御でき、第１実施形態と同様にＯＬＥＤ１０の
間欠的な発光を実現できる。
【００６０】以上、本発明を実施の形態をもとに説明し
た。この実施の形態は例示であり、その各構成要素や各
処理プロセスの組合せにいろいろな変形例が可能なこ
と、またそうした変形例も本発明の範囲にあることは当
業者に理解されるところである。
【００６１】ゲート電極が走査線に接続されて輝度デー
タ書込のスイッチ素子として利用されるトランジスタＴ
ｒ１０、Ｔｒ１３、Ｔｒ１６、Ｔｒ１９は、それぞれを
複数のトランジスタの組合せで構成してもよく、それら
の能力に関して任意の組合せで構成してもよい。
【００６２】各実施形態において、第１〜１２のトラン
ジスタＴｒ１０、Ｔｒ１１、Ｔｒ１２、Ｔｒ１３、Ｔｒ
１４、Ｔｒ１５、Ｔｒ１６、Ｔｒ１７、Ｔｒ１８、Ｔｒ
１９、Ｔｒ２０、Ｔｒ２１は、それぞれｎチャネルトラ
ンジスタで構成していたが、これらのうち少なくとも一
つをｐチャネルトランジスタで構成してもよい。
【００６３】実施の形態では、ＯＬＥＤに対して順バイ
アスの電圧を印加していた。変形例においては、以下の
図１１〜図１６の通り、逆バイアスを印加する構成であ
ってもよい。
【００６４】図１１は、図１に示した画素回路に対して
バイパス回路を設けた構成を示す。第１３のトランジス
タＴｒ３０のソース電極をＯＬＥＤ１０のカソード電極
が接続される接地電位より低い負電位Ｖｅｅに接続す
る。同様に、図１２は、図６に示した画素回路に対して
バイパス回路を設けた構成を示す。第１３のトランジス
タＴｒ３０のソース電極をＯＬＥＤ１０のカソード電極
が接続される接地電位より低い負電位Ｖｅｅに接続す
る。これらの画素回路において、制御信号線ＣＴＬ１が
ローになると、第３のトランジスタＴｒ１２はオフとな
り、第１３のトランジスタＴｒ３０がオンとなる。この
ときＯＬＥＤ１０のアノード電極の電位は、負電位Ｖｅ
ｅと同電位になる。ＯＬＥＤ１０のカソード電極は接地
電位であり、アノード電極より高電位となっているた
め、ＯＬＥＤ１０は逆バイアスが印加された状態とな
る。
【００６５】このようにＯＬＥＤ１０を逆バイアス印加
状態とすることで、ＯＬＥＤ１０のアノード電極に残留
している電荷を引き抜き、残像現象を抑制できると同時
に、ＯＬＥＤ１０を構成する有機膜の特性回復を実施で
きる。一般的な課題として、ＯＬＥＤは、液晶を利用し
た光学素子などと比較して長期使用による有機膜の劣化
つまり輝度低下が顕著であるという課題がある。このよ
うに、ＯＬＥＤをその輝度データの更新期間に逆バイア
ス印加状態とすることで表示品位の低下を防ぎつつ有機
膜の劣化を回復できる。
【００６６】ここでは、第３、１３のトランジスタＴｒ
１２、Ｔｒ３０を走査線ＳＬ１とは別の制御信号線ＣＴ
Ｌ１によりオンオフ制御したがこれに限る趣旨ではな
く、走査線ＳＬ１によって第３、１３のトランジスタＴ
ｒ１２、Ｔｒ３０をオンオフ制御してもよい。
【００６７】一般にＯＬＥＤの積層構造は、図１３に示
すようにガラス基板３００などの絶縁基板上に、アノー
ド層３１０、正孔輸送層３２０、有機ＥＬ層３３０、カ
ソード層３４０が順に積層されている。ＯＬＥＤの積層
構造は、図１３に示した構造に限らず図１４に示すよう
に、ガラス基板３００などの絶縁基板上に、カソード層
３４０、有機ＥＬ層３３０、正孔輸送層３２０、アノー
ド層３１０が順に積層された構造であってもよい。ＯＬ
ＥＤの積層構造が図１３に示した構造である場合、ＯＬ
ＥＤのカソード電極が固定電位である接地電位に接続さ
れたが、図１４に示す構造である場合、ＯＬＥＤのアノ
ード電極が固定電位に接続される。このような積層構造
を有するＯＬＥＤに好適な画素回路を図１５および１６
に例示する。
【００６８】図１５は、図１１に示した画素回路に対し
て、ＯＬＥＤ１０のアノード電極とカソード電極を入れ
替え、アノード電極を正電位かつ固定電位である電源電
位Ｖｆｆに接続した構成を示す。また第１３のトランジ
スタＴｒ３０の負電位Ｖｅｅに接続されていた電極は、
電源電位Ｖｆｆより高い電位である正電位Ｖｇｇに接続
される。電源供給線Ｖｄｄに接続されていた第３のトラ
ンジスタＴｒ１２の電極は、接地電位となっている低電
位線Ｖｈｈに接続される。
【００６９】ＯＬＥＤ１０の発光期間には、電流は電源
電位Ｖｆｆから、ＯＬＥＤ１０、第２のトランジスタＴ
ｒ１１、第３のトランジスタＴｒ１２を経て接地電位で
ある低電位線Ｖｈｈに流れる。このとき、制御信号線Ｃ
ＴＬ１をローとすることで、第３のトランジスタＴｒ１
２をオン、第１３のトランジスタＴｒ３０をオフとす
る。ＯＬＥＤ１０の輝度データの更新期間に制御信号線
ＣＴＬ１をローとすると、第３のトランジスタＴｒ１２
はオフとなり、第１３のトランジスタＴｒ３０がオンと
なるので、ＯＬＥＤ１０のカソード電極の電位は、電源
電位Ｖｆｆより高電位である正電位Ｖｇｇとなり、ＯＬ
ＥＤ１０は逆バイアス印加状態となる。
【００７０】図１６は、図１２に示した画素回路に対し
て、ＯＬＥＤ１０のアノード電極とカソード電極を入れ
替え、アノード電極を固定電位である電源電位Ｖｆｆに
接続した構成を示す。図１２で第２のトランジスタＴｒ
１１が接続されていた正電位である電源供給線Ｖｄｄを
負電位である負電位線Ｖｉｉとする。また、第１３のト
ランジスタＴｒ３０の負電位Ｖｅｅに接続されていた電
極は、接地電位より高電位である正電位Ｖｇｇに接続さ
れる。ＯＬＥＤ１０の輝度データの更新期間に、制御信
号線ＣＴＬ１をハイとすると、第１３のトランジスタＴ
ｒ３０がオンとなり第３のトランジスタＴｒ１２がオフ
となる。このとき、ＯＬＥＤ１０のカソード電極の電位
はアノード電極の電位である電源電位Ｖｆｆより高い正
電位ＶｇｇとなるのでＯＬＥＤ１０は逆バイアス印加状
態となる。
【００７１】図１５、図１６で示した画素回路では、第
３、１３のトランジスタＴｒ１２、Ｔｒ３０を制御信号
線ＣＴＬ１によりオンオフ制御したがこれに限る趣旨で
はなく、走査線ＳＬ１によりオンオフ制御する構成とし
てもよい。その場合、第２のトランジスタＴｒ１１に輝
度データが設定されるときに、第３のトランジスタＴｒ
１２がオフかつ第１３のトランジスタＴｒ３０がオンと
なる型のトランジスタとすればよい。
【００７２】
【発明の効果】本発明によれば、電流駆動型の光学素子
を用いたアクティブマトリックス表示装置の視認性を改
善することができる。
【図面の簡単な説明】
【図１】 第１実施形態における表示装置の１画素分の
回路構成を示す図である。
【図２】 第１実施形態における制御回路の詳細な回路
構成を示す図である。
【図３】 第１実施形態における制御回路の動作を示す
タイミングチャートである。
【図４】 第２実施形態における制御回路の詳細な構成
を示す図である。
【図５】 第２実施形態における制御回路の動作を示す
タイミングチャートである。
【図６】 第３実施形態における表示装置の１画素分の
回路構成を示す図である。
【図７】 第４実施形態における表示装置の４画素分の
回路構成を示す図である。
【図８】 第４実施形態における制御回路の詳細な構成
を示す図である。
【図９】 第４実施形態における制御回路の動作を示す
タイムチャートである。
【図１０】 第５実施形態における表示装置の１画素分
の回路構成を示す図である。
【図１１】 図１に示した画素回路に対してバイパス回
路を設けた構成を示す図である。
【図１２】 図６に示した画素回路に対してバイパス回
路を設けた構成を示す図である。
【図１３】 一般的な有機発光ダイオードの積層構造を
示した図である。
【図１４】 一般的な有機発光ダイオードの積層構造と
は逆の積層構造を示した図である。
【図１５】 図１１に示した画素回路に対して、ＯＬＥ
Ｄのアノード電極とカソード電極を入れ替え、アノード
電極を正電位かつ固定電位である電源電位Ｖｆｆに接続
した構成を示す図である。
【図１６】 図１２に示した画素回路に対して、ＯＬＥ
Ｄのアノード電極とカソード電極を入れ替え、アノード
電極を固定電位である接地電位に接続した構成を示す図
である。
【図１７】 従来技術における表示装置の１画素分の回
路構成を示す図である。
【符号の説明】
Ｖｄｄ１〜Ｖｄｄ４ 電源供給線、 ＤＬ１〜ＤＬ４
データ線、 ＳＬ１〜ＳＬ２４０ 走査線、 ＣＴＬ１
〜ＣＴＬ２４０ 制御信号線、 ＯＬＥＤ１０〜ＯＬＥ
Ｄ１３ 有機発光ダイオード、 Ｔｒ１０〜Ｔｒ２１
トランジスタ、Ｃ１０〜Ｃ１３ コンデンサ、 １００
制御回路。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 松本 昭一郎 大阪府守口市京阪本通２丁目５番５号 三 洋電機株式会社内 Ｆターム(参考） 3K007 AB17 BA06 DB03 GA04 5C080 AA06 BB05 DD05 EE19 EE28 FF11 JJ02 JJ03 JJ04 JJ06

Claims (5)

    【特許請求の範囲】
  1. 【請求項１】 電流駆動型の光学素子と電源の間に遮断
    回路を設け、この遮断回路を前記光学素子に対する輝度
    データ設定タイミングとは別の独立したタイミングで制
    御することにより前記光学素子の間欠的な発光を実現す
    ることを特徴とする表示装置。
  2. 【請求項２】 前記遮断回路を前記光学素子への輝度デ
    ータ設定タイミングを制御する走査信号とは別の経路で
    与えられる制御信号によって制御することを特徴とする
    請求項１に記載の表示装置。
  3. 【請求項３】 電流駆動型の光学素子と電源の間を遮断
    する遮断回路と、この遮断回路を制御する制御回路と、
    を含み、 前記制御回路は、前記光学素子に対する輝度データ設定
    タイミングとは別の独立したタイミングで前記遮断回路
    を制御することにより前記光学素子の間欠的な発光を実
    現することを特徴とする表示装置。
  4. 【請求項４】 一画素を構成する光学素子は、複数の色
    との対応で複数設けられ、 前記制御回路は、前記複数の光学素子のそれぞれに対す
    るオンとオフのデューティー比を個別に設定することを
    特徴とする請求項３に記載の表示装置。
  5. 【請求項５】 前記遮断回路は、前記光学素子を駆動す
    る駆動素子と、その駆動素子に設定される輝度データの
    保持状態を安定させる容量と、を含むとともに、前記容
    量を介して前記輝度データの状態を変動させることによ
    って前記光学素子をオフ状態にすることを特徴とする請
    求項１から４のいずれかに記載の表示装置。
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