JPH0964099A - 半導体装置及びその実装構造 - Google Patents
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Abstract
とができる、放熱性が改善された半導体装置を提供す
る。 【解決手段】 基板10に搭載された半導体素子14の
一面側に設けられた接続端子16と、半導体素子14の
搭載面近傍の基板面に配設された外部接続端子とが、前
記基板面に形成された導体パターン12を介して接合さ
れ、且つ半導体素子14の接続端子16と導体パターン
12の一端との接続部が封止樹脂によって封止されて成
る半導体装置において、該半導体素子14の一面側に形
成された接続端子16と、前記基板面に形成された導体
パターン12の一端とがフリップチップボンディング方
式で接続され、且つ半導体素子14の他面側が封止樹脂
によって形成された樹脂封止層17から露出することを
特徴とする。
Description
実装構造に関し、更に詳細には、基板に搭載された半導
体素子の一面側に設けられた接続端子と、前記半導体素
子の搭載部近傍の基板面に配設された外部接続端子とを
連結する導体パターンが前記基板面に形成され、且つ半
導体素子の接続端子と導体パターンの一端との接続部が
封止樹脂によって封止されて成る半導体装置半導体装置
及びその実装構造に関する。
BTレジン等を用いたプリント回路基板を多層に積層し
て得られたパッケージ100に設けられたキャビティ内
に、銀ペーストや耐熱性樹脂等の接着剤を介して搭載さ
れた半導体素子102の接続端子と、半導体素子102
を搭載した多層プリント回路基板104の内部導体パタ
ーン105の一端とがワイヤ106でボンディングされ
て成るものである。更に、この内部導体パターン105
とパッケージ100に設けられたキャビティの開口部周
縁のプリント回路基板に形成された導体パターン108
とは、スルーホール107、107によって連通されて
おり、導体パターン108に形成された外部接続端子用
接続パッドには、外部接続端子としてのはんだボール1
10が装着されている。かかる半導体装置においては、
半導体素子102及びワイヤ106は、ポッティングさ
れた封止樹脂から成る封止樹脂層112によって封止さ
れ、外部接続端子用接続パッドを除く、キャビティの開
口部周縁の導体パターン108は、ソルダーレジスト1
14が塗布されて保護されている。この半導体装置のは
んだボール110と実装基板116の回路パターンに設
けられた接続パッド120とを当接し、はんだボールを
一括リフローして半導体装置を実装基板116に実装す
ると、実装基板116と半導体装置との間に空間118
が形成される。このため、半導体素子102で発生する
殆どの熱は、半導体素子102と直接接触しているパッ
ケージ100を介して放熱される。
体装置においては、半導体素子102から発生する熱を
効率よくパッケージ100の外部に放熱すべく、半導体
素子102の搭載部分(パッケージ100のキャビティ
底面)を銅板等の金属板で形成し、半導体素子102と
パッケージ100との伝熱特性を向上することがなされ
ている。しかしながら、図7に示す如く、半導体素子1
02がパッケージ100及び封止樹脂層112によって
覆われているため、半導体素子102のパッケージ10
0側の一面が伝熱に寄与するのみである。また、封止樹
脂層112の表面からの放熱性を向上し、半導体素子1
02の他面側(ワイヤボンディングされた面)からの放
熱性を向上すべく、放熱フィン等の放熱手段を封止樹脂
層112の表面に設けることは、半導体装置を実装した
ときに形成される空間118が極めて狭いため、不可能
である。唯、半導体装置においては、搭載した半導体素
子102の両面側から放熱することができれば、半導体
装置の放熱性を著しく向上することができる。そこで、
本発明の課題は、搭載した半導体素子の両面側から放熱
することができる半導体装置、及びその実装構造を提案
することにある。
を達成すべく検討を重ねた結果、基板に搭載された半導
体素子の一面側に形成された接続端子と、半導体素子の
搭載部近傍の基板面に形成された導体パターンの一端と
をフリップチップボンディング方式で接続することによ
って、搭載した半導体素子の他面側を樹脂封止層から露
出させることができ、半導体装置の放熱性を向上し得る
ことを見出し、本発明に到達した。すなわち、本発明
は、基板に搭載された半導体素子の一面側に設けられた
接続端子と、前記半導体素子の搭載部近傍の基板面に配
設された外部接続端子とが、前記基板面に形成された導
体パターンを介して接続され、且つ半導体素子の接続端
子と導体パターンの一端との接続部が封止樹脂によって
封止されて成る半導体装置において、該半導体素子の一
面側に設けられた接続端子と、前記基板面に形成された
導体パターンの一端とがフリップチップボンディング方
式で接続され、且つ半導体素子の他面側が封止樹脂によ
って形成された樹脂封止層から露出することを特徴とす
る半導体装置にある。また、本発明は、基板に搭載され
た半導体素子の一面側に設けられた接続端子と、前記半
導体素子の搭載部近傍の基板面に配設された外部接続端
子とが、前記基板面に形成された導体パターンを介して
接続され、且つ半導体素子の接続端子と導体パターンの
一端との接続部が封止樹脂によって封止されて成る半導
体装置が、実装基板に実装されて成る半導体装置の実装
構造において、該実装基板に実装された半導体装置が、
半導体素子の一面側に形成された接続端子と、前記基板
面に形成された導体パターンの一端とがフリップチップ
ボンディング方式で接続された半導体装置であって、前
記半導体装置の外部接続端子が実装基板の回路パターン
と接続されていると共に、前記封止樹脂によって形成さ
れた樹脂封止層から露出する半導体素子の他面側が実装
基板面に実質的に当接していることを特徴とする半導体
装置の実装構造でもある。
接続端子をはんだボールとすることによって、半導体装
置の実装を容易に行うことができる。また、基板とし
て、可撓性フィルムによって形成したフレキシブル配線
基板を使用し、一面側に半導体素子の搭載部を形成した
フレキシブル配線基板の他面側に、前記搭載部に相当す
る部分に空間部を形成した枠体を放熱体として被着する
することによって、半導体装置を実装基板面に実装した
とき、フレキシブル配線基板が変形可能であるため、外
部接続端子の長さ調整を緩和できる。この枠体を金属枠
体とすることによって、半導体装置の放熱性を更に向上
することができる。更に、半導体素子の他面側と実装基
板の基板面との間に、金属粉を混合した熱伝導性接着剤
層を形成することにより、半導体装置の熱放散性を向上
しつつ半導体素子を実装基板に固着できる。かかる半導
体素子の端面が当接する実装基板の領域にも、金属層を
設けることによって、半導体装置の放熱性を更に一層向
上できる。尚、本発明において、「実質的に当接」と
は、半導体素子の端面を実装基板面に固着すべく、半導
体素子の端面と実装基板面との間に接着剤層を介して当
接させてもよいことを意味する。
れた接続端子と、基板の一面側に形成された導体パター
ンの一端とをフリップチップボンディング方式で接続す
ることにより、半導体素子の他面側を封止樹脂層から露
出させることができる。このため、半導体素子で発生し
た熱は、半導体素子の一面側から基板側に放熱できると
共に、封止樹脂層から露出している半導体素子の他面側
からも放熱できる結果、半導体装置の放熱性を向上させ
ることができる。特に、半導体装置を実装基板に実装し
たとき、封止樹脂層から露出する半導体素子の他面側が
実装基板面に実質的に当接する場合には、半導体素子の
端面と実装基板面との間に空間部が形成される場合より
も、半導体装置の放熱性を向上できる。つまり、この場
合には、半導体装置の基板と、半導体装置の基板の面積
よりも大きく且つ熱容量も大である実装基板とを介して
放熱できるからである。
説明する。図1は、本発明の一実施態様を示す半導体装
置の縦断面図であり、放熱性に優れた窒化アルミニウム
成分を含むセラミック製等の基板10の一面側に形成さ
れた導体パターン12の一端と、半導体素子14の一面
側に設けられたはんだバンプ16とが、フリップチップ
ボンディング方式によって接続されている。はんだバン
プ16は、半導体素子14の接続端子である。また、導
体パターン12の他端に形成された外部接続端子用パッ
ドには、外部接続端子としてのはんだボール18、18
・・が配設されている。更に、導体パターン12の一端
と半導体素子14のはんだバンプ16との接合部は、ポ
ッティングされたアンダーフィル材(例えばエポキシ樹
脂)によって樹脂封止されている。図1の半導体装置で
は、半導体素子14の他面側及び導体パターン12の大
部分が、封止樹脂層としてのアンダーフィル材層17か
ら露出している。但し、導体パターン12の露出部分
は、外部端子用接続パッドを除き、ソルダーレジスト2
0が塗布されており、外部端子用接続パッドと半導体素
子14の他面側とが露出面となっている。かかる半導体
装置について、はんだボール18側から見た概略底面図
を図2に示す。図2は、外部端子用接続パッドを除いて
塗布したソルダーレジスト20の一部を切り欠いたもの
である。図2に示す様に、基板10に搭載された半導体
素子14のはんだバンプ16と一端が接続された導体パ
ターン12の他端側は、基板10の周縁方向に延出され
て導体パターン12の他端に形成された外部接続端子用
パッドには、はんだボール18が装着される。
基板に実装した際に、はんだボール18、18・・が実
装基板の回路パターンに接続され、且つ半導体素子14
の露出面が実装基板面に実質的に当接されるように、は
んだボール18、18・・が高さ調整されている。この
ため、図3に示す様に、はんだボール18、18・・を
実装基板22の回路パターンに設けられた接続パッド2
6に接続することによって、半導体装置を実装基板22
に実装すると、半導体素子14の露出面は実装基板面に
当接しつつ銅粉等の金属粉が混合された熱伝導性接着剤
層25によって固着される。このため、半導体素子14
で発生する熱は、はんだバンプ16を介して半導体装置
の基板10と、熱伝導性接着剤層25を介して実装基板
22とから放熱される。しかも、実装基板22は、通
常、複数の電子部品を搭載するため、半導体装置を構成
する基板10の面積に比較して大きく且つ熱容量も大き
いため、半導体装置の放熱性を、図7に示す従来の半導
体装置よりも向上できる。
22に実装する際には、半導体装置のはんだボール1
8、18・・の各々を、実装基板22の回路パターンに
形成された所定の接続パッド26に載置した後、一括し
てリフローする。この際に、半導体素子14が支柱の役
目をするため、はんだボール18、18・・の潰れ量を
一定とすることができる。この様に、はんだボール18
を一括してリフローする際に、半導体素子14の一面側
に形成されたはんだバンプ16がリフローされないよう
に、半導体素子14の接続端子としてのはんだバンプ1
6は、はんだボール18、18・・を形成するはんだよ
りも高融点のはんだによって形成する。尚、はんだバン
プ16に代えて金バンプ等の他の金属製バンプを用い、
導電性接着剤によって導体パターンの一端と接合しても
よい。
として、放熱性に優れた窒化アルミニウム成分を含むセ
ラミック製の基板を使用したが、放熱性に優れた基板と
しては、アルミニウム板の表面をアルマイト処理(陽極
酸化処理)させて絶縁皮膜を形成した後、導体パターン
をスパッタリングや蒸着によって形成した基板、或いは
銅板の表面を樹脂層で覆った後、導体パターンを形成し
た、いわゆるメタルコア基板を使用できる。これら基板
10は剛体であり、実質的に変形しないものであるた
め、はんだボール18、18・・の高さ調整を厳密に行
うことが必要である。この点、図4に示す様に、基板と
して、ポリイミドフィルム等の可撓性フィルムを用いた
フレキシブル配線基板30を使用することによって、外
部接続端子としてのはんだボール32の高さ調整におい
て、その厳密さの程度を緩和することができる。つま
り、図4に示す半導体装置は、フレキシブル基板30の
一面側に形成された導体パターン34の一端と、半導体
素子36のはんだバンプ38とがフリップチップボンデ
ィング方式で接続され、且つ導体パターン34の一端と
半導体素子36のはんだバンプ38との接続部を封止す
るアンダーフィル材層40から半導体素子36の他面側
が露出しているものである。この半導体装置において
も、アンダーフィル材層40から露出する導体パターン
34の露出部には、外部端子用接続パッドを除き、ソル
ダーレジスト42が塗布されて保護されている。
には、金属製、セラミック製、或いは樹脂製(好ましく
は金属製)の剛体から成る、放熱体としての枠体44が
被着されている。この枠体44は、フレキシブル配線基
板30の他面側において、その枠部分45がはんだボー
ル32、32・・(外部接続端子)を覆う位置にあり、
且つ空間部46も半導体素子36の搭載部に相当する位
置に在る。このため、半導体装置の実装基板への実装
を、枠体44を押圧することによって行うことができ
る。すなわち、実装基板の所定位置に載置された半導体
装置の枠体44を押圧することによって、はんだボール
32、32・・を実装基板の回路パターンに形成された
所定の接続パッドに接合できるからである。しかも、こ
の際に、枠体44の押圧力によってフレキシブル配線基
板30の一面側に搭載された半導体素子36の露出面
が、実装基板の基板面に当接してフレキシブル配線基板
30の他面側方向への押圧力を受け、フレキシブル配線
基板30の搭載部が湾曲されても、半導体素子36の一
部と共に枠体44の空間部46内に逃げ込むことができ
る。
ール32、32・・の高さが、フレキシブル配線基板3
0の一面側に搭載された半導体素子36よりも低くなっ
ても半導体素子36の露出面を実装基板面に当接させる
ことができる。つまり、図4に示す様に、はんだボール
32、32・・の高さが、フレキシブル配線基板30の
一面側に搭載された半導体素子36よりも低い半導体装
置を実装基板に実装すると、図5に示す様に、実装基板
22の基板面に露出面が当接した半導体素子36がフレ
キシブル配線基板30の他面側方向に押される。この押
圧力によって、フレキシブル回路基板30の搭載部が湾
曲され、半導体素子36の一部と共に枠体44の空間部
46内に逃げ込むことができる。この様に、図4の半導
体装置は、枠体44によってフレキシブル回路基板30
を変形可能とすることができるため、はんだボール3
2、32・・の高さ調整を、図1〜図3に示す半導体装
置に比較して緩和できるのである。尚、図4の半導体装
置の半導体素子36の端面も、銅粉等の金属粉が混合さ
れた熱伝導性接着剤層25を介して実装基板面に固着さ
れている。
装基板22に実装したとき、アンダーフィル材層17か
ら露出する半導体素子14の他面側が実装基板22に当
接しているが、図6に示す様に、半導体素子14の他面
側が実装基板22に当接しなくても、図7に示す半導体
装置の実装構造よりも半導体装置の放熱性を向上するこ
とができる。半導体素子14の他面側がアンダーフィル
材層17から露出しているため、半導体素子14で発生
した熱は、アンダーフィル材層17から露出する半導体
素子14の露出面から放熱されると共に、はんだバンプ
16を介して半導体装置の基板10にも放熱されるため
である。尚、半導体素子14の露出面からの放熱性を向
上すべく、半導体素子14の露出面側に冷却風を流すこ
とも好ましい。
基板22からの放熱性を向上するためには、図3及び図
5に示す様に、半導体素子14又は半導体素子36の端
面が当接する実装基板22の領域に、銅箔や銅板等の金
属層24を設けることが好ましい。また、図3及び図5
に示す実施態様においては、半導体装置の半導体素子を
実装基板面に熱伝導性接着剤層25を介して実装基板面
に固着しているが、熱伝導性接着剤層25を介すること
なく直接接触させてもよいことは勿論である。更に、外
部接続用端子としてのはんだボールも、中心部の銅ボー
ル等の導電性剛体にはんだ等の低融点金属めっきが施さ
れたものであってもよく、長さ調整されたピンを用いる
こともできる。
た半導体素子で発生した熱を、半導体素子の基板側面と
実装基板側面とから放熱でき、実質的に半導体素子の基
板側面のみから放熱していた従来の半導体装置に比較し
て、半導体装置の放熱性を向上できる。
面図である。
らの概略底面図である。
態を説明するための断面図である。
断面図である。
態を説明するための断面図である。
断面図である。
ある。
Claims (10)
- 【請求項1】 基板に搭載された半導体素子の一面側に
設けられた接続端子と、前記半導体素子の搭載部近傍の
基板面に配設された外部接続端子とが、前記基板面に形
成された導体パターンを介して接続され、 且つ半導体素子の接続端子と導体パターンの一端との接
続部が封止樹脂によって封止されて成る半導体装置にお
いて、 該半導体素子の一面側に設けられた接続端子と、前記基
板面に形成された導体パターンの一端とがフリップチッ
プボンディング方式で接続され、 且つ半導体素子の他面側が封止樹脂によって形成された
樹脂封止層から露出することを特徴とする半導体装置。 - 【請求項2】 外部接続端子が、はんだボールである請
求項1記載の半導体装置。 - 【請求項3】 外部接続端子が、外部接続端子を実装基
板の回路に接続して半導体装置を実装した際に、半導体
素子の露出面が実装基板面に実質的に当接するように、
高さ調整されている請求項1又は請求項2記載の半導体
装置。 - 【請求項4】 基板が可撓性フィルムによって形成され
たフレキシブル配線基板であって、一面側に半導体素子
の搭載部が形成されたフレキシブル配線基板の他面側
に、前記搭載部に相当する部分に空間部が形成された枠
体が放熱体として被着されている請求項1〜3のいずれ
か一項記載の半導体装置。 - 【請求項5】 枠体が金属枠体である請求項請求項1〜
4のいずれか一項記載の半導体装置。 - 【請求項6】 基板に搭載された半導体素子の一面側に
設けられた接続端子と、前記半導体素子の搭載部近傍の
基板面に配設された外部接続端子とが、前記基板面に形
成された導体パターンを介して接続され、 且つ半導体素子の接続端子と導体パターンの一端との接
続部が封止樹脂によって封止されて成る半導体装置が、
実装基板に実装された半導体装置の実装構造において、 該実装基板に実装された半導体装置が、半導体素子の一
面側に形成された接続端子と、前記基板面に形成された
導体パターンの一端とがフリップチップボンディング方
式で接続された半導体装置であって、 前記半導体装置の外部接続端子が実装基板の回路パター
ンと接続されていると共に、前記封止樹脂によって形成
された封止樹脂層から露出する半導体素子の他面側が実
装基板面に実質的に当接していることを特徴とする半導
体装置の実装構造。 - 【請求項7】 外部接続端子が、はんだボールである請
求項6記載の半導体装置の実装構造。 - 【請求項8】 基板が可撓性フィルムによって形成され
たフレキシブル配線基板であって、一面側に半導体素子
の搭載部が形成されたフレキシブル配線基板の他面側
に、前記搭載部に相当する部分に空間部が形成された枠
体が放熱体として被着された半導体装置が使用されてい
る請求項6又は請求項7記載の半導体装置の実装構造。 - 【請求項9】 半導体素子の他面側と実装基板の基板面
との間に、金属粉が混合された熱伝導性接着剤層が形成
されている請求項6〜8のいずれか一項記載の半導体装
置の実装構造。 - 【請求項10】 半導体素子の他面側が当接する実装基
板の領域に、金属層が設けられている請求項6〜9のい
ずれか一項記載の半導体装置の実装構造。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21446695A JP3549294B2 (ja) | 1995-08-23 | 1995-08-23 | 半導体装置及びその実装構造 |
US08/698,624 US5777386A (en) | 1995-08-23 | 1996-08-16 | Semiconductor device and mount structure thereof |
KR1019960034225A KR100231589B1 (ko) | 1995-08-23 | 1996-08-19 | 반도체장치 및 그 실장구조 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21446695A JP3549294B2 (ja) | 1995-08-23 | 1995-08-23 | 半導体装置及びその実装構造 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0964099A true JPH0964099A (ja) | 1997-03-07 |
JP3549294B2 JP3549294B2 (ja) | 2004-08-04 |
Family
ID=16656195
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP21446695A Expired - Fee Related JP3549294B2 (ja) | 1995-08-23 | 1995-08-23 | 半導体装置及びその実装構造 |
Country Status (3)
Country | Link |
---|---|
US (1) | US5777386A (ja) |
JP (1) | JP3549294B2 (ja) |
KR (1) | KR100231589B1 (ja) |
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JP3549294B2 (ja) | 2004-08-04 |
KR100231589B1 (ko) | 1999-11-15 |
KR970013239A (ko) | 1997-03-29 |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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