JP2001210761A - 半導体装置及びその製造方法 - Google Patents
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Abstract
すると共に、小型化(薄型化)及び軽量化を図ることを
目的とする。 【解決手段】 配線基板11の一方の面に形成された配
線パターン13に、その電極端子15が電気的に接続さ
れるように半導体素子14を実装し、さらに半導体素子
14を覆うようにシート状の放熱板18を所要形状に成
形して配線基板11の一方の面に接着し、配線基板11
を貫通して配線パターン13に電気的に接続されるよう
に配線基板11の他方の面に外部接続端子19を設け、
シート状の放熱板18を、補強材として炭素繊維を含む
耐熱性を有する樹脂体により構成する。
Description
の製造方法に係り、より詳細には、BGA(ボール・グ
リッド・アレイ)やPGA(ピン・グリッド・アレイ)
等のパッケージ構造を有し、且つ放熱手段を備えた半導
体装置において、その小型化及び軽量化を行うのに有用
な技術に関する。
される半導体素子(LSIチップ)の高性能化に伴い高
速動作が要求されているが、その一方で、高速になれば
なるほど回路動作時の発熱量が増大し、動作信頼性の低
下をきたすといった不都合がある。
体装置では、半導体チップから発生される熱をパッケー
ジ外部に逃すための放熱手段を備えている。図1にその
例が示される。図1は、樹脂(プラスチック)の配線基
板に外部接続端子として金属のバンプを設けたプラスチ
ックBGA(パッケージ)に半導体チップを搭載した半
導体装置の構造を模式的に示したものであり、(a)は
現在既に量産されているタイプの、性能がそれほど高く
ない半導体チップを搭載した例、(b)は(a)よりも
高速で消費電力が大きな半導体チップを搭載した例、
(c)は更に性能が高い半導体チップを搭載した例をそ
れぞれ示している。
方の面に、半導体チップ2の電極端子が設けられている
側と反対側の面が接着されるようにして半導体チップ2
が搭載され、配線基板1上に適宜形成された配線パター
ンに、半導体チップ2の電極端子がボンディングワイヤ
3を介して電気的に接続されており、さらに半導体チッ
プ2及びボンディングワイヤ3を覆うように封止樹脂4
で封止されている。配線基板1の他方の面には、半導体
チップ2の外部接続端子として供されるはんだバンプ5
と共に、半導体チップ2から発生される熱を放熱する端
子として供されるはんだバンプ6が設けられている。放
熱用端子(はんだバンプ6)は、配線基板1を貫通して
半導体チップ2に熱的につながっている。外部接続端子
(はんだバンプ5)についても同様に、特に図示はして
いないが、配線基板1を貫通して配線基板1上の配線パ
ターンに電気的に接続されている。
面に配線パターンを形成して2層配線構造とすることが
可能であるが、更に高速動作を必要とする半導体チップ
を搭載するには2層配線だけでは不十分である。図1
(b)に示す例では、かかる高速動作に適応させるため
に、配線基板1aを4層配線構造とし、半導体チップ2
aにおける回路動作時のスイッチング雑音の抑制や熱抵
抗の低減を図っている。この構成例においても、半導体
チップ2aから発生される熱を放熱する手段として放熱
用端子(はんだバンプ6)が設けられている。
対応するために、配線基板1bを6層配線構造とし、こ
の配線基板1bの中央部に形成されたキャビティ内に配
置される半導体チップ2bの裏面(半導体チップ2bの
電極端子が設けられている側と反対側の面)に、高伝熱
性を有する銅(Cu)やアルミニウム(Al)等の金属
板のヒートスプレッダ7を接合して熱抵抗の更なる低減
を図り、さらにヒートスプレッダ7に金属やセラミック
等からなるヒートシンク8を取り付けて放熱効果を高め
ている。なお、ヒートスプレッダ7に接合された半導体
チップ2bの電極端子は、配線基板1bの各層に形成さ
れた配線パターンにそれぞれボンディングワイヤ3aを
介して電気的に接続されており、さらに半導体チップ2
b及びボンディングワイヤ3aを覆うように封止樹脂4
aで封止されている。
半導体装置では、例えば図1(a),(b)に示す構造
の場合、半導体チップ2,2aから発生される熱は、設
置個数が限られた放熱用端子(はんだバンプ6)を介し
てパッケージ(配線基板1,1a)の下方側から放熱さ
れるにすぎないため、放熱効果という点で必ずしも十分
ではないといった不利がある。
子6の個数を増やすことが考えられる。しかし、パッケ
ージのサイズが規定の大きさに設定されているため、放
熱用端子6の個数を増やすと、本来の外部接続端子(は
んだバンプ5)の個数が相対的に減少することになる。
結局、放熱用端子6の設置個数が制限されることにな
り、有効な対策とは言えない。
体チップ2bに熱的に直結した放熱手段(ヒートスプレ
ッダ7、ヒートシンク8)が設けられているので、半導
体チップ2bから発生される熱は、この放熱手段7,8
を介してパッケージ(配線基板1b)の上方側から有効
に放熱されると共に、封止樹脂4a内を伝導し、マザー
ボード等の実装用基板(図示せず)との間の空気を媒体
としてパッケージ(配線基板1b)の下方側からも放熱
される。従って、図1(a),(b)に示す構造の場合
と比べて、放熱効果という点では有利である。
装置では、放熱手段(ヒートスプレッダ7、ヒートシン
ク8)としてCuやAl等の金属板、或いはセラミック
板等が用いられているため、パッケージ全体が相対的に
大型化し、また重量があるといった不利がある。特に、
最近の半導体パッケージに対する小型化及び軽量化の要
求がより一層厳しくなっている状況を考慮すると、かか
る不利を改善する余地は残されている。
に鑑み創作されたもので、所要の放熱効果を維持すると
共に、小型化(薄型化)及び軽量化を図ることができる
半導体装置及びその製造方法を提供することを目的とす
る。
を解決するため、本発明の一形態によれば、一方の面に
配線パターンが形成された配線基板と、電極端子が前記
配線パターンに電気的に接続されるように前記配線基板
に実装された半導体素子と、該半導体素子を覆うように
成形されて前記配線基板の一方の面に接着されたシート
状の放熱板と、前記配線基板を貫通して前記配線パター
ンに電気的に接続されるように前記配線基板の他方の面
に形成された外部接続端子とを備え、前記シート状の放
熱板が、補強材として炭素繊維を含む耐熱性を有する樹
脂体からなることを特徴とする半導体装置が提供され
る。
ージの外形に応じた形状を有し、且つ補強材として炭素
繊維を含む耐熱性を有するプリプレグ状の樹脂体を準備
する第1の工程と、前記プリプレグ状の樹脂体を、実装
する半導体素子を覆うような外形に倣う型に入れて加熱
・加圧処理を施し、所要の形状に成形する第2の工程
と、一方の面に配線パターンが形成された配線基板に、
電極端子が前記配線パターンに電気的に接続されるよう
に半導体素子を実装する第3の工程と、前記半導体素子
の電極端子形成面の反対側の面及び前記配線基板の一方
の面に接着剤を塗布する第4の工程と、前記配線基板の
接着剤を塗布した面側に前記第2の工程により成形され
た樹脂体を重ねて、パッケージの外形に倣う型に入れて
加熱・加圧処理を施す第5の工程と、該第5の工程によ
り得られた配線基板の他方の面に、前記配線基板を貫通
して前記配線パターンに電気的に接続された外部接続端
子を形成する第6の工程とを含むことを特徴とする半導
体装置の製造方法が提供される。
パッケージの外形に応じた形状を有し、且つ補強材とし
て炭素繊維を含む耐熱性を有するプリプレグ状の樹脂体
を準備する第1の工程と、一方の面に配線パターンが形
成された配線基板に、電極端子が前記配線パターンに電
気的に接続されるように半導体素子を実装する第2の工
程と、前記配線基板の半導体素子を実装した面側に前記
プリプレグ状の樹脂体を重ねて、パッケージの外形に倣
う型に入れて加熱・加圧処理を施し、該樹脂体を所要の
形状に成形して前記配線基板の一方の面に接着する第3
の工程と、該第3の工程により得られた配線基板の他方
の面に、前記配線基板を貫通して前記配線パターンに電
気的に接続された外部接続端子を形成する第4の工程と
を含むことを特徴とする半導体装置の製造方法が提供さ
れる。
によれば、半導体素子から発生される熱を放熱するため
のシート状の放熱板として、炭素繊維を補強材として含
む耐熱性を有する成形された樹脂体を用いているので、
所要の放熱効果を維持する一方で、放熱手段としてCu
やAl等の金属板などを用いた従来技術の場合と比べ
て、小型化(薄型化)及び軽量化を図ることが可能とな
る。
半導体装置の断面的な構造を模式的に示したものであ
る。本実施形態に係る半導体装置10は、基本的には、
半導体パッケージとして供される配線基板11と、この
パッケージ(配線基板)11に実装された半導体素子
(チップ)14と、この半導体チップ14を覆うように
配線基板11に接着されたシート状の放熱板18と、本
装置10の外部接続端子として供されるはんだバンプ1
9とを備えて構成されている。
面(図示の例では上側)に配線パターン13が所要形状
に形成されてなる構成を有している。また、絶縁性基材
12の他方の面(図示の例では下側)に、絶縁性基材1
2を貫通して配線パターン13に電気的に接続されるよ
うにはんだバンプ(外部接続端子)19が設けられてい
る。このはんだバンプ(外部接続端子)19は、本装置
10をマザーボード等の実装用基板に実装するために用
いられる。
のみ配線パターン13が形成されているが、これに限ら
ず、配線基板11の両面に配線パターンを形成したもの
を用いてもよい。但しこの場合には、配線基板11の下
面に形成される配線パターンが露出するため、これを外
部から保護するためにソルダレジスト等の保護膜を適宜
設ける必要がある。
樹脂やエポキシ樹脂等の絶縁性の樹脂フィルムの表面に
銅(Cu)の配線パターンが形成されたものが用いられ
る。具体的な例としては、ポリイミド樹脂フィルムの片
面に銅(Cu)箔がパターニングされて形成されたTA
Bテープを用いることができる。また、半導体チップ1
4は、その電極端子15が配線基板11の配線パターン
13に電気的に接続されるようにフリップチップ実装さ
れている。本実施形態では、このフリップチップ実装と
して、異方性導電膜(ACF)を用いたACF実装を行
っている。このACF16としては、例えば銀(Ag)
フィラー等の導電性粒子を含有するエポキシ樹脂等の熱
硬化性樹脂が用いられる。
接着するための接着剤を示し、図示の例では、配線基板
11の配線パターン13が形成されている側と半導体チ
ップ14の裏面(電極端子15が設けられている側と反
対側の面)とにそれぞれ接着剤17が塗布されている。
接着剤17としては、後述するように、熱硬化性樹脂等
の絶縁性の材料又はAgペースト等の導電性の材料が、
必要に応じて適宜用いられる。
を図るために、半導体チップ14の厚さが可及的に薄い
ものを使用している。現状の技術では、半導体チップと
して50μm〜100μm程度の厚さのものが提供され
ており、この程度の厚さの半導体チップであれば基板に
実装することは技術的に十分に可能である。これを考慮
して本実施形態では、半導体チップ14として厚さが5
0μm程度の薄いものを使用している。
ト状の放熱板18が、補強材として炭素繊維を含む耐熱
性を有する成形された樹脂体により構成されていること
を特徴とする。このような炭素繊維で補強された樹脂体
を、以下、CFRP(CarbonFiber Reinforced Plastic)
と称する。放熱板18としては、例えばポリアクリロ
ニトリル(PAN)を原料とするPAN系炭素繊維、コ
ールタール等を蒸留したときに得られるピッチを原料と
するピッチ系炭素繊維等を補強材とし、この補強材にエ
ポキシ樹脂等の熱硬化性樹脂を含浸させて半硬化のBス
テージ状態にした接着シート(つまり、プリプレグ状の
CFRP)を、加熱・加圧処理により硬化させたものが
用いられる。
成形されたCFRP)18は、その機能を効果的に果た
すためにプロセス上の工夫がなされている。図3にその
例が示される。図3はCFRP(放熱板18)の補強材
の構造を示したものであり、(a)は平面的に見た構
造、(b)は(a)のA−A’線に沿って断面的に見た
構造をそれぞれ模式的に示している。
のようにxy方向(つまり配線基板11の面と平行する
方向)に炭素繊維を編んで形成されている。炭素繊維と
して例えばPAN系のものを用い、xy方向に編んだ場
合、このxy方向の熱伝導率は40〜45〔W/m・
K〕であり、一方、このxy方向と直交する方向(z方
向)の熱伝導率は1〜2〔W/m・K〕程度にすぎな
い。つまり、炭素繊維が延びる方向(xy方向)の熱伝
導率は比較的大きい。従って、図示のようにxy方向に
炭素繊維を編むことで、放熱板18としての機能を効果
的に果たすことができる。
yの両方向としているが、炭素繊維の向きは、x,yの
いずれか一方向のみとしてもよいし、或いはxy面内の
任意の方向としてもよい。以下、本実施形態の半導体装
置10を製造する方法の一例について、その製造工程を
順に示す図4及び図5を参照しながら説明する。
パッケージ(配線基板)11の外形に応じた形状を有す
るプリプレグ状のCFRP18aを準備する。このプリ
プレグ状のCFRP18aは、例えば1つの方法とし
て、予め所定の幅でプリプレグ状のCFRPが巻かれた
ロール(図示せず)から、当該プリプレグ状のCFRP
が解かれて図中矢印で示すように搬送されてくる過程に
おいて、破線で示すように所定の長さ単位でカットする
ことにより得られる。
は、その補強材は、炭素繊維を配線基板11の面と平行
する方向に編んで形成されている(図3参照)。次の工
程では(図4(b)参照)、実装する半導体チップ14
を覆うような外形に倣う凸形の下型21とこれに嵌合す
る凹形の上型22とを用いて、プリプレグ状のCFRP
18aの成形を行う。すなわち、下型21の上にプリプ
レグ状のCFRP18aを配置し、この上から上型22
を用いて、150℃前後の温度で加熱すると共に矢印で
示すように加圧する。これによって、プリプレグ状のC
FRP18aが所定の形状に倣って硬化し、一例として
キャップ状に成形される。このようにして成形されるC
FRP(つまり、シート状の放熱板18)は、厚さが1
00μm程度に選定される。
を型(下型21及び上型22)から取り出す。次の工程
では(図4(c)参照)、一方の面に配線パターン13
が形成された配線基板11に、金(Au)バンプからな
る電極端子15が配線パターン13に電気的に接続され
るように半導体チップ14を実装する。この実装はフリ
ップチップ実装により行い、特定的に異方性導電膜(A
CF)16を用いたACF実装により行う。半導体チッ
プ14については、上述したように厚さが50μm程度
の薄いものを使用する。
作製され得る。先ず、接着剤層(図示せず)が形成され
た厚さが20μm程度のポリイミド樹脂フィルム(絶縁
性基材12)を用意し、このポリイミド樹脂フィルムの
所要箇所に、レーザ加工又はプレス加工によりスルーホ
ールTHを形成した後、接着剤層により厚さが12μm
程度の銅(Cu)箔をポリイミド樹脂フィルムの上に熱
プレス接着し、さらに銅(Cu)箔にフォトエッチング
を施して配線パターン13を形成する。
(図4(c)の工程)と、プリプレグ状のCFRP18
aを硬化・成形してシート状の放熱板18を作製する工
程(図4(a)及び(b)の工程)とは、その順序を逆
にしてもよい。次の工程では(図5(a)参照)、配線
基板11の配線パターン13が形成されている側と半導
体チップ14の裏面(電極端子15が設けられている側
と反対側の面)とにそれぞれ接着剤17を塗布する。
絶縁性の材料又は導電性の材料が用いられるが、導電性
の材料を用いた場合には、信号用の配線パターン13が
電気的に短絡しないように留意する必要がある。例え
ば、放熱板18をグランドプレーンとして兼用する場
合、半導体チップ14の裏面と放熱板18との間、及び
グランド用の配線パターン13と放熱板18との間の接
着剤にはそれぞれ導電性の材料を用い、他の部分の接着
剤には絶縁性の材料を用いる必要がある。
ージの外形に倣う凹形の下型(底面半分体23a及び側
面半分体23b)とこの下型23a,23bの開口部に
嵌合する凹形の上型24とを用いて、成形されたCFR
P(シート状の放熱板18)の配線基板11上への接着
を行う。すなわち、下型23a,23bの開口部に、配
線基板11を接着剤17が塗布されている側を上にして
配置し、更にその上にシート状の放熱板18を重ねて配
置し、この上から上型24を用いて、150℃前後の温
度で加熱すると共に矢印で示すように加圧する。これに
よって、成形されたシート状の放熱板18が配線基板1
1上に接着される。
た配線基板11を型(下型23a,23b及び上型2
4)から取り出す。最後の工程では(図5(c)参
照)、配線基板11の他方の面(放熱板18が接着され
ている側と反対側の面)に、配線基板11上の配線パタ
ーン13に電気的に接続されるようにはんだバンプ(外
部接続端子)19を形成する。
ーホールTH内に径が300μm程度のはんだボールを
配置し、リフローにより接合する。これによって、はん
だボールがスルーホールTH内を満たして配線パターン
13に電気的に接続され、絶縁性基材12の下面側にボ
ール状に突出したはんだバンプ19が形成される。な
お、特に図示はしていないが、スルーホールTH内には
んだボールを配置する前に、はんだの濡れ性を向上させ
るために、スルーホールTHの内壁にCuめっき等によ
る導体皮膜を形成するようにすると好適である。
導体装置10及びその製造方法によれば、半導体チップ
14から発生される熱を放熱するための放熱板18とし
てシート状のCFRPを用いているので、所要の放熱効
果を維持する一方で、放熱手段としてCuやAl等の金
属板などを用いた従来技術(図1(c)参照)の場合と
比べて、小型化(薄型化)及び軽量化を図ることができ
る。
を構成する炭素繊維を、熱伝導率が比較的良好なxy方
向(つまり配線基板11の面と平行する方向)に編んで
いるので、放熱効果を有効に奏することができる。ま
た、本実施形態に係る製造方法では、プリプレグ状のC
FRP18aを所要形状にカットした後、加熱・加圧処
理を施して成形(硬化)することでシート状の放熱板1
8を作製しているが、このカット処理と成形処理の順序
を逆にすると不都合が生じる。すなわち、プリプレグ状
のCFRPに加熱・加圧処理を施して成形(硬化)した
後、カット処理を行うと、カットしたCFRPの端面に
カーボン粉が出て、汚れるといった不都合がある。本実
施形態では、カット処理によりプリプレグ状のCFRP
18aの端面にカーボン粉が出ても、その後の成形のた
めの加熱処理によりCFRP18aの端面が樹脂で覆わ
れるので、かかる不都合は生じない。
製造する方法として、プリプレグ状のCFRP18a
を、目的の形状に成形した後(放熱板18)、半導体チ
ップ14が実装された配線基板11に接着して半導体装
置10とする場合(つまり、CFRP18aを成形する
工程と、成形された放熱板18を配線基板11に接着す
る工程とを別工程にした場合)について説明したが、製
造方法はこれに限定されないことはもちろんである。
を、目的の形状に成形しながら、半導体チップ14が実
装された配線基板11に接着するようにしてもよい。そ
の一例は図6に示される。すなわち、先ず最初の工程で
は(図6(a)参照)、図4(a)の工程で行った処理
と同様にして、パッケージ(配線基板)11の外形に応
じた形状を有するプリプレグ状のCFRP18aを準備
する。
(c)の工程で行った処理と同様にして、半導体チップ
14の電極端子15が配線基板11上の配線パターン1
3に電気的に接続されるように半導体チップ14をAC
F実装により実装する。なお、半導体チップ14を実装
する工程(図6(b)の工程)と、プリプレグ状のCF
RP18aを準備する工程(図6(a)の工程)とは、
その順序を逆にしてもよい。
ージの外形に倣う凹形の下型(底面半分体23a及び側
面半分体23b)とこの下型23a,23bの開口部に
嵌合する凹形の上型24とを用いて、プリプレグ状のC
FRP18aの成形と配線基板11上への接着とを同時
に行う。すなわち、下型23a,23bの開口部に、配
線基板11を半導体チップ14が実装されている側を上
にして配置し、更にその上にプリプレグ状のCFRP1
8aを重ねて配置し、この上から上型24を用いて、1
50℃前後の温度で加熱すると共に矢印で示すように加
圧する。これによって、プリプレグ状のCFRP18a
が、実装した半導体チップ14を覆うような外形に倣っ
て硬化し、一例としてキャップ状に成形されると共に、
配線基板11上に接着される。
ト状の放熱板18)が接着された配線基板11を型(下
型23a,23b及び上型24)から取り出す。最後の
工程では(図6(d)参照)、図5(c)の工程で行っ
た処理と同様にして、配線基板11の放熱板18が接着
されている側と反対側の面に、配線基板11を貫通して
配線基板11上の配線パターン13に電気的に接続され
るようにはんだバンプ(外部接続端子)19を形成す
る。これによって、本製造方法に係る半導体装置10a
が作製されたことになる。
おいて加熱・加圧処理を施した際にプリプレグ状のCF
RP18aは接着剤として機能するので、プリプレグ状
のCFRP18aの成形(硬化)と配線基板11上への
接着とを同時に行うことができる。つまり、図4及び図
5に示す製造方法と比べて、製造工程を簡略化すること
ができる。また、これに関連して、図4及び図5に示す
製造方法で用いたような接着剤17を不要とすることが
できる。
1としてポリイミド樹脂等の絶縁性の樹脂フィルムの表
面に銅(Cu)箔の配線パターンが形成された可撓性
(フレキシブル)基板を用いた場合について説明した
が、配線基板11の形態はこれに限定されないことはも
ちろんである。例えば、ビルドアップ多層配線基板等で
一般的に用いられているようなガラス−エポキシ樹脂基
板、ガラスBT樹脂基板等の剛性(リジッド)基板を用
いてもよい。
1の作製に際し、絶縁性基材12にスルーホールTHを
形成してから配線パターン13を形成する場合について
説明したが、絶縁性基材12の種類や形態によっては、
配線パターン13を形成した後にスルーホールTHを形
成してもよい。さらに、上述した実施形態では、外部接
続端子としてはんだバンプ19を用いた場合について説
明したが、外部接続端子の材料や形態はこれに限定され
ないことはもちろんである。例えば、はんだバンプ19
に代えて金(Au)バンプを用いてもよいし、また、ピ
ンの形態とすることも可能である。
を外部接続端子として用いる場合、ピンの接合は以下の
ように行われる。先ず、配線基板11の下面において絶
縁性基材12から露出する配線パターン13の端子形成
部分に適量のはんだペーストを載せ、その上に、T字状
のピンの頭部を配置し、更にリフローによりはんだペー
ストを固めてピンを接合する。
強材として炭素繊維を含む耐熱性を有する成形された樹
脂体を放熱板として用いることにより、所要の放熱効果
を維持すると共に、小型化(薄型化)及び軽量化を図る
ことが可能となる。
ための図である。
模式的に示す断面図である。
造を模式的に示す図である。
図(その1)である。
図(その2)である。
面図である。
倣う型 23a,23b,24…パッケージの外形に倣う型 TH…スルーホール
Claims (5)
- 【請求項1】 一方の面に配線パターンが形成された配
線基板と、 電極端子が前記配線パターンに電気的に接続されるよう
に前記配線基板に実装された半導体素子と、 該半導体素子を覆うように成形されて前記配線基板の一
方の面に接着されたシート状の放熱板と、 前記配線基板を貫通して前記配線パターンに電気的に接
続されるように前記配線基板の他方の面に形成された外
部接続端子とを備え、 前記シート状の放熱板が、補強材として炭素繊維を含む
耐熱性を有する樹脂体からなることを特徴とする半導体
装置。 - 【請求項2】 前記補強材の炭素繊維が、前記配線基板
の面と平行する方向に編まれていることを特徴とする請
求項1に記載の半導体装置。 - 【請求項3】 パッケージの外形に応じた形状を有し、
且つ補強材として炭素繊維を含む耐熱性を有するプリプ
レグ状の樹脂体を準備する第1の工程と、 前記プリプレグ状の樹脂体を、実装する半導体素子を覆
うような外形に倣う型に入れて加熱・加圧処理を施し、
所要の形状に成形する第2の工程と、 一方の面に配線パターンが形成された配線基板に、電極
端子が前記配線パターンに電気的に接続されるように半
導体素子を実装する第3の工程と、 前記半導体素子の電極端子形成面の反対側の面及び前記
配線基板の一方の面に接着剤を塗布する第4の工程と、 前記配線基板の接着剤を塗布した面側に前記第2の工程
により成形された樹脂体を重ねて、パッケージの外形に
倣う型に入れて加熱・加圧処理を施す第5の工程と、 該第5の工程により得られた配線基板の他方の面に、前
記配線基板を貫通して前記配線パターンに電気的に接続
された外部接続端子を形成する第6の工程とを含むこと
を特徴とする半導体装置の製造方法。 - 【請求項4】 パッケージの外形に応じた形状を有し、
且つ補強材として炭素繊維を含む耐熱性を有するプリプ
レグ状の樹脂体を準備する第1の工程と、 一方の面に配線パターンが形成された配線基板に、電極
端子が前記配線パターンに電気的に接続されるように半
導体素子を実装する第2の工程と、 前記配線基板の半導体素子を実装した面側に前記プリプ
レグ状の樹脂体を重ねて、パッケージの外形に倣う型に
入れて加熱・加圧処理を施し、該樹脂体を所要の形状に
成形して前記配線基板の一方の面に接着する第3の工程
と、 該第3の工程により得られた配線基板の他方の面に、前
記配線基板を貫通して前記配線パターンに電気的に接続
された外部接続端子を形成する第4の工程とを含むこと
を特徴とする半導体装置の製造方法。 - 【請求項5】 前記第1の工程において、前記プリプレ
グ状の樹脂体として、補強材の炭素繊維が前記配線基板
の面と平行する方向に編まれた樹脂体を用いることを特
徴とする請求項3又は4に記載の半導体装置の製造方
法。
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000014809A JP2001210761A (ja) | 2000-01-24 | 2000-01-24 | 半導体装置及びその製造方法 |
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EP01300405A EP1120830B1 (en) | 2000-01-24 | 2001-01-18 | Semiconductor device having a carbon fiber reinforced resin as a heat radiation plate with a concave portion |
DE60140093T DE60140093D1 (de) | 2000-01-24 | 2001-01-18 | Halbleiter mit kohlenfaserverstärkter Harz-Kühlplatte mit konkavem Teil |
US10/777,232 US6864120B2 (en) | 2000-01-24 | 2004-02-12 | Semiconductor device having a carbon fiber reinforced resin as a heat radiation plate having a concave portion |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2000014809A JP2001210761A (ja) | 2000-01-24 | 2000-01-24 | 半導体装置及びその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2001210761A true JP2001210761A (ja) | 2001-08-03 |
JP2001210761A5 JP2001210761A5 (ja) | 2007-01-18 |
Family
ID=18542206
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2000014809A Pending JP2001210761A (ja) | 2000-01-24 | 2000-01-24 | 半導体装置及びその製造方法 |
Country Status (5)
Country | Link |
---|---|
US (2) | US6713863B2 (ja) |
EP (1) | EP1120830B1 (ja) |
JP (1) | JP2001210761A (ja) |
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EP1120830A2 (en) | 2001-08-01 |
DE60140093D1 (de) | 2009-11-19 |
US6713863B2 (en) | 2004-03-30 |
US6864120B2 (en) | 2005-03-08 |
EP1120830A3 (en) | 2002-05-22 |
KR20010076329A (ko) | 2001-08-11 |
US20010009302A1 (en) | 2001-07-26 |
EP1120830B1 (en) | 2009-10-07 |
US20040166609A1 (en) | 2004-08-26 |
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Legal Events
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A621 | Written request for application examination |
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|
A977 | Report on retrieval |
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|
A131 | Notification of reasons for refusal |
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|
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