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JP2003520406A - 高輝度放電ランプを駆動するための電子安定回路 - Google Patents

高輝度放電ランプを駆動するための電子安定回路

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JP2003520406A
JP2003520406A JP2001553346A JP2001553346A JP2003520406A JP 2003520406 A JP2003520406 A JP 2003520406A JP 2001553346 A JP2001553346 A JP 2001553346A JP 2001553346 A JP2001553346 A JP 2001553346A JP 2003520406 A JP2003520406 A JP 2003520406A
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Abstract

(57)【要約】 電子安定回路（図１）に電圧調整型直流電源と、複数のトランジスタ（Ｑ５，Ｑ６，Ｑ７，Ｑ８）をもつＨブリッジとが設けられている。この回路は高輝度放電ランプ（５０）を駆動する。トランジスタと電気的に接続された調整回路は、寄生容量（Ｃ）を放電させることによりＨブリッジを流れるピーク電流を調整する。

Description

【発明の詳細な説明】
【０００１】 本発明は電子安定回路および該回路を駆動する方法に関する。この電子回路は
ピーク電流サージたとえば高輝度放電（ＨＩＤ）ランプを流れるピーク電流サー
ジを検出して制限する。
【０００２】 従来の技術 典型的なＤ１ ＨＩＤランプの点弧後に突入電流が発生する。この電流は公称
３０Ａというピークをもつ。自動車用ＨＩＤ回路において使用されるランプなど
のようなこの種のランプは、ランプへ交流電流を供給するためのスイッチング回
路としてＨブリッジまたはフルブリッジを使用する。３０ＡのサージによってＨ
ブリッジ制御回路の動作信頼性が失われたり、あるいはＨブリッジＭＯＳＦＥＴ
スイッチが故障してしまうおそれがある。
【０００３】 電子安定回路を流れる高電流は様々なやり方によって扱うことができる。１つ
のやり方によれば、システムを流れる最大電流と同じ高さあるいはそれよりも高
い所定の電流レベルを定格とするＭＯＳＦＥＴのような素子が用いられる。高い
電流を定格とする素子を利用することの１つの欠点は、それらが余計に高価なこ
とである。また、高い定格の素子は低い定格の相当品よりも大きくかつ重くなる
傾向にある。ほとんどの適用事例では、素子の占めるスペースおよび素子の重さ
を最低限に抑えたい。
【０００４】 過剰電流を扱う２番目のやり方は、「スイッチオン」時の突入電流を制御する
ためのコンポーネントを組み込むことである。このようなコンポーネントとして
は（これに限定するわけではないけれども）、Huber 等の US 5,719,473 に開示
されているアクティブフィルタ昇圧回路内の１つのサイリスタまたは一対のサイ
リスタ、Huber の US 5,877,614 に開示されている昇圧レギュレータまたはブロ
ッキングオシレータとして設計された出力段、Twardzik の US 6,078,144 に開
示された振動トランス、EP0 757,420 に開示されたヒステリシスつきのマルチバ
イブレータ、あるいは十分なボルトセコンド（volt-second）能力をもつインダ
クタが挙げられる。このインダクタは通常、ピーク電流を制限するためにランプ
と直列に配置されることになる。これらのコンポーネントのいずれを組み込んで
もシステム全体のサイズが増大しシステムが複雑になるし、そのコストが高くな
ってしまう。
【０００５】 発明の概要 本発明の目的は、Ｈブリッジ回路内に設けられている低い定格のＭＯＳＦＥＴ
を利用してその回路を流れる電流を制限することにある。
【０００６】 本発明の別の課題は、ランプ点弧に続く周期中にＨブリッジ内のＭＯＳＦＥＴ
ゲート電圧を抑えて、ＭＯＳＦＥＴを流れる電流を制限することにある。
【０００７】 さらに本発明の課題は、寄生容量を使用してＭＯＳＦＥＴを流れる電流を制限
するための方法を提供することにある。
【０００８】 本発明によればこれらの課題やそのほかの目的は、既存のＨブリッジＭＯＳＦ
ＥＴスイッチのうちの少なくとも１つを使用して、Ｄ１ランプのサージ電流を既
存のデバイスの定格内のレベルに抑えることによって達成される。本発明の有利
な実施形態によれば、回路を駆動することにより発生する寄生容量が利用される
。この寄生容量を放電させる目的で回路内の抵抗のうちの１つから電圧を引き出
すことにより、ＭＯＳＦＥＴのゲート電圧が抑えられる。その際、このゲートを
不完全に閉じることでＭＯＳＦＥＴに流れる電流が制限される。この手法の利点
は、サージの検出および制限にあたり外部のコンポーネントを加える必要がなく
なることであるし、あるいはスイッチングＭＯＳＦＥＴのコストが必要以上にか
からなくなることである。
【０００９】 図面の簡単な説明 添付の図面を参照することで本発明を明瞭に理解することができる。この図に
は、本発明の有利な実施形態によるＨＩＤランプ用の電子安定回路が示されてい
る。
【００１０】 有利な実施例の説明 本発明を他の目的や利点ならびにその可能性を含めてなおいっそう理解できる
ようにするため、上述の図面を参照しながらこの明細書やそれに付随する特許請
求の範囲について説明する。
【００１１】 図面には本発明の有利な実施形態が描かれており、この実施形態ではランプ５
０は自動車用Ｄ１ ＨＩＤランプである。ランプ５０は点弧トランス６０といっ
しょに統合することができる。ランプ５０およびトランス６０は破線のブロック
７０内の回路によって表されている。
【００１２】 安定器の出力によって直流電圧が供給され、これはＨブリッジスイッチング回
路３０へと導かれる。このような安定器は適切な変形を加えて使用することがで
きる。Ｈブリッジ３０の出力は約５００Ｈｚの周波数をもつ方形波電圧である。
Ｈブリッジのコンポーネントならびに動作についてはあとで説明する。
【００１３】 放電ランプ５０は密封された慣用のアーク管５１を有しており、これによって
放電空間が規定されている。アーク管５１は要求に従い透明でも半透明でもよい
。慣用の手法で放電空間内に無水銀ハライド充填物が収容されている。
【００１４】 放電ランプ５０は、アーク放電を形成するためその内部に密封された２つの電
極を有している。たとえばアーク管５１は慣用の手法によって、その内部の対向
する各端部のところで密封された２つの電極５３および５４を有している。電極
５４は接続点６６と電気的に接続されており、電極５３はトランス６０と電気的
に接続されており、さらにこのトランス自体は接続点６８と電気的に接続されて
いて、これによりアーク管５１がＨブリッジスイッチング回路３０と電気的に接
続される。
【００１５】 Ｈブリッジスイッチング回路３０には４つのＭＯＳＦＥＴが含まれており、す
なわち２つのローサイド（低電位側）ＭＯＳＦＥＴ Ｑ５，Ｑ６と２つのハイサ
イド（高電位側）ＭＯＳＦＥＴ Ｑ７，Ｑ８が設けられている。安定した状態の
動作中、回路はＱ６，Ｑ８がＯＮとなりＱ５，Ｑ７がＯＦＦとなるときと、Ｑ６
，Ｑ８がＯＦＦとなりＱ５，Ｑ７がＯＮとなるときとで、交互に入れ替わる。本
発明は点弧動作時点ならびにその直後の動作に係わるものであるため、Ｑ６，Ｑ
８にのみ関連させてこの回路を説明する。殊にＱ８のゲートと接続された回路の
検出動作と制御について説明する。
【００１６】 Ｑ６とＱ８は点弧より前と点弧中と点弧直後、ＯＮに保持される。Ｑ８の駆動
源であるフェーズＢ（ＰＨＢ）は直流スイッチング電源であり、つまりこの駆動
源は−８５Ｖとアースとの間で周期的に動作し、約５００Ｈｚの周波数を有する
。Ｑ７の駆動源（ＰＨＡ、図示せず）も同様に動作する。２つの駆動源（ＰＨＢ
，ＰＨＡ）は１８０°の位相のずれをもち、約５０％の電力で動作する。
【００１７】 図面には、本発明に従い構成された絶縁ゲートデバイスＱ８のためのゲート駆
動（制御）回路の１つの実施形態が示されている。この実施形態の場合、絶縁ゲ
ートデバイスＱ８はＭＯＳＦＥＴである。とはいえ当業者であれば理解できるよ
うに、このゲート駆動回路を他のＦＥＴ、ＩＧＢＴ、ＭＣＴを駆動するためにも
使用できる。当然ながら１つの駆動回路によって１つまたは複数のゲートデバイ
スを駆動することができる。
【００１８】 ゲート駆動回路はエネルギー蓄積コンデンサＣ２８を有しており、これは安定
器出力電圧Ｖｏｕｔの高電位側すなわちハイサイドと接続されており、さらに抵
抗Ｒ１４と直列に接続されていて、この抵抗自体は電源の低電位側すなわちロー
サイドと接続されている。また、Ｃ２８はツェナダイオードＤ７とも並列に接続
されている。当然ながら他の実施形態として、ダイオードＤ７をツェナダイオー
ドとしなくてもよい。これらＣ２８，Ｒ１４，Ｄ７がいっしょになって、トラン
ジスタＱ１１のための調整供給側を成している。図１に示されているようにトラ
ンジスタＱ１１とトランジスタＱ１５は、Ｃ２８とＲ１４の接続点と電源のハイ
サイドとの間に結線されたトーテムポール構成をとっている。図示されている実
施形態の場合、トーテムポール構成は、ｎｐｎトランジスタＱ１１ならびにこれ
と直列に接続された第１のｐｎｐトランジスタＱ１５から成る。Ｑ１１およびＱ
１５のエミッタとゲートＱ８のゲートの間にトランジスタＲ７９が接続されてい
る。
【００１９】 第２のｐｎｐトランジスタＱ３９は、抵抗Ｒ７５における１０ＶＤＣを維持す
るための電流源として動作する。抵抗Ｒ７５は電源のハイサイドと接続されてお
り、静的な保護とＱ８のゲートのプルダウンつまりはＭＯＳＦＥＴ Ｑ８のター
ンオフのために用いられる。したがってトランジスタＱ３９と抵抗Ｒ７５はレベ
ルシフト回路を成している。とはいえ当業者であれば実現できるように、本発明
の広い範囲内でどのような駆動回路を使用してもどのようなデバイスを使用して
もかまわない。
【００２０】 さらにゲート駆動回路は抵抗Ｒ７６を有しており、これは駆動信号位相源（Ｐ
ＨＢ）とＱ３９のエミッタの間に直列に接続されている。ＰＨＢは絶縁ゲートデ
バイスＱ８をターンオンおよびターンオフする。上述のようにＰＨＢは、Ｑ７を
制御する第２の駆動信号源ＰＨＡに対し１８０°の位相がずれて動作する。
【００２１】 駆動信号位相源ＰＨＢから生じる駆動電圧ＶｂによりＱ８のゲートが駆動され
、これにより絶縁ゲートデバイスＱ８がターンオンする。Ｑ８を完全にオンの状
態に維持するために必要とされる電圧は５Ｖ〜８Ｖの間にある。この電圧は、抵
抗Ｒ７５における電圧降下からＱ１１のベース・エミッタ接合部における電圧降
下を差し引いたものにほぼ等しい。
【００２２】 上述の回路構成ゆえに、Ｑ３９のベースとコレクタの間に寄生容量（寄生容量
Ｃ）が発生する。普通の当業者であれば通常、このように構成された回路を望む
ことはないであろう。それというのも寄生容量の発生により回路のスイッチング
速度が遅くなるからである。しかしながら本発明にはこれまで知られていなかっ
た寄生容量Ｃを利用した技術が含まれており、それによって後述のようにＭＯＳ
ＦＥＴからみたピーク電流が低減される。Ｑ８からみたピーク電流を低減するた
めには、Ｈブリッジ内の電流を抑える必要がある。この電流低減は寄生容量Ｃを
放電させることによって達成される。寄生容量Ｃを放電させるための電流はＱ３
９から到来する。この放電電流は抵抗Ｒ７５における１０ＶＤＣを維持するため
に使われるのと同じ電流源（Ｑ３９）からのものであるため、抵抗Ｒ７５を通る
電流は必然的に低減される。抵抗Ｒ７５を流れる電流が低減されると、そこにお
ける電圧降下もそれに比例して低減される。上述のようにＱ８のゲートにおける
電圧は、抵抗Ｒ７５における電圧降下からトランジスタＱ１１のベース・エミッ
タ接合部における電圧を差し引いたものにほぼ等しい。したがって抵抗Ｒ７５に
おける電圧を低減するということは、Ｑ８のゲートにおける電圧の低減に相応す
る。Ｑ８のゲートにおける電圧は２Ｖ〜４Ｖまで低減する。この電圧降下によっ
てＭＯＳＦＥＴチャネルにおけるインピーダンスが増大し、Ｑ８を流れる最大電
流が約２０Ａまで減少する。
【００２３】 ランプ５０は最初はオフであり、トランス６０の２次側における電圧がランプ
５０の点弧に十分になるまでオフのまま維持される。安定器は通常、約−４００
ＶＤＣを出力する。点弧中は他の約−６００ＶＤＣが出力され、トランス６０の
１次側に加えられる。トランス６０の１次側に対し合成された約−１０００ＶＤ
が生じる。トランス６０の２次側は約２３，０００Ｖの出力電圧となり、これは
ランプの点弧に十分なものである。
【００２４】 点弧シーケンスは０μｓから５μｓまで継続する。点弧に応じてランプ５０が
グロー放電し始めるがまだアーク放電していない。したがって電流はまだ流れず
、非常に高くほぼ無限大の抵抗が存在することになる。電流を流せるようにする
ためにはランプはアーク放電しなければならない。Ｖｏｕｔにおける約−４００
ＶＤＣによって電流を流し始めるエネルギーが供給され、アーク放電が形成され
る。ひとたびランプがアーク放電すれば、ランプの抵抗は約１０Ωまで下がり、
回路に電流サージが流れ始める。約１３μｓの期間内で上述の制御回路の動作に
基づき、電流はゼロＡから２０Ａの最大値まで変化する。
【００２５】 電流がそのピーク値まで上昇すると、Ｖｏｕｔにおける約−４００ＶＤＣが０
Ｖに向かって減少する。その結果として生じた電圧降下により、上述の回路構成
に基づき充電コンデンサである寄生容量Ｃが生成される。トランジスタＱ３９は
抵抗Ｒ７５において１０ＶＤＣを維持するので、コンデンサＣにおける初期の電
圧は−３９０ＶＤＣになる。この電圧は電流が増加するにつれて０Ｖに向かって
減少する。
【００２６】 寄生容量Ｃは、正の側がアース電位となり負の側がＲ７５の上端の電位となる
よう充電されている。寄生容量Ｃを放電させるために、寄生容量ＣのＲ７５の側
からこの寄生容量Ｃを通ってアースの側へ電流を流さなければならない。寄生容
量Ｃの放電に用いられる電流はトランジスタＱ３９から到来する。この電流は通
常は抵抗Ｒ７５における１０ＶＤＣを維持するために用いられるものであるから
、寄生容量Ｃを放電させるためにこの電流の一部を利用することにより、抵抗Ｒ
７５を流れる電流つまりはそこにおける電圧が減少する。その結果、トランジス
タＱ８のゲートにおける電圧が２〜４Ｖまで下がる。トランジスタＱ８のゲート
における電圧が低減することによりＱ８のインピーダンスが高まり、トランジス
タＱ８のゲートに生じる電圧降下によってドレイン・ソース電圧が０Ｖから１５
０Ｖまで上昇し、これによってランプのピーク電流が２０Ａに制限され、これは
この種のデバイスにおいて一般的に達せられる３０Ａよりも小さい。つまりこの
ことは、ＭＯＳＦＥＴひいてはデバイスを小さくできることを意味する。
【００２７】 最初のフェーズＢのサイクル中に電流制限が行われる。ひとたびランプが安定
状態に達してしまえばＱ６もＱ８もオンとなり、あるいはＱ５とＱ７がオンにさ
れる。システムにおける電圧は生のランプ電力消費が３５Ｗとなるように維持さ
れる。３５Ｗの電力は、６０Ｖ〜１００Ｖの範囲内のどこかであるにせよ、約８
５Ｖの定格Ｖｏｕｔと言い換えられる。
【００２８】 この回路をそれを逆方向に動作させるように再構成することができ、その場合
、ピーク制限は最初のフェーズＡサイクル中に行われる。外部の回路を加えるこ
とができ、主電源出力をコントロールするマイクロプロセッサを回路の逆方向動
作のために使うこともできる。
【００２９】 これまで説明してきた実施形態は例証のために挙げたものであり、これに限定
されるものではない。自明のように、当業者であれば容易に理解できるような他
の実施形態を本発明の着想や範囲を大きく逸脱することなく実現できる。
【図面の簡単な説明】
【図１】 本発明の有利な実施形態によるＨＩＤランプ用の電子安定回路を示す図である
。
───────────────────────────────────────────────────── フロントページの続き (81)指定国 ＥＰ(ＡＴ，ＢＥ，ＣＨ，ＣＹ， ＤＥ，ＤＫ，ＥＳ，ＦＩ，ＦＲ，ＧＢ，ＧＲ，ＩＥ，Ｉ Ｔ，ＬＵ，ＭＣ，ＮＬ，ＰＴ，ＳＥ，ＴＲ)，ＯＡ(ＢＦ ，ＢＪ，ＣＦ，ＣＧ，ＣＩ，ＣＭ，ＧＡ，ＧＮ，ＧＷ， ＭＬ，ＭＲ，ＮＥ，ＳＮ，ＴＤ，ＴＧ)，ＡＰ(ＧＨ，Ｇ Ｍ，ＫＥ，ＬＳ，ＭＷ，ＭＺ，ＳＤ，ＳＬ，ＳＺ，ＴＺ ，ＵＧ，ＺＷ)，ＥＡ(ＡＭ，ＡＺ，ＢＹ，ＫＧ，ＫＺ， ＭＤ，ＲＵ，ＴＪ，ＴＭ)，ＡＥ，ＡＧ，ＡＬ，ＡＵ， ＢＡ，ＢＢ，ＢＧ，ＢＲ，ＢＺ，ＣＡ，ＣＮ，ＣＲ，Ｃ Ｕ，ＣＺ，ＤＭ，ＤＺ，ＥＥ，ＧＤ，ＧＥ，ＨＲ，ＨＵ ，ＩＤ，ＩＬ，ＩＮ，ＩＳ，ＪＰ，ＫＰ，ＫＲ，ＬＣ， ＬＫ，ＬＲ，ＬＴ，ＬＶ，ＭＡ，ＭＧ，ＭＫ，ＭＮ，Ｍ Ｘ，ＮＯ，ＮＺ，ＰＬ，ＲＯ，ＳＧ，ＳＩ，ＳＫ，ＴＴ ，ＵＡ，ＵＳ，ＵＺ，ＶＮ，ＹＵ，ＺＡ Ｆターム(参考） 3K072 AA11 AC01 CA12 CB02 DD06 DE02 DE04 GA03 GB18 HA03 HB01 HB02 HB05 3K083 AA23 AA88 AA91 BA05 BA25 BC42 BC47 BD25 BE28 CA32

Claims (20)

    【特許請求の範囲】
  1. 【請求項１】 電子安定回路において、 電圧調整型直流電源とＨブリッジが設けられており、該Ｈブリッジは複数のＨ
    ブリッジトランジスタを有しており、該Ｈブリッジは前記電源と電気的に接続さ
    れており、 該Ｈブリッジと接続されたランプソケットと、前記Ｈブリッジトランジスタの
    少なくとも１つと電気的に接続された調整回路が設けられており、該調整回路に
    より前記Ｈブリッジを流れるピーク電流が調整されることを特徴とする、 電子安定回路。
  2. 【請求項２】 放電ランプと直列に配置された点弧トランスが設けられてお
    り、該点弧トランスは前記複数のＨブリッジトランジスタの間でＨブリッジと接
    続されており、 前記複数のＨブリッジトランジスタは、第１のトランジスタと第２のトランジ
    スタと第３のトランジスタと第４のトランジスタとから成り、 前記第１のトランジスタは電源のローサイドとランプの第１の端子との間に配
    置されており、該ランプの対向する第２の端子は前記点弧トランスの第１の端子
    と電気的に接続されており、 前記第２のトランジスタは点弧トランスの第２の端子と電源のローサイドとの
    間に配置されており、 前記第３のトランジスタは電源のハイサイドと点弧トランスと第２の端子との
    間に配置されており、 前記第４のトランジスタは電源のハイサイドとランプの第１の端子との間に配
    置されており、該第４のトランジスタは前記調整回路と電気的に接続されている
    、 請求項１記載の安定回路。
  3. 【請求項３】 前記トランジスタはＭＯＳＦＥＴである、請求項２記載の安
    定回路。
  4. 【請求項４】 前記放電ランプは高輝度放電ランプである、請求項２記載の
    安定回路。
  5. 【請求項５】 前記調整回路は、駆動信号出力側、電源のハイサイドと電気
    的に接続されたバイアス抵抗、電流源トランジスタ、第１のゲート駆動トランジ
    スタおよび第２のゲート駆動トランジスタを有しており、 前記電流源トランジスタは、電源のローサイドと電気的に接続されたベースと
    、前記バイアス抵抗と電気的に接続されたコレクタと、前記駆動信号出力側と電
    気的に接続されたエミッタを有しており、 前記第１および第２のゲート駆動トランジスタは、各々前記バイアス抵抗と接
    続されたベースを有しており、 前記第４のトランジスタは、前記第１のゲート駆動トランジスタのエミッタと
    電気的に接続されており、前記電流源トランジスタのベースとコレクタはそれら
    の間で寄生容量が生じるように接続されている、 請求項３記載の安定回路。
  6. 【請求項６】 前記Ｈブリッジはさらに、前記電源のローサイドに電気的に
    接続された抵抗と、該抵抗と電気的に接続されたコンデンサと、該コンデンサと
    並列に接続されたツェナダイオードを有する、請求項５記載の安定回路。
  7. 【請求項７】 前記調整回路はさらに、電源のハイサイドに接続された抵抗
    と、該抵抗に接続された電流源を有しており、該電流源は少なくとも１つのＨブ
    リッジトランジスタの１つにバイアス電圧を供給する、請求項１記載の安定回路
    。
  8. 【請求項８】 前記抵抗と前記電流源との間に形成された接続部と、電源の
    ローサイドの間に素子が設けられており、該素子は電源により供給される電圧が
    低減したときに前記抵抗からの電流を分流させる、請求項７記載の安定回路。
  9. 【請求項９】 前記電流源は電流源トランジスタから成り、前記少なくとも
    １つのＨブリッジトランジスタはゲートをもつＭＯＳＦＥＴトランジスタであり
    、前記素子は前記電流源トランジスタのベースと該電流源トランジスタのエミッ
    タとの間の寄生容量である、請求項８記載の安定回路。
  10. 【請求項１０】 ベースおよびエミッタをもつ第１のトーテムポールトラン
    ジスタと、ベースおよびエミッタをもつ第２のトーテムポールトランジスタが設
    けられており、前記のベースの各々は前記抵抗と接続されており、前記のエミッ
    タの各々は前記Ｈブリッジトランジスタのうちの１つのゲートと電気的に接続さ
    れている、請求項９記載の安定回路。
  11. 【請求項１１】 電圧調整型直流電源とＨブリッジが設けられており、該Ｈ
    ブリッジは複数のＨブリッジトランジスタを有しており、該Ｈブリッジは前記電
    源と電気的に接続されており、 該Ｈブリッジと接続されたランプソケットと、 前記複数のＨブリッジトランジスタのうち少なくとも１つを制御して前記Ｈブ
    リッジを流れる電流を制限する手段が設けられていることを特徴とする、 電子安定回路。
  12. 【請求項１２】 放電ランプと直列に配置された点弧トランスが設けられて
    おり、該点弧トランスは前記複数のＨブリッジトランジスタの間でＨブリッジと
    接続されており、 前記複数のＨブリッジトランジスタは、第１のトランジスタと第２のトランジ
    スタと第３のトランジスタと第４のトランジスタとから成り、 前記第１のトランジスタは電源のローサイドとランプの第１の端子との間に配
    置されており、該ランプの対向する第２の端子は前記点弧トランスの第１の端子
    と電気的に接続されており、 前記第２のトランジスタは点弧トランスの第２の端子と電源のローサイドとの
    間に配置されており、 前記第３のトランジスタは電源のハイサイドと点弧トランスと第２の端子との
    間に配置されており、 前記第４のトランジスタは電源のハイサイドとランプの第１の端子との間に配
    置されており、該第４のトランジスタは前記制御手段と電気的に接続されている
    、 請求項１１記載の安定回路。
  13. 【請求項１３】 前記トランジスタはＭＯＳＦＥＴである、請求項１２記載
    の安定回路。
  14. 【請求項１４】 前記放電ランプは高輝度放電ランプである、請求項１２記
    載の安定回路。
  15. 【請求項１５】 前記制御手段は、駆動信号出力側、電源のハイサイドと電
    気的に接続されたバイアス抵抗、電流源トランジスタ、第１のゲート駆動トラン
    ジスタおよび第２のゲート駆動トランジスタを有しており、 前記電流源トランジスタは、電源のローサイドと電気的に接続されたベースと
    、前記バイアス抵抗と電気的に接続されたコレクタと、前記駆動信号出力側と電
    気的に接続されたエミッタを有しており、 前記第１および第２のゲート駆動トランジスタは、各々前記バイアス抵抗と接
    続されたベースを有しており、 前記第４のトランジスタは、前記第１のゲート駆動トランジスタのエミッタと
    電気的に接続されており、前記電流源トランジスタのベースとコレクタはそれら
    の間で寄生容量が生じるように接続されている、 請求項１３記載の安定回路。
  16. 【請求項１６】 前記Ｈブリッジのローサイドに電気的に接続された抵抗と
    、該抵抗と電気的に接続されたコンデンサと、該コンデンサと並列に接続された
    ツェナダイオードを有する、請求項１５記載の安定回路。
  17. 【請求項１７】 前記調整回路はさらに、電源のハイサイドと接続された抵
    抗と、該抵抗と接続されていて前記少なくとも１つのＨブリッジトランジスタの
    １つにバイアストランジスタを供給する電流源と、前記の抵抗と電流源トランジ
    スタの間に形成された接続部と電源のローサイドとの間に配置された素子を有し
    ており、該素子は電源により供給される電圧が低減したときに前記抵抗からの電
    流を分流させ、 前記電流源はトランジスタを有しており、 前記少なくとも１つのＨブリッジトランジスタのうちの１つはゲートをもつＭ
    ＯＳＦＥＴであり、 前記素子は、前記電流源トランジスタのベースと該電流源トランジスタのエミ
    ッタとの間の寄生容量である、 請求項１１記載の安定回路。
  18. 【請求項１８】 ベースおよびエミッタをもつ第１のトーテムポールトラン
    ジスタと、ベースおよびエミッタをもつ第２のトーテムポールトランジスタが設
    けられており、前記のベースの各々は前記抵抗と接続されており、前記のエミッ
    タの各々は前記少なくとも１つのトランジスタのうちの１つのゲートと電気的に
    接続されている、請求項１７記載の安定回路。
  19. 【請求項１９】 高輝度放電ランプ回路の作動方法において、 前記放電ランプに点弧電圧を供給するステップと、 該ランプと直列に接続された複数のトランジスタにバイアス電圧を供給するス
    テップと、 ランプ内にアーク放電が形成されるまでランプにアーク電圧を供給するステッ
    プと、 アーク放電が生じると、前記複数のトランジスタのうちの１つに対するバイア
    ス電圧を調整して、該トランジスタを流れる電流を制限するステップが設けられ
    ていることを特徴とする、 高輝度放電ランプ回路の作動方法。
  20. 【請求項２０】 前記点弧電圧を供給するステップにおいてアーク電圧によ
    りキャパシタンスを充電し、 前記のバイアス電圧調整ステップにおいてキャパシタンスの電圧を放電させ、
    バイアス抵抗から電流を引き出して前記バイアス電圧を低減する、 請求項１９記載の方法。
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