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JP2002140045A - 液晶表示装置用データドライバ - Google Patents

液晶表示装置用データドライバ

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JP2002140045A
JP2002140045A JP2000333517A JP2000333517A JP2002140045A JP 2002140045 A JP2002140045 A JP 2002140045A JP 2000333517 A JP2000333517 A JP 2000333517A JP 2000333517 A JP2000333517 A JP 2000333517A JP 2002140045 A JP2002140045 A JP 2002140045A
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crystal display
data driver
circuit
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Shinya Uto
真也 鵜戸
Masatoshi Kokubu
政利 國分
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Fujitsu Ltd
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Fujitsu Ltd
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Abstract

(57)【要約】 【課題】回路面積の増大を抑制する。 【解決手段】ドット反転駆動方式のデータドライバ１０
Ａにおいて、電圧バッファアンプＢ１〜Ｂ１２の出力端
がそれぞれ液晶表示パネルのデータバスラインＤ１〜Ｄ
１２に接続され、同一表示色に関する隣り合うデータバ
スライン間の１つおきに短絡スイッチ素子Ｓ１、Ｓ３、
Ｓ５、Ｓ７、Ｓ９及びＳ１１が接続され、その第１行の
配線と第２行の配線とが交互に配置されている。これら
短絡スイッチ素子は、データラインの１つおきにその一
方側に形成されている。電圧バッファアンプの出力がハ
イインピーダンス状態の時に該短絡スイッチ素子が制御
回路１３によりオンにされる。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、アナログ階調電圧
を出力する電圧バッファ増幅回路を備え、同一表示色に
関する隣り合うデータバスライン間で極性が逆になるよ
うに該アナログ階調電圧を該データバスラインに印加す
る液晶表示装置用データドライバに係り、特にドット反
転駆動方式の液晶表示装置に用いられるデータドライバ
に関する。
【０００２】
【従来の技術】図８は、液晶表示パネルのデータバスラ
インに接続される従来のデータドライバ１０Ｘの出力段
を示す。
【０００３】データドライバ１０Ｘの電圧バッファアン
プＢ１〜Ｂ１２は、電圧ホロアであり、これらの出力端
はそれぞれ液晶表示パネルのデータバスラインＤ１〜Ｄ
１２に接続されている。データドライバ１０Ｘは、ドッ
トライン駆動方式である。すなわち、隣り合うデータバ
スライン間で極性が逆になり、かつ、各データバスライ
ンについて１水平期間毎に極性が逆になるように、表示
データに応じたアナログ階調電圧が電圧バッファアンプ
Ｂ１〜Ｂ１２から出力される。ドット反転駆動方式によ
れば、データバスラインと走査バスラインのクロス容量
に起因する画素電極の電位変動が相殺され、また、対向
電極のコモン電位が安定するので、フリッカが軽減され
る。
【０００４】しかし、電圧バッファアンプＢ１〜Ｂ１２
の充放電電流が大きいので、消費電力が増大する。
【０００５】そこで、データバスラインに蓄積された電
荷を有効利用して消費電力を低減するために、データバ
スラインＤ１〜Ｄ１２とコモンラインＣＬとの間にそれ
ぞれ短絡スイッチ素子Ｓ１〜Ｓ１２が接続されている。
水平ブランキング期間において電圧バッファアンプＢ１
〜Ｂ１２の出力がハイインピーダンス状態にされ、この
時、短絡スイッチ素子Ｓ１〜Ｓ１２が同時にオンにされ
る。これにより、データバスラインＤ１〜Ｄ１２の電位
が、液晶表示パネルの対向べた電極のコモン電位にほぼ
等しくなるので、電圧バッファアンプＢ１〜Ｂ１２の消
費電流を半減することができる。
【０００６】しかしながら、電圧バッファアンプの各々
に短絡スイッチ素子を備える必要があるので、データド
ライバ１０Ｘの面積が増大し、データバスラインの高密
度化が妨げられる。
【０００７】図９は、特開平１０−２８２９４０に開示
されたドット反転駆動方式のデータドライバ１０Ｙを示
す。
【０００８】この回路では、隣り合うバスライン間の１
つおきに短絡スイッチ素子Ｓ１〜Ｓ９が接続されてい
る。この回路によれば、短絡スイッチ素子の数が図８の
それの半分になるので、上記問題が解決される。
【０００９】
【発明が解決しようとする課題】しかし、隣り合うバス
ラインには異なる色信号が供給されるので、相関がな
く、データバスラインに蓄積された電荷の利用効率が良
くない。例えば、ある水平期間においてデータバスライ
ンＤ１〜Ｄ６の電位が図１０に示すようになり、次の水
平ブランキング期間で短絡スイッチ素子Ｓ１、Ｓ３及び
Ｓ５がオンになると、これらの電位は図１１に示す如く
なって、対向電極のコモン電位ＶＣＯＭとの間に差が生
じ、図８の場合よりもデータドライバ１０Ｙの消費電力
が増大する。また、コモン電位ＶＣＯＭが変動してフリ
ッカが生ずる原因となる。
【００１０】本発明の目的は、上記問題点に鑑み、回路
面積の増大を抑制することができると共に、消費電力を
低減し且つフリッカを軽減することが可能な液晶表示装
置用データドライバを提供することにある。
【００１１】
【課題を解決するための手段及びその作用効果】本発明
による液晶表示装置用データドライバの第１態様では、
同一表示色に関する隣り合うデータバスライン間に間欠
的に短絡スイッチ素子が接続され、電圧バッファ増幅回
路の出力又は該電圧バッファ増幅回路と該データバスラ
インとの間がハイインピーダンス状態の時に該短絡スイ
ッチ素子がオンにされる。
【００１２】隣り合う同一色の画素データ信号は、逆極
性であり、絶対値がほぼ同一である確率が高い。特に背
景画像の領域でこの確率が高い。したがって、この液晶
表示装置用データドライバによれば、短絡スイッチ素子
のオンによりデータバスラインの電位が液晶表示パネル
の対向電極のコモン電位にほぼ等しくなり、電圧バッフ
ァアンプの消費電流を、隣り合うデータバスライン間に
間欠的に短絡スイッチ素子を接続した場合よりも低減す
ることができる。
【００１３】また、該コモン電位が安定するので、隣り
合うデータバスライン間に間欠的に短絡スイッチ素子を
接続した場合よりもフリッカが軽減して画質が向上す
る。
【００１４】さらに、短絡スイッチ素子の数が、隣り合
うデータバスライン間の全てに短絡スイッチ素子を接続
した場合よりも少ないので、データドライバの回路面積
を低減することができる。
【００１５】本発明による液晶表示装置用データドライ
バの第２態様では、上記第１態様において、上記短絡ス
イッチ素子を接続する第１行の配線と第２行の配線とが
交互に配置されている。
【００１６】この液晶表示装置用データドライバによれ
ば、短絡スイッチ素子及びその配線の密度がほぼ一様に
なるように配置されるので、データドライバの回路面積
をさらに狭くし、且つ、データバスラインをより高密度
化することができる。
【００１７】本発明による液晶表示装置用データドライ
バの第３態様では、上記第２態様において、上記短絡ス
イッチ素子が上記データラインの１つおきにその一方側
に形成されている。
【００１８】この液晶表示装置用データドライバによれ
ば、上記効果がさらに高められる。
【００１９】本発明の他の目的、構成及び効果は以下の
説明から明らかになる。
【００２０】
【発明の実施の形態】以下、図面を参照して本発明の実
施形態を説明する。
【００２１】［第１実施形態］図１は、本発明の第１実
施形態の液晶表示装置の概略構成を示す。図１では簡単
化のために、液晶表示パネル１１の画素配列が４行６列
の場合を示している。
【００２２】液晶表示パネル１１では、不図示の１対の
ガラス基板が対向して配置され、その間に液晶が封入さ
れている。その一方のガラス基板上には、画素電極がマ
トリックス状に配列され、各画素について薄膜トランジ
スタが形成され、第１〜４行の薄膜トランジスタに対し
それぞれ走査バスライン（ゲートライン）Ｇ１〜Ｇ４が
形成され、第１〜６列の薄膜トランジスタに対しそれぞ
れデータバスラインＤ１〜Ｄ６が形成され、走査バスラ
インＧ１〜Ｇ４とデータバスラインＤ１〜Ｄ６とが絶縁
膜を介し交差している。他方のガラス基板上には、全画
素に共通の透明べた電極が形成され、これにコモン電位
ＶＣＯＭが印加される。例えば第１行第１列の液晶画素
Ｃ１１については、その画素電極とデータバスラインＤ
１との間に薄膜トランジスタＴ１１が接続され、薄膜ト
ランジスタＴ１１のゲートが走査バスラインＧ１に接続
され、液晶画素Ｃ１１の対向電極にコモン電位ＶＣＯＭ
が印加される。
【００２３】液晶表示パネル１１のデータバスラインＤ
１〜Ｄ６はデータドライバ１０の出力端子に接続され、
液晶表示パネル１１の走査バスラインＧ１〜Ｇ４は走査
ドライバ１２の出力端子に接続されている。
【００２４】制御回路１３は、供給されるビデオ信号Ｖ
Ｓ、ピクセルクロックＣＬＫ、水平同期信号ＨＳＹＮＣ
及び垂直同期信号ＶＳＹＮＣに基づき、タイミング信号
を生成してデータドライバ１０及び走査ドライバ１２に
供給すると共に、データドライバ１０にビデオ信号を供
給する。
【００２５】走査ドライバ１２により走査バスラインＧ
１〜Ｇ４が線順次に活性化され、選択行の画素の信号電
荷がデータドライバ１０により更新される。データドラ
イバ１０は、データバスラインＤ１〜Ｄ６へ表示データ
信号を同時に供給し、これを１水平期間毎に更新する。
【００２６】データドライバ１０は、ドット反転駆動方
式である。すなわち、隣り合うデータバスライン間で極
性が逆になり、かつ、各データバスラインについて１水
平期間毎に極性が逆になるように、表示データに応じた
アナログ階調電圧がデータドライバ１０から出力され
る。図２（Ａ）及び図２（Ｂ）はそれぞれ、奇数フレー
ム及び偶数フレームの画素電圧極性分布を示す。
【００２７】図３は、データドライバ１０の出力段の構
成を示す。データバスラインの本数は実際には、例えば
１０２４×３＝３０７２であり、図３ではそのうちデー
タバスラインＤ１〜Ｄ１２のみ示す。
【００２８】液晶表示パネル１１上のデータバスライン
Ｄ１〜Ｄ１２はそれぞれ、データドライバ１０の、電圧
ホロアで構成された電圧バッファアンプＢ１〜Ｂ１２の
出力端子に接続されている。赤（Ｒ）、緑（Ｇ）及び青
（Ｂ）色信号のデータバスラインはいずれも、３つおき
に配置されている。
【００２９】短絡スイッチ素子Ｓ１は、同一表示色に関
する隣合うデータバスライン間の１つおきに接続されて
いる。すなわち、隣り合うＲのデータバスラインＤ１と
Ｄ４との間に短絡スイッチ素子Ｓ１が接続され、その次
に隣り合うＲのデータバスラインＤ４とＤ７との間には
短絡スイッチ素子が接続されず、次に隣り合うＲのデー
タバスラインＤ７とＤ１０との間に短絡スイッチ素子Ｓ
７が接続されている。同様に、隣り合うＧのデータバス
ラインＤ２とＤ５との間に短絡スイッチ素子Ｓ２が接続
され、隣り合うＧのデータバスラインＤ８とＤ１１との
間に短絡スイッチ素子Ｓ８が接続されている。また、隣
り合うＢのデータバスラインＤ３とＤ６との間に短絡ス
イッチ素子Ｓ３が接続され、隣り合うＢのデータバスラ
インＤ９とＤ１２との間に短絡スイッチ素子Ｓ９が接続
されている。
【００３０】制御回路１３は、各水平ブランキング期間
において、電圧バッファアンプＢ１〜Ｂ１２の出力をハ
イインピーダンス状態にし、この時、短絡スイッチ素子
Ｓ１〜Ｓ３及びＳ７〜Ｓ９を同時にオンにする。
【００３１】隣り合う同一色の画素データ信号は、逆極
性であり、絶対値がほぼ同一である確率が高い。特に背
景画像の領域でこの確率が高い。これにより、データバ
スラインＤ１〜Ｄ１２の電位がほぼコモン電位ＶＣＯＭ
となるので、電圧バッファアンプＢ１〜Ｂ１２の消費電
流を、短絡スイッチ素子が無い場合のほぼ半分に減ずる
ことができる。また、対向電極のコモン電位ＶＣＯＭが
安定して、フリッカが図９の場合よりも軽減する。さら
に、短絡スイッチ素子の数が図８の場合の半分であるの
で、データドライバ１０の回路面積を低減することがで
きる。
【００３２】［第２実施形態］図４は、本発明の第２実
施形態のデータドライバ１０Ａの出力段構成を示す。
【００３３】この回路では、短絡スイッチ素子を接続す
る第１行の配線Ｌ１〜Ｌ３と第２行の配線Ｌ４〜Ｌ６と
が交互に配置されている。
【００３４】また、第１行と第２行の各々について、隣
り合う短絡スイッチ素子Ｓ１の一端がそれぞれ隣り合う
データラインに接続されている。すなわち、短絡スイッ
チ素子Ｓ１とＳ５の一端がそれぞれデータバスラインＤ
４とＤ５に接続され、短絡スイッチ素子Ｓ５とＳ９の一
端がそれぞれデータバスラインＤ８とＤ９に接続され、
短絡スイッチ素子Ｓ３とＳ７の一端がそれぞれデータバ
スラインＤ６とＤ７に接続され、短絡スイッチ素子Ｓ７
とＳ１１の一端がそれぞれデータバスラインＤ１０とＤ
１１に接続されている。
【００３５】短絡スイッチ素子Ｓ１、Ｓ３、Ｓ５、Ｓ
７，Ｓ９及びＳ１１は、制御回路１３により上記第１実
施形態と同様に制御される。
【００３６】本第２実施形態によれば、上記第１実施形
態と同じ効果が得られる。さらに、短絡スイッチ素子の
配線が第１行と第２行のみに、配線密度がほぼ一様にな
るように配置され、短絡スイッチ素子の配置密度もほぼ
一様であるので、データドライバ１０Ａの面積を図３の
場合よりも狭くし、且つ、データバスラインＤ１〜Ｄ１
２をより高密度化することができる。
【００３７】［第３実施形態］図５は、本発明の第３実
施形態のデータドライバ１０Ｂの一部を示す。
【００３８】正極性電圧バッファアンプＰＢ１〜ＰＢ３
は、コモン電位ＶＣＯＭ（例えば５Ｖ）よりも高い（Ｈ
側）電圧を出力するためのものであり、負極性電圧バッ
ファアンプＮＢ１〜ＮＢ３はコモン電位ＶＣＯＭよりも
低い（Ｌ側）電圧を出力するためのものである。このよ
うに電圧バッファアンプをＨ側用とＬ側用とに分けてい
るのは、出力振幅を狭くしてその構成を簡単化するため
である。
【００３９】正極性電圧バッファアンプＰＢ１と負極性
電圧バッファアンプＮＢ１の出力を水平期間（１Ｈ）毎
に切り換えて出力端子Ｔ１とＴ２に供給するために、正
極性電圧バッファアンプＰＢ１の出力端と出力端子Ｔ１
及びＴ２との間にそれぞれ転送ゲートＰ１及びＰ２が接
続され、負極性電圧バッファアンプＮＢ１の出力端と出
力端子Ｔ１及びＴ２との間にそれぞれ転送ゲートＮ１及
びＮ２が接続されている。転送ゲートＰ１、Ｐ２、Ｎ１
及びＮ２が１組の切換スイッチを構成している。他の電
圧バッファアンプと出力端子との間の切換スイッチにつ
いても同様である。これら切換スイッチと出力端子Ｔ１
〜Ｔ６との間の配線には、図４の場合と同様に、短絡ス
イッチ素子Ｓ１、Ｓ４及びＳ５が接続されている。
【００４０】図５中の点線より下側の回路２０のパター
ンを図６に示す。図６中の電極Ａ〜Ｆ、Ｉ〜Ｔ及びＵ〜
Ｗは、図５中の同じ符号の位置に対応している。
【００４１】図５中の各転送ゲートは、ＰＭＯＳトラン
ジスタとＮＭＯＳトランジスタとが並列接続された構成
であり、ＰＭＯＳトランジスタは領域２１に形成され、
ＮＭＯＳトランジスタは領域２２に形成されている。
【００４２】例えば転送ゲートＰ１のＰＭＯＳトランジ
スタは、電極ＡとＩとその間の黒線で示すゲートとを有
し、転送ゲートＮ１のＰＭＯＳトランジスタは、電極Ａ
とＪとその間の黒線で示すゲートとを有している。転送
ゲートＰ１及びＮ１のＮＭＯＳトランジスタは、ＮＭＯ
Ｓトランジスタ領域２２のこれらに対応する部分を有す
る。
【００４３】短絡スイッチ素子Ｓ１のＰＭＯＳトランジ
スタは、電極ＡとＵとその間の黒線で示すゲートとを有
し、短絡スイッチ素子Ｓ３のＰＭＯＳトランジスタは、
電極ＣとＶとその間の黒線で示すゲートとを有し、短絡
スイッチ素子Ｓ５のＰＭＯＳトランジスタは、電極Ｅと
Ｗとその間の黒線で示すゲートとを有し、短絡スイッチ
素子Ｓ１、Ｓ３及びＳ５のＮＭＯＳトランジスタは、Ｎ
ＭＯＳトランジスタ領域２２のこれらに対応する部分を
有する。電極Ｕは、第１行の配線Ｌ１により、電極Ｄに
接続され、電極Ｖは、第２行の配線Ｌ４により電極Ｆに
接続され、電極Ｗは、第１行の配線Ｌ５に接続されてい
る。
【００４４】短絡スイッチ素子がデータラインの１つお
きにその一方側に形成され、短絡スイッチ素子を接続す
る配線Ｌ１、Ｌ４及びＬ５が、ＰＭＯＳトランジスタ領
域２１とＮＭＯＳトランジスタ領域２２の間の第１行と
第２行のみに、配線密度がほぼ一様になるように配置さ
れているので、回路２０の面積を狭くし且つデータバス
ラインの一部である出力端子Ｔ１〜Ｔ６を高密度化する
ことができる。
【００４５】図５に戻って、正極性電圧セレクタＰＳ１
〜ＰＳ３はそれぞれ、レジスタＲ１、Ｒ３及びレジスタ
Ｒ５の出力値に応じて正極性階調電圧ＶＰ３１〜ＶＰ０
の１つを選択し、正極性電圧バッファアンプＰＢ１〜Ｐ
Ｂ３に供給する。同様に、負極性電圧セレクタＮＳ１〜
ＮＳ３はそれぞれ、レジスタＲ２ 、Ｒ４及びレジスタ
Ｒ６の出力値に応じて負極性階調電圧ＶＮ３１〜ＶＮ０
の１つを選択し、負極性電圧バッファアンプＮＢ１〜Ｎ
Ｂ３に供給する。レジスタＲ１〜Ｒ６のクロック入力端
には、ラッチ信号ＬＴが供給される。
【００４６】図７は、図５の出力段の動作を示す波形図
である。
【００４７】ラッチ信号ＬＴは１Ｈ毎のパルスであり、
このパルスの立ち上がりでレジスタＲ１〜Ｒ６に画素デ
ータがラッチされる。ラッチ信号ＬＴのパルス期間で
は、転送ゲートＰ１〜Ｐ６及びＮ１〜Ｎ６がオフであ
り、電圧バッファアンプと出力端子との間がハイインピ
ーダンス状態になる。この時、短絡スイッチ素子Ｓ１、
Ｓ３及びＳ５がオンになって、短絡スイッチ素子で接続
された端子の電圧が平均化される。
【００４８】なお、本発明には外にも種々の変形例が含
まれる。例えば、電圧バッファアンプはソースホロア回
路であってもよい。また、データドライバは、薄膜トラ
ンジスタを用いて液晶表示パネルと一体的に形成したも
のであってもよい。
【図面の簡単な説明】
【図１】本発明の第１実施形態の液晶表示装置の概略構
成を示す回路図である。
【図２】（Ａ）及び（Ｂ）はそれぞれ奇数フレーム及び
偶数フレームの画素電圧極性分布を示す図である。
【図３】図１中のデータドライバの出力段を示す回路図
である。
【図４】本発明の第２実施形態のデータドライバの出力
段を示す回路図である。
【図５】本発明の第３実施形態のデータドライバの一部
を示す回路図である。
【図６】図５中の点線より下側の回路のレイアウト図で
ある。
【図７】図５の出力段の動作を示す波形図である。
【図８】液晶表示パネルのデータバスラインに接続され
る従来のデータドライバの出力段を示す回路図である。
【図９】従来の他のデータドライバの出力段を示す回路
図である。
【図１０】ある水平期間における図９中のデータバスラ
インＤ１〜Ｄ６の電位説明図である。
【図１１】図１０の状態からデータバスライン間短絡ス
イッチ素子がオンになった後のデータバスラインＤ１〜
Ｄ６の電位説明図である。
【符号の説明】
１０、１０Ａ、１０Ｂ、１０Ｘ、１０Ｙ データドライ
バ １１ 液晶表示パネル １２ 走査ドライバ １３ 制御回路 ２０ 回路 ２１ ＰＭＯＳトランジスタ領域 ２２ ＮＭＯＳトランジスタ領域 Ｔ１１ 薄膜トランジスタ Ｃ１１ 液晶画素 Ｄ１〜Ｄ６ データバスライン Ｇ１〜Ｇ４ 走査バスライン ＶＣＯＭ コモン電位 Ｂ１〜Ｂ９、Ｂ１０〜Ｂ１２ 電圧バッファアンプ Ｓ１〜Ｓ９、Ｓ１０〜Ｓ１２ 短絡スイッチ素子 Ｒ１〜Ｒ６ レジスタ ＰＳ１〜ＰＳ３ 正極性電圧セレクタ ＮＳ１〜ＮＳ３ 負極性電圧セレクタ ＰＢ１〜ＰＢ３ 正極性電圧バッファアンプ ＮＢ１〜ＮＢ３ 負極性電圧バッファアンプ Ｐ１〜Ｐ６、Ｎ１〜Ｎ６ 転送ゲート Ｔ１〜Ｔ６ 出力端子 ＬＴ ラッチ信号 ＶＰ３１、ＶＮ３１ 階調電圧 Ａ〜Ｆ、Ｉ〜Ｔ、Ｕ〜Ｗ 電極
フロントページの続き (51)Int.Cl.7 識別記号 ＦＩ テーマコート゛(参考） Ｇ０９Ｇ 3/20 ６１１ Ｇ０９Ｇ 3/20 ６１１Ｅ ６２３ ６２３Ｂ ６２３Ｃ Ｆターム(参考） 2H093 NA16 NA34 NA43 NA53 NB05 NC14 NC34 ND06 ND10 ND35 ND39 NE03 5C006 AC21 AC26 BB16 BC13 BF25 BF33 BF34 EB05 FA23 FA42 FA43 FA47 5C080 AA10 BB05 DD06 DD22 DD23 DD25 DD26 EE29 FF11 JJ02 JJ03 JJ04 JJ06

Claims (8)

    【特許請求の範囲】
  1. 【請求項１】 アナログ階調電圧を出力する電圧バッフ
    ァ増幅回路を備え、同一表示色に関する隣り合うデータ
    バスライン間で極性が逆になるように該アナログ階調電
    圧を該データバスラインに印加する液晶表示装置用デー
    タドライバにおいて、 同一表示色に関する隣り合うデータバスライン間に間欠
    的に接続された短絡スイッチ素子と、 該電圧バッファ増幅回路の出力又は該電圧バッファ増幅
    回路と該データバスラインとの間がハイインピーダンス
    状態の時に該短絡スイッチ素子をオンにする制御回路
    と、 を有することを特徴とする液晶表示装置用データドライ
    バ。
  2. 【請求項２】 上記短絡スイッチ素子は、上記同一表示
    色に関する隣り合うデータバスライン間の１つおきに接
    続されていることを特徴とする請求項１記載の液晶表示
    装置用データドライバ。
  3. 【請求項３】 上記短絡スイッチ素子を接続する第１行
    の配線と第２行の配線とが交互に配置されていることを
    特徴とする請求項２記載の液晶表示装置用データドライ
    バ。
  4. 【請求項４】 上記短絡スイッチ素子は、上記第１行と
    上記第２行の各々について、隣り合う第１及び第２の短
    絡スイッチ素子の一端がそれぞれ隣り合う第１及び第２
    のデータラインに接続されていることを特徴とする請求
    項３記載の液晶表示装置用データドライバ。
  5. 【請求項５】 上記短絡スイッチ素子は、上記データラ
    インの１つおきにその一方側に形成されていることを特
    徴とする請求項４記載の液晶表示装置用データドライ
    バ。
  6. 【請求項６】 上記短絡スイッチ素子の各々は、第３行
    に形成されたＮＭＯＳトランジスタと第４行に形成され
    たＰＭＯＳトランジスタとが並列接続されたものである
    ことを特徴とする請求項５記載の液晶表示装置用データ
    ドライバ。
  7. 【請求項７】 上記第１及び第２行の配線は、上記第３
    及び第４行のトランジスタの間の領域であることを特徴
    とする請求項６記載の液晶表示装置用データドライバ。
  8. 【請求項８】 複数のデータラインと複数の走査ライン
    とを有する液晶表示パネルと、 該複数のデータラインに接続された請求項１乃至７のい
    ずれか１つに記載の液晶表示装置用データドライバと、 該複数の走査ラインに接続された走査駆動回路と、 を有することを特徴とする液晶表示装置。
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