[go: up one dir, main page]

WO2005015617A1 - 半導体層 - Google Patents

半導体層 Download PDF

Info

Publication number
WO2005015617A1
WO2005015617A1 PCT/JP2004/011531 JP2004011531W WO2005015617A1 WO 2005015617 A1 WO2005015617 A1 WO 2005015617A1 JP 2004011531 W JP2004011531 W JP 2004011531W WO 2005015617 A1 WO2005015617 A1 WO 2005015617A1
Authority
WO
WIPO (PCT)
Prior art keywords
layer
gan
semiconductor
growth
substrate
Prior art date
Application number
PCT/JP2004/011531
Other languages
English (en)
French (fr)
Inventor
Noboru Ichinose
Kiyoshi Shimamura
Kazuo Aoki
Encarnacion Antonia Garcia Villora
Original Assignee
Koha Co., Ltd.
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Koha Co., Ltd. filed Critical Koha Co., Ltd.
Priority to KR1020117030584A priority Critical patent/KR101197416B1/ko
Priority to KR1020067002599A priority patent/KR101132546B1/ko
Priority to US10/567,369 priority patent/US7977673B2/en
Priority to EP04771516A priority patent/EP1653502A4/en
Publication of WO2005015617A1 publication Critical patent/WO2005015617A1/ja
Priority to US13/067,726 priority patent/US8674399B2/en

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/20Deposition of semiconductor materials on a substrate, e.g. epitaxial growth solid phase epitaxy
    • CCHEMISTRY; METALLURGY
    • C30CRYSTAL GROWTH
    • C30BSINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
    • C30B25/00Single-crystal growth by chemical reaction of reactive gases, e.g. chemical vapour-deposition growth
    • C30B25/02Epitaxial-layer growth
    • C30B25/18Epitaxial-layer growth characterised by the substrate
    • C30B25/20Epitaxial-layer growth characterised by the substrate the substrate being of the same materials as the epitaxial layer
    • CCHEMISTRY; METALLURGY
    • C30CRYSTAL GROWTH
    • C30BSINGLE-CRYSTAL GROWTH; UNIDIRECTIONAL SOLIDIFICATION OF EUTECTIC MATERIAL OR UNIDIRECTIONAL DEMIXING OF EUTECTOID MATERIAL; REFINING BY ZONE-MELTING OF MATERIAL; PRODUCTION OF A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; SINGLE CRYSTALS OR HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; AFTER-TREATMENT OF SINGLE CRYSTALS OR A HOMOGENEOUS POLYCRYSTALLINE MATERIAL WITH DEFINED STRUCTURE; APPARATUS THEREFOR
    • C30B25/00Single-crystal growth by chemical reaction of reactive gases, e.g. chemical vapour-deposition growth
    • C30B25/02Epitaxial-layer growth
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02367Substrates
    • H01L21/0237Materials
    • H01L21/02414Oxide semiconducting materials not being Group 12/16 materials, e.g. ternary compounds
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02367Substrates
    • H01L21/0237Materials
    • H01L21/0242Crystalline insulating materials
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02367Substrates
    • H01L21/02433Crystal orientation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02436Intermediate layers between substrates and deposited layers
    • H01L21/02439Materials
    • H01L21/02455Group 13/15 materials
    • H01L21/02458Nitrides
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02518Deposited layers
    • H01L21/02521Materials
    • H01L21/02538Group 13/15 materials
    • H01L21/0254Nitrides
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02612Formation types
    • H01L21/02617Deposition types
    • H01L21/0262Reduction or decomposition of gaseous compounds, e.g. CVD
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02365Forming inorganic semiconducting materials on a substrate
    • H01L21/02656Special treatments
    • H01L21/02658Pretreatments

Definitions

  • the present invention relates to a semiconductor layer, and more particularly to a semiconductor layer capable of obtaining a GaN-based epitaxial layer having high crystal quality.
  • FIG. 3 shows a conventional semiconductor layer.
  • the semiconductor layer includes a eight 1 2 0 3 substrate 1 1 composed of eight 1 2 ⁇ 3, and A 1 N layer 1 2 formed on the A 1 2 ⁇ 3 substrate 1 1 of a surface, of A 1 N layer 12
  • a GaN growth layer 13 formed by epitaxial growth by the MOC VD (Metal Organic Chemical Vapor Deposition) method is provided thereon (for example, see Japanese Patent Publication No. Sho 52-36117).
  • MOC VD Metal Organic Chemical Vapor Deposition
  • this semiconductor layer by forming the A 1 N layer 12 between the A 1 2 0 3 substrate 1 1 and G aN growth layer 1 3, to reduce the crystal defects by reducing the lattice constant mismatch Can be.
  • the lattice constants of the A 1 N layer 12 and the GaN growth layer 13 cannot be completely matched, and the crystal quality of the GaN growth layer 13 is further improved. Is difficult.
  • the crystallinity of the light emitting layer is deteriorated, and the light emission efficiency is reduced.
  • an object of the present invention is to provide a semiconductor layer from which a GaN-based epitaxial layer having high crystal quality can be obtained. Disclosure of the invention
  • the present invention provides a first layer made of a Ga 2 ⁇ 3 -based semiconductor, and substituting some or all of the oxygen atoms of the first layer with nitrogen atoms.
  • a semiconductor layer comprising a second layer.
  • a second layer obtained by replacing a part of the oxygen atoms of the first layer or all the nitrogen atom on the first layer consisting of G a 2 ⁇ 3 based semiconductor
  • a second layer made of a GaN-based compound semiconductor having high crystallinity can be obtained without interposing a buffer layer.
  • FIG. 1 is a sectional view of a semiconductor layer according to Example 1 of the present invention.
  • FIG. 2 is a diagram illustrating a manufacturing process of a semiconductor layer according to Example 1 of the present invention.
  • FIG. 3 is a cross-sectional view of a conventional semiconductor layer. BEST MODE FOR CARRYING OUT THE INVENTION
  • a semiconductor layer according to an embodiment of the present invention will be described.
  • a first layer made of a Ga 2 ⁇ 3 -based semiconductor and a part of oxygen atoms of the first layer or a part of the first layer formed on the first layer by performing a nitriding treatment or the like on the surface of the first layer. It is composed of a second layer composed of a GaN-based compound semiconductor obtained by replacing the whole with nitrogen atoms, and a third layer composed of a GaN-based epitaxial layer on the second layer.
  • Ga 2 ⁇ 3 semiconductor includes Ga 2 0 3 , (In x G a!
  • the n type Epitakisharu layer ", GaN, I n z G a X _ Z n ( However, 0 ⁇ ⁇ 1), a 1 2 G a t _ z n ( However, 0 ⁇ ⁇ 1) or I n z A 1 P G a Z _ P N (where 0 ⁇ ⁇ 1, 0 ⁇ p ⁇ l, 0 ⁇ z + p ⁇ l), etc. includes those having n-type conductivity or p-type conductivity by. for example, a first layer of Ga 2 0 3 as the first example, and a second layer made of GaN, the GaN That as the third layer, the second layer and the third layer can be constituted by the same compound semiconductors.
  • the first consisting of G a 2 ⁇ 3 as a second example Layer, a second layer consisting of G a N, and a third layer consisting of I r ⁇ G ai— Z N (where 0 ⁇ ⁇ ⁇ 1).
  • the layers can also be composed of different compound semiconductors.
  • I n x G ai - x ) 2 0 3 ( however, 0 ⁇ X rather 1) a first layer of, I n z A 1 P G ai- z- P N ( provided that , 0 ⁇ ⁇ ⁇ 1,
  • a second layer such as a second layer consisting of 0 ⁇ p ⁇ l, 0 ⁇ z + p ⁇ 1) and a third layer consisting of A lz G a iN (where 0 ⁇ ⁇ ⁇ 1)
  • the third layer and the third layer can be made of different compound semiconductors, and the first layer and the second layer can be combined differently from the first and second examples.
  • the lattice constants of the second layer and the third layer can be matched or extremely approximated, so that a GaN-based epitaxy layer with high crystal quality can be obtained.
  • FIG. 1 shows a semiconductor layer according to Example 1 of the present invention.
  • the semiconductor layer of this embodiment 1, / 3- G a 2 ⁇ 3 / 3- G a 2 ⁇ 3 substrate 1 of a first layer of single crystal, beta one G a 2 ⁇ 3 surface of the substrate 1
  • a GaN growth layer 3 as a third layer.
  • a GaN growth layer 3 as a third layer.
  • a nitrogen atom is replaced by a nitrogen atom
  • G aN layer 2 is formed.
  • FIG. 2 shows a manufacturing process of the semiconductor layer.
  • step I First,] 3- G a 2 ⁇ 3 seed crystal and i8 -G a 2 O 3 to prepare the polycrystalline material.
  • j8- G a 2 ⁇ three crystal, / 3- G a 2 ⁇ 3 has a prismatic cross-section square cut out by utilizing such a cleavage plane of a single crystal, the axial direction, and the shaft ⁇ 1 0 0> azimuth, 0 1 0> direction along the b axis, or 0 0 1> direction along the c axis.
  • a G a 2 0 3 powder having a purity of 4N was filled in a rubber tube, which was cold compressed to a 5 0 OMP a, 1 in 1 5 0 0T 0 Obtained by sintering for hours. Then, the quartz tube, under an atmosphere of total pressure of 1-2 atm of nitrogen and oxygen gas mixture (varying between 1 0 0% nitrogen oxygen 100%), / 3- Ga 2 0 3 or crystals and / three to G a 2 0 3 tip brought to contact with each other between the polycrystalline, the contact portion was heated to melt, by cooling the beta '-Ga 2 ⁇ 3 polycrystal melt, JS-Ga 2 O 3 single crystals are produced.
  • the jS—Ga 2 O 3 substrate 1 is etched by boiling in a 6 O: nitric acid aqueous solution (process port), and the i3—Ga 2 O 3 substrate 1 is immersed in ethanol and subjected to ultrasonic cleaning. (Step 8), further immersion in water and ultrasonic cleaning (Step 2), drying (Step e), vacuum cleaning in a MOC VD apparatus growth furnace at 1000 (to the step), / 3—Ga 2 0 3 Clean the surface of substrate 1.
  • step Bok 3- Ga 2 O s to the surface of the substrate 1 is subjected to nitriding treatment. That is, J3- G a 2 ⁇ 3 substrate 1 in the growth furnace of M MOCVD apparatus in a predetermined atmosphere, heated during a prescribed time. Atmosphere (including pressure), heating temperature, Ri by the appropriate selection of the heating time, / 3- Ga 2 ⁇ 3 desired GaN layer 2 on the surface of the substrate 1 is obtained.
  • GaN is grown by MOCVD to obtain a GaN growth layer 3 (step h). That is, when the pressure in the growth furnace of the M ⁇ C VD apparatus is reduced to 100 torr and ammonia gas is supplied as the N supply material and trimethyl gallium (TMG) is supplied as the G supply material into the growth furnace, the GaN layer 2 A GaN growth layer 3 having a thickness of, for example, about 100 nm is grown thereon.
  • the thickness of the GaN growth layer 3 can be controlled by adjusting the concentration of the raw material, the heating temperature, and the like.
  • Example 1 trimethylaluminum (TMA) was supplied together with TMG Then, instead of the GaN layer 2, an A1 GaN layer can be formed as the second layer.
  • TMG trimethylaluminum
  • TMG trimethylindium
  • TMG trimethylindium
  • InGaN layer can be formed as the second layer instead of the GaN layer 2.
  • a light-emitting device such as a light-emitting diode or a semiconductor laser can be manufactured. .
  • the above vacuum cleaning (to the process), nitriding (to the process), and GaN epitaxial growth (to the process) can be performed consecutively in the growth furnace of the MOCVD equipment, so that semiconductor layers can be efficiently produced. it can.
  • GaN growth layer 3 InGaN, A1GaN or InGaA1N may be grown.
  • the lattice constant with GaN layer 2 can be almost matched, and in the case of InAl GaN, the lattice constant with GaN layer 2 can be matched. is there.
  • a Si-doped GaN layer is formed on a thin GaN layer 2, a non-doped InGaN layer is formed thereon, and a Mg-doped GaN layer or A1 GaN
  • a laser diode element having an MQW multiple quantum well layer
  • a GaN substrate is obtained by removing the GaN layer 2 and the substrate 1 after setting the GaN growth layer 3 to a predetermined thickness.
  • each substrate can be obtained by forming an InGaN layer, an A1GaN layer or an InGaA1N layer instead of the GaN growth layer 3.
  • j3_Ga 2 0 3 deposition substrate 1 it has been described FZ method, or with EF G (Edge-defined Film- fed Growth method) method other growth methods such as.
  • EF G Erge-defined Film- fed Growth method
  • MOCVD method has been described as a method for growing the GaN-based epitaxial layer, other growth methods such as a PLD (Pulsed Laser Deposition) method may be used.
  • the semiconductor layer of the present invention can be applied to various types of semiconductor components, not limited to light-emitting elements.
  • Industrial potential a high-emitting element
  • a second layer obtained by replacing a part of the oxygen atoms of the first layer or all the nitrogen atom on the first layer consisting of G a 2 ⁇ 3 based semiconductor Forming a second layer of a GaN-based compound semiconductor with high crystallinity without intervening a buffer layer, the GaN-based epitaxial layer is formed on the second layer.
  • the lattice constant of the second layer and the GaN-based epitaxial layer can be matched or extremely approximated, and a GaN-based epitaxial layer with high crystal quality can be obtained.

Landscapes

  • Engineering & Computer Science (AREA)
  • Chemical & Material Sciences (AREA)
  • Manufacturing & Machinery (AREA)
  • General Physics & Mathematics (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Materials Engineering (AREA)
  • General Chemical & Material Sciences (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Metallurgy (AREA)
  • Organic Chemistry (AREA)
  • Led Devices (AREA)
  • Crystals, And After-Treatments Of Crystals (AREA)
  • Recrystallisation Techniques (AREA)
  • Chemical Vapour Deposition (AREA)

Abstract

結晶品質の高いGaN系エピタキシャル層を得ることができる半導体層を提供する。この半導体層は、β−Ga2O3単結晶からなるβ−Ga2O3基板1と、β−Ga2O3基板1の表面に窒化処理を施して形成されたGaN層2と、GaN層2にMOCVD法によりエピタキシャル成長して形成されたGaN成長層3とを備える。GaN層2とGaN成長層3の格子定数が一致し、GaN成長層3はGaN層2の高い結晶性を引き継いで成長するため、結晶性の高いGaN成長層3が得られる。

Description

明 細 書
半導体層 本出願は、 日本国特許出願 (特願 200 3— 290862) に基づいており、 この日本国出願の全内容は、 本出願において参照され導入される。 技術分野
本発明は、 半導体層に関し、 特に、 結晶品質の高い GaN系ェピタキシャル層 を得ることができる半導体層に関する。 背景技術
第 3図は、 従来の半導体層を示す。 この半導体層は、 八 123からなる八 12 03基板 1 1と、 A 123基板 1 1の表面に形成された A 1 N層 1 2と、 A 1 N 層 12の上に MOC VD (Metal Organic Chemical Vapor Deposition) 法により ェピタキシャル成長して形成された G aN成長層 1 3とを備える (例えば、 特公 昭 52— 36 1 1 7号公報参照。)。
この半導体層によれば、 A 1203基板 1 1と G aN成長層 1 3との間に A 1 N層 12を形成することにより、 格子定数の不一致を低減して結晶不良を減らす ことができる。
しかし、 従来の半導体層によると、 A 1 N層 1 2と G aN成長層 1 3との格子 定数を完全に一致させることができず、 GaN成長層l 3の結晶品質をさらに向 上することは難しい。 また、 発光素子に適用した場合は、 発光層の結晶性が劣化 し、 発光効率が減少する。
従って、 本発明の目的は、 結晶品質の高い G a N系ェピタキシャル層を得るこ とができる半導体層を提供することにある。 発明の開示
本発明は、 上記目的を達成するため、 Ga23系半導体からなる第 1の層と、 前記第 1の層の酸素原子の一部あるいは全部を窒素原子に置換することにより得 られる第 2の層により構成されたことを特徴とする半導体層を提供する。
本発明の半導体層によれば、 G a23系半導体からなる第 1の層上に第 1の 層の酸素原子の一部あるいは全部を窒素原子に置換することにより得られる第 2 の層を形成することにより、 緩衝層を介在させることなく結晶性の高い G a N系 化合物半導体からなる第 2の層が得られる。 図面の簡単な説明
第 1図は、 本発明の実施例 1に係る半導体層の断面図である。
第 2図は、 本発明の実施例 1に係る半導体層の製造工程を示す図である。
第 3図は、 従来の半導体層の断面図である。 発明を実施するための最良の形態
本発明の実施の形態に係る半導体層を説明する。 この実施の形態は、 Ga23系半導体からなる第 1の層と、 第 1の層の表面に窒化処理等を施して第 1の層 上に第 1の層の酸素原子の一部あるいは全部を窒素原子に置換することにより得 られる G a N系化合物半導体からなる第 2の層と、 第 2の層上に G a N系ェピ夕 キシャル層からなる第 3の層とから構成される。 ここで、 「G a23系半導体」 には、 Ga 203、 ( I nxG a !_x) 203 (ただし、 0≤χ<1)、 (A 1 XG a x -J 23 (ただし、 0≤xく 1)、 ( I nxA 1 yG a n— y) 203 (ただし、 0 ≤x< 1 , 0≤y< 1 , 0≤x + y< 1) 等からなるものが含まれ、 これらに対 し原子置換あるいは原子欠陥によって n型導電性あるいは p型導電性を示すもの も含まれる。 また、 「G aN系化合物半導体」 および 「G a N系ェピタキシャル 層」 には、 GaN、 I n z G a X_ZN (ただし、 0≤ζ<1)、 A 12 G a t_zN (ただし、 0≤ζ<1) 又は I n z A 1 PG a Z_PN (ただし、 0≤ζ<1, 0≤p<l, 0≤z +p<l) 等からなるものが含まれ、 これらに対し原子置換 あるいは原子欠陥によって n型導電性あるいは p型導電性を示すものも含まれる。 例えば、 第 1例として Ga 203からなる第 1の層と、 GaNからなる第 2の 層と、 GaNからなる第 3の層のように、 第 2の層と第 3の層を同じ化合物半導 体により構成することができる。 また、 第 2例として G a23からなる第 1の 層と、 G a Nからなる第 2の層と、 I r^ G a i— ZN (ただし、 0≤ ζ < 1 ) か らなる第 3の層のように、 第 2の層と第 3の層を異なる化合物半導体により構成 することもできる。 また、 第 3例として ( I nxG a ix) 203 (ただし、 0≤ Xく 1 ) からなる第 1の層と、 I n z A 1 PG a i— z— PN (ただし、 0≤ ζ < 1 ,
0≤p< l , 0≤ z + p< 1 ) からなる第 2の層と、 A l z G a iN (ただし、 0≤ ζ < 1 ) からなる第 3の層のように、 第 2の層と第 3の層を異なる化合物半 導体により構成し、 第 1の層と第 2の層を第 1例および第 2例と異なる組み合わ せにすることもできる。
この実施の形態によれば、 第 2の層と第 3の層の格子定数を一致、 あるいは極 めて近似させることが可能となるので、 結晶品質の高い G a N系ェピタキシャル 層が得られる。
(実施例 1 )
第 1図は、 本発明の実施例 1に係る半導体層を示す。 この実施例 1の半導体層 は、 /3— G a 23単結晶からなる第 1の層としての /3— G a 23基板 1と、 β 一 G a 23基板 1の表面に窒化処理を施して形成された厚さ約 2 nmの第 2の 層としての G aN層 2と、 G aN層 2上に例えば MOCVD法によりェピ夕キシ ャル成長して形成された第 3の層としての G aN成長層 3とを備える。 この窒化 処理において、 /3— G a 23基板 1の酸素原子が窒素原子によって置換される ことにより、 G aN層 2が形成される。
第 2図は、 半導体層の製造工程を示す。 まず、 — G a 203基板 1を F Z (フローティングゾーン) 法により作製する (工程ィ)。 最初に、 ]3— G a 23 種結晶と i8 -G a2 O 3多結晶素材を準備する。
j8— G a 23種結晶は、 /3— G a 23単結晶から劈開面の利用等により切り 出した断面正方形の角柱状を有し、 その軸方向は、 &軸< 1 0 0>方位、 b軸ぐ 0 1 0〉方位、 あるいは c軸ぐ 0 0 1>方位にある。
j8— G a 203多結晶素材は、 例えば、 純度 4Nの G a 203の粉末をゴム管に 充填し、 それを 5 0 OMP aで冷間圧縮し、 1 5 0 0Tで 1 0時間焼結すること により得られる。 次に、 石英管中において、 全圧が 1〜 2気圧の窒素と酸素の混合気体 (1 0 0 %窒素から 100 %酸素の間で変化) の雰囲気の下、 /3— Ga 203種結晶と /3 一 G a 203多結晶との先端を互いに接触させ、 その接触部分を加熱溶融させ、 β' -Ga23多結晶の溶解物を冷却することにより、 jS— Ga2 O 3単結晶が生成さ れる。 β— G a23単結晶は、 b軸く 0 1 0>方位に結晶成長させた場合は、 (1 00) 面の劈開性が強くなるので、 (1 00) 面に平行な面と垂直な面で切 断して /3— Ga 203基板 1を作製する。 なお、 a軸ぐ 1 00〉方位あるいは c軸 <00 1〉方位に結晶成長させた場合は、 (1 00) 面および (00 1) 面の劈 開性が弱くなるので、 全ての面の加工性が良くなり、 上記のような切断面の制限 はない。
次に、 6 O :の硝酸水溶液中でボイリングすることにより jS— Ga 203基板 1 をエッチングし (工程口) 、 この i3—Ga23基板 1をエタノールに浸して超音 波洗浄し (工程八) 、 さらに水に浸して超音波洗浄した後 (工程二) 、 乾燥し (工程ホ) 、 MOC VD装置の成長炉内で 1000 で真空洗浄し (工程へ) 、 /3— Ga 203基板 1の表面を清浄化させる。
次に、 ]3— Ga2Os基板 1の表面に窒化処理を施す (工程卜)。 すなわち、 M OCVD装置の成長炉内で j3— G a23基板 1を所定の雰囲気中で、 所定の時 間加熱する。 雰囲気 (気圧含む)、 加熱温度、 加熱時間を適宜選択することによ り、 /3— Ga23基板 1の表面に所望の GaN層 2が得られる。 例えば、 β — Ga23基板 1を 300 t o r rの ΝΗ3雰囲気中で 1 050 、 5分加熱する ことにより、 ]3— G a 203基板 1の表面に厚さが 2 nm程度の薄い G aN層 2 が形成される。
次に、 MOCVD法により G aNを成長させて G aN成長層 3を得る (工程 チ)。 すなわち、 M〇C VD装置の成長炉内を 1 00 t o r rまで減圧し、 成長 炉内に N供給原料としてアンモニアガスと G a供給原料としてトリメチルガリゥ ム (TMG) を供給すると, GaN層 2の上に、 例えば、 厚み 1 00 nm程度の GaN成長層 3が成長する。 GaN成長層 3の厚さは、 供給原料の濃度、 加熱温 度等を調整することにより制御することができる。
実施例 1において、 TMGとともにトリメチルアルミニウム (TMA) を供給 すると、 第 2の層として G a N層 2に代えて A 1 G a N層を形成することができ る。 また、 TMGとともにトリメチルインジウム (TM I ) を供給すると、 第 2 の層として G a N層 2に代えて I nG aN層を形成することができる。
この実施例 1によれば、 以下の効果が得られる。
(ィ) 結晶性の高い jS— G a 203基板 1が得られるので、 その上に形成した G a N層 2も貫通転位密度が低く、 結晶性の高い G a N層 2が得られる。 さらに、 この G aN層 2と G aN成長層 3とは格子定数が一致し、 しかも G a N成長層 3 は GaN層 2の高い結晶性を引き継いで成長するため、 貫通転位が少なく、 結晶 性の高い G a N成長層 3が得られる。
(口) n型の G aN成長層と p型の G aN成長層との間に、 例えば、 I nGaN 層を形成することにより、 発光ダイオード、 半導体レーザ等の発光素子を作製す ることができる。
(八) 本発明を発光素子に適用した場合、 結晶性の高い発光層が得られるので、 発光効率が高くなる。
(二) jS— G a 203基板 1は、 導電性を有するので、 発光素子を作製した場合、 層構造の上下方向から電極を取り出す垂直型の構造を採用することができ、 層構 成、 製造工程の簡素化を図ることができる。
(ホ) 3—&&23基板1は、 透光性を有するので、 基板側からも光を取り出 すことがきる。
(へ) MOCVD装置の成長炉内で上記真空洗浄 (工程へ)、 窒化処理 (工程ト)、 GaNェピタキシャル成長 (工程チ) を連続して行えるため、 半導体層を効率的 に生産することができる。 なお、 GaN成長層 3の代わりに、 I nGaN、 A 1 G a Nあるいは I n G a A 1 Nを成長させてもよい。 I n G aNおよび A 1 G aNの場合は、 GaN層 2 との格子定数をほぼ一致させることができ、 I nA l GaNの場合は、 GaN層 2との格子定数を一致させることが可能である。
例えば、 薄膜の GaN層 2の上に S i ドープ GaN層を形成し、 その上にノン ドープ I nGaN層を形成し、 その上に Mgド一プ GaN層あるいは A 1 GaN 層を形成すると、 ダブルへテロ型発光素子が得られる。 このとき、 ノンドープ I n G aN層を I n組成比の異なる井戸層と障壁層を交互に積層すると、 MQW (多重量子井戸層) を有したレーザダイオード素子が得られる。
一方、 第 1図において、 G aN成長層 3を所定の厚みにしてその後、 GaN層 2及び基板 1を削除すると、 GaN基板が得られる。 同様にして、 GaN成長層 3に代えて、 I nGaN層、 A 1 G a N層あるいは I n G a A 1 N層を形成する ことにより、 それぞれの基板を得ることができる。
また、 j3_Ga203基板 1の成長法として、 F Z法について説明したが、 EF G (Edge-defined Film-fed Growth method)法等の他の成長法でもよい。 また、 G a N系ェピタキシャル層の成長法として MOCVD法について説明したが、 P LD (Pulsed Laser Deposition) 法等の他の成長法でもよい。
また、 本発明の半導体層は、 発光素子に限らず、 様々な種類の半導体部品に適 用することができる。 産業上の利用の可能性
本発明の半導体層によれば、 G a 23系半導体からなる第 1の層上に第 1の 層の酸素原子の一部あるいは全部を窒素原子に置換することにより得られる第 2 の層を形成することにより、 緩衝層を介在させることなく結晶性の高い GaN系 化合物半導体からなる第 2の層が得られるので、 第 2の層上に G a N系ェピタキ シャル層を形成した場合に、 第 2の層と GaN系ェピタキシャル層の格子定数を 一致、 あるいは極めて近似させることが可能となり、 結晶品質の高い GaN系ェ ピ夕キシャル層が得られる。

Claims

請求の範囲
1. Ga 203系半導体からなる第 1の層と、
前記第 1の層の酸素原子の一部あるいは全部を窒素原子に置換することにより 得られる第 2の層により構成されたことを特徴とする半導体層。
2. 前記第 2の層は、 GaN系化合物半導体からなることを特徴とする請求の範 囲 1に記載の半導体層。
3. 前記第 1の層は、 Ga23系単結晶基板であることを特徴とする請求の範 囲 1に記載の半導体層。
4. 前記第 1の層は、 主成分として、 G a23、 ( I nxG a,_x) 203 (ただ し、 0≤χ<1)、 (A 1 XG a^J 203 (ただし、 0≤χ< 1) 又は ( I nxA 1 yG a,.x_y) 203 (ただし、 0≤χ<1, 0≤y< 1 , 0≤x + y<l) 等か らなることを特徴とする請求範囲 1に記載の半導体層。
5. 前記第 2の層は、 主成分として、 G aN、 I n z G a!_zN (ただし、 0≤ zく 1)、 A 1 ZG a,_,N (ただし、 0≤ z < 1 ) 又は I rizA l pGa!— zPN (ただし、 0≤ζ<1, 0≤p<l, 0≤z +p<l) 等からなることを特徴と する請求の範囲 2に記載の半導体層。
6. G a23系半導体からなる第 1の層と、
前記第 1の層の酸素原子の一部あるいは全部を窒素原子に置換することにより 得られる G aN系化合物半導体からなる第 2の層と、
前記第 2の層上に形成された G a N系ェピタキシャル層からなる第 3の層によ り構成されたことを特徴とする半導体層。
7. G a23系半導体からなる第 1の層と、 前記第 1の層上に形成された G a N系化合物半導体からなる第 2の層により構 成されたことを特徴とする半導体層。
8. Ga 203系半導体からなる第 1の層と、
前記第 1の層上に形成された G a N系化合物半導体からなる第 2の層と、 前記第 2の層上に形成された G a N系ェピタキシャル層からなる第 3の層によ り構成されたことを特徴とする半導体層。
PCT/JP2004/011531 2003-08-08 2004-08-04 半導体層 WO2005015617A1 (ja)

Priority Applications (5)

Application Number Priority Date Filing Date Title
KR1020117030584A KR101197416B1 (ko) 2003-08-08 2004-08-04 반도체층
KR1020067002599A KR101132546B1 (ko) 2003-08-08 2004-08-04 반도체층
US10/567,369 US7977673B2 (en) 2003-08-08 2004-08-04 Semiconductor layer with a Ga2O3 system
EP04771516A EP1653502A4 (en) 2003-08-08 2004-08-04 SEMICONDUCTOR LAYER
US13/067,726 US8674399B2 (en) 2003-08-08 2011-06-22 Semiconductor layer

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2003-290862 2003-08-08
JP2003290862A JP4754164B2 (ja) 2003-08-08 2003-08-08 半導体層

Related Child Applications (2)

Application Number Title Priority Date Filing Date
US10/567,369 A-371-Of-International US7977673B2 (en) 2003-08-08 2004-08-04 Semiconductor layer with a Ga2O3 system
US13/067,726 Continuation US8674399B2 (en) 2003-08-08 2011-06-22 Semiconductor layer

Publications (1)

Publication Number Publication Date
WO2005015617A1 true WO2005015617A1 (ja) 2005-02-17

Family

ID=34131611

Family Applications (1)

Application Number Title Priority Date Filing Date
PCT/JP2004/011531 WO2005015617A1 (ja) 2003-08-08 2004-08-04 半導体層

Country Status (7)

Country Link
US (2) US7977673B2 (ja)
EP (2) EP1653502A4 (ja)
JP (1) JP4754164B2 (ja)
KR (2) KR101132546B1 (ja)
CN (2) CN101257079B (ja)
TW (2) TWI488814B (ja)
WO (1) WO2005015617A1 (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE102006000150A1 (de) * 2005-03-31 2006-11-30 Toyoda Gosei Co., Ltd., Haruhi Verfahren zur Ausbildung einer bei einer niedrigen Temperatur gewachsenen Pufferschicht, Lichtemissionselement, Verfahren zu dessen Herstellung, und Lichtemissionsvorrichtung

Families Citing this family (28)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100482511B1 (ko) * 2004-02-05 2005-04-14 에피밸리 주식회사 Ⅲ-질화물계 반도체 발광소자
JP4476691B2 (ja) * 2004-05-13 2010-06-09 日本軽金属株式会社 酸化ガリウム単結晶複合体及びその製造方法並びに酸化ガリウム単結晶複合体を用いた窒化物半導体膜の製造方法
JP2006237556A (ja) * 2005-01-31 2006-09-07 Kanagawa Acad Of Sci & Technol GaN膜生成方法及び半導体素子並びにIII族窒化物の薄膜生成方法及びIII族窒化物の薄膜を有する半導体素子
JP2006273684A (ja) * 2005-03-30 2006-10-12 Koha Co Ltd Iii族酸化物系単結晶の製造方法
KR100691159B1 (ko) * 2005-04-30 2007-03-09 삼성전기주식회사 질화갈륨계 반도체의 제조 방법
JP4611103B2 (ja) * 2005-05-09 2011-01-12 株式会社光波 β−Ga2O3結晶の製造方法
JP5180430B2 (ja) * 2005-08-04 2013-04-10 独立行政法人物質・材料研究機構 発光素子
JP2007254174A (ja) * 2006-03-20 2007-10-04 Nippon Light Metal Co Ltd 酸化ガリウム単結晶及びその製造方法、並びに窒化物半導体用基板及びその製造方法
JP2008156141A (ja) * 2006-12-21 2008-07-10 Koha Co Ltd 半導体基板及びその製造方法
KR101020958B1 (ko) * 2008-11-17 2011-03-09 엘지이노텍 주식회사 산화갈륨기판 제조방법, 발광소자 및 발광소자 제조방법
JP5529420B2 (ja) * 2009-02-09 2014-06-25 住友電気工業株式会社 エピタキシャルウエハ、窒化ガリウム系半導体デバイスを作製する方法、窒化ガリウム系半導体デバイス、及び酸化ガリウムウエハ
KR101047652B1 (ko) 2009-12-18 2011-07-07 엘지이노텍 주식회사 발광소자 및 그 제조방법
JP6066210B2 (ja) * 2011-09-08 2017-01-25 株式会社タムラ製作所 Ga2O3系半導体素子
JP5777479B2 (ja) * 2011-10-14 2015-09-09 株式会社タムラ製作所 β−Ga2O3系基板の製造方法、及び結晶積層構造体の製造方法
US9966439B2 (en) * 2013-07-09 2018-05-08 Flosfia Inc. Semiconductor device and manufacturing method for same, crystal, and manufacturing method for same
CN103456603B (zh) * 2013-09-05 2016-04-13 大连理工大学 在镓系异质半导体衬底上制备氧化镓膜的方法及氧化镓膜
KR102086360B1 (ko) * 2013-11-07 2020-03-09 삼성전자주식회사 n형 질화물 반도체의 전극형성방법, 질화물 반도체 소자 및 그 제조방법
JP6248359B2 (ja) * 2013-12-20 2017-12-20 住友電工デバイス・イノベーション株式会社 半導体層の表面処理方法
CN104805505A (zh) * 2014-01-24 2015-07-29 泉州市博泰半导体科技有限公司 一种制备目标薄膜层的方法
JP2014123765A (ja) * 2014-02-27 2014-07-03 Sumitomo Electric Ind Ltd ウエハ生産物、窒化ガリウム系半導体光素子
TWI596710B (zh) 2015-06-12 2017-08-21 國立交通大學 半導體元件的製備方法
US10593544B2 (en) 2016-10-14 2020-03-17 Case Westen Reverse University Method for forming a thin film comprising an ultrawide bandgap oxide semiconductor
GB201705755D0 (en) 2017-04-10 2017-05-24 Norwegian Univ Of Science And Tech (Ntnu) Nanostructure
CN107587190A (zh) * 2017-08-14 2018-01-16 南京大学 一种制备GaN衬底材料的方法
CN107611004B (zh) * 2017-08-14 2020-01-31 南京大学 一种制备自支撑GaN衬底材料的方法
CN107833945B (zh) * 2017-11-24 2019-09-24 中国科学院半导体研究所 GaN基垂直LED结构及其制备方法
CN116314278B (zh) * 2023-05-22 2023-08-15 江西兆驰半导体有限公司 高电子迁移率晶体管外延结构及制备方法、hemt器件
CN116885066B (zh) * 2023-09-04 2023-12-01 江西兆驰半导体有限公司 发光二极管外延片及其制备方法、发光二极管

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000349336A (ja) * 1999-06-04 2000-12-15 Showa Denko Kk Iii族窒化物半導体発光素子
JP2003046128A (ja) * 2001-07-31 2003-02-14 Shin Etsu Handotai Co Ltd 発光素子の製造方法及び発光素子

Family Cites Families (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US3922475A (en) 1970-06-22 1975-11-25 Rockwell International Corp Process for producing nitride films
US5777350A (en) * 1994-12-02 1998-07-07 Nichia Chemical Industries, Ltd. Nitride semiconductor light-emitting device
JP4018177B2 (ja) 1996-09-06 2007-12-05 株式会社東芝 窒化ガリウム系化合物半導体発光素子
US6218207B1 (en) * 1998-05-29 2001-04-17 Mitsushita Electronics Corporation Method for growing nitride semiconductor crystals, nitride semiconductor device, and method for fabricating the same
WO1999066565A1 (en) * 1998-06-18 1999-12-23 University Of Florida Method and apparatus for producing group-iii nitrides
JP4083396B2 (ja) 2000-07-10 2008-04-30 独立行政法人科学技術振興機構 紫外透明導電膜とその製造方法
JP2002029713A (ja) * 2000-07-21 2002-01-29 Tokai Univ 窒化ガリウムの製造方法
JP2002075986A (ja) * 2000-08-30 2002-03-15 Oki Electric Ind Co Ltd GaAs系基板の表面処理方法
JP4291527B2 (ja) * 2000-10-13 2009-07-08 日本碍子株式会社 Iii族窒化物エピタキシャル基板の使用方法
JP3639789B2 (ja) * 2001-01-31 2005-04-20 シャープ株式会社 窒化物系半導体発光素子
JP4187422B2 (ja) * 2001-03-14 2008-11-26 明彦 吉川 半導体薄膜の形成方法およびその方法を用いて製造された半導体薄膜付き基板およびその半導体薄膜付き基板を用いた半導体デバイス。
JP3793918B2 (ja) 2002-03-29 2006-07-05 株式会社月星製作所 頭付部品の製造方法及びその装置
JP3679097B2 (ja) * 2002-05-31 2005-08-03 株式会社光波 発光素子

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000349336A (ja) * 1999-06-04 2000-12-15 Showa Denko Kk Iii族窒化物半導体発光素子
JP2003046128A (ja) * 2001-07-31 2003-02-14 Shin Etsu Handotai Co Ltd 発光素子の製造方法及び発光素子

Non-Patent Citations (2)

* Cited by examiner, † Cited by third party
Title
See also references of EP1653502A4 *
YING-GE YANG ET AL: "PREPARATION AND STRUCTURAL PROPERTIES FOR GAN FILMS", APPLIED SURFACE SCIENCE, vol. 193, 2002, pages 254 - 260, XP002981790 *

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE102006000150A1 (de) * 2005-03-31 2006-11-30 Toyoda Gosei Co., Ltd., Haruhi Verfahren zur Ausbildung einer bei einer niedrigen Temperatur gewachsenen Pufferschicht, Lichtemissionselement, Verfahren zu dessen Herstellung, und Lichtemissionsvorrichtung
DE102006000150B4 (de) * 2005-03-31 2018-02-08 Koha Co., Ltd. Verfahren zur Ausbildung einer bei einer niedrigen Temperatur gewachsenen Pufferschicht

Also Published As

Publication number Publication date
US20110253973A1 (en) 2011-10-20
US7977673B2 (en) 2011-07-12
EP2472567A3 (en) 2012-08-15
TWI362365B (en) 2012-04-21
EP1653502A4 (en) 2009-12-16
US8674399B2 (en) 2014-03-18
JP4754164B2 (ja) 2011-08-24
CN101257079A (zh) 2008-09-03
EP1653502A1 (en) 2006-05-03
JP2005064153A (ja) 2005-03-10
TW200510252A (en) 2005-03-16
CN100394549C (zh) 2008-06-11
US20060289860A1 (en) 2006-12-28
TWI488814B (zh) 2015-06-21
CN1833310A (zh) 2006-09-13
TW201213239A (en) 2012-04-01
CN101257079B (zh) 2012-07-18
KR101197416B1 (ko) 2012-11-05
KR20120003506A (ko) 2012-01-10
KR20060034723A (ko) 2006-04-24
KR101132546B1 (ko) 2012-04-03
EP2472567A2 (en) 2012-07-04

Similar Documents

Publication Publication Date Title
WO2005015617A1 (ja) 半導体層
US8044414B2 (en) Semiconductor layered structure and its method of formation, and light emitting device
US7674699B2 (en) III group nitride semiconductor substrate, substrate for group III nitride semiconductor device, and fabrication methods thereof
US5770887A (en) GaN single crystal
US7955957B2 (en) Group III-nitride semiconductor thin film, method for fabricating the same, and group III-nitride semiconductor light emitting device
US8148712B2 (en) Group III nitride compound semiconductor stacked structure
JP4189386B2 (ja) 窒化物半導体結晶層の成長方法および窒化物半導体発光素子の製法
US20110003420A1 (en) Fabrication method of gallium nitride-based compound semiconductor
JPH11135882A (ja) 化合物半導体基板、及び化合物半導体基板の製造方法、並びに発光素子
JP5077985B2 (ja) 窒化物半導体層の形成方法
JPH11135889A (ja) 結晶成長用基板及びそれを用いた発光装置
JP2008053703A (ja) AlN層およびAlGaN層並びにそれらの製造方法
JP2007103955A (ja) 窒化物半導体素子および窒化物半導体結晶層の成長方法
JPH09237938A (ja) Iii−v族化合物半導体装置
JP2008053640A (ja) Iii−v族窒化物層およびその製造方法
Matsuoka Lattice-matching growth of InGaAIN systems
JP2008308349A (ja) Iii族窒化物単結晶の製造方法、金属窒化物層を有する下地結晶基板、および多層構造ウエハ
Ichinose et al. Semiconductor layer with a Ga 2 O 3 system
EP1898449A1 (en) Compound semiconductor devices and methods of manufacturing the same

Legal Events

Date Code Title Description
WWE Wipo information: entry into national phase

Ref document number: 200480022689.2

Country of ref document: CN

AK Designated states

Kind code of ref document: A1

Designated state(s): AE AG AL AM AT AU AZ BA BB BG BR BW BY BZ CA CH CN CO CR CU CZ DE DK DM DZ EC EE EG ES FI GB GD GE GH GM HR HU ID IL IN IS KE KG KP KR KZ LC LK LR LS LT LU LV MA MD MG MK MN MW MX MZ NA NI NO NZ OM PG PH PL PT RO RU SC SD SE SG SK SL SY TJ TM TN TR TT TZ UA UG US UZ VC VN YU ZA ZM ZW

AL Designated countries for regional patents

Kind code of ref document: A1

Designated state(s): BW GH GM KE LS MW MZ NA SD SL SZ TZ UG ZM ZW AM AZ BY KG KZ MD RU TJ TM AT BE BG CH CY CZ DE DK EE ES FI FR GB GR HU IE IT LU MC NL PL PT RO SE SI SK TR BF BJ CF CG CI CM GA GN GQ GW ML MR NE SN TD TG

121 Ep: the epo has been informed by wipo that ep was designated in this application
WWE Wipo information: entry into national phase

Ref document number: 2004771516

Country of ref document: EP

WWE Wipo information: entry into national phase

Ref document number: 1020067002599

Country of ref document: KR

WWP Wipo information: published in national office

Ref document number: 1020067002599

Country of ref document: KR

WWP Wipo information: published in national office

Ref document number: 2004771516

Country of ref document: EP

WWE Wipo information: entry into national phase

Ref document number: 2006289860

Country of ref document: US

Ref document number: 10567369

Country of ref document: US

WWP Wipo information: published in national office

Ref document number: 10567369

Country of ref document: US