[go: up one dir, main page]

KR910006852A - 메모리 제어 시스템 및 방법 - Google Patents

메모리 제어 시스템 및 방법 Download PDF

Info

Publication number
KR910006852A
KR910006852A KR1019900014936A KR900014936A KR910006852A KR 910006852 A KR910006852 A KR 910006852A KR 1019900014936 A KR1019900014936 A KR 1019900014936A KR 900014936 A KR900014936 A KR 900014936A KR 910006852 A KR910006852 A KR 910006852A
Authority
KR
South Korea
Prior art keywords
read
memory
transmission error
sequence
address
Prior art date
Application number
KR1019900014936A
Other languages
English (en)
Other versions
KR930008561B1 (ko
Inventor
엔 팜 자오
시이 슈밋트 케니스
Original Assignee
원본미기재
엔시이아아르 코오포레이션
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 원본미기재, 엔시이아아르 코오포레이션 filed Critical 원본미기재
Publication of KR910006852A publication Critical patent/KR910006852A/ko
Application granted granted Critical
Publication of KR930008561B1 publication Critical patent/KR930008561B1/ko

Links

Classifications

    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C7/00—Arrangements for writing information into, or reading information out from, a digital store
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F5/00—Methods or arrangements for data conversion without changing the order or content of the data handled
    • G06F5/06—Methods or arrangements for data conversion without changing the order or content of the data handled for changing the speed of data flow, i.e. speed regularising or timing, e.g. delay lines, FIFO buffers; over- or underrun control therefor
    • G06F5/10—Methods or arrangements for data conversion without changing the order or content of the data handled for changing the speed of data flow, i.e. speed regularising or timing, e.g. delay lines, FIFO buffers; over- or underrun control therefor having a sequence of storage locations each being individually accessible for both enqueue and dequeue operations, e.g. using random access memory
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00—Error detection; Error correction; Monitoring
    • G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/14—Error detection or correction of the data by redundancy in operation
    • G06F11/1402—Saving, restoring, recovering or retrying
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C8/00—Arrangements for selecting an address in a digital store
    • G11C8/04—Arrangements for selecting an address in a digital store using a sequential addressing device, e.g. shift register, counter
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C8/00—Arrangements for selecting an address in a digital store
    • G11C8/16—Multiple access memory array, e.g. addressing one storage element via at least two independent addressing line groups
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F2201/00—Indexing scheme relating to error detection, to error correction, and to monitoring
    • G06F2201/88—Monitoring involving counting
    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F2205/00—Indexing scheme relating to group G06F5/00; Methods or arrangements for data conversion without changing the order or content of the data handled
    • G06F2205/06—Indexing scheme relating to groups G06F5/06 - G06F5/16
    • G06F2205/062—Allowing rewriting or rereading data to or from the buffer

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Quality & Reliability (AREA)
  • Communication Control (AREA)
  • Static Random-Access Memory (AREA)
  • Testing Of Engines (AREA)

Abstract

내용 없음

Description

메모리 제어 시스템 및 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 일 실시예에 따른 메모리 제어 시스템의 블럭도.
제2도는 제1도에 도시된 FIFO 제어기의 블럭도.

Claims (7)

  1. 판독어드레스를 수신하기 위한 제1어드레스 포트를 갖춘 이중 포트식 랜덤 액세스메모리와 판독 신호를 수신하여 이 신호에 응답해서 상기 포트에 판독 어드레스를 제공하고, 상기 랜덤 액세스 메모리로 부터 판독된 데이타 전송시 에러 존재 여부를 지시하는 제1및 제2신호들을 각기 수신하고, 전송 에러가 존재하는 최종 데이타 요소의 어드레스를 상기 포트에 제공하기 위한 제어기를 구비한 것을 특징으로 하는 메모리 제어 시스템
  2. 메모리부터 개별적으로 어드레스 가능한 데이타 요소의 제1시퀀스(d1, d2, ...dn)를 재전송하는 제1수단과 데이타 요소의 제2시퀀스(di,di+1,....dn)(여기서 di는 전송 에러가 있는 상기 제1시퀀스의 제1데이타요소)를 상기 메모리로 부터 재전송하는 제2수단을 구비하는 것을 특징으로 하는 메모리 제어 시스템.
  3. 제2항에 있어서, 상기 제1수단은 판독 신호를 수신하고 판독될 다음 데이타 요소의 어드레스를 발생시키기 위해 상기 메모리에 접속된 제1계수기를 포함하는 것을 특징으로 하는 메모리 제어 시스템.
  4. 제3항에 있어서, 상기 제2수단은 상기 메모리로부터 판독된 최종 데이타 요소의 어드레스를 전송 에러없이 갱신시키는 제2계수기를 포함하는 것을 특징으로 하는 시스템.
  5. 제4항에 있어서, 상기 제2계수기는 판독된 각 데이타 요소의 신호를 전송 에러없이 수신하는 것을 특징으로 하는 시스템.
  6. 제5항에 있어서, 전송 에러를 지시하는 신호에 응답해서 상기 제2계수기의 출력을 상기 제1계수기에 접속시키는 회로를 아울러 구비하는 것을 특징으로 하는 시스템.
  7. 메모리에서 선택된 데이타 요소를 재전송하는 방법에 있어서, 상기 메모리로부터 개별적으로 어드레스 가능한 데이타 요소의 제1시퀀스(d1, d2, ...dn)를 판독하는 단계.
    각 데이타 요소가 전송 에러없이 판독 되었는지의 여부를 나타내는 제1및 제2신호를 제공하는 단계 및 데이타 요소의 제2시퀀스(di,di+1,....dn)(여기서 di는 전송 에러가 존재하는 상기 제1시퀀스의 제1데이타 요소임)를 재전송하는 단계를 구비한 것을 특징으로 하는 데이타 요소의 재전송 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019900014926A 1989-09-21 1990-09-20 압축공기 분출용 오리피스경 측정기구 KR930008561B1 (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US410773 1989-09-21
US07/410,773 US5283763A (en) 1989-09-21 1989-09-21 Memory control system and method

Publications (2)

Publication Number Publication Date
KR910006852A true KR910006852A (ko) 1991-04-30
KR930008561B1 KR930008561B1 (ko) 1993-09-09

Family

ID=23626151

Family Applications (2)

Application Number Title Priority Date Filing Date
KR1019900014926A KR930008561B1 (ko) 1989-09-21 1990-09-20 압축공기 분출용 오리피스경 측정기구
KR1019900014936D KR940006992B1 (ko) 1989-09-21 1990-09-20 메모리 제어 시스템 및 방법

Family Applications After (1)

Application Number Title Priority Date Filing Date
KR1019900014936D KR940006992B1 (ko) 1989-09-21 1990-09-20 메모리 제어 시스템 및 방법

Country Status (3)

Country Link
US (1) US5283763A (ko)
JP (1) JP3220749B2 (ko)
KR (2) KR930008561B1 (ko)

Families Citing this family (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2778373B2 (ja) * 1992-09-04 1998-07-23 日本電気株式会社 再送機能付きバッファ装置
FR2716276B1 (fr) * 1994-02-16 1996-05-03 Sgs Thomson Microelectronics Circuit de réorganisation de données.
US6044030A (en) * 1998-12-21 2000-03-28 Philips Electronics North America Corporation FIFO unit with single pointer
JP4700589B2 (ja) * 2006-10-26 2011-06-15 株式会社クボタ キャビンのドア装置
US8109190B2 (en) * 2008-08-23 2012-02-07 George Arthur Proulx Railgun system
US8701639B2 (en) 2011-04-14 2014-04-22 George Arthur Proulx Open railgun with steel barrel sections

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4037091A (en) * 1976-04-05 1977-07-19 Bell Telephone Laboratories, Incorporated Error correction circuit utilizing multiple parity bits
US4051355A (en) * 1976-04-29 1977-09-27 Ncr Corporation Apparatus and method for increasing the efficiency of random access storage
US4344171A (en) * 1980-12-11 1982-08-10 International Business Machines Corporation Effective error control scheme for satellite communications
US4423482A (en) * 1981-06-01 1983-12-27 Sperry Corporation FIFO Register with independent clocking means
JPS59117800A (ja) * 1982-12-25 1984-07-07 Fujitsu Ltd バツフア・ストレ−ジの１ビツトエラ−処理方式
US4535455A (en) * 1983-03-11 1985-08-13 At&T Bell Laboratories Correction and monitoring of transient errors in a memory system
US4604750A (en) * 1983-11-07 1986-08-05 Digital Equipment Corporation Pipeline error correction
JPS60133599A (ja) * 1983-12-21 1985-07-16 Nec Corp 半導体メモリ装置
US4641305A (en) * 1984-10-19 1987-02-03 Honeywell Information Systems Inc. Control store memory read error resiliency method and apparatus
JPH0727462B2 (ja) * 1985-10-11 1995-03-29 株式会社日立製作所 データ処理装置におけるページフォールト実行再開方法
US4694426A (en) * 1985-12-20 1987-09-15 Ncr Corporation Asynchronous FIFO status circuit
US4754396A (en) * 1986-03-28 1988-06-28 Tandem Computers Incorporated Overlapped control store
US4740969A (en) * 1986-06-27 1988-04-26 Hewlett-Packard Company Method and apparatus for recovering from hardware faults
EP0272869B1 (en) * 1986-12-19 1993-07-14 Fujitsu Limited Dual port type semiconductor memory device realizing a high speed read operation
CA1286421C (en) * 1987-10-14 1991-07-16 Martin Claude Lefebvre Message fifo buffer controller

Also Published As

Publication number Publication date
KR930008561B1 (ko) 1993-09-09
KR940006992B1 (ko) 1994-08-03
JP3220749B2 (ja) 2001-10-22
US5283763A (en) 1994-02-01
JPH03108182A (ja) 1991-05-08

Similar Documents

Publication Publication Date Title
KR910005308A (ko) 반도체 메모리
KR850006652A (ko) 프로세스와 메모리를 내장한 집적회로와 그것을 사용한 시스템
KR860003556A (ko) 인터럽트 제어 시스템
KR950033856A (ko) 데이타 전송 제어방법과 이것에 사용하는 주변회로, 데이타 프로세서 및 데이타 처리 시스템
KR920008598A (ko) 직접 또는 인터리브모드로 메모리를 액세스하는 메모리 컨트롤러 및 이를 구비한 데이타 처리시스템
KR890008822A (ko) 반도체메모리
KR910001777A (ko) 속도변환용 라인 메모리
KR920001552A (ko) 반도체 메모리 장치의 다중 비트 병렬 테스트방법
KR880003252A (ko) 마이크로 프로세서
KR900015008A (ko) 데이터 프로세서
KR920001528A (ko) 동기형 데이터전송회로를 갖춘 다이나믹형 반도체기억장치
KR970071302A (ko) 프로세서로부터의 프로그램가능한 판독/기록 억세스 신호 및 이 신호의 형성 방법
KR910006852A (ko) 메모리 제어 시스템 및 방법
KR880000859A (ko) 마이크로 프로세서
KR860004349A (ko) 시이퀀스 제어기의 프로세스 입출력장치
KR880005762A (ko) 데이타 전송 시스템
KR920001532A (ko) 이중포트메모리장치
KR890008823A (ko) 직렬 메모리 장치
KR910006855A (ko) 인터럽트 제어회로
JPS61255451A (ja) デ−タ処理装置
KR850007713A (ko) 반도체 기억장치
KR910010340A (ko) 확장 어드레싱 회로 및 접합기 카드
KR920001353A (ko) 프로세서와 코프로세서의 프로세서간 통신방식
SU1203602A1 (ru) Запоминающее устройство
SU391559A1 (ru) Устройство для отображения буквенно- цифровой информации

Legal Events

Date Code Title Description
PA0109 Patent application

Patent event code: PA01091R01D

Comment text: Patent Application

Patent event date: 19900920

A201 Request for examination
PA0201 Request for examination

Patent event code: PA02012R01D

Patent event date: 19901113

Comment text: Request for Examination of Application

Patent event code: PA02011R01I

Patent event date: 19900920

Comment text: Patent Application

PG1501 Laying open of application
E902 Notification of reason for refusal
PE0902 Notice of grounds for rejection

Comment text: Notification of reason for refusal

Patent event date: 19931230

Patent event code: PE09021S01D

G160 Decision to publish patent application
PG1605 Publication of application before grant of patent

Comment text: Decision on Publication of Application

Patent event code: PG16051S01I

Patent event date: 19940709

E701 Decision to grant or registration of patent right
PE0701 Decision of registration

Patent event code: PE07011S01D

Comment text: Decision to Grant Registration

Patent event date: 19941011

GRNT Written decision to grant
PR0701 Registration of establishment

Comment text: Registration of Establishment

Patent event date: 19950104

Patent event code: PR07011E01D

PR1002 Payment of registration fee

Payment date: 19950104

End annual number: 3

Start annual number: 1

PR1001 Payment of annual fee

Payment date: 19970729

Start annual number: 4

End annual number: 4

PR1001 Payment of annual fee

Payment date: 19980803

Start annual number: 5

End annual number: 5

PR1001 Payment of annual fee

Payment date: 19990729

Start annual number: 6

End annual number: 6

PR1001 Payment of annual fee

Payment date: 20000729

Start annual number: 7

End annual number: 7

PR1001 Payment of annual fee

Payment date: 20011026

Start annual number: 8

End annual number: 8

PR1001 Payment of annual fee

Payment date: 20020618

Start annual number: 9

End annual number: 9

PR1001 Payment of annual fee

Payment date: 20030716

Start annual number: 10

End annual number: 10

PR1001 Payment of annual fee

Payment date: 20040618

Start annual number: 11

End annual number: 11

FPAY Annual fee payment

Payment date: 20050718

Year of fee payment: 12

PR1001 Payment of annual fee

Payment date: 20050718

Start annual number: 12

End annual number: 12

LAPS Lapse due to unpaid annual fee
PC1903 Unpaid annual fee