KR101961145B1 - 표시 장치 - Google Patents
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Abstract
Description
도 3은 도 1에 도시된 화소의 레이아웃이다.
도 4는 도 3에 도시된 I-I'선의 단면도이다.
도 5는 도 3에 도시된 Ⅱ-Ⅱ'선의 단면도이다.
도 6은 도 1에 도시된 화소의 다른 실시 예에 따른 레이아웃이다.
도 7은 도 6에 도시된 Ⅲ-Ⅲ'선의 단면도이다.
도 8은 도 1에 도시된 화소의 등가 회로도이다.
도 9는 도 8에 도시된 제3 및 제4 트랜지스터들의 저항 성분을 표시한 도면이다.
도 10은 도 8에 도시된 화소에 충전되는 화소 전압 레벨을 도시한 도면이다.
도 11은 본 발명의 실시 예에 따른 제1, 제2, 및 제3 화소 전극들의 면적비가 1:2:4이고, 제1, 제2, 및 제3 서브 화소들의 전압 비가 1:0.8:0.65일 경우 정면 및 측면 감마 곡선을 보여주는 도면이다.
도 12는 본 발명의 실시 예에 따른 제1, 제2, 및 제3 화소 전극들의 면적비가 1:2:5일 경우, 제1, 제2, 및 제3 서브 화소들의 전압비의 변화에 따른 정면 및 측면 감마 곡선을 보여주는 도면이다.
도 13은 본 발명의 실시 예에 따른 제1, 제2, 및 제3 화소 전극들의 면적비가 1:2:6일 경우, 제1, 제2, 및 제3 서브 화소들의 전압비의 변화에 따른 정면 및 측면 감마 곡선을 보여주는 도면이다.
도 14는 2D 모드로 동작하는 본 발명의 실시 예에 따른 표시 장치의 화소 상태를 도시한 도면이다.
도 15는 3D 모드로 동작하는 본 발명의 실시 예에 따른 표시 장치의 화소 상태를 도시한 도면이다.
도 16은 3D 모드에서 표시 장치의 동작 상태를 개략적으로 보여주는 도면이다.
120: 타이밍 컨트롤러 130: 게이트 구동부
140: 데이터 구동부 10,20: 제1 및 제2 편광 필름
30: 패턴 리타더 40: 편광 안경
111: 제1 기판 112: 제1 절연막
113: 보호막 114: 제2 절연막
115: 제2 기판
Claims (20)
- 제1 게이트 라인들, 제2 게이트 라인들, 및 데이터 라인들에 대응되게 연결된 복수의 화소들을 포함하는 표시 패널을 포함하고,
상기 복수의 화소들 각각은,
대응하는 제1 게이트 라인 및 대응하는 데이터 라인에 연결된 제1 트랜지스터 및 상기 제1 트랜지스터에 연결된 제1 화소 전극을 포함하는 제1 서브 화소;
대응하는 제2 게이트 라인 및 상기 대응하는 데이터 라인에 연결된 제2 트랜지스터 및 상기 제2 트랜지스터에 연결된 제2 화소 전극을 포함하는 제2 서브 화소; 및
상기 대응하는 제2 게이트 라인 및 상기 대응하는 데이터 라인에 연결된 제3 트랜지스터, 상기 대응하는 제2 게이트 라인에 연결되며 스토리지 전압을 제공받는 제4 트랜지스터, 및 상기 제3 및 제4 트랜지스터들에 공통으로 연결된 제3 화소 전극을 포함하는 제3 서브 화소를 포함하고,
상기 제1 화소 전극의 면적은 상기 제2 화소 전극의 면적보다 작고, 상기 제2 화소 전극의 면적은 상기 제3 화소 전극의 면적보다 작은 표시 장치. - 제 1 항에 있어서,
상기 제1 트랜지스터는 상기 제1 화소 전극 및 상기 제2 화소 전극 사이에 배치되고, 상기 제2, 제3, 및 제4 트랜지스터들은 상기 제2 화소 전극 및 상기 제3 화소 전극 사이에 배치되는 표시 장치. - 제 2 항에 있어서,
상기 대응하는 제1 및 제2 게이트 라인들과 평행하게 연장되는 제1 , 제2, 및 제3 스토리지 라인들;
상기 제1 스토리지 라인과 교차하는 방향으로 분기되어 서로 이격되어 연장된 제1 및 제2 분기 전극들;
상기 제2 스토리지 라인과 교차하는 방향으로 분기되어 서로 이격되어 연장된 제3 및 제4 분기 전극들; 및
상기 제3 스토리지 라인과 교차하는 방향으로 분기되어 서로 이격되어 연장된 제5 및 제6 분기 전극들을 더 포함하고,
상기 제4 트랜지스터는 상기 제4 분기 전극에 연결되어 상기 스토리지 전압을 제공받는 표시 장치. - 제 3 항에 있어서,
상기 제1 화소 전극은 상기 제1 스토리지 라인, 및 상기 제1 및 제2 분기 전극들과 부분적으로 오버랩되고, 상기 제2 화소 전극은 상기 제2 스토리지 라인, 및 상기 제3 및 제4 분기 전극들과 부분적으로 오버랩되고, 상기 제3 화소 전극은 상기 제3 스토리지 라인, 및 상기 제5 및 제6 분기 전극들과 부분적으로 오버랩되는 표시 장치. - 제 3 항에 있어서,
공통 전압을 인가받으며, 상기 제1 화소 전극, 상기 제2 화소 전극, 및 상기 제3 화소 전극과 마주하도록 구비되는 공통 전극을 더 포함하고 ,
상기 제1 서브 화소는 상기 제1 화소 전극과 상기 공통 전극에 의해 형성되는 제1 커패시터를 더 포함하고,
상기 제2 서브 화소는 상기 제2 화소 전극과 상기 공통 전극에 의해 형성되는 제2 커패시터를 더 포함하고,
상기 제3 서브 화소는 상기 제3 화소 전극과 상기 공통 전극에 의해 형성되는 제3 커패시터를 더 포함하는 표시 장치. - 제 5 항에 있어서,
상기 제1 트랜지스터는 상기 대응하는 제1 게이트 라인을 통해 제공된 제1 게이트 신호에 응답하여 상기 대응하는 데이터 라인을 통해 제공된 제1 데이터 전압을 상기 제1 커패시터에 제공하고,
상기 제2 트랜지스터는 상기 대응하는 제2 게이트 라인을 통해 제공된 제2 게이트 신호에 응답하여 상기 대응하는 데이터 라인을 통해 제공되고, 상기 제1 데이터 전압보다 작은 크기를 갖는 제2 데이터 전압을 상기 제2 커패시터에 제공하고,
상기 제3 및 제4 트랜지스터들은 상기 대응하는 제2 게이트 라인을 통해 제공된 상기 제2 게이트 신호에 응답하여 상기 대응하는 데이터 라인을 통해 제공된 상기 제2 데이터 전압과 상기 제4 분기 전극을 통해 제공되는 상기 스토리지 전압을 상기 제3 커패시터에 제공하는 표시 장치. - 제 6 항에 있어서,
상기 제1 커패시터에는 상기 제1 데이터 전압에 대응되는 제1 화소 전압이 충전되고, 상기 제2 커패시터에는 상기 제2 데이터 전압에 대응되는 제2 화소 전압이 충전되고, 상기 제3 커패시터에는 상기 제2 데이터 전압보다 작고 상기 스토리지 전압보다 큰 전압에 대응되는 제3 화소 전압이 충전되는 표시 장치. - 제 7 항에 있어서,
상기 제3 화소 전압에 대응되는 상기 제3 트랜지스터 및 상기 제4 트랜지스터 사이의 노드 전압은
Vlow=Vcst(R2/(R1+R2))+VD2(R2/(R1+R2))
(이때, Vlow는 상기 제3 트랜지스터 및 상기 제4 트랜지스터 사이의 노드 전압, Vcst는 상기 스토리지 전압, VD2는 상기 제2 데이터 전압, R1은 상기 제3 트랜지스터의 턴 온시 저항상태의 저항값, R2는 상기 제4 트랜지스터의 턴 온시 저항 상태의 저항값이다.)
을 만족하는 전압 값을 갖는 표시 장치. - 제 7 항에 있어서,
상기 제1, 제2, 및 제3 화소 전압들의 전압비는 1 : 0.75 내지 0.9 : 0.65 내지 0.75 이고, 상기 제1, 제2, 및 제3 화소 전극들의 면적비는 1 : 1.5 내지 2.5 : 4 내지 6 인 표시 장치. - 제 3 항에 있어서,
상기 제1 트랜지스터는,
상기 대응하는 제1 게이트 라인으로부터 분기된 제1 게이트 전극;
상기 대응하는 데이터 라인으로부터 분기된 제1 소스 전극; 및
상기 제1 화소 전극으로부터 분기된 제1 연결 전극에 전기적으로 연결된 제1 드레인 전극을 포함하고,
상기 제2 트랜지스터는,
상기 대응하는 제2 게이트 라인으로부터 분기된 제2 게이트 전극;
상기 대응하는 데이터 라인으로부터 분기된 제2 소스 전극; 및
상기 제2 화소 전극으로부터 분기된 제2 연결 전극에 전기적으로 연결된 제2 드레인 전극을 포함하고,
상기 제3 트랜지스터는,
상기 대응하는 제2 게이트 라인으로부터 분기된 제3 게이트 전극;
상기 대응하는 데이터 라인으로부터 분기된 제3 소스 전극; 및
상기 제3 화소 전극으로부터 분기된 제3 연결 전극에 전기적으로 연결된 제3 드레인 전극을 포함하고,
상기 제4 트랜지스터는,
상기 대응하는 제2 게이트 라인으로부터 분기된 제4 게이트 전극;
상기 제4 분기 전극과 전기적으로 연결된 제4 소스 전극; 및
상기 제3 드레인 전극으로부터 연장되고, 상기 제3 연결 전극에 전기적으로 연결된 제4 드레인 전극을 포함하는 표시 장치. - 제 1 항에 있어서,
상기 제3 트랜지스터의 저항값은 상기 제4 트랜지스터의 저항값보다 큰 표시 장치. - 삭제
- 제 1 항에 있어서,
상기 제1, 제2, 및 제3 화소 전극들 각각은,
십자 형상으로 구성되어 대응하는 화소를 복수의 도메인들으로 구획하는 줄기부;
상기 줄기부로부터 방사형으로 돌출되어 연장된 복수의 가지부들; 및
상기 복수의 가지부들 사이에 형성되는 복수의 미세 슬릿들을 포함하고,
상기 복수의 가지부들은 상기 줄기부에 의해 구획된 상기 각각의 도메인 내에서 서로 평행하게 연장되며 상기 각각의 도메인마다 서로 다른 방향으로 연장되는 표시 장치. - 제 1 항에 있어서,
상기 표시 패널은,
상기 화소들이 정의되는 제1 기판;
상기 제1 기판과 마주보며 공통 전극이 형성되는 제2 기판; 및
상기 제1 및 제2 기판들 사이에 개재되는 액정층을 더 포함하는 표시 장치. - 제1 게이트 라인들, 제2 게이트 라인들, 및 데이터 라인들에 대응되게 연결된 복수의 화소들을 포함하는 표시 패널을 포함하고,
상기 복수의 화소들 각각은,
대응하는 제1 게이트 라인 및 대응하는 데이터 라인에 연결된 제1 트랜지스터 및 상기 제1 트랜지스터에 연결된 제1 화소 전극을 포함하는 제1 서브 화소;
대응하는 제2 게이트 라인 및 상기 대응하는 데이터 라인에 연결된 제2 트랜지스터 및 상기 제2 트랜지스터에 연결된 제2 화소 전극을 포함하는 제2 서브 화소; 및
상기 대응하는 제2 게이트 라인 및 상기 대응하는 데이터 라인에 연결된 제3 트랜지스터, 상기 대응하는 제2 게이트 라인에 연결되며 스토리지 전압을 제공받는 제4 트랜지스터, 및 상기 제3 및 제4 트랜지스터들에 공통으로 연결된 제3 화소 전극을 포함하는 제3 서브 화소를 포함하고,
상기 화소들은 좌안 영상 신호와 우안 영상 신호를 포함하는 3차원 영상 신호들에 대응되는 데이터 전압들 및 블랙 데이터에 대응되는 데이터 전압들을 제공받고,
상기 화소들의 제1 서브 화소들은 상기 블랙 데이터에 대응되는 데이터 전압들을 제공받아 블랙 계조를 표시하고, 홀수 행의 화소들의 제2 서브 화소들 및 제3 서브 화소들은 상기 좌안 영상 신호에 대응되는 데이터 전압들을 제공받아 좌안 영상을 표시하고, 짝수 행의 화소들의 제2 서브 화소들 및 제3 서브 화소들은 상기 우안 영상 신호에 대응되는 데이터 전압들을 제공받아 우안 영상을 표시하는 표시 장치. - 제 15 항에 있어서,
상기 표시 패널 상에 배치되는 패턴 리타더를 더 포함하고,
상기 패턴 리타더는
상기 홀수 행에 배치되어 상기 좌안 영상을 투과하는 제1 리타더; 및
상기 짝수 행에 배치되어 상기 우안 영상을 투과하고 상기 제1 리타더와 광흡수축이 서로 수직한 제2 리타더를 포함하는 표시 장치. - 제1 게이트 라인들, 제2 게이트 라인들, 및 데이터 라인들에 대응되게 연결된 복수의 화소들을 포함하는 표시 패널을 포함하고,
상기 복수의 화소들 각각은,
대응하는 제1 게이트 라인 및 대응하는 데이터 라인에 연결된 제1 트랜지스터 및 상기 제1 트랜지스터에 연결된 제1 화소 전극을 포함하는 제1 서브 화소;
대응하는 제2 게이트 라인 및 상기 대응하는 데이터 라인에 연결된 제2 트랜지스터 및 상기 제2 트랜지스터에 연결된 제2 화소 전극을 포함하는 제2 서브 화소;
상기 대응하는 제2 게이트 라인 및 상기 대응하는 데이터 라인에 연결된 제3 트랜지스터, 상기 대응하는 제2 게이트 라인에 연결되며 스토리지 전압을 제공받는 제4 트랜지스터, 및 상기 제3 및 제4 트랜지스터들에 공통으로 연결된 제3 화소 전극을 포함하는 제3 서브 화소;
상기 대응하는 제1 및 제2 게이트 라인들과 평행하게 연장되는 제1 및 제2 스토리지 라인들;
상기 제1 스토리지 라인과 교차하는 방향으로 분기되어 서로 이격되어 연장된 제1 및 제2 분기 전극들; 및
상기 제2 스토리지 라인과 교차하는 방향으로 분기되어 서로 이격되어 연장된 제3 및 제4 분기 전극들을 포함하고,
상기 제1, 제2, 제3, 및 제4 트랜지스터들은 상기 제1 화소 전극 및 상기 제2 화소 전극 사이에 배치되고, 상기 제4 트랜지스터는 상기 제2 분기 전극에 연결되는 표시 장치. - 삭제
- 제 17 항에 있어서,
상기 제1 화소 전극은 상기 제1 스토리지 라인, 및 상기 제1 및 제2 분기 전극들과 부분적으로 오버랩되고, 상기 제2 화소 전극은 상기 제3 및 제4 분기 전극들과 부분적으로 오버랩되고, 상기 제3 화소 전극은 상기 제2 스토리지 라인, 및 상기 제3 및 제4 분기 전극들과 부분적으로 오버랩되는 표시 장치. - 제 17 항에 있어서,
상기 제1 트랜지스터는,
상기 대응하는 제1 게이트 라인으로부터 분기된 제1 게이트 전극;
상기 대응하는 데이터 라인으로부터 분기된 제1 소스 전극; 및
상기 제1 화소 전극으로부터 분기된 제1 연결 전극에 전기적으로 연결된 제1 드레인 전극을 포함하고,
상기 제2 트랜지스터는,
상기 대응하는 제2 게이트 라인으로부터 분기된 제2 게이트 전극;
상기 대응하는 데이터 라인으로부터 분기된 제2 소스 전극; 및
상기 제2 화소 전극으로부터 분기된 제2 연결 전극에 전기적으로 연결된 제2 드레인 전극을 포함하고,
상기 제3 트랜지스터는,
상기 대응하는 제2 게이트 라인으로부터 분기된 제3 게이트 전극;
상기 대응하는 데이터 라인으로부터 분기된 제3 소스 전극; 및
상기 제3 화소 전극에 전기적으로 연결된 제3 드레인 전극을 포함하고,
상기 제4 트랜지스터는,
상기 대응하는 제2 게이트 라인으로부터 분기된 제4 게이트 전극;
상기 제4 분기 전극과 전기적으로 연결된 제4 소스 전극; 및
상기 제3 드레인 전극으로부터 연장되고, 상기 제3 화소 전극에 전기적으로 연결된 제4 드레인 전극을 포함하는 표시 장치.
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Legal Events
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