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KR0133178B1 - 디지탈 데이타 정보 기록 재생 장치 - Google Patents

디지탈 데이타 정보 기록 재생 장치

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Publication number
KR0133178B1
KR0133178B1 KR1019880003861A KR880003861A KR0133178B1 KR 0133178 B1 KR0133178 B1 KR 0133178B1 KR 1019880003861 A KR1019880003861 A KR 1019880003861A KR 880003861 A KR880003861 A KR 880003861A KR 0133178 B1 KR0133178 B1 KR 0133178B1
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KR
South Korea
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digital data
data information
data
recording
recorded
Prior art date
Application number
KR1019880003861A
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English (en)
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KR880013154A (ko
Inventor
겐따로 오다까
신야 오자끼
마사끼 야마다
히로시 이시바시
요시즈미 이나자와
Original Assignee
오오가 노리오
소니 가부시끼가이샤
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Filing date
Publication date
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Priority claimed from JP14817487A external-priority patent/JP2576509B2/ja
Priority claimed from JP15834687A external-priority patent/JP2576511B2/ja
Priority claimed from JP62158885A external-priority patent/JPS644981A/ja
Application filed by 오오가 노리오, 소니 가부시끼가이샤 filed Critical 오오가 노리오
Publication of KR880013154A publication Critical patent/KR880013154A/ko
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Abstract

내용없음.

Description

디지탈 데이타 정보 기롬 재생 장치
제1도는 본 발명의 기록 재생 장치 실시예의 전체 장치를 도시한 회로 블록도.
제2도, 3a도 내지 3c도는 본 발명의 기록 재생 장치에 의해 기록 매체상에 형성된 기록 패턴의 실시예를 각각 도시한 도면.
제4도는 본 발명의 기록 재생 장치의 또다른 실시예의 전체 장치를 도시한 회로 블록도.
제5a도 내지 5c도 및 6도는 본 발명의 기록 재생 장치에 의해 기록 매체상에 형성된 기록 패턴의 또다른 실시예를 각각 도시한 도면.
제7도는 신드록 발생 회로의 실시예를 도시한 회로 블록도.
제8a도 내지 8e도는 본 발명의 재생 장치의 동작을 설명하는데 사용되는 타이밍도.
제9도는 DAT 포맷을 도시한 도면.
제10도는 서브코드 영역에 포함된 패킷의 기록 포맷을 도시한 표.
제11a도 및 11b도는 DAT 포맷의 ID 구성을 도시한 도면.
제12도는 에러 정정용 신드롬을 발생시키기 위한 프로그램을 도시한 흐름도.
* 도면의 주요 부분에 대한 부호의 설명
1 : 디지탈 오디오 테이프 레코더(DAT)
11 : 로터리 헤드 드럼 12 : 자기 테이프
14 : 디지탈 신호 처리기 19 : 테이프 이송 메카니즘
23 : DMA 회로 24 : 버퍼 메모리
본 발명은 디지탈 데이타를 기록 재생하기 위한 장치에 관한 것이다. 특히, 본 발명은 컴퓨터 등으로부터의 데이타를 기록하는데 사용되는 로터리 헤드형 디지탈 오디오 테이프 레코더(R-DAT)에 관한 것이다.
하드 디스크상에 수록된 컴퓨터 발생 데이타를 보호하기 위해, 상기 데이타는 가끔 데이타 스트리머(data streamer)(또는 데이타 레코더)에 전송되어 하루에 한 번씩 다른 기록 매체상에 기록(또는 백업)된다.
대부분의 경우, 종래의 데이타 스트리머는 소위 아나로그 오디오 테이프 레코더이다. 그러나, 상기 아나로그 오디오 테이프 레코더는 대용량의 기록 매체(즉, 테이프)를 필요로 한다. 또, 상기 종래의 데이타 스트리머는 기록시에 낮은 데이타율을 가지므로 데이타 전송 및 기록에 상당한 시간이 소요된다. 또, 아나로그 오디오 테이프 레코더에서 원하는 기록된 데이타의 시작점을 찾아내기가 쉽지 않다.
예컨대 컴퓨터로부터 발생된 데이타가 종래의 오디오 테이프 레코더상에 기록될 때 레코더에는 컴퓨터로부터 임의의 파일마크 신호가 공급된다. 재생시에, 컴퓨터 지정 어드레스에 대한 파일 마크의 위치 번호가 탐색된다. 종래의 아나로그 오디오 테프크 레코더는 통상의 재생동작에서의 파일 마크의 재생신호를 카운트함으로써 파일마크의 위치 번호를 찾기 때문에, 원하는 파일마크를 찾는데 상당한 시간이 소요된다. 따라서, 파일마크의 위치 번호를 찾는 것은 어렵다.
DAT(디지탈 오디오 테이프 레코더)는 소니사의 시바우라 공장에서 ISSN 0389-7737로 1985년에 공표된 ES 리뷰 페이지 11 내지 14에 기술된 바와 같이 개발되었다. 상기 DAT는 디지탈화된 오디오 신호인 디지탈 신호를 기록 재생하도록 설계되어 있으므로, 상술한 데이타를 기록하기에 매우 적절하다.
그러나, 통상 DAT 기록 헤드의 폭은 트랙 피치보다 크므로, 선행 트랙의 일부가 현재 트랙에 의해 삭제되며, 데이타는, 두 인접 트랙 사이의 보호대 제공없이 부분적으로 중복된 트랙에 기록된다. 이것은 예컨대 기록된 데이타의 일부가 재생되어 편집된 후 다시 기록될 때 문제점을 야기시킬 것이다. 재생 및 편집 동작은 쉽게 실행될 수 있겠지만, 편집된 데이타를 다시 기록하는 것이 어렵다.
특히, 데이타가 상술한 부분 중첩 트랙내에 기록될 때, 만약 편집된 데이타가 재기록되면, 데이타가 이미 기록된 후행 트랙이 삭제된다. 왜냐하면, 기록 헤드의 헤드폭은 트랙폭보다 크기 때문이다. 따라서. 보전되어야 할 데이타가 손상된다.
상기 문제점에 대처하기 위해, 본 발명의 양수인은, DAT를 사용하여 데이타가 한꺼번에 기록되는 각각의 기록 영역의 개시부 및 종단부에 앰블 신호 구간을 제공함으로써 데이타 정보를 만족스럽게 기록할 수 있는 장치를 제안했다.(1987년 12월 15일자로 출원된 미합중국 특허원 제133,010호와 부분적으로 대응하는 일본국 일허원 제61-314922호 참조). 그러나, 상기 장치는 선행 기록동작에서 기록된 모든 데이타를 재기록해야 하므로, 용량이 큰 데이타가 존재한다면, 그 데이타를 재생하여 기록하는데 긴 시간이 필요하다.
상술한 바와 같이, 종래의 DAT가 데이타 레코더로 사용되면, 먼저 기록된 데이타는 다시 쉽게 기록될 수 없다는 등의 문제점이 발생된다.
DAT에 의해 기록된 데이타 신호는 리드-솔로몬 코드와 같은 에러 정정 코드를 포함한다. 또, DAT는 오디오 신호 즉, 다소 연속적인 아나로그 신호를 기록하기 위해 의도된 것이기 때문에, 비록 에러가 에러 정정 코드에 의해 교정될 수 없어도, 선행값 홀딩과 같은 보간 기술에 의해 쉽게 보상될 수 있다.
그러나, DAT가 데이타 레코더로 사용될 때, 디지탈 데이타의 불연속 특성으로 인해 선행값 홀딩과 같은 보간 기술에 의한 데이타 보상이 실행될 수 없으므로 에러가 에러 정정 코드에 의해 교정되지 않으면 에러성 데이타는 더 이상 재생될 수 없다.
상술한 문제점을 고려하여, 본 발명의 목적은 개선된 디지탈 데이타 정보 기록 재생 장치를 제공하는 것이다.
본 발명의 또다른 목적은 DAT를 사용하여 디지탈 데이타 정보를 기록 재생하는 장치를 제공하는 것이다.
본 발명의 또다른 목적은 컴퓨터 등으로부터 고속, 고밀도, 고충실도로 디지탈 데이타 정보를 기록 재생할 수 있는 디지털 데이타 정보 기록 재생 장치를 제공하는 것이다.
본 발명의 또다른 목적은 임의의 길이의 데이타 시퀀스에 대해 에러 정정 코드의 발생을 허용하며 임의 길이의 데이타 신호를 매끄럽게 기록할 수 있는 디지탈 데이타 정보 기록 재생 장치를 제공하는 것이다.
본 발명에 따르면, 기록 매체상에 디지탈 데이타 정보를 기록하기 위한 장치로서, (1) 입력된 디지탈 신호를, 로터리 헤드에 의해 형성된 두 경사 트랙으로 이루어진 한 프레임에 기록하는 기록 수단과, (2) 소정의 각 프레임 부분의 디지탈 데이타 정보를 배분하여, 배분된 디지탈 데이타 정보 기록 수단에 제공하는 제어 수단을 구비하는 디지탈 데이타 정보 기록 재생 장치가 제공된다.
이하, 첨부된 도면으로 본 발명의 상기 목적, 형태 및 장점을 기술하기로 한다.
제1도를 참조하면, 본 발명의 제1실시예에 따르는 데이타 레코더는 디지탈 오디오 테이프 레코더(DAT : 1)를 포함한다. 상기 디지탈 오디오 테이프 레코더(1)에는 헤드 드럼(11)이 제공되며, 로터리 헤드 드럼(11)의 바깥쪽 표면 둘레에 헤드 여정(travel)의 약 90인 각도 범위에 걸쳐 자기 테이프(12)가 감기어, 테이프 이송 메카니즘(19)에 의해 헤드 드럼(11)을 지나 이송된다. 로터리 헤드 드럼(11)에는 두 로터리 헤드 A 및 B가 장착되며, 제2도에 보다 명확하게 도시된 바와 같이, 로터리 헤드 드럼(11)이 한 번 회전할 때마다 로터리 헤드 A 및 B에 의해 두 개의 경사 트랙이 기록 재생된다.
입력 디지탈 데이타는 DAT(1)의 I/O(입출력) 회로(13)에 공급된다. I/O 회로(13)로부터의 디지탈 데이타는 디지탈 신호 처리기(14)에 공급되어, DAT 포맷으로 변환된다. DAT 포맷에 따라 변환된 디지탈 신호는 기록 증폭기(15) 및 기록/재생 전환 스위치(16)의 기록 접촉부 R을 통해 로터리 헤드 A 및 B에 제공되어, 테이프(12)상에 기록된다.
테이프(12)상에 기록된 신호가 로터리 헤드 A 및 B에 의해 재생될 때, 재생된 신호는 기록/재생 전환 스위치(16)에 재생측 접촉부 P 및, 재생 증폭기(17)를 거쳐 디지탈 신호 처리기(14)에 공급되며, 여기서, 재생 신호는 디지탈 데이타로 재변환되어 I/O 회로(13)를 통해 외부로 전달된다.
또한, DAT(1)의 시스템 제어 회로(18)에 입력 제어 신호가 공급된다. 시스템 제어 회로(18)로부터의 신호에 기초하여, 로터리 헤드 드럼(11)이 회전되고, 테이프 이송 메카니즘(19)이 테이프(19)를 이송하고, 기록/재생 전환 스위치(16)가 위치를 변경하도록 제어된다. 또, 기록시에, 시스템 제어 회로(18)로부터의 신호는 디지탈 신호 처리기(14)에 공급되며, 그에따라 상기 처리기는 후술하는 서브코드 신호 등을 발생시킨다. 재생시에는 디지탈 신호 처리기(14)에 의해 추출되는 신호가 시스템 제어 회로(18)에 공급됨으로써 트랙킹 제어 동작이 행해지며, 상기 신호의 일부가 외부로 공급된다.
상기 디지탈 오디오 테이프 레코더(1)에서는 DA(디지탈-아나로그)/AD(아나로그-디지탈) 변환회로를 I/O 회로(13)의 출력에 접속시키고, 소정의 제어장치를 시스템 제어 회로(18)의 출력에 접속시킴으로써, 아나로그 오디오 신호를 기록 재생시킬 수 있다.
그러나, 본 발명에서는 인터페이스 버스(3)가 외부 장치로서의 제어기(2)를 통해 디지탈 오디오 테이프 레코더(1)에 접속된다. 인터페이스 버스(3)는 예컨대 SCSI(소형 컴퓨터 시스템 인터페이스) 표준(니혼게이자이 신문사에 의해 1986년 10월 6일자 출판된 NIKKEI ELECTRONICS의 페이지 102 내지 107 참조)에 따르는 유형이 될 수 있다. 이 인터페이스 버스(3)에는 호스트 어댑터(4)를 통해 호스트 컴퓨터(5) 및 HDD(하드 디스크 드라이브 : 6)가 접속된다.
상술한 제어기에 있어서, 프로토콜 제어회로(21)가 인터페이스 버스(3)에 접속되어 있다. 프로토콜 제어회로(21)를 통해, 데이타 및 제어 신호가 제어기(2)의 동작을 제어하는 마이크로 컴퓨터(22)와, 메모리 제어 또는 DMA(다이나믹 메모리 엑세스) 회로(23) 및 버스(3) 사이에서 교환된다. 마이크로 컴퓨터(22)는 제어기(2)가 동작을 제어할 뿐 아니라 DMA 회로(23)의 동작을 제어한다. 또, 데이타는 DMA 회로(23)를 통해 버퍼 메모리(24)와 인터페이스 버스(3) 사이에서 교환된다. 또, 데이타는 I/O회로(25 및 13)을 통해 버퍼 메모리(24)와 DAT(1)에 제공된 디지탈 신호 처리기(14)사이에서 교환된다. 또, 제어 신호 마이크로 컴퓨터(2)와 시스템 제어 회로(18)사이에서 교환된다.
따라서, 상기 장치에 있어서, 하드 디스크 드라이브(6)에 수록된 데이타는 기록중에 제어기(2)로부터의 전달 요청에 응답하여 인터페이스 버스(3)를 통해 제어기(2)에 공급되며, DMA 회로(23)를 통해 버퍼 메모리(24)내에 수록된다. 버퍼 메모리(24)에 수록된 데이타는 I/O 회로(25)를 통해 판독되어 디지탈 오디오 테이프 레코더(DAT : 1)에 공급된다. 디지탈 오디오 테이프 레코더(1)에서, I/O 회로(13)에 입력된 데이타는, 오디오 신호가 기록될 때 A/D 변환회로로부터 추출되는 데이타와 동일한 것으로 간주된다. 따라서, 상기 데이타는 디지탈 신호 처리기(14)에 의해 소정의 DAT 포맷에 따라 변환되어, 로터리 헤드 A 및 B에 의해 테이프(12)상에 기록된다.
재생시, 헤드 A 및 B에 의해 테이프(12)로부터 재생된 신호는 디지탈 신호 처리기(14)에 의해 다시 변환되어, 오디오 신호에 대응하는 데이타가 생성된다. 상기 데이타는 I/O 회로(13)를 통해 제어기(2)에 제공된다. 제어기(2)에서, I/O 회로(25)를 통해 버퍼 메모리(24)에 수록된 데이타는 DMA 회로(23)를 통해 판독된 후 인터페이스 버스(3)를 통해 하드 디스크 드라이브(6)에 수록된다.
기록동작 동안에, 호스트 컴퓨터(5)는 2m(예로서 512)의 단이 비트로 DAT(1)에 데이타 신호를 전달시킨다. 따라서, 버퍼 메모리(24)에 기억된 데이타는 디지탈 신호 처리기(14)에 제공되어 2m비트의 데이타가, 드럼(11)의 한 회전에 의해 형성된 2개의 경사 트랙으로 이루어진 한 프레임에 기록된다(일본국 특허원 제61-303080호 참조).
상기 기록 모드에 있어서, 버퍼 메모리(24)의 판독은 예컨대 소정수의 데이타 프레임이 테이프에 기록될 때마다 의미없는 데이타의 한 개 내지 수개의 프레임 부분이 기록되는 식으로 제어된다.
상기 기록 모드는 제2도를 참조로 더욱 상세히 설명되는데, 제2도는 기록 동작에 있어서 한번에 기록되는 전데이타를 나타낸다. 먼저, 엠블신호의 복수의 프레임(빗금친 트랙)이 테이프의 개시부(제2도에서 좌측부)에 기록되면 데이타 신호의 N 프레임이 엠블신호 다음에 기록된다. 다음에, 의미없는 의사 신호의 한 프레임(빗금친 트랙)이 데이타 신호의 N 프레임 다음에 기록된다. 데이타 신호의 N 프레임 및 의사 신호의 한 프레임은 반복적으로 기록된다. 최종적으로, 데이타 신호의 잔존 m 프레임(m＜n)이 기록되며, 복수의 엠블신호가 그 후에 기록된다. 제3a도는 어떻게 데이타 신호가 의사 신호사이에서 기록되는가를 상세하게 도시하는 데, 여기서 데이타 신호의 N 프레임을 기록하는 구간은 로터리 헤드 드럼(11)의 헤드 A 및 B에 의해 기록된 의사 신호(빗금으로 표시)의 한 프레임후에 제공되며, 의사 신호의 다른 프레임이 데이타 신호 기록 구간후에 제공된다. 두 의사 신호 기록 구간 사이의 원하는 데이타 신호는, 예컨대 재생되는 동안에 데이타 신호내에 포함되어 있는 프레임 번호 등을 나타내는 신호와 같은 타이밍 신호를 사용함으로써 추출된다.
제3b도에 도시된 것처럼, 데이타 신호가 편집 등의 처리후에 재기록될 때에는 재기록될 데이타 신호가 기록되는 테이프 위치로 드럼(11)의 로터리 위상 서보가 진행되는 상태에서, 헤드 B에 의한 의사 신호의 후반부가 우선 기록된 후, 데이타 신호의 N 프레임이 기록되며, 헤드 A에 의한 의사 신호만이 다음에 기록된다. 따라서, 재기록은 끝난다.
상기 과정에 있어서, 재기록 동작은 제3c도에 도시된 바와 같이 이행된다. 재기록의 종단부에서, 헤드 B에 의해 앞서 기록된 트랙의 부분은 트랙폭보다 넓은 폭을 가진 헤드 A에 의해 삭제된다. 그러나, 삭제된 트랙에는 의사 신호만이 기록되어 있으므로 어떠한 문제도 발생되지 않는다.
상술된 바와 같이, 의사 신호 프레임사이에 기록된 데이타 신호는 임의로 재기록될 수 있으므로, 기록된 데이타 신호의 편집, 수정 등이 쉽게 이행될 수 있다.
의사 신호 프레임사이에 기록될 데이타 신호의 N 프레임은 기록된 트랙수로부터 정해질 수 있다. 이것과는 별도로, 예컨대 본 발명의 양수인이 일본국 특허원 제62-4434호에서 기술한 바와 같이, 데이타 신호가 기록 에러가 발생될 때 반복하여 기록되면, 프레임수 n은 기록된 프레임의 실질적인 개수가 되도록 선택될 수 있다.
일반적으로, 의사 신호의 한 프레임으로 충분하다. 그러나, 데이타 신호가 상술한 바와 같이 반복하여 기록되는 동안 재기록중에 에러가 증가하면, 증가한 양을 고려하여, 복수의 의사 신호의 프레임이 제공될 수도 있다.
또, 이 경우에, 데이타 신호의 거의 N 프레임을 기록하기 위해 최대로 요구되는 트랙의 수가 기록 매체에 따라 가정된 에러 발생비 등에 의해 결정되고, 다음에, 의사 프레임사이의 트랙수가 결정된 트랙수에 따라 세트될 수 있다. 이 방법은 의사 신호들의 기록 위치가 레코딩 매체상에서 항상 일정하게 되도록 허용한다. 그러므로, 엠블 신호들이 기록되는 프레임 구간이 고속 탐색 동작 등에 의해 검출 가능한 구간인지를 결정함으로써, 원하는 기록 부분이 검출후에 그것의 거리를 근거로 테이프로부터 취해질 수 있다.
상술된 바와 같이, 이 실시예에 따라서, 디지탈 신호의 선정된 수의 프레임들이 기록될 때마다 의미없는 데이타의 한개 내지 수개의 프레임들이 기록되기 때문에, 의미없는 데이타 프레임들이 데이타 신호의 재기록시에 또한 기록된다면, 재기록은 필요한 데이타 신호의 임의 부분을 파괴함 없이 부드럽게 실행될 수 있다. 따라서, DAT가 장비된 만족스런 데이타 레코더를 제공하는 것이 가능하다.
다음에 본 발명의 제2실시예가 제4도를 참조로 설명될 것이다. 제1도의 부분들에 대응하는 제4도의 부분들은 동일한 참조 번호를 사용하여 지정되어 있으며, 중복부분들의 상세한 설명은 생략한다.
제1도에 도시된 실시예에서처럼, 제4도의 제어기(2)에는 버스(3)와 접속되는 프로토콜 제어기(2)가 제공된다. 제어기(2)와 메모리 제어기(DMA)(23)의 동작을 제어하는 마이크로 컴퓨터(22)는 프로토콜 제어기(21)를 통해 데이타 및 제어 신호를 버스(3)와 통신한다. 마이크로 컴퓨터(22)는 DMA(23)를 통해 버스(3)와 통신한다.
그러나, 이 실시예에서, 메모리(24)에는 버퍼 메모리(24)에 저장되는 데이타에 대한 에러 정정 코드를 발생시키는 에러 정정 코드(ECC) 발생 회로(26)가 제공된다. 이러한 에러 정정 코드는 또한 버퍼 메모리(24)의 소정의 영역에 저장된다.
버퍼 메모리(24)는 I/O 회로(13 및 25)를 통해 DAT(1)의 처리회로(14)와 통신한다. 또한 마이크로 컴퓨터(22)는 제1도에 도시된 실시예에서와 비슷하게 DAT(1)의 시스템 제어기(18)와 통신한다.
제4도에 도시된 전술된 구조로, 하드 디스크 유닛(6)에 저장된 데이타는 제어기(2)에 의한 전송 요청에 응답하여 버스(3)를 통해 제어기(2)에 공급되어 기록 DMA(23)를 통해 버퍼 메모리(24)에 저장된다. ECC 발생회로(26)는 마이크로 컴퓨터(22)의 제어하에, 버퍼 메모리(24)에 저장된 데이타에 대한 에러 정정 코드를 발생시킨다. 에러 정정 코드를 포함하는 데이타는 버퍼 메모리(24)로부터 차기 판독되어 I/O 회로(13)를 통해 DAT(1)에 공급된다.
DAT(1)에서, I/O 회로(13)에 공급된 데이타는 A/D 변환기로부터의 오디오 데이타와 마찬가지로 디지탈 신호 처리기(14)에 의해 처리되어, 소정의 DAT 포맷으로 변환된 후에 헤드 A 및 B에 의해 테이프(12)상에 기록된다.
DAT 포맷은 원래 데이타의 5760 바이트가 드럼(11)의 한회전에 의해 형성되는 두 개의 경사트랙으로 구성되는 1프레임에 기록될 수 있도록 한 것이다. 한 유닛이 12프레임으로 구성되는 경우, 11프레임은 각각 데이타의 5760 바이트를 기록하는데 사용되고 나머지 1프레임은 단지 데이타의 2176 바이트를 기록하는데 사용된다. 이 나머지 바이트들은 무효 데이타들이다. 이런식으로, 65536 바이트(64 킬로바이트)가 전술된 1 유닛(12프레임)내에 기록될 수 있다.
데이타의 64킬로바이트가 버퍼 메모리(24)내에 저장되었을 때, ECD 발생회로(26)는 에러 정정 코드를 발생시킨다. 이런 에러 정정 코드로는 리드-솔로몬 코드가 사용된다. 데이타의 12프레임에는 예컨대 에러 정정 코드의 2프레임 부분이 제공된다. 발생된 에러 정정 코드는 버퍼 메모리(24)의 소정의 영역에 저장된다.
기록동안, 버퍼 메모리(24)는 에러 정정 코드의 첫번째 1프레임부분, 다음에 데이타 신호의 12프레임부분, 마지막으로 에러 정정 코드의 1프레임 부분이 버퍼 메모리(24)로부터 판독되어, I/O 소자(25,13)를 거쳐 헤드 A 및 B에 의해 기록되는 식으로 마이크로 컴퓨터(22)에 의해 제어된다.
이렇게 테이프(22)상에 만들어진 기록 패턴은 제5a도에 도시된 바와 같다. 제5a도에서 에러 정정 코드(ECC) 신호의 1프레임은 데이타 신호(그 일부는 도면에서 생략됨)의 후속 12프레임과 ECC 신호의 또다른 프레임 앞에 위치하며, 이들 프레임은 로터리 드럼(11)상에 장착된 헤드 A 및 B에 의해 각각 기록된다. 재생시에, ECC 프레임들 사이에 위치한 원하는 데이타 신호들은 데이타 신호에 포함되어 있는 프레임수 등을 나타내는 신호와 같은 타이밍 신호의 사용에 의해 획득된다.
이제, 예컨대 재기록될 데이타 신호들이 기록되기 전에 테이프 위치로부터 회전 위상 서보 등에 의해 드럼(11)이 서보 제어되는 조건하에서, 편집 등의 처리가 실행된 후에 데이타 신호가 재기록된다고 가정한다. 이런 조건하에서 헤드 B에 의해 본래 기록된 ECC 프레임내의 ECC 신호의 후반부가 먼저 기록되고, 그후 데이타 신호의 12프레임이 기록되고, 헤드 A에 의해 본래 기록된 ECC 신호가 제5b도에 도시된 바와 같이 기록된다. 그 후 재기록이 끝난다.
상술된 처리에 의해, 재기록은 제5c도에 도시된 바와 같이 달성된다. ECC 신호의 1프레임 부분이 재기록에 의해 삭제되었음을 제5c로부터 알 수 있다. 이런 ECC 신호의 삭제에 의해 재생시에 에러 정정 능력이 다소 격하될지라도, 데이타 신호들은 보존되기 때문에, 일반적인 사용에서는 문제가 발생하지 않을 것이다.
상술된 바와 같이, 제2실시예에 따른 장치는 ECC 프레임들 사이에 위치한 데이타 신호를 임의로 기록하는 것을 허용한다. 그러므로, 편집, 수정 등이 기록된 데이타 신호에 대해 쉽게 실행될 수 있다.
부수적으로, 에러 정정 코드의 k프레임이 데이타 신호에 대해 제공될 때, 데이타 신호의 k프레임까지 발생하는 에러를 정정하는 것이 가능하다. 그러므로, 수록후 판독 헤드가 기록된 데이타 신호내의 에러를 검사하는데 사용될 때, k프레임까지에서 발생되는 에러들이 무시되면서 데이타 신호들이 기록될 수 있다. 그러므로, 예컨대, 기록동안 에러가 발생될 때 데이타 신호들을 반복해서 기록하는 절차는 크게 단순화될 수 있다.
에러들이 데이타 신호의 k번째 프레임 이후에 발생될 때, ECC 프레임들 사이의 데이타 신호의 전체 블록은 반복 기록될 수 있다. 데이타 신호들이 ECC 프레임에 의해 충분히 작은 블록으로 분할되기 때문에, 데이타 신호 블록을 반복 기록하는 것은 쉽다.
값 k는 첫번째 재기록시 k-1로 대체되어야 한다.
또한, 선행된 재기록시에 삭제되지 않고 남아 있는 ECC 프레임의 잘못된 검출을 예방하기 위해 예컨대 각 프레임에는 재기록의 수를 나타내는 ID 코드가 삽입될 수 있다. 그런 ID 코드에 의해, 재기록의 수와 동일한 값을 가지고 있는 프레임을 제외한 프레임을 무시하는 것이 가능하다.
또한, 각각의 트랙사이에 인터리브될 수 있는 데이타 시퀀스를 에러 정정 코드를 발생시키는데 사용된 데이타로 사용함으로써, 테이프상의 수평 스크래치 등에 의해 발생된 에러를 정정할 수 있는 능력을 향상시키는 것이 가능하다.
또한, 제2실시예에서, ECC가 고급 장치를 위해 제공된 모든 ECC 프레임에 기록되도록, 또는 ECC가 ECC 프레임의 일부에만 기록되고 저급 장치를 위한 나머지 부분에는 의미없는 데이타가 기록되도록, 충분한 ECC 프레임수를 제공하는 것이 가능하다.
제2실시예의 장치에 따라, 상술된 바와 같이, 기록동안, 데이타 신호의 소정 개수의 프레임이 기록될 때마다 에러 정정 코드의 한개 내지 수개의 프레임이 의사 신호 대신 기록되므로, 에러 정정 능력은 크게 향상될 수 있다. ECC 프레임들은 또한 재기록중에도 기록되므로, 필요한 데이타 신호들이 파괴됨 없이 부드럽게 재기록되어 DAT를 사용하는 만족스런 데이타 레코더가 제공될 수 있다.
실제로 에러 정정 코드가 기록 동작에서 대응하는 프레임에 어떻게 기록되는 지를 예를 들어 설명한다.
DAT 포맷은 제6도에 도시된 바와 같이, 왼쪽 채널의 짝수 데이타가 1프레임의 1트랙(플러스 방위)의 전반부에 기록되고, 오른쪽 채널의 홀수 데이타가 동일 트랙의 후반부에 기록되며, 오른쪽 채널의 짝수 데이타가 동일 프레임의 다른 트랙(마이너스 방위)의 전반부에 기록되고, 왼쪽 채널의 홀수 데이타가 동일 트랙의 후반부에 기록되는 식으로, 드럼(11)의 1회전에 의해 형성된 두 경사 트랙으로 이루어지는 1프레임내에 데이타가 인터리브되도록 되어 있다. 제6도의 각 트랙의 중앙에 기록된 참조 문자 C는 DAT(1)에 의해 각 트랙에 부가된 에러 정정 코드를 나타낸다. 에러 정정 코드 발생시에, 각 프레임의 2n번째(짝수) 데이타 및 (2n+1)번째(홀수) 데이타는 데이타 시퀀스를 형성하도록 취해지며, 그에 따라 테이프(12)상의 인터리브된 데이타 시퀀스에 대한 에러 정정 코드 프레임에 기록될 에러 정정 코드가 발생된다.
에러 정정 코드 발생 매트릭스는 예컨대 다음과 같이 데이타 시퀀스에 대해 배열된다.
Figure kpo00001
데이타 섹션 패리티 섹션
이렇게 발생된 매트릭스에 대해 예컨대 제7도에 도시된 바와 같이 신드롬 발생회로가 형성된다. 특히, 도면 좌측이 단자(31)에 공급된 데이타 신호는 가산기 회로(32a 내지 32d)에 공급된다. 가산기 회로(32a 내지 32d)로부터의 출력 신호들은 직접 그리고 α, α2, α3의 계수를 각각 갖고 있는 계수 회로(33b 내지 33d)를 통해 신드롬 레지스터(34a 내지 34d)에 각각 공급된다. 신드롬 레지스터(34a 내지 34d)로부터 출력된 신호들은 가산기 회로(32a 내지 32d)로 각각 피드백된다. 이렇게, 신드롬들은 데이타 신호가 가산기 회로(32a 내지 32d)에 공급될 때마다 실행되는 피드백에 의해 레지스터(34a 내지 34d)에서 발생된다.
그러므로, 데이타 신호가 단자(31)에 공급될 때마다, 상기 매트릭스의 데이타 섹션의 오른쪽으로부터 계산이 실행된다. 일반적으로, 예컨대 데이타의 251 심볼이 공급될 때 신드롬들이 레지스터(34a 내지 34d)로부터 발생된다. 그렇게 발생된 신드롬들은 상기 매트릭스의 패리티 섹션에 대응하는 계산회로(35)에 공급되어 4심볼 에러 정정 코드를 발생시킨다. 데이타 시퀀스가 계산이 진행되는 동안 종료되면, 레지스터(34a 내지 34d)는 데이타 시퀀스에 근거한 계산이 실행된 점으로부터 왼쪽에 위치한 신드롬의 모든 요소에 0이 공급되는 것과 같은 신드롬을 각각 발생시킨다. 이때, 레지스터(34a 내지 34d)들은 동작하지 않게 되고, 그들 각각의 내용이 계산 회로(35)에 공급됨으로써, 그때까지 신드롬 발생회로에 공급된 데이타에 대한 에러 정정 코드가 발생된다.
이러한 처리에 의해서, 에러 정정 코드는 부드럽게 발생되어 임의 가변 길이의 데이타 시퀀스에 부가될 수 있다. 이 경우에, 상술된 신드롬 발생회로는 실제로 마이크로 컴퓨터 등의 소프트웨어에 의해 실현된다. 요구되는 하드웨어는 신드롬 레지스터(34a 내지 34d)에 대응하는 메모리 영역뿐이므로, 상기 장치는 간단한 구조로 실현될 수 있다. 즉, 레지스터(34a 내지 34d) 각각의 메모리 용량은 1트랙에 대한 데이타 양의 4배이므로, 신드롬 발생회로는 극히 작은 메모리 용량과 적절히 프로그램된 마이크로 컴퓨터로 쉽게 구성될 수 있음이 이해될 것이다.
제12도를 참조하면, 그러한 신드롬 발생 프로그램에 대한 흐름도가 예시되어 있다. 프로그램은 스텝 SP1에서 시작하고, 데이타 신호는 스텝 SP2에서 입력된다. 스텝 SP3에서, 입력 데이타 신호는 메모리 M1(메모리 유닛(24)내에 존재함)에 저장된 데이타 신호에 부가되며, 부가된 데이타 신호는 버퍼 메모리(24)의 메모리 영역 M2에 저장된다.
입력 데이타 신호는 스텝 SP4에서 메모리 영역 M2내에 저장된 데이타 신호에 부가된다. 부가된 데이타 신호는 계수 α만큼 증배된다. 증배된 데이타 신호는 메모리 영역 M2에 저장된다. 스텝 SP5에서, 입력 데이타 신호는 버퍼 메모리(24)의 메모리 영역 M3에 저장된 데이타 신호에 부가되고, 부가된 데이타 신호는 계수 α2만큼 증배된다. 증배된 데이타 신호는 메모리 영역 M3에 저장된다.
다음에, 입력 데이타 신호는 버퍼 메모리 영역(24)의 메모리 영역 M4 내에 저장된 데이타 신호에 부가된다. 부가된 데이타 신호는 계수 α3만큼 증배된다. 증배된 데이타 신호는 스텝 SP6에서 메모리 영역 M4에 저장된다. 스텝 SP7에서 입력 데이타 신호가 끝났는지가 결정된다. 대답이 아니오이면, 과정은 스텝 SP2로 돌아간다. 대답이 예이면, 과정은 스텝 SP8로 진행하며, 스텝 SP8에서, 4개의 에러 정정 코드들이 매트릭스 계산에 의해 메모리 영역 M1,M2,M3 및 M4 내에 저장된 데이타 신호로부터 발생된다.
발생된 에러 정정 코드는 임의 가변 길이의 데이타 신호를 부드럽게 기록하기 위해 데이타 신호 다음에 DAT(1)에 공급됨으로써, DAT를 사용하는 만족스런 데이타 레코더가 제공되는 것이 가능하게 된다.
상술된 실시예에서, 두 개의 심볼이 에러 정정 코드를 발생시키기 위해 데이타 시퀀스의 각 프레임으로부터 취해지기 때문에, 발생된 4심볼 에러 정정 코드는 2프레임(4트랙)에 기록될 수 있다.
만약, 특정 예로서, 에러 정정 코드가 2심볼로 구성된다고 가정한다면, 예컨대, 다음의 매트릭스가 사용될 수 있다.
Figure kpo00002
데이타 섹션 패리티 섹선
이 매트릭스에 의해 계산회로(35)는 불필요하게 된다.
다음에 제8a 내지 8e도를 참조로, 에러 정정 처리가 상술된 장치에 의해 재생중에 어떻게 실행되는지를 설명한다.
먼저, 데이타 신호와 에러 정정 코드(ECC)는 제8a도에 도시된 바와 같이 재생된다. DAT(1)가 제8b도에 도시된 바와 같이 정정될 수 없는 에러를 갖는 프레임이 존재한다는 것을 검출하면, 먼저 데이타가 직접 출력되는 상태가 제8c도에 도시된 바와 같이 중지된다. 그러나, 이때 데이타 신호들은 신드롬 발생회로에 연속해서 제공되므로 신드롬 발생회로는 에러 정정 코드의 재생이 종료된 때에 잘못된 프레임내의 에러를 정정하기 위한 데이타를 발생시킨다. 이런 상태로부터, DAT(1)는 제8d도에 도시된 바와 같이 테이프를 되감도록 지시받는다. 그후, 제8e도에 도시된 바와 같이, DAT(1)는 다시 처음부터 데이타 신호의 재생을 시작하는데, 여기서는 신드롬 발생회로에 의해 발생된 에러 정정 데이타가 검출된 잘못된 프레임에 대해 삽입된 후 전체 데이타 신호들이 재생된다.
에러가 데이타 프레임에서 발견되지 않을 때, 데이타 신호들은 그 상태로 재생되어 임의의 다른 처리없이 버스(3)에 출력된다. 상술된 처리는 에러가 데이타 프레임내에서 발견될 때만 실행된다. 그러므로, 데이타 신호들은 전체적으로 아주 빠르게 재생될 수 있다.
상술된 에러 정정은, 앞서의 매트릭스 등의 데이타 섹션내에 모든 데이타를 저장하기 위한 큰 용량의 버퍼 메모리를 제공할 필요없이, DAT(1)로부터 다시 재생된 데이타 신호를 사용함으로써 신드롬 레지스터(34a 내지 34d)에 대응하는 메모리 영역의 작은 용량만으로 실행될 수 있다.
상술된 바와 같은 에러 정정은, 재생시에 적어도 에러 정정 코드의 프레임 번호를 검출하고 그 프레임이 데이타 신호를 포함하는지 에러 정정 코드를 포함하는 지를 식별하는 것을 필요로 한다. 그러므로, DAT 포맷에는 그런 검출 및 식별을 위한 신호 영역이 확보된다. 데이타 신호가 테이프(12)에 기록될 때 의존하게 될 이런 DAT 포맷이 제9도를 참조로 설명될 것이다.
제9도로부터 알 수 있는 바와 같이, 1프레임은 헤드 A 및 B로 형성된 두 개의 트랙 Ta 및 Tb로 구성된다. 트랙 Ta 및 Tb 각각은 각 헤드의 90도 회전에 대응하는 길이를 갖고 있고, 트랙 각각은 하단부터(즉, 도면의 우측부터 좌측으로), 마진 영역 5.051도, 서브코드의 PLL에 대한 프리앰블 영역 0.918도, 제1서브코드 3.673도, 포스트앰블 영역 0.459도, 블록간 갭영역 1.378도, 트랙킹(ATF) 신호 영역 2.296도, 블록간 갭영역 1.378도, 데이타의 PLL에 대한 프리앰블 영역 0.918도, 데이타 영역 58.776도, 블록간 갭영역 1.378도, AFT 신호 영역 2.296도, 블록간 갭영역 1.378도, 서브코드의 PLL에 대한 프리앰블 영역 0.918도, 제2서브코드 영역 3.673도, 포스트앰블 영역 0.459도, 마진 영역 5.051도로 세분화된다. 제9도의 각 영역의 스케일이 정확하지 않음에 유의해야 한다.
I/O 회로(13)에서 DAT(1)에 공급된 데이타는 처리 회로(14)에 공급되고, 상기 처리회로(14)는 소정의 에러 검출 및 정정 코드 드을 상기 데이타에 부가시키고, 다음에 그것을 소정의 인터리빙 관계에 따라서 트랙 Ta 및 Tb의 데이타 영역에 삽입시킨다.
제11a도에 도시된 바와 같이, 데이타 영역은 시작부분에 8비트 동기 섹션을 포함하고 다음에 W1 및 W2로 형성된 ID 섹션의 총 16비트를 포함한다. ID 섹션은 2비트의 8 ID 영역으로 분할된다. 첫번째 ID 영역(ID-0)은 예컨대 포맷 ID에 할당되어 데이타 명세를 위해 1에 세트된다. 차기 ID 영역(ID-1)은 예컨대 서브카테고리 ID에 할당되어 컴퓨터 주변 장치를 위해 0에 세트된다. 차기 ID 영역(ID-2)은 예컨대 프레임 사이즈 ID에 할당되어 프레임의 기록 용량이 5760바이트일 때 0에 세트되고 프레임의 기록 용량이 5992바이트일 때는 1에 세트된다. ID 영역(ID-3)은 예컨대 트랙 피치 ID에 할당되어 트랙 피치가 13.6㎛일 때는 0에 세트되고 트랙 피치가 20.4㎛일 때는 1에 세트된다.
제11b도에 도시된 바와 같이, 서브코드 영역은 또한 W1 및 W2로 형성된 ID 섹션을 포함한다. W1의 첫번째 비트는 데이타의 유효성(1에 세트) 또는 무효성(0에 세트)을 나타내는 코드에 할당된다. W1의 차기 3비트는 프레임을 포함하는 영역의 위치를 나타내는 코드이다. 특히, 이 코드는 영역이 리드인(read-in) 영역, 즉 테이프의 시작점에 위치할 때 0에 세트되고, 리드-아웃(read-out) 영역 즉, 데이타 기록 영역의 단부에 위치할 때는 10에 세트되고, 매체의 단부 즉, 테이프의 단부에 위치할 때는 11에 세트된다. W1의 나머지 4비트는, 통상의 프레임(0**0에 세트됨), 동기화 또는 그같은 것에 사용되는 앰플 프레임(0**1에 세트됨), 파일마크가 아닌 프레임(000*에 세트됨), 제1파일마크(001*에 세트됨), 제2파일마크(010*에 세트됨), 또는 제3파일마크(011*에 세트됨)를 나타내는 코드에 할당된다. 한편, W2는, 1에 세트된 첫번째 비트와, 다음 서브코드가 이하 설명될 팩포맷임을 나타내는 0에 세트된 차기 3비트와, 블록 어드레스를 나타내는 값에 세트된 마지막 4비트를 갖고 있다.
DAT가 데이타 레코더로서 사용될 때 상술된 정보에 의해 다양한 결정이 실행될 수 있다.
제1 및 제2서브코드 영역은 각각 2048비트의 데이타를 기록할 수 있는 용량을 갖고 있다. 오디오 신호용 DAT 포맷에 따르면 2048비트는 64비트 팩으로 분할되고, 각 팩은 기록된 신호의 시간 코드, 기록 날짜 등의 정보를 기록하는데 사용된다.
데이타 레코더상에 정보를 기록하기 위해 팩을 사용하는 것이 가능하므로 한쌍의 팩을 사용하여 다양한 제어 동작이 수행될 수 있다. 제10도는 제어동작을 위한 팩의 포맷을 도시한다. 제10도의 표에서 알 수 있듯이, 64비트의 각 팩은 각각 8비트를 포함하는 8워드로 분할된다. 각 팩의 상부 즉, 첫번째 워드의 상위 4비트는 ITEM영역에 할당된다. 상기 ITEM은 오디오 신호의 기록 포맷에 공통이며 4개의 이진코드에 의해 팩의 내용을 보여준다. 4비트로 이루어진 16조합중 9개는 오디오 신호 기록을 위해 이미 할당되어 있으므로, 데이타 레코더의 명령은 나머지 7조합으로부터 임의로 선택된다. 예컨대 사용중인 두 팩중 제1팩의 ITEM 영역은 10에 세트되고 제2팩의 ITEM 영역은 1에 세트된다.
제1팩의 제1워드의 하위 4비트와 제2 및 제3워드로 이루어진 총 20비트 영역은 논리 프레임 번호(LFNO) 영역에 할당되는데, 이 영역에는 예컨대 테이프의 헤드로부터 유효 프레임의 일련번호를 나타내는 이진 코드 조합이 기록된다.
제1팩의 제4및 제5워드로 이루어진 총 16비트 영역은 세이브 세트(save set) 번호(SSNO) 영역에 할당되는데, 이 영역에는 예컨대 백업이 장치의 초기 사용으로부터 몇번 실행되었나를 나타내는 이진 코드 조합이 기록된다.
제1팩의 제6 및 제7워드로 이루어진 영역은 파일 번호(FNO) 영역에 할당되는데, 이 영역에는 한번에 백업된(세이브된) 데이타의 전체 파일내의 한 파일의 일련번호를 나타내는 이진 코드 조합이 기록된다.
제1팩의 제8워드는 제1 내지 제7워드에 대한 패리티에 할당된다.
제2팩의 제1워드의 4비트와 제2 및 제3워드로 이루어진 총 20비트 영역은 프레임 상태를 나타내는데 할당된다. 특히, 제1워드의 상위 4비트중 상위 2비트는, 상술된 앰블 영역(0에 세트됨), 데이타 영역(1에 세트됨), 리드-아웃 영역(10에 세트됨), 매체의 단부(11에 세트됨)를 나타내는 코드에 세트되는 반면, 상기 상위 4비트 중 하위 2비트는, 통상의 프레임(0*에 세트됨), 파일 프레임(1*에 세트됨), 유효 데이타(*0에 세트됨), 또는 무효 데이타(*1에 세트됨)를 나타내는 코드에 세트된다. 제2워드의 하위 4비트는 이진 코드인 에러 정정 코드의 프레임수(PFL)에 세트된다. 제3워드는 이진 코드인 데이타 신호 프레임과 에러 정정 코드 프레임의 총수(ECFL)에 세트되는데, 이들의 모든 비트는 프레임의 수가 무한정이면 0이 세트된다.
제4워드는 에러 정정 코드가 부가된 프레임의 번호(EFNO) 영역에 할당된다. 제1 즉, 최상위 비트가 0에 세트될 때, 그것은 관련 프레임이 데이타 신호 프레임이라는 것을 나타내는 그다음 7비트는 데이타 신호 프레임의 일련번호를 나타내는 이진 코드 조합에 세트된다. 반대로, 제1비트가 1에 세트되면, 그것은 관련 프레임이 에러 정정 코드 프레임이라는 것을 나타내며, 그다음 7비트는 에러 정정 코드 프레임의 일련번호를 나타내는 이진 코드 조합에 세트된다.
제5워드의 제1 즉, 최상위 비트는 서브 코드 영역의 신호들이 데이타 영역에도 기록되는지(1에 세트됨) 기록되지 않는지(0에 세트됨)를 나타내는 플래그(F1)이다. 제5워드의 차기 2비트는 파일마크 순서(#FM)를 나타내는 이진 코드 조합에 세트된다. 제5워드의 하위 5비트 및 제6워드는 1프레임인 유효 데이타의 바이트수(EBL) 영역을 나타내는데 할당되며 바이트 수를 나타내는 이진 코드 조합에 세트된다.
제2워드의 상위 4비트 및 제7워드는 연장된 비트로서 확보되고, 모두 현재 0에 세트되어 있다. 제8워드는 제1 내지 제7워드에 대한 패리티로 할당된다.
이렇게, 데이타 신호들은 이들 ID 코드 등을 식별함으로써 상술된 바와 같이 아주 부드럽게 재생될 수 있다.
그러므로, 데이타 레코더로서 DAT를 사용하는 것이 가능하며, 여기에서 로터리 드럼(11)은 예컨대 2000rpm으로 회전하므로 데이타는 초당 192,000 바이트의 비율로 아주 빠르게 기록되고, 따라서 기록 매체의 소비는 상당히 감소될 수 있다. 더구나, 데이타는 부가된 에러 정정 코드에 의해 부드럽게 기록될 수 있으며, 이것은 만족스러운 데이타 기록을 허용한다.
상술된 제2실시예에 따르면, 데이타에 부가된 에러 정정 코드 등의 프레임이 DAT 포맷에 포함되기 때문에, 임의 길이의 데이타 시퀀스에 대한 에러 정정 코드를 발생시키는 것이 가능하며, 따라서, 임의길이의 데이타 시퀀스를 부드럽게 기록할 수 있으므로, DAT를 사용하는 만족스런 데이타 레코더가 제공될 수 있다.
상기 설명은 본 발명의 양호한 실시예에 대하여 기술되었지만, 본 발명의 기술분야에 숙련된 사람이라면 본 발명의 정신 및 범위를 벗어나지 않고 다양한 변형 및 수정을 행할 수 있음이 자명하다.

Claims (6)

  1. 기록 매체에 디지탈 데이타 정보를 기록하는 장치에 있어서, (a) 입력 디지탈 데이타 정보를, 각각 두개의 경사 트랙으로 구성되는 개별 프레임에 기록하는 기록 수단과, (b) 입력 디지탈 데이타 정보를 N(N은 정수)개의 프레임으로 분할하고, 입력 디지탈 데이타 정보의 각각의 N 프레임 사이에 비입력 디지탈 데이타 정보의 소정의 수의 프레임을 산재(intersperse)시키며, 분할된 입력 디지탈 데이타 정보 및 비입력 디지탈 데이타 정보를 상기 기록 수단에 공급함으로써, 기록된 입력 디지탈 데이타 정보의 매 N 프레임 사이에, 기록된 비입력 디지탈 정보의 소정수의 프레임이 존재하도록 하는 제어 수단을 포함하는 것을 특징으로 하는 디지탈 데이타 정보 기록 장치.
  2. 제2항에 있어서, 상기 제어 수단은, 상기 기록 수단에 대해 비입력 디지탈 데이타 정보로서, 의사 신호의 소정수의 프레임을 입력 디지탈 데이타 정보의 각 N 프레임 사이에 공급하는 수단을 포함하는 것을 특징으로 하는 디지탈 데이타 정보 기록 장치.
  3. 제1항에 있어서, 상기 제어 수단은, 디지탈 데이타 정보의 N 프레임의 각 그룹에 대한 에러 정정 코드의 소정수의 프레임을 발생시키는 수단과, 상기 기록 수단에 대해 비입력 디지탈 데이타 정보로서 상기 에러 정정 코드를 입력 데이타 정보의 각 N 프레임사이에 공급하는 수단을 포함하는 것을 특징으로 하는 디지탈 데이타 정보 기록 장치.
  4. 제3항에 있어서, 상기 디지탈 데이타 정보가 기록되는 각각의 프레임과 상기 에러 정정 코드가 기록되는 각각의 프레임을 식별하는 개별 식별 신호를 기록하는 수단을 더 포함하는 것을 특징으로 하는 디지탈 데이타 정보 기록 장치.
  5. 제4항에 있어서, 상기 식별 신호 각각은, 상기 디지탈 데이타 정보가 기록되는 기록 매체의 주영역과 다른 기록 매체의 서브영역에 기록되는 것을 특징으로 하는 디지탈 데이타 정보 기록 장치.
  6. 제4항에 있어서, 경사 트랙에 기록된 상기 식별 신호와 디지탈 데이타 정보들을 재생하는 재생수단과, 재생된 디지탈 데이타 정보에서 에러를 정정하는 제1에러 정정 수단과, 상기 재생된 식별 신호를 근거로 에러 정정을 위한 신드롬을 발생시키는 수단과, 상기 제1에러 정정 수단에 의해 정정될 수 없는 에러가 상기 재생된 디지탈 데이타 정보에서 발생할 때 상기 재생된 디지탈 데이타 정보의 출력을 중지시키는 수단과, 상기 신드롬이 발생된 후에 기록된 디지탈 데이타 정보를 다시 재생하는 수단 및, 상기 신드롬에 의해 상기 디지탈 데이타 정보에서 발생하는 상기 에러를 정정하고 상기 에러 없는 디지탈 데이타 정보를 디지탈 데이타 정보로서 출력시키는 출력 수단을 더 포함하는 것을 특징으로 하는 디지탈 데이타 정보 기록장치.
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