JPS5981918A - Ｄｐｃｍ符号化信号処理回路における復号化回路の信号補間方法 - Google Patents
Ｄｐｃｍ符号化信号処理回路における復号化回路の信号補間方法Info
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- JPS5981918A JPS5981918A JP19304682A JP19304682A JPS5981918A JP S5981918 A JPS5981918 A JP S5981918A JP 19304682 A JP19304682 A JP 19304682A JP 19304682 A JP19304682 A JP 19304682A JP S5981918 A JPS5981918 A JP S5981918A
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- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M3/00—Conversion of analogue values to or from differential modulation
- H03M3/04—Differential modulation with several bits, e.g. differential pulse code modulation [DPCM]
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- Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はＤ Ｐ ＣＭ ｍ号化佑号処理回路における復
号化回路の信号補間り法に関する。
号化回路の信号補間り法に関する。
従来、例えば、Ｉ） １Ｈｅｒｅｎｔｉａｌ Ｐ ｕ
ｌｓｅ Ｃ：、 ｏｄｅ Ｍ ０ｄＬＩｌａｔｉＯ
ｎ （差分パルス符号化変調）方式を使用したＤＰＣ
Ｍ方式音響回路では、先ず、音源どなるアナログ入力信
号がフィルタを通してΔ／Ｄ変換器に入れられ、マスタ
ーフ〔Ｊツク信号に基づくυンプリング信号にＪ、って
入力アナログ信号のサンプリングが行なわれる。そしく
、各リーンプル値の差分が量子化され、Ｄ Ｉ’ ＣＭ
符号に符号化され、デジタル信号として記憶される等の
処理が行なわれる。このＤＰＣＭ符号信号が次に復号化
される場合には、まず、Ｄ／Ａ変換器に送られ、同変換
器内のＤ／Ａ変挽素子にＪ：っＣ第１図（ａ ）に示さ
れるよ−うに量子化レベルが階段状に表われた差分アナ
ログ信号に変換される。
ｌｓｅ Ｃ：、 ｏｄｅ Ｍ ０ｄＬＩｌａｔｉＯ
ｎ （差分パルス符号化変調）方式を使用したＤＰＣ
Ｍ方式音響回路では、先ず、音源どなるアナログ入力信
号がフィルタを通してΔ／Ｄ変換器に入れられ、マスタ
ーフ〔Ｊツク信号に基づくυンプリング信号にＪ、って
入力アナログ信号のサンプリングが行なわれる。そしく
、各リーンプル値の差分が量子化され、Ｄ Ｉ’ ＣＭ
符号に符号化され、デジタル信号として記憶される等の
処理が行なわれる。このＤＰＣＭ符号信号が次に復号化
される場合には、まず、Ｄ／Ａ変換器に送られ、同変換
器内のＤ／Ａ変挽素子にＪ：っＣ第１図（ａ ）に示さ
れるよ−うに量子化レベルが階段状に表われた差分アナ
ログ信号に変換される。
この差分アナ［］グ信号は、第１図に表わされＣいるｊ
；うに復号化周期毎の佐分信号のり換わり点で量子化レ
ベルが異なることから信２３が乱れている。その乱れた
信号を積分器へ送ると積分器から出力される信号が乱れ
、原信号に対づる忠実度が損なわれる。そこでさらに、
Ｋ分アナＩ］グイ８号を、アナログスイッチのゲートに
よって入力信号の制御を行うチェツバを介して積分器に
送るようにし、同図（ｂ）に示寸如ぎサンプリング周期
に同期したチョップ制御信号によって差分アナ【」グ信
号の各周期毎の信号の安定した成分が取り出され、積分
器に送られ、積分される。その結集積分器の出力からは
同図（Ｃ）に示すように原信号に沿って階段状に復号化
された信号が出力され、その後出力フィルタを通されて
アブログ音響信号として出力される。
；うに復号化周期毎の佐分信号のり換わり点で量子化レ
ベルが異なることから信２３が乱れている。その乱れた
信号を積分器へ送ると積分器から出力される信号が乱れ
、原信号に対づる忠実度が損なわれる。そこでさらに、
Ｋ分アナＩ］グイ８号を、アナログスイッチのゲートに
よって入力信号の制御を行うチェツバを介して積分器に
送るようにし、同図（ｂ）に示寸如ぎサンプリング周期
に同期したチョップ制御信号によって差分アナ【」グ信
号の各周期毎の信号の安定した成分が取り出され、積分
器に送られ、積分される。その結集積分器の出力からは
同図（Ｃ）に示すように原信号に沿って階段状に復号化
された信号が出力され、その後出力フィルタを通されて
アブログ音響信号として出力される。
ところで、このようなり Ｐ Ｃ’Ｍ方式を使用した音
響信号回路では、音を歪みなくきれいに再生（るために
Ｖンプリングにお１）る時間幅（サンプリング周期）を
できるだけ小さくして標本化を行なう必要があるが、Ｄ
ＰＣＭ符号であるデジタル信号を記憶する場合必要なメ
モリの量は→ノンプリング信号の周波数の増加と共に増
加り゛る。よって回路ロス１−低減の観点からはサンプ
リング周期をできるだけ小さくして記憶Ｊるメモリのｍ
を少なくすることが望しい。よって、このような音響回
路においでは、処理する音ｖＩ信号の種類ににって、つ
まり忠実度よく再生づ−る必要の音響信号に対してはメ
モリ上の制約の範囲内で１ノンプリングの時間間隔を９
．ｕ ＜ Ｌ／てきめ細かなサンプリングを行ない、そ
れ以外の比較的忠実度を必要としない音響信号処理に対
しては復号化周期を長くしτ各局期間の段差の比較的大
きい信号の処理を行なうようにしている。しかしながら
出力フィルタは、復号化周期に応じて階段状に復号化さ
れた信号の周期に合わせて複数のフィルタを用意づる必
要があることから、このようにメモリの船を制約したも
ののフィルタを種々用意する必要が生じ、また複数のフ
ィルタを挿入した場合には、ノイズの発生の原因ともな
っていた。
響信号回路では、音を歪みなくきれいに再生（るために
Ｖンプリングにお１）る時間幅（サンプリング周期）を
できるだけ小さくして標本化を行なう必要があるが、Ｄ
ＰＣＭ符号であるデジタル信号を記憶する場合必要なメ
モリの量は→ノンプリング信号の周波数の増加と共に増
加り゛る。よって回路ロス１−低減の観点からはサンプ
リング周期をできるだけ小さくして記憶Ｊるメモリのｍ
を少なくすることが望しい。よって、このような音響回
路においでは、処理する音ｖＩ信号の種類ににって、つ
まり忠実度よく再生づ−る必要の音響信号に対してはメ
モリ上の制約の範囲内で１ノンプリングの時間間隔を９
．ｕ ＜ Ｌ／てきめ細かなサンプリングを行ない、そ
れ以外の比較的忠実度を必要としない音響信号処理に対
しては復号化周期を長くしτ各局期間の段差の比較的大
きい信号の処理を行なうようにしている。しかしながら
出力フィルタは、復号化周期に応じて階段状に復号化さ
れた信号の周期に合わせて複数のフィルタを用意づる必
要があることから、このようにメモリの船を制約したも
ののフィルタを種々用意する必要が生じ、また複数のフ
ィルタを挿入した場合には、ノイズの発生の原因ともな
っていた。
水元明け、上記の問題点を解決Ｊるためになされたもの
で、サンプリング周期をメモリ戦の削減の観点から長く
シｌ〔場合にも、滑らかな歪みの４１いアナログ復調信
号が得られ、最小のメモリ使用量で良好なりＰＣＭ符号
の復号化を行ないＩＪるＤＰＣＭ符号化信号処理回路に
おりる復号化回路の信号補間方法を提供することを目的
とＪる。
で、サンプリング周期をメモリ戦の削減の観点から長く
シｌ〔場合にも、滑らかな歪みの４１いアナログ復調信
号が得られ、最小のメモリ使用量で良好なりＰＣＭ符号
の復号化を行ないＩＪるＤＰＣＭ符号化信号処理回路に
おりる復号化回路の信号補間方法を提供することを目的
とＪる。
このために、本発明は、Ｄ／Ａ変換素子によって差分デ
ジタル信号を差分アナログ信号に変換し、該差分アナ【
コグ信号の各復号化周期毎の成分を該復号化周期に同期
したチョップ制御信号で制御されるゲートを介して積分
処理を行うことによって差分デジタル信号の復号化を行
うｌ） Ｐ ＣＭ符号化信号処理回路において、前記差
分アナログ信号の各復号化周期毎の成分をチョップ制御
信号により複数箇所でチョップし、−視号七周期内で複
数回の積分処理を行うことによって該差分アナログ信号
の補間を行なうことを特徴としている。
ジタル信号を差分アナログ信号に変換し、該差分アナ【
コグ信号の各復号化周期毎の成分を該復号化周期に同期
したチョップ制御信号で制御されるゲートを介して積分
処理を行うことによって差分デジタル信号の復号化を行
うｌ） Ｐ ＣＭ符号化信号処理回路において、前記差
分アナログ信号の各復号化周期毎の成分をチョップ制御
信号により複数箇所でチョップし、−視号七周期内で複
数回の積分処理を行うことによって該差分アナログ信号
の補間を行なうことを特徴としている。
以下、本発明の実施例を図面に基づい（説明づる。
ｈｙ ２図は水元明方ｄ１が適用されたＤ Ｐ ＣＭ
Ｆ１号化信舅処理回路の１１１１７９図を示し、２は、
入カ端了１から入力されたへカ信号から、信号処理に必
要イ【周波数範囲以外の帯域に含まれる不要な周波数成
分やＴｊ１１音を除）、゛づる人力フィルタである。
Ｆ１号化信舅処理回路の１１１１７９図を示し、２は、
入カ端了１から入力されたへカ信号から、信号処理に必
要イ【周波数範囲以外の帯域に含まれる不要な周波数成
分やＴｊ１１音を除）、゛づる人力フィルタである。
Ｊ３は入カフＣルタ２の出力側に接続されるＡ／ｌ’）
変換２：であり、加筒器、サンプル・ボールド回路、Ａ
／Ｄ変換変換素地幅器、及び積分器等にで構成され、入
力したアナログ波形を予め定められた時間間隔のタロツ
ク（Ｍｉ ８によっ“（→ノンブリングをｆ）ない、時
間軸上で周期的に一サンプリング周期前の信号との差分
のみがＡ／Ｄ変換によって量子化され、符号化され、差
分デジタル信号として次の差分デジタル信号処理回路４
に出力される。デジタル処理回路４は符号化された差分
子ジタル信号を入力してメモリに記憶し、ディレィ処理
等必要な処理を行う。５はマスタークロック回路であり
、マスタークロッ９１６号を出力して△／Ｄ変換器３、
デジタル処理回路４、及び後述づ−るＤ／Ａ変換器６に
サンプリング等の信号処理に必要なり［１ツク信号を送
る。また、このマスタークロック回路５には分周器が内
蔵され、クロック信号の周期、つまりサンプリングの時
間間隔が必要に応じて長く伸される等の操作が行なわれ
る。Ｄ ／ Ａ変換器６は、デジタル処理回路４の出力
側に接続され、Ｄ／Ａ変換素子７、積分器８、及び補間
パルス発生回路９を内蔵し、差分デジタル信号を復号化
する回路を構成りる。Ｊなわち、差分デジタル１８月を
Ｄ／Ａ変換素子７に入力し【差分アナ［１グ信号に変換
し、差分）７す［１グ信号をゲート１０を通して積分１
８に送り、補間パルス発生回路９から出力される補間パ
ルス信号をブヨツバ制御用のゲルト信号としてグー１−
１０に印加するように構成され、積分器８からアナログ
信号が取出される。補間パルス発生回路９は、マスター
クロツタ回路５からマスタークロックパルス信号を入力
し、信号のチンプリング時に基準となったこのり［１ツ
ク信号から、サンプリング周期と同じ階段状の差分アノ
−ログ信号の安定した中間部を例えば２個又はそれ以上
のチョップ制御信号でブヨ１ツブして取り出すことが可
能なブヨツバ制御信号を出力をするように構成される。
変換２：であり、加筒器、サンプル・ボールド回路、Ａ
／Ｄ変換変換素地幅器、及び積分器等にで構成され、入
力したアナログ波形を予め定められた時間間隔のタロツ
ク（Ｍｉ ８によっ“（→ノンブリングをｆ）ない、時
間軸上で周期的に一サンプリング周期前の信号との差分
のみがＡ／Ｄ変換によって量子化され、符号化され、差
分デジタル信号として次の差分デジタル信号処理回路４
に出力される。デジタル処理回路４は符号化された差分
子ジタル信号を入力してメモリに記憶し、ディレィ処理
等必要な処理を行う。５はマスタークロック回路であり
、マスタークロッ９１６号を出力して△／Ｄ変換器３、
デジタル処理回路４、及び後述づ−るＤ／Ａ変換器６に
サンプリング等の信号処理に必要なり［１ツク信号を送
る。また、このマスタークロック回路５には分周器が内
蔵され、クロック信号の周期、つまりサンプリングの時
間間隔が必要に応じて長く伸される等の操作が行なわれ
る。Ｄ ／ Ａ変換器６は、デジタル処理回路４の出力
側に接続され、Ｄ／Ａ変換素子７、積分器８、及び補間
パルス発生回路９を内蔵し、差分デジタル信号を復号化
する回路を構成りる。Ｊなわち、差分デジタル１８月を
Ｄ／Ａ変換素子７に入力し【差分アナ［１グ信号に変換
し、差分）７す［１グ信号をゲート１０を通して積分１
８に送り、補間パルス発生回路９から出力される補間パ
ルス信号をブヨツバ制御用のゲルト信号としてグー１−
１０に印加するように構成され、積分器８からアナログ
信号が取出される。補間パルス発生回路９は、マスター
クロツタ回路５からマスタークロックパルス信号を入力
し、信号のチンプリング時に基準となったこのり［１ツ
ク信号から、サンプリング周期と同じ階段状の差分アノ
−ログ信号の安定した中間部を例えば２個又はそれ以上
のチョップ制御信号でブヨ１ツブして取り出すことが可
能なブヨツバ制御信号を出力をするように構成される。
（尚、同号化処理と復号化処理を非同期で行′う場合は
、Ｄ／Ａ変換素子７等の復号化周期信号等を１〜リガー
として補間パルス信号を発生するよう構成される。）１
１はＤ／Ａ変換器６の出力側に接続された出力フィルタ
であり、Ｄ／Ａ変換器６の積分器８から出力されたアノ
ーログ復調伏号に含まれる不要な周波数成分を除去し、
出力端子１２にフィルタリングしＩこアノ゛［１グ信号
を送出Ｊる。
、Ｄ／Ａ変換素子７等の復号化周期信号等を１〜リガー
として補間パルス信号を発生するよう構成される。）１
１はＤ／Ａ変換器６の出力側に接続された出力フィルタ
であり、Ｄ／Ａ変換器６の積分器８から出力されたアノ
ーログ復調伏号に含まれる不要な周波数成分を除去し、
出力端子１２にフィルタリングしＩこアノ゛［１グ信号
を送出Ｊる。
次にＤＰ、ＣＭれ７月化信号処理回路の動作と）ξに、
その復号化回路における信号補間を第３図の信号波形図
により説明りる。
その復号化回路における信号補間を第３図の信号波形図
により説明りる。
入力端子１から入力された音響１８号等のアノ−１コグ
信号は、入力フィルタ２によってフィルタリングされ、
必要な周波数範囲以外の帯域に含まれる不要な周波数成
分や雑名が除去され、Ａ／Ｄ変換器３に送られる。Ａ／
Ｄ変換器３では先ず、υ゛ンブルホールド回路ににって
連続的４丁アナログ波形のυンブリングが行なわれ、マ
スタークロック回路５から送られるり［」ツク信号にに
り決まるり一ンプリング周期でアナ［］グ信号の瞬間の
リーンプル値と一周期前の１ノンプル値との差が取り出
され、量子化が行なわれるｆｌその差が２進数による符
号に変換され、差分デジタル信号となってＡ ／ Ｄ変
換器３からデジタル処理回路４に送られる。デジタル信
号処理回路４では、Ａ／Ｄ変換器３で符号化されたｌ）
Ｐ ＣＭ符号化信号をメモリに記憶し一定時間だリデ
ィレイして出力するとか（ｔンブリング周期と復号化周
期を変化させるといった所望の処理が行われる。
信号は、入力フィルタ２によってフィルタリングされ、
必要な周波数範囲以外の帯域に含まれる不要な周波数成
分や雑名が除去され、Ａ／Ｄ変換器３に送られる。Ａ／
Ｄ変換器３では先ず、υ゛ンブルホールド回路ににって
連続的４丁アナログ波形のυンブリングが行なわれ、マ
スタークロック回路５から送られるり［」ツク信号にに
り決まるり一ンプリング周期でアナ［］グ信号の瞬間の
リーンプル値と一周期前の１ノンプル値との差が取り出
され、量子化が行なわれるｆｌその差が２進数による符
号に変換され、差分デジタル信号となってＡ ／ Ｄ変
換器３からデジタル処理回路４に送られる。デジタル信
号処理回路４では、Ａ／Ｄ変換器３で符号化されたｌ）
Ｐ ＣＭ符号化信号をメモリに記憶し一定時間だリデ
ィレイして出力するとか（ｔンブリング周期と復号化周
期を変化させるといった所望の処理が行われる。
第３図＜ａ ＞で示Ｊデジタル処理回路４から出力され
た差分デジタル信号はＤ／Ａ変換器６に送られ、次のよ
うに後月化が行なわれる。すなわち、差分デジタル信号
は先ず、Ｄ／Δ変換素了７によって同図（１））で示り
°如き差分アノ［」グＩ、； 弓に変換され、アブ１］
グスイツチからなるグーｌ〜１０に送られる。一方、補
間パルス光中回路９では、マスターフ［１ツク回路５か
らのクロック信号に基づき、差分アナログ信号の階段状
の一復号化周則の１ｉ ｔ’ｊの内、安定した中間部で
２つのパルス信号を位置させるように、同図＜Ｃ＞で示
す補間パルス信■４がつくられ、ゲート１０にチョップ
制御信号として出力される。チョップ制御信号のパルス
信号が高レベルでゲート１０に印加される時、ゲート１
０が１用かれ、グー１−１０から差分ノアノーログｉ言
号における各周期の中間部分が量子化レベルを右づる差
分信号として、２回づつヂョップ制御拾多シによつ’Ｃ
１！Ｉ′ｉ続的に抽出され、積分器に送られる。。
た差分デジタル信号はＤ／Ａ変換器６に送られ、次のよ
うに後月化が行なわれる。すなわち、差分デジタル信号
は先ず、Ｄ／Δ変換素了７によって同図（１））で示り
°如き差分アノ［」グＩ、； 弓に変換され、アブ１］
グスイツチからなるグーｌ〜１０に送られる。一方、補
間パルス光中回路９では、マスターフ［１ツク回路５か
らのクロック信号に基づき、差分アナログ信号の階段状
の一復号化周則の１ｉ ｔ’ｊの内、安定した中間部で
２つのパルス信号を位置させるように、同図＜Ｃ＞で示
す補間パルス信■４がつくられ、ゲート１０にチョップ
制御信号として出力される。チョップ制御信号のパルス
信号が高レベルでゲート１０に印加される時、ゲート１
０が１用かれ、グー１−１０から差分ノアノーログｉ言
号における各周期の中間部分が量子化レベルを右づる差
分信号として、２回づつヂョップ制御拾多シによつ’Ｃ
１！Ｉ′ｉ続的に抽出され、積分器に送られる。。
したがって、この時、差分）アナログ信号の各周期端部
〈レベルの変動部）でのノイズはカッ１へされ、各周期
の信÷３の安定した中間部２箇所で量子化された差分が
抽出され、従来、 周期に一回たり抽出されていた信号
が、更に一回の同レベルの差分アナログ信号が抽出され
て補間されることになる。このようにしてゲート１０か
ら出力された信号は積分器８に送られ、積分され、同図
（ｄ ＞に示づ如きチョップ制ｏＩｌ信号と同様の周期
成分を有づるアナログ信号となって出力される。なお、
（イ）子化された差分デジタル信号がアブログ信号に変
換される際、各周期を断続する２個のチョップ制御信号
に従って抽出づることから、符号化においてサンプリン
グした時の２倍の差分が表われ、復号時に信号１辰幅が
２倍に増幅きれることになるが、Ａ／Ｄ変換器３におい
て予め１８号レベルを１／２にして変換したり、また符
号化時のリンプリング周期と非同期に行う場合等は、グ
ー１−１０の聞り１・５間を調整！Ｊることにより積分
後のレベルを調整が可能となり、元の信号レベルをつく
り出すことができる。イして、復号化されたアナログ信
ｆｊ（ｄ）はさらに、出力フィルタ１１を通Ｊことによ
り、不要’ｃｌ−ｆ：Ｉツブ制御信号の周波数成分が除
去され、良θｒな歪みのｋいアナ［］グ信号が出力端子
１２から出力される。
〈レベルの変動部）でのノイズはカッ１へされ、各周期
の信÷３の安定した中間部２箇所で量子化された差分が
抽出され、従来、 周期に一回たり抽出されていた信号
が、更に一回の同レベルの差分アナログ信号が抽出され
て補間されることになる。このようにしてゲート１０か
ら出力された信号は積分器８に送られ、積分され、同図
（ｄ ＞に示づ如きチョップ制ｏＩｌ信号と同様の周期
成分を有づるアナログ信号となって出力される。なお、
（イ）子化された差分デジタル信号がアブログ信号に変
換される際、各周期を断続する２個のチョップ制御信号
に従って抽出づることから、符号化においてサンプリン
グした時の２倍の差分が表われ、復号時に信号１辰幅が
２倍に増幅きれることになるが、Ａ／Ｄ変換器３におい
て予め１８号レベルを１／２にして変換したり、また符
号化時のリンプリング周期と非同期に行う場合等は、グ
ー１−１０の聞り１・５間を調整！Ｊることにより積分
後のレベルを調整が可能となり、元の信号レベルをつく
り出すことができる。イして、復号化されたアナログ信
ｆｊ（ｄ）はさらに、出力フィルタ１１を通Ｊことによ
り、不要’ｃｌ−ｆ：Ｉツブ制御信号の周波数成分が除
去され、良θｒな歪みのｋいアナ［］グ信号が出力端子
１２から出力される。
以、１−説明したように、本発明のＤ ）） ＣＭ符号
化１６号処即回路にお（）る復号化回路の信号補間り法
によれば、差分７ ｊログ信号の各周期（符号化にお【
）る−複号化周朋に相当）のイへ号の安定した中間部分
を２個又はイれ以上のチョップ制御信号によって取り出
し、後目化処理を行なうことから、符号化におりるサン
プリング周期を長くして荒く符号化処即を行なつ１Ｃ場
合にも、復号化の際により細かくイ門１号補間をｔ）な
うことができ、Ｄ Ｐ ＣＭ符弓のデジタル信号を記憶
Ｊるメモリ数を増加さｔ！ずに高い忠実度で歪みのない
滑らかな復調を行なうことができ、したがって、信号の
種類に応じ−Ｃサンプリング周期等を変えても、各種の
出力フィルタを設【プる必要がなく、メモリ量も比較的
少なくすることが可能となり、その分コス１−安になる
等の効果を有している。
化１６号処即回路にお（）る復号化回路の信号補間り法
によれば、差分７ ｊログ信号の各周期（符号化にお【
）る−複号化周朋に相当）のイへ号の安定した中間部分
を２個又はイれ以上のチョップ制御信号によって取り出
し、後目化処理を行なうことから、符号化におりるサン
プリング周期を長くして荒く符号化処即を行なつ１Ｃ場
合にも、復号化の際により細かくイ門１号補間をｔ）な
うことができ、Ｄ Ｐ ＣＭ符弓のデジタル信号を記憶
Ｊるメモリ数を増加さｔ！ずに高い忠実度で歪みのない
滑らかな復調を行なうことができ、したがって、信号の
種類に応じ−Ｃサンプリング周期等を変えても、各種の
出力フィルタを設【プる必要がなく、メモリ量も比較的
少なくすることが可能となり、その分コス１−安になる
等の効果を有している。
第１図は従来の復号化回路におりる各信号の波形図、第
２図は本発明方法が適用されＩ、：実施例ＤＰＣｔｖｌ
Ｆ１号化信号処理回路のブＥ」ツク図、第３図は本実施
例の復号化回路の各信号波形図である。 ５・・・マスタークロック回路 ６・・・Ｄ／Ａ変換器（復号化回路） ７・・・Ｄ／△変換素子 ８・・・積分器９・・
・補間パルス発生回路 １０・・・ゲート代理人 弁
理士 足ｔｒ−勉 他１名
２図は本発明方法が適用されＩ、：実施例ＤＰＣｔｖｌ
Ｆ１号化信号処理回路のブＥ」ツク図、第３図は本実施
例の復号化回路の各信号波形図である。 ５・・・マスタークロック回路 ６・・・Ｄ／Ａ変換器（復号化回路） ７・・・Ｄ／△変換素子 ８・・・積分器９・・
・補間パルス発生回路 １０・・・ゲート代理人 弁
理士 足ｔｒ−勉 他１名
Claims (1)
- Ｄ／Ａ変換素子にＪ：つて差分デジタル信号を差分アＪ
′１コグ信号に変換し、該差分アブログ１８号の各復号
化周期毎の成分を該復号上周期に同＋１１Ｊ ｔ、たチ
３ツブ制ｔａ信号で制御されるゲー１へを介して積分処
理を行うことによって差分デジタル信号の復号化を行う
ＤＰＣＭ符号化信号処理回路において、前記差分アナ［
コグ信号の各復号化周期毎の成分をチョップ制御信号に
より複数箇所でチョップし、−役岩化周期内で複数回の
積分処理を行うことによって咳差分アノ−［ｌグ信号の
補間を行なうことを！ｌ−１黴とＪる信号補間方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19304682A JPS5981918A (ja) | 1982-11-02 | 1982-11-02 | Ｄｐｃｍ符号化信号処理回路における復号化回路の信号補間方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19304682A JPS5981918A (ja) | 1982-11-02 | 1982-11-02 | Ｄｐｃｍ符号化信号処理回路における復号化回路の信号補間方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5981918A true JPS5981918A (ja) | 1984-05-11 |
Family
ID=16301270
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19304682A Pending JPS5981918A (ja) | 1982-11-02 | 1982-11-02 | Ｄｐｃｍ符号化信号処理回路における復号化回路の信号補間方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5981918A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6068392A (ja) * | 1983-09-26 | 1985-04-18 | 沖電気工業株式会社 | 音声合成方式 |
| JPS62159198A (ja) * | 1986-01-07 | 1987-07-15 | 沖電気工業株式会社 | 音声合成方式 |
| JPH01144822A (ja) * | 1987-12-01 | 1989-06-07 | Matsushita Electric Ind Co Ltd | 適応形デルタ変調復号化装置 |
| JPH01145700A (ja) * | 1987-12-01 | 1989-06-07 | Matsushita Electric Ind Co Ltd | 適応形デルタ変調符号化装置 |
| JPH01149523A (ja) * | 1987-12-04 | 1989-06-12 | Matsushita Electric Ind Co Ltd | 適応形デルタ変調復号化装置 |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5411661A (en) * | 1977-06-27 | 1979-01-27 | Fujitsu Ten Ltd | Fluorescent display tube |
| JPS5423369A (en) * | 1977-07-22 | 1979-02-21 | Philips Nv | Code converter |
| JPS5575344A (en) * | 1978-11-30 | 1980-06-06 | Philips Nv | Digitalltooanalog converter |
| JPS5687926A (en) * | 1979-12-18 | 1981-07-17 | Matsushita Electric Ind Co Ltd | Digital signal processor |
-
1982
- 1982-11-02 JP JP19304682A patent/JPS5981918A/ja active Pending
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