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JPH0645875A - スイッチトキャパシタ回路 - Google Patents

スイッチトキャパシタ回路

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Publication number
JPH0645875A
JPH0645875A JP4197978A JP19797892A JPH0645875A JP H0645875 A JPH0645875 A JP H0645875A JP 4197978 A JP4197978 A JP 4197978A JP 19797892 A JP19797892 A JP 19797892A JP H0645875 A JPH0645875 A JP H0645875A
Authority
JP
Japan
Prior art keywords
operational amplifier
capacitor
circuit
switched capacitor
time
Prior art date
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Withdrawn
Application number
JP4197978A
Other languages
English (en)
Inventor
Satoshi Tatsumi
聡 辰巳
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Priority to DE69319033T priority patent/DE69319033T2/de
Priority to EP93111599A priority patent/EP0582862B1/en
Publication of JPH0645875A publication Critical patent/JPH0645875A/ja
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Withdrawn legal-status Critical Current

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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03F—AMPLIFIERS
    • H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
    • H03F3/005—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements using switched capacitors, e.g. dynamic amplifiers; using switched capacitors as resistors in differential amplifiers

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  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Amplifiers (AREA)
  • Filters That Use Time-Delay Elements (AREA)

Abstract

(57)【要約】 【目的】オフセットキャンセル型のスイッチトキャパシ
タ増幅回路において、オフセット電圧のキャンセル動作
のときの発振現象を押える。 【構成】ＯＴＡ型のオペアンプ８の反転入力端子と基準
電圧９との間にコンデンサＣL １２を設ける。スイッチ
Ａ３，Ａ４，Ａ５がオン状態となるオフセットキャンセ
ル時のみ、コンデンサＣL １２はオペアンプ８の負荷と
なる。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は増幅回路に関し、特にオ
フセット電圧を自動補償するスイッチトキャパシタ回路
に関する。
【０００２】
【従来の技術】オペアンプでは、初段のトランジスタ対
の特性の差のために、直流オフセット電圧を生じ、出力
誤差の原因となる。そこで、スイッチトキャパシタ回路
では、従来から、このオフセット電圧を自動補償する回
路が用いられている。図２にオフセット電圧を補償した
増幅回路の１例を示す。
【０００３】図２において、３〜７は、それぞれＡまた
はＢの互いに半周期づつずれ、かつ重ならないクロック
により、オン，オフするスイッチである。つまり、スイ
ッチＡ３，４，５がオン状態のとき、スイッチＢ６，７
は必ずオフ状態であり、逆に、スイッチＢ６，７がオン
状態のとき、Ａ３，４，５は必ずオフ状態である。
【０００４】図３の（ａ）にスイッチＡがオンとなるオ
フセットキャンセル時の回路（ｂ）にスイッチＢがオン
となる増幅時の回路をそれぞれ示してある。ここで、ス
イッチＡ３，４，５コンデンサがオンのとき、オペアン
プ８は利得が「１」のアンプとして働きコンデンサαＣ
１０にＶOS−Ｖin，コンデンサＣ１１にＶOSだけ充電さ
れ、出力電圧はＶOSとなる。
【０００５】次に、スイッチＢ６，７がオンのとき、出
力電圧をＶout とすると、コンデンサαＣ１０にＶOS，
コンデンサＣ１１にＶOS−Ｖout だけ充電される。ここ
で、オペアンプ８の反転入力端子における電荷量は一定
であるから、 αＣ（ＶOS−Ｖin）＋ＣＶOS＝αＣＶOS＋Ｃ（ＶOS−Ｖout ） 故にＶout ＝αＶinとなり、オフセット電圧は相殺さ
れ、出力電圧に影響を与えない。
【０００６】
【発明が解決しようとする課題】従来のオフセットキャ
ンセル型のスイッチトキャパシタ回路では、スイッチＡ
がオン状態のときには、オペアンプはユニティーゲイン
バッファとして働き、このオペアンプがＯＴＡ（Ｏｐｅ
ｒａｔｉｏｎａｌ−Ｔｒａｎｓｃｏｎｄｕｃｔａｎｃｅ
Ａｍｐｌｉｆｉｅｒｓ）型の場合、非常に発振しやす
くなるという問題点があった。
【０００７】
【課題を解決するための手段】本発明のスイッチトキャ
パシタ回路は、オフセット電圧のキャンセル動作を行う
スイッチトキャパシタ回路において、オペアンプの反転
入力端子と基準電圧との間にコンデンサを設け、このコ
ンデンサは、前記オフセット電圧のキャンセル動作のと
きのみ、前記オペアンプの負荷となる構成である。
【０００８】
【実施例】次に、本発明について図面を参照して説明す
る。
【０００９】図１は本発明の一実施例の回路図である。
図１に示すスイッチトキャパシタ回路では、従来例を示
す図２と異なる点は、オペアンプ８の反転入力端子と基
準電圧９との間にコンデンサＣL が追加されている点で
ある。
【００１０】このコンデンサＣL は、スイッチＢ６，７
がオン状態のとき、つまり、増幅時には、回路機能に何
ら影響を与えず、スイッチＡ３，４，５がオン状態のと
き、つまり、ＯＴＡ型のオペアンプ８がユニティーゲイ
ンバッファとして働くときにだけ、負荷として機能し、
発振現象を押える。
【００１１】
【発明の効果】以上説明したように本発明は、オフセッ
トキャンセル型のスイッチトキャパシタ回路において、
そのＯＴＡ型のオペアンプの反転入力端子と基準電圧と
の間にコンデンサを備えているので、オフセット電圧の
キャンセル動作のときのみにオペアンプの出力に負荷を
もたせ、発振現象を押えるという効果を有する。
【図面の簡単な説明】
【図１】本発明の一実施例の回路図である。
【図２】従来のスイッチトキャパシタの１例の回路図で
ある。
【図３】（ａ）は図２におけるスイッチＡがオン状態の
ときを示す回路図である。（ｂ）は図２におけるスイッ
チＢがオン状態のときを示す回路図である。
【符号の説明】
１ 入力端子 ２ 出力端子 ３〜７ スイッチ ８ オペアンプ ９ 基準電圧 １０〜１２ コンデンサ １３ 仮想オフセット電圧源

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】 オフセット電圧のキャンセル動作を行う
    スイッチトキャパシタ回路において、オペアンプの反転
    入力端子と基準電圧との間にコンデンサを設け、このコ
    ンデンサは、前記オフセット電圧のキャンセル動作のと
    きのみ、前記オペアンプの負荷となることを特徴とする
    スイッチトキャパシタ回路。
JP4197978A 1992-07-24 1992-07-24 スイッチトキャパシタ回路 Withdrawn JPH0645875A (ja)

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EP93111599A EP0582862B1 (en) 1992-07-24 1993-07-20 Switched capacitor amplifier circuit
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