[go: up one dir, main page]

JPH06275615A - 半導体装置及びその製造方法 - Google Patents

半導体装置及びその製造方法

Info

Publication number
JPH06275615A
JPH06275615A JP8813993A JP8813993A JPH06275615A JP H06275615 A JPH06275615 A JP H06275615A JP 8813993 A JP8813993 A JP 8813993A JP 8813993 A JP8813993 A JP 8813993A JP H06275615 A JPH06275615 A JP H06275615A
Authority
JP
Japan
Prior art keywords
insulating film
interlayer insulating
semiconductor device
wiring layer
metal pattern
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Withdrawn
Application number
JP8813993A
Other languages
English (en)
Inventor
Ryuya Hara
竜弥 原
Koichiro Kawamura
光一郎 河村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nippon Steel Corp
Original Assignee
Nippon Steel Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Steel Corp filed Critical Nippon Steel Corp
Priority to JP8813993A priority Critical patent/JPH06275615A/ja
Publication of JPH06275615A publication Critical patent/JPH06275615A/ja
Withdrawn legal-status Critical Current

Links

Landscapes

  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】 【目的】 層間絶縁膜の最適な研磨終了時点を確実に検
出することのできる半導体装置の製造方法と、それによ
り得られる所望の平坦化形状をした層間絶縁膜を有する
半導体装置を提供する。 【構成】 半導体基板6上に下部配線層1を形成し、こ
の後、下部配線層1とは異質の金属により金属パターン
2を半導体基板1上に形成し、この後、半導体装置上に
層間絶縁膜3を形成し、この後、層間絶縁膜3に金属パ
ターン2が露出するまで化学的機械研磨を施し、この
後、層間絶縁膜3上に上部配線層4を形成する。更に、
化学的機械研磨を施す工程において、化学的機械研磨剤
中に、金属パターン2と反応して発色する薬品を添加す
ることが好ましい。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体装置及びその製
造方法に関し、特にその下部配線層と上部配線層との間
の層間絶縁膜形成の方法と、それにより製造される半導
体装置に関する。
【0002】
【従来の技術】多層配線を有する半導体装置の製造方法
において層間絶縁膜の平坦化技術は重要な技術の一つで
あり、平坦化技術の一つとして化学的機械研磨法が行わ
れている。この化学的機械研磨を行うにあたり、下部配
線層露出まで研磨を行うと配線の腐食、断線等の損傷が
生じる恐れがある。そのため層間絶縁膜をある程度まで
研磨した時点で研磨を終了する必要があるが、従来は、
例えば特開平4−155927号公報に開示のように、
長年の経験に基づく研磨時間により研磨終了を決定して
いた。
【0003】
【発明が解決しようとする課題】従来の層間絶縁膜の研
磨は、研磨時間によりその終了を制御していたため、研
磨速度の変化や配線パターンの違いに対応しにくく不安
定なものであり、そのため所望の平坦化形状をした層間
絶縁膜が得られにくいという問題があった。
【0004】そこで本発明においては、層間絶縁膜の最
適な研磨終了時点を確実に検出することのできる半導体
装置の製造方法と、それにより得られる所望の平坦化形
状をした層間絶縁膜を有する半導体装置を提供すること
を目的とする。
【0005】
【課題を解決するための手段】上記課題を解決するため
に、本発明に係る半導体装置は、半導体基板上に形成さ
れた下部配線層と、前記半導体基板上に前記下部配線層
とは異質の金属により形成された金属パターンと、前記
下部配線層及び金属パターンが形成された半導体装置上
に形成された層間絶縁膜と、該層間絶縁膜上に形成され
た上部配線層とを有する。その場合、前記金属パターン
が柱状であることが好ましい。更に、前記層間絶縁膜
上、かつ上部配線層下に、第2層間絶縁膜を有すること
が好ましい。
【0006】また、本発明に係る半導体装置の製造方法
は、半導体基板上に下部配線層を形成し、然る後該下部
配線層とは異質の金属により金属パターンを半導体基板
上に形成する工程と、この工程の後、この半導体装置上
に層間絶縁膜を形成する工程と、この工程の後、前記層
間絶縁膜に前記金属パターンが露出するまで化学的機械
研磨を施す工程とを有する。その場合、前記化学的機械
研磨を施す工程の後、前記層間絶縁膜上に第2層間絶縁
膜を形成し、該第2層間絶縁膜上に上部配線層を形成す
る工程を有することが好ましい。更に、前記化学的機械
研磨を施す工程において、化学的機械研磨剤中に、前記
金属パターンと反応して発色する薬品を添加することが
好ましい。
【0007】
【作用】本発明においては、前記層間絶縁膜表面に前記
金属パターンが露出するまで化学的機械研磨を行うこと
により的確な研磨制御が可能となり、過剰或は過少に研
磨することなく、良好な平坦化形状をもつ層間絶縁膜を
得ることができる。更に、前記金属パターンを柱状に形
成することにより、該金属パターンの半導体装置に占め
る占有面積を最小におさえている。更に、化学的機械研
磨を施す工程の後、前記層間絶縁膜上に第2層間絶縁膜
を形成してから該第2層間絶縁膜上に上部配線層を形成
することにより、前記金属パターンと上部配線層との接
触を防止することができる。更に、化学的機械研磨剤中
に、前記金属パターンと反応して発色する薬品を添加す
ることにより層間絶縁膜の最適な研磨終了時点を確実に
検出することができる。
【0008】
【実施例】以下、図1乃至図6を用いて、本発明の実施
例を説明する。図1は本発明の一実施例による半導体装
置の概略断面図であり、図2〜図5は図1の半導体装置
をその製造工程順に並べた概略断面図である。また図6
は本発明の別の実施例による半導体装置の概略断面図で
ある。
【0009】まず、図2に示すように、通常の半導体装
置製造方法により、目的に適った拡散層や酸化膜等を形
成した半導体基板6上に、アルミニウム等からなる下部
配線層1を形成する。
【0010】次に、図3に示すように、公知のスパッタ
リング法により、コバルト、銅、鉄、クロム等の材料を
用いて金属パターン2を半導体基板6上に形成する。こ
のとき金属パターン2は、柱状になるように、かつ下部
配線層1の膜厚より0.3〜2μm程度厚い膜厚になる
ように形成する。
【0011】次に、図4に示すように、上記半導体装置
上に層間絶縁膜3を0.5〜3μmの膜厚で形成する。
【0012】次に、図5に示すように、化学的機械研磨
により層間絶縁膜3を、金属パターン2が該膜表面に露
出するまで研磨し、層間絶縁膜3の平坦化を行う。この
とき研磨剤中に、アンモニウムイオン(NH4 + )、硫
酸イオン(SO4 2- )、硝酸イオン(NO3 - )、水酸
イオン(OH- )等の、金属パターン2を形成している
前記金属材料と反応し発色するイオンを含んだ化合物を
添加することにより、図5に示したように層間絶縁膜3
表面に金属パターン2が露出した段階で、発色反応を生
じる。そこで研磨装置に光学的センサ等を備えておくこ
とにより、発色を即座に検知することが可能となり、最
適な状態で研磨を終了することができる。
【0013】次に、図1に示すように、層間絶縁膜3上
に上部配線層4を形成する。このとき、金属パターン2
と上部配線層4との接触が問題になる場合は、図6に示
す別の実施例のように、層間絶縁膜3上、上部配線層4
下に第2層間絶縁膜5を形成することによりこれを防止
する。
【0014】
【発明の効果】以上説明したように本発明によれば、層
間絶縁膜の化学的機械研磨の際、研磨速度の変化や配線
パターンの違いに十分対応し、かつ最適な研磨終了時点
を確実に検出することのできる半導体装置の製造方法
と、それにより形成された、良好な平坦化形状を持つ層
間絶縁膜を有する半導体装置を実現することができる。
【図面の簡単な説明】
【図1】本発明の一実施例による半導体装置における、
上部配線層形成後の状態を示す概略断面図である。
【図2】本発明の一実施例による半導体装置の製造工程
における、下部配線層形成後、金属パターン形成前の状
態を示す概略断面図である。
【図3】本発明の一実施例による半導体装置の製造工程
における、金属パターン形成後、層間絶縁膜形成前の状
態を示す概略断面図である。
【図4】本発明の一実施例による半導体装置の製造工程
における、層間絶縁膜形成後、化学的機械研磨施行前の
状態を示す概略断面図である。
【図5】本発明の一実施例による半導体装置の製造工程
における、化学的機械研磨施行後、上部配線層形成前の
状態を示す概略断面図である。
【図6】本発明の別の実施例による半導体装置におけ
る、第2層間絶縁膜形成後、上部配線層を形成した状態
を示す概略断面図である。
【符号の説明】
1 下部配線層 2 金属パターン 3 層間絶縁膜 4 上部配線層 5 第2層間絶縁膜 6 半導体基板

Claims (6)

    【特許請求の範囲】
  1. 【請求項1】 半導体基板上に形成された下部配線層
    と、 前記半導体基板上に前記下部配線層とは異質の金属によ
    り前記下部配線層よりも高く形成された金属パターン
    と、 前記下部配線層及び金属パターンが形成された半導体装
    置上に形成された層間絶縁膜と、 該層間絶縁膜上に形成された上部配線層とを有すること
    を特徴とする半導体装置。
  2. 【請求項2】 請求項1に記載の半導体装置において、
    前記金属パターンが柱状であることを特徴とする半導体
    装置。
  3. 【請求項3】 請求項1に記載の半導体装置において、
    前記層間絶縁膜上、かつ上部配線層下に、第2層間絶縁
    膜を有することを特徴とする半導体装置。
  4. 【請求項4】 半導体基板上に下部配線層を形成し、然
    る後該下部配線層とは異質の金属により金属パターンを
    半導体基板上に形成する第一の工程と、 この第一の工程の後、該半導体装置上に層間絶縁膜を形
    成する第二の工程と、 この第二の工程の後、前記層間絶縁膜に前記金属パター
    ンが露出するまで化学的機械研磨を施す第三の工程とを
    有することを特徴とする半導体装置の製造方法。
  5. 【請求項5】 請求項4に記載の半導体装置の製造方法
    において、前記第三の工程の後、前記層間絶縁膜上に第
    2層間絶縁膜を形成し、該第2層間絶縁膜上に上部配線
    層を形成することを特徴とする半導体装置の製造方法。
  6. 【請求項6】 請求項4に記載の半導体装置の製造方法
    において、前記第三の工程において、化学的機械研磨剤
    中に、前記金属パターンと反応して発色する薬品を添加
    することを特徴とする半導体装置の製造方法。
JP8813993A 1993-03-23 1993-03-23 半導体装置及びその製造方法 Withdrawn JPH06275615A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP8813993A JPH06275615A (ja) 1993-03-23 1993-03-23 半導体装置及びその製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP8813993A JPH06275615A (ja) 1993-03-23 1993-03-23 半導体装置及びその製造方法

Publications (1)

Publication Number Publication Date
JPH06275615A true JPH06275615A (ja) 1994-09-30

Family

ID=13934609

Family Applications (1)

Application Number Title Priority Date Filing Date
JP8813993A Withdrawn JPH06275615A (ja) 1993-03-23 1993-03-23 半導体装置及びその製造方法

Country Status (1)

Country Link
JP (1) JPH06275615A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4879570A (en) * 1987-03-24 1989-11-07 Nippon Antenna Co., Ltd. Broadcasting wave reception antenna

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4879570A (en) * 1987-03-24 1989-11-07 Nippon Antenna Co., Ltd. Broadcasting wave reception antenna

Similar Documents

Publication Publication Date Title
US5872042A (en) Method for alignment mark regeneration
EP1471572A1 (en) Embedded copper interconnection structure
KR100244783B1 (ko) 반도체 장치의 제조방법
US6864177B2 (en) Method for manufacturing metal line contact plug of semiconductor device
JPH06275615A (ja) 半導体装置及びその製造方法
JPH06275616A (ja) 半導体装置及びその製造方法
US6884713B2 (en) Method for forming metal line of semiconductor device
EP0887860B1 (en) Formation of alignment mark and structure covering the same
JP2005079156A (ja) 配線形成方法
JPH0969561A (ja) 半導体装置の製造方法
US20060183293A1 (en) Method of forming alignment mark and method of manufacturing semiconductor device
JP2000058647A (ja) 半導体装置の製造方法
JPH08162431A (ja) 半導体装置の平坦化方法
JPH01241118A (ja) アライメント・マーク
US20020081840A1 (en) Method of manufacturing a semiconductor device including dual-damascene process
JP2001176872A (ja) 半導体装置の製造方法
JPH07106277A (ja) 半導体装置の製造方法
JP2001102448A (ja) 配線の形成方法
JP3063836B2 (ja) 半導体の製造方法
KR100511091B1 (ko) 반도체장치의 평탄화 방법
KR100356474B1 (ko) 반도체 소자의 중첩 버니어 형성 방법
US20050130408A1 (en) Method for forming metal wiring of semiconductor device
JPH04264728A (ja) 半導体装置およびその製造方法
JPS59175124A (ja) 半導体装置の製造方法
KR0135142B1 (ko) 반도체소자의 금속배선 형성방법

Legal Events

Date Code Title Description
A300 Withdrawal of application because of no request for examination

Free format text: JAPANESE INTERMEDIATE CODE: A300

Effective date: 20000530