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JPH0371647A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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Publication number
JPH0371647A
JPH0371647A JP20814689A JP20814689A JPH0371647A JP H0371647 A JPH0371647 A JP H0371647A JP 20814689 A JP20814689 A JP 20814689A JP 20814689 A JP20814689 A JP 20814689A JP H0371647 A JPH0371647 A JP H0371647A
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JP
Japan
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resin
punching
lead frame
burrs
leads
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Application number
JP20814689A
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English (en)
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JP2589184B2 (ja
Inventor
Akira Ochiai
公 落合
Kenichi Tomaru
都丸 賢一
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sanyo Electric Co Ltd
Original Assignee
Sanyo Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
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Publication date
Family has litigation
First worldwide family litigation filed litigation Critical https://patents.darts-ip.com/?family=16551399&utm_source=google_patent&utm_medium=platform_link&utm_campaign=public_patent_search&patent=JPH0371647(A) "Global patent litigation dataset” by Darts-ip is licensed under a Creative Commons Attribution 4.0 International License.
Application filed by Sanyo Electric Co Ltd filed Critical Sanyo Electric Co Ltd
Priority to JP1208146A priority Critical patent/JP2589184B2/ja
Publication of JPH0371647A publication Critical patent/JPH0371647A/ja
Application granted granted Critical
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Expired - Lifetime legal-status Critical Current

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    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
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    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
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    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
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    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
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  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (イ)産業上の利用分野 本発明は半導体装置の製造方法に関するものである。
(ロ)従来の技術 一般に、リードフレームに半導体素子を固着し樹脂モー
ルドする技術は、例えば特公昭55−24694号公報
が詳しい。
これは、リードフレームの打抜き面を下部金型と対面さ
せ、フレームの反りを防止するものである。
しかし現在は、打抜き技術が進歩し打抜き面の角部の丸
みを極力抑えることが可能となり、打抜き面とこの打抜
き面と対向する面とが実質的に同じ面積となっている。
しかも対向する面の周辺に生じる抜きバリを平坦にでき
ない理由と相俟って、第4図の如く、打抜き面を上にし
て半導体装置(1)を製造している。
第4図を参照しながら半導体装e(1)の構成を説明す
ると、先ずリードフレーム(2)があり、このリードフ
レーム(2)の打抜き面は上にしである。図からも判る
通り、打抜き面の角部(3)は丸みを生じ、この打抜き
面と反対の面の周辺には抜きバリ(4)が形成されてい
る。(5)はダフであり、(6)はリード、(7)は金
属細線である。
(ハ)発明が解決しようとする課題 前述の半導体装置(1〉を樹脂モールドする時の概略図
を第5図に示す。現在は益々リード(6)の数が増え、
リード(6)下面のトータル面積が増大しているので、
矢印の如く樹脂注入口が下金型にあると、抜きバリ〈4
〉が流入抵抗となって樹脂の流動性を低下させていた。
またタイバ一部の樹脂バリ(8〉を、タイバーカット時
に第6図の如くパンチ(9)で除去するが、樹脂がリー
ド部(6〉の抜きダレ部(角部の丸み)に強固に接着し
ているため、このタイバーカット工程で完全に除去でき
ず、第6図で示した黒い部分(10)が残ってしまう問
題を有していた。
そのためつオータジェット等で樹脂バリを完全に取り除
く工程が必要となっていた。
(ニ)課題を解決するための手段 本発明は前述の課題に鑑みて成され、前記樹脂バリ(2
9)をリード(24〉の打抜き方向と逆の方向からバン
チ(30〉を挿入して除去し、更にはリードフレームの
打抜き面を下にして、打抜き面の方より樹脂を流入する
ことで解決するものである。
(*〉作用 第2図の如く、打抜き面を下にして形成しであるので、
前記抜きダレ部(27〉が下に形成される。
従って樹脂注入口が下金型にあっても、第3図の矢印の
如く抵抗なく流入させることができる。
また第1図の如く、抜きバリ〈28〉の生じている面か
らバンチ〈30)で打抜く際、樹脂バリ(29)はノー
ド(24)の縦側面のみにしか付着していないので、こ
のパンチを使って良好に樹脂バリ(29)を除去できる
〈へ〉実施例 以下に本発明の実施例を詳述する。
先ず説明の都合上第2図に示した半導体装置(21)の
構成について述べてゆく。
半導体素子(22)がリードフレームの一部であるタブ
(23)に固着されており、半導体素子(22)とノー
ドフレームの一部である複数本のリード(24)との間
を金属細線(25)で電気的に接続されている。更には
半導体素子〈22)、タブ(23)、金属細線(25)
およびリード(24〉の一部が樹脂(26)によってモ
ールドされており、このリード(24)は下方に所定形
状に折り曲げられている。
次にこの半導体装置(21〉の製造方法について説明し
てゆく。
先ずリードフレームを打抜き形成するために、例えば銅
を主成分とした金属基板が用意される。
この金属基板はプレスによって一連のリードフレームが
形成される。従って図にも示されるように、下面に抜き
ダレ部〈27〉が生じ、上面には抜きバリ(28)が生
じる。またリード(24〉の一端は金属細線(25)の
接合領域として平坦化されている。
次にこのリードフレームの一部であるタブ(23)に半
導体素子〈22)が固着され、金属細線(25)にて前
記リード(24〉の接合領域とこの半導体素子(22)
のポンディングパッド部が電気的に接合される。
続いて第3図の如く金型にこのリードフレームを組込み
、図の如く樹脂を注入する。リードフレームの下面は前
述した如く抜きダレ(27)が生じ丸みが生じているた
め、矢印の如くスムーズに流れる。その結果、第5図の
樹脂の流動性とは異なり大幅に改善される。従って樹脂
厚27II11前後の薄いものでも、リードフレームは
上下せず良好な位置に固定できる。
更に第1図の如く、リード(24)間に固着された樹脂
バリ(29〉を取り除く工程がある。この時は同時にタ
イバーカットも実施される。点でハツチングした領域が
樹脂バリ(29)であり、図からも判る通り、リードの
側面にしか付いていない領域を先にバンチ(30〉で押
してゆくので、固着力の強い抜きブレ部(27)の樹脂
バリは樹脂バリ(29)と一体となって除去されてゆく
。従って樹脂バリを完全に取除くことができる。
最後に第2図で示したように、リード(24)を折り曲
げる工程がある。樹脂バリ(29)が完全に除去できる
ので、折り曲げ治具(31)と樹脂(26)の間に樹脂
バリ(29)が入り込まず良好な寸法で折り曲げられる
(ト〉発明の効果 以上の説明からも明らかな如く、抜きブレを下面にする
ため樹脂の流動性が向上し、リードフレームに与える樹
脂注入時の抵抗を低下させることができる。従って樹脂
厚の薄いものでも良好にリードフレームを固定でき、不
良を防止できる。
またリード間に発生する樹脂バリは、打抜き面とは反対
の面から打抜き除去されるので、完全に除去できる。従
って折り曲げ寸法を精度良く加工できる。しかも別にウ
ォータージェット等で樹脂バリを除去する工程が省け、
工程を短かくすることができる。
【図面の簡単な説明】
第1図は本発明の樹脂バリ除去の工程を説明する断面図
、第2図は本発明で達成できる半導体装置の断面図、第
3図は本発明の樹脂モールド工程を説明する断面図、第
4図は従来の半導体装置の断面図、第5図は従来の樹脂
モールド工程を説明する断面図、第6図は従来の樹脂バ
リ除去の工程を説明する図である。

Claims (3)

    【特許請求の範囲】
  1. (1)半導体素子を樹脂モールドして形成する半導体装
    置の製造方法に於いて、 少なくとも前記樹脂モールド部の1辺より導出している
    複数のリード間に形成される樹脂バリを、リードの打抜
    き方向と逆の方向からパンチを挿入して除去することを
    特徴とする半導体装置の製造方法。
  2. (2)リードフレーム用の金属板を打抜きする工程と、 前記リードフレームの打抜き面と反対の面に半導体素子
    を固着する工程と、 前記半導体素子と前記リードフレームのリード間を金属
    細線にて電気的に接続する工程と、前記半導体素子と前
    記リードフレームの一部を樹脂モールドする工程と、 この樹脂モールドによって前記リード間に生じた樹脂バ
    リを、リードフレームの打抜き方向と逆の方向からパン
    チを挿入して除去する工程と、前記リードをカットし、
    所定形状に折曲げる工程とを備えることを特徴とした半
    導体装置の製造方法。
  3. (3)前記樹脂モールド工程に於いて、 樹脂の流入方向は、打抜き面より打抜き面と反対の面へ
    流入することを特徴とした請求項第2項記載の半導体装
    置の製造方法。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100693241B1 (ko) * 1992-03-27 2007-03-12 가부시끼가이샤 히다치 세이사꾸쇼 반도체장치

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS55157235A (en) * 1979-05-25 1980-12-06 Nec Corp Manufacture of semiconductor integrated circuit
JPH0230152A (ja) * 1988-07-19 1990-01-31 Nec Corp 半導体装置の製造方法

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