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JPH0338689A - 液晶表示装置 - Google Patents

液晶表示装置

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Publication number
JPH0338689A
JPH0338689A JP1174620A JP17462089A JPH0338689A JP H0338689 A JPH0338689 A JP H0338689A JP 1174620 A JP1174620 A JP 1174620A JP 17462089 A JP17462089 A JP 17462089A JP H0338689 A JPH0338689 A JP H0338689A
Authority
JP
Japan
Prior art keywords
drain bus
bus lines
bus line
liquid crystal
crystal display
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1174620A
Other languages
English (en)
Inventor
Toshikazu Shimizu
寿和 清水
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP1174620A priority Critical patent/JPH0338689A/ja
Priority to EP19900112874 priority patent/EP0406870A3/en
Publication of JPH0338689A publication Critical patent/JPH0338689A/ja
Pending legal-status Critical Current

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    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
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    • G09G3/3611—Control of matrices with row and column drivers
    • G09G3/3685—Details of drivers for data electrodes
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は液晶表示装置に関し、特にアクティブマトリク
ス型液晶表示装置に関する。
〔従来の技術〕
従来の液晶表示装置の液晶表示パネルは、第５図のよう
な等何回路で表わされるように、ゲートバスライン０１
１　Ｇ２１　Ｇ３１　Ｇ４１・・・・・・Ｇ、とドレイ
ンバスラインＤ＋、Ｉｈ、Ｄ３．Ｄ４．−−Ｄ、ｎが互
いに直交して配線され、その交点にトランジスタ表示画
素が接続されていた。また、駆動に関しては、第６図の
ような表示画素配列ｄ＋＋（ｉ、ｊ＝１，２．・・・・
・・）の表示を行うために第７図に示す駆動信号で行っ
ていた。すなわち、ゲートバスラインの１本を高レベル
にし、トランジスタをＯＮさせドレインバスラインのデ
ータを表示画素に書き込む。この動作をゲートバスライ
ンに対し、順次行うことにより、液晶表示パネルの表示
画素全部を表示させていた。
〔発明が解決しようとする課題〕
上述した従来の液晶表示装置は、マトリクス状に配線さ
れたゲートバスラインとドレインバスラインの交点１つ
に対し、トランジスタ、表示画素が１つとなっているの
でドレインバスライン１本に対し、表示画素１列が対応
、すなわち、表示画素１列に対し、ドレインバスライン
駆動用ドライバが１つ必要となっている。また、ドレイ
ンバスライン駆動用ドライバは、映像信号等の広い周波
数帯域を扱い、高速のデータレートで動作するため、た
いへん高価なものとなっている。
ゆえに表示画素数が多くなると、高価なドレインバスラ
イン駆動用ドライバを数多く使用しなければならず、た
いへん高価なものとなるという欠点がある。
〔課題を解決するための手段〕
本発明の液晶表示装置は、複数のドレインバスラインと
複数のゲートバスラインと複数の表示画素と複数のトラ
ンジスタよりなる液晶表示パネルと前記ドレインバスラ
インを駆動するドライバと前記ゲートバスラインを駆動
するドライバからなるアクティブマトリクス型液晶表示
装置において、ｍ行ｎ列の表示画素に対し、ドレインバ
スラインが＋ｎ列、ゲートバスラインが２ｍ行になって
おり、ｊ列目のドレインバスラインには２ｊ−１列目と
２ｊ列目の表示画素をトランジスタを介して接続し、ｉ
行目のゲートバスラインにはｉ−１行、２ｋ列目（ｋ＝
１．２．・・・・・・）及びｉ行、２ｋ一１列目の表示
画素をトランジスタを介して接続した構成になっている
。
〔実施例〕
次に、本発明について図面を参照して説明する。
第１図は本発明の液晶表示パネルの等価回路図である。
第２図は表示データ構成で、第３図は、第２図のデータ
構成を表示するためのタイミング図である。
第１図においてドレインバスライン１本に対し、表示画
素が２列接続され、各トランジスタにゲートバスライン
が接続されている。第３図において、ゲートバスライン
のＧｌ、Ｇｉ、Ｇｓ、Ｇｙ続けてＧ２１Ｇｔ、Ｇｓ、Ｇ
ｓというようにゲート電位を高レベルにし、パスライン
上に並ぶトランジスタをＯＮさせ、そのタイミングのド
レインバスラインのデータを表示画素に書き込む。ドレ
インバスラインのデータ列は、ドレインバスライン１本
は、ｄｌｌ＋ｄ２＋＋　ｄｓ＋＊　ｄ４＋と表示画素１
列目を書き込み、続いてｄ１２＋ｄ２□、ｄ３□、Ｇ４
２と表示画素２列目を書き込む。他のドレインバスライ
ンも同様に行う。
第４図は本発明の別の駆動方法のドレインバスラインの
タイミング図である。第４図において、ドレインバスラ
インのデータ列をドレインバスラ表示画素に書き込むこ
とにより、データが表示画面上にちらばるため、ライン
フリッカを防止できる利点がある。なお、ゲートバスラ
インに印加する信号は第３図と同じである。
〔発明の効果〕
以上説明したように本発明はドレインバスライン１本で
表示画素２列を駆動できるため、ドレインバスラインの
ドライバを半減することが出来、製品のコストの削減ま
た、ドライバの数が減ることにより、消費電流が大幅に
少なくできる効果がある。
【図面の簡単な説明】
第１図は本発明の液晶表示パネルの等価回路図、第２図
は表示データ構成を示す図、第３図、第４図は駆動タイ
ミング図、第５図は従来の液晶表示パネルの等価回路図
、第６図は表示データ構成、第７図は従来の駆動タイミ
ング図である。

Claims (1)

    【特許請求の範囲】
  1. 　複数のドレインバスラインとこのドレインバスライン
    に交叉する複数のゲートバスラインと前記ドレインバス
    ラインにドレイン電極が接続し前記ゲートバスラインに
    ゲート電極が接続した複数のトランジスタと前記トラン
    ジスタのソース電極に接続してマトリクス状に配置され
    た複数の表示画素より成る液晶表示パネルと、前記ドレ
    インバスラインを駆動するドライバと前記ゲートバスラ
    インを駆動するドライバから成るアクティブマトリクス
    型液晶表示装置において、ｊ列目のドレインバスライン
    には２ｊ−１列目と２ｊ列目の表示画素をトランジスタ
    を介して接続し、ｉ行目のゲートバスラインにはｉ−１
    行、２ｋ列目（ｋ＝１、２、・・・・・・）の表示画素
    及びｉ行、２ｋ−１列目の表示画素をトランジスタを介
    して接続したことを特徴とする液晶表示装置。
JP1174620A 1989-07-05 1989-07-05 液晶表示装置 Pending JPH0338689A (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP1174620A JPH0338689A (ja) 1989-07-05 1989-07-05 液晶表示装置
EP19900112874 EP0406870A3 (en) 1989-07-05 1990-07-05 Active matrix liquid crystal display having reduced drain bus lines

Applications Claiming Priority (1)

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JP1174620A JPH0338689A (ja) 1989-07-05 1989-07-05 液晶表示装置

Publications (1)

Publication Number Publication Date
JPH0338689A true JPH0338689A (ja) 1991-02-19

Family

ID=15981778

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JP1174620A Pending JPH0338689A (ja) 1989-07-05 1989-07-05 液晶表示装置

Country Status (2)

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EP (1) EP0406870A3 (ja)
JP (1) JPH0338689A (ja)

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EP0406870A2 (en) 1991-01-09
EP0406870A3 (en) 1991-10-30

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