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JP6855989B2 - Rfタグ回路 - Google Patents

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Description

本発明は、アンテナと負荷とに接続されるRFタグ回路に関する。
近年、RFタグの発展は目覚ましく、本来の個体識別用途以外にも受信した電波によって供給される電力をエネルギー源として、センサ、LED、IC、マイコン、通信回路、RFタグ回路等によって例示される負荷を駆動する用途が増えている。これら負荷の動作には、安定的に電力が供給されるよう、RFタグにおいて受け取る電力をより大きくすることが好ましい。このようなRFタグ回路では、アンテナとRFタグ回路との間のインピーダンスの不整合により負荷に対する給電能力が低下することがある。インピーダンスの不整合は、例えば、金属片や水、油等の誘電体がアンテナに付着するもしくは接近することでアンテナのインピーダンス変化に起因して生じることがある。そのため、アンテナとRFタグ回路との間のインピーダンスを整合させる技術が提案されている(例えば、特許文献1参照)。
特開平7−111470号公報
電波によって供給されるエネルギーは、負荷の駆動とその他の処理とを同時に行うには不足することが多い。そのため、RFタグ回路では、負荷は所定周期で起動されて駆動し、負荷が駆動していないときにその他の処理が実行されることが多い。
インピーダンスの調整では、RFタグ回路のインピーダンスを変更しながらRFタグ回路が生成する電力が増加するようにインピーダンス値が探索される。負荷が駆動していないときは電圧が飽和(例えば、リミッターによる制限値に達している状態)しているため、負荷が駆動していないときにインピーダンス調整を行っても電力の上昇を検出できず、適切なインピーダンス調整を行うことが困難となる。そのため、インピーダンス調整は負荷の駆動中に行われることが好ましい。
インピーダンス値の探索では、RFタグ回路が生成する電力が安定している状態でインピーダンスの調整が行われることが好ましい。そのため、負荷の駆動期間は、RFタグ回路が生成する電力が安定するまでの期間を確保できるように決定される。その結果、RFタグ回路が生成する電力が安定するまでの期間よりも短い時間で駆動できる負荷を採用しても、負荷の駆動期間を短縮することは困難であった。
そこで、開示の技術の1つの側面は、RFタグ回路が生成する電力が不安定な状態であってもインピーダンス調整を実行可能なRFタグ回路を提供することを目的とする。
本開示の一例は、アンテナと負荷とに接続されるRFタグ回路によって例示される。本RFタグ回路は、整流回路と、マッチング回路と、制御部と、調整部とを備える。整流回路は、アンテナが受信した電波を整流して直流電力を供給する。マッチング回路は、アンテナと整流回路との間に配置され、インピーダンスが可変である。制御部は、負荷の起動と停止を繰り返し制御する。調整部は、負荷が起動してから所定時間経過したときにマッ
チング回路のインピーダンスを所定の方向に変化させるとともに整流回路が生成する第1の電力を記憶し、第1の電力が生成される時点より後のタイミングで負荷が起動してから所定時間経過したときの整流回路が生成する第2の電力と記憶した第1の電力との大小関係に基づいて、マッチング回路のインピーダンスを変化させる。
上記構成において、負荷は、受信した電波によって供給される電力をエネルギー源として駆動する素子である。負荷は、例えば、センサ、LED、IC、マイコン、通信回路、RFタグ回路等である。マッチング回路は可変インピーダンス素子を含む。可変インピーダンス素子は、例えば、複数のコンデンサを組み合わせた回路であってもよいし、バラクタダイオードのようなアナログ制御素子であってもよい。上記構成では、負荷の起動から負荷の駆動時間以下である所定時間経過したときにマッチング回路のインピーダンスを所定の方向に変化させるとともに整流回路が生成する第1の電力を記憶する。RFタグ回路は、第1の電力が生成される時点より後のタイミングで負荷が起動してから所定時間経過したときに整流回路が生成する第2の電力と記憶した第1の電力との大小関係に基づいてマッチング回路のインピーダンスを変化させる。たとえば、所定の方向がインピーダンスを増加させる方向であった場合、アンテナとRFタグ回路との間のインピーダンスが整合すると、第2の電力は第1の電力以下となる。そのため、第2の電力と第1の電力とを比較することで、RFタグ回路は、インピーダンスが整合したか否かを判定でき、インピーダンスが整合していない場合にはさらにマッチング回路のインピーダンスを増加させる事ができる。なお、所定の方向としてインピーダンスを増加させる方向を採用する場合、アンテナとRFタグ回路とが整合するインピーダンス値の探索アルゴリズムは、インピーダンスを単調増加させる線形探索によることになる。しかしながら、インピーダンス値の探索アルゴリズムは、単調増加による線形探索に限定されない。インピーダンス値の探索アルゴリズムには、単調減少による線形探索、二分探索、木探索等の任意のアルゴリズムが採用可能である。また、負荷の起動から所定時間経過したときの電圧が比較されることで、RFタグ回路は、負荷の起動による電圧降下によって整流回路が生成する電力が安定していない状態であっても電力の変動を検出できる。電力が安定していない状態であっても電力の変動を検出できるため、上記構成において、所定時間は、負荷の時定数で示される時間未満であってもよい。
上記構成において、RFタグ回路とアンテナとの間のインピーダンスが不整合である場合に、インピーダンス調整の開始を指示する調整指示を調整部に送信する指示回路をさらに備えてもよい。調整部は、指示回路から調整指示を受信すると処理を開始してもよい。このような構成とすることで、RFタグ回路とアンテナとの間のインピーダンスが不整合である場合に、RFタグ回路はインピーダンスの調整を実行できる。
上記構成において、RFタグ回路とアンテナとの間のインピーダンスが不整合である場合は、整流回路が生成する電圧が負荷の起動に伴う電圧降下により所定の閾値未満となる場合を含んでもよい。所定の閾値は、例えば、負荷を安定して駆動させることが可能な電圧を基に決定される。このような構成とすることで、整流回路から供給される電力が負荷の安定した駆動に不足する場合に、RFタグ回路はインピーダンスの調整を実行することができる。
上記構成において、RFタグ回路とアンテナとの間のインピーダンスが不整合である場合は、アンテナを介した無線通信により負荷を利用する装置(例えば、リーダライタ装置や通信インタフェース)から受信した負荷に対するコマンドの実行結果がエラーであった場合を含んでもよい。アンテナを介した無線通信により負荷を利用する装置は、例えば、コンピュータ等の上位装置に、アンテナが取り付けられたリーダライタを接続したリーダライタ装置である。負荷に対するコマンドの実行結果がエラーである場合、アンテナとRFタグ回路とのインピーダンスの不整合による影響で整流回路が生成する電力が低下し、
その結果、負荷が安定動作していない場合が考えられる。そのため、このような構成とすることで、RFタグ回路は負荷が安定動作していない場合にインピーダンスの調整を実行できる。
上記構成において、RFタグ回路とアンテナとの間のインピーダンスが不整合である場合は、アンテナを介した無線通信により負荷を利用する装置からインピーダンス調整の指示を受信した場合を含んでもよい。負荷を利用する装置は、例えば、負荷からの応答でエラーを受信した場合、負荷に対してコマンドを送信する場合等にインピーダンス調整の指示を送信する。そのため、このような構成とすることで、RFタグ回路は負荷を利用する装置からの指示に応じてインピーダンスの調整を実行できる。さらに、上記構成において、負荷は所定の周期で起動されてもよい。なお、所定の周期は、各周期における1周期にかかる時間が厳密に一致しなくともよい。すなわち、1周期分にかかる時間は多少変動があってもよい。
本RFタグ回路は、電圧が不安定な状態であってもインピーダンス調整を実行可能である。
図1は、実施形態に係るRFタグ回路の構成および使用態様の一例を示す図である。 図2は、マッチング回路の構成の一例を示す図である。 図3は、マッチング回路の可変容量の構成の一例を示す図である。 図4は、整流回路の構成の一例を示す図である。 図5は、負荷制御回路の構成の一例を示す図である。 図6は、調整トリガ生成回路の構成の一例を示す図である。 図7は、インピーダンス調整制御回路の構成の一例を示す図である。 図8は、インピーダンス調整制御回路によるインピーダンス調整フローの一例を示す図である。 図9は、実施形態に係る処理フローの一例を示す図である。 図10は、実施形態における整流回路から出力される電源電圧の変動の一例を示す図である。 図11は、実施形態で送信される各種信号の波形の一例を示す図である。 図12は、変形例に係るRFタグ回路の構成の一例を示す図である。 図13は、変形例に係る処理フローの一例を示す図である。 図14は、変形例で送信される各種信号の波形の一例を示す図である。
以下、図面を参照して、実施形態について説明する。以下に示す実施形態の構成は例示であり、開示の技術は実施形態の構成に限定されない。
<第1実施形態>
図1は、実施形態に係るRFタグ回路10の構成および使用態様の一例を示す図である。RFタグ回路10は、アンテナ20および負荷30に接続される。RFタグ回路10は、リーダライタ装置40が無線にて、負荷30を利用できるシステムを構築する回路である。負荷30は、受信した電波によって供給される電力をエネルギー源として駆動する素子である。負荷30は、例えば、センサ、LED、IC、マイコン等である。RFタグ回路10は、リーダライタ装置40から受信する電波をエネルギー源として負荷30を駆動させる回路である。RFタグ回路10は、負荷30を所定周期で起動して駆動し、負荷を駆動していない期間に通信等の他の処理を実行する。RFタグ回路10は、ワイヤレス給
電回路、ワイヤレス給電装置ということもできる。また、RFタグ回路10に接続された負荷30は、ワイヤレスセンサということもできる。RFタグ回路10は、例えば、ICチップ、ディスクリート部品を組み合わせた回路、ICチップとディスクリート部品を組み合わせた回路のいずれかとして実現されるものである。また、リーダライタ装置40は、例えば、コンピュータ等の上位装置43に、アンテナ41が取り付けられたリーダライタ42を接続した装置である。負荷30は、「負荷」の一例である。リーダライタ装置40は、「前記アンテナを介した無線通信により前記負荷を利用する装置」の一例である。
RFタグ回路10は、例えば、リーダライタ装置40からの電波を受信するアンテナ20と、リーダライタ装置40に利用させる負荷30とに接続される回路である。RFタグ回路10は、マッチング回路11、整流回路12、負荷制御回路13、インピーダンス調整制御回路14、制御部/記憶部15、調整トリガ生成回路16および通信回路18を備える。
マッチング回路11は、アンテナ20とRFタグ回路10内の回路とのインピーダンスを整合させるための回路である。マッチング回路11は、アンテナ20と整流回路12との間に配置される。マッチング回路11の具体的な回路構成は特に限定されない。マッチング回路11の回路構成は、例えば、図2に例示するように、2つのインダクタ51、52と、インピーダンス調整制御回路14からの調整信号により容量を変更可能な可変容量コンデンサ53とを組合せた回路であってもよい。インピーダンス調整制御回路14から受信する調整信号によって容量を変更可能な可変容量コンデンサ53としては、例えば、互いに容量の異なるコンデンサC〜CとスイッチSC1〜SC5とを図3に例示するように組み合わせた回路を使用することができる。また、マッチング回路11は、バラクタダイオードのようなアナログ制御素子であってもよい。RFタグ回路10では、金属片や水、油等の誘電体がアンテナ20に付着するもしくは接近することで、アンテナ20のインピーダンスが変化し得る。アンテナ20のインピーダンス変化によりアンテナ20とRFタグ回路10内の回路との間のインピーダンス不整合が大きくなると、アンテナ20からRFタグ回路10内の回路へのエネルギー伝送効率が低下する。そこで、マッチング回路11によってアンテナ20とRFタグ回路10内の回路とのインピーダンスを整合させることで、アンテナ20からRFタグ回路10内の回路へのエネルギー伝送効率の低下が抑制される。マッチング回路11は、「マッチング回路」の一例である。
整流回路12は、電波を受信したアンテナ20が出力する交流電力を整流して直流(DC)電力を負荷30及びRFタグ回路10内の各部(負荷制御回路13、インピーダンス調整制御回路14)に供給する回路である。図4は、整流回路12の構成の一例を示す図である。整流回路12としては、図4に例示されるような、2つのダイオードD(DとD等)とコンデンサC(CとC等)とにより構成された倍電圧整流回路を多段接続した回路であってもよい。整流回路12は、負荷30の駆動に用いるVOUT(電源電圧)とは別に、インピーダンス調整で使用するための別系統の直流信号を生成してもよい。整流回路12は、「整流回路」の一例である。
通信回路18は、アンテナ20を介してリーダライタ装置40と無線通信を行うための回路である。通信回路18は、リーダライタ装置40から受信した電波からコマンド等の情報を取り出す復調回路と、リーダライタ装置40に送信する情報を電波によって伝送するために変調する変調回路とを含む。通信回路18は、例えば、リーダライタ装置40から無線通信によって送信されるコマンドを受信し、また、コマンドの実行結果等の情報をリーダライタ装置40に無線通信によって送信する。
負荷制御回路13は、制御部/記憶部15から受信した信号に応じて負荷30を起動させる回路である。図5は、負荷制御回路13の構成の一例を示す図である。負荷制御回路
13としては、図5に例示されるように、負荷30への電力供給のオンとオフとを切り替えるスイッチSW131およびコンデンサ132を備える回路を利用することができる。コンデンサ132は、例えば、整流回路12から供給される直流電力を蓄電する。コンデンサ132は、例えば、整流回路12から供給される直流電力のうち、負荷30の駆動に利用されない余剰分を蓄電してもよい。余剰分の電力は、例えば、負荷30の駆動期間外にアンテナ20が受信した電波によって供給された電力である。コンデンサ132に蓄電された電力は負荷30に供給される。コンデンサ132は、容量が比較的大きいもの(例えば、負荷30の抵抗成分の逆数より容量が大きいもの(時定数の大きい(〜秒オーダー)もの))を選定することで、負荷30に供給される電圧の降下を抑制できる。このようなコンデンサ132が選定されることで、リーダライタ装置40からの受信状況が悪化する等の理由により瞬間的な電力遮断等が生じた場合でも、負荷30をより安定して動作させることが可能となる。スイッチSW131は、負荷制御回路13が制御部/記憶部15から負荷制御信号を受信している間オンにされる。スイッチSW131がオンにされることで整流回路12から供給される直流電力が負荷30に供給され、負荷30が起動される。そのため、負荷制御回路13が負荷制御信号を受信している間、負荷30は継続して駆動する。
制御部/記憶部15は、負荷制御回路13のスイッチSW131のオンにする負荷制御信号を所定周期で送信する。負荷制御信号は、インピーダンス調整制御回路にも送信される。制御部/記憶部15は、例えば、所定周期で外部から入力される命令(クロック信号等)に応じて負荷制御信号を負荷制御回路13に送信することで、負荷制御回路13のスイッチSW131をオンにする。その結果、負荷30は、所定周期で起動される。制御部/記憶部15は、「制御部」の一例である。
制御部/記憶部15は、例えば、プロセッサと記憶部とを組み合わせた素子である。プロセッサは単一のプロセッサに限定される訳ではなく、マルチプロセッサ構成であってもよい。また、単一のソケットで接続される単一のプロセッサがマルチコア構成を有していても良い。プロセッサが実行する処理のうち少なくとも一部は、例えば、Digital Signal
Processor(DSP)、Graphics Processing Unit(GPU)、数値演算プロセッサ、ベクトルプロセッサ、画像処理プロセッサ等の専用プロセッサで行われても良い。また、プロセッサが実行する処理のうち少なくとも一部は、集積回路(IC)、その他のディジタル回路によって実行されてもよい。また、プロセッサの少なくとも一部にアナログ回路が含まれても良い。集積回路は、Large Scale Integrated circuit(LSI)、Application Specific Integrated Circuit(ASIC)、プログラマブルロジックデバイス(PL
D)を含む。PLDは、例えば、Field-Programmable Gate Array(FPGA)を含む。
プロセッサは、プロセッサと集積回路との組み合わせであっても良い。組み合わせは、例えば、マイクロコントローラユニット(MCU)、System-on-a-chip(SoC)、システムLSI、チップセットなどと呼ばれる。記憶部は、プロセッサから読み書き可能な記憶媒体である。記憶部は、例えば、プロセッサから直接アクセスされる記憶媒体である。記憶部は、例えば、Random Access Memory(RAM)およびRead Only Memory(ROM)を含む。
調整トリガ生成回路16は、インピーダンス調整の開始を指示する調整トリガをインピーダンス調整制御回路14に送信する。調整トリガ生成回路16は、例えば、整流回路12からインピーダンス調整制御回路14に入力される電源電圧が所定の閾値を下回った際に調整トリガを送信する。調整トリガ生成回路16は、例えば、外部の回路から入力される外部調整トリガが入力された場合に調整トリガを送信してもよい。調整トリガ生成回路16は、「指示回路」の一例である。調整トリガは、「調整指示」の一例である。
図6は、調整トリガ生成回路16の構成の一例を示す図である。調整トリガは後述する
ように様々な事象を契機として生成されるが、図6では整流回路12から供給される電源電圧を基に調整トリガを生成する調整トリガ生成回路16の構成について例示する。なお、図6に例示される調整トリガ生成回路16がRFタグ回路10に採用される場合、図1において整流回路12から調整トリガ生成回路16に対して電源電圧を供給する配線が追加される。調整トリガ生成回路16は、例えば、閾値生成回路161、比較回路162、OR器163およびタイマ164を含む。閾値生成回路161は、閾値1および閾値2の2種類の閾値を生成する回路である。閾値1は、例えば、インピーダンス調整を開始する基準値となる電圧を示す値である。閾値1は、例えば、負荷30を安定して動作させることが可能な電圧の下限値に対して安全係数を考慮して決定される。閾値2は、例えば、負荷30を安定動作可能な電圧の下限を示す。閾値1は閾値2より大きく、閾値2は負荷30が駆動可能な電圧値の下限より高い。閾値生成回路161は、例えば、整流回路12から入力される電源電圧に基づいて閾値1を決定してもよい。また、閾値生成回路161は閾値2を予めメモリ上に保持してもよい。比較回路162は、閾値生成回路161から入力される閾値1、閾値2と整流回路12から入力される電源電圧とを比較する。電源電圧が閾値2より低い場合、負荷30の安定動作が期待できない。そのため、調整トリガ生成回路16は、制御部/記憶部15に対して負荷強制OFF信号を送信する。負荷強制OFF信号は、負荷30が起動される所定周期にかかわらず負荷30をオフにさせる指示である。電源電圧が閾値2より大きく閾値1よりは小さい場合は、調整トリガ生成回路16は制御部/記憶部15に対して負荷強制ON信号を送信するとともに、タイマ164による計時を開始する。負荷強制ON信号は、負荷30が起動される所定周期にかかわらず負荷30を継続して駆動させる指示である。タイマ164には負荷30に供給される電源電圧が安定すると考えられる電圧安定期間が記憶されており、調整トリガ生成回路16はタイマ164による計時開始から電圧安定期間経過後に制御部/記憶部15の調整トリガを送信する。電源電圧が安定すると考えられる電圧安定期間としては、例えば、負荷30の時定数の2倍から4倍程度の期間が例示される。
調整トリガ生成回路16は、例えば、外部調整トリガを用いずに閾値の比較結果に基づいて調整トリガを送信してもよい。この場合、OR器163が調整トリガ生成回路16から省略されてもよい。また、調整トリガ生成回路16は、例えば、閾値を用いずに外部調整トリガが入力された際に調整トリガを送信してもよい。この場合、閾値生成回路161および比較回路162が調整トリガ生成回路16から省略されてもよい。
図6に例示される調整トリガ生成回路16では、閾値生成回路161によって生成された閾値と電源電圧との比較結果と外部調整トリガの入力に基づいて調整トリガを送信する。しかしながら、調整トリガ生成回路16が調整トリガを送信する契機は、これらに限定されない。調整トリガ生成回路16は、例えば、整流回路12が生成する電源電圧を監視し、電源電圧の監視結果に基づいて調整トリガを送信してもよい。電源電圧の監視は、例えば、電源立ち上がりの検出、電池接続の検出、リミッタ解除および図6を参照して説明した閾値との比較を含む。電源立ち上がりの検出は、例えば、Power on Reset(POR)の検出、RFタグ回路10に接続された外部電源からの電力供給開始、電源電圧が供給されたことによる制御部/記憶部15の記憶部がmemory read enable状態に遷移したことの検出、を含む。
また、調整トリガ生成回路16は、内部タイマを備え、内部タイマによって一定時間の経過が計時されるたびに(すなわち定期的に)調整トリガを送信してもよい。この場合、閾値生成回路161、比較回路162、OR器163、タイマ164が調整トリガ生成回路16から省略されてもよい。
また、調整トリガ生成回路16は、RFタグ回路10が外部入力端子を備え、外部インタフェースから入力される割り込み信号を契機として調整トリガを送信してもよい。外部
インタフェースは、例えば、General Perpose Input Output(GPIO)端子である。外部インタフェースで入力される割り込みとしては、例えば、外部インタフェースに接続されたMicro Control Unit(MCU)から入力される割り込み、外部インタフェースに接続された外部スイッチから入力される割り込み、を挙げることができる。
また、調整トリガ生成回路16は、例えば、リーダライタ装置40に例示される無線通信の相手装置やSerial Peripheral Interface(SPI)、Inter-Integrated Circuit(
I2C)等の通信インタフェースを介して入力されたコマンドに応じて、調整トリガを送信してもよい。調整トリガ生成回路16は、例えば、リーダライタ装置40から連続波(Continuous Wave, CW)を受信した場合に調整トリガを送信してもよい。また、調整ト
リガ生成回路16は、受信したコマンドの実行エラーを検知した場合に調整トリガを送信してもよい。実行エラーは、例えば、負荷30を起動するコマンドを受信したにもかかわらず、負荷30の起動ができなかった場合である。また、調整トリガ生成回路16は、コマンドを受信すると、そのコマンドの実行前または実行後に、調整トリガを送信してもよい。また、調整トリガ生成回路16は、インピーダンス調整の実行を指示するコマンドを受信した場合に、調整トリガを送信してもよい。また、調整トリガ生成回路16は、特定のコマンドを受信した場合に調整トリガを送信してもよい。特定のコマンドは、例えば、負荷30の起動を指示するコマンドである。
また、調整トリガ生成回路16は、例えば、特定動作の検出を契機として調整トリガを送信してもよい。特定動作は、例えば、負荷30が停止状態と駆動状態との間の遷移であってもよい。特定動作は、例えば、GPIOが有効状態と無効状態との間で切替わる動作であってもよい。特定動作は、例えば、SPIやI2Cにおける役割がマスタとスレーブとの間で遷移であってもよい。特定動作は、例えば、不揮発性メモリに対する書き込み処理であってもよい。特定動作は、例えば、上記した動作においてエラーを検出した場合であってもよい。
インピーダンス調整制御回路14は、マッチング回路11のインピーダンスを指定する調整信号(本実施形態では、可変容量コンデンサ53(図2)の容量を指定する調整信号)を出力する回路である。本実施形態に係るRFタグ回路10には、例えば、図7に示した構成を有するインピーダンス調整制御回路14が使用されている。
このインピーダンス調整制御回路14の全体的な動作については後述するが、アップカウンタ61は、Resetパルスが入力されたときにカウント値を“0”クリアし、UPパルスが入力されたときにカウントアップするカウンタである。このアップカウンタ61のカウンタ値は、マッチング回路11のインピーダンス(可変容量コンデンサ53(図2)の容量)を指定する調整信号として使用されている。
比較器62は、電源電圧(整流回路12の出力電圧)VOUTとコンデンサ63の電圧との比較結果を出力する回路である。この比較器62の出力は、CMP_OUT信号線により制御部/記憶部15に入力されている。スイッチ64は、Ctrl信号線を介して制御部/記憶部15によってON/OFF制御されるスイッチである。Ctrl信号は、例えば、インピーダンス調整制御回路14に入力されていた負荷制御信号がオフになるときに入力される。
図8は、制御部/記憶部15がインピーダンス調整制御回路14を制御する制御フローの一例を示す図である。図7の制御フローは、例えば、調整トリガ生成回路16から制御部/記憶部15に調整トリガが入力されることで開始される。以下、図7を参照して、制御部/記憶部15がインピーダンス調整制御回路14を制御する制御フローの一例について説明する。
調整トリガが入力された制御部/記憶部15は、まず、Resetパルスを出力する(ステップS101)。これにより、インピーダンス調整制御回路14(図7参照)内のアップカウンタ61のカウント値が“0”にリセットされ、マッチング回路11内の可変容量コンデンサ53(図2)の容量が最低容量Cに調整される。
次いで、制御部/記憶部15は、Ctrlパルスを出力する(ステップS102)。すなわち、制御部/記憶部15は、スイッチ64をONとすることにより、コンデンサ63の電圧(比較器62の−端子への入力電圧)を、その時点における電源電圧VOUTと一致させてから、スイッチ64をOFFとすることにより、コンデンサ63の電圧をホールドする。
その後、制御部/記憶部15は、UPパルスを出力(ステップS103)してから、比較器62の出力CMP_OUTがローであるか否かを判定する(ステップS104)。
UPパルスが入力されると、アップカウンタ61のカウント値がカウントアップされるため、マッチング回路11内の可変容量コンデンサ53の容量が増加する。可変容量コンデンサ53の容量が増加を増加させた後におけるマッチング回路11のインピーダンスが適正値とはなっておらず、かつ、マッチング回路11のインピーダンスが適正値に近づいた場合には、電源電圧が上昇する。一方、可変容量コンデンサ53の容量を増加させた後におけるマッチング回路11のインピーダンスが適正値となっていた場合には、電源電圧は殆ど変化しない。また、可変容量コンデンサ53の容量を増加させた後におけるインピーダンスが適正値となっておらず、かつ、インピーダンスが適正値からさらに外れた場合にも、電源電圧は殆ど変化しない。従って、インピーダンスが適正値となっている場合、または、インピーダンスが適正値からさらに外れる場合には、CMP_OUTがローになる。そのため、CMP_OUTがローである場合には、インピーダンスが適正値であるとして、または、インピーダンスが適正値からさらに適正値から外れることを抑制するために、マッチング回路11のインピーダンスの調整が完了される。また、マッチング回路11のインピーダンスが適正値とはなっておらず、かつ、マッチング回路11のインピーダンスが適正値に近づいた場合には、CMP_OUTがハイになる。そのため、CMP_OUTが、ハイである場合には、マッチング回路のインピーダンスの調整が完了していないことになり、インピーダンスの調整が継続して実行される。
そのため、制御部/記憶部15は、比較器62の出力CMP_OUTがハイであった場合(ステップS104;NO)には、ステップS103以降の処理を再び開始する。そして、制御部/記憶部15は、比較器62の出力CMP_OUTがローとなったとき(ステップS104;YES)に、このインピーダンス調整処理(図8の処理)を終了する。インピーダンス調整制御回路14は、「調整部」の一例である。
図9は、実施形態に係る処理フローの一例を示す図である。以下、図9を参照して、実施形態に係る処理フローの一例について説明する。
OP1では、負荷制御回路13は負荷30を起動する。調整トリガ生成回路16から調整トリガが入力されている場合(OP2でYES)、処理はOP3に進められる。調整トリガ生成回路16から調整トリガが入力されていない場合(OP2でNO)、処理はOP9に進められる。
OP3では、インピーダンス調整制御回路14は、負荷30の駆動時間(図中ではTONと記載)経過を待つ。OP4では、以下の(1)〜(3)の処理が実行される。(1)インピーダンス調整制御回路14は、整流回路12からの電源電圧(図中では監視電圧と
記載)をサンプルホールド(S/H)する。(2)制御部/記憶部15は、負荷制御回路13への負荷制御信号送信を停止することで、負荷30を停止する。(3)インピーダンス調整制御回路14は、マッチング回路11のインピーダンスをΔZ変化させる。OP4における(1)〜(3)の処理の順番は入れ替えてもよい。OP4の処理は、例えば、図8のS102、S103に例示される処理である。OP4の(1)でサンプルホールドされた電圧は、「第2の電力」の一例である。
OP5では、OP4で停止された負荷30の停止期間(図中ではTOFFと記載)を経過すると、処理がOP6に進められる。OP6では、制御部/記憶部15は負荷制御信号を負荷制御回路13に送信することで負荷30を起動させる。
OP7の処理はOP3と同様であるため、その説明を省略する。OP8では、インピーダンス調整制御回路14は、OP4でS/Hした電圧とOP8の時点における整流回路12からの電源電圧との差がδV未満であるか否かを判定する。ここで、δVは、インピーダンス調整制御回路14の比較器141の分解能によって定まる値である。また、δVは、は所定の閾値であってもよい。δVより大きい場合(OP8でYES)、処理はOP4に進められる。δV以下の場合(OP8でNO)、処理はOP10に進められる。OP8の処理は、例えば、図8のS104に例示される処理である。OP8の時点における整流回路12からの電源電圧は、「第1の電力」の一例である。
OP9では、制御部/記憶部15から負荷制御信号が負荷制御回路13に送信されることにより、負荷30が駆動時間の間駆動する。OP10では、制御部/記憶部15からの負荷制御信号が停止することにより、負荷30が停止される。
図10は、実施形態における整流回路12から出力される電源電圧の変動の一例を示す図である。図10では、縦軸に電圧、横軸に時間が例示される。図10では、負荷30が起動されるタイミングを「負荷ON」または「ON」、負荷30が停止されるタイミングを「負荷OFF」または「OFF」と記載している。すなわち、実施形態に係る負荷30は、所定周期で「負荷ON」されるとともに、「負荷ON」されてから「負荷OFF」されるまでの間は継続して駆動される。図10に例示されるように、負荷30が起動すると、負荷30の起動に伴う電圧降下により、整流回路12が出力する電源電圧が低下する。RFタグ回路10に水等が付着することでアンテナ20とRFタグ回路10とのインピーダンス不整合が生じると、整流回路12から出力される電源電圧が負荷30の起動に伴う電圧降下によってインピーダンス調整開始の契機となる所定の閾値を下回る。(1)では、例えば、電源電圧が所定の閾値(例えば、図6の閾値1)を下回ると、調整トリガ生成回路16から調整トリガがインピーダンス調整制御回路14に送信される。調整トリガを受信することで、インピーダンス調整制御回路14は、インピーダンスの調整を開始する。(1)の処理は、例えば、図9のOP2の処理に相当する。(2)では、負荷制御回路13が負荷30を停止するとともに、インピーダンス調整制御回路14が負荷30が駆動している状態から停止する状態に遷移する時点での電源電圧をサンプルホールドする。(3)では、インピーダンス調整制御回路14は、マッチング回路11のインピーダンスをΔZ増加させる。(2)および(3)の処理は、例えば、図9のOP4の処理に相当する。(4)では、インピーダンス調整制御回路14は、負荷30が駆動している状態から停止する状態に遷移する時点での電源電圧と(2)でサンプルホールドされた電圧とを比較する。(4)の処理は、例えば、図9のOP8の処理に相当する。(5)では、インピーダンス調整制御回路14は、(4)の時点では電源電圧の上昇を検知したため、マッチング回路11のインピーダンスをΔZ増加させる。(5)の処理は、例えば、図9のOP8でYESからOP4の処理に相当する。(6)では、(4)および(5)と同様の処理が実行される。(7)では、インピーダンス調整制御回路14は、(6)の時点よりも(7)時点の電源電圧が下がっていることを検知するため、インピーダンス調整を終了する。
(7)の処理は、例えば、図9のOP8でNOの処理に相当する。
図11は、実施形態で送信される各種信号の波形の一例を示す図である。図11において、「TON」の期間は負荷30が駆動している期間の例示であり、「TOFF」の期間は負荷30が駆動していない期間の例示である。図11において、横軸は時間を例示する。また、図11において、1段目は電源電圧(実線)およびサンプルホールドされた電圧(破線)の変動を例示し、2段目は負荷制御信号の変動を例示し、3段目は調整トリガ(実線)およびサンプルホールドの指示(破線)を含む調整制御信号の変動を例示し、4段目はインピーダンス調整制御回路14が備える比較器62(図中ではCOMPと記載)の比較が例示される。図11の1段目から4段目の縦軸は、電圧が例示される。インピーダンス調整制御回路14は、調整トリガが入力されたときの可変容量コンデンサ53の容量が設定可能な容量の最低値ではない場合、可変容量コンデンサ53の容量を可変容量コンデンサ53に設定可能な容量の最低値に初期化してもよい。
図11に例示されるように、負荷30は負荷制御信号が送信されている間(TONの期間)は駆動し、負荷制御信号が送信されていない間(TOFFの期間)は停止する。調整トリガを受信することで、インピーダンス調整制御回路14は、インピーダンス調整を開始する。サンプルホールドされた電源電圧よりも現在の電源電圧の方が高い場合、インピーダンス調整制御回路14が備える比較器62の出力は「H」となる。比較器62の出力が「H」である場合、インピーダンス調整制御回路14は、マッチング回路11が備える可変容量コンデンサ53の容量を増加させる。可変容量コンデンサ53の容量が増加した結果、サンプルホールドした電源電圧と現在の電源電圧との差がなくなると、比較器62の出力が「L」となり、インピーダンス調整が終了する。
<実施形態の作用効果>
実施形態では、上述の通り、負荷30は所定周期で駆動状態(例えば、図11のTON)、停止状態(例えば、図11のTOFF)、駆動状態、停止状態を繰り返す。負荷30が起動される各周期において、負荷30が駆動状態から停止状態に遷移するタイミングでサンプルホールドされた電源電圧が比較される。そのため、電源電圧が安定するまで待たなくともインピーダンス調整が可能となる。その結果、実施形態によれば、負荷30の駆動時間を時定数より短時間にしても、インピーダンス調整を行うことが可能となる。
実施形態では、RFタグ回路10とアンテナ20との間のインピーダンスが不整合である場合に、調整トリガ生成回路16は調整トリガを送信した。インピーダンス調整制御回路14は、調整トリガを受信すると、図9に例示されるインピーダンス調整を開始した。そのため、実施形態によれば、RFタグ回路10は、インピーダンスの不整合が生じた場合に、インピーダンスの調整を実行できる。
実施形態では、調整トリガ生成回路16は、整流回路12が生成する電圧が負荷の起動に伴う電圧降下により負荷30を安定して動作させることが可能な電圧の下限値に対して安全係数を考慮した値によって例示される閾値1未満となる場合に調整トリガを送信する。そのため、実施形態によれば、整流回路12が生成する電圧が負荷30の安定動作に不足する前に、インピーダンス調整を行うことが可能となる。
実施形態では、上述の通り、調整トリガ生成回路16は、例えば、アンテナ20を介した無線通信により負荷30を利用するリーダライタ装置40から受信した負荷30に対するコマンドの実行結果がエラーであったことを契機として、調整トリガを送信してもよい。負荷30に対するコマンドの実行結果がエラーである場合、アンテナ20とRFタグ回路10とのインピーダンスの不整合による影響で整流回路12が生成する電力が低下し、その結果、負荷30が安定動作していない場合が考えられる。そのため、実施形態によれ
ば、RFタグ回路10は負荷30が安定動作していない場合にインピーダンスの調整を実行できる。
実施形態では、上述の通り、調整トリガ生成回路16は、例えば、アンテナ20を介した無線通信により負荷30を利用するリーダライタ装置40からインピーダンス調整の指示を受信したことを契機として、調整トリガを送信してもよい。リーダライタ装置40は、例えば、負荷30からの応答でエラーを受信した場合、負荷30に対してコマンドを送信する場合等にインピーダンス調整の指示を送信する。そのため、実施形態によれば、RFタグ回路10は負荷30を利用するリーダライタ装置40からの指示に応じてインピーダンスの調整を実行できる。
<変形例>
実施形態では、負荷30が起動される各周期において、負荷30が駆動状態から停止状態に遷移するタイミングでサンプルホールドされた電源電圧が比較される。しかしながら、電源電圧をサンプルホールドして比較するタイミングは、負荷30が駆動状態から停止状態に遷移するタイミングに限定されない。電源電圧をサンプルホールドして比較するタイミングは、負荷30が駆動中であって負荷30の起動から一定時間経過後であればよい。変形例では、負荷30が駆動中であって負荷30の起動から一定時間経過後のタイミングで電源電圧をサンプルホールドして比較するRFタグ回路について説明する。以下、図面を参照して変形例について説明する。なお、実施形態と同一の構成については同一の符号を付し、その説明を省略する。
図12は、変形例に係るRFタグ回路10aの構成の一例を示す図である。図12では、リーダライタ装置40および通信回路18の図示は省略している。変形例に係るRFタグ回路10aは、インピーダンス調整制御回路14と制御部/記憶部15との間にタイマ回路17が追加される点で、実施形態に係るRFタグ回路10とは異なる。
タイマ回路17は、負荷30の起動を検知してからの経過時間を計時し、所定待機時間経過すると調整命令をインピーダンス調整制御回路14に出力する。所定待機時間の長さは、負荷30の駆動時間以下である。すなわち、タイマ回路17は、負荷30が駆動している間に調整命令を送信する。タイマ回路17は、例えば、負荷制御信号が制御部/記憶部15から入力されることで、負荷30の起動を検知できる。
図13は、変形例に係る処理フローの一例を示す図である。図9と同一の処理については同一の符号を付し、その説明を省略する。以下、図13を参照して、変形例に係る処理フローの一例について説明する。
SP1では、インピーダンス調整制御回路14は、調整命令がタイマ回路17から入力されているか否かを判定する。タイマ回路17は、上述の通り、負荷30が起動されてから所定待機時間経過すると調整命令をインピーダンス調整制御回路14に出力する。入力されている場合(SP1でYES)、処理はOP4に進められる。入力されていない場合(SP1でNO)、SP1の処理が繰り返される。SP2の処理は、SP2でNOの場合に繰り返される処理がSP2であることを除いてSP1と同様であるため、その説明を省略する。
図14は、変形例で送信される各種信号の波形の一例を示す図である。図14は、タイマ回路17の出力である調整命令が追加されるとともに、調整命令が送信されるタイミングでサンプルホールドが実行される点で、図11と異なる。図14では、タイマ回路17が計時する所定待機時間(負荷30が起動してから調整トリガを送信するまでの時間)は、「Δt」と記載されている。
変形例では、負荷30が起動されてから所定待機時間後に調整命令を送信した。そのため、変形例によれば、負荷30が起動される周期が変動しても、負荷30が起動してから一定時間経過したときの電源電圧を比較することができる。そのため、第1変形れによれば、負荷30が起動される周期に変動があっても、適切なインピーダンス調整が実行できる。
以上説明した実施形態や変形例では、調整トリガ生成回路16は、整流回路12から供給される電圧と閾値1、閾値2とを比較した。しかしながら、調整トリガ生成回路16が比較対象とするのは、整流回路12から供給される電圧に限定されるわけではない。調整トリガ生成回路16は、例えば、整流回路12から供給される電流や電力を比較対象としてもよい。
以上説明した実施形態や変形例では、マッチング回路11内の可変容量コンデンサ53の容量を単調増加させる線形探索によってインピーダンスの調整が実施された。しかしながら、インピーダンスの調整のアルゴリズムが、可変容量コンデンサ53の容量を単調増加させる線形探索に限定されるわけではない。例えば、可変容量コンデンサ53の容量を単調減少させる線形探索によってインピーダンスの調整が実施されてもよい。また、二分探索、木探索等の任意の探索アルゴリズムによってインピーダンスの調整が実施されてもよい。
以上説明した実施形態や変形例では、例えば、監視電圧と図9のOP4でサンプルホールドしておいた電源電圧との差がδV以下である場合(図9のOP8でNO)に、インピーダンスの調整が終了された。しかしながら、インピーダンス調整終了の判定は、他の基準が採用されてもよい。例えば、インピーダンスの調整は、インピーダンスの調整の実施回数が所定の回数に達した場合に、終了されてもよい。また、インピーダンスの調整は、インピーダンスの調整を実行した時間が所定時間に達した場合に、終了されてもよい。さらには、インピーダンスの調整によって増加させたマッチング回路11のインピーダンス値が所定の値(最大値または最小値)となった場合に、インピーダンス調整が終了されてもよい。
以上で開示した実施形態や変形例はそれぞれ組み合わせる事ができる。
10、10a・・・RFタグ回路
11・・・マッチング回路
12・・・整流回路
13・・・負荷制御回路
132・・・コンデンサ
14・・・インピーダンス調整制御回路
15・・・制御部/記憶部
16・・・調整トリガ生成回路
17・・・タイマ回路
18・・・通信回路
20、41・・・アンテナ
30・・・負荷
40・・・リーダライタ装置
42・・・リーダライタ
43・・・上位装置

Claims (7)

  1. アンテナと負荷とに接続されるRFタグ回路であって、
    前記アンテナが受信した電波を整流して直流電力を供給する整流回路と、
    前記アンテナと前記整流回路との間に配置された、インピーダンスが可変なマッチング回路と、
    前記負荷の起動と停止を繰り返し制御する制御部と、
    前記負荷が起動してから所定時間経過したときに前記マッチング回路のインピーダンスを所定の方向に変化させるとともに前記整流回路が生成する第1の電力を記憶し、前記第1の電力が生成される時点より後のタイミングで前記負荷が起動してから前記所定時間経過したときの前記整流回路が生成する第2の電力と記憶した前記第1の電力との大小関係に基づいて、前記マッチング回路のインピーダンスを変化させる調整部と、を備える、
    RFタグ回路。
  2. 前記所定時間は、前記負荷の時定数で示される時間未満である、
    請求項1に記載のRFタグ回路。
  3. 前記RFタグ回路と前記アンテナとの間のインピーダンスが不整合である場合に、インピーダンス調整の開始を指示する調整指示を前記調整部に送信する指示回路をさらに備え、
    前記調整部は、前記指示回路から前記調整指示を受信すると処理を開始する、
    請求項1または2に記載のRFタグ回路。
  4. 前記RFタグ回路と前記アンテナとの間のインピーダンスが不整合である場合は、前記整流回路が生成する電圧が前記負荷の起動に伴う電圧降下により所定の閾値未満となる場合を含む、
    請求項1から3のいずれか一項に記載のRFタグ回路。
  5. 前記RFタグ回路と前記アンテナとの間のインピーダンスが不整合である場合は、前記アンテナを介した無線通信により前記負荷を利用する装置から受信した前記負荷に対するコマンドの実行結果がエラーであった場合を含む、
    請求項1から4のいずれか一項に記載のRFタグ回路。
  6. 前記RFタグ回路と前記アンテナとの間のインピーダンスが不整合である場合は、前記アンテナを介した無線通信により前記負荷を利用する装置からインピーダンス調整の指示を受信した場合を含む、
    請求項1から5のいずれか一項に記載のRFタグ回路。
  7. 前記制御部は、前記負荷を所定の周期で起動する、
    請求項1から6のいずれか一項に記載のRFタグ回路。
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Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8749319B2 (en) * 2006-11-18 2014-06-10 Rfmicron, Inc. Method and apparatus for detecting RF field strength
JP7227813B2 (ja) * 2019-03-26 2023-02-22 ラピスセミコンダクタ株式会社 無線通信装置
CN112241637B (zh) * 2019-07-19 2024-05-14 上海双十信息科技有限公司 一种rfid读写器及外部控制其通断的方法
WO2021134074A1 (en) * 2019-12-28 2021-07-01 Avery Dennison Retail Information Services, Llc Tuning block methods and systems for use with reactive straps
CN115176252A (zh) 2019-12-28 2022-10-11 艾利丹尼森零售信息服务有限公司 三维物体的射频识别标签
CN113285193B (zh) * 2021-04-20 2022-06-21 武汉德威斯电子技术有限公司 零点可调的跳频滤波器
CN113792833B (zh) * 2021-09-10 2024-05-03 厦门印天电子科技有限公司 阻抗自调节iso15693标签读写装置及其调节方法

Family Cites Families (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07111470A (ja) 1993-10-13 1995-04-25 Tokai Rika Co Ltd 受信機
JP3392016B2 (ja) * 1996-09-13 2003-03-31 株式会社日立製作所 電力伝送システム並びに電力伝送および情報通信システム
JP3488166B2 (ja) * 2000-02-24 2004-01-19 日本電信電話株式会社 非接触icカードシステムとそのリーダライタおよび非接触icカード
JP3650317B2 (ja) * 2000-08-23 2005-05-18 日本電信電話株式会社 電磁場受信装置
JP4666281B2 (ja) * 2005-03-01 2011-04-06 ブラザー工業株式会社 無線タグ回路素子及びタグラベル作成装置
EP1914669B1 (en) * 2006-10-18 2011-04-20 Semiconductor Energy Laboratory Co., Ltd. RFID tag
JP5838324B2 (ja) * 2010-05-03 2016-01-06 パナソニックIpマネジメント株式会社 発電装置、発電システム、および無線電力伝送装置
US8952792B1 (en) * 2011-01-07 2015-02-10 Impinj, Inc. Self tuning RFID tags
US9130369B2 (en) * 2012-08-29 2015-09-08 Qualcomm Incorporated Wireless power overvoltage protection circuit with reduced power dissipation
US8622313B1 (en) * 2012-09-25 2014-01-07 Cambridge Silicon Radio Limited Near field communications device
CN204179231U (zh) * 2012-11-30 2015-02-25 株式会社村田制作所 天线模块
EP2963587B1 (en) * 2014-07-04 2017-03-15 Nxp B.V. Voltage converter
CN105826154B (zh) * 2015-01-06 2017-12-19 北京北方华创微电子装备有限公司 针对脉冲射频电源的阻抗匹配方法及装置
CN105099527B (zh) * 2015-09-08 2018-07-20 王清斌 一种具有独立能量接收天线的无源nfc通信接口
KR20170081809A (ko) * 2016-01-04 2017-07-13 한국전자통신연구원 Rfid 태그 및 그 제어방법

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