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JP5214554B2 - 半導体チップ内蔵パッケージ及びその製造方法、並びに、パッケージ・オン・パッケージ型半導体装置及びその製造方法 - Google Patents

半導体チップ内蔵パッケージ及びその製造方法、並びに、パッケージ・オン・パッケージ型半導体装置及びその製造方法 Download PDF

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JP5214554B2
JP5214554B2 JP2009177856A JP2009177856A JP5214554B2 JP 5214554 B2 JP5214554 B2 JP 5214554B2 JP 2009177856 A JP2009177856 A JP 2009177856A JP 2009177856 A JP2009177856 A JP 2009177856A JP 5214554 B2 JP5214554 B2 JP 5214554B2
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JP
Japan
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package
semiconductor chip
electrode
ball
manufacturing
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良実 江川
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Lapis Semiconductor Co Ltd
Original Assignee
Lapis Semiconductor Co Ltd
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Publication date
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Description

本発明は、半導体チップを内蔵するパッケージを積層することによって構成されるパッケージ・オン・パッケージ（ＰＯＰ）型半導体装置、この装置を構成するための半導体チップ内蔵パッケージ、及びこれらの製造方法に関するものである。
ＰＯＰ型半導体装置及びこの装置を構成するための半導体チップ内蔵パッケージについて、種々の提案がある（例えば、特許文献１及び非特許文献１参照）。
特許文献１（例えば、図１、請求項１参照）は、半導体チップ内蔵パッケージである両面電極構造を開示している。この両面電極構造は、半導体チップが搭載された有機基板と、有機基板の裏面に形成された電極と、半導体チップを覆う封止樹脂と、有機基板の表面の配線に接続され且つ封止樹脂を貫通する柱状の内部接続用電極と、封止樹脂の表面に形成された再配線とを備えている。
また、特許文献１（例えば、図１〜図６、請求項１４参照）は、両面電極構造の製造方法を開示している。この製造方法においては、裏面に外部接続用電極を備えた有機基板の表面上に半導体チップを実装し、連結板により一体に構成された複数の柱状の内部接続用電極のそれぞれの一端を有機基板の表面上に置いて接続し、半導体チップを樹脂封止した後、連結板が無くなるまで研磨又は研削して個々の内部接続用電極に分離して表面の外部接続用電極としている。
非特許文献１（例えば、図１、図３、及びその説明文参照）は、半導体チップ内蔵パッケージである両面電極パッケージを開示している。この両面電極パッケージは、半導体チップが搭載されたインタポーザと、インタポーザの裏面に形成された半田ボールと、半導体チップを覆う封止樹脂と、封止樹脂を貫通する柱状のビアと、封止樹脂の表面に形成された再配線とを備えている。
また、非特許文献１（例えば、図３及びその説明文参照）は、両面電極パッケージの製造方法を開示している。この製造方法においては、半導チップをインタポーザ上に実装し、ステンレス製の支持板上に電気めっき技術により柱状のビアを形成し、支持板上に支持されたビアをインタポーザ上に接続し、半導体チップ上に封止樹脂を充填し、支持板を除去することにより個々のビアを分離し、複数のビアの上端を表面における電極としている。
特願２００８−１６７２９号公報
日経エレクトロニクス、２００８年６月１６日号、第１２〜１３ページ、「３次元実装のＰｏＰに新構造、低背化と積層自由度向上を実現」
しかしながら、特許文献１の装置においては、内部接続用電極は連結板と一体に構成された柱状電極であり、柱状電極のそれぞれの一端を有機基板の配線パターン上に接続した後に、連結板を研磨又は研削して除去するという時間のかかる工程が必要であり、製造コストの削減及び製造時間の短縮（ＴＡＴ短縮）が難しく、その結果、製品の低価格化が難しいという問題がある。
また、特許文献２の装置においては、ビアはステンレス製の支持板上に電気めっきにより形成された柱状電極であり、電気めっきに用いられるレジスタパターン形成のためのフォトリソグラフィ技術はマスクを使用するので製造コスト削減が難しく、また、電気めっきでビアを形成するためには長時間を要するので製造時間の短縮（ＴＡＴ短縮）が難しく、その結果、製品の低価格化が難しいという問題がある。
そこで、本発明は、上記従来技術の課題を解決するためになされたものであり、その目的は、上面に他のパッケージを積層することができ、製造コストの削減及び製造時間の短縮ができ、製品の低価格化を実現できる半導体チップ内蔵パッケージ及びその製造方法、並びに、この半導体チップ内蔵パッケージの上面に他のパッケージを積層させたパッケージ・オン・パッケージ型半導体装置及びその製造方法を提供することにある。
本発明に係る半導体チップ内蔵パッケージの製造方法は、配線パターン及び／又は貫通配線を有する配線基板の第２の面上に、電極としてのボールパッドを形成し、及び、半導体チップを搭載するステップと、前記ボールパッド上に半田材料及び第１のボールを置き、加熱して前記第１のボールを前記ボールパッドに半田接合するステップと、支持板上に第２の外部接続用電極を形成し、該第２の外部接続用電極上に半田材料及び第２のボールを置き、加熱して前記第２のボールを第２の外部接続用電極に半田接合するステップと、前記第１のボール上に前記第２のボールが重なるように前記配線基板上に前記支持板を置き、加熱して前記第１のボールと前記第２のボールを半田接合するステップと、前記半導体チップ、及び、前記第１のボールと前記第２のボールと前記半田とから構成される電極部を、モールド樹脂で封止するステップと、前記支持板を剥がして第２の外部接続用電極を露出させるステップとを有し、前記第１のボール及び前記第２のボールのそれぞれは、前記半田の融点よりも高いガラス転移点を持つ芯部を有することを特徴としている。
本発明によれば、上面に他のパッケージを積層することができる半導体チップ内蔵パッケージ及びこの半導体チップ内蔵パッケージの上面に他のパッケージを積層させたパッケージ・オン・パッケージ型半導体装置の製造コストの削減及び製造時間の短縮ができ、製品の低価格化を実現できるという効果がある。
本発明の第１の実施形態に係る半導体チップ内蔵パッケージの構成の一例を概略的に示す縦断面図である。 第１の実施形態に係る半導体チップ内蔵パッケージの上面の一例を概略的に示す平面図である。 （ａ）〜（ｃ）は、第１の実施形態に係る半導体チップ内蔵パッケージの製造方法の一例を概略的に示す製造工程図（その１）である。 （ａ）〜（ｃ）は、第１の実施形態に係る半導体チップ内蔵パッケージの製造方法の一例を概略的に示す製造工程図（その２）である。 （ａ）〜（ｅ）は、第１の実施形態に係る半導体チップ内蔵パッケージの製造方法の一例を概略的に示す製造工程図（その３）である。 本発明の第２の実施形態に係るＰＯＰ型半導体装置の製造方法の一例を概略的に示す縦断面図である。 第２の実施形態に係るＰＯＰ型半導体装置の構成の一例を概略的に示す縦断面図である。 本発明の第３の実施形態に係るＰＯＰ型半導体装置の構成の一例を概略的に示す縦断面図である。 （ａ）及び（ｂ）は、第３の実施形態に係るＰＯＰ型半導体装置の製造方法の一例を概略的に示す製造工程図である。 第３の実施形態に係るＰＯＰ型半導体装置のリードフレームの一例を概略的に示す平面図である。 本発明の第４の実施形態に係る半導体チップ内蔵パッケージの上面の一例を概略的に示す平面図である。
第１の実施形態．
図１は、本発明の第１の実施形態に係る半導体チップ内蔵パッケージ１０１の構成の一例を概略的に示す縦断面図であり、図２は、第１の実施形態に係る半導体チップ内蔵パッケージ１０１の上面の一例を概略的に示す平面図である。第１の実施形態に係る半導体チップ内蔵パッケージ１０１は、その上の他のパッケージを重ねることにより、パッケージ・オン・パッケージ（ＰＯＰ）型半導体装置を構成することができる。
図１及び／又は図２に示されるように、第１の実施形態に係る半導体チップ内蔵パッケージ１０１は、基板上に形成されたプリント配線からなる配線パターン（図示せず）及び／又は基板を貫通するスルーホールにより基板の両面を電気的に接続する貫通配線１１２を有する配線基板（例えば、ガラスエポキシ基板）１１１と、ガラスエポキシ基板１１１の第１の面１１１ａ側（図１において下側）に備えられた第１の外部接続用電極（例えば、半田端子）１１３とを有している。また、半導体チップ内蔵パッケージ１０１は、ガラスエポキシ基板１１１の第１の面１１１ａの反対側の第２の面１１１ｂ側（図１において上側）に備えられ、配線パターン（図示せず）に接続された電極であるボールパッド１１４と、ガラスエポキシ基板１１１の第２の面１１１ｂ側に搭載された半導体チップ１１５と、配線パターン（図示せず）に接続された電極であるボンディングパッド１１６と、半導体チップ１１５とボンディングパッド１１６を電気的に接続するボンディングワイヤである金線１１７とを有している。ボールパッド１１４及びボンディングパッド１１６は、例えば、Ａｕ−Ａｌ合金などで形成される。
また、図１及び／又は図２に示されるように、半導体チップ内蔵パッケージ１０１は、ボールパッド１１３に接続された電極部１１８と、電極部１１８の上面に備えられた第２の外部接続用電極（ＰＯＰ用パッド）１１９と、半導体チップ１１５と電極部１１８を覆うモールド樹脂１２０とを有している。ＰＯＰ用パッド１１９は、モールド樹脂１２０の表面１２０ａ側（図１の上面）において露出している。ＰＯＰ用パッドは、例えば、Ａｕ−Ａｌ合金などで形成される。また、電極部１１８は、ボールパッド１１４上に配置された第１のボール１２１と、第１のボール１２１とＰＯＰ用パッド１１９の間に配置された第２のボール１２２と、ボールパッド１１３と第１のボール１２１の間、及び、第１のボール１２１と第２のボール１２２の間、及び、第２のボール１２２とＰＯＰ用パッド１１９の間を接続する半田１２３とから構成されている。
第１のボール１２１及び第２のボール１２２のそれぞれは、半田１２３の融点（例えば、２５０℃）よりも高いガラス転移点（ＴＧ）を持つ芯部１２１ａ及び１２２ａを有している。また、第１のボール１２１及び第２のボール１２２のそれぞれは、芯部１２１ａ及び１２２ａのみから構成することができるが（例えば、芯部を導電性の金属とした場合）、芯部１２１ａ及び１２２ａの外周をそれぞれ覆う表面部１２１ｂ及び１２２ｂを有する構成としてもよい。第１のボール１２１及び第２のボール１２２の芯部１２１ａ及び１２２ａは、金属（例えば、Ｃｕ、Ｎｉ、Ａｕ、Ｆｅなど）、合成樹脂、セラミックスなどから構成される。芯部１２１ａ及び１２２ａの周囲の表面部１２１ｂ及び１２２ｂは、例えば、メッキにより形成された導電性の金属層であり、材料としては、例えば、ＳｎＡｇ、ＳｎＡｇＣｕ、ＳｎＡｇＢｉ、Ａｕなどのいずれかの材料がある。第１のボール１２１及び第２のボール１２２の具体例としては、球状のＣｕ材の芯部１２１ａ及び１２２ａの外周にＳｎＡｇめっきして表面部１２１ｂ及び１２２ｂとしたもの、又は、球状の樹脂からなる芯部１２１ａ及び１２２ａの外周をＳｎＡｇめっきして表面部１２１ｂ及び１２２ｂとしたものがある。
図３（ａ）〜（ｃ）、図４（ａ）〜（ｃ）、及び図５（ａ）〜（ｅ）は、第１の実施形態に係る半導体チップ内蔵パッケージ１０１の製造方法の一例を概略的に示す製造工程図である。
半導体チップ内蔵パッケージ１０１の製造においては、図３（ａ）に示されるように、ガラスエポキシ基板１１１の第２の面１１１ｂ上の所定の位置にボールパッド１１４及びボンディングパッド１１６を形成し、所定の位置に接着剤を用いて半導体チップ１１５を搭載し（ダイボンド工程）、図３（ｂ）に示されるように、半導体チップ１１５とボンディングパッド１１６を金線１１７で接続する（ワイヤボンド工程）。次に、図３（ｃ）に示されるように、ボールパッド１１４上に半田ペースト（又は、フラックス及び半田ペースト）１２３ａを供給し、その上に第１のボール１２１を置き、例えば、リフロー法による加熱工程により第１のボール１２１をボールパッド１１４に半田接合し、必要に応じてフラックス除去などを目的とする洗浄を行う（ボール搭載／リフロー工程）。このときのリフロー法では、半田１２３の融点以上の温度であって、第１のボール１２１及び第２のボール１２２の芯部のガラス転移点（ＴＧ）よりも低い温度を用いる。このため、リフロー工程において、第１のボール１２１及び第２のボール１２２の形状はほとんど変形しない。
また、図４（ａ）に示されるように、支持板としてのステンレス（ＳＵＳ）板１３０上に直接又は剥離の容易な層（例えば、図示しない樹脂層など）を挟んで、所定の位置にＰＯＰ用パッド１１９を形成し（例えば、めっき工程によりＰＯＰ用パッド１１９を形成し、又は、接着剤によりＰＯＰパッド１１９を接着し）（パッド形成工程）、図４（ｂ）に示されるように、ＰＯＰ用パッド１１９上に半田ペースト（又は、フラックス及び半田ペースト）１２３ｂを供給する（半田印刷工程）。次に、図４（ｃ）に示されるように、半田ペースト１２３ｂ上に第２のボール１２２を置き、例えば、リフロー法などの加熱工程により第２のボール１２２をＰＯＰ用パッド１１９に半田接合し、必要に応じてフラックス除去などを目的とする洗浄を行う（ボール搭載／リフロー工程）。このときのリフロー法では、半田１２３の融点以上の温度であって、第１のボール１２１及び第２のボール１２２の芯部のガラス転移点（ＴＧ）よりも低い温度を用いる。
次に、図５（ａ）に示されるように、ステンレス板１３０を上下逆にし、第１のボール１２１上に第２のボール１２２が重なるようにガラスエポキシ基板１１１上にステンレス板１３０を置き、例えば、リフロー法などの加熱工程により第１のボール１２１と第２のボール１２２を半田接合し、必要に応じてフラックス成分を洗浄する（ボール接合工程）。このときのリフロー法では、半田１２３の融点以上の温度であって、第１のボール１２１及び第２のボール１２２の芯部のガラス転移点（ＴＧ）よりも低い温度を用いる。次に、図５（ｂ）に示されるように、半導体チップ１１５、及び、第１のボール１２１と第２のボール１２２と半田１２３とから構成される電極部１１８を、モールド樹脂１２０で封止する（樹脂封止工程）。次に、図５（ｃ）に示されるように、ステンレス板１３０を剥がしてＰＯＰ用パッド１１９を露出させる（ステンレス板剥がし工程）。次に、図５（ｄ）に示されるように、ガラスエポキシ基板１１１の第１の面１１１ａ上に第１の外部接続用電極として、例えば、半田端子１１３を形成する（端子形成工程）。次に、図５（ｅ）に示されるように、個片化を行う（個片化工程）ことによって、半導体チップ内蔵パッケージ１０１となる。なお、ステンレス板剥がし工程において、ＰＯＰ用パット１１９が電極部１１８から剥がれないように、ステンレス板１３０とＰＯＰ用パット１１９との接着力を、ＰＯＰ用パット１１９と電極部１１８及びモールド樹脂１２０との密着力よりも弱くしておく必要がある。ＰＯＰ用パット１１９、電極部１１８、モールド樹脂１２０の材料の選定、並びに、ステンレス板１３０にＰＯＰ用パット１１９の接着の仕方（例えば、間に他の剥離層を介在させる、又は、接着力の弱い接着剤を用いるなど）を適切に選ぶことによって、ステンレス板剥がし工程において、ＰＯＰ用パット１１９が電極部１１８から剥がれないようにすることができる。
以上に説明したように、第１の実施形態に係る半導体チップ内蔵パッケージ１０１及びその製造方法によれば、パッケージ上面にＰＯＰ用パッド１１９が形成されているので、その上に他のパッケージを積層することが可能になる。また、第１の実施形態に係る半導体チップ内蔵パッケージ１０１及びその製造方法によれば、電極部１８を第１のボール１２１と、その上に重ねられた第２のボール１２２と、これらをボールパッド１１４及びＰＯＰパッド１１９に接続する半田とから構成しているので、製造コストの削減及び製造時間の短縮ができ、製品の低価格化を実現できる。
第２の実施形態．
図６は、本発明の第２の実施形態に係るＰＯＰ型半導体装置の製造方法の一例を概略的に示す縦断面図であり、図７は、第２の実施形態に係るＰＯＰ型半導体装置の構成の一例を概略的に示す縦断面図である。図６及び図７において、図１に示される構成と同一又は対応する構成には、同じ符号を付す。
図６に示されるように、第２の実施形態に係るＰＯＰ型半導体装置の製造方法においては、上記第１の実施形態に係る半導体チップ内蔵パッケージの製造方法により第１の半導体チップ内蔵パッケージ１０１ａを形成し、上記第１の実施形態に係る半導体チップ内蔵パッケージの製造方法により第２の半導体チップ内蔵パッケージ１０１ｂを形成し、第１の半導体チップ内蔵パッケージ１０１ａ上のＰＯＰ電極１１９に第２の半導体チップ内蔵パッケージ１０１ｂの半田電極１１３が重なるように、第１の半導体チップ内蔵パッケージ１０１ａ上に第２の半導体チップ内蔵パッケージ１０１ｂを重ねて配置し、ＰＯＰ電極と半田電極とを、例えば、リフロー法などの加熱工程により半田接合する。
また、図７に示されるように、上記第１の実施形態に係る半導体チップ内蔵パッケージの製造方法により第３の半導体チップ内蔵パッケージ１０１ｃを形成し、第２の半導体チップ内蔵パッケージ１０１ｂ上に第３の半導体チップ内蔵パッケージ１０１ｃを重ねて配置し、ＰＯＰ電極と半田電極とを、例えば、リフロー法などの加熱工程により半田接合する。以上の工程により、第２の実施形態に係るＰＯＰ型半導体装置が製造される。
第２の実施形態に係るＰＯＰ型半導体装置及びその製造方法によれば、半導体チップ内蔵パッケージ上に他の半導体チップ内蔵パッケージを重ねた積層構造を採用しているので、実装面積の削減を実現することができる。また、第２の実施形態に係るＰＯＰ型半導体装置及びその製造方法によれば、半導体チップ内蔵パッケージの電極部１８を、第１のボール１２１と、その上に重ねられた第２のボール１２２と、これらをボールパッド１１４及びＰＯＰパッド１１９に接続する半田１２３とから構成しているので、製造コストの削減及び製造時間の短縮ができ、製品の低価格化を実現できる。
第３の実施形態．
図８は、本発明の第３の実施形態に係るＰＯＰ型半導体装置の構成の一例を概略的に示す縦断面図であり、図９（ａ）及び（ｂ）は、第３の実施形態に係るＰＯＰ型半導体装置の製造方法の一例を概略的に示す製造工程図である。また、図１０は、第３の実施形態に係るＰＯＰ型半導体装置のリードフレームの一例を概略的に示す平面図である。図８及び図９（ｂ）において、図７に示される構成と同一又は対応する構成には、同じ符号を付す。
図８に示されるように、第３の実施形態に係るＰＯＰ型半導体装置は、図７に示される第２の実施形態に係るＰＯＰ型半導体装置をリードフレーム１４０に接合した構成を有している。図に示されるように、リードフレーム１４０は、例えば、部材１４１を覆うモールド樹脂１４４と、モールド樹脂１４４の外側に固定されたリード端子部１４２とから構成される。図９（ａ）に示されるようなリードフレーム１４０のインナーリード部１４２ａ上に、図９（ｂ）に示されるように、上記第１の実施形態に係る半導体チップ内蔵パッケージ１０１又は上記第２の実施形態に係るＰＯＰ型半導体装置の半田端子１１３を置き、フラックス又は半田ペーストを供給した後に、例えば、リフロー法などの加熱工程により半田接合する。その後、必要があればフラックス成分を洗浄で除去する。さらに、外部リード１４２ｂを曲げ、切断して、図８に示されるようなリードフレーム付きのＰＯＰ型半導体装置が完成する。
第３の実施形態に係るＰＯＰ型半導体装置及びその製造方法によれば、半導体チップ内蔵パッケージ上に他の半導体チップ内蔵パッケージを重ねた積層構造を採用しているので、実装面積の削減を実現することができる。また、第３の実施形態に係るＰＯＰ型半導体装置及びその製造方法によれば、半導体チップ内蔵パッケージの電極部１８を、第１のボール１２１と、その上に重ねられた第２のボール１２２と、これらをボールパッド１１４及びＰＯＰパッド１１９に接続する半田１２３とから構成しているので、製造コストの削減及び製造時間の短縮ができ、製品の低価格化を実現できる。さらに、第３の実施形態に係るＰＯＰ型半導体装置及びその製造方法によれば、ユーザからの要望に応じたリード端子付き半導体チップ内蔵パッケージ又はリード端子付きＰＯＰ型半導体装置を提供できる。
第４の実施形態．
図１１は、本発明の第４の実施形態に係る半導体チップ内蔵パッケージ１０１ｄの上面の一例を概略的に示す平面図である。図１１において、図２の構成と同一又は対応する構成には、同じ符号を付す。第４の実施形態に係る半導体チップ内蔵パッケージ１０１ｄは、モールド樹脂１２０の表面側に備えられた第３の外部接続用電極としてのＰＯＰ用パッド１１９ａと、ＰＯＰ用パッド１１９とＰＯＰ用パッド１１９ａとを接続する再配線１１９ｂとを有する点が、上記第１の実施形態に係る半導体チップ内蔵パッケージ１０１と相違する。上記以外の点において、第４の実施形態に係る半導体チップ内蔵パッケージ１０１ｄ及びその製造方法は、上記第１の実施形態に係る半導体チップ内蔵パッケージ１０１と同じである。
また、第４の実施形態に係る半導体チップ内蔵パッケージ１０１ｄの製造方法においては、第１の実施形態を説明する図４（ａ）の工程において、ステンレス板１３０上にＰＯＰ用パッド１１９、ＰＯＰ用パッド１１９ａ、及びＰＯＰ用パッド１１９とＰＯＰ用パッド１１９ａとを接続する再配線１１９ｂを形成する。上記以外の点において、第４の実施形態に係る半導体チップ内蔵パッケージ１０１ｄの製造方法は、上記第１の実施形態に係る半導体チップ内蔵パッケージ１０１の製造方法と同じである。
第４の実施形態に係る半導体チップ内蔵パッケージ１０１ｄ及びその製造方法によれば、異なるサイズの半導体チップ内蔵パッケージを積層することが可能になる。
なお、第４の実施形態に係る半導体チップ内蔵パッケージ１０１ｄを、第２の実施形態又は第３の実施形態に係るＰＯＰ型半導体装置を構成するパッケージとして使用することができる。
１０１，１０１ａ〜１０１ｄ 半導体チップ内蔵パッケージ、 １１１ ガラスエポキシ基板、 １１１ａ ガラスエポキシ基板の第１の面、 １１１ｂ ガラスエポキシ基板の第２の面、 １１２ ガラスエポキシ基板の貫通配線、 １１３ 半田端子、 １１４ ボールパッド、 １１５ 半導体チップ、 １１６ ボンディングパッド、 １１７ 金線、 １１８ 電極部、 １１９，１１９ａ ＰＯＰ用パッド、 １１９ｂ 再配線、 １２０ モールド樹脂、 １２０ａ モールド樹脂の表面、 １２１ 第１のボール、 １２１ａ 第１のボールの芯部、 １２１ｂ 第１のボールの表面部、 １２２ 第２のボール、 １２２ａ 第２のボールの芯部、 １２２ｂ 第２のボールの表面部、 １２３ 半田、 １２３ａ，１２３ｂ 半田材料、 １３０ ステンレス板、 １４０ リードフレーム、 １４４ モールド樹脂。

Claims (11)

  1. 配線パターン及び／又は貫通配線を有する配線基板の第２の面上に、電極としてのボールパッドを形成し、及び、半導体チップを搭載するステップと、
    前記ボールパッド上に半田材料及び第１のボールを置き、加熱して前記第１のボールを前記ボールパッドに半田接合するステップと、
    支持板上に第２の外部接続用電極を形成し、該第２の外部接続用電極上に半田材料及び第２のボールを置き、加熱して前記第２のボールを第２の外部接続用電極に半田接合するステップと、
    前記第１のボール上に前記第２のボールが重なるように前記配線基板上に前記支持板を置き、加熱して前記第１のボールと前記第２のボールを半田接合するステップと、
    前記半導体チップ、及び、前記第１のボールと前記第２のボールと前記半田とから構成される電極部を、モールド樹脂で封止するステップと、
    前記支持板を剥がして第２の外部接続用電極を露出させるステップとを有し、
    前記第１のボール及び前記第２のボールのそれぞれは、前記半田の融点よりも高いガラス転移点を持つ芯部を有する
    ことを特徴とする半導体チップ内蔵パッケージの製造方法。
  2. 前記第１のボール及び前記第２のボールのそれぞれは、前記芯部の外周を覆う外面部をさらに有することを特徴とする請求項１に記載の半導体チップ内蔵パッケージの製造方法。
  3. 前記芯部は、金属、合成樹脂、セラミックスのいずれかの材料で構成され、
    前記外面部は、金属材料で構成される
    ことを特徴とする請求項２に記載の半導体チップ内蔵パッケージの製造方法。
  4. 前記モールド樹脂の表面側に第３の外部接続用電極を形成するステップと、
    前記第２の外部接続用電極と前記第３の外部接続用電極とを接続する再配線を形成するステップと
    をさらに有することを特徴とする請求項１乃至３のいずれか１項に記載の半導体チップ内蔵パッケージの製造方法。
  5. 前記支持板は、ステンレス板であることを特徴とする請求項１乃至３のいずれか１項に記載の半導体チップ内蔵パッケージの製造方法。
  6. 前記支持板は、ステンレス板と、該ステンレス板上に形成された樹脂層とを有し、
    前記支持板上の前記第２の外部接続用電極は、前記樹脂層上に配置される
    ことを特徴とする請求項１乃至３のいずれか１項に記載の半導体チップ内蔵パッケージの製造方法。
  7. 前記配線基板の前記第２の面の反対側の第１の面に半田材料からなる第１の外部接続用電極を形成するステップをさらに有することを特徴とする請求項１乃至６のいずれか１項に記載の半導体チップ内蔵パッケージの製造方法。
  8. 請求項１乃至７のいずれか１項に記載の半導体チップ内蔵パッケージの製造方法により第１の半導体チップ内蔵パッケージを形成するステップと、
    請求項７に記載の半導体チップ内蔵パッケージの製造方法により第２の半導体チップ内蔵パッケージを形成するステップと、
    前記第１の半導体チップ内蔵パッケージの第２の外部接続用電極上に前記第２の半導体チップ内蔵パッケージの第１の外部接続用電極が接続されるように、前記第１の半導体チップ内蔵パッケージ上に前記第２の半導体チップ内蔵パッケージを重ねて配置し、加熱して半田接合するステップと
    を有することを特徴とするパッケージ・オン・パッケージ型半導体装置の製造方法。
  9. 請求項４に記載の半導体チップ内蔵パッケージの製造方法により第１の半導体チップ内蔵パッケージを形成するステップと、
    請求項７に記載の半導体チップ内蔵パッケージの製造方法により第２の半導体チップ内蔵パッケージを形成するステップと、
    前記第１の半導体チップ内蔵パッケージの第３の外部接続用電極上に前記第２の半導体チップ内蔵パッケージの第１の外部接続用電極が接続されるように、前記第１の半導体チップ内蔵パッケージ上に前記第２の半導体チップ内蔵パッケージを重ねて配置し、加熱して半田接合するステップと
    を有することを特徴とするパッケージ・オン・パッケージ型半導体装置の製造方法。
  10. 配線パターン及び／又は貫通配線を有する配線基板の第２の面上に、電極パッドを形成し、及び、半導体チップを搭載するステップと、
    前記電極パッド上に半田材料及び第１の電極を置き、加熱して前記第１の電極を前記電極パッドに半田接合するステップと、
    支持板上に第２の外部接続用電極を形成し、該第２の外部接続用電極上に半田材料及び第２の電極を置き、加熱して前記第２の電極を第２の外部接続用電極に半田接合するステップと、
    前記第１の電極上に前記第２の電極が重なるように前記配線基板上に前記支持板を置き、加熱して前記第１の電極と前記第２の電極を半田接合するステップと、
    前記半導体チップ、及び、前記第１の電極と前記第２の電極と前記半田とから構成される電極部を、モールド樹脂で封止するステップと、
    前記支持板を剥がして第２の外部接続用電極を露出させるステップとを有し、
    前記第１の電極及び前記第２の電極のそれぞれは、前記半田の融点よりも高いガラス転移点を持つ芯部を有する
    ことを特徴とする半導体チップ内蔵パッケージの製造方法。
  11. 前記第１の電極及び前記第２の電極は、ボール形状であることを特徴とする請求項１０に記載の半導体チップ内蔵パッケージの製造方法。
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