JP5076881B2

JP5076881B2 - 伝送特性調整装置、回路基板、及び伝送特性調整方法

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Publication number: JP5076881B2
Application number: JP2007334547A
Authority: JP
Inventors: 大太鍔本; 誠須和田; 均除村; 正喜登坂
Original assignee: Fujitsu Ltd
Current assignee: Fujitsu Ltd
Priority date: 2007-12-26
Filing date: 2007-12-26
Publication date: 2012-11-21
Anticipated expiration: 2027-12-26
Also published as: EP2075970A2; JP2009159257A; US8000662B2; US20090167452A1

Description

本発明は伝送路を介して送信素子と受信素子との間での伝送特性を調整する伝送特性調整装置、回路基板および伝送特性調整方法に係り、特に、信号伝送系の受信素子入力における波形品質の劣化を、多相CLKを用いて測定した時間軸方向のウィンドウ幅を指標として監視し、その結果を用いて伝送特性の調整を行う伝送特性調整装置、回路基板、及び伝送特性調整方法に関するものである。

近年、信号伝送の高速化に伴い、そのマージン（波形マージン）は小さくなる傾向にあり、設計、評価段階だけでなく、装置上で適所ごとに逐次伝送特性を調整する必要性が高まってきている。

これに対して従来から提供されている技術は、エラー率を監視しながら、任意の回路要素を調整して伝送特性を調整する方式を採用している。例えば参考文献として、下記特許文献が挙げられる。
特開２００３−０３２１８７号公報

しかしながら、エラー率を監視しながら、回路要素を調整することになると、ある程度のエラー率を許容せざるを得ず、従って、従来の技術ではある程度のエラー率を許容することができるシステムにしか適用することができないという問題点がある。

本発明は、上述した問題点を解決するためになされたものであり、エラーを起こす前に回路調整を行うことができ、エラーを生じることがなくて、伝送特性の信頼性の高い伝送特性調整装置、そのような伝送特性調整装置を組み込んだ回路基板、及び伝送特性調整方法を提供することを目的としている。

上述した課題を解決するため、この伝送特性調整装置は、伝送路を介する送信素子と受信素子との間での伝送特性を調整する伝送特性調整装置であって、多相クロックの各位相により、確定されたデータについての相異の有無を判断する判断部と、前記判断部の判断結果と前記多相クロックの位相に基づいて、受信データの時間軸方向のウィンドウ幅を検出するウィンドウ検出部と、前記ウィンドウ検出部により検出されたウィンドウ幅の変動に基づいて、受信波形に影響を及ぼす前記送信素子又は前記受信素子の回路要素の設定値について評価し、該評価結果に基づいて、前記送信素子又は前記受信素子の回路要素の設定値を変更する回路要素設定部とを備える。

また、この回路基板は、伝送路を介して送信素子と受信素子との間での伝送特性を調整する伝送特性調整装置を有する回路基板であって、前記伝送特性調整装置は、多相クロックの各位相により、確定されたデータについての相異の有無を判断する判断部と、前記判断部の判断結果と前記多相クロックの位相に基づいて、受信データの時間軸方向のウィンドウ幅を検出するウィンドウ検出部と、前記ウィンドウ検出部により検出されたウィンドウ幅の変動に基づいて、受信波形に影響を及ぼす前記送信素子又は前記受信素子の回路要素の設定値について評価し、該評価結果に基づいて、前記送信素子又は前記受信素子の回路要素の設定値を変更する回路要素設定部とを備える。

また、この伝送特性調整方法は、伝送路を介する送信素子と受信素子との間での伝送特性を調整する伝送特性調整方法であって、多相クロックの各位相により、確定されたデータについての相異の有無を判断し、前記判断結果と前記多相クロックの位相に基づいて、受信データの時間軸方向のウィンドウ幅を検出し、前記検出されたウィンドウ幅の変動に基づいて、受信波形に影響を及ぼす前記送信素子又は前記受信素子の回路要素の設定値について評価し、該評価結果に基づいて、前記送信素子又は前記受信素子の回路要素の設定値を変更する。

本発明によれば、検出された時間軸方向のウィンドウ幅の変動に基づいて、設定の評価を行い、その評価結果に応じて伝送特性を調整することができ、常に信頼性高い伝送を行うことができるという効果を奏する。

以下、本発明の実施の形態を図を用いて説明する。

実施の形態１．
図１は本発明の実施の形態１における全体構成を示すブロック図である。この実施の形態は送信素子１００と受信素子２００とこれらの間に設けられる伝送路３００とを備えて構成される。

送信素子１００は、内部処理回路１０１とその処理結果を伝送路に出力する出力バッファ１０２を備えている。

また受信素子２００は、イコライザ２０１Ａ，２０１Ｂと入力バッファ２０２Ａ，２０２Ｂとを有する二つの受信系ＲＡ，ＲＢと経路切り替え回路２０３と内部処理回路２０４とを備える。

そして、二つの受信系ＲＡ，ＲＢのうちの一つの受信系ＲＢは、多相クロックを発生する多相クロック発生器２０５と、時間軸ウィンドウ幅を検出する時間軸ウィンドウ幅監視回路（時間軸ウィンドウ幅検出部）２０６と、時間軸ウィンドウ幅監視回路２０６により検出されたウィンドウ幅の変動を検出し該変動に基づいて、ウィンドウ幅に影響を与える回路要素（ここではイコライザ２０１Ｂ）の設定値についての評価を行い、該評価結果に基づいてイコライザ２０１Ｂ（回路要素の設定値）を調整する回路要素調整回路（回路要素調整部）２０７を備える。

以下これらについて詳述する。伝送路３００は、送信素子１００と受信素子２００を接続する線路であり、具体的にはプリント配線板、Cableなどにより構成される。

イコライザ２０１Ａ，２０１Ｂは、伝送路で損失する高周波成分を受信素子２００側で補償する回路である。

多相クロック発生器２０５は、１周期を任意数で分割した時間幅ずつ位相を変動させたCLKを発生する。

時間軸ウィンドウ幅監視回路２０６は、入力されるデータを多相CLKから供給されたそれぞれの位相のCLKで確定し、隣り合う位相の論理が異なる部分をデータ変化点として認識することにより、時間軸上のウィンドウ幅を測定する。なお、時間軸ウィンドウ幅監視回路２０６は、ウィンドウ幅の測定とともに、その変動を監視するものであってもよい。

回路要素調整回路２０７は、時間軸ウィンドウ幅監視回路２０６により測定されたウィンドウ幅の変動を検出し、該変動に基づいてイコライザ２０１Ｂの設定値を評価し、該評価結果に基づいて、イコライザ２０１Ｂの設定値を変更調整する。この調整は時間軸ウィンドウの幅が最大になるように行う。なお、本実施の形態においては、回路要素調整回路２０７にウィンドウ幅の変動の検出機能を設けたが、上述のように、時間軸ウィンドウ幅監視回路２０６に設けるようにしても良い。

以下、実施の形態１の全体動作について、図２のフローチャートを用いて説明する。

（データ変化点の検出：Ｓ１）
データ変化点を検出する方式は一般的なクロック・リカバリ回路で採用されている方式とする。具体的なプロセスを以下に説明する。

（第１ステップ）多相クロックの発生
図３に示すように、外部から入力された、または内部でもっている基準となるクロック信号を元に、任意の値だけ位相がずれたクロックを発生させる。発生させる本数はクロックの周期を位相ずれの値で割った数とする。

（第２ステップ）各位相クロックでの論理確定
図４に示すように、前項（第１ステップ）で発生した多相クロックのそれぞれで受信データを確定する。

（第３ステップ）隣接位相間で論理が異なる部分を検出
図５に示すように、前項（第２ステップ）で確定した論理を調べ、隣り合う位相で論理が異なる部分を検出する。図の例では「CLK1」と「CLK2」の間がそれにあたる。これをデータの変化点とみなす。このとき、変化点の抽出は複数ビットのデータにおける変化点の平均値をとることとする。

（時間軸ウィンドウ幅の算出：Ｓ２）
図６に示すように、前項の手法（Ｓ１）によって、データ変化点を検出し、検出されたデータ変化点同士の時間間隔を測定することにより時間軸ウィンドウ幅を得ることができる。

（時間軸ウィンドウ幅の変動監視：Ｓ３）
図７に示すように、時間軸ウィンドウ幅監視回路２０６は、一定の周期でウィンドウ幅を監視し、ウィンドウ幅に変動があった場合は（Ｓ３，Ｙ）、回路要素の調整（Ｓ４）に進む。変動がない場合は（Ｓ３，Ｎ）、ステップＳ１に戻る。ウィンドウ幅の監視は前回測定との差分に対して任意の基準値を設定することによって実現する。

（回路要素の調整：Ｓ４）
回路要素の調整は、以下の手順で行われる。図８は動作概要を示すブロック図であり、図９は回路要素の調整動作を示すフローチャートである。

イコライザ回路の高周波成分に関する増幅量(以降イコライザ量と表現する)の設定を初期値「０」に設定し（Ｓ４−１）、時間軸ウィンドウ幅を測定する(Ｓ４−２)。次に、イコライザ量の設定を次の増加方向段階に変更し（Ｓ４−３）、時間軸ウィンドウ幅を測定する（Ｓ４−４）。

以上のステップ（Ｓ４−３）、（Ｓ４−４）の処理を全ての設定値について実施し（Ｓ４−５）、ウィンドウ幅が最大となる設定を検出し、これを採用値とする（Ｓ４−６）。

（設定の反映：Ｓ５）
前項（Ｓ４）で検出した設定を回路に反映する。
このとき設定変更に伴うエラーを生じないように回路を制御する必要がある。この機能を図１０に示す動作概念図の経路切り替え回路に持たせる。具体的な手順を図１１に従って説明する。

まず、抽出した設定を図１０に示すSub系ＲＢに反映する（Ｓ５−１）。次に、Sub系の設定切り替え時のエラーが収まったことを、Sub系とMain系の受信データの相異（一致）により検出する（Ｓ５−２）。このデータの相異を確認する回路の具体例としては排他的論理和の利用があげられる。データの相異を確認するためには数ミリ秒程度の監視が必要となる。この監視に必要な時間が送受信データの何倍に相当するかを計算し、その結果をカウンタで計測することによって、所望の一致（相異）監視時間を得る。この構成回路の一例を図１２に示す。

図１２には、Main系とSub系の受信データを入力する排他的論理和回路２２１と、その出力を一致を監視するための周期計算回路２２２で指示される周期にわたり、カウントするカウンタ２２３と、そのカウンタ２２３のカウント値に基づいてMain系とSub系を切替えるセレクタ２２４とを備えて構成される。

そして、Main系とSub系の一致が確認されると（Ｓ５−２）、受信データとしてSub系を選択する(Ｓ５−３)。そして、Sub系の設定をMain系に反映し（Ｓ５−４）、Main系の設定切り替え時のエラーが収まったことを、Sub系とMain系の受信データの一致により確認すると(Ｓ５−５)、受信データとしてMain系を選択する(Ｓ５−６)。

実施の形態２．
実施の形態１では伝送特性を制御する回路要素、即ち回路要素設定回路２０７が調整する回路要素としてイコライザを採用しているが、送信素子１００、および受信素子２００を制御することによって、同様の効果を得ることができる。

例えば実施の形態２として、図１３に示すように伝送路の両端である送信素子１００の出力バッファ１０２の出力側と受信素子２００の入力バッファ２０２Ａ,２０２Ｂの入力側とに設けられる内蔵終端抵抗１３１，２３１Ａ，２３１Ｂの値を変更制御することによっても、実施の形態１と同様な効果を得ることができる。

実施の形態３．
また、実施の形態３においては、回路要素の設定として、送信素子１００Ａの送信系を冗長化することもできる。上述した実施の形態１では、受信素子側のみで冗長回路が構成されているため、送信側の回路要素を調節することができない。

そこで、図１４に示すように、送信素子１００Ａ内におけるデータ送信系を冗長に備えることによって、受信素子側から伝送されてくる制御信号によって、プリエンファシス量、振幅、およびデータ送信系の切り替えを行いながら伝送特性を調整することによって、同様の効果を得ることができる。

図１４では、送信素子内に複数（二つ）のデータ送信系ＴＡ，ＴＢを備えるとともに、これら送信系のそれぞれが出力バッファ１０２Ａ,１０２Ｂとプリエンファシス設定回路１０５Ａ,１０５Ｂを有する。そして、これら送信系を受信素子２００側の回路要素設定回路２０７からの制御信号により切替える経路切り替え回路１０６を備えている。

実施の形態４．
実施の形態１では、信号伝送系をMainとSunの２系統にわけ、回路要素の調整についてはSub側にその機能をもたせている。この構成によれば、図１５（ａ）に示すように、設定の切り替え時にMain→Sub→Mainという手順になり２回の切り替えが必要となる。これに対し、図１５（ｂ）に示すように、信号伝送系の２重化を完全に対称な形態にすることによって、MainとSubという区別がなくなり、回路の切り替えを信号伝送系（１）→信号伝送系（２）と１回に減少させることができる。

実施の形態５．
実施の形態１では、図１６（ａ）に示すように、ウィンドウ幅監視系を含むSub系をそれぞれのチェンネルに持たせることになるが、これを図１６（ｂ）に示すように複数のデータ伝送系で共有することにより回路規模を小さくすることができる。なお、共有は時分割方式とする。

実施の形態６．
実施の形態３では、送信素子の冗長化について説明した。これは図１７（ａ）に示すように、送信素子側の回路要素を制御する手段として主信号の伝送路３００ａと別に、受信素子から送信素子へ制御信号を送付するための伝送路３００ｂを付加している。このため、専用の信号Ｐｉｎを送信素子、受信素子、コネクタに用意する必要があり、実装効率を悪化させることとなる。

これに対し、図１７（ｂ）に示すように、受信素子２００に制御信号搬送波を生成して主信号の配線に重畳する制御信号搬送波生成回路３７１を設けると共に、送信素子１００に主信号に重畳された制御信号搬送波を受信する制御信号搬送波受信回路１７１を設け、受信素子２００側からの制御信号を差動データ伝送系に同相で重畳して伝送することにより、送受信データへの影響なく、かつ、制御信号用伝送路を追加することなく、送信素子への制御信号伝送を実現できる。

実施の形態７．
実施の形態１では、図１８（ａ）に示すように、伝送特性を制御する回路要素としてイコライザを採用しているが、図１８（ｂ）に示すように、送信素子１００、または受信素子２００のＰＬＬ２６１に供給する電源の電源フィルタを構成する回路部品(定数可変のインダクタンス、コンデンサ、抵抗)２６２の定数を制御することによっても、同様の効果を得ることができる。実施の形態１１では、このようにジッタ周波数耐性を調整する。

信号伝送系においてジッタによるエラーが発生する場合、その原因となるジッタ周波数は限定されることが多い。そして、そのジッタはＰＬＬ２６１の電源供給系に混入する雑音によって生じる場合が多い。よって、ＰＬＬ２６１への電源供給端子の内部に可変素子(コンデンサ、またはインダクタンス)２６２を作りこみ、この内部素子と外部に作成した外部電源フィルタ（フィルタ回路）２６３の合成で決まるフィルタの特性を変化させることのよって原因となるジッタを抑制することができる。

以上に説明したように、本実施の形態によれば、結果を確認しながら伝送特性の調整を図る事が可能となり、またマージンの測定をデジタル回路で構成しているのでLSIへの適用が容易になる。よって、信号伝送の品質改善に寄与することができるという効果を奏する。

以上に説明したように、実施の形態によれば、伝送の結果を確認しながら伝送特性の調整を図る事が可能となり、また時間軸ウィンドウ幅の測定をデジタル回路で構成しているのでLSIへの適用が容易になる。よって、信号伝送の品質改善に寄与することができるという効果を奏する。

以上、本実施の形態によれば、以下の付記で示す技術的思想が開示されている。
（付記１）伝送路を介する送信素子と受信素子との間での伝送特性を調整する伝送特性調整装置であって、
多相クロックの各位相により、確定されたデータについての相異の有無を判断する判断部と、
前記判断部の判断結果と前記多相クロックの位相に基づいて、受信データの時間軸方向のウィンドウ幅を検出するウィンドウ検出部と、
前記ウィンドウ検出部により検出されたウィンドウ幅の変動に基づいて、受信波形に影響を及ぼす前記送信素子又は前記受信素子の回路要素の設定値について評価し、該評価結果に基づいて、前記送信素子又は前記受信素子の回路要素の設定値を変更する回路要素設定部と、
を備える伝送特性調整装置。
（付記２）付記１に記載の伝送特性調整装置において、
前記回路要素設定部は、前記伝送路の終端に設けられる内蔵終端抵抗を変更することにより伝送特性を調整する伝送特性調整装置。
（付記３）付記１に記載の伝送特性調整装置において、
前記受信素子内に複数のデータ受信系を備えてなり、前記回路要素設定部は、前記評価結果に基づいて、前記データ受信系を切替えることにより伝送特性を調整する伝送特性調整装置。
（付記４）付記１に記載の伝送特性調整装置において、
前記送信素子内に複数のデータ送信系を備えてなり、前記回路要素設定部は、前記評価結果に基づいて、前記複数のデータ送信系を切替えることにより伝送特性を調整する伝送特性調整装置。
（付記５）付記１に記載の伝送特性調整装置であって、
前記伝送特定調整装置は、前記受信素子内に設けられる複数の受信系のそれぞれに設けられる伝送特性調整装置。
（付記６）付記１に記載の伝送特性調整装置であって、
前記ウィンドウ検出部及び前記回路要素設定部は、前記受信素子内に設けられる複数の受信系に対して共用されるように設けられる伝送特性調整装置。
（付記７）付記１に記載の伝送特性調整装置において、
前記回路要素設定部は、前記送信素子、または前記受信素子のPLLに供給する電源の電源フィルタを構成するインダクタンス、コンデンサ、及び抵抗のうちの少なくともいずれか一つの定数を変更することによって、ジッタ周波数耐性の調整を行う伝送特性調整装置。
（付記８）付記４に記載の伝送特性調整装置において、
前記回路要素設定部は、前記送信素子側へ送信する設定用の制御信号を、変調して差動データ伝送系に同相で重畳して伝送する伝送特性調整装置。
（付記９）伝送路を介して送信素子と受信素子との間での伝送特性を調整する伝送特性調整装置を有する回路基板であって、
前記伝送特性調整装置は、
多相クロックの各位相により、確定されたデータについての相異の有無を判断する判断部と、
前記判断部の判断結果と前記多相クロックの位相に基づいて、受信データの時間軸方向のウィンドウ幅を検出するウィンドウ検出部と、
前記ウィンドウ検出部により検出されたウィンドウ幅の変動に基づいて、受信波形に影響を及ぼす前記送信素子又は前記受信素子の回路要素の設定値について評価し、該評価結果に基づいて、前記送信素子又は前記受信素子の回路要素の設定値を変更する回路要素設定部と、
を備える回路基板。
（付記１０）付記９に記載の回路基板において、
前記回路要素設定部は、前記伝送路の終端に設けられる内蔵終端抵抗を変更することにより伝送特性を調整する回路基板。
（付記１１）付記９に記載の回路基板において、
前記受信素子内に複数のデータ受信系を備えてなり、前記回路要素設定部は、前記評価結果に基づいて、前記データ受信系を切替えることにより伝送特性を調整する回路基板。
（付記１２）付記９に記載の回路基板において、
前記送信素子内に複数のデータ送信系を備えてなり、前記回路要素設定部は、前記評価結果に基づいて、前記複数のデータ送信系を切替えることにより伝送特性を調整する回路基板。
（付記１３）付記９に記載の回路基板において、
前記ウィンドウ検出部及び前記回路要素設定部は、前記受信素子内に設けられる複数の受信系に対して共用されるように設けられる回路基板。
（付記１４）付記９に記載の回路基板において、
前記回路要素設定部は、前記送信素子、または前記受信素子のPLLに供給する電源の電源フィルタを構成するインダクタンス、コンデンサ、及び抵抗のうちの少なくともいずれか一つの定数を変更することによって、ジッタ周波数耐性の調整を行う回路基板。
（付記１５）伝送路を介する送信素子と受信素子との間での伝送特性を調整する伝送特性調整方法であって、
多相クロックの各位相により、確定されたデータについての相異の有無を判断し、
前記判断結果と前記多相クロックの位相に基づいて、受信データの時間軸方向のウィンドウ幅を検出し、
前記検出されたウィンドウ幅の変動に基づいて、受信波形に影響を及ぼす前記送信素子又は前記受信素子の回路要素の設定値について評価し、該評価結果に基づいて、前記送信素子又は前記受信素子の回路要素の設定値を変更する
伝送特性調整方法。
（付記１６）付記１５に記載の伝送特性調整方法において、
前記伝送路の終端に設けられる内蔵終端抵抗を変更することにより伝送特性を調整する伝送特性調整方法。
（付記１７）付記１５に記載の伝送特性調整方法において、
前記受信素子内に複数のデータ受信系を備えてなり、前記評価結果に基づいて、前記データ受信系を切替えることにより伝送特性を調整する伝送特性調整方法。
（付記１８）付記１５に記載の伝送特性調整方法において、
前記送信素子内に複数のデータ送信系を備えてなり、前記評価結果に基づいて、前記複数のデータ送信系を切替えることにより伝送特性を調整する伝送特性調整方法。
（付記１９）付記１５に記載の伝送特性調整方法において、
前記送信素子、または前記受信素子のPLLに供給する電源の電源フィルタを構成するインダクタンス、コンデンサ、及び抵抗のうちの少なくともいずれか一つの定数を変更することによって、ジッタ周波数耐性の調整を行う伝送特性調整方法。
（付記２０）付記１８に記載の伝送特性調整方法において、
前記送信素子側へ送信される設定用の制御信号は、変調されて差動データ伝送系に同相で重畳されて伝送される伝送特性調整方法。

本発明の実施の形態１を示すブロック図である。本発明の実施の形態１の全体動作を示すフローチャートである。多相クロックの発生を説明する概念図である。各位相クロックでの論理確定動作を示す概念図である。隣接位相間で論理値の変化検出動作を示す概念図である。時間軸ウィンドウ幅の算出動作を示す概念図である。時間軸ウィンドウ幅の変動監視動作を示す概念図である。回路要素の調整動作を示す概念図である。回路要素の調整動作を示すフローチャートである。調整された設定値の反映動作を示す概念図である。経路切り替え動作を示すフローチャートである。データの一致（相異）監視回路を示すブロック図である。実施の形態２における内臓終端抵抗の制御の調整動作を示す概念図である。実施の形態３における送信素子の冗長化を示すブロック図である。実施の形態４における信号伝送系の２重化を示すブロック図である。実施の形態５における時間軸ウィンドウ幅監視系の共有を示すブロック図である。実施の形態６における主信号伝送系への制御信号の重畳を示す概念図である。実施の形態７における電源フィルタ定数の調整動作を示すブロック図である。

符号の説明

１００送信素子、１０１内部処理回路、１０２出力バッファ、２００受信素子、２０１Ａ，２０１Ｂイコライザ、２０２Ａ，２０２Ｂ入力バッファ、２０３経路切り替え回路、２０４内部処理回路、２０５多相クロック発生器、２０６時間軸ウィンドウ幅監視回路、２０７回路要素調整回路、ＲＡ，ＲＢ受信系。

Claims

伝送路を介する送信素子と受信素子との間での伝送特性を調整する伝送特性調整装置であって、
多相クロックの各位相により、確定されたデータについての相異の有無を判断する判断部と、
前記判断部の判断結果と前記多相クロックの位相に基づいて、受信データの時間軸方向のウィンドウ幅を検出するウィンドウ検出部と、
前記ウィンドウ検出部により検出されたウィンドウ幅の変動に基づいて、受信波形に影響を及ぼす前記送信素子又は前記受信素子の回路要素の設定値について評価し、該評価結果に基づいて、前記送信素子又は前記受信素子の回路要素の設定値を変更する回路要素設定部とを備え、
前記送信素子内に複数のデータ送信系を備えてなり、前記回路要素設定部は、前記評価結果に基づいて、前記複数のデータ送信系を切替えることにより伝送特性を調整する伝送特性調整装置。
請求項１に記載の伝送特性調整装置において、
前記受信素子内に複数のデータ受信系を備えてなり、前記回路要素設定部は、前記評価結果に基づいて、前記データ受信系を切替えることにより伝送特性を調整する伝送特性調整装置。
請求項１に記載の伝送特性調整装置であって、
前記伝送特定調整装置は、前記受信素子内に設けられる複数の受信系のそれぞれに設けられる伝送特性調整装置。
請求項１に記載の伝送特性調整装置であって、
前記ウィンドウ検出部及び前記回路要素設定部は、前記受信素子内に設けられる複数の受信系に対して共用されるように設けられる伝送特性調整装置。
請求項２に記載の伝送特性調整装置において、
前記回路要素設定部は、前記送信素子側へ送信する設定用の制御信号を、変調して差動データ伝送系に同相で重畳して伝送する伝送特性調整装置。
伝送路を介して送信素子と受信素子との間での伝送特性を調整する伝送特性調整装置を有する回路基板であって、
前記伝送特性調整装置は、
多相クロックの各位相により、確定されたデータについての相異の有無を判断する判断部と、
前記判断部の判断結果と前記多相クロックの位相に基づいて、受信データの時間軸方向のウィンドウ幅を検出するウィンドウ検出部と、
前記ウィンドウ検出部により検出されたウィンドウ幅の変動に基づいて、受信波形に影響を及ぼす前記送信素子又は前記受信素子の回路要素の設定値について評価し、該評価結果に基づいて、前記送信素子又は前記受信素子の回路要素の設定値を変更する回路要素設定部とを備え、
前記送信素子内に複数のデータ送信系を備えてなり、前記回路要素設定部は、前記評価結果に基づいて、前記複数のデータ送信系を切替えることにより伝送特性を調整する回路基板。
伝送路を介する送信素子と受信素子との間での伝送特性を調整する伝送特性調整方法であって、
多相クロックの各位相により、確定されたデータについての相異の有無を判断し、
前記判断結果と前記多相クロックの位相に基づいて、受信データの時間軸方向のウィンドウ幅を検出し、
前記検出されたウィンドウ幅の変動に基づいて、受信波形に影響を及ぼす前記送信素子又は前記受信素子の回路要素の設定値について評価し、該評価結果に基づいて前記送信素子又は前記受信素子の回路要素の設定値を変更し、前記評価結果に基づいて前記送信素子内に備えられた複数のデータ送信系を切替えることにより伝送特性を調整する伝送特性調整方法。