JP3524817B2 - バーストゲートパルスタイミング補正回路 - Google Patents
バーストゲートパルスタイミング補正回路Info
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- Processing Of Color Television Signals (AREA)
Description
【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明はＮＴＳＣ方式の搬送
色信号を処理するＴＶ、ＶＴＲに関する。 【０００２】 【従来の技術】近年ＴＶや家庭用ＶＴＲにおいて信号処
理をデジタル処理するものが増えている。 【０００３】このようなシステムでは入力信号の搬送色
信号におけるバースト部を抜き取り、色副搬送波である
３．５８ＭＨｚの４倍の周波数ｆｓｃ＝１４．３ＭＨｚ
を入力信号のバーストにＰＬＬで位相同期させるのが一
般的である。 【０００４】図３に回路例を示す。以下この図にしたが
って説明する。 【０００５】Ａ／Ｄ変換入力された輝度信号，または複
合映像信号は同期分離回路内１のローパスフィルタ（以
下ＬＰＦ）により高域ノイズ及び色信号が除去され、Ｌ
ＰＦ出力をスレッシュレベルと比較してスレッシュレベ
ル以下の期間を同期信号とする。 【０００６】バーストの検出に用いるバーストゲートパ
ルス（以下、ＢＧＰと略記する）のタイミングは前記の
同期信号からＨカウンタ２及びラインカウンタ３の値を
固定して決定している。 【０００７】例えば１４．３ＭＨｚのクロックの場合、
同期信号の立ち下がりからＨカウンタ値で約７５〜１１
０クロック程度の期間”Ｈ”となるＢＧＰ６を作成し、
この”Ｈ”期間の色信号をバーストと見なしている。 【０００８】ところで、ＮＴＳＣ信号における正式な色
差信号はＩ，Ｑ信号であるが、以下の説明においては、
処理が簡単なＵ，Ｖ信号を色差信号として説明する。 【０００９】民生用機器においては、一般的にＵ，Ｖ信
号が用いられている。なお、Ｂ−Ｙ信号がＵ信号で、Ｒ
−Ｙ信号がＶ信号である。 【００１０】デコード回路８にて搬送色信号をＵＶの色
差信号にデコードするが、ＢＧＰ内のデコード結果であ
るＵＶのレベルからＰＬＬ用の誤差信号を生成し外部の
電圧制御水晶発振器（以下、ＶＣＸＯと略記する）の発
振位相を制御することでメインクロックをバーストに位
相ロックさせる。 【００１１】ここでサグがある場合シンクチップのＤＣ
レベルが上昇するので、同期分離のスレッシュを下回る
のがサグが無い場合と比べてタイミングが早くなる。 【００１２】この為バーストと同期分離したＨとの間隔
は長くなり、ＢＧＰ内にバーストが入らなくなる場合が
ある。 【００１３】このためサグのある垂直帰線期間ではＰＬ
Ｌの引き込みができず、有効画像がはじまる画面上部で
サグの影響がなくなりＰＬＬが引き込むので画面上部で
は色相が異なってしまう。 【００１４】 【発明が解決しようとする課題】家庭用ＶＴＲの再生信
号はアナログ処理が大半でＹＣ別々に処理するので、ダ
ビングを繰り返したりするとＹＣの時間ずれが発生しや
すい。 【００１５】またサグにより垂直帰線期間中の同期信号
の直流分が失われ、この期間Ｙ信号がＣ信号に対して時
間進みとなる。従って同期信号から作成したＢＧＰと実
際のバースト信号とに時間ずれが発生することでＰＬＬ
の誤差信号が不正確になるので、正しいレベルの色差信
号に復調することができず色ムラや色相ズレとなる。ま
た色ずれはずれ量が定量化できず自動的に補正できな
い。 【００１６】 【課題を解決するための手段】本発明はこうした課題を
解決するための手段を提供するもので、各請求項の発明
は、以下の技術手段を構成する。 【００１７】上記目的を達成するために、本発明のバー
ストゲートパルスタイミング補正回路装置は以下の構成
要素を有する。 【００１８】Ａ／Ｄ変換後の入力輝度信号から水平同期
と垂直同期を分離する同期分離回路と、前記同期分離回
路から出力される水平同期によりリセットされ１クロッ
ク毎に増加する水平カウンター手段と、垂直同期でリセ
ットされ水平同期毎に増加するラインカウンター手段
と、水平カウンタとラインカウンタの値からバースト判
別用パルスを生成するバースト判別用パルス生成回路手
段と、入力色信号を色差に変換するデコード回路、デコ
ード回路出力を平滑するローパスフィルタ、前記ＬＰＦ
出力のうち前記バースト判別用パルス生成回路出力のバ
ースト判別用パルス内の最小値を検出し、その最小値が
得られたバースト判別用パルス内の位置をカウンタ値で
出力する最小値検出回路手段と、前記最小値検出回路出
力とＢＧＰの中心との差分を算出する差分算出回路と、
Ｙ，Ｃいずれかの信号の遅延量を可変する可変遅延回路
と、を具備し差分値に応じて前記ＢＧＰ生成回路の出力
タイミングと、Ｙ，Ｃいずれかの信号の遅延量を可変す
ることで色ムラと色ずれの無い高品位の画像を提供する
ことを特徴とする。 【００１９】 【発明の実施の形態】図１に本発明のブロック図を示
す。以下図１に従って説明する。 【００２０】入力の輝度またはビデオ信号はＡＤコンバ
ータによってデジタル値に変換されビデオ信号はＹＣ分
離４によってＹとＣに分離される。 【００２１】またＡＤ後の輝度またはビデオ信号から同
期分離回路１にて水平同期（Ｈ）、垂直同期（Ｖ）が得
られ、Ｈより水平方向のＨカウンター２を、ＨＶより垂
直方向のラインカウンター３を生成する。 【００２２】バーストはＮＴＳＣの場合１０Ｈ〜２６３
Ｈ、２７３Ｈ〜５２５Ｈに存在するので、ＢＧＰは該当
するラインのＨカウンター値がデフォルトで７５〜１０
７程度に各回路での遅延分を考慮した期間”Ｈ”を６の
ブロックから出力する。 【００２３】分離色信号またはＡＤ入力色信号は７のＳ
Ｗで選択後８でデコードされＵＶそれぞれＬＰＦ９、１
０を通すことで３．５８Ｍのキャリア成分を除去する。 【００２４】バーストは負のＵ成分しかないのでデコー
ド後のＢＧＰ内のＵレベルを調べればＢＧＰとバースト
の位相関係が解る。 【００２５】この様子を図２に示す。ＢＧＰの中心とＵ
レベルの最小値とのＨカウントの差をＤｉｆｆとする
と、ＢＧＰとバーストの位相が合っているときは図２Ａ
のようにＢＧＰの中心と、ＢＧＰ内Ｕレベルの最小値が
一致するのでＤｉｆｆ＝０となる。 【００２６】ＢＧＰがバーストに対して進んでいる場
合、図２Ｂのように、逆に遅れている場合は、図２Ｃの
ようになる。 【００２７】図２Ｂの場合、Ｄｉｆｆは正の値、図２Ｃ
の場合、負の値となる。 【００２８】垂直帰線期間はサグが発生しやすく、ＹＣ
の時間がずれていなくてもＢＧＰとバーストの位相が合
わない場合がある。 【００２９】６のＢＧＰ生成回路では１２の垂直帰線期
間用Ｄｉｆｆ＿Ｉを１０Ｈ〜２１Ｈ、２７３Ｈ〜２８４
Ｈに適用し、２２Ｈ〜２６３Ｈ、２８５Ｈ〜５２５Ｈの
有効画像領域については１３出力のＤｉｆｆ＿Ｖを適用
する。 【００３０】Ｄｉｆｆ＿Ｉ，Ｄｉｆｆ＿Ｖいずれも垂直
同期毎にリセットされ、該当ラインの最初のライン（Ｄ
ｉｆｆ＿Ｖの場合２２Ｈと２８５Ｈ）での検出結果を許
容誤差を超える検出結果が出ない限りこれを保持する。 【００３１】許容誤差を超える検出結果が出た場合Ｄｉ
ｆｆ＿Ｉ、Ｄｉｆｆ＿Ｖ共に値が更新される。Ｄｉｆｆ
＿Ｉ及びＤｉｆｆ＿ＶをデフォルトのＢＧＰスタートカ
ウント値に加算して次のラインに反映させればバースト
とＢＧＰの位相は一致する。 【００３２】Ｄｉｆｆ＿Ｖはサグの影響がないのでＹＣ
の時間ずれが発生の主要因である。 【００３３】従ってＤｉｆｆ＿Ｖの値に応じてＹ信号の
遅延量を制御すればＹＣの時間ずれも補正できる。 【００３４】例えばＤｉｆｆ＿Ｖ＝３の時Ｙの遅延量を
デフォルトから３クロック遅らせれば良い。 【００３５】 【発明の効果】上記にて説明された本発明により以下の
効果がもたらされる。 【００３６】本発明によればＢＧＰとバーストの位相関
係が常に一致した状態なので、ダビングを繰り返してＹ
Ｃの時間差が大きい信号や、サグにより垂直帰線期間だ
け同期分離したＨ信号とバーストの位置関係が離れた場
合でもＰＬＬの誤差信号が不正確にならず、ＵＶを正し
いレベルで復調することができ、またＹＣの時間ずれも
補正できるので色ムラや色相ずれ、時間ずれのない高品
位の画像を提供することができる。
色信号を処理するＴＶ、ＶＴＲに関する。 【０００２】 【従来の技術】近年ＴＶや家庭用ＶＴＲにおいて信号処
理をデジタル処理するものが増えている。 【０００３】このようなシステムでは入力信号の搬送色
信号におけるバースト部を抜き取り、色副搬送波である
３．５８ＭＨｚの４倍の周波数ｆｓｃ＝１４．３ＭＨｚ
を入力信号のバーストにＰＬＬで位相同期させるのが一
般的である。 【０００４】図３に回路例を示す。以下この図にしたが
って説明する。 【０００５】Ａ／Ｄ変換入力された輝度信号，または複
合映像信号は同期分離回路内１のローパスフィルタ（以
下ＬＰＦ）により高域ノイズ及び色信号が除去され、Ｌ
ＰＦ出力をスレッシュレベルと比較してスレッシュレベ
ル以下の期間を同期信号とする。 【０００６】バーストの検出に用いるバーストゲートパ
ルス（以下、ＢＧＰと略記する）のタイミングは前記の
同期信号からＨカウンタ２及びラインカウンタ３の値を
固定して決定している。 【０００７】例えば１４．３ＭＨｚのクロックの場合、
同期信号の立ち下がりからＨカウンタ値で約７５〜１１
０クロック程度の期間”Ｈ”となるＢＧＰ６を作成し、
この”Ｈ”期間の色信号をバーストと見なしている。 【０００８】ところで、ＮＴＳＣ信号における正式な色
差信号はＩ，Ｑ信号であるが、以下の説明においては、
処理が簡単なＵ，Ｖ信号を色差信号として説明する。 【０００９】民生用機器においては、一般的にＵ，Ｖ信
号が用いられている。なお、Ｂ−Ｙ信号がＵ信号で、Ｒ
−Ｙ信号がＶ信号である。 【００１０】デコード回路８にて搬送色信号をＵＶの色
差信号にデコードするが、ＢＧＰ内のデコード結果であ
るＵＶのレベルからＰＬＬ用の誤差信号を生成し外部の
電圧制御水晶発振器（以下、ＶＣＸＯと略記する）の発
振位相を制御することでメインクロックをバーストに位
相ロックさせる。 【００１１】ここでサグがある場合シンクチップのＤＣ
レベルが上昇するので、同期分離のスレッシュを下回る
のがサグが無い場合と比べてタイミングが早くなる。 【００１２】この為バーストと同期分離したＨとの間隔
は長くなり、ＢＧＰ内にバーストが入らなくなる場合が
ある。 【００１３】このためサグのある垂直帰線期間ではＰＬ
Ｌの引き込みができず、有効画像がはじまる画面上部で
サグの影響がなくなりＰＬＬが引き込むので画面上部で
は色相が異なってしまう。 【００１４】 【発明が解決しようとする課題】家庭用ＶＴＲの再生信
号はアナログ処理が大半でＹＣ別々に処理するので、ダ
ビングを繰り返したりするとＹＣの時間ずれが発生しや
すい。 【００１５】またサグにより垂直帰線期間中の同期信号
の直流分が失われ、この期間Ｙ信号がＣ信号に対して時
間進みとなる。従って同期信号から作成したＢＧＰと実
際のバースト信号とに時間ずれが発生することでＰＬＬ
の誤差信号が不正確になるので、正しいレベルの色差信
号に復調することができず色ムラや色相ズレとなる。ま
た色ずれはずれ量が定量化できず自動的に補正できな
い。 【００１６】 【課題を解決するための手段】本発明はこうした課題を
解決するための手段を提供するもので、各請求項の発明
は、以下の技術手段を構成する。 【００１７】上記目的を達成するために、本発明のバー
ストゲートパルスタイミング補正回路装置は以下の構成
要素を有する。 【００１８】Ａ／Ｄ変換後の入力輝度信号から水平同期
と垂直同期を分離する同期分離回路と、前記同期分離回
路から出力される水平同期によりリセットされ１クロッ
ク毎に増加する水平カウンター手段と、垂直同期でリセ
ットされ水平同期毎に増加するラインカウンター手段
と、水平カウンタとラインカウンタの値からバースト判
別用パルスを生成するバースト判別用パルス生成回路手
段と、入力色信号を色差に変換するデコード回路、デコ
ード回路出力を平滑するローパスフィルタ、前記ＬＰＦ
出力のうち前記バースト判別用パルス生成回路出力のバ
ースト判別用パルス内の最小値を検出し、その最小値が
得られたバースト判別用パルス内の位置をカウンタ値で
出力する最小値検出回路手段と、前記最小値検出回路出
力とＢＧＰの中心との差分を算出する差分算出回路と、
Ｙ，Ｃいずれかの信号の遅延量を可変する可変遅延回路
と、を具備し差分値に応じて前記ＢＧＰ生成回路の出力
タイミングと、Ｙ，Ｃいずれかの信号の遅延量を可変す
ることで色ムラと色ずれの無い高品位の画像を提供する
ことを特徴とする。 【００１９】 【発明の実施の形態】図１に本発明のブロック図を示
す。以下図１に従って説明する。 【００２０】入力の輝度またはビデオ信号はＡＤコンバ
ータによってデジタル値に変換されビデオ信号はＹＣ分
離４によってＹとＣに分離される。 【００２１】またＡＤ後の輝度またはビデオ信号から同
期分離回路１にて水平同期（Ｈ）、垂直同期（Ｖ）が得
られ、Ｈより水平方向のＨカウンター２を、ＨＶより垂
直方向のラインカウンター３を生成する。 【００２２】バーストはＮＴＳＣの場合１０Ｈ〜２６３
Ｈ、２７３Ｈ〜５２５Ｈに存在するので、ＢＧＰは該当
するラインのＨカウンター値がデフォルトで７５〜１０
７程度に各回路での遅延分を考慮した期間”Ｈ”を６の
ブロックから出力する。 【００２３】分離色信号またはＡＤ入力色信号は７のＳ
Ｗで選択後８でデコードされＵＶそれぞれＬＰＦ９、１
０を通すことで３．５８Ｍのキャリア成分を除去する。 【００２４】バーストは負のＵ成分しかないのでデコー
ド後のＢＧＰ内のＵレベルを調べればＢＧＰとバースト
の位相関係が解る。 【００２５】この様子を図２に示す。ＢＧＰの中心とＵ
レベルの最小値とのＨカウントの差をＤｉｆｆとする
と、ＢＧＰとバーストの位相が合っているときは図２Ａ
のようにＢＧＰの中心と、ＢＧＰ内Ｕレベルの最小値が
一致するのでＤｉｆｆ＝０となる。 【００２６】ＢＧＰがバーストに対して進んでいる場
合、図２Ｂのように、逆に遅れている場合は、図２Ｃの
ようになる。 【００２７】図２Ｂの場合、Ｄｉｆｆは正の値、図２Ｃ
の場合、負の値となる。 【００２８】垂直帰線期間はサグが発生しやすく、ＹＣ
の時間がずれていなくてもＢＧＰとバーストの位相が合
わない場合がある。 【００２９】６のＢＧＰ生成回路では１２の垂直帰線期
間用Ｄｉｆｆ＿Ｉを１０Ｈ〜２１Ｈ、２７３Ｈ〜２８４
Ｈに適用し、２２Ｈ〜２６３Ｈ、２８５Ｈ〜５２５Ｈの
有効画像領域については１３出力のＤｉｆｆ＿Ｖを適用
する。 【００３０】Ｄｉｆｆ＿Ｉ，Ｄｉｆｆ＿Ｖいずれも垂直
同期毎にリセットされ、該当ラインの最初のライン（Ｄ
ｉｆｆ＿Ｖの場合２２Ｈと２８５Ｈ）での検出結果を許
容誤差を超える検出結果が出ない限りこれを保持する。 【００３１】許容誤差を超える検出結果が出た場合Ｄｉ
ｆｆ＿Ｉ、Ｄｉｆｆ＿Ｖ共に値が更新される。Ｄｉｆｆ
＿Ｉ及びＤｉｆｆ＿ＶをデフォルトのＢＧＰスタートカ
ウント値に加算して次のラインに反映させればバースト
とＢＧＰの位相は一致する。 【００３２】Ｄｉｆｆ＿Ｖはサグの影響がないのでＹＣ
の時間ずれが発生の主要因である。 【００３３】従ってＤｉｆｆ＿Ｖの値に応じてＹ信号の
遅延量を制御すればＹＣの時間ずれも補正できる。 【００３４】例えばＤｉｆｆ＿Ｖ＝３の時Ｙの遅延量を
デフォルトから３クロック遅らせれば良い。 【００３５】 【発明の効果】上記にて説明された本発明により以下の
効果がもたらされる。 【００３６】本発明によればＢＧＰとバーストの位相関
係が常に一致した状態なので、ダビングを繰り返してＹ
Ｃの時間差が大きい信号や、サグにより垂直帰線期間だ
け同期分離したＨ信号とバーストの位置関係が離れた場
合でもＰＬＬの誤差信号が不正確にならず、ＵＶを正し
いレベルで復調することができ、またＹＣの時間ずれも
補正できるので色ムラや色相ずれ、時間ずれのない高品
位の画像を提供することができる。
【図面の簡単な説明】
【図１】本発明によるバーストゲートパルスタイミング
補正回路装置の一実施形態例を示す機能ブロック図であ
る。 【図２】本発明によるバーストゲートパルスタイミング
補正回路装置の動作説明図である。 【図３】従来技術のブロック図を示す。 【符号の説明】 １：同期分離 ２：水平カウンター ３：ラインカウンター ４：Ｙ／Ｃ分離 ５：ＳＷ ６：ＢＧＰ生成回路 ７：ＳＷ ８：デコード回路 ９：Ｕ用ローパスフィルター １０：Ｖ用ローパスフィルター １１：最小値検出回路 １２：垂直帰線期間用差分値検出回路 １３：有効画像用差分値検出回路 １４：輝度信号可変遅延線 １５：位相検出回路
補正回路装置の一実施形態例を示す機能ブロック図であ
る。 【図２】本発明によるバーストゲートパルスタイミング
補正回路装置の動作説明図である。 【図３】従来技術のブロック図を示す。 【符号の説明】 １：同期分離 ２：水平カウンター ３：ラインカウンター ４：Ｙ／Ｃ分離 ５：ＳＷ ６：ＢＧＰ生成回路 ７：ＳＷ ８：デコード回路 ９：Ｕ用ローパスフィルター １０：Ｖ用ローパスフィルター １１：最小値検出回路 １２：垂直帰線期間用差分値検出回路 １３：有効画像用差分値検出回路 １４：輝度信号可変遅延線 １５：位相検出回路
─────────────────────────────────────────────────────
フロントページの続き
(58)調査した分野(Int.Cl.7，ＤＢ名)
H04N 9/455
H04N 5/08
H04N 9/77
Claims (1)
- (57)【特許請求の範囲】 【請求項１】 ａ）Ａ／Ｄ変換後の入力輝度信号から水
平同期と垂直同期を分離する同期分離回路と、 ｂ）前記同期分離回路から出力される水平同期によりリ
セットされ１クロック毎に増加する水平カウンター手段
と、 ｃ）垂直同期でリセットされ水平同期毎に増加するライ
ンカウンター手段と、 ｄ）水平カウンタとラインカウンタの値からバースト判
別用パルスを生成するバースト判別用パルス生成回路手
段と、 ｅ）入力色信号を色差に変換するデコード回路、デコー
ド回路出力を平滑するローパスフィルタ、前記ＬＰＦ出
力のうち前記バースト判別用パルス生成回路出力のバー
スト判別用パルス内の最小値を検出し、その最小値が得
られたバースト判別用パルス内の位置をカウンタ値で出
力する最小値検出回路手段と、 ｆ）前記最小値検出回路出力とバースト判別用パルスの
中心との差分を算出する差分算出回路と、 ｇ）Ｙ，Ｃいずれかの信号の遅延量を可変する可変遅延
回路と、を具備し差分値に応じて前記バースト判別用パ
ルス生成回路の出力タイミングと、Ｙ，Ｃいずれかの信
号の遅延量を可変することで色ムラと色ずれの無い高品
位の画像を提供することを特徴とするバーストゲートパ
ルスタイミング補正回路装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18460399A JP3524817B2 (ja) | 1999-06-30 | 1999-06-30 | バーストゲートパルスタイミング補正回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18460399A JP3524817B2 (ja) | 1999-06-30 | 1999-06-30 | バーストゲートパルスタイミング補正回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2001016603A JP2001016603A (ja) | 2001-01-19 |
| JP3524817B2 true JP3524817B2 (ja) | 2004-05-10 |
Family
ID=16156113
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18460399A Expired - Fee Related JP3524817B2 (ja) | 1999-06-30 | 1999-06-30 | バーストゲートパルスタイミング補正回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3524817B2 (ja) |
-
1999
- 1999-06-30 JP JP18460399A patent/JP3524817B2/ja not_active Expired - Fee Related
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| Publication number | Publication date |
|---|---|
| JP2001016603A (ja) | 2001-01-19 |
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