JP2001053110A - 半導体素子の実装方法及び実装装置 - Google Patents
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Abstract
電極同士を確実に接続することができる半導体素子の実
装方法及び実装装置を提供する。 【解決手段】本発明は絶縁性接着剤中に導電粒子を分散
させた異方導電性接着フィルムを用いて半導体素子の電
極と回路基板の電極を電気的に接続する半導体素子の実
装方法であって、導電粒子を含まないフィルム状の絶縁
性接着剤を回路基板22上に仮圧着して絶縁性接着剤層
23を設ける工程と、所定の位置に押圧用チップ21を
備えた圧着ヘッド2を用いて絶縁性接着剤層23に所定
の大きさの凹部23aを形成する工程と、絶縁性接着剤
層23の凹部23a内に所定の大きさの異方導電性接着
フィルムを配置する工程と、所定のICチップ11を圧
着ヘッド2の所定の位置に装着した後、このICチップ
11を位置決めして回路基板22上に本圧着する工程と
を有する。
Description
基板に実装する技術に関し、特に、異方導電性接着フィ
ルムを用いてベアチップを基板上に直接実装する半導体
素子の実装方法及び実装装置に関する。
ベアチップを直接実装する方法としては、バインダ中に
導電粒子を分散させた異方導電性接着フィルムを用いる
方法が知られている。
チップを回路基板上に実装する方法においては、通常の
場合、ICチップ側又は回路基板側に突起状のバンプ電
極が設けられる。
接続の場合には、ICチップの縁部のスクライブライン
に導電粒子が接触してショートが発生する場合があるか
らである。
種の回路基板においては、各電極間のファインピッチ化
が要求されており、このファインピッチ化に対応するた
めには、回路基板とICチップとの接続電極部の大きさ
を小さくする必要がある。
を実用化するには、電極同士の間に導電粒子を確実に介
在させることが必要であり、そのためには、例えば、導
電粒子の径をさらに小さくして異方導電性接着フィルム
のバインダ中における導電粒子の数を増やすことが考え
られる。
合量を増加すると、それに伴って異方導電性接着フィル
ムの粘度が上昇してバインダ中の導電粒子の流動性が低
下し、これにより導電粒子がバインダ内で均等に分散さ
れにくくなるとともに、異方導電性接着フィルムの絶縁
性が低下するという問題がある。
着の際に導電粒子がつぶれてもその変形する絶対量が小
さく、バンプ電極の高さのばらつきを吸収できないた
め、回路基板とICチップとの電極同士のうち接続され
ないものが生じて導通信頼性が低下するおそれがある。
ファインピッチ化を十分に実用化する段階まで至ってい
ない。
を含まない絶縁性接着フィルムを回路基板に仮圧着した
後、例えば、ICチップの外形程度の大きさの押圧ヘッ
ドを用いて絶縁性接着フィルムに凹部を形成し、その凹
部に異方導電性接着フィルムを配置して本圧着を行う方
法も考えられる。
や径を従来のレベルに維持しつつ、ICチップと回路基
板との間において導電粒子を密集させ接続電極同士を確
実に電気的に接続することができる。
ドの他に凹部形成用の押圧ヘッドを設けなければならな
いため、装置構成が複雑になるという問題がある。
ti Chip Module)等のように、回路基板に多くのサイズ
のICチップを実装する場合には、各ICチップの外形
に対応した押圧ヘッドを複数個用意しなければならない
ため、装置構成がさらに複雑になるとともに装置も大型
化してしまい、さらには押圧ヘッドの交換の手間によっ
て実装作業に時間がかかるという問題がある。
解決するためになされたもので、その目的とするところ
は、ファインピッチの半導体素子及び回路基板の各電極
同士を確実に接続しうる半導体素子の実装方法及び実装
装置を提供することにある。
ないICチップにおいて、半導体素子と回路基板との間
のショートの発生を防止しうる半導体素子の実装方法及
び実装装置を提供することにある。
多種類の半導体素子を容易迅速に実装しうる半導体素子
の実装方法及び実装装置を提供することにある。
になされた請求項1記載の発明は、絶縁性接着剤中に導
電粒子を分散させた異方導電性接着フィルムを用いて半
導体素子の電極と回路基板の電極を電気的に接続する半
導体素子の実装方法であって、導電粒子を含まないフィ
ルム状の絶縁性接着剤を前記回路基板上に仮圧着して絶
縁性接着剤層を設ける工程と、所定の位置に押圧用薄片
を備えた圧着ヘッドを用いて前記絶縁性接着剤層に所定
の大きさの凹部を形成する工程と、前記絶縁性接着剤層
の凹部内に所定の大きさの異方導電性接着フィルムを配
置する工程と、所定の半導体素子を前記圧着ヘッドの所
定の位置に装着した後、当該半導体素子を位置決めして
前記回路基板上に本圧着する工程とを有することを特徴
とする。
加熱圧着を行う際には、絶縁性接着剤とともに導電粒子
がICチップの縁部に向って逃げようとするが、請求項
1記載の発明の場合は、ICチップの縁部に向って逃げ
ようとする導電粒子が絶縁性接着剤層に形成した凹部の
堤部に阻まれ、ICチップの縁部方向へはほとんど流動
しない。
回路基板との間において導電粒子を密集して保持するこ
とができるため、各接続電極の間隔が極めて小さい場合
であっても、複数個の導電粒子を各接続電極上に極めて
高い確率で配置して接続電極同士を確実に電気的に接続
することができる。
のスクライブラインの部位に導電粒子が達しないため、
スクライブラインと回路基板の間においてショートが発
生することがない。
押圧用薄片を備えた押圧ヘッドを用いて前記絶縁性接着
剤層に凹部を形成することから、多種類のICチップを
実装する場合であっても、ICチップの外形に対応させ
た押圧ヘッドをそれぞれ用いる必要がなく、装置構成を
簡素化することが可能になる。
請求項1記載の発明において、押圧ヘッドと圧着ヘッド
とを兼用して絶縁性接着剤の仮圧着及び凹部の形成並び
に異方導電性接着フィルムの本圧着を行うことも効果的
である。
の押圧ヘッドを省略することができるので、装置構成を
さらに簡素小型化することが可能になる。
の電極と回路基板の電極を電気的に接続するための圧着
ヘッドを備えた半導体素子の実装装置であって、前記回
路基板側の絶縁性接着剤層に所定の大きさの凹部を形成
するための押圧用薄片と前記半導体素子とをそれぞれ保
持する保持手段を有する押圧ヘッドを備えたことを特徴
とする。
発明の方法を容易に実施することが可能になる。
請求項3記載の発明において、圧着ヘッドと押圧ヘッド
とを兼用するように構成すれば、装置構成を簡素小型化
することができる。
項4記載の発明において、保持手段が、押圧用薄片と半
導体素子とをそれぞれ着脱自在に保持するように構成さ
れている場合には、装置構成をさらに簡素で小型のもの
とすることができる。
求項6に記載されているように、請求項5記載の発明に
おいて、当該圧着ヘッドの圧着部に設けられた吸引孔か
ら大気を吸引するように構成するとよい。
オフによって押圧用薄片等の着脱を容易迅速に行うこと
ができるとともに、種々の形状の部品を圧着ヘッドに装
着することが可能になる。
項3乃至6のいずれかに記載の発明において、押圧用薄
片の前記絶縁性接着剤層と接触する側の面が当該絶縁性
接着剤に対して剥離性を有していることも効果的であ
る。
剤層に凹部を形成する際、絶縁性接着剤層が押圧用薄片
に吸着して回路基板から剥がれることを防ぐことができ
る。
実装装置及び実装方法の好ましい実施の形態を図面を参
照して詳細に説明する。図1(a)〜(c)は、本発明
に係る半導体素子の実装装置の概略構成を示すもので、
図1(a)は、圧着ヘッドに押圧用チップを吸着した状
態を示す説明図、図1(b)は、圧着ヘッドにICチッ
プを吸着した状態を示す説明図、図1(c)は、図1
(b)におけるA部の拡大図である。
1として、バンプを有するもの及びバンプを有していな
いもののいずれにも適用可能であるが、本実施の形態に
おいては、バンプを有していないICチップ11を例に
とって説明する。
形態の実装装置1は、ICチップ11を回路基板22に
圧着するための圧着ヘッド2を有する圧着ユニット4を
備えている。この圧着ヘッド2は取付部20によって装
置本体(図示せず)に取り付けられ、回路基板22を載
置するためのテーブル5に対して上下動できるように構
成されている。
タが配設されている。また、圧着ヘッド2の押圧面2a
には、後述する複数の吸引孔2bが設けられている。
部に中空の吸引部20aが設けられている。この吸引部
20aは圧着ヘッド2の吸引孔2bと連通される一方
で、図示しない真空ポンプに接続されている。そして、
この真空ポンプを駆動して吸引部20a内の圧力を減圧
することによって、図1(a)(b)に示すように、後
述する押圧用チップ21(押圧用薄片)又はICチップ
11を圧着ヘッド2に吸着保持できるように構成されて
いる。
着すべきICチップ11又は押圧用チップ21のうち最
も大きいものより大きくなるようにその大きさが設定さ
れている。
面2a上において、吸着すべきICチップ11又は押圧
用チップ21のうち最も小さいものより小さい領域内に
含まれるように配置されている。
及び個数は特に限定されるものではないが、ICチップ
11又は押圧用チップ21を確実に吸着する観点から
は、その一個当たりの開口面積が0.01〜5mm2のも
のを、1〜5個程度配置することが好ましい。
特に限定されるものではなく、例えば、円形や四角形状
等の任意の形状とすることができる。
適用されるICチップ11は、例えば、シリコンウェハ
12の酸化膜(SiO2)13上に所定の回路パターン1
4が形成されている。そして、この回路パターン14上
には、そのパッド部14aの部位にコンタクトホール1
6を設けた保護酸化膜(パッシベーション膜)15が形
成されている。
(c)は、本発明に係る半導体素子の実装方法の一例を
示す工程図である。図2(a)に示すように、本実施の
形態においては、まず、所定の回路パターンが形成され
た回路基板22上に、導電粒子を含まないフィルム状の
絶縁性接着剤を接続電極22aを覆うように貼付し、約
80℃の温度に加熱された圧着ヘッド2を用い、例え
ば、圧力3kgf/cm2で、2秒間仮圧着を行うことによって
絶縁性接着剤層23を形成する。
導電粒子25の流出を防止する観点から、後述する異方
導電性接着フィルム24中の絶縁性接着剤24aの溶融
粘度より大きいものであることが好ましい。
度、特に最低溶融粘度(熱圧着工程中で最も粘度が下が
った状態における溶融粘度)が、1×106〜1×109
mPa・Sであるものを用いることが好ましく、より好
ましくは5×106〜5×108mPa・Sである。
mPa・Sより小さいと、導電粒子が流出してしまうと
いう不都合があり、1×109mPa・Sより大きい
と、接続電極間の導通を阻害するという不都合がある。
ば、ビスフェノールA型の固形エポキシ樹脂と液状エポ
キシ樹脂との混合物や、フェノキシ樹脂、アクリル樹
脂、ポリエステル樹脂等の熱可塑性樹脂とエポキシ樹脂
との混合物等があげられる。
ヘッド2の吸引部20a内を吸引することによって、図
2(b)に示すように、押圧用チップ21を圧着ヘッド
2の押圧面2aに吸着させる。この場合、押圧用チップ
21を図示しない突き当て部に突き当てることにより、
また、取り込んだ押圧用チップ21の画像をディジタル
処理することによって押圧用チップ21の位置決めを行
う。
は、少なくとも絶縁性接着剤層23と接触する側の面2
1aが当該絶縁性接着剤に対して剥離性を有しているこ
とが好ましい。
としては、例えば、ポリテトラフルオロエチレン(PT
FE)樹脂を用いてチップ形状に成形したものや、チッ
プ形状のアルミニウム片の表面を、例えばシリコーンを
用いて剥離処理したものがあげられる。
から、押圧用チップ21の厚さは、絶縁性接着剤層23
の厚さより大きいことが好ましい。
100μmである場合に、押圧用チップ21の厚さを
0.1〜5mmとすることが好ましい。
Cチップ11の外形寸法と比較して1.5〜0.5倍の
大きさにすることが好ましく、より好ましくは、1〜
0.7倍である。
11の外形寸法と比較して0.5倍より小さいと、電極
(バンプ)の位置より内側の部位に後述する凹部が形成
され後述する導電粒子と電極とを電気的に接続させるこ
とができなくなるという不都合があり、押圧用チップ2
1の大きさが、ICチップ11の外形寸法と比較して
1.5倍より大きいと、後述の導電粒子をせき止めてパ
ッド部14a上の粒子数を増加させるというメリット
や、後述のスクライブラインの部位に導電粒子を到達さ
せないというメリットが得られなくなる。
ニット4を下降させ、約80℃の温度に加熱された圧着
ヘッド2を用い、例えば、圧力3kgf/cm2で、2秒間熱プ
レスを行うことにより、絶縁性接着剤層23に押圧用チ
ップ21の外形の大きさとほぼ等しい大きさの凹部23
aを形成する。
部23a内に異方導電性接着フィルム24を配置して仮
圧着を行う。この異方導電性接着フィルム24は、絶縁
性接着剤中に導電粒子25を分散させたもので、予め、
押圧用チップ21の外形の大きさより若干小さく切断し
たものを用意しておく。
って凹部23aの周囲に堤部23bが形成されるが、図
3(a)に示すように、この堤部23bの高さ即ち凹部
23aの深さは、ICチップ11の厚さ(ICチップ1
1にバンプが設けられている場合には当該バンプまでの
距離)より小さく、かつ、異方導電性接着フィルム24
中の導電粒子25の外径(直径)より大きくなるように
することが好ましい。
が、導電粒子25の外径より小さいと、熱圧着時に導電
粒子25の逃げを十分に阻止することができないという
不都合があり、他方、ICチップ11の厚さより大きい
と、絶縁性接着剤樹脂がICチップ11からはみ出して
熱圧着ヘッド2が汚れるおそれがあるという不都合があ
る。
壁部がICチップ11のスクライブライン(図示せず)
より内側で、かつ、ICチップ11のパッド部14aの
最外径の部位より外側に位置するように形成することが
好ましい。
クライブラインに達すると、当該スクライブラインに導
電粒子25が接触してショートを起こすおそれがあり、
他方、堤部23bの内壁部がICチップ11のパッド部
14aに達すると、パッド部14aに接触する導電粒子
25の数が少なくなるため導通信頼性が低下するという
不都合がある。
頼性を確保する観点から、1〜10μmであることが好
ましく、さらに好ましくは2〜8μmである。
〜15体積%分散させることが好ましく、より好ましい
導電粒子の配合量は、3〜15体積%である。
いと、ICチップ11のパッド部14a及び回路基板2
2の接続電極22a間の電気的接続が確保されず導通抵
抗が高くなるという不都合があり、15体積%より大き
いと、導電粒子25同士が凝集して隣接する電極間の絶
縁抵抗が低くなるという不都合がある。
1によって絶縁性接着剤層23に凹部23を形成した
後、真空ポンプの駆動を停止することによって、圧着ヘ
ッド2から押圧用チップ21を外す。その後、図3
(b)に示すように、ICチップ11を圧着ヘッド2の
押圧面2aに吸着させ、押圧用チップ21の場合と同様
の方法によってICチップ21の位置決めを行う。
ップ11の回路基板22に対する位置決めを行った後、
圧着ユニット4を下降させ、約180℃の温度に加熱さ
れた圧着ヘッド2を用い、例えば、圧力1000kgf/cm
2で、20秒間加熱することにより、ICチップ11の本
圧着を行う。
及び絶縁性接着剤層23がICチップ11によって押し
つぶされ、導電粒子31が、コンタクトホール16内に
おいて、回路基板22の接続電極22aとICチップ1
1のパッド部14aに接触することによって、ICチッ
プ11と回路基板22が電気的に接続される。
チップ11の縁部に向って逃げようとする導電粒子25
が絶縁性接着剤層23に形成した凹部23aの堤部23
bに阻まれ、ICチップ11の縁部方向へはほとんど流
動しない。
ップ11と回路基板22との間において導電粒子25を
密集して保持することができるため、各電極端子の間隔
が極めて小さい場合であっても、複数個の導電粒子25
を回路基板22の接続電極22a及びICチップ11の
パッド部14a上に極めて高い確率で配置して接続電極
同士を確実に電気的に接続することができる。
11の縁部のスクライブラインの部位に導電粒子25が
達しないため、スクライブラインと回路基板22の間に
おいてショートが発生することがない。
ッド2に対してICチップ11及び押圧用チップ21を
着脱できるように構成したことから、凹部形成用の押圧
ヘッドを別途設ける必要がなく、実装装置1を簡素で小
型の構成にすることができる。
気の吸引によってICチップ11及び押圧用チップ21
を圧着ヘッド2に吸着させるようにしたことから、大気
の吸引のオン・オフによってICチップ11等の着脱を
容易迅速に行うことができるとともに、種々の形状のI
Cチップ11等を圧着ヘッド2に装着することが可能に
なる。
とも絶縁性接着剤層23と接触する側の面21aが当該
絶縁性接着剤に対して剥離性を有するものを用いたこと
から、絶縁性接着剤層23に凹部を形成する際、絶縁性
接着剤層23が押圧用チップ21に吸着して回路基板2
2から剥がれることを防ぐことができる。
回路基板(マルチチップモジュール)の一例を示す平面
図であり、図5は、本発明の他の実施の形態の要部を示
す概略構成図である。
には、外形の異なる3種類のICチップ11A、11
B、11Cが実装されている。
0に3種類のICチップ11A、11B、11Cを実装
する場合には、図5(a)(b)に示すように、各IC
チップ11A、11B、11Cの実装位置に対応する位
置に、上述した吸引孔2bがそれぞれ設けられた圧着ヘ
ッド2Aを用いる。
れた各吸引部20aは、上記実施の形態と同様に、圧着
ヘッドの吸引孔2bと連通される一方で、図示しない真
空ポンプに接続されている。
A、11B、11Cについて、上記条件を満たした第1
〜第3の押圧用チップ21A、21B、21C及び異方
導電性接着フィルム(図示せず)を用意しておく。
後、図5(a)に示すように、例えば、第1〜第3の押
圧用チップ21を実装装置の圧着ヘッド2Aに吸着させ
て上述した工程により絶縁性接着剤層に凹部を形成し、
その後、第1〜第3の押圧用チップ21A、21B、2
1Cを圧着ヘッド2Aから取り外す。
ムを絶縁性接着剤の凹部に配置した後、図5(b)に示
すように、第1〜第3のICチップ11A〜11Cを圧
着ヘッド2Aに吸着させて本圧着を行い、その後、第1
〜第3の押圧用チップ21を圧着ヘッド2Aから取り外
す。
つの圧着ヘッドに第1〜第3の押圧用チップ21A、2
1B、21C及び第1〜第3のICチップ11A、11
B、11Cを着脱できるよう構成したことから、異なる
ICチップ11A、11B、11Cごとに押圧及び圧着
ヘッドを交換する必要がなく、多種類のICチップを短
時間で回路基板220に確実に実装することができる。
しかも本実施の形態によれば、装置構成を簡素かつ小型
化することができる。
ることなく、種々の変更を行うことができる。例えば、
上述の実施の形態においては、一つの圧着ヘッドを用
い、この圧着ヘッドに押圧用チップ及びICチップを着
脱できるように構成したが、本発明はこれに限られず、
例えば、押圧用チップとICチップを吸着するヘッドを
設けるようにすることも可能である。ただし、装置構成
の簡素化及び小型化のためには、上記実施の形態のよう
に一つの圧着ヘッドに押圧用チップ及びICチップを着
脱できるように構成することが好ましい。
有する半導体素子を実装する場合にも適用しうるもので
ある。
に説明する。 <実施例1>評価用TEGとして、厚さ0.7mmの耐
熱性ガラス布基材エポキシ樹脂銅張積層板(FR−4)
上に、幅18μm、ピッチ150μmの銅(Cu)パタ
ーンを形成し、その上にニッケル−金めっきを施したリ
ジッド基板を用い、ICチップとして、150μmピッ
チの電極(バンプレス)が形成された、チップA(6mm
×6mm)、チップB(3mm×6mm)、チップC(3.3
mm×3.3mm)を準備した。
リテトラフルオロエチレン(PTFE)樹脂からなる、
チップ(5.7mm×5.7mm)、チップ(2.7mm
×5.7mm)、チップ(3.0mm×3.0mm)を用い
た。
5μmのソニーケミカル社製のSCCFP20626を
用いた。また、導電粒子を含まない絶縁性接着剤として
は、上記ソニーケミカル社製のSCCFP20626か
ら導電粒子を除いたフィルム(厚さ15μm)を用い
た。
ルムを各ICチップA〜Cに対応させて切断した後、温
度80℃、圧力3kgf/cm2、時間2秒の条件で仮圧着し
た。
ルムを剥離し、圧着ヘッドを80℃に維持したまま押圧
用のチップ〜を吸着させ、温度80℃、圧力3kgf/
cm2、時間2秒の条件で絶縁性接着フィルムの表面を熱プ
レスしたところ、各絶縁性接着フィルムに深さ約10μ
mの凹部が形成された。
ムを配置して仮圧着した後、各ICチップの位置決めを
行い、温度180℃、圧力1000kgf/cm2・バンプ、
時間20秒の条件で本圧着を行った。
mmのアルミニウム(Al)製のシリコーンによる表面処
理を施したチップ(3.0mm×3.0mm)を用いた他は
実施例1と同様の方法によって異方導電性接着フィルム
による接続を行った。
のアルミニウム(Al)からなるチップ(3.0mm×
3.0mm)を用いた他は実施例1と同様の方法によって
異方導電性接着フィルムによる接続を行った。
着剤層に対する剥離性を評価した。その結果を表1に示
す。
によって押圧された絶縁性接着剤層が回路基板から剥が
れないものを良好(○)、回路基板から剥がれたものを
不良(×)とした。
用チップ及び表面をシリコーン処理した押圧用チップを
用いた実施例1、2のものは、凹部形成の際に絶縁性接
着剤層に対する剥離性が良好であった。
を測定したところ、初期抵抗値の最大が15mΩ以下で
あるとともに、温度121℃、湿度飽和、2気圧の条件
下でのプレッシャクッカ試験(pressure cooker test)
を行った後の抵抗値も最大で50mΩ以下であり、導通
信頼性も良好であった。
圧用チップが絶縁性接着剤層に密着してしまい、このた
め凹部形成後に押圧用チップに伴って回路基板から絶縁
性接着剤層が剥離し、異方導電性接着フィルムを用いて
接続を行うことができなかった。
続電極の間隔が極めて小さい場合であっても、複数個の
導電粒子を各接続電極上に極めて高い確率で配置して接
続電極同士を確実に電気的に接続することができる。ま
た、本発明によれば、バンプを有しないICチップを用
いた場合に、スクライブラインと回路基板の間における
ショートを防止することができる。さらに、本発明によ
れば、装置構成を複雑大型化することなく、短時間で多
種類のICチップを容易に回路基板に実装することがで
きる。
装装置の一例の概略構成図である。 (a):圧着ヘッドに押圧用チップを吸着した状態を示
す図 (b):圧着ヘッドにICチップを吸着した状態を示す
図 (c):図1(b)におけるA部の拡大図
装方法の一例を示す工程図(その1)である。
装方法の一例を示す工程図(その2)である。
を示す平面図である。
図である。
Claims (7)
- 【請求項1】絶縁性接着剤中に導電粒子を分散させた異
方導電性接着フィルムを用いて半導体素子の電極と回路
基板の電極を電気的に接続する半導体素子の実装方法で
あって、 導電粒子を含まないフィルム状の絶縁性接着剤を前記回
路基板上に仮圧着して絶縁性接着剤層を設ける工程と、 所定の大きさの押圧用薄片を備えた押圧ヘッドを用いて
前記絶縁性接着剤層に凹部を形成する工程と、 前記絶縁性接着剤層の凹部内に所定の大きさの異方導電
性接着フィルムを配置する工程と、 所定の半導体素子を前記圧着ヘッドの所定の位置に装着
した後、当該半導体素子を位置決めして前記回路基板上
に本圧着する工程とを有することを特徴とする半導体素
子の実装方法。 - 【請求項2】押圧ヘッドと圧着ヘッドとを兼用して絶縁
性接着剤の仮圧着及び凹部の形成並びに異方導電性接着
フィルムの本圧着を行うことを特徴とする請求項1記載
の半導体素子の実装方法。 - 【請求項3】半導体素子の電極と回路基板の電極を電気
的に接続するための圧着ヘッドを備えた半導体素子の実
装装置であって、 前記回路基板側の絶縁性接着剤層に所定の大きさの凹部
を形成するための押圧用薄片と前記半導体素子とをそれ
ぞれ保持する保持手段を有する押圧ヘッドを備えたこと
を特徴とする半導体素子の実装装置。 - 【請求項4】圧着ヘッドと押圧ヘッドとを兼用するよう
に構成されていることを特徴とする請求項3記載の半導
体素子の実装装置。 - 【請求項5】保持手段が、押圧用薄片と半導体素子とを
それぞれ着脱自在に保持するように構成されていること
を特徴とする請求項4記載の半導体素子の実装装置。 - 【請求項6】保持手段が、当該圧着ヘッドの圧着部に設
けられた吸引孔から大気を吸引するように構成されてい
ることを特徴とする請求項5記載の半導体素子の実装装
置。 - 【請求項7】押圧用薄片の前記絶縁性接着剤層と接触す
る側の面が当該絶縁性接着剤に対して剥離性を有してい
ることを特徴とする請求項3乃至6のいずれか1項記載
の半導体素子の実装装置。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22527599A JP3372511B2 (ja) | 1999-08-09 | 1999-08-09 | 半導体素子の実装方法及び実装装置 |
US09/631,282 US6340607B1 (en) | 1999-08-09 | 2000-08-03 | Process for mounting semiconductor device and mounting apparatus |
KR1020000044982A KR100616792B1 (ko) | 1999-08-09 | 2000-08-03 | 반도체 소자의 실장 방법 및 실장 장치 |
EP00116898A EP1076360A3 (en) | 1999-08-09 | 2000-08-04 | Process for mounting semiconductor device and mounting apparatus |
US09/928,516 US6769469B2 (en) | 1999-08-09 | 2001-08-14 | Process for mounting semiconductor device and mounting apparatus |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22527599A JP3372511B2 (ja) | 1999-08-09 | 1999-08-09 | 半導体素子の実装方法及び実装装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2001053110A true JP2001053110A (ja) | 2001-02-23 |
JP3372511B2 JP3372511B2 (ja) | 2003-02-04 |
Family
ID=16826784
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP22527599A Expired - Fee Related JP3372511B2 (ja) | 1999-08-09 | 1999-08-09 | 半導体素子の実装方法及び実装装置 |
Country Status (4)
Country | Link |
---|---|
US (2) | US6340607B1 (ja) |
EP (1) | EP1076360A3 (ja) |
JP (1) | JP3372511B2 (ja) |
KR (1) | KR100616792B1 (ja) |
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- 1999-08-09 JP JP22527599A patent/JP3372511B2/ja not_active Expired - Fee Related
-
2000
- 2000-08-03 KR KR1020000044982A patent/KR100616792B1/ko not_active IP Right Cessation
- 2000-08-03 US US09/631,282 patent/US6340607B1/en not_active Expired - Fee Related
- 2000-08-04 EP EP00116898A patent/EP1076360A3/en not_active Withdrawn
-
2001
- 2001-08-14 US US09/928,516 patent/US6769469B2/en not_active Expired - Lifetime
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---|---|
EP1076360A2 (en) | 2001-02-14 |
US20020029857A1 (en) | 2002-03-14 |
KR20010039786A (ko) | 2001-05-15 |
EP1076360A3 (en) | 2005-02-02 |
KR100616792B1 (ko) | 2006-08-29 |
US6769469B2 (en) | 2004-08-03 |
US6340607B1 (en) | 2002-01-22 |
JP3372511B2 (ja) | 2003-02-04 |
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Date | Code | Title | Description |
---|---|---|---|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20091122 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20091122 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20101122 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20111122 Year of fee payment: 9 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121122 Year of fee payment: 10 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121122 Year of fee payment: 10 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20131122 Year of fee payment: 11 |
|
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