CN107294888B - 等化增强模块、解调制系统以及等化增强方法 - Google Patents

Abstract

本发明涉及一种等化增强模块，包含有一乘法单元，用来将多个等化信号乘以一缩放系数，以取得多个缩放信号；一判断单元，耦接于该乘法单元，用来判断该多个缩放信号是否位于一特定区域，产生多个判断结果；一比例计算单元，耦接于该判断单元，用来根据该多个判断结果，计算一区内比例，其中该区内比例相关于该多个缩放信号位于该特定区域的一比例；以及一系数计算单元，耦接于该比例计算单元，用来根据该区内比例，计算该缩放系数。

Description

等化增强模块、解调制系统以及等化增强方法

技术领域

本发明涉及一种等化增强模块、解调制系统以及等化增强方法，尤指一种可改善最小均方差均衡器的等化增强模块、解调制系统以及等化增强方法。

背景技术

数字通讯系统已广泛地应用于手机、数字视频转换盒(Set-Top Box，STB)、数字电视棒、无线网卡等数字通讯装置中。一般来说，数字通讯系统包含调制(Modulation)系统以及解调制(Demodulation)系统，调制系统将欲传输的位(Bits)调制成为传送符元并传送至通道中再由解调制系统接收接收信号以进行解调制；解调制系统所接收的一接收信号y可表示为y＝hs+n，其中s代表调制系统产生的传送符元，h代表信道响应，n代表噪声。解调制系统接收道接收信号后，利用包含于解调制系统的一均衡器以消除通道对传送符元的影响。

在已知技术中，强制归零均衡器(Zero Forcing Equalizer)为复杂度低的均衡器，其将接收信号y乘以信道响应的倒数(记为h^-1)，强制归零均衡器的输出信号x_ZF可表示为x_ZF＝h^-1y＝s+h^-1n，如此一来，强制归零均衡器即可消除通道对传送符元的影响。然而，当通道响应小时，强制归零均衡器具有噪声增强(Noise Enhancement)的问题。为了避免强制归零均衡器所造成噪声增强的效应，最小均方差均衡器(Minimum Mean Square ErrorEqualizer，MMSE Equalizer)已成为解调制系统中常见的解决方案，最小均方差均衡器系将接收信号y乘以

其中

及

分别代表传送符元及噪声的能量，而最小均方差均衡器的输出信号x_MMSE可表示为

如此一来，无论通道响应或强或弱，当接收信噪比(Received Signal-to-Noise Ratio，Received SNR)够高，即接收信号能量

远大于噪声能量

时，

可近似于h^-1，最小均方差均衡器可近似于强制归零均衡器。

然而，当噪声能量

较强时，最小均方差均衡器会造成其输出信号x_MMSE的能量减小，反而降低解调制系统的符元判断精准度，即最小均方差均衡器的输出信号x_MMSE的能量减小会导致解调制系统的符元错误率(Symbol Error Rate，SER)及相应的位错误率(BitError Rate，BER)上升，反而降低解调制系统的系统效能。

因此，已知技术实有改善的必要。

发明内容

因此，本发明的主要目的即在于提供一种等化增强模块、解调制系统以及等化增强方法，以改善已知技术的缺点。

本发明揭示一种等化增强模块，包含有一乘法单元，用来将多个等化信号(Equalized Signal)乘以一缩放系数(Scaling Coefficient)，以取得多个缩放信号(Scaled Signal)；一判断单元，耦接于该乘法单元，用来判断该多个缩放信号是否位于一特定区域，产生多个判断结果；一比例计算单元，耦接于该判断单元，用来根据该多个判断结果，计算一区内比例，其中该区内比例相关于该多个缩放信号位于该特定区域的一比例；以及一系数计算单元，耦接于该比例计算单元，用来根据该区内比例，计算该缩放系数。

本发明另揭示露一种解调制(Demodulation)系统，包含有一等化模块，用来对多个接收信号进行等化，以产生多个等化信号；一符元判断模块；以及一等化增强模块，耦接于这些化模块与该符元判断模块之间，这些化增强模块包含有一乘法单元，用来将该多个等化信号乘以一缩放系数，以取得多个缩放信号；一判断单元，耦接于该乘法单元，用来判断该多个缩放信号是否位于一特定区域，产生多个判断结果；一比例计算单元，耦接于该判断单元，用来根据该多个判断结果，计算一区内比例；以及一系数计算单元，耦接于该比例计算单元，用来根据该区内比例，计算该缩放系数；其中，该符元判断模块对该多个缩放信号进行解调制。

本发明另揭示一种等化增强方法，包含有将多个等化信号乘以一缩放系数，以取得多个缩放信号；判断多个缩放信号是否位于一特定区域，产生多个判断结果；根据该多个判断结果，计算一区内比例，其中该区内比例相关于该多个缩放信号位于该特定区域的一比例；以及根据该区内比例，计算该缩放系数。

附图说明

图1为本发明实施例一解调制系统的示意图。

图2为本发明实施例一等化增强模块的示意图。

图3为本发明实施例一比例计算单元的示意图。

图4为本发明实施例一系数计算单元的示意图。

图5为多个等化信号的星座图。

图6为多个缩放信号的星座图。

图7为一帧的示意图。

图8为本发明实施例一解调制系统的示意图。

图9为本发明实施例一等化增强模块的示意图。

符号说明

1 解调制系统

10 等化增强模块

12 等化模块

14 符元判断模块

200 乘法单元

202 判断单元

204、304 比例计算单元

206、406 系数计算单元

300 平均单元

80 等化增强流程

800～810 步骤

90 等化增强模块

902 处理单元

904 储存单元

908 程序代码

y₁～y_n 接收信号

x₁～x_n 等化信号

gx₁～gx_n 缩放信号

AD1、AD2 加法器

D1、D2 缓存器

Data 数据子帧

FR 帧

Header 标头子帧

MUX 多任务器

MP1、MP2 乘法器

I_k、I_k+1 区内比例

IR 特定比例

R₀ 特定区域

SB 减法器

g_k、g_k+1 缩放系数

hit_k 判断结果

α 平均系数

μ 调整系数

具体实施方式

请参考图1，图1为本发明实施例一解调制系统1的示意图。解调制系统1可为一特殊应用集成电路(Application-Specific Integrated Circuit，ASIC)，其包含一等化模块12、一等化增强模块10以及一符元判断模块14。解调制系统1自一信道中接收多个接收信号，等化模块12用来对该多个接收信号进行等化，以产生多个等化信号(EqualizedSignal)，等化增强模块10将该多个等化信号乘以一缩放系数(Scaling Coefficient)，以产生多个缩放信号(Scaled Signal)至符元判断模块14，符元判断模块14即可对该多个缩放符元进行解调制(Demodulation)。其中，等化模块12可为一最小均方差均衡器(MinimumMean Square Error Equalizer，MMSE Equalizer)。详细来说，于一第1时间区间至一第n时间区间中，解调制系统1分别由等化模块12接收到接收信号y₁～y_n，而等化模块12接收到接收信号y₁～y_n后分别对接收信号y₁～y_n进行等化，而产生等化信号x₁～x_n。等化增强模块10可根据等化信号x₁～x_n-1(即于第n时间区间前等化增强模块10所接收来自等化模块12的输出信号)，产生缩放系数g₁～g_n，并将等化信号x₁～x_n分别乘以缩放系数g₁～g_n，以产生缩放信号gx₁～gx_n。符元判断模块14即可对缩放信号gx₁～gx_n进行解调制。

具体来说，于第1时间区间时，等化增强模块10可预先设定缩放系数g₁为1，缩放信号gx₁即为等化信号x₁本身(即gx₁＝x₁)。于第2时间区间时，等化增强模块10可根据等化信号x₁产生缩放系数g₂，并将等化信号x₂乘以缩放系数g₂以产生缩放信号gx₂为gx₂＝g₂x₂。以此类推，于第n时间区间时，等化增强模块10可根据等化信号x₁～x_n-1产生缩放系数g_n，并将等化信号x_n乘以缩放系数g_n以产生缩放信号gx_n为gx_n＝g_nx_n。

需注意的是，因等化模块12为最小均方差均衡器，当噪声能量强时，其输出信号(即等化信号x₁～x_n)的能量比其对应的接收信号y₁～y_n的能量小(即|x_k|²＜|y_k|²)。为了避免因等化信号x₁～x_n的能量较小而导致对应于解调制系统1的符元错误率或位错误率上升，等化增强模块10所产生的缩放系数g₁～g_n系用来补偿等化模块12(即最小均方差均衡器)所造成的能量缩减，以进一步改善系统效能。

关于等化增强模块10产生缩放系数g₂～g_n(缩放系数g₁已预先设定为1)的操作细节，请进一步参考图1，图2为等化增强模块10的示意图。如图2所示，等化增强模块10包含一乘法单元200、一判断单元202、一比例计算单元204以及一系数计算单元206。于第1时间区间至第n时间区间中，等化增强模块10自等化模块12分别接收等化信号x₁～x_n，乘法单元200分别将等化信号x₁～x_n乘以缩放系数g₁～g_n，以取得缩放信号gx₁～gx_n。判断单元202耦接于乘法单元200，用来判断缩放信号gx₁～gx_n的对应星座点是否位于一特定区域R，以产生判断结果hit₁～hit_n。比例计算单元204耦接于判断单元202，用来根据判断结果hit₁～hit_n，计算区内比例I₁～I_n，其中区内比例I₁～I_n相关于缩放信号gx₁～gx_n-1位于特定区域R的比例。系数计算单元206耦接于比例计算单元204，用来根据区内比例I₁～I_n，计算缩放系数g₁～g_n，并将缩放系数g₁～g_n传递回乘法单元200，使得于第n时间区间时，乘法单元200可将等化信号x_n乘以缩放系数g_n，以产生缩放信号gx_n至符元判断模块14，符元判断模块14即可对缩放信号gx_n进行解调制。

详细来说，于第k时间区间中，判断单元202判断缩放信号gx_k的对应星座点是否位于特定区域R，若缩放信号gx_k位于特定区域R，判断单元202输出对应于缩放信号gx_k的判断结果hit_k为1；反之，若缩放信号gx_k不位于特定区域R，判断单元202输出对应于缩放信号gx_k的判断结果hit_k为0。判断单元202判断缩放信号gx_k之对应星座点是否位于特定区域R的方式并未有所限，于一实施例中，判断单元202可判断缩放信号gx_k的一同相成份(In-phaseComponent)与一正交成份(Quadrature Component)是否于一特定范围，若缩放信号gx_k的同相成份与正交成份于特定范围，判断单元202判断缩放信号gx_k位于特定区域R且输出判断结果hit_k为1；反之，判断单元202判断缩放信号gx_k不位于特定区域R且输出判断结果hit_k为0。举例来说，当接收信号y₁～y_n具有以四位相位偏移调制(Quadrature Phase ShiftKeying，QPSK)的符元(Symbol)信号时，判断单元202可判断缩放信号gx_k的同相成份的一绝对值(记为|Re{gx_k}|)是否小于一特定值d，并判断缩放信号gx_k的正交成份的一绝对值(记为|Im{gx_k}|)是否小于特定值d，当|Re{gx_k}|小于特定值d且|Im{gx_k}|小于特定值d时，判断单元202判断缩放信号gx_k位于特定区域R且输出判断结果hit_k为1；反之，判断单元202输出判断结果hit_k为0。判断单元202产生判断结果hit₁～hit_n，并将判断结果hit₁～hit_n传递至比例计算单元204。

比例计算单元204可根据判断结果hit₁～hit_n并利用一递归平均(RecursiveAverage)方式，计算区内比例I₁～I_n。请参考图3，图3为本发明实施例一比例计算单元304的示意图。比例计算单元304可用来实现比例计算单元204，其包含有一多任务器MUX以及一平均单元300，多任务器MUX可耦接于判断单元202，用来接收判断单元202所产生的判断结果hit₁～hit_n。以判断结果hit₁～hit_n中一判断结果hit_k为例，当判断结果hit_k为1时，多任务器MUX输出一信号S为一平均系数α；当判断结果hit_k为0时，多任务器MUX输出该信号为0。换句话说，多任务器MUX所输出的信号S可表示为αhit_k。

另一方面，平均单元300可根据平均系数α以及判断结果hit₁～hit_n，计算区内比例I₁～I_n，具体来说，平均单元300包含有一乘法器MP1、一加法器AD1以及一缓存器D1，加法器AD1耦接于多任务器MUX，缓存器D1耦接于加法器AD1，乘法器MP1耦接于加法器AD1与缓存器D1之间。以下以第k时间区间与第k+1时间区间为例进行说明，于第k时间区间时，缓存器D1的输出为一区内比例I_k(对应至暂存区内比例)，乘法器MP1将区内比例I_k乘以一系数为(1－α)后产生一相乘结果R1，并将相乘结果R1传递至加法器AD1，其中相乘结果R1可表示为R1＝(1－α)I_k。加法器AD1将信号S与相乘结果R1相加以取得一相加结果R2，相加结果R2可表示为R2＝αhit_k+(1－α)I_k，相加结果R2即为区内比例I_k+1。另外，比例计算单元304将相加结果R2/区内比例I_k+1储存于缓存器D1中，使得于第k+1时间区间时，缓存器D1即可输出区内比例I_k+1，换句话说，比例计算单元304的平均单元300用来实现I_k+1＝αhit_k+(1－α)I_k，其中整数k可为1到n－1的正整数。如此一来，比例计算单元304于第1时间区间至第n－1时间区间接收到判断结果hit₁～hit_n-1后，即可根据判断结果hit₁～hit_n-1分别于第1时间区间至第n时间区产生区内比例I₁～I_n，其中区内比例I₁可预先设定为一特定值。同时，于第1时间区间至第n时间区间中，比例计算单元304将所产生的区内比例I₁～I_n传递至系数计算单元206。

系数计算单元206可于第1时间区间至第n时间区间中分别判断区内比例I₁～I_n是否大于一特定比例IR，以计算缩放系数g₂～g_n，使得区内比例渐趋近于(收敛至)特定比例IR。以于第k时间区间所收到的区内比例I_k为例，当区内比例I_k大于特定比例IR时，系数计算单元206计算缩放系数g_k+1为缩放系数g_k(对应至暂存缩放系数)增加一第一特定值Δg₁(即g_k+1＝g_k+Δg₁)；反之，当区内比例I_k小于特定比例IR时，系数计算单元206计算缩放系数g_k+1为缩放系数g_k减去一第二特定值Δg₂(即g_k+1＝g_k－Δg₂)，其中第一特定值Δg₁与第二特定值Δg₂皆大于零。

具体来说，请参考图4，图4为本发明实施例一系数计算单元406的示意图。系数计算单元406可用来实现系数计算单元206，其包含有一减法器SB、一乘法器MP2、一加法器AD2以及一缓存器D2。减法器SB耦接于比例计算单元204以接收比例计算单元204所产生的区内比例，乘法器MP2耦接于减法器SB，加法器AD2耦接于乘法器MP2与缓存器D2之间，且缓存器D2还将输出回馈至加法器AD2。同样地，以下以第k时间区间与第k+1时间区间为例进行说明，于第k时间区间时，减法器SB接收比例计算单元204所产生的区内比例I_k，减法器SB将区内比例I_k减去特定比例IR，产生一相减结果R3，相减结果R3可表示为R3＝I_k－IR。乘法器MP2将相减结果R3(即I_k－IR)乘以一调整系数μ，即产生一相乘结果R4并将相乘结果R4传递至加法器AD2，其中相乘结果R4可表示为R4＝μ(I_k－I_R)，此时(即于第k时间区间中)缓存器D2的输出为缩放系数g_k(对应至暂存缩放系数)，而加法器AD2将相乘结果R4与缩放系数g_k相加，以产生一相加结果R5，相加结果R5可表示为R5＝g_k+μ(I_k－IR)，相加结果R5即为缩放系数g_k+1。另外，系数计算单元406将相加结果R5/缩放系数g_k+1储存于缓存器D2中，使得于第k+1时间区间时，缓存器D2即可输出缩放系数g_k+1，换句话说，系数计算单元406用来实现g_k+1＝g_k+μ(I_k－IR)，其中整数k可为1到n－1的正整数。如此一来，系数计算单元406于第1时间区间至第n－1时间区间接收到区内比例I₁～I_n－1，并分别计算缩放系数g₂～g_n(其中缩放系数g₁预先设定为1)，使得区内比例收敛至特定比例IR。

如此一来，等化增强模块10可产生缩放系数，以补偿等化模块12(即最小均方差均衡器)所造成的能量缩减。请参考图5及图6，图5为等化模块12所输出的多个等化信号的之星座图，图6等化增强模块10所产生的多个缩放信号的星座图。因等化模块12造成能量缩减，多个等化信号位于一特定区域R₀的一比例为52％，若直接对等化模块12所输出的多个等化信号进行解调制，将导致符元错误率或位错误率升高。相比之下，透过等化增强模块10所产生的缩放系数，可使多个缩放信号的星座点向外散开，多个缩放信号位于特定区域R₀的一比例降低为25％，对化增强模块10所产生的缩放系数进行解调制，可降低符元错误率或位错误率，提升解调制系统1的效能。

另一方面，解调制系统1可用来对一帧(Frame)FR进行解调制。详细来说，帧FR可包含一标头子帧Header以及一数据子帧Data，如图7所示。帧FR可由一传送端传送至一通道中，解调制系统1可自信道接收对应于帧FR的接收信号y₁～y_N，其中接收信号y₁～y_n可对应于标头子帧Header而接收信号y_n+1～y_N可对应于数据子帧Data。解调制系统1可依照上述方式根据接收信号y₁～y_n产生缩放系数g_n(即最后更新的缩放系数)，并根据缩放系数g_n对其后续对应于数据子帧Data的接收信号y_n+1～y_N进行解调。如此一来，即可更准确地解调制出帧FR所包含的信息，以提升系统效能。

关于等化增强模块产生缩放信号的操作流程，可进一步归纳为一等化增强流程80，请参考图8，图8为本发明实施例等化增强流程80的示意图。等化增强流程80可由一等化增强模块来执行，其包含以下步骤：

步骤800：开始。

步骤802：将等化信号x₁～x_n-1乘以一缩放系数g，以取得缩放信号gx₁～gx_n-1。

步骤804：判断缩放信号gx₁～gx_n-1之对应星座点是否位于特定区域R，产生判断结果hit₁～hit_n-1。

步骤806：根据判断结果hit₁～hit_n-1，计算一区内比例I_n，其中区内比例I_n相关于缩放信号gx₁～gx_n-1位于特定区域R的比例。

步骤808：根据区内比例I_n，调整缩放系数g。

步骤810：结束。

于等化增强流程80中，缩放系数g的系数值可随时间变化而不同，即缩放系数g的系数值于第1时间区间至第n时间区间可分别为缩放系数g₁～g_n。另外，于步骤806中，等化增强模块可利用递归平均方式计算区内比例I_n，即计算区内比例I_n为I_k+1＝αhit_k+(1－α)I_k，除此之外，等化增强模块亦可直接计算区内比例I_n为

亦符合本发明的要求。

另外，于步骤808中，等化增强模块可判断区内比例I_n是否大于特定比例IR，当区内比例I_n大于特定比例IR时，等化增强模块计算缩放系数g为一暂存缩放系数g_-1增加第一特定值Δg₁(即g＝g_-1+Δg₁)；当区内比例I_n小于特定比例IR时，等化增强模块计算缩放系数为暂存缩放系数g_-1减去第二特定值Δg₂(即g_k+1＝g_k－Δg₂)。除此之外，等化增强模块亦可计算缩放系数g为g＝g_-1+μ(I_n－IR)，亦符合本发明的要求。其余等化增强流程80之操作细节，可参考前述相关段落，于此不再赘述。

另一方面，等化增强模块不限于以特殊应用集成电路来实现，请参考图9，图9本发明实施例一等化增强模块90的示意图，等化增强模块90包含一处理单元902及一储存单元904。前述等化增强流程80可编译成一程序代码908并储存于储存单元904中，以指示处理单元902执行等化增强流程80。其中，处理单元902可为一中央处理器(CPU)、一数字信号处理器(Digital Signal Processor，DSP)或是一微处理器(Microprocessor)，而不在此限，储存单元904可为一只读式内存(read-only memory，ROM)或是一非挥发性内存(non-volatile memory，例如，一电子抹除式可复写只读存储器(electrically erasableprogrammable read only memory,EEPROM)或一闪存(flash memory))，而不在此限。

需注意的是，前述实施例用以说明本发明的概念，本领域具通常知识者当可据以做不同的修饰，而不限于此。举例来说，前述实施例是以接收信号y₁～y_n为具有四位相位偏移调制(QPSK)的符元信号为例进行说明，而本发明不限于此，接收信号y₁～y_n亦可具有正交振幅调制(Quadrature Amplitude Modulation，QAM)、相位偏移调制(Phase ShiftKeying，PSK)或振幅相位偏移调制(Amplitude Phase Shift Keying，APSK)的符元信号，亦属于本发明的范畴。另外，等化模块12不限于最小均方差均衡器，只要等化模块12所产生的等化信号的能量不大于等化模块12所产生的接收信号的能量，皆可利用本发明的等化增强模块补偿等化模块12所造成的能量缩减，以进一步改善解调制系统1的系统效能。

由上述可知，本发明根据缩放信号位于特定区域的比例来调整缩放系数，以补偿等化模块(最小均方差均衡器)所造成的能量缩减，进一步降低符元错误率或位错误率，提升解调制系统的效能。

以上所述仅为本发明的较佳实施例，凡依本发明申请专利范围所做的均等变化与修饰，皆应属本发明的涵盖范围。

Claims (18)

1.一种等化增强模块，包含有：

一乘法单元，用来将多个等化信号分别乘以不同的缩放系数，以取得多个缩放信号；

一判断单元，耦接于该乘法单元，用来判断该多个缩放信号的对应星座点是否位于一特定区域，产生多个判断结果；

一比例计算单元，耦接于该判断单元，用来根据该多个判断结果，计算一区内比例，其中该区内比例相关于该多个缩放信号位于该特定区域的一比例；以及

一系数计算单元，耦接于该比例计算单元，用来根据该区内比例，计算缩放系数。

2.如权利要求1所述的等化增强模块，其特征在于，该比例计算单元包含有一平均单元，该平均单元根据该多个判断结果以及一平均系数，计算该区内比例。

3.如权利要求2所述的等化增强模块，其特征在于，该平均单元包含有：

一第一乘法器，用来将一暂存区内比例乘以一第一系数，以产生一第一相乘结果，其中该第一系数为1减该平均系数；

一第一加法器，耦接于该第一乘法器，用来将该第一相乘结果与一第一信号相加，以产生一第一相加结果，其中该第一信号相关于该多个判断结果中一判断结果与该平均系数；以及

一第一缓存器，耦接于该第一加法器，用来输出该区内比例为该第一相加结果。

4.如权利要求3所述的等化增强模块，其特征在于，当该判断结果显示该多个缩放信号的一缩放信号位于该特定区域之内时，该第一信号为该平均系数，当该判断结果显示该缩放信号位于该特定区域之外时，该第一信号为0。

5.如权利要求3所述的等化增强模块，其特征在于，该平均单元另包含有一多任务器，耦接于该第一加法器，其中当该判断结果显示该多个缩放信号的一缩放信号位于该特定区域之内时，该多任务器所产生的该第一信号为该平均系数，当该判断结果显示该缩放信号位于该特定区域之外时，该多任务器所产生之该第一信号为0。

6.如权利要求1所述的等化增强模块，其中当该区内比例大于一特定比例时，该系数计算单元计算缩放系数为一暂存缩放系数增加一第一特定值。

7.如权利要求6所述的等化增强模块，其特征在于，当该区内比例小于该特定比例时，该系数计算单元计算缩放系数为该暂存缩放系数减去一第二特定值。

8.如权利要求6所述的等化增强模块，其特征在于，该系数计算单元包含有：

一减法器，用来产生该区内比例与该特定比例的一相减结果；

一第二乘法器，耦接于该减法器，用来将该相减结果乘以一调整系数，以产生一第二相乘结果；

一第二加法器，耦接于该第二乘法器，用来将该第二相乘结果与该暂存缩放系数相加，以产生一第二相加结果；以及

一第二缓存器，耦接于该第二加法器，用来输出缩放系数为该第二相加结果。

9.一种解调制系统，包含有：

一等化模块，用来对多个接收信号进行等化，以产生多个等化信号；

一符元判断模块；以及

一等化增强模块，耦接于该等化模块与该符元判断模块之间，该等化增强模块包含有：

一乘法单元，用来将该多个等化信号分别乘以不同的缩放系数，以取得多个缩放信号；

一判断单元，耦接于该乘法单元，用来判断该多个缩放信号是否位于一特定区域，产生多个判断结果；

一比例计算单元，耦接于该判断单元，用来根据该多个判断结果，计算一区内比例；以及

一系数计算单元，耦接于该比例计算单元，用来根据该区内比例，计算缩放系数；

其中，该符元判断模块对该多个缩放信号进行解调制。

10.如权利要求9所述的解调制系统，其特征在于，该等化模块为一最小均方差均衡器。

11.如权利要求9所述的解调制系统，其特征在于，该等化模块所产生的该多个等化信号的能量不大于其对应的多个接收信号的能量。

12.一种等化增强方法，可提升一解调制系统的效能，包含有：

将多个等化信号分别乘以不同的缩放系数，以取得多个缩放信号；

判断多个缩放信号的对应星座点是否位于一特定区域，产生多个判断结果；

根据该多个判断结果，计算一区内比例，其中该区内比例相关于该多个缩放信号位于该特定区域之一比例；以及

根据该区内比例，计算缩放系数，使该区内比例渐趋近于一特定比例。

13.如权利要求12所述的等化增强方法，其特征在于，根据该多个判断结果计算该区内比例的步骤包含有：

根据该多个判断结果以及一平均系数，计算该区内比例。

14.如权利要求13所述的等化增强方法，其特征在于，根据该多个判断结果以及该平均系数计算该区内比例的步骤包含有：

将一暂存区内比例乘以一第一系数，以产生一第一相乘结果，其中该第一系数为1减该平均系数；

将该第一相乘结果与一第一信号相加，以产生一第一相加结果，其中该第一信号相关于该多个判断结果中一判断结果与该平均系数；以及

输出该区内比例为该第一相加结果。

15.如权利要求14所述的等化增强方法，其特征在于，当该判断结果显示该多个缩放信号的一缩放信号位于该特定区域之内时，产生该第一信号为该平均系数，当该判断结果显示该缩放信号位于该特定区域之外时，产生该第一信号为0。

16.如权利要求12所述的等化增强方法，其特征在于，根据该区内比例计算缩放系数的步骤包含有：

当该区内比例大于该特定比例时，计算缩放系数为一暂存缩放系数增加一第一特定值。

17.如权利要求16所述的等化增强方法，其特征在于，根据该区内比例计算缩放系数的步骤另包含有：

当该区内比例小于该特定比例时，计算缩放系数为该暂存缩放系数减去一第二特定值。

18.如权利要求16所述的等化增强方法，其特征在于，根据该区内比例计算缩放系数的步骤包含有：

产生该区内比例与该特定比例之一相减结果；

将该相减结果乘以一调整系数，以产生一第二相乘结果；

将该第二相乘结果与该暂存缩放系数相加，以产生一第二相加结果；以及取得缩放系数为该第二相加结果。

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