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TW201447848A - 顯示器及其驅動方法 - Google Patents

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TW201447848A
TW201447848A TW102120756A TW102120756A TW201447848A TW 201447848 A TW201447848 A TW 201447848A TW 102120756 A TW102120756 A TW 102120756A TW 102120756 A TW102120756 A TW 102120756A TW 201447848 A TW201447848 A TW 201447848A
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TW
Taiwan
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control signal
scan
pulse
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TW102120756A
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English (en)
Inventor
Chun-Yen Liu
Shang-Heng Hsieh
Original Assignee
Au Optronics Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
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Publication date
Application filed by Au Optronics Corp filed Critical Au Optronics Corp
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Priority to CN201310331913.7A priority patent/CN103489395A/zh
Priority to US14/063,041 priority patent/US20140362069A1/en
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Abstract

顯示器及其驅動方法。所述顯示器包括有第一畫素、第二畫素與驅動電路。所述第一畫素設置以接收第一控制訊號，並設置以接收第一掃描訊號，並根據第一掃描訊號在第一時段接收第一畫素的資料訊號。第二畫素設置以接收第一控制訊號，並設置以在相異於第一時段的第二時段接收第二掃描訊號，並根據第二掃描訊號接收第二畫素的資料訊號，且第一畫素及第二畫素分別包括一發光二極體。驅動電路係電性耦接第一畫素與第二畫素，並設置以提供第一掃描訊號、第二掃描訊號與第一控制訊號，其中第一控制訊號係設置以決定是否允許電流通過上述發光二極體。

Description

顯示器及其驅動方法
本發明是有關於一種顯示器，尤其是有關於一種顯示器的畫素驅動架構。
在傳統有機發光二極體(Organic Light-Emitting Diode,OLED)畫素的電路架構中，都會採用具臨界電壓(Threshold voltage,Vth)補償之設計，以改善畫素中之薄膜電晶體(Thin Film Transistor,TFT)的電性不均勻的問題。
然而，在這種畫素的電路設計下，每一畫素都會需要不少的訊號來驅動。這表示，在每一畫素有限的佈局空間內，都會需要電性耦接多條訊號線來接收上述這些訊號。
本發明提供一種顯示器，其畫素驅動架構可以減少驅動訊號的複雜度。
本發明另提供上述顯示器之驅動方法。
根據本發明的實施例，提出一種顯示器，其包括有第一畫素、第二畫素與驅動電路。所述之第一畫素設置以接收第一控制訊號，並設置以接收第一掃描訊號，並根據第 一掃描訊號在第一時段接收第一畫素的資料訊號。所述之第二畫素設置以接收上述第一控制訊號，並設置以在相異於第一時段的第二時段接收第二掃描訊號，並根據第二掃描訊號接收第二畫素的資料訊號。此外，上述第一畫素及第二畫素分別包括一發光二極體。至於上述之驅動電路，其係電性耦接第一畫素與第二畫素，並設置以提供上述第一掃描訊號、上述第二掃描訊號與上述第一控制訊號，其中上述之第一控制訊號係設置以決定是否允許電流通過上述各發光二極體。
根據本發明另一實施例所提出之一種顯示器，其包括有第一畫素、第二畫素與驅動電路。所述之第一畫素設置以接收第二控制訊號，並設置以接收第一掃描訊號，並根據第一掃描訊號在第一時段接收第一畫素的資料訊號。所述之第二畫素設置以接收上述第二控制訊號，並設置以在相異於第一時段的第二時段接收第二掃描訊號，並根據第二掃描訊號接收第二畫素的資料訊號。此外，上述第一畫素及第二畫素皆包括一發光二極體與一第二電晶體，其中所述之第二電晶體設置以根據其閘極與源極的電壓差而控制流過對應的畫素的發光二極體的電流大小，且上述之第二控制訊號係設置以決定是否將上述各第二電晶體的閘極電壓重置至一預設電位。至於所述之驅動電路，其係電性耦接上述第一畫素與上述第二畫素，並設置以提供上述第一掃描訊號、上述第二掃描訊號與上述第二控制訊號。
根據本發明又一實施例，再提出一種顯示器的驅動方法。所述之顯示器具有第一畫素與第二畫素，且所述之第一畫素與第二畫素皆具有第一電晶體、第二電晶體及發光二極體。其中，每一第一電晶體設置以根據第一控制訊號的 控制而決定是否允許電流通過對應的畫素的發光二極體。每一第二電晶體設置以根據其閘極與源極的電壓差而決定流過對應的畫素的發光二極體的電流大小。所述之驅動方法包括有下列步驟：透過第一控制訊號截止上述第一畫素及第二畫素的第一電晶體，以禁止電流流過第一畫素與第二畫素的發光二極體；在第一時段驅動第一畫素，以使第一畫素接收第一畫素的資料訊號；在相異於第一時段的第二時段驅動第二畫素，以使第二畫素接收第二畫素的資料訊號；以及根據第一畫素的資料訊號及第二畫素的資料訊號而分別驅動第一畫素與第二畫素發光。
本發明之顯示器係採用共用畫素之部分訊號的設計方式，因此可以簡化畫素之驅動電路的設計。
100‧‧‧發光二極體畫素
102‧‧‧電容
104~114‧‧‧電晶體
116‧‧‧發光二極體
300、500‧‧‧顯示器
310、510、802、806‧‧‧驅動電路
320、520‧‧‧顯示面板
322、522、702、704、804、808、810‧‧‧畫素
324、524、706~714‧‧‧訊號線
EM、EM[n]、EM[n+2]、Scan_N-1、Scan_N-1[n]、Scan_N-1[n+2]‧‧‧控制訊號
OVDD‧‧‧電源電壓
OVSS‧‧‧參考電位
Scan_N、Scan_N[n]、Scan_N[n+1]、Scan_N[n+2]、Scan_N[n+3]‧‧‧掃描訊號
T1、T2‧‧‧時段
Vdata‧‧‧資料訊號
Vint‧‧‧預設電位
S602~S608‧‧‧步驟
圖1係繪示本發明發光二極體畫素之電路架構示意圖。
圖2係繪示圖1相鄰二列之發光二極體畫素的控制訊號時序的第一實施例示意圖。
圖3為採用圖1所示畫素之顯示器的第一實施例示意圖。
圖4係繪示圖1相鄰二列之發光二極體畫素的控制訊號時序的第二實施例示意圖。
圖5為採用圖1所示畫素之顯示器的第二實施例示意圖。
圖6為為圖5顯示器的驅動方法的流程圖。
圖7為採用本發明設計之相鄰二畫素的佈局示意圖。
圖8為習知技術與本發明之比較的示意圖。
圖1係繪示本發明發光二極體畫素之電路架構示意圖。在圖1中，標示100即表示具有臨界電壓Vth補償設計之發光二極體畫素的電路架構。此發光二極體畫素100係由電容102、發光二極體116以及電晶體104~114所組成。在此例中，發光二極體116例如是以有機發光二極體來實現，而P型電晶體104~114則例如是皆以P型的薄膜電晶體來實現。
如圖1所示，電晶體104的其中一源/汲極係透過電容102來電性耦接電源電壓OVDD，另一源/汲極係電性耦接預設電位Vint，而閘極則設置以接收控制訊號Scan_N-1。電晶體106的其中一源/汲極係電性耦接電源電壓OVDD，而閘極則設置以接收控制訊號EM。電晶體108的其中一源/汲極係電性耦接電晶體106的另一源/汲極，而閘極則透過電容102電性耦接電源電壓OVDD。電晶體110的其中一源/汲極係電性耦接電晶體108的閘極，另一源/汲極係電性耦接電晶體108的另一源/汲極，而閘極則設置以接收掃描訊號Scan_N。其中N為自然數。
電晶體112的其中一源/汲極係透過電晶體106電性耦接電源電壓OVDD，另一源/汲極係設置以接收資料訊號Vdata，而閘極則設置以接收掃描訊號Scan_N。至於電晶體114的其中一源/汲極係電性耦接電晶體108的另一源/汲極與電晶體110的另一源/汲極，電晶體114的另一源/汲極係透過發光二極體116電性耦接參考電位OVSS，而電晶體114的閘極則設置以接收控制訊號EM。
圖2係繪示圖1相鄰二列之發光二極體畫素的控 制訊號時序的第一實施例示意圖。在圖2中，上半部分的三個訊號時序係第N列畫素中之每一個畫素所需要的控制訊號Scan_N-1、掃描訊號Scan_N與控制訊號EM的時序，而下半部分的三個訊號時序係第N+1列畫素中之每一個畫素所需要的控制訊號Scan_N-1、掃描訊號Scan_N與控制訊號EM的時序。
圖3為採用圖1所示畫素之顯示器的第一實施例示意圖，此顯示器300包括有驅動電路310與顯示面板320，而顯示面板320又包括有多個畫素322與多條訊號線324。驅動電路310係透過各訊號線324電性耦接顯示面板320中的對應畫素322。為方便說明，圖3中的顯示面板320係僅描繪二列相鄰的畫素來舉例，且圖3中的驅動電路310亦僅描繪這二列畫素所需的訊號。如圖3所示，第N列畫素與第N+1列畫素中之每列畫素皆需要一個控制訊號Scan_N-1、一個掃描訊號Scan_N與一個控制訊號EM。換句話說，每相鄰二列畫素就需要電性耦接六條訊號線。這表示，顯示面板320的邊框需要有很大的空間來容納訊號線324的走線。
本發明提出圖1所示畫素的一種新驅動方式，以圖4來舉例說明之。圖4係繪示圖1相鄰二列之發光二極體畫素的控制訊號時序的第二實施例示意圖。在圖4中，上半部分的三個訊號時序係第N列畫素中之每一個畫素所需要的控制訊號Scan_N-1、掃描訊號Scan_N與控制訊號EM的新時序，而下半部分的三個訊號時序係第N+1列畫素中之每一個畫素所需要的控制訊號Scan_N-1、掃描訊號Scan_N與控制訊號EM的新時序。
請同時參照圖4與圖1，由這二個圖式可知，第 N列畫素中的每一畫素係設置以接收控制訊號Scan_N-1、掃描訊號Scan_N與控制訊號EM，並設置以根據掃描訊號Scan_N而在時段T1接收畫素的資料訊號。類似地，第N+1列畫素中的每一畫素亦設置以接收控制訊號Scan_N-1、掃描訊號Scan_N與控制訊號EM，並設置以在相異於時段T1的時段T2根據掃描訊號Scan_N接收畫素的資料訊號。
此外，由圖1與圖4亦可知，每一畫素中的電晶體114係設置以根據控制訊號EM的控制而決定是否允許電流通過發光二極體116，或者可以說，每一畫素中的電晶體114係設置以根據控制訊號EM的控制而決定斷開或者導通電晶體108與發光二極體116之間的電流路徑。而每一畫素中的電晶體108係設置以根據其閘極與源極的電壓差而決定流過發光二極體116的電流大小，此外，每一畫素中的電晶體108的閘極與源極的電壓差係根據每一畫素所接收的資料訊號Vdata而改變。另外，控制訊號Scan_N-1係設置以決定是否將電晶體108的閘極電壓重置至預設電位Vint。
請再參照圖4，由圖4所示的訊號時序關係可以知道，第N列畫素所接收之掃描訊號Scan_N的脈衝的起始邊緣係位於控制訊號Scan_N-1之脈衝的結束邊緣之後，第N+1列畫素所接收之掃描訊號Scan_N的脈衝的起始邊緣係位於第N列畫素所接收之掃描訊號Scan_N的脈衝的結束邊緣之後，控制訊號EM之脈衝的起始邊緣係位於控制訊號Scan_N-1之脈衝的起始邊緣之前，且控制訊號EM之脈衝的結束邊緣係位於第N+1列畫素所接收之掃描訊號Scan_N的脈衝的結束邊緣之後。
當然，第N列畫素所接收之掃描訊號Scan_N的 脈衝的起始邊緣也可以是位於控制訊號Scan_N-1之脈衝的結束邊緣，第N+1列畫素所接收之掃描訊號Scan_N的脈衝的起始邊緣也可以是位於第N列畫素所接收之掃描訊號Scan_N的脈衝的結束邊緣，控制訊號EM之脈衝的起始邊緣也可以是位於控制訊號Scan_N-1之脈衝的起始邊緣，而控制訊號EM之脈衝的結束邊緣也可以是位於第N+1列畫素所接收之掃描訊號Scan_N的脈衝的結束邊緣。只要控制訊號EM的脈衝致能時間涵蓋控制訊號Scan_N-1的脈衝致能時間、第N列畫素所接收之掃描訊號Scan_N的脈衝致能時間以及第N+1列畫素所接收之掃描訊號Scan_N的脈衝致能時間；且第N列畫素所接收之掃描訊號Scan_N的脈衝致能時間以及第N+1列畫素所接收之掃描訊號Scan_N的脈衝致能時間互不重疊即可。
請同時參照圖4與圖2，經比較之後可以發現，在圖4中，第N+1列畫素所接收之控制訊號Scan_N-1的時序被提前至與第N列畫素所接收之控制訊號Scan_N-1的時序相同，且控制訊號EM的脈衝致能時間被拉長到足以涵蓋控制訊號Scan_N-1的脈衝致能時間、第N列畫素所接收之掃描訊號Scan_N的脈衝致能時間以及第N+1列畫素所接收之掃描訊號Scan_N的脈衝致能時間。這表示，第N列畫素所接收之控制訊號Scan_N-1與第N+1列畫素所接收之控制訊號Scan_N-1可以共用，且第N列畫素所接收之控制訊號EM與第N+1列畫素所接收之控制訊號EM也可以共用。
除此之外，亦可以僅共用第N列畫素所接收之控制訊號Scan_N-1與第N+1列畫素所接收之控制訊號Scan_N-1，或者僅供用第N列畫素所接收之控制訊號EM與第N+1列畫素所接收之控制訊號EM。
更近一步的，若不需共用的訊號，該訊號亦可以不需經過調整，舉例而言，若僅共用第N列畫素所接收之控制訊號EM與第N+1列畫素所接收之控制訊號EM，那麼第N+1列畫素所接收之控制訊號Scan_N-1可以如圖4所示，其脈衝的起始邊緣可以位於第N列畫素所接收之控制訊號Scan_N-1的脈衝的結束邊緣或者位於第N列畫素所接收之控制訊號Scan_N-1的脈衝的結束邊緣之後。
由此可知，藉由圖4所示之新訊號時序，驅動電路中對應於圖4之第N列畫素與第N+1列畫素的對應二級電路勢必可以簡化，更近一步可以使得驅動電路的尺寸得以縮小。如此一來，本發明之顯示器的顯示面板的邊框便得以窄化。當然，基於共用訊號的概念，我們亦可知道即使是非相鄰二列的畫素共用訊號，一樣可以達到使驅動電路的尺寸得以縮小的效果。此外，基於共用訊號的概念，我們同樣可知道相鄰二列畫素所需電性耦接的總訊號線數亦可減少，以圖5來說明之。
圖5為採用圖1所示畫素之顯示器的第二實施例示意圖，此顯示器500包括有驅動電路510與顯示面板520，而顯示面板520又包括有多個畫素522與多條訊號線524。在此例中，每一畫素522的電路架構係可採用圖1所示的畫素電路架構，亦可以採用其他的臨界電壓Vth補償架構。此外，驅動電路510係透過各訊號線524電性耦接顯示面板520中的對應畫素522。
為方便說明，圖5中的顯示面板520係僅描繪四列相鄰的畫素來舉例，且圖5中的驅動電路510亦僅描繪這四列畫素所需的訊號。在圖5所示之驅動電路510所輸出的 訊號中，控制訊號EM[n]與EM[n+2]皆設置以控制對應畫素中的電晶體114是否允許電流通過對應的發光二極體116，控制訊號Scan_N-1[n]與Scan_N-1[n+2]皆設置以控制對應畫素中的電晶體104的閘極電壓是否被重置至預設電位Vint，至於掃描訊號Scan_N[n]、Scan_N[n+1]、Scan_N[n+2]與Scan_N[n+3]則皆設置以控制對應畫素是否接收畫素的資料訊號。其中N與n皆為自然數。
如圖5所示，第N列畫素需要一個控制訊號EM[n]、一個掃描訊號Scan_N[n]與一個控制訊號Scan_N-1[n]，而第N+1列畫素需要一個控制訊號Scan_N-1[n]、一個掃描訊號Scan_N[n+1]與一個控制訊號EM[n]。由於這二列畫素的控制訊號Scan_N-1[n]為共用，因此這二列畫素係可以傳輸控制訊號Scan_N-1[n]的訊號線524為對稱軸對稱排列，並且所需電性耦接的訊號線524僅有五條。當然，這二列畫素也可以共用控制訊號EM[n]，因此這二列畫素亦可以傳輸控制訊號EM[n]的訊號線524為對稱軸對稱排列。此外，若僅共用控制訊號EM[n]或者僅共用控制訊號Scan_N-1[n]，則可選擇以傳輸共用訊號的訊號線524為軸對稱排列。
類似地，第N+2列畫素需要一個控制訊號EM[n+2]、一個掃描訊號Scan_N[n+2]與一個控制訊號Scan_N-1[n+2]，而第N+3列畫素需要一個控制訊號Scan_N-1[n+2]、一個掃描訊號Scan_N[n+3]與一個控制訊號EM[n+2]。由於這二列畫素的控制訊號Scan_N-1[n+2]為共用，因此這二列畫素係以傳輸控制訊號Scan_N-1[n+2]的訊號線524為對稱軸對稱排列，並且所需電性耦接的訊號線524 也僅有五條。
圖6為圖5顯示器的驅動方法的流程圖。所述之顯示器具有第一畫素與第二畫素，且所述之第一畫素與第二畫素皆具有第一電晶體、第二電晶體及發光二極體。其中，每一第一電晶體設置以根據第一控制訊號的控制而決定是否允許電流通過對應的畫素的發光二極體。每一第二電晶體設置以根據其閘極與源極的電壓差而決定流過對應的畫素的發光二極體的電流大小。
請參照圖6，所述之驅動方法包括有下列步驟：透過第一控制訊號(如控制訊號EM)截止上述第一畫素及第二畫素的第一電晶體，以禁止電流流過第一畫素與第二畫素的發光二極體(如步驟S602所示)。在第一時段驅動第一畫素，以使第一畫素接收第一畫素的資料訊號(如步驟S604所示)。在相異於第一時段的第二時段驅動第二畫素，以使第二畫素接收第二畫素的資料訊號(如步驟S606所示)。以及根據第一畫素的資料訊號及第二畫素的資料訊號而分別驅動第一畫素與第二畫素發光(如步驟S608所示)。
此外，在上述驅動方法中，還可包含以下步驟：在第一時段與第二時段之前，透過第二控制訊號(如控制訊號Scan_N-1)驅動第一畫素與第二畫素，以重置第一畫素與第二畫素中之第二電晶體的閘極電壓。
儘管在上述實施方式中，係以發光二極體畫素100的電路架構來舉例說明，然此並非設置以限制本發明。本領域具有通常知識者當知即使是採用其他電路架構之發光二極體畫素，亦可實現本發明。舉例來說，有的畫素的電路架構只需要一個控制訊號EM[n]與一個掃描訊號Scan_N來進行 操作，其中控制訊號EM[n]係設置以控制對應畫素是否允許電流通過對應的發光二極體，而掃描訊號Scan_N係設置以控制對應畫素是否接收畫素的資料訊號。
在這種情況下，相鄰二列畫素中的第N+1列畫素所接收之掃描訊號的脈衝的起始邊緣係可位於第N列畫素所接收之掃描訊號的脈衝的結束邊緣，或是位於第N列畫素所接收之掃描訊號的脈衝的結束邊緣之後，且這二列畫素所接收之控制訊號的脈衝的起始邊緣係可位於第N列畫素所接收之掃描訊號的脈衝的起始邊緣，或是位於第N列畫素所接收之掃描訊號的脈衝的起始邊緣之前，而這二列畫素所接收之控制訊號的脈衝的結束邊緣係可位於第N+1列畫素所接收之掃描訊號的脈衝的結束邊緣，或是位於第N+1列畫素所接收之掃描訊號的脈衝的結束邊緣之後。
總之，通常而言，上述這二列畫素所接收的控制訊號的脈衝致能時間要能涵蓋這二列畫素所接收之掃描訊號的脈衝致能時間，且這二列畫素所接收的掃描訊號的脈衝致能時間需互不重疊。
圖7為採用本發明設計之相鄰二畫素的佈局示意圖。如圖7所示，畫素702與704係位於同一行的相鄰二列中，且這二個畫素共需要五條訊號線，分別以706~714來標示。此外，在這五條訊號線中，訊號線710係由這二個畫素所共用。由此圖可看出，畫素702與704係以訊號線710為對稱軸對稱排列，且畫素702與704係設置以經由訊號線710位於畫素702與704之間的一區段接收控制訊號。在實際的設計方式中，舉例來說，訊號線710可以用來傳輸這二個畫素所共用的控制訊號Scan_N-1，訊號線706與714皆可用來 傳輸控制訊號EM，而訊號線708與712則可用來分別傳輸畫素702與704各自需要的掃描訊號Scan_N。或者，訊號線710可以用來傳輸這二個畫素所共用的控制訊號EM，訊號線706與714皆可用來傳輸控制訊號Scan_N-1，而訊號線708與712則可用來分別傳輸畫素702與704各自需要的掃描訊號Scan_N。
圖8為習知技術與本發明之比較的示意圖。在圖8中，上半部分係繪示習知技術的做法，而下半部分則繪示本發明之做法。如圖8所示，在習知技術中，驅動電路802所提供的控制訊號Scan_N-1與EM係只能提供至單一畫素804。而在本發明中，驅動電路806所提供的控制訊號Scan_N-1與EM係能提供至位於相鄰二列的畫素808與810。因此在電路的佈局上，能夠將驅動電路806設置在兩列畫素808與810的範圍內，因此能夠達到較窄邊框的效果。
本發明之顯示器係採用共用畫素之部分訊號的設計方式，因此可以簡化畫素之驅動電路的設計，甚至是減少電性耦接至相鄰二列之畫素的訊號線的線數。如此一來，本發明之顯示器的顯示面板的邊框便得以窄化。
EM、Scan_N-1‧‧‧控制訊號
Scan_N‧‧‧掃描訊號
T1、T2‧‧‧時段

Claims (13)

  1. 一種顯示器，包括：一第一畫素，設置以接收一第一控制訊號，並接收一第一掃描訊號並根據該第一掃描訊號在一第一時段接收該第一畫素的一資料訊號；一第二畫素，設置以接收該第一控制訊號，並在相異於該第一時段的一第二時段接收一第二掃描訊號並根據該第二掃描訊號接收該第二畫素的一資料訊號，且該第一畫素及該第二畫素分別包括一發光二極體；以及一驅動電路，電性耦接該第一畫素與該第二畫素，並設置以提供該第一掃描訊號、該第二掃描訊號與該第一控制訊號，其中該第一控制訊號係設置以決定是否允許電流通過該些發光二極體。
  2. 如申請專利範圍第1項所述之顯示器，其中該第二掃描訊號之脈衝的起始邊緣係位於該第一掃描訊號之脈衝的結束邊緣，或是位於該第一掃描訊號之脈衝的結束邊緣之後；該第一控制訊號之脈衝的起始邊緣係位於該第一掃描訊號之脈衝的起始邊緣，或是位於該第一掃描訊號之脈衝的起始邊緣之前；而且該第一控制訊號之脈衝的結束邊緣係位於該第二掃描訊號之脈衝的結束邊緣，或是位於該第二掃描訊號之脈衝的結束邊緣之後。
  3. 如申請專利範圍第1或2項所述之顯示器，其中該第一畫素及該第二畫素分別包括一第一電晶體，每一第一電晶體 分別電性耦接每一畫素的發光二極體，每一第一電晶體設置以根據該第一控制訊號而決定是否允許電流通過對應的畫素的該發光二極體。
  4. 如申請專利範圍第3項所述之顯示器，其中該第一畫素及該第二畫素分別更包括一第二電晶體，每一第二電晶體電性耦接對應的第一電晶體，設置以根據該第二電晶體的閘極與源極的電壓差，而控制流過對應的畫素的該發光二極體的電流大小。
  5. 如申請專利範圍第4項所述之顯示器，其中該第一畫素與該第二畫素更設置以接收該驅動電路所提供之一第二控制訊號，該第二控制訊號係設置以決定是否將對應的畫素的第二電晶體的閘極電壓重置至一預設電位。
  6. 如申請專利範圍第5項所述之顯示器，其中該第一掃描訊號之脈衝的起始邊緣係位於該第二控制訊號之脈衝的結束邊緣，或是位於該第二控制訊號之脈衝的結束邊緣之後。
  7. 如申請專利範圍第3項所述之顯示器，其中該第一畫素與該第二畫素係排列在相鄰二列。
  8. 如申請專利範圍第7項所述之顯示器，其中該顯示器還包含一第一訊號線，設置以傳輸該第一控制訊號，該第一畫素與該第二畫素係以該第一訊號線為對稱軸對稱排列，且該第一畫素與該第二畫素係設置以經由該第一訊號線位於該第 一畫素與該第二畫素之間的一區段接收該第一控制訊號。
  9. 一種顯示器，包括：一第一畫素，設置以接收一第二控制訊號，並設置以接收一第一掃描訊號並根據該第一掃描訊號在一第一時段接收該第一畫素的一資料訊號；一第二畫素，設置以接收該第二控制訊號，並設置以在相異於該第一時段的一第二時段接收一第二掃描訊號並根據該第二掃描訊號接收該第二畫素的一資料訊號，且該第一畫素及該第二畫素皆包括一發光二極體與一第二電晶體，其中每一第二電晶體設置以根據該閘極與源極的電壓差而控制流過對應的畫素的該發光二極體的電流大小，且該第二控制訊號係設置以決定是否將該些第二電晶體的閘極電壓重置至一預設電位；以及一驅動電路，電性耦接該第一畫素與該第二畫素，並設置以提供該第一掃描訊號、該第二掃描訊號與該第二控制訊號。
  10. 如申請專利範圍第9項所述之顯示器，其中該第一掃描訊號之脈衝的起始邊緣係位於該第二控制訊號之脈衝的結束邊緣，或是位於該第二控制訊號之脈衝的結束邊緣之後，而該第二掃描訊號之脈衝的起始邊緣係位於該第一掃描訊號之脈衝的結束邊緣，或是位於該第一掃描訊號之脈衝的結束邊緣之後。
  11. 如申請專利範圍第9或10項所述之顯示器，其中該顯 示器還包含一第二訊號線，設置以傳輸該第二控制訊號，該第一畫素與該第二畫素係以該第二訊號線為對稱軸對稱排列。
  12. 一種顯示器的驅動方法，該顯示器具有一第一畫素與一第二畫素，該第一畫素與該第二畫素皆具有一第一電晶體、一第二電晶體及一發光二極體，其中每一第一電晶體設置以根據一第一控制訊號的控制而決定是否允許電流通過對應的畫素的該發光二極體；每一第二電晶體設置以根據其閘極與源極的電壓差而決定流過對應的畫素的該發光二極體的電流大小，該驅動方法包括：透過該第一控制訊號截止該第一畫素及該第二畫素的該第一電晶體，以禁止電流流過該第一畫素與該第二畫素的該發光二極體；在一第一時段驅動該第一畫素，以使該第一畫素接收該第一畫素的一資料訊號；在一相異於該第一時段的一第二時段驅動該第二畫素，以使該第二畫素接收該第二畫素的一資料訊號；以及根據該第一畫素的資料訊號及該第二畫素的資料訊號而分別驅動該第一畫素與該第二畫素發光。
  13. 如申請專利範圍第12項所述之驅動方法，還包含在該第一時段與該第二時段之前，透過一第二控制訊號驅動該第一畫素與該第二畫素，以重置該第一畫素與該第二畫素中之該些第二電晶體的閘極電壓。
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