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KR950003998A - 컴퓨터 시스템과 그의 전력사용 관리방법, 인터럽트 제어기의 베이스 어드레스 상태 확인방법과 씨피유(cpu) 상태 보존 및 복원방법 - Google Patents

컴퓨터 시스템과 그의 전력사용 관리방법, 인터럽트 제어기의 베이스 어드레스 상태 확인방법과 씨피유(cpu) 상태 보존 및 복원방법 Download PDF

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KR950003998A
KR950003998A KR1019940014694A KR19940014694A KR950003998A KR 950003998 A KR950003998 A KR 950003998A KR 1019940014694 A KR1019940014694 A KR 1019940014694A KR 19940014694 A KR19940014694 A KR 19940014694A KR 950003998 A KR950003998 A KR 950003998A
Authority
KR
South Korea
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state
computer system
power
cpu
memory
Prior art date
Application number
KR1019940014694A
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English (en)
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KR0128275B1 (ko
Inventor
리 콤스 제임스
토마스 크럼프 드와이네
테일러 팬코스트 스티븐
Original Assignee
윌리암 티. 엘리스
인터내셔널 비지네스 머신즈 코포레이션
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Family has litigation
First worldwide family litigation filed litigation Critical https://patents.darts-ip.com/?family=22262466&utm_source=google_patent&utm_medium=platform_link&utm_campaign=public_patent_search&patent=KR950003998(A) "Global patent litigation dataset” by Darts-ip is licensed under a Creative Commons Attribution 4.0 International License.
Application filed by 윌리암 티. 엘리스, 인터내셔널 비지네스 머신즈 코포레이션 filed Critical 윌리암 티. 엘리스
Publication of KR950003998A publication Critical patent/KR950003998A/ko
Application granted granted Critical
Publication of KR0128275B1 publication Critical patent/KR0128275B1/ko

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Abstract

본 발명은 정규 동작 상태(normal operating state), 대기 상태(standby state), 중지 상태(suspend state) 및 오프 상태(off state)의 4가지 전력 관리 상태를 갖는 컴퓨터 시스템에 관한 것이다. 대기 상태는 비디오 제어기, 하드 드라이브와 같은 장치가 컴퓨터 시스템에서 실행되는 운영 체제 및 응용 프로그램에 투명한(transparent) 저-전력 모드(low-power mode)에 놓이는 것을 특징으로 한다. 중지 상태는 실행코드가 인터럽트되는 것과 컴퓨터 시스템의 상태가 하드 드라이브에 저장된 후에 시스템 전력이 제거되는 방식으로 컴퓨터 시스템의 상태가 하드 드라이브상의 화일에 보관되는 것을 특징으로 한다. 차후에, 시스템 전력이 복원된 후에, 컴퓨터 시스템의 상태는 하드 드라이브로 부터 판독되고, 로딩되므로써 재시작되며, 이때 운영 체제 및 응용 프로그램에 나쁜 영향을 미치지 않는다. 정규 동작 상태 및 오프 상태는 다수의 통상적인 컴퓨터 시스템의 전형적인 온 및 오프 상태에 대응한다. 중지/재시작/대기 특징은 다수의 표준 구성소자(standard components)를 사용하여 저가(lon cost)로 구현된다.

Description

컴퓨터 시스템과 그의 전력사용 관리방법, 인터럽트 제어기의 베이스 어드레스 상태 확인방법과 씨피유(CPU) 상태 보존 및 복원방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명을 구체화하는 퍼스널 컴퓨터의 사시도.

Claims (36)

  1. 코드(code)가 컴퓨터 시스템에 의해 정상적으로 실행되는 정규 동작 상태(normal operating state) 대기 상태(standby state) 및 중지 상태(suspend state)의 3가지 전력 관리(power management)의 상태중 선택된 하나의 상태에서 동작할 수 있는 상기 컴퓨터 시스템에 있어서, 다수의 사전선택된 이벤트들(preselected events)중 적어도 하나에 응답하여, 상기 컴퓨터 시스템을 각각의 상기 상태와 상기 상태들중 적어도 하나의 다른 상태 사이에서 변경시키기 위한 제어장치(control unit)를 포함하는 컴퓨터 시스템.
  2. 제1항에 있어서, 오프 상태(off state)의 제4전력 관리 상태에서 동작할 수 있는 능력(capability)을 더 포함하며 또한, 상기 제어장치는 다수의 사전선택된 이벤트들(preselected events)중 적어도 하나에 응답하여, 상기 컴퓨터 시스템을 각각의 상태와 상기 상태들중 적어도 하나의 다른 상태 사이에서, 변경시키기 위해 기능(function)하는 컴퓨터 시스템.
  3. 코드가 컴퓨터 시스템에 의해 정상적으로 실행되는 정규 동작 상태, 대기 상태 및 중지 상태의 3가지 전력 관리 상태중 선택된 하나의 상태에서 동작가능한 상기 컴퓨터 시스템에 있어서, 상기 컴퓨터 시스템은; 코드를 실행할 수 있는 CPU와; 다수의 사전선택된 이벤트들중 적어도 하나에 응답하여, 상기 컴퓨터 시스템을 각각의 상기 상태와 상기 상태들중의 적어도 하나의 다른 상태 사이에서 변경시키기 위한, 상기 CPU와 회로 통신하는(in circuit communication with) 제어장치와; 상기 CPU 및 상기 제어 장치와 회로 통신하며, 고 전력 사용 상태(high electrical power usage state)와 저 전력 사용 상태(low electrical power usage state)중 선택된 하나의 상태에서 동작가능하며, 상기 제어 장치에 응답하여 상기 고 및 저 전력 사용상태 사이에서 변경시키는 주변 장치(peripheral device)와; 상기 CPU, 상기 제어 장치 및 상기 주변 장치와 회로 통신하며 외부 소오스(external source)로 부터의 시스템 전력을 상기 컴퓨터 시스템에 선택적으로 제공하기 위한 전력 선택 회로(power selection circuitry)를 포함하며, 제1전원 상태 및 제2전원 상태중 선택된 하나의 상태에서 동작가능하며, 상기 제어 장치에 응답하여 상기 제1 및 제2전원 상태사이에서 변경되는 전원(power supply)을 포함하되, 상기 정규 동작 상태는 상기 전원이 상기 제1전원 상태이며 상기 주변 장치가 상기 고 전력 사용 상태(high electrical usage power supply)인 것을 특징으로 하며; 상기 대기 상태는 상기 전원이 상기 제1전원 상태이며 상기 주변 장치가 상기 저 전력 사용상태(low electrical power usage state)인 것을 특징으로 하는 상기 대기 상태와; 상기 중지 상태는 상기 전원이 상기 제2전원 상태이며, 상기 CPU상에서 실행되는 상기 코드는 상기 전원이 상기 제1전원 상태로 변경된 후에 상기 CPU상의 상기 코드 실행이 재시작될 수 있도록 가역적으로 인터럽트(reversibly interrupt)된 것을 특징으로 하는 컴퓨터 시스템.
  4. 제3항에 있어서, 상기 제1전원 상태는 상기 전력 선택 회로가 상기 외부 소오스로 부터의 시스템 전력을 상기 CPU, 상기 제어장치 및 상기 주변 장치에 제공하는 것을 특징으로 하며; 또한, 상기 제2전원 상태는 상기 외부 소오스로 부터 상기 CPU로의 시스템 전력이 인터럽트되는 것을 특징으로 하는 컴퓨터 시스템.
  5. 제3항에 있어서, 상기 전원은 보조 전력(auxiliary power)을 공급하기 위한 2차 회로(secondary circuitry)를 포함하고; 상기 제1전원 상태는 상기 전력 선택 회로가 시스템 전력을 상기 외부 소오스로 부터 상기 CPU, 상기 제어 장치 및 상기 주변 장치에 제공하는 것을 특징으로 하며; 상기 제2전원 상태는 상기 2차 회로가 보조 전력을 상기 외부 소오스로 부터 상기 제어 장치로 계속 공급하는 동안, 상기 외부 소오스로 부터 상기 CPU로의 시스템 전력이 인터럽트되는 것을 특징으로 하는 컴퓨터 시스템.
  6. 제3항에 있어서, 오프 상태의 제4전력 관리 상태에서 동작할 수 있는 능력을 더 포함하며, 상기 오프 상태는 상기 전원이 상기 제2전원 상태이며 상기 CPU상에서 실행되는 코드는 비가역적으로 인터럽트(irreversibly interrupt)되는 것을 특징으로 하는 컴퓨터 시스템.
  7. 코드가 컴퓨터 시스템에 의해 정상적으로 실행되는 정규 동작 상태, 코드가 상기 컴퓨터 시스템에서 계속 실행중인 상태로서 상기 컴퓨터 시스템은 상기 정규 동작 상태로 동작할 때보다 적은 전력을 소비하는 대기 상태, 그리고 상기 컴퓨터 시스템에 의한 코드 실행이 인터럽트되며 상기 컴퓨터 시스템은 상기 대기상태에서 동작할 때 보다 적은 전력을 소비하는 중지 상태중에서 선택된 하나의 상태에서 동작가능한 상기 컴퓨터 시스템에 있어서, 상기 컴퓨터 시스템은; 코드를 실행할 수 있는 CPU와; 다수의 사전선택된 이벤트들중 적어도 하나에 응답하여, 상기 컴퓨터 시스템을 각각의 상기 상태와 상기 상태들중의 적어도 다른 하나의 다른 상태사이에서 변경시키기 위한, 상기 CPU와 회로 통신하는(in circuit connection with) 제어장치와; 데이타를 수신, 저장 및 전송하기 위한, 상기 CPU 및 상기 제어 장치와 회로 통신하는 비휘발성 저장장치(non-volatile storage unit)와; 메모리 데이타를 저장하기 위한, 상기 CPU, 상기 제어 장치 및 상기 비휘발성 저장장치와 회로 통신하는 휘발성 메모리(volatile memory)와; 상기 CPU, 상기 제어장치, 상기 비휘발성 저장장치 및 상기 휘발성 메모리와 회로 통신하며 레지스터 데이타를 저장하기 위한 휘발성 레지스터들(volatile registers)를 포함하되, 상기 제어 장치는 상기 휘발성 메모리로부터/로 상기 메모리 데이타를 상기 비휘발성 저장장치로/로부터 전송하고, 상기 휘발성 레지스터로부터/로 상기 레지스터데이타를 상기 비휘발성 저장장치로/로부터 전송하여, 상기 컴퓨터 시스템이 상기 중지 상태로 진입하면 상기 메모리 데이타 및 상기 레지스터 데이타를 상기 비휘발성 저장장치에 저장되도록 하고, 상기 컴퓨터 시스템이 상기 정규 동작 상태로 진입하면 상기 비휘발성 저장장치로 부터 상기 휘발성 메모리 및 상기 레지스터 메모리로 전송되도록 하는 컴퓨터 시스템.
  8. 제7항에 있어서, 오프 상태에 제4전력 관리 상태에서 동작할 수 있는 능력을 더 포함하며, 상기 오프 상태는 상기 메모리 데이타 및 레지스터 데이타가 상기 비휘발성 저장장치에 저장되지 않으며, 상기 컴퓨터 시스템은 상기 중지 상태보다 상기 오프 상태에서 전력을 보다 적게 소비하는 컴퓨터 시스템.
  9. 코드가 컴퓨터 시스템에 의해 정상적으로 실행되는 정규 동작 상태, 코드가 상기 컴퓨터 시스템에서 계속 실행중인 상태로서 상기 컴퓨터 시스템은 상기 정규 동작 상태에서 동작할 때보다 적은 전력을 소비하는 대기 상태, 그리고 상기 컴퓨터 시스템에 의한 코드 실행이 인터럽트되며 상기 컴퓨터 시스템은 상기 대기 상태에서 동작할 때보다 적은 전력을 소비하는 중지 상태중에서 선택된 하나의 상태에서 동작가능하며, 중앙 처리 장치(central processing unit), 휘발성 메모리, 시스템 전력을 공급하는 전원(power supply), 밀봉체(enclosure)에서 회전하는 고정 매개체(fixed medium)를 가지는 고정 디스크 저장장치(fixed disk storage), 비디오 신호를 발생하는 비디오 디스플레이 제어기(video display controller), 상기 비디오 신호에 대응하는 시각 이미지(optical image)를 디스플레이하는 비디오 디스플레이 터미날(vodeo display terminal), 비활동 중지 타이머(inactivity suspend timer), 비활동 대기 타이머, 그리고 제1전력 관리 커멘드(first power management command) 및 제2전력 관리 커맨드를 생성할 수 있는 전력 관리 제어기를 포함하는 상기 컴퓨터 시스템에 있어서, 상기 대기 타이머를 시작시켜 제1사전선택된 시간 간격(a first preselected time interval)후 종료하도록 하는 단계와; 상기 중지 타이머를 시작시켜 제2사전선택된 시간간격후 종료하도록 하는 단계와; 상기 제1 및 제2시간 간격중의 하나가 종료할 때까지 상기 컴퓨터 시스템을 상기 정규 동작 상태로 동작시키는 단계와, 상기 대기 타이머 및 중지 타이머를 재시작하므로써 상기 컴퓨터 시스템이 상기 정규 동작 상태에 있는 동안 발생하는 사용자 활동(user activity)에 응답하는 단계와; 상기 컴퓨터 시스템을 상기 정규 동작 상태에서 상기 대기 상태로 변경시켜 상기 컴퓨터 시스템의 정규 동작 동안 상기 제1시간 간격의 종료(expiration)에 응답하는 단계와; 상기 컴퓨터 시스템을 중지 상태로 변경시켜, 상기 제2시간 간격의 종료에 응답하는 단계와; 상기 컴퓨터 시스템을 상기 정규 동작 상태로 변경시켜 상기 컴퓨터 시스템이 상기 대기 상태인 동안 발생되는 사용자 활동에 응답하는 단계와; 상기 대기 타이머를 재시작시키고 상기 컴퓨터 시스템의 상태를 상기 대기 상태에서 상기 정규 동작 상태로 변경하므로써 상기 컴퓨터 시스템이 상기 대기 상태인 동안 발생하는 사용자 활동에 응답하는 단계와; 상기 컴퓨터 시스템이 상기 정규 동작 상태와 대기 상태중 하나의 상태에 있는 동안, 상기 컴퓨터 시스템의 상태를 상기 하나의 상태에서 상기 중지 상태로 변경시키므로써, 제1전력 관리 커맨드 발생에 응답하는 단계와; 상기 컴퓨터 시스템을 상기 정규 동작 상태로 변환시키므로써 상기 컴퓨터 시스템이 상기 중지 상태에 있는 동안 제2전력 관리 커맨드 발생에 응답하는 단계를 포함하는 상기 컴퓨터 시스템의 전력 사용을 관리하는 방법.
  10. 제9항에 있어서, 상기 컴퓨터 시스템은 상기 전력 관리 제어기와 통신하기 위한 순시적 푸시버튼 스위치(momentary pushbutton switch)를 포함하며, 상기 스위치의 패쇄 이벤트(closure event)에 의해 상기 제1 및 제2전력 관리 커맨드를 발생하는 단계를 더 포함하는 컴퓨터 시스템의 전력 사용 관리 방법.
  11. 제9항에 있어서, 상기 컴퓨터 시스템은 전력 관리 제어기와 통신하기 위해 제1스위치 위치(a first switch position)와 제2스위치 위치간에 이동가능한 토글 스위치(toggle switch)를 가지며, 상기 스위치를 상기 제1 및 제2스위치 위치중의 대응하는 하나에 위치시키므로써, 상기 제1 및 제2전력 관리 커맨드를 발생하는 단계를 더 포함하는 컴퓨터 시스템의 전력 사용 관리 방법.
  12. 제9항에 있어서, 상기 컴퓨터 시스템을 상기 정규 동작 상태에서 상기 대기 상태로 변경시켜 상기 컴퓨터 시스템이 상기 정규 동작 상태인 동안 상기 제1시간 간격의 종료에 응답하는 상기 단계는; 상기 비디오 디스플레이 제어기의 상기 비디오 신호 발생을 멈추는 단계와; 상기 고정 디스크 저장장치의 상기 고정 매개체의 회전(rotation)을 정지시키는 단계를 포함하는 컴퓨터 시스템 전력 사용 관리 방법.
  13. 제9항에 있어서, 상기 컴퓨터 시스템을 중지 상태로 변경시켜 상기 제2시간 간격의 종료에 응답하는 상기 단계는; 상기 컴퓨터 시스템의 상태를 확인(ascertaining)하는 단계와; 상기 시스템 상태를 상기 고정 디스크 저장장치에 저장하는 단계와; 상기 전원으로 부터의 시스템 전력 전송을 중지하는 단계를 포함하는 컴퓨터 시스템 전력 사용 관리 방법.
  14. 제13항에 있어서, 상기 컴퓨터 시스템을 상기 정규 동작 상태로 변환하므로써 상기 컴퓨터 시스템이 상기 중지 상태에 있는 동안 제2전력 관리 커맨드의 발생에 응답하는 상기 단계는; 상기 전원으로 부터의 시스템 전력의 전송을 재시작하는 단계와; 단축된 파워-온 셀프-테스트(abbreviated power-on self-test)를 수행하는 단계와; 상기 고정 디스크 저장장치로 부터 상기 저장된 시스템 상태를 판독하는 단계와; 상기 컴퓨터 시스템의 상태를 복원(restoring)하는 단계를 포함하는 컴퓨터 시스템 전력 사용 관리 방법.
  15. 중앙처리장치(CPU), 상기 CPU와 회로 통신하는 메모리 및 상기 CPU와 회로 통신하는 인터럽트 제어기를 구비한 컴퓨터 시스템으로서, 상기 인터럽트 제어기는 CPU와 함께(in coordination with) 다수의 인터럽트 이벤트를 처리할 수 있고, 메모리내에 위치하며 이에 연관된 제1인터럽트 벡터(interrupt vector) 세트와 메모리내에 위치하며 이에 연관된 제1인터럽트 서비스 루틴(interrupt service routine) 세트와, 상기 제1인터럽트 서비스 루틴 세트에 대응하는 하나 또는 그 이상의 베이스 어드레스(base address)를 구비하는 상기 컴퓨터 시스템에 있어서, 제2인터럽트 벡터 세트를 상기 메모리에 기록하는 단계와; 상기 제2인터럽트 벡터 세트로 부터의 하나 또는 그 이상의 상기 인터럽트 벡터들에 각각 대응하는 제2인터럽트 서비스 루틴 세트를 메모리에 기록하는 단계와; 상기 제2인터럽트 벡터 세트로 부터의 하나 또는 그이상의 상기 인터럽트 벡터들에 대응하는 상기 인터럽트 서비스 루틴들중 하나에 의해 서비스(service)될 인터럽트 이벤트(inturrupt event)를 발생시키는 단계와; 상기 인터럽트 제어기와 함께(in coordination with) 상기 CPU내에서 상기 인터럽트 이벤트를 처리(processing)하는 단계와; 상기 제2인터럽트 벡터 세트로 부터의 하나 또는 그이상의 상기 인터럽트 벡터들에 대응하는 상기 인터럽트 서비스 루틴들중 하나로 상기 인터럽트를 서비스하는 단계와; 상기 인터럽트 서비스 단계 후에 상기 메모리의 상태로 부터의 상기 인터럽트 제어기의 하나 또는 그 이상의 베이스 어드레스의 상태를 결정하는 단계를 포함하는 인터럽트 제어기의 하나 또는 그이상의 베이스 어드레스 상태를 확인하는 방법.
  16. 제15항에 있어서, 상기 인터럽트 제어기는 8259인 인터럽트 제어기의 베이스 어드레스 상태 확인방법.
  17. 제15항에 있어서, 상기 인터럽트 제어기는 회로 통신에서 8259에 상당하는 하나 또는 그이상의 회로(one or more circuit equivalents df an 8259)를 포함하는 칩세트(chipset)인 인터럽트 제어기의 베이스 어드레스 상태 확인방법.
  18. 제15항에 있어서, 제2인터럽트 벡터 세트를 상기 메모리에 기록하고 제2인터럽트 서비스 루틴 세트를 상기 메모리에 기록하는 상기 양 단계이전에, 상기 제1인터럽트 벡터 세트 및 상기 제1인터럽트 서비스 루틴 세트를 상기 메모리내의 그들 각각의 위치로부터 상기 메모리내 다른 위치로 복사하는 단계를 더 포함하는 인터럽트 제어기의 베이스 어드레스 상태 확인 방법.
  19. 운영 체제(operating system)및 응용 프로그램(application program)을 실행할 수 있는 BIOS를 구비하는 컴퓨터 시스템에 상기 컴퓨터 시스템은, CPU와; 외부 소오스로 부터 상기 컴퓨터 시스템에 시스템 전력을 선택적으로 제공하기 위한 회로를 구비하며, 제1전원 상태 및 제2전원 상태를 가지는 것을 특징으로 하는 전원과; 상기 CPU와 회로 통신하는 비휘발성 저장장치와; 상기 CPU와 회로 통신하며 메모리 데이타를 저장하기 위한 휘발성 시스템 메모리와; 상기 CPU와 회로 통신하며 레지스터 데이타를 저장하기 위한 휘발성 시스템 레지스터들과; 상기 CPU와 회로 통신하며 사전선택된 중지 이벤트에 응답하여 상기 컴퓨터 시스템의 상태를 정규 동작 상태와 중지 상태사이에서 선택적으로 변경시키는 제어 장치를 포함하되, 상기 정규 동작 상태는 상기 전원이 상기 제1전원 상태이며 상기 컴퓨터 시스템은 사용자 커맨드 혹은 상기 운영 체제 혹은 상기 BIOS에 응답하여 상기 응용 프로그램을 실행할 수 있는 것을 특징으로 하고, 상기 중지 상태는 상기 레지스터 데이타 및 메모리 데이타가 상기 비휘발성 저장장치상에 저장되며 상기 전원이 상기 제2전원 상태인 것을 특징으로 하고, 상기 정규 동작 상태와 상기 중지 상태간의 변경은, 상기 제어 장치가 상기 사전선택된 중지 이벤트에 응답하여, 상기 메모리 데이타 및 상기 레지스터 데이타를 상기 시스템 메모리와 상기 시스템 레지스터들과 상기 비휘발성 저장장치 간에 복사하는 것을 포함하고, 상기 전원은 상기 제어 장치에 응답하여 상기 전원 상태들 사이에서 변경되고, 상기 정규 동작 상태와 상기 중지 상태간에 상기 변경은, 상기 제어 장치가 상기 사전선택된 중지 이벤트에 응답하여, 상기 전원을 상기 제1전원 상태와 상기 제2전원 상태사이에서 각각 변경시키는 것을 더 포함하는 컴퓨터 시스템.
  20. 제19항에 있어서, 상기 제1전원 상태는 상기 전원이 시스템 전력을 외부 소오스로 부터 상기 컴퓨터 시스템에 제공하는 것을 특징으로 하고; 상기 제2전원 상태는 상기 전원이 상기 시스템 전력을 상기 외부 소오스로 부터 상기 컴퓨터 시스템에 제공하지 않는 것을 특징으로 하는 컴퓨터 시스템.
  21. 제19항에 있어서, 상기 전원은 보조 전력(anxiliary power)을 상기 컴퓨터 시스템에 제공하기 위한 회로를 더 포함하고; 상기 제1전원 상태는 상기 전원이 시스템 전력 및 보조 전력을 상기 외부 소오스로 부터 상기 컴퓨터 시스템에 제공하는 것을 특징으로 하고; 상기 제2전원 상태는 상기 전원이 시스템 전력을 상기 외부 소오스로 부터 상기 컴퓨터 시스템에 제공하지 않고, 보조 전력을 상기 외부 소오스로 부터 상기 컴퓨터 시스템에 제공하는 것을 특징으로 하는 컴퓨터 시스템.
  22. 제19,20 혹은 21항에 있어서, 상기 비휘발성 저장장치는 고정 디스크 저장장치인 컴퓨터 시스템.
  23. 제19,20 혹은 21항에 있어서, 상기 비휘발성 저장장치는 배터리-지원 판독 전용 메모리(battery-backed read only memory)인 컴퓨터 시스템.
  24. 제19항에 있어서, 사전선택된 시간주기후에 종료하도록 세트된 비활동 중지 타이머를 더 포함하며; 상기 사전선택된 중지 이벤트는 상기 비활동 중지 타이머의 종료를 포함하는 컴퓨터 시스템.
  25. 제19항에 있어서, 상기 CPU와 회로 통신하며, 눌려지는 것에 응답하여 패쇄 이벤트(closure event)를 발생하는 순시 푸시버튼 스위치를 더 포함하며; 상기 사전선택된 중지 이벤트는 상기 스위치의 패쇄 이벤트를 포함하는 컴퓨터 시스템.
  26. 제19항에 있어서, 상기 CPU와 회로 통신하며, 눌려지는 것에 응답하여 패쇄 이벤트를 발생하는 순시 푸시버튼 스위치를 더 포함하며; 상기 CPU상에 실행되는 코드(code)에 의해 조작가능(manipulable)한 제1플래그 상태 및 제2플래그 상태를 갖는 조작가능 플래그를 더 포함하고; 하나 또는 그 이상의 상기 사전선택된 중지 이벤트들은 상기 제1플래그 상태에 있는 동안 상기 스위치의 패쇄 이벤트를 포함하는 컴퓨터 시스템.
  27. 메모리 데이타를 저장하기 위한 시스템 메모리와; 비휘발성 저장장치와; 코드의 인스트럭션(instruction) 상기 시스템 메모리내 부적절한 영역을 액세스 하려고 한다든지 혹은 인스트럭션이 특권 인스트럭션(privileged instruction)을 실행하고자 하는 경우 CPU가 보호 폴트(protection fault)를 발생시키도록 하는 보호 모드에서 상기 코드를 실행할 수 있으며, 보호 폴트의 발생없이 상기 시스템 메모리의 선택된 영역에 기록가능하도록 허용하고 특권 인스트럭션의 실행을 허용하는 비폴트(non-fault)모드에서 실행할 수 있으며, 상기 시스템 메모리에 스택(stack)을 생성하며, 레지스터값을 저장하기 위한 휘발성 레지스터들을 포함하는 상기 CPU와; ROM내의 BIOS와; 상기 BIOS가 복사되어 실행되는 섀도우 RAM과; 상기 CPU상에서의 코드 실행을 인터럽트할 수 있고 중지 이벤트에 응답하여 중지 루틴을 호출할 수 있는 운영체제와; 하나 또는 그이상의 사전선택된 조건에 응답하여 중지 이벤트를 발생하는 제어 루틴을 포함하되, 상기 중지 루틴은 상기 운영 체제에 의해 선택적으로 호출가능하며, 또한 보호 폴트의 발생없이 상기 레지스터 값들을 상기 CPU로 부터 상기 스택 혹은 상기 섀도우 RAM중 어느 하나에 전송하는 능력과; 상기 CPU를 비-폴트 모드에 두는 능력과; 상기 레지스터 값들을 상기 스택 혹은 상기 섀도우 RAM의 어느 하나로 부터 상기 비휘발성 저장장치로 전송하는 능력을 갖는 것을 특징으로 하는 컴퓨터 시스템에 있어서, 중지 이벤트에 응답하여 상기 운영 체제로 코드 실행중인 상기 CPU상의 상태를 인터럽트하는 단계와; 상기 중지 루틴을 활성화시키는 단계와; 상기 레지스터 값들을 상기 섀도우 RAM내 혹은 상기 스택에 일시적으로 저장하는 단계와; 상기 섀도우 RAM 혹은 상기 스택의 어느 하나로부터 상기 레지스터 값들을 상기 비휘발성 저장장치로 복사하는 것이 상기 CPU내에서 보호 폴트를 발생시키지 않는 것을 특징으로 하는 비-폴트 모드(non-fault mode)로 상기 CPU를 두는 단계와; 상기 레지스터 값들을 상기 스택 혹은 상기 섀도우 RAM으로 부터 비휘발성 저장장치에 전송하는 단계를 포함하는 보호 모드에서 코드를 실행중인 CPU의 상태를 보존(preserve the state of the CPU)하는 방법.
  28. 메모리 데이타를 저장하기 위한 시스템 메모리와; 비휘발성 저장장치와; 코드의 인스트럭션이 상기 시스템 메모리내 부적절한 영역을 액세스하려고 한다든지 혹은 인스트럭션이 특권 인스트럭션을 실행하고자 하는 경우 CPU가 보호 폴트를 발생시키도록 하는 보호 모드에서 상기 코드를 실행할 수 있으며 보호 폴트의 발생없이 상기 시스템 메모리의 선택된 영역에 기록하도록 허용하고 특권 인스트럭션의 실행을 허용하는 비폴트 모드에서 실행할 수 있으며, 상기 시스템 메모리내 스택을 생성하며, 레지스터값을 저장하기 위한 휘발성 레지스터들을 포함하는 상기 CPU와; ROM내의 BIOS와; 상기 BIOS가 복사되어 실행되는 섀도우 RAM과; 상기 CPU상에서의 코드 실행을 복원(restore)할 수 있고 재시작 이벤트(resume event)에 응답하여 재시작 루틴을 호출할 수 있는 운영 체제와; 하나 또는 그이상의 사전선택된 조건에 응답하여 재시작 이베트를 발생하는 제어 루틴을 포함하되, 상기 재시작 루틴은 선택적으로 상기 운영 체제에 의해 호출가능하며, 또한 상기 CPU를 비폴트 모드에 두는 능력과; 상기 비휘발성 저장장치로 부터 상기 CPU의 상기 레지스터값들을 상기 스택 혹은 상기 섀도우 RAM으로 전송하는 능력과; 상기 CPU를 폴트 모드에 두는 능력과; 상기 스택 혹은 상기 섀도우 RAM중 어느 하나로 부터의 상기 레지스터값들을 보호 폴트의 발생없이 전송하는 능력을 갖는 것을 특징으로 하는 컴퓨터 시스템에 있어서, 재시작 이벤트에 응답하여 상기 재시작 루틴을 활성화시키는 단계와; 상기 CPU를 비폴트 모드에 두되, 상기 비폴트 모드는 상기 레지스터값을 상기 비휘발성 저장장치로 부터 상기 섀도우 RAM이나 혹은 상기 스택의 어느 하나에 복사하는 것이 상기 CPU내에서 보호 폴트를 발생하지 않는 것을 특징으로 하는 단계와; 상기 CPU의 상기 레지스터값들을 상기 비휘발성 저장장치로 부터 상기 스택이나 혹은 상기 섀도우 RAM의 어느 하나로 전송하는 단계와; 상기 섀도우 RAM내 상기 BIOS는 CPU 페이징(CPU paging)이 활성화된 직후에 액세스될 수 있는 것을 특징으로 하는 페이지 테이블 세트(a set of page tables)를 상기 섀도우 RAM으로 로딩(loding)하는 단계와; 상기 CPU를 폴트 모드로 두는 단계와; 상기 레지스터값들을 상기 스택이나 혹은 상기 섀도우 RAM으로 부터 상기 CPU로 전송하는 단계와; 상기 운영 체제와 함께 상기 CPU상에서 상기 인터럽트된 코드 실행을 재시작하는 단계를 포함하는 비휘발성 메모리로 부터 CPU 상태를 복원하는 방법.
  29. 제27 혹은 28항에 있어서, 상기 섀도우 RAM은 선형 어드레스(linear addresses)가 물리적 어드레스(physical address)와 동일한 시스템 메모리 부분에서 동작하는 CPU 상태 보존 및 복원 방법.
  30. 제27 혹은 28항에 있어서, 상기 CPU를 상기 비-폴트 모드에 두는 상기 단계는 상기 CPU를 리세팅하는 단계를 포함하는 CPU 상태 보존 및 복원 방법.
  31. 제27 혹은 28항에 있어서, 상기 운영 체제는 고급 전력 관리 명세(Advanced Power Management specification)를 따르는 CPU 상태 보존 및 복원 방법.
  32. 제27 혹은 28항에 있어서, 상기 비휘발성 저장장치는 고정 디스크 저장장치인 CPU 상태 보존 및 복원 방법.
  33. 제27 혹은 28항에 있어서, 상기 CPU는 386 혹은 486 마이크로프로세서 계열의 일원(member)인 CPU 상태 보존 및 복원 방법.
  34. 코드가 컴퓨터 시스템에 의해 정상적으로 실행되는 정규 동작 상태, 오프 상태 및 중지 상태의 3가지 전력 관리 상태중에서 선택된 한 상태에서 동작할 수 있는 상기 컴퓨터 시스템에 있어서, 상기 컴퓨터 시스템은, 스위치와; 코드를 실행할 수 있는 CPU와; 다수의 사전선택된 이벤트들중 적어도 하나에 응답하여, 상기 컴퓨터 시스템을 각각의 상기 상태와 상기 상태들중 적어도 하나의 다른 상태사이에서 변경시키기 위한, 상기 CPU 및 상기 스위치와 회로 통신하는 제어 장치와; 상기 CPU상에서 실행되는 코드에 응답하여 다수의 사전선택된 플래그 상태들중 하나를 추정(assume)할 수 있는 상기 CPU 및 상기 제어 장치와 회로 통신할 수 있는 플래그와; 상기 CPU 및 상기 제어 장치와 회로 통신하며, 시스템 전력을 외부 소오스로 부터 상기 컴퓨터 시스템에 선택적으로 제공하기 위한 전력 선택 회로를 포함하되, 제1전원 상태 및 제2전원 상태중 하나의 상태에서 동작가능하며, 상기 제어 장치에 응답하여 상기 제1 및 제2전원 상태사이에서 변경시키는 전원을 포함하되, 상기 정규 동작 상태는 상기 전원이 상기 제1전원 상태이고 코드가 상기 CPU상에서 정상적으로 실행되는 것을 특징으로 하며; 상기 중지 상태는 상기 전원이 상기 제2전원 상태이며, 상기 CPU상에서 실행되는 상기 코드는 상기 전원이 상기 제1전원 상태로 변경된 후에 상기 CPU상의 상기 코드 실행이 재시작될 수 있도록 가역적으로 인터럽트된 것을 특징으로 하며; 상기 오프상태는 상기 전원이 상기 제2전원 상태이며 상기 CPU상에서 실행되는 상기 코드가 비가역적으로(irreversibly) 인터럽트된 것을 특징으로 하는 컴퓨터 시스템.
  35. 제34항에 있어서, 상기 스위치는 순시 푸시버튼 스위치이며; 상기 플래그의 상태가 상기 플래그 상태중 제1상태인 경우, 상기 제어 장치는 상기 스위치의 패쇄 이벤트에 응답하여 상기 컴퓨터 시스템을 상기 정규 동작 상태과 상기 오프 상태 사이에서 변경시키고; 상기 플래그의 상태가 상기 플래그 상태중 제2상태인 경우, 상기 제어 장치는 상기 스위치의 패쇄 이벤트에 응답하여 상기 컴퓨터 시스템을 상기 정규동작 상태와 상기 중지 상태사이에서 변경시키는 컴퓨터 시스템.
  36. 제34항에 있어서, 상기 스위치는 제1스위치 위치와 제2스위치 위치사이에서 이동가능한 토글 스위치이며; 상기 플래그의 상기 플래그 상태중 제1상태인 경우, 상기 제어 장치는 상기 스위치가 상기 제1스위치 위치에 진입(enter)한 것에 응답하여 상기 컴퓨터 시스템을 상기 정규 동작 상태에서 상기 오프 상태로 변경시키며; 상기 플래그가 상기 플래그 상태중 제1상태인 경우, 상기 제어 장치는 상기 스위치가 상기 제2스위치 위치로 진입한 것에 응답하여 상기 컴퓨터 시스템을 상기 오프 상태에서 상기 정규 동작상태로 변경시키며 상기 플래그가 상기 플래그 상태중 제2상태인 경우, 상기 제어 장치는 상기 스위치가 상기 제1스위치 위치에 진입한 것에 응답하여 상기 컴퓨터 시스템을 상기 정규 동작 상태에서 상기 중지상태로 변경시키며; 상기 플래그가 상기 플래그 상태중 제2상태인 경우, 상기 제어 장치는 상기 스위치가 상기 제2스위치 상태에 진입한 것에 응답하여 상기 컴퓨터 시스템을 상기 중지 상태에서 상기 정규 동작상태로 변경시키는 컴퓨터 시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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