KR930014074A - 다중-채널 직접메모리 억세스(dma)동작을 인터리브하기 위한 장치 및 그 방법 - Google Patents
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Abstract
Description
Claims (11)
- 소정의 채널 인터리브 크기를 각각 갖추고, 전송 자원을 이용하는 복수의 DMA 채널에 데이타를 전송하는 방법에 있어서, 상기 전송 자원을 이용하므로서 데이타의 제1넘버를 전송하도록 제1DMA 채널을 제공하는 단계; 상기 제1넘버를 상기 제1DMA채널의 제1소정의 채널 인터리브크기와 비교하는 단계; 상기 제1넘버가 상기 제1소정의 채널 인터리브 크기 이하이면 상기 전송 자원을 이용하여 상기 제1채널을 통해서 데이타의 상기 제1넘버를 전송하는 단계; 데이타의 상기 제1넘버를 상기 제1소정의 채널 인터리브 크기보다 크지 않은 복수의 슬라이스로 분할하는 단계; 상기 전송자원을 이용하여 상기 제1DMA 채널에 데이타의 각각의 슬라이스를 전송하는 단계; 제2DMA 채널이 상기 전송자원의 제어를 갖추고 있는지의 여부를 결정하도록 상기 제1DMA채널에서 데이타의 각각의 슬라이스 이후에 질의하는 단계; 상기 제2DMA 채널이 제어를 갖추고 있지 않으면 상기 전송-자원을 이용하여 상기 제1DMA 채널에서 데이타의 슬라이스를 계속 전송하는 단계; 및 상기 전송 자원의 제어를 상기 제2DMA채널에 전송하고, 이에 따라 상기 제2DMA채널은 데이타를상기 전송자원을 통해 전송하고 각각의 슬라이스 후에 질의하는 단계;로 구성한 것을 특징으로 하는 데이타 전송방법.
- 제1항에 있어서, 상기 전송 자원을 통해서 상기 제1DMA채널에 전송된 데이타의 제2넘버를 계수하는 단계; 상기 제2넘버를 상기 제1넘버와 비교함으로서 상기 제2DMA 채널이 데이타의 상기 제1넘버를 완결했는지의 여부를 결정하는 단계;및 상기 제2넘버가 상기 제1넘버와 동일하면, 채널 인터리브 크기가 상기 제1DMA 채널에 도달할때까지 대기하지 않고 상기 전송자원의 제어를 상기 제2DMA채널에 전송하여 제어가 다음 DMA 채널에 용이하게 전송되는 단계;를 추가로 포함하는 것을 특징으로 하는 데이타 전송방법.
- 제2항에 있어서, 질의하는 단계는 상기 전송자원을 이용하기 위하여 복수의 DMA 채널로 부터 요구를 수신하는 단계; 소정의 우선 계획에 따라 상기 요구들 사이에 아비트레이트 하는 단계; 및 상기 제1DMA 채널에서 데이타의 상기 슬라이스 후에 가장 높은 우선이 전송되어 상기 전송 자원의 제어가 요구에 부여되는 단계;로 구성된 것을 특징으로 하는 데이타 전송방법.
- 제2항에 있어서, 상기 제1DMA 채널에서 전송의 각각의 슬라이스 후에 상기 실의하는 단계를 억재하는 단계; 그리고 상기 전송자원의 제어를 상기 제2DMA 채널에 전송하지 않고 상기 제1DMA채널에 남아 있는 슬라이스를 계속 전송하는 단계;를 추가로 포함하는 것을 특징으로 하는 데이타 전송방법.
- 제2항에 있어서, 상기 제1DMA 채널이 상기 전송자원의 제어를 갖추고 있지 않고, 그 전송을 완전할 수 없으면, 상기 제어를 다음 DMA 채널에 전송하는 단계를 추가로 포함하는 것을 특징으로 하는 데이타 전송방법.
- 전송자원을 통해서 소정의 채널 인터리브 크기를 갖춘 복수의 DMA 채널에 전송데이타를 인터리브하는 장치에 있어서, 제1채널에 대해서 전송되는 데이타의 총 넘버인 총 전송계수를 상기 제1채널로부터 수신하기 위해 상기 전송 자원에 접속된 수신수단; 상기 총 전송계수가 상기 제1채널의 상기 소정의 채널 인터리브 크기보다 큰지의 여부를 결정하기 워해 상기 수신수단에 접속된 제어수단; 상기 제1채널로부티, 상기 총 전송계수가 상기 소정의 채널 인터리브크기보다 크면 상기 제1채널을 위한 상기 소정의 채널 인터리브크기 이하인 복수의 슬라이스 내로상기 데이타를 슬라이스하기 위해 상기 제어수단에 접속되는 데이타슬라이스수단; 상기 제1채널에 상기 복수의 슬라이스를 전송하는 전송수단; 상기 전송자원을 통해서 각각의 상기 DMA채널에 이미 전송된 데이타넘버인 각각의 상기 DMA 채널을 위한 현행 전송계수를 유지하기 위해 상기 전송수단에 접속된 제1계수 수단; 상기 제1채널이 전송되어서 상기 전송수단이 상기 제2재널에 연결되는것으로부터 슬라이스후에 제2채널이 상기 전송자원상에 제어를 갖추고 있는지의 여부를 결정하기 위해 상기 제1 계수 수단에 접속된 질의 수단; 및 상기 제1채널을 위한 상기 총 전송계수가 상기 제1채널을 위한 상기 현행 전송계수와 동일한지의 여부를 결정하기 위하여, 그리고 만일 동일하다면 상기 전송자원을 상기 제2재널에 접속하여 모든 데이타가 이미 전송되었을 그 채널 인터리브 크기를 마무리하도록 상기 제2채널이 상기 제1채널을 대기할 필요가 없는, 상기 전송수단에 접속뒨 제2계수 수단:으로 구성된 것을 특징으로 하는 전송 데이타를 인터리브하는 장치.
- 제6항에 있어서, 소겅의 우선 계획에 따라 상기 DMA 채널들중의 어느 하나가 상기 전송자원의 제어를 획득하는 것을 결정하는 아비트레이트 수단; 및 동일한 DMA 채널이 상기 전송자원의 제어를 계속 갖추는 것을 허용하도록 상기 아비트레이트 수단을 억제하는 아비트레이트 억제수단;을 추가로 포함하는 것을 특징으로 하는 데이타를 인터리브하는 장치.
- 제7항에 있어서, 만약 상기 전송자원을 제어하는 제1DMA채널이 소정 주기 시간이 지난후 그 동작을 완결할수 없을 경우 상기 전송 자원의 제어를 제2DMA채널에 전송하는 스킵 수단을 추가로 포함하는 것을 특징으로하는 전송 데이타를 인터리브하는 장치.
- 제1DMA채널이 전송자원을 통해 데이타의 제1넘버를 전송하고, 각각이 소정의 채널 인터리브크기를 갖춘 다수의 DMA 채널에 데이타를 전송하는 장치에 있어서, 상기 재1넘버가 상기 소정의 제1채널 인터리브 크기보다작거나 같은가를 결정하며, 만약 그렇다면 상기 전송자원을 이용해서 상기 제1채널을 통해 데이타의 상기 제1넘버를 전송하기 위해 상기 제1DMA 채널의 소정의 제1채널 인터리브 크기를 상기 제1넘버와 비교하는 비교수단; 각각이 소정의 상기 제1채널 인터리브크기보다더 크지 않은 다수의 슬라이스로 데이타의 상기 제1넘버를 분할하는 데이타 분할 수단: 상기 전송자원을 이용해서 상기 제1DMA 채널의 데이타의 각 슬라이스를 전송하는 데이타전송수단; 제2DMA 채널이 상기 전송자원을 제어하는가를 결정하며, 만약 그렇다면 상기 전송자원을 이용해서 상기 제1DMA 채널에서 데이타의 슬라이스를 전송하기 위해 상기 제1DMA 채널에서 데이타의 각 슬라이스 후에 질의하는 질의 수단: 및 상기 제2DMA 채널로의 상기 전송자원의 제어를 해제함으로써 상기 제2DMA 채널이상기 전송자원을 통해 데이타를 전송해서 각 슬라이스 후에 질의하는 제어수단;으로 구성되는 것을 특징으로하는 데이타 전송장치.
- 제9항에 있어서, 상기 전송자원을 통해 상기 재1DMA 채널에서 전송되는 데이타의 제2넘버를 계수하는 계수수단; 상기 제1DMA채널이 상기 제2넘버를 제1넘버와 비교함으로써 데이타의 상기 제1넘버를 완결하는지를 결정하는 수단; 제어가 손쉽게 다음 요구 DMA 채널로 전송되도록 만약 상기 제2넘버가 제1넘버와 동일하다면 상기 제1DMA 채널에 채널 인터리브 크기에 도달할때까지 대기없이 상기 전송자원의 제어를 해제하는 수단;을 추가로 포함하는 것을 특징으로 하는 데이타 전송장치.
- 제10항에 있어서, 상기 DMA 채널중 어떤 것이 소정의 우선계획에 기초한 상기 전송자원의 제어를 획득하는가를 결정하는 아비트레이트 수단을 추가로 포함하는 것을 특징으로 하는 데이타 전송장치.※ 참고사항 : 최초출원 내용에 의하여 공개되는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
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US814,766 | 1991-12-30 |
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Publication Number | Publication Date |
---|---|
KR930014074A true KR930014074A (ko) | 1993-07-22 |
KR960006503B1 KR960006503B1 (ko) | 1996-05-16 |
Family
ID=25215954
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Application Number | Title | Priority Date | Filing Date |
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KR1019920026619A Expired - Fee Related KR960006503B1 (ko) | 1991-12-30 | 1992-12-30 | 다중-채널 직접메모리 억세스(dma)동작을 인터리브하기 위한 장치 및 그 방법 |
Country Status (5)
Country | Link |
---|---|
US (1) | US5388237A (ko) |
EP (1) | EP0550164B1 (ko) |
JP (1) | JP3271125B2 (ko) |
KR (1) | KR960006503B1 (ko) |
DE (1) | DE69225463T2 (ko) |
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- 1992-12-07 DE DE69225463T patent/DE69225463T2/de not_active Expired - Fee Related
- 1992-12-28 JP JP35881492A patent/JP3271125B2/ja not_active Expired - Fee Related
- 1992-12-30 KR KR1019920026619A patent/KR960006503B1/ko not_active Expired - Fee Related
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Publication number | Publication date |
---|---|
EP0550164A1 (en) | 1993-07-07 |
KR960006503B1 (ko) | 1996-05-16 |
DE69225463T2 (de) | 1998-12-24 |
EP0550164B1 (en) | 1998-05-13 |
DE69225463D1 (de) | 1998-06-18 |
JPH06266650A (ja) | 1994-09-22 |
US5388237A (en) | 1995-02-07 |
JP3271125B2 (ja) | 2002-04-02 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
PA0109 | Patent application |
Patent event code: PA01091R01D Comment text: Patent Application Patent event date: 19921230 |
|
PG1501 | Laying open of application | ||
A201 | Request for examination | ||
PA0201 | Request for examination |
Patent event code: PA02012R01D Patent event date: 19931230 Comment text: Request for Examination of Application Patent event code: PA02011R01I Patent event date: 19921230 Comment text: Patent Application |
|
G160 | Decision to publish patent application | ||
PG1605 | Publication of application before grant of patent |
Comment text: Decision on Publication of Application Patent event code: PG16051S01I Patent event date: 19960424 |
|
E701 | Decision to grant or registration of patent right | ||
PE0701 | Decision of registration |
Patent event code: PE07011S01D Comment text: Decision to Grant Registration Patent event date: 19960730 |
|
GRNT | Written decision to grant | ||
PR0701 | Registration of establishment |
Comment text: Registration of Establishment Patent event date: 19961007 Patent event code: PR07011E01D |
|
PR1002 | Payment of registration fee |
Payment date: 19961007 End annual number: 3 Start annual number: 1 |
|
PR1001 | Payment of annual fee |
Payment date: 19990716 Start annual number: 4 End annual number: 4 |
|
PR1001 | Payment of annual fee |
Payment date: 20000513 Start annual number: 5 End annual number: 5 |
|
PR1001 | Payment of annual fee |
Payment date: 20010511 Start annual number: 6 End annual number: 6 |
|
PR1001 | Payment of annual fee |
Payment date: 20020508 Start annual number: 7 End annual number: 7 |
|
PR1001 | Payment of annual fee |
Payment date: 20030512 Start annual number: 8 End annual number: 8 |
|
FPAY | Annual fee payment |
Payment date: 20040507 Year of fee payment: 9 |
|
PR1001 | Payment of annual fee |
Payment date: 20040507 Start annual number: 9 End annual number: 9 |
|
LAPS | Lapse due to unpaid annual fee | ||
PC1903 | Unpaid annual fee |