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KR920009127A - 메시지 송수신 장치 및 방법 - Google Patents

메시지 송수신 장치 및 방법 Download PDF

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Publication number
KR920009127A
KR920009127A KR1019900016052A KR900016052A KR920009127A KR 920009127 A KR920009127 A KR 920009127A KR 1019900016052 A KR1019900016052 A KR 1019900016052A KR 900016052 A KR900016052 A KR 900016052A KR 920009127 A KR920009127 A KR 920009127A
Authority
KR
South Korea
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message
transmission
receiving
processor
fifo
Prior art date
Application number
KR1019900016052A
Other languages
English (en)
Other versions
KR930008501B1 (ko
Inventor
백영식
이영희
이현태
강영만
김종문
Original Assignee
경상현
재단법인 한국전자통신연구소
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 경상현, 재단법인 한국전자통신연구소 filed Critical 경상현
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내용 없음

Description

메시지 송수신 장치 및 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 의한 메시지 송수신 장치의 구성을 나타낸 블럭도,
제2도는 본 발명에 의하 메시지 수신처리 방법의 흐름도.

Claims (3)

100Mbits/sec 이상의 고속으로 메시지를 전송하는 다증폭 메시지 송수신 장치에 있어서, 메시지를 송수신하기 위해 처리하는 프로세스(100), 상기 프로세스(100)에 연결되어 상기 프로세서(100)로부터 메시지의 시작과 끝을 나타내는 제어 비트를 저장하는 송신 TAG수단(110a), 상기 송신 TAG수단(110a) 및 프로세서(100)에 연결되고 다중의 송신 FIFO로 구성되어 상기 송신 TAG수단(110a)으로부터의 제어비트와 프로세서(100)로부터의 송신메시지를 저장하는 송신 FIFO수단(130a), 상기 송신 FIFO수단(130a)에 연결되어 상기 송신 메시지 및 제어비트를 전송하는 송신수단(140a)과, 상기 송신수단(140a) 및 송신 FIFO 수단(130a)에 연결되어 상기 송신 FIFO수단(130a)의 메시지를 차례로 선택하여 송신하는 송신 제어수단(120a), 상기 프로세서(100)에 연결되어 상기 프로세서(100)가 읽는 수신 메시지중 메시지의 시작과 끝을 나타내는 제어비트를 저장하는 수신 TAG수단(110b), 상기 수신 TAG수단(110b) 및 상기 프로세서(100)에 연결되고 다중의 수신 FIFO로 구성되어 상기 수신 TAG수단(110b)으로 보낼 제어비트와 상기 프로세서(100)로 보낼 수신메시지를 저장하는 수신 FIFO 수단(130b)와, 상기 수신 FIFO 수단(130b)에 연결되어 상기 수신 메시지 및 제어비트를 수신하는 수신수단(140b), 및 상기 수신수단(140b) 및 수신 FIFO수단(130b)에 연결되어 상기 수신 FIFO수단(130b)에 상기 수신 메시지를 차례로 선택하여 분배하는 수신제어수단(120b)으로 구성되는 것을 특징으로 하는 메시지 송수신 장치.
제1항에 있어서, 상기 송수신 TAG수단(110a,110b)은 읽고 쓸수있는 레지스터로 구성되어 상기 메시지의 시작과 끝을 알리는 제어비트의 값을 사용자가 임의로 정의할수 있는 것을 특징으로 하는 메시지 송수신 장치.
메시지를 송수신하기 위해 처리하는 프로세서(100), 상기 프로세서(100)에 연결되어 상기 프로세서(100)로부터 메시지의 시작과 끝을 나타내는 제어비트를 저장하는 송신 TAG수단(100a), 상기 송단 TAG수단(100a) 및 프로세서(100)에 연결되고 다중의 송신 FIFO로 구성되어 상기 송신 TAG수단(110a)으로부터의 제어비트와 프로세서(100)로부터의 송신메시지를 저장하는 송신 FIFO 수단(130a) 상기 송신 FIFO수단(130a)에 연결되어 상기 송신 메시지 및 제어비트를 전송하는 송신수단(140a), 상기 송신수단(140a) 및 송신 FIFO수단(130a)에 연결되어 상기 송신FIFO수단(130a)의 메시지를 차례로 선택하여 송신하는 송신제어수단(120a), 상기 프로세서(100)에 연결되어 상기 프로세서(100)가 읽는 수신메시지중 메시지의 시작과 끝을 나타내는 제어비트를 저장하는 수신TAG수단(110b), 상기 수신 TAG수단(110b) 및 상기 프로세서(100)에 연결되고 다중의 수신 FIFO로 구성되어 상기 수신 TAG수단(110b)으로 보낼 제어비트와 상기 프로세서(100)로 보낼 수신 메시지를 저장하는 수신 FIFO수단(130b), 상기 수신 FIFO수단(130b)에 연결되어 상기 수신 메시지 및 제어비트를 수신하는 수신수단(140b), 및 상기 수신수단(140b) 및 수신 FIFO 수단(130b)에 연결되어 상기 수신 FIFO수단(130b)에 상기 수신 메시지를 차례로 선택하여 분배하는 수신제어 수단(120b)으로 구성된 메시지 송수신 장치의 메시지 송수신 방법에 있어서;상기 메시지를 송신하기 위해 메시지의 시작을 나타내는 제어비트를 상기 송신 TAG수단(110a)에 저장하고 메시지의 처음을 송신하는 제1단계, 상기 송신 TAG수단(110a)에 보통의 바이트표시를 하고 마지막 메시지가 나올때까지 메시지의 바이트를 상기 송신 FIFO 수단(130a)에 쓰는 제2단계, 마지막 메시지에 도달하면 송신 TAG수단(110a)에 메시지의 마지막을 나타내는 제어비트를 상기 송신 TAG수단(110a)에 저장하고 마지막 바이트를 송신 FIFO 수단(130a)에 저장하므로써 하나의 메시지를 송신하는 제3단계, 상기 메시지를 수신하기 위해 상기 수신FIFO수단(130b)의 상태를 점검하는 제4단계, 수신된 메시지가 있으면 상기 수신 FIFO수단(130b)의 메시지를 읽고 수신된 제어비트를 점검하는 제5단계, 및 수신된 제어비트가 메시지 시작을 알리는 값이면 마지막을 알리는 제어비트가 검출될때까지 수신 FIFO수단(130b)의 메시지를 읽는 제6단계에 의해 수행되는 것을 특징으로 하는 송수신 방법.
※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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