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KR100457522B1 - 플라즈마 디스플레이 패널의 전력 회수 장치 및 방법 - Google Patents

플라즈마 디스플레이 패널의 전력 회수 장치 및 방법 Download PDF

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KR100457522B1
KR100457522B1 KR10-2002-0031293A KR20020031293A KR100457522B1 KR 100457522 B1 KR100457522 B1 KR 100457522B1 KR 20020031293 A KR20020031293 A KR 20020031293A KR 100457522 B1 KR100457522 B1 KR 100457522B1
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inductor
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energy
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노정욱
이상훈
김혜정
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삼성전자주식회사
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Abstract

본 발명은 플라즈마 디스플레이 패널 구동 장치 및 방법에 관한 것으로서, 특히 단일의 에너지 축적 소자 및 비교적 적은 수의 소자로 화면 상태에 따라서 도통되는 픽셀의 수에 관계없이 향상된 전력 회수 효율을 갖는 플라즈마 디스플레이 패널의 전력 회수 장치 및 방법에 관한 것이다.
본 발명에 의하면 전력 회수 회로의 에너지 축적 소자로 실제 구현 가능한 용량의 인덕터만을 이용하여 전력 회수 회로를 설계함으로써, 종래의 기술에 비하여 전력 회수 회로의 구성이 간단해지는 효과가 발생되며, 도통되는 어드레스 전극 수가 증가되더라도 전력 회수를 충분히 실행할 수 있는 효과가 발생되며, 뿐만 아니라 하나의 전력 회수 장치로 여러개의 어드레스 드라이버 회로의 전력 회수를 실현할 수 있어서 회로 구성이 간단해지고 PCB 설계가 용이해지는 효과가 발생된다.

Description

플라즈마 디스플레이 패널의 전력 회수 장치 및 방법{Apparatus and method for recovering energy of a plasma display panel}
본 발명은 플라즈마 디스플레이 패널 구동 장치 및 방법에 관한 것으로서, 특히 단일의 에너지 축적 소자 및 비교적 적은 수의 소자로 화면 상태에 따라서 도통되는 픽셀의 수에 관계없이 향상된 전력 회수 효율을 갖는 플라즈마 디스플레이 패널의 전력 회수 장치 및 방법에 관한 것이다.
일반적으로 플라즈마 디스플레이 패널(Plasma Display Panel ; PDP)은 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 차세대 평판 디스플레이 장치로서, 플라즈마 디스플레이 패널은 크기에 따라 수십에서 수 백만 개 이상의 픽셀이 매트릭스(matrix)형태로 배열되어 있다.
플라즈마 디스플레이 패널의 구동 시퀀스는 리세트 구간, 어드레스 구간 및 서스테인 구간으로 구분된다. 리세트 구간은 모든 셀들을 방전시킴과 동시에 벽 전하(wall charge)를 소거함으로써 표시 이력을 소거하는 구간이며, 어드레스 구간은 패널의 행/열 전극의 조합에 의하여 매트릭스 구성에 의하여 방전 셀을 선택하여 어드레스 방전을 형성시키는 구간이며, 서스테인 구간은 스캔 구간에 형성된 방전 셀의 충/방전을 전력 회수와 함께 반복하여 실행하면서 화상을 표시하는 구간이다.
위의 구동 시퀀스 중에서 어드레스 구간 및 서스테인 구간에서 소비 전력을 줄이기 위하여 전력 회수 회로를 이용한다.
종래의 기술에 의한 어드레스 구간에서의 플라즈마 디스플레이 패널의 전력 회수 장치는 도 1에 도시된 바와 같이 같다.
플라즈마 디스플레이 패널에서 열(column) 전극은 각각 커패시턴스 Ca의 부하로 가정할 수 있다. 어드레스 구간 동작 시에 화상 조건에 따라 부하는 0에서 nCa(n : 행(row) 전극(어드레스 전극) 당 ON 상태 픽셀의 수)의 가변 부하로 표시된다. 에너지 축적 소자인 커패시터 C1 및 인덕터 L1에 의한 어드레스 전력 회수 동작을 다음과 같이 4개의 모드(mode)로 나누어 도 2(a)∼(h)의 스위칭 타이밍도 및 파형도를 참조하여 설명하기로 한다.
(1) 모드 1(M1)
MOSFET 스위치 S1이 도통되기 직전에 스위치 S4는 도통되어 있고, 각 어드레스 전극의 양단 전압 Vp=Vo(1)=Vo(2)=...=Vo(n)=0으로 유지되어 있다. t0에서 스위치 S1이 도통되면 모드 1의 동작이 시작된다. 모드 1구간 동안에 C1-S1-D1-L1-Su(도통시킬 픽셀)-Ca(도통시킬 픽셀)의 경로로 LC 공진회로가 형성된다. 이에 따라서 인덕터 L1에 공진 전류가 흐르게 되어 어드레스 전극 전압 Vp는 증가된다. t1에서 인덕터 L1의 전류는 0이 되고, Vp는 +Va가 된다.
(2) 모드 2(M2)
t1에서 스위치 S3이 도통된다. 모드 2 구간동안 Vp는 +Va로 유지되고, 각 어드레스 전극은 화상 조건에 따라 벽 전하를 형성한다.
(3) 모드 3(M3)
t2에서 스위치 S2가 도통되고 스위치 S1 및 S3은 차단된다. 이에 따라서 모드 3 구간 동안에 Ca(도통시킬 픽셀)-Su(도통시킬 픽셀)-L1-D2-S2-C1의 경로로 LC 공진회로가 형성되어 인덕터 L1에 공진 전류가 흐르고 Vp는 감소한다. t3에서 인덕터의 전류는 0A, Vp는 0V 가 된다.
(4) 모드 4(M4)
t3에서 스위치 S4가 도통된다. 모드 4 구간 동안 Vp는 0V로 유지된다. t4에서 스위치 S2 및 S4가 차단되고, S1이 도통되면 다음 주기가 반복된다.
위의 회로에서 전력 회수를 위한 인덕터 L1의 값은 수학식 1에 근거하여 결정한다.
예를 들어, t2+t4=200ns, Ca=66.5pF, n=1248(HD급 경우 어드레스 전극 수)일 때 충분한 전력 회수를 위한 인덕터 L1 값은 수학식 1에 의하면 12.2nH가 되나, 현실적으로 인쇄회로기판(PCB) 누설 인덕턴스 등을 고려하면 구현 가능한 인덕턴스 값은 100nH 이하로 되기가 어렵다. 인덕터 L1을 100nH 정도로 설정하면 도 2(h)에 도시된 바와 같이 n이 클 경우 Vst만큼의 급격한 전압 변화가 존재하게 되고, 이에 따라 어드레스 전력 회수를 할 수 없게 되는 문제점이 있었다. 이를 해결하기 위해서는 도 1에 도시된 바와 같은 어드레스 전력 회수 회로를 여러 개 채용하여야 하는데, 이로 인하여 회로 부품 수가 증가되어 자재비가 상승되는 문제점이 발생될 뿐만 아니라 신호선의 개수가 증가하게 되어 PCB 설계가 매우 복잡해지는 문제점이있었다.
본 발명이 이루고자 하는 기술적 과제는 상술한 문제점을 해결하기 위하여 전력 회수 회로의 에너지 축적 소자로 인덕터만을 이용하고 비교적 적은 수의 회로 소자를 적용하여 향상된 에너지 회수율을 갖는 플라즈마 디스플레이 패널의 전력 회수 장치 및 방법을 제공하는데 있다.
도 1은 종래의 기술에 의한 플라즈마 디스플레이 패널의 어드레스 전극 전력 회수 장치의 구성도이다.
도 2(a)∼(h)는 도 1에 적용되는 주요 신호들의 파형도이다.
도 3은 본 발명에 의한 플라즈마 디스플레이 패널의 전력 회수 장치의 구성도이다.
도 4(a)∼(f)는 본 발명에 적용되는 플라즈마 디스플레이 패널 구동 스위칭 시퀀스에 따른 주요 신호들의 파형도이다.
도 5(a)∼(e)는 본 발명에 의한 플라즈마 디스플레이 패널의 전력 회수 방법에 따른 모드별 전류의 흐름을 도시한 도면이다.
도 6은 본 발명을 적용한 플라즈마 디스플레이 구동 시스템에서의 모드 2 구간이 작을 때 주요 전압/전류 파형의 모의 실험 결과를 도시한 그래프이다.
도 7은 본 발명을 적용한 플라즈마 디스플레이 구동 시스템에서의 모드 2 구간이 중간 정도의 값일 때 주요 전압/전류 파형의 모의 실험 결과를 도시한 그래프이다.
도 8은 본 발명을 적용한 플라즈마 디스플레이 구동 시스템에서의 모드 2 구간이 클 때 주요 전압/전류 파형의 모의 실험 결과를 도시한 그래프이다.
상기 기술적 과제를 달성하기 위하여 본 발명에 의한 플라즈마 디스플레이 패널의 전력 회수 장치는 플라즈마 디스플레이 패널 구동 시스템의 전력 회수 장치에 있어서, 소정의 스위칭 시퀀스에 의하여 도통되는 픽셀에 소정의 공급 전원을 공급하기 위한 제1폐회로, 상기 제1폐회로에 의하여 충전된 픽셀에서 방전되는 에너지를 단일의 에너지 축적 소자를 통하여 회수하기 위한 제2폐회로 및 상기 에너지 축적 소자에 저장된 에너지를 소정의 스위칭 시퀀스에 의하여 도통되는 픽셀로 천이시키기 위한 제3폐회로를 포함함을 특징으로 한다.
상기 기술적 과제를 달성하기 위하여 본 발명에 의한 플라즈마 디스플레이 패널의 어드레스 드라이버 회로에 적용되는 전력 회수 장치는 어드레스 구간에서 픽셀들의 충/방전 시퀀스를 스위칭하는 어드레스 드라이버를 포함하는 플라즈마 디스플레이 패널 구동 시스템의 전력 회수 장치에 있어서, 소정의 공급 전원을 입력단자에 연결하고, 출력단자는 상기 어드레스 드라이버에 연결되는 제1스위칭 수단, 상기 제1스위칭 수단의 출력단자에 제1단자를 연결하고, 제2단자를 에너지 축적 소자의 제1단자에 연결하여 소정의 시퀀스에 의하여 상기 픽셀에서 방전되는 전류 또는 상기 제1스위칭 수단에서 출력되는 전원의 도통을 스위칭하는 제2스위칭 수단, 상기 제2스위칭 수단의 제2단자와 제3스위칭 수단의 제1단자 사이에 연결되어, 인가되는 전류에 의하여 에너지를 축적하는 에너지 축적 소자, 상기 에너지 축적 소자에 제1단자를 연결하고, 접지에 제2단자를 연결하는 제3스위칭 수단, 상기 제2스위칭 수단의 제2단자 및 접지 사이에 연결되는 제1다이오드 및 상기 제1스위칭 수단의 출력단자 및 상기 제3스위칭 수단의 제1단자에 연결되는 제2다이오드를 포함함을 특징으로 한다.
상기 다른 기술적 과제를 달성하기 위하여 본 발명에 의한 플라즈마 디스플레이 패널의 어드레스 드라이버 전력 회수 방법은 플라즈마 디스플레이 패널 구동 시스템의 전력 회수 방법에 있어서, (a) 소정의 스위칭 시퀀스에 의하여 도통되는 픽셀에 소정의 공급 전원을 공급하기 위한 제1모드를 실행하는 단계, (b) 소정의 스위칭 시퀀스에 의하여 상기 픽셀에 소정의 전압을 공급하면서 에너지 축적 소자로 흐르는 전류는 증가시키는 제2모드를 실행하는 단계, (c) 소정의 스위칭 시퀀스에 의하여 상기 충전된 픽셀에서 방전되는 에너지를 에너지 축적 소자를 통하여 회수하는 제3모드를 실행시키는 단계, (d) 소정의 스위칭 시퀀스에 의하여 상기 픽셀의 충/방전 프로세스를 종료시키고, 상기 에너지 축적 소자를 통하여 회수된 에너지를 유지하는 제4모드를 실행시키는 단계 및 (e) 소정의 스위칭 시퀀스에 의하여 상기 에너지 축적 소자에 저장된 에너지를 도통되는 픽셀로 천이시키는 제5모드를 실행시키는 단계를 포함함을 특징으로 한다.
이하 첨부된 도면을 참조하여 본 발명의 바람직한 실시 예에 대하여 상세히 설명하기로 한다.
설명의 편의를 위하여 본 발명에 의한 전력 회수 장치를 플라즈마 디스플레이 패널의 어드레스 드라이브 회로에 적용하여 설명하기로 한다. 물론, 본 발명은 플라즈마 디스플레이 패널의 어드레스 드라이브 회로뿐만 아니라, 서스테인 구간에서의 플라즈마 디스플레이 패널의 X전극 및 Y전극 드라이브 회로의 전력 회수에도 적용될 수 있음은 당연한 사실이다.
도 3은 본 발명에 의한 플라즈마 디스플레이 패널의 전력 회수 장치를 어드레스 드라이브 회로(100)에 적용한 구성도이다.
도 3에 도시된 바와 같이, 본 발명에 의한 전력 회수 장치는 단일의 에너지 축적 소자인 인덕터(L2)를 이용한다. 이에 비하여, 도 1에 도시된 바와 같은 종래의 기술에 의한 전력 회수 장치에서는 에너지 축적 소자로 커패시터(C1)와 인덕터(L1)를 함께 이용하였다. 뿐만 아니라, 종래의 기술에 비하여 스위칭 소자의 개수가 1개 줄어든 것을 알 수 있다.
그러면, 도 4(a)∼(g)의 스위칭 신호 및 주요 전압, 전류의 파형도와 도 5(a)∼(e)의 모드별 전류 흐름도를 참조하여 전력 회수의 구체적인 동작 원리를 모드별로 나누어 설명하기로 한다.
1) 모드 1
도 5(a)에 도시된 바와 같이, 모드 1에서 스위치 S5 및 Su는 도통되어 있고, 어드레스 전극의 전압 Vp는 +Va를 유지하여 선택된 어드레스 전극(부하는 nCa)에벽전하를 형성하게 한다. 인덕터 L2에 흐르는 전류는 0이다. 모드 1의 기간은 PDP의 어드레스 방전 특성에 따라 결정되고, 통상 1.6us 이상이다.
2) 모드 2
t=t1에서 스위치 S6과 S7이 도통한다. Vp는 +Va를 유지하고, 인덕터 L2의 전류 IL은 기울기 +Va/L2로 선형적으로 증가한다. 모드 2의 구간 D*Ts(여기에서, D는 모드 2 구간의 듀티 값이고, Ts는 모드 1∼ 모드 5의 1주기 시간이다)는 화면 조건에 따라 변하는 값으로 조절한다. t=t2에서 인덕터 L2 전류 IL(t2)는 수학식 2와 같이 표현된다.
모드 2에서는 에너지 회수 모드인 모드 3 실행 전에 인덕터 L2에 에너지 회수 모드에서의 전류 방향과 동일한 방향의 초기 천이 전류를 공급하여 인덕터의 관성 전류에 의하여 에너지 회수가 원활하게 이루어지도록 한다.
3) 모드 3
t=t2에서 스위치 S5가 차단된다. 그러면, 도 5(c)에 도시된 바와 같이 공진 경로 nCa-Su-S6-L2-S7의 경로로, 선택된 어드레스 전극의 픽셀에 충전된 에너지가 인덕터 L2로 천이 되어 전력회수 동작이 개시된다. 이 구간 동안 인덕터 L2의 전류와 전압 Vp는 각각 수학식 3과 4와 같이 표현된다.
여기서,,
여기에서 주목할 점은 종래의 기술에 의한 회로와 달리 iL(t2)의 존재로 n이 크더라도 모드 2의 구간을 조절하여 실제로 회로에서 구현 가능한 인덕터 L2 값(100nH 이상)으로도 전력 회수가 이루어질 수 있다는 것이다.
4) 모드 4
t=t3에서 스위치 Sd가 도통하고, 스위치 Su는 차단된다. 전압 Vp는 0으로 유지되고, 인덕터 L2 전류 IL은 도 5(d)에 도시된 바와 같이 Sd-Su(body diode)-S6-L2-S7의 경로로 흐르고 이 구간 동안 IL(t3)는 일정하게 유지된다. 통상 모드 4의 구간은 고속 어드레싱을 위하여 위해서 스위치 타이밍을 작게 설정한다.
5) 모드 5
t=t4에서 스위치 S6 및 S7이 차단된다. 이에 따라서, 도 5(e)에 도시된 바와 같이 공진 경로 D3-L2-D4-Su-nCa의 경로로 인덕터 L2에 저장된 에너지가 선택된 어드레스 전극으로 천이된다. 이 구간 동안 인덕터 L2 전류 IL과 전압 Vp는 수학식 5 및 6과 같이 각각 표현된다.
여기에서, iL(t3)를 적절히 크도록 설계하면(즉 모드 2의 기간을 늘임으로써), 어드레스 전극 전압 Vp이 정확히 Va까지 증가되도록 설계가 가능하다. 스위치 S5가 도통하면 모드 1의 동작을 반복하여 다음 주기 동작이 개시된다.
이와 같은 동작에 의하여 단일의 에너지 축적 소자인 인덕터 및 비교적 적은 수의 회로 소자를 이용하여 화상 조건(즉, 도통되는 픽셀의 개수(n))에 관계없이 정확하게 플라즈마 디스플레이 패널의 전력 회수를 실현할 수 있게 되었다.
예로서, t2+t4=200ns. Ca=66.5pF, n=1248(HD급 경우 어드레스 전극 수)일 때, 현실적으로 구현 가능한 인덕턴스 값인 100nH 정도로 전력 회수용 인덕터 L2를 설정하였을 때, Pspice 모의 실험 결과를 도 6, 7 및 8에 도시하였다.
도 6, 7 및 8에서 n이 클 경우에도 모드 2의 기간을 길게 하면 어드레스 전력 회수가 충분히 일어날 수 있다는 것을 보여준다.
본 발명은 방법, 장치, 시스템 등으로서 실행될 수 있다. 소프트웨어로 실행될 때, 본 발명의 구성 수단들은 필연적으로 필요한 작업을 실행하는 코드 세그먼트들이다. 프로그램 또는 코드 세그먼트들은 프로세서 판독 가능 매체에 저장되어 질 수 있으며 또는 전송 매체 또는 통신망에서 반송파와 결합된 컴퓨터 데이터 신호에 의하여 전송될 수 있다. 프로세서 판독 가능 매체는 정보를 저장 또는 전송할수 있는 어떠한 매체도 포함한다. 프로세서 판독 가능 매체의 예로는 전자 회로, 반도체 메모리 소자, ROM, 플레쉬 메모리, E2PROM, 플로피 디스크, 광 디스크, 하드 디스크, 광 섬유 매체, 무선 주파수(RF) 망, 등이 있다. 컴퓨터 데이터 신호는 전자 망 채널, 광 섬유, 공기, 전자계, RF 망, 등과 같은 전송 매체 위로 전파될 수 있는 어떠한 신호도 포함된다.
첨부된 도면에 도시되어 설명된 특정의 실시 예들은 단지 본 발명의 예로서 이해되어 지고, 본 발명의 범위를 한정하는 것이 아니며, 본 발명이 속하는 기술 분야에서 본 발명에 기술된 기술적 사상의 범위에서도 다양한 다른 변경이 발생될 수 있으므로, 본 발명은 보여지거나 기술된 특정의 구성 및 배열로 제한되지 않는 것은 자명하다.
상술한 바와 같이, 본 발명에 의하면 전력 회수 회로의 에너지 축적 소자로 실제 구현 가능한 용량의 인덕터만을 이용하여 전력 회수 회로를 설계함으로써, 종래의 기술에 비하여 전력 회수 회로의 구성이 간단해지는 효과가 발생되며, 도통되는 어드레스 전극 수가 증가되더라도 전력 회수를 충분히 실행할 수 있는 효과가 발생되며, 뿐만 아니라 하나의 전력 회수 장치로 여러개의 어드레스 드라이버 회로의 전력 회수를 실현할 수 있어서 회로 구성이 간단해지고 PCB 설계가 용이해지는 효과가 발생된다.

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  16. 플라즈마 디스플레이 패널 구동 시스템의 전력 회수 장치에 있어서,
    픽셀 표시 소자에 연결된 복수개의 스위칭 소자들의 스위칭 시퀀스에 따라서 어드레스 전극을 통하여 상기 픽셀 표시 소자로 에너지를 충전시키거나 또는 상기 픽셀 표시 소자에 충전된 에너지를 상기 어드레스 전극을 통하여 방전시키는 어드레스 드라이버;
    소정의 공급 전원을 입력단자에 연결하고, 출력단자는 상기 어드레스 전극에 연결되는 제1스위칭 수단;
    상기 제1스위칭 수단의 출력단자에 제1단자를 연결하고, 제2단자를 에너지 축적 소자의 제1단자에 연결하여 소정의 시퀀스에 의하여 상기 픽셀 표시 소자에서 방전되는 전류 또는 상기 제1스위칭 수단에서 출력되는 전원의 도통을 스위칭하는 제2스위칭 수단;
    상기 제2스위칭 수단의 제2단자와 제3스위칭 수단의 제1단자 사이에 연결되어, 인가되는 전류에 의하여 에너지를 축적하는 인덕터;
    상기 인덕터에 제1단자를 연결하고, 접지에 제2단자를 연결하는 제3스위칭 수단;
    상기 제2스위칭 수단의 제2단자 및 접지 사이에 연결되는 제1다이오드; 및
    상기 제1스위칭 수단의 출력단자 및 상기 제3스위칭 수단의 제1단자에 연결되는 제2다이오드를 포함함을 특징으로 하는 플라즈마 디스플레이 패널의 전력 회수 장치.
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  18. 제16항에 있어서, 상기 제1,2,3스위칭 수단은 각각 MOSFET 스위치임을 특징으로 하는 플라즈마 디스플레이 패널의 전력 회수 장치.
  19. 제16항에 있어서, 상기 제1,2,3스위칭 수단들의 스위칭 제어 시퀀스는
    상기 제2,3스위칭 수단은 차단시키고 상기 제1스위칭 수단을 도통시켜서, 상기 어드레스 드라이버에 의하여 스위칭되는 픽셀 표시 소자를 충전시키는 제1모드;
    상기 제1,2,3스위칭 수단들을 도통시켜, 상기 인덕터로 흐르는 전류는 증가시키는 제2모드;
    상기 제1스위칭 수단을 차단시키고 상기 제2,3스위칭 수단들을 도통시켜, 상기 어드레스 드라이버에 의하여 스위칭되는 픽셀 표시 소자에 충전된 에너지를 상기 인덕터에서 회수하는 제3모드;
    상기 제1스위칭 수단을 차단시키고 상기 제2,3스위칭 수단들을 도통시켜, 상기 어드레스 드라이버에 의하여 스위칭되는 접지와 폐회로를 형성하여 회수된 에너지를 유지하는 제4모드; 및
    상기 제1,2,3스위칭 수단을 차단시켜, 제1다이오드 - 인덕터 - 제2다이오드 - 어드레스 드라이버 - 픽셀 표시 소자(어드레스 드라이버에 의하여 도통되는 픽셀)의 경로를 통하여 픽셀로 상기 인덕터에 저장된 에너지를 전달하는 제5모드를 포함함을 특징으로 하는 플라즈마 디스플레이 패널의 전력 회수 장치.
  20. 플라즈마 디스플레이 패널 구동 시스템의 전력 회수 방법에 있어서,
    (a) 소정의 스위칭 시퀀스에 의하여 도통되는 픽셀 표시 소자에 소정의 공급 전원을 공급하기 위한 제1모드를 실행하는 단계;
    (b) 소정의 스위칭 시퀀스에 의하여 상기 픽셀 표시 소자에 소정의 전압을 공급하면서 인덕터로 흐르는 전류는 증가시키는 제2모드를 실행하는 단계;
    (c) 소정의 스위칭 시퀀스에 의하여 상기 충전된 픽셀 표시 소자에서 방전되는 에너지를 상기 인덕터를 통하여 회수하는 제3모드를 실행시키는 단계;
    (d) 소정의 스위칭 시퀀스에 의하여 상기 픽셀 표시 소자의 충/방전 프로세스를 종료시키고, 상기 인덕터를 통하여 회수된 에너지를 유지하는 제4모드를 실행시키는 단계; 및
    (e) 소정의 스위칭 시퀀스에 의하여 상기 인덕터에 저장된 에너지를 도통되는 픽셀 표시 소자로 천이시키는 제5모드를 실행시키는 단계를 포함함을 특징으로 하는 플라즈마 디스플레이 패널의 전력 회수 방법.
  21. 삭제
  22. 플라즈마 디스플레이 패널 구동 시스템의 전력 회수 방법에 있어서,
    소정의 스위칭 시퀀스에 의하여 도통되는 픽셀 표시 소자에 소정의 공급 전원에 의한 소정의 전압을 공급하기 위한 제1폐회로를 생성시키고, 상기 제1폐회로에 의하여 충전된 픽셀 표시 소자에서 방전되는 에너지를 단일의 인덕터를 통하여 회수하기 위한 제2폐회로를 생성시키고, 상기 단일의 인덕터에 저장된 에너지를 소정의 스위칭 시퀀스에 의하여 도통되는 픽셀 표시 소자에 공급하기 위한 제3폐회로를 생성시키도록 제어함을 특징으로 하는 플라즈마 디스플레이 패널의 전력 회수 방법.
  23. 제22항에 있어서, 에너지 회수 실행 전에 소정의 기간 동안 상기 인덕터에 에너지 회수 모드에서와 동일한 방향으로 전류를 공급하기 위한 제4폐회로를 더 생성시킴을 특징으로 하는 플라즈마 디스플레이 패널의 전력 회수 방법.
  24. 제22항에 있어서, 상기 인덕터에 의하여 회수된 에너지를 상기 픽셀 표시 소자에 공급하기 전에 소정의 기간 동안 유지하기 위한 제5폐회로를 더 생성시킴을 특징으로 하는 플라즈마 디스플레이 패널의 전력 회수 방법.
  25. 제22항에 있어서, 에너지 회수 실행 전에 소정의 기간 동안 상기 인덕터에 에너지 회수 모드에서와 동일한 방향으로 전류를 공급하기 위한 제4폐회로 및 상기 인덕터에 의하여 회수된 에너지를 상기 픽셀 표시 소자에 공급하기 전에 소정의 기간 동안 유지하기 위한 제5폐회로를 더 생성시킴을 특징으로 하는 플라즈마 디스플레이 패널의 전력 회수 방법.
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