[go: up one dir, main page]

JPS63122135A - 半導体チツプの電気的接続方法 - Google Patents

半導体チツプの電気的接続方法

Info

Publication number
JPS63122135A
JPS63122135A JP26799586A JP26799586A JPS63122135A JP S63122135 A JPS63122135 A JP S63122135A JP 26799586 A JP26799586 A JP 26799586A JP 26799586 A JP26799586 A JP 26799586A JP S63122135 A JPS63122135 A JP S63122135A
Authority
JP
Japan
Prior art keywords
electrodes
semiconductor chip
chip
gold
electrode
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP26799586A
Other languages
English (en)
Inventor
Yasuhiko Horio
泰彦 堀尾
Yoshihiro Bessho
芳宏 別所
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP26799586A priority Critical patent/JPS63122135A/ja
Publication of JPS63122135A publication Critical patent/JPS63122135A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/80Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected
    • H01L24/81Methods for connecting semiconductor or other solid state bodies using means for bonding being attached to, or being formed on, the surface to be connected using a bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Manufacturing Of Electrical Connectors (AREA)
  • Wire Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は、半導体チップと実装基板上の端子電極群との
電気的接続に、半導体チップの微細端子電極に形成され
た突起電極と超音波を用いる半導体チップの電気的接続
方法に関するものである。
従来の技術 従来、電子部品の接続端子と基板上の回路パターン端子
との接続には半田付けがよく利用されていたが、近年、
例えばICフラットパッケージ等の小型化と、接続端子
の増加により、接続端子間、いわゆるピッチ間隔が次第
に狭くなり、従来の半田付は技術で対処することが次第
に困難になって来た。また、最近では電卓、電子時計あ
るいは液晶ディスプレイ等にあっては、裸のICチップ
をガラス基板上の電極に直付けして実装面積の効率的使
用を図ろうとする動きがあり、半田付けに代わる有効か
つ微細な電気的接続手段が強く望まれている。裸のIC
チップを基板の電極と電気的に接続する方法としては、
メッキ技術によりICチップの電極パッド上にハンダ(
Pb/Sn)からなる突起電極(バンプ)を用いたもの
が知られている。既知の突起電極の形成方法は、最初に
ICチップ上の電極パッド上に、Cr、Cu、pb/S
n等の金属メッキ部を形成した後、余分なレジストと金
属を除去して、突起電極を形成するというものである。
また、特開昭60−133603号公報に示されている
ように、シリコンゴム中にカーボンを含めて導電ゴムを
得、これを基板の電極部とICチップのバンプとの間に
介して加圧して、電気的な接続を行う方法が提案されて
いる。
発明が解決しようとする問題点 しかしながら第一の従来方法においては、ICチップと
基板との接続に際して、200℃以上といった高温の処
理工程が必要であった。また、第二の従来方法において
は、導電ゴムを用いているため、接続抵抗が大きく、微
小な電流しか流すことができず、用途が限定されるもの
であった。さらに、電極が微細になり、また、電極密度
が高くなればなる程、電極間に介在させる導電ゴムの微
細化が困難となるといった欠点を有していた。
本発明は上記の問題点に鑑みてなされたものであり、そ
の目的とする所は微細かつ密に半導体の電極パッドと基
板上の電極群とを信頬性良く低温で直付けするために、
半導体チップの電極パッド部に突起電極を得た後、半導
体チップの裏面から超音波を加えることによって突起電
極と基板上の電極との間を接合し、半導体チップと実装
基板を簡易に、かつ、信頬性良く電気的接続を行うこと
にある。
問題点を解決するための手段 本発明は上記の問題点を解決するため、微細ピッチ、微
細端子電極が形成されている半導体チップの電気的接続
において、微細端子電極部に突起電極部が形成された半
導体チップを実装基板上の接続電極と位置合せをした後
、半導体チップの裏面より超音波を加えることによって
突起電極と接続電極の間を接合して電気的接続を得るこ
とを特徴として半導体チップの電気的な接続を実現しよ
うとするものである。
作用 しかして本発明の上記した方法によれば、半導体チップ
上の電極パッド部に従来の技術を用いて突起電極を形成
した後、半導体チップの裏面より超音波を加えて電気的
接続を行うため、簡易で信頼性の高い電気的な接続が可
能となる。
実施例 以下、本発明の一実施例の半導体チップの電気的接続方
法について図面に基づいて詳細に説明する。
第1図〜第4図は本発明の一実施例を示す工程断面図で
ある。
図において1はICチップ、2はICチップの電極パッ
ド、3は突起電極(バンプ)、4は実装基板、5は接続
電極、6は超音波ヘッドである。
本発明の実施例では、まず第1図に示すようにICチッ
プ1の電極パッド2部にメッキ技術またはネイルヘッド
ボンディングの技術を用いて、突起電極(バンプ)3を
形成する。なお、その形成方法は既知であるため、ここ
ではその説明は省略する。突起電極3には通常は金ある
いはアルミニウムが用いられるが、銅など他の材料を用
いることも可能である。
ICチップ上のすべての電極パッド2上に突起電極3を
形成した後、第2図に示すように突起電極3を実装基板
4上の接続電極5に位置合せをする。位置合せの方法と
しては、ICチップ1の外周を実装基板4上に設けた位
置合せマークで合せたり、実装基板4がガラス等の透明
基板の場合には、基板の裏から位置合せを行うなどする
位置合せの後、第3図に示すようにICチップ1の裏面
より超音波へラド6を用いて超音波を加えて、突起電極
3と接続電極5の間を接合する。
この際、突起電極3と接続電極5の材料の組合せとして
は、金と金、金とアルミニウム、アルミニウムと金ある
いはアルミニウムとアルミニウムが最適であるが、他の
金属の組合せも可能である。
以上のようにして突起電極3と接続電極5を接合すると
、第4図に示すようにICチップ1と実装基板4が電気
的に接続できる。
なお、実装基板4上の接続電極5としては、銅箔の上に
金メッキしたものが用いられるが、アルミニウムなどの
他の金属でもよく、さらには、透明電極(ITO電極)
上へ金やアルミニウムをメッキあるいは蒸着したものを
用いることも可能である。
また、上の実施例ではICチップ1の裏面から超音波を
加えて電気的接続をするとしたが、その際に、熱も同時
に加えて電気的接続をするとしてもよい。
発明の効果 以上に説明したように、本発明の半導体チップの電気的
接続方法によれば、半導体チップの電極パッド部に従来
の技術を用いて簡単に突起電極を形成した後、半導体チ
ップの裏面より超音波を加えて突起電極と実装基板上の
接続電極とを接合するため、半導体チップを実装基板に
簡易で信頼性の高い電気的接続が可能となり、実用上極
めて価値が高い。
【図面の簡単な説明】
第1図〜第4図は本発明の一実施例を示す工程断面図で
ある。 1・・・・・・ICチップ、2・・・・・・ICチップ
の電極パッド、3・・・・・・突起電極(バンプ)、4
・・・・・・実装基板、5・・・・・・接続電極、6・
・・・・・超音波ヘッド。

Claims (5)

    【特許請求の範囲】
  1. (1)微細ピッチ、微細端子電極が形成されている半導
    体チップの電気的接続において、微細端子接続部に突起
    電極が形成された半導体チップを実装基板上の接続電極
    に位置合せをする工程と、前記半導体チップの裏面より
    超音波を加えることによって、前記突起電極と接続電極
    の間を接合することにより電気的接続を得る工程とから
    なることを特徴とする半導体チップの電気的接続方法。
  2. (2)半導体チップの微細端子電極部に形成される突起
    電極は、メッキ技術を用いて形成される金属突起電極か
    らなることを特徴とする特許請求の範囲第(1)項記載
    の半導体チップの電気的接続方法。
  3. (3)半導体チップの微細端子電極部に形成される突起
    電極は、ネイルヘッドボンディングの技術を用いて形成
    される金属突起電極からなることを特徴とする特許請求
    の範囲第(1)項記載の半導体チップの電気的接続方法
  4. (4)半導体チップの微細端子電極部に形成される突起
    電極は、金またはアルミニウムからなることを特徴とす
    る特許請求の範囲第(1)項記載の半導体チップの電気
    的接続方法。
  5. (5)実装基板の接続電極は、金またはアルミニウムか
    らなること、あるいは、それらがメッキされていること
    を特徴とする特許請求の範囲第(1)項記載の半導体チ
    ップの電気的接続方法。
JP26799586A 1986-11-11 1986-11-11 半導体チツプの電気的接続方法 Pending JPS63122135A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP26799586A JPS63122135A (ja) 1986-11-11 1986-11-11 半導体チツプの電気的接続方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP26799586A JPS63122135A (ja) 1986-11-11 1986-11-11 半導体チツプの電気的接続方法

Publications (1)

Publication Number Publication Date
JPS63122135A true JPS63122135A (ja) 1988-05-26

Family

ID=17452447

Family Applications (1)

Application Number Title Priority Date Filing Date
JP26799586A Pending JPS63122135A (ja) 1986-11-11 1986-11-11 半導体チツプの電気的接続方法

Country Status (1)

Country Link
JP (1) JPS63122135A (ja)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02112250A (ja) * 1988-08-31 1990-04-24 Siemens Ag 半導体チツプを基板に結合する方法
JPH04212277A (ja) * 1990-09-12 1992-08-03 Matsushita Electric Works Ltd プリント配線板への端子の接続法
US5888847A (en) * 1995-12-08 1999-03-30 Lsi Logic Corporation Technique for mounting a semiconductor die
KR100527989B1 (ko) * 2003-07-25 2005-11-09 동부아남반도체 주식회사 반도체 장치의 실장 방법

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02112250A (ja) * 1988-08-31 1990-04-24 Siemens Ag 半導体チツプを基板に結合する方法
JPH04212277A (ja) * 1990-09-12 1992-08-03 Matsushita Electric Works Ltd プリント配線板への端子の接続法
US5888847A (en) * 1995-12-08 1999-03-30 Lsi Logic Corporation Technique for mounting a semiconductor die
KR100527989B1 (ko) * 2003-07-25 2005-11-09 동부아남반도체 주식회사 반도체 장치의 실장 방법

Similar Documents

Publication Publication Date Title
US5367435A (en) Electronic package structure and method of making same
US6420664B1 (en) Metal foil having bumps, circuit substrate having the metal foil, and semiconductor device having the circuit substrate
US6528889B1 (en) Electronic circuit device having adhesion-reinforcing pattern on a circuit board for flip-chip mounting an IC chip
JPH04263433A (ja) 電気的接続接点の形成方法および電子部品の実装方法
JPH0432541B2 (ja)
JPS63150930A (ja) 半導体装置
JP2643613B2 (ja) 電気的接続接点の形成方法および電子部品の実装方法
JPH0750726B2 (ja) 半導体チップの実装体
JPH09162230A (ja) 電子回路装置及びその製造方法
JPS63122135A (ja) 半導体チツプの電気的接続方法
JPS63122133A (ja) 半導体チツプの電気的接続方法
JPH04263434A (ja) 電気的接続接点の形成方法および電子部品の実装方法
JPH02163950A (ja) 半導体装置の実装体およびその実装方法
JPS63168028A (ja) 微細接続構造
KR100310037B1 (ko) 복수개의집적회로칩을연성인쇄회로기판상에실장히기위한방법
JP2000252320A (ja) 半導体装置およびその製造方法
JPH03129745A (ja) 半導体装置の実装方法
JP2511909B2 (ja) 電気的接続材料のマイクロ形成方法
JPS62287647A (ja) 半導体チツプの接続バンプ
JP2652222B2 (ja) 電子部品搭載用基板
JPH01145826A (ja) 電気的接続接点
JPH05855B2 (ja)
JPH01232735A (ja) 半導体装置の実装体
JPH0362538A (ja) 電極端子
JP3027841B2 (ja) 配線基板の接続方法