JPS61180293A - 液晶表示パネル及び駆動方法 - Google Patents
液晶表示パネル及び駆動方法Info
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、液晶表示パネルの駆動方法に関し、特に、ブ
ロック分割画素駆動用スイッチ素子としてＴＰＴ （
薄膜トランジスタ）を使用して時分割駆動される液晶表
示パネルの、−水子期間で反転駆動される際に生じるブ
ロック毎高輝度ラインを解消する補正駆動方法に関する
。
ロック分割画素駆動用スイッチ素子としてＴＰＴ （
薄膜トランジスタ）を使用して時分割駆動される液晶表
示パネルの、−水子期間で反転駆動される際に生じるブ
ロック毎高輝度ラインを解消する補正駆動方法に関する
。
［従来の技術］
従来、ＴＰＴをブロック分割画素駆動用スイッチ素子と
して使用し、時分割駆動される液晶表示パネルにおいて
は、駆動に必要なアクティブマトリクス回路基板と、表
示部ＴＰＴアクティブマトリクス回路基板とが同一基板
上で構成されていた。第３図は、−１−記の如き液晶表
示パネルの一例を示す概略構成図で、表示部Ｐをマトリ
クスに駆動するを２つの基本回路として、ゲートライン
・ドライバ一部Ｇとソースライン・ドライバ一部りとが
配設され、更に、ブロック分割用ＴＦＴアレイｌがソー
スライン・ドライバ一部りからのマトリクス回路２に付
設されている。なお、前記ブロック分割用ＴＦＴアレイ
ｌは、ＴＦＴアレイ・ドライバ一部Ｂによって駆動され
る。また、図中破線で囲まれている部分、即ち、表示部
Ｐと、ブロック分割用ＴＦＴアレイｌと、マ］・リクス
回路２とは、同一基板−Ｌで構成されている。
して使用し、時分割駆動される液晶表示パネルにおいて
は、駆動に必要なアクティブマトリクス回路基板と、表
示部ＴＰＴアクティブマトリクス回路基板とが同一基板
上で構成されていた。第３図は、−１−記の如き液晶表
示パネルの一例を示す概略構成図で、表示部Ｐをマトリ
クスに駆動するを２つの基本回路として、ゲートライン
・ドライバ一部Ｇとソースライン・ドライバ一部りとが
配設され、更に、ブロック分割用ＴＦＴアレイｌがソー
スライン・ドライバ一部りからのマトリクス回路２に付
設されている。なお、前記ブロック分割用ＴＦＴアレイ
ｌは、ＴＦＴアレイ・ドライバ一部Ｂによって駆動され
る。また、図中破線で囲まれている部分、即ち、表示部
Ｐと、ブロック分割用ＴＦＴアレイｌと、マ］・リクス
回路２とは、同一基板−Ｌで構成されている。
その同一基板上の部分を更に詳細に示す配線図が、第４
図である。同図において、映像出力回路であるソースラ
イン・ドライバ一部りからの出力線ＤＩ、 Ｉ１２．０
３〜Ｄ１１は、マトリクス回路２で、出力線の本数ｍ本
毎に１ブロツクとしてまとめられ、ブロック数をｋとす
れば、ｍＸｋのマトリクスによりｍ Ｘ ｋ本の映像信
号線が得られる。各ブロックは、ＴＦＴアレイ・ドライ
バ一部Ｂからの出力線Ｂｌ、８２〜Ｂｋにより、それぞ
れｍ本の映像信号線Ｓｌ、 Ｓ２． Ｓ３〜Ｓ、にまと
められ、分割されていることになる。各映像信号線Ｓｌ
、 Ｓ２． Ｓ３〜Ｓ、は、ホールドコンデンサＣを介
して接地されている。これらのｍＸｋ本の映像信号線と
前記ゲートソース・ドライバ一部Ｇからの出力線０１〜
Ｇ１１−１．”Ｇ１１とで成るマトリクスの交点に、図
中○印囲みで示された液晶セルの一画素Ｕが配設される
。
図である。同図において、映像出力回路であるソースラ
イン・ドライバ一部りからの出力線ＤＩ、 Ｉ１２．０
３〜Ｄ１１は、マトリクス回路２で、出力線の本数ｍ本
毎に１ブロツクとしてまとめられ、ブロック数をｋとす
れば、ｍＸｋのマトリクスによりｍ Ｘ ｋ本の映像信
号線が得られる。各ブロックは、ＴＦＴアレイ・ドライ
バ一部Ｂからの出力線Ｂｌ、８２〜Ｂｋにより、それぞ
れｍ本の映像信号線Ｓｌ、 Ｓ２． Ｓ３〜Ｓ、にまと
められ、分割されていることになる。各映像信号線Ｓｌ
、 Ｓ２． Ｓ３〜Ｓ、は、ホールドコンデンサＣを介
して接地されている。これらのｍＸｋ本の映像信号線と
前記ゲートソース・ドライバ一部Ｇからの出力線０１〜
Ｇ１１−１．”Ｇ１１とで成るマトリクスの交点に、図
中○印囲みで示された液晶セルの一画素Ｕが配設される
。
上記のような液晶表示パネルを一水平期間の反転周期で
駆動すると、分割されたブロック間の境界部、即ち、第
４図におけるＳ、とＳｌとの間で、ソース線間容量成分
のため、チャージシェアリング効果と呼ばれる電荷移動
現象が生じ、信号線Ｓ。
駆動すると、分割されたブロック間の境界部、即ち、第
４図におけるＳ、とＳｌとの間で、ソース線間容量成分
のため、チャージシェアリング効果と呼ばれる電荷移動
現象が生じ、信号線Ｓ。
上の映像信号にその効果分のΔＶが重畳し、本来の映像
信号よりも大きい電圧振幅が出力されてしまう。（但し
、対向電極は接地されている。）以下、チャージシェア
リング効果の原理を第５図及び第６図とともに説明する
。第５図は、チャージシェアリング効果の原理図であり
、第６図は、そのタイムチャートである。第５図におい
て、図中央の一点鎖線はブロック間の境界を示し、一点
鎖線より左方を第１のブロック、一点鎖線より右方を第
２のブロックとする。第１のブロックの最終の信号線Ｓ
、は、最終のソースラインＤ−からの出力をブロック分
割用ＴＰＴで第１ブロツク駆動電圧Ｂ１によりドライブ
され、第２のブロックの最初の信号線Ｓ１は、最初のソ
ースラインＩｌｌからの出力をブロック分割用ＴＰＴで
第２ブロツク駆動電圧Ｂ２によりドライブされる。各ブ
ロック分割用ＴＦＴのソース端子から見たソースライン
容量Ｃ１およびＣ１は、前記映像信号ホールドコンデン
サＣに相当するもので、ソース線間には、前記ΔＶを生
じさせる線間容量ＣＳＳが存在する。ここで、第６図に
示される如く、Ｂ１にゲートパルスが入ると、映像信号
Ｄ−がＴＰＴのチャネルを通してＳ−に伝達され、即ち
、Ｃｍに充電されることになる。Ｃ−が所属する第１の
ブロックのソースラインの充電が終了すると、次に、Ｂ
２にパルスが入り、Ｓｌを含むン 第２のブロックに所属する＾−スラインが充電される。
信号よりも大きい電圧振幅が出力されてしまう。（但し
、対向電極は接地されている。）以下、チャージシェア
リング効果の原理を第５図及び第６図とともに説明する
。第５図は、チャージシェアリング効果の原理図であり
、第６図は、そのタイムチャートである。第５図におい
て、図中央の一点鎖線はブロック間の境界を示し、一点
鎖線より左方を第１のブロック、一点鎖線より右方を第
２のブロックとする。第１のブロックの最終の信号線Ｓ
、は、最終のソースラインＤ−からの出力をブロック分
割用ＴＰＴで第１ブロツク駆動電圧Ｂ１によりドライブ
され、第２のブロックの最初の信号線Ｓ１は、最初のソ
ースラインＩｌｌからの出力をブロック分割用ＴＰＴで
第２ブロツク駆動電圧Ｂ２によりドライブされる。各ブ
ロック分割用ＴＦＴのソース端子から見たソースライン
容量Ｃ１およびＣ１は、前記映像信号ホールドコンデン
サＣに相当するもので、ソース線間には、前記ΔＶを生
じさせる線間容量ＣＳＳが存在する。ここで、第６図に
示される如く、Ｂ１にゲートパルスが入ると、映像信号
Ｄ−がＴＰＴのチャネルを通してＳ−に伝達され、即ち
、Ｃｍに充電されることになる。Ｃ−が所属する第１の
ブロックのソースラインの充電が終了すると、次に、Ｂ
２にパルスが入り、Ｓｌを含むン 第２のブロックに所属する＾−スラインが充電される。
この時、２つのブロックの境界に配置されたＳ、とＳｌ
の充電波形は第６図に示されるように変化し、Ｓヨは図
中斜線部で示される振幅ΔＶが重畳されて、本来の映像
信号よりも大きくなっており、一方でＳｌは反転初期に
波形が図中斜線で示されるように変動している。このよ
うな現象は、前記ソース線間容量ＣＳＳがＧａとＣ＋と
の間で前記チャージシェアリング効果を生じさせている
ためで、Δ■と■との関係は下式に近似する。
の充電波形は第６図に示されるように変化し、Ｓヨは図
中斜線部で示される振幅ΔＶが重畳されて、本来の映像
信号よりも大きくなっており、一方でＳｌは反転初期に
波形が図中斜線で示されるように変動している。このよ
うな現象は、前記ソース線間容量ＣＳＳがＧａとＣ＋と
の間で前記チャージシェアリング効果を生じさせている
ためで、Δ■と■との関係は下式に近似する。
（Ｃ＝Ｃ−嬌Ｃ＋）
ＡＶ’：Ｏｓｓ／Ｃ＋Ｇ５５１７ （’Ｍ）［発明が解
決しようとする問題点］ 上記の如き液晶表示パネルをいささかの補正も行わずに
駆動すると、ブロック毎に最終のＳ■ラインが高輝度ラ
インとなって目視され、ディスプレイとして非常に不具
合である。本発明が解決しようとする問題点は、このよ
うな高輝度ラインの除去であって、本発明の目的は、パ
ネル側の改造を必要とせずに、チャージシェアリング効
果により生じる高輝度ラインを外部補正回路ヤ解消し、
−水子期間反転駆動に際してのブロック分割駆動を実現
する液晶表示パネルの駆動方法を提供することにある。
決しようとする問題点］ 上記の如き液晶表示パネルをいささかの補正も行わずに
駆動すると、ブロック毎に最終のＳ■ラインが高輝度ラ
インとなって目視され、ディスプレイとして非常に不具
合である。本発明が解決しようとする問題点は、このよ
うな高輝度ラインの除去であって、本発明の目的は、パ
ネル側の改造を必要とせずに、チャージシェアリング効
果により生じる高輝度ラインを外部補正回路ヤ解消し、
−水子期間反転駆動に際してのブロック分割駆動を実現
する液晶表示パネルの駆動方法を提供することにある。
［問題点を解決するための手段］
本発明において、を記の問題点を解決するために講じら
れた手段は、ＴＰＴ （薄ｌタトランジスタ）アクテ
ィブマトリクス回路基板で構成される液晶表示部と、該
液晶表示部の映像信号線側に信号線の本数に対応する個
数で配列されたサンプル／ホールド用のスイッチ素子ア
レイと、そのスイッチ素子アレイを複数のブロックに分
割し、時分割駆動するアクティブマトリクス回路と、前
記スイッチ素子アレイの１ブロツク分の信号線の本数に
対応する出力線数の外部映像信号出力回路とで構成され
た液晶表示パネルの駆動方法であって、液晶表示パネル
の一水乎期間を反転周期とする交流駆動により該液晶表
示パネルを駆動する際に、映像に生じるブロック毎の高
輝度ラインを解消する演算処理を外部映像信号出力回路
で映像信号へ施すことにより、補正駆動を行うことを特
徴とする液晶表示パネルの駆動方法の実施手段である。
れた手段は、ＴＰＴ （薄ｌタトランジスタ）アクテ
ィブマトリクス回路基板で構成される液晶表示部と、該
液晶表示部の映像信号線側に信号線の本数に対応する個
数で配列されたサンプル／ホールド用のスイッチ素子ア
レイと、そのスイッチ素子アレイを複数のブロックに分
割し、時分割駆動するアクティブマトリクス回路と、前
記スイッチ素子アレイの１ブロツク分の信号線の本数に
対応する出力線数の外部映像信号出力回路とで構成され
た液晶表示パネルの駆動方法であって、液晶表示パネル
の一水乎期間を反転周期とする交流駆動により該液晶表
示パネルを駆動する際に、映像に生じるブロック毎の高
輝度ラインを解消する演算処理を外部映像信号出力回路
で映像信号へ施すことにより、補正駆動を行うことを特
徴とする液晶表示パネルの駆動方法の実施手段である。
演算処理は、ソースドライバー回路の最終信号線に減算
器を介設することにより行われ、実施例では、ソースド
ライバーが第２図のようにデジタル／アナログ・コンバ
ーターで構成されているため、レジスタはデジタルレジ
スタとなっているが、特にデジタルレジスタでなくても
補正回路は実現できる。
器を介設することにより行われ、実施例では、ソースド
ライバーが第２図のようにデジタル／アナログ・コンバ
ーターで構成されているため、レジスタはデジタルレジ
スタとなっているが、特にデジタルレジスタでなくても
補正回路は実現できる。
ソースドライバーがオールアナログの場合は、このレジ
スターはサンプルホールド用コンデンサを用いることに
より可能である。
スターはサンプルホールド用コンデンサを用いることに
より可能である。
［作 用１
チャージシェアリング効果によるΔＶの大きさは、前記
のとおり、隣接ブロックの電圧■に比例する。
のとおり、隣接ブロックの電圧■に比例する。
Δｖ′、Ｃ５ｓ／Ｃ＋Ｃ５ｓ・ｖ
そして、電圧■は隣接ブロックへ出力される映像信号に
よって変動するので、その第１信号線の■の値からΔＶ
の値を予想し、この予想値を当該゛ブロックへ出力する
際に減算器で差し引けば、高輝度ラインを解消できる原
理になる。
よって変動するので、その第１信号線の■の値からΔＶ
の値を予想し、この予想値を当該゛ブロックへ出力する
際に減算器で差し引けば、高輝度ラインを解消できる原
理になる。
［実施例］
以下、本発明を実施例とその図面により詳細に説明する
。
。
第１図は、本発明を実施するのに好適な補正回路の基本
例を示す部分構成図である。第１図において、１はブロ
ック分割用ＴＦＴアレイ、２はアクティブマトリクス回
路、３はソースドライバ一部、４はその出力段を示す。
例を示す部分構成図である。第１図において、１はブロ
ック分割用ＴＦＴアレイ、２はアクティブマトリクス回
路、３はソースドライバ一部、４はその出力段を示す。
外部映像出力回路５からの映像データｄ＋、 ｄ２．
ｄ３〜ｄ、は第１のレジスタ６に一時格納され、かつ初
頭の映像データｄｌは第２のレジスタ７にも一時保留さ
れる。この第２のレジスタ７の出力は、ゲイン調整回路
８で調整されたのち、減算器９で、前記第１のレジスタ
６の最終映像データｄａの出力を演算処理するのに使用
される。なお、１０は映像データｄ＋、 ｄ２． ｄ３
〜ｄａを第１のレジスタ７に格納するタイミングを管理
するラッチパルス、１１は初頭の映像データｄ１を第２
のレジスタに格納するタイミングを管理する別なラッチ
パルスである。
ｄ３〜ｄ、は第１のレジスタ６に一時格納され、かつ初
頭の映像データｄｌは第２のレジスタ７にも一時保留さ
れる。この第２のレジスタ７の出力は、ゲイン調整回路
８で調整されたのち、減算器９で、前記第１のレジスタ
６の最終映像データｄａの出力を演算処理するのに使用
される。なお、１０は映像データｄ＋、 ｄ２． ｄ３
〜ｄａを第１のレジスタ７に格納するタイミングを管理
するラッチパルス、１１は初頭の映像データｄ１を第２
のレジスタに格納するタイミングを管理する別なラッチ
パルスである。
チャージシェアリング効果を生じるのは、第１のブロッ
クのＳｌ＋ ｓ、−＋・・・であり、その現象を生じさ
せるのは、第２のブロックのｓｌ、ｓ２・・・である。
クのＳｌ＋ ｓ、−＋・・・であり、その現象を生じさ
せるのは、第２のブロックのｓｌ、ｓ２・・・である。
ブロック分割用子ＦＴアレイ１の第１ブロツクへアクテ
ィブマトリクス回路２から映像信号Ｄ１〜Ｄ−を出力す
る時点で、第２のブロックへ出力すべき映像データｄ１
はソースドライバ一部３で既に定まっていて、このｄｌ
をｄｌの出力段へ導き、前記ゲイン調整回路８でΔＶ相
当量のゲインｇを作り出して、そのゲインｇを差し引い
た映像信号ローを第１のブロックの最終ラインＳ、へ出
力することにより、所望の補正駆動方法を実現すること
ができる。
ィブマトリクス回路２から映像信号Ｄ１〜Ｄ−を出力す
る時点で、第２のブロックへ出力すべき映像データｄ１
はソースドライバ一部３で既に定まっていて、このｄｌ
をｄｌの出力段へ導き、前記ゲイン調整回路８でΔＶ相
当量のゲインｇを作り出して、そのゲインｇを差し引い
た映像信号ローを第１のブロックの最終ラインＳ、へ出
力することにより、所望の補正駆動方法を実現すること
ができる。
具体的な例として、たとえば水平走査線数（ケートライ
ン数） ２４０ Ｘ垂直線数（ソースライン数）４８０
の規模の液晶表示パネルを使用するものとする。これは
、テレビ画面のサイズで約３インチの大きさのパネルで
あるが、ソースラインのブロック分割数を４ブロツクと
すれば、■ブロックのライン数は１２０木となり、アク
ティブマトリクスの配線回路は１２０ラインになる。ま
た、ブロック分割用ＴＦＴアレイのコモンゲート線は４
ビツトとなる。なお、映像のソースとしては、力ラーＴ
Ｖ信号を使用し、フルカラーＴＶ映像なノ々ネルに出力
するものとする。
ン数） ２４０ Ｘ垂直線数（ソースライン数）４８０
の規模の液晶表示パネルを使用するものとする。これは
、テレビ画面のサイズで約３インチの大きさのパネルで
あるが、ソースラインのブロック分割数を４ブロツクと
すれば、■ブロックのライン数は１２０木となり、アク
ティブマトリクスの配線回路は１２０ラインになる。ま
た、ブロック分割用ＴＦＴアレイのコモンゲート線は４
ビツトとなる。なお、映像のソースとしては、力ラーＴ
Ｖ信号を使用し、フルカラーＴＶ映像なノ々ネルに出力
するものとする。
第２図は、」−記実施例の補正回路部の一例を示す部分
回路図である。第２図において、１２は第１のレジスタ
、１３はデジタル／アナログ・コンバータ、１４はイン
バータ、１５は減算器、１６は出力段、１７は第２のレ
ジスタ、１８．１９はゲイン調整器、２０は加算器であ
る。第１のレジスタ１２、第２のレジスタ１７、減算器
１５は、第１図における第１のレジスタ６、第２のレジ
スタ７、減算器９に相当し、２つのゲイン調整器１８お
よび１８と加算器２０とで、第１図におけるゲイン調整
回路８を構成する。
回路図である。第２図において、１２は第１のレジスタ
、１３はデジタル／アナログ・コンバータ、１４はイン
バータ、１５は減算器、１６は出力段、１７は第２のレ
ジスタ、１８．１９はゲイン調整器、２０は加算器であ
る。第１のレジスタ１２、第２のレジスタ１７、減算器
１５は、第１図における第１のレジスタ６、第２のレジ
スタ７、減算器９に相当し、２つのゲイン調整器１８お
よび１８と加算器２０とで、第１図におけるゲイン調整
回路８を構成する。
ここで、補正駆動を行うには、ｍ＝１２０として、第１
図におけるＳｌ、３２・・・のそれぞれが隣接ブロック
の５１２０． ＳＩ＋９・・・のそれぞれに予め如何な
る割合でチャージシェアリング効果の影響を与えている
かを知る必要がある。そして、その結果により、ゲイン
調整回路８のゲイン比率を調整しなければならない。
図におけるＳｌ、３２・・・のそれぞれが隣接ブロック
の５１２０． ＳＩ＋９・・・のそれぞれに予め如何な
る割合でチャージシェアリング効果の影響を与えている
かを知る必要がある。そして、その結果により、ゲイン
調整回路８のゲイン比率を調整しなければならない。
実験の結果によれば、あるブロックの映像信号線５１２
０．３Ｉ＋９・・・に隣接ブロックの映像信号線Ｓｌ。
０．３Ｉ＋９・・・に隣接ブロックの映像信号線Ｓｌ。
Ｓ２・・・がｔえるＶの影響度は、５Ｉ２０１８Ｉ＋９
・・・が受ける影響度の８０％はＳｌによってｔえられ
、残り２０％が８２によってかえられていた。また、影
響を与えられる範囲は約４ラインで、８１２Ｆ１−３Ｉ
＋７が影響を受けていた。従って、映像信号線のｏ、＋
２０〜ＤＩｌ＋までに補正回路を付設し、差引き量の
ゲインをｄｌとｄ２から８：２の比率に調整して加算し
た出力を減算器で補正し、補正駆動を行えばよい。
・・・が受ける影響度の８０％はＳｌによってｔえられ
、残り２０％が８２によってかえられていた。また、影
響を与えられる範囲は約４ラインで、８１２Ｆ１−３Ｉ
＋７が影響を受けていた。従って、映像信号線のｏ、＋
２０〜ＤＩｌ＋までに補正回路を付設し、差引き量の
ゲインをｄｌとｄ２から８：２の比率に調整して加算し
た出力を減算器で補正し、補正駆動を行えばよい。
なお、上記実施例では、デジタル値の映像信号をフィー
ドバックさせて予想データとしたが、そちろん、これに
限定されるものではなく、アナログ値の映像信号であっ
ても、サンプル／ホールドコンデンサをアナログ出力段
に設けることによりフィードバック可能である。
ドバックさせて予想データとしたが、そちろん、これに
限定されるものではなく、アナログ値の映像信号であっ
ても、サンプル／ホールドコンデンサをアナログ出力段
に設けることによりフィードバック可能である。
本発明では、液晶として例えばねじれネマチック液晶を
用いることができるが、その他に米国特許第４３６７９
２４号公報に記載されたらせん構造をとらないカイラル
スメクティック相（例えばＣ相。
用いることができるが、その他に米国特許第４３６７９
２４号公報に記載されたらせん構造をとらないカイラル
スメクティック相（例えばＣ相。
Ｈ相等）で現われる強誘電性液晶を用いることができる
。
。
［発明の効果］
以上、説明したとおり、本発明によれば、−水子期間で
反転駆動する際に、ソース線間容量ａＳＳがパネルに存
在しても、ブロック境界近辺ラインに高輝度ラインを生
ずることなく、ブロック分割駆動を実現する液晶パネル
駆動方法を提供することができ、しかも、線間容量ＣＳ
Ｓ軽減するための配線や構成工夫も負担とならず、更に
、この補正回路はドライバーのＩＣ化に伴う回路規模の
変更負荷としては軽微なもので、コストにさほど影響を
与えない非常に経済的な効果を有する。
反転駆動する際に、ソース線間容量ａＳＳがパネルに存
在しても、ブロック境界近辺ラインに高輝度ラインを生
ずることなく、ブロック分割駆動を実現する液晶パネル
駆動方法を提供することができ、しかも、線間容量ＣＳ
Ｓ軽減するための配線や構成工夫も負担とならず、更に
、この補正回路はドライバーのＩＣ化に伴う回路規模の
変更負荷としては軽微なもので、コストにさほど影響を
与えない非常に経済的な効果を有する。
第１図は本発明の基本原理を示す構成図、第２図は本発
明の一実施例の部分回路図、第３図は従来例の構成図、
第４図はその部分回路図、第５図はチャージシェアリン
グ効果の原理図、第６図はそのタイムチャートである。 ｌ・・・ブロック分割用ＴＦＴアレイ、２・・・マトリ
クス回路、 ３・・・ソースライン・ドライバー回路、６．７，１２
．１７・・・レジスタ、 ８・・・ゲイン調整回路、９，１５・・・減算器、Ｐ・
・・表示部、 Ｇ・・・ゲートライン・ドライバ一部、Ｂ・・・ＴＰＴ
ドライバ一部、 Ｄ・・・ソースライン・ドライバ一部、ｄ Ｉ” ｄ
ｍ・・・映像データ、 ＤＩ〜Ｄ、・・・映像信号、Ｓ
１〜Ｓ、・・・ソース信号、Ｃ＋ （ＩＩ−Ｇ＠・・・
容量、ＣＳＳ・・・線間容量。
明の一実施例の部分回路図、第３図は従来例の構成図、
第４図はその部分回路図、第５図はチャージシェアリン
グ効果の原理図、第６図はそのタイムチャートである。 ｌ・・・ブロック分割用ＴＦＴアレイ、２・・・マトリ
クス回路、 ３・・・ソースライン・ドライバー回路、６．７，１２
．１７・・・レジスタ、 ８・・・ゲイン調整回路、９，１５・・・減算器、Ｐ・
・・表示部、 Ｇ・・・ゲートライン・ドライバ一部、Ｂ・・・ＴＰＴ
ドライバ一部、 Ｄ・・・ソースライン・ドライバ一部、ｄ Ｉ” ｄ
ｍ・・・映像データ、 ＤＩ〜Ｄ、・・・映像信号、Ｓ
１〜Ｓ、・・・ソース信号、Ｃ＋ （ＩＩ−Ｇ＠・・・
容量、ＣＳＳ・・・線間容量。
Claims (1)
- ＴＦＴ（薄膜トランジスタ）アクティブマトリクス回路
基板で構成される液晶表示部と、該液晶表示部の映像信
号線側に信号線の本数に対応する個数で配列されたサン
プル／ホールド用のスイッチ素子アレイと、そのスイッ
チ素子アレイを複数のブロックに分割し、時分割駆動す
るアクティブマトリクス回路と、前記スイッチ素子アレ
イの１ブロック分の信号線の本数に対応する出力線数の
外部映像信号出力回路とで構成された液晶表示パネルの
駆動方法であって、液晶表示パネルの一水平期間を反転
周期とする交流駆動により該液晶表示パネルを駆動する
際に、映像に生じるブロック毎の高輝度ラインを解消す
る演算処理を外部映像信号出力回路で映像信号へ施すこ
とにより、補正駆動を行うことを特徴とする液晶表示パ
ネルの駆動方法。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60019879A JPH0680477B2 (ja) | 1985-02-06 | 1985-02-06 | 液晶表示パネル及び駆動方法 |
| US06/823,731 US4714921A (en) | 1985-02-06 | 1986-01-29 | Display panel and method of driving the same |
| EP86101460A EP0190738B1 (en) | 1985-02-06 | 1986-02-05 | Display panel and method of driving the same |
| DE86101460T DE3689153T2 (de) | 1985-02-06 | 1986-02-05 | Anzeigetafel und Verfahren zur Steuerung dieser Tafel. |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60019879A JPH0680477B2 (ja) | 1985-02-06 | 1985-02-06 | 液晶表示パネル及び駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61180293A true JPS61180293A (ja) | 1986-08-12 |
| JPH0680477B2 JPH0680477B2 (ja) | 1994-10-12 |
Family
ID=12011490
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60019879A Expired - Lifetime JPH0680477B2 (ja) | 1985-02-06 | 1985-02-06 | 液晶表示パネル及び駆動方法 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4714921A (ja) |
| EP (1) | EP0190738B1 (ja) |
| JP (1) | JPH0680477B2 (ja) |
| DE (1) | DE3689153T2 (ja) |
Cited By (4)
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| JPS6371892A (ja) * | 1986-09-16 | 1988-04-01 | 三洋電機株式会社 | マトリクス型液晶表示装置の駆動方法 |
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| CN102955754A (zh) * | 2011-08-22 | 2013-03-06 | 海力士半导体有限公司 | 集成电路芯片和包括集成电路芯片的传输/接收系统 |
| US8436841B2 (en) | 2008-11-18 | 2013-05-07 | Canon Kabushiki Kaisha | Display apparatus |
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-
1985
- 1985-02-06 JP JP60019879A patent/JPH0680477B2/ja not_active Expired - Lifetime
-
1986
- 1986-01-29 US US06/823,731 patent/US4714921A/en not_active Expired - Lifetime
- 1986-02-05 EP EP86101460A patent/EP0190738B1/en not_active Expired - Lifetime
- 1986-02-05 DE DE86101460T patent/DE3689153T2/de not_active Expired - Lifetime
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Also Published As
| Publication number | Publication date |
|---|---|
| JPH0680477B2 (ja) | 1994-10-12 |
| US4714921A (en) | 1987-12-22 |
| EP0190738A2 (en) | 1986-08-13 |
| EP0190738B1 (en) | 1993-10-13 |
| DE3689153D1 (de) | 1993-11-18 |
| DE3689153T2 (de) | 1994-02-24 |
| EP0190738A3 (en) | 1989-05-10 |
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|---|---|---|---|
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