JPH11195739A - リードフレームの製造方法 - Google Patents
リードフレームの製造方法Info
- Publication number
- JPH11195739A JPH11195739A JP10307057A JP30705798A JPH11195739A JP H11195739 A JPH11195739 A JP H11195739A JP 10307057 A JP10307057 A JP 10307057A JP 30705798 A JP30705798 A JP 30705798A JP H11195739 A JPH11195739 A JP H11195739A
- Authority
- JP
- Japan
- Prior art keywords
- layer
- etching
- foil
- etched
- photoresist
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000004519 manufacturing process Methods 0.000 title claims abstract description 16
- 238000005530 etching Methods 0.000 claims abstract description 34
- 230000000873 masking effect Effects 0.000 claims description 4
- 229920002120 photoresistant polymer Polymers 0.000 abstract description 27
- 238000000034 method Methods 0.000 abstract description 19
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 abstract description 11
- 229910052802 copper Inorganic materials 0.000 abstract description 11
- 239000010949 copper Substances 0.000 abstract description 11
- 239000000463 material Substances 0.000 abstract description 10
- 239000007788 liquid Substances 0.000 abstract description 6
- 229910045601 alloy Inorganic materials 0.000 abstract description 2
- 239000000956 alloy Substances 0.000 abstract description 2
- 239000011888 foil Substances 0.000 description 29
- 229910052751 metal Inorganic materials 0.000 description 9
- 239000002184 metal Substances 0.000 description 9
- 239000004065 semiconductor Substances 0.000 description 5
- ORTQZVOHEJQUHG-UHFFFAOYSA-L copper(II) chloride Chemical compound Cl[Cu]Cl ORTQZVOHEJQUHG-UHFFFAOYSA-L 0.000 description 4
- 239000010953 base metal Substances 0.000 description 3
- 101100269850 Caenorhabditis elegans mask-1 gene Proteins 0.000 description 2
- 229910021578 Iron(III) chloride Inorganic materials 0.000 description 2
- KDLHZDBZIXYQEI-UHFFFAOYSA-N Palladium Chemical compound [Pd] KDLHZDBZIXYQEI-UHFFFAOYSA-N 0.000 description 2
- 239000002775 capsule Substances 0.000 description 2
- 229960003280 cupric chloride Drugs 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 2
- RBTARNINKXHZNM-UHFFFAOYSA-K iron trichloride Chemical compound Cl[Fe](Cl)Cl RBTARNINKXHZNM-UHFFFAOYSA-K 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 238000007747 plating Methods 0.000 description 2
- 229910001030 Iron–nickel alloy Inorganic materials 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- 229910052763 palladium Inorganic materials 0.000 description 1
- 229910052709 silver Inorganic materials 0.000 description 1
- 239000004332 silver Substances 0.000 description 1
- 238000005476 soldering Methods 0.000 description 1
- 239000007858 starting material Substances 0.000 description 1
- 239000000758 substrate Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49541—Geometry of the lead-frame
- H01L23/49548—Cross section geometry
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the groups H01L21/18 - H01L21/326 or H10D48/04 - H10D48/07
- H01L21/4814—Conductive parts
- H01L21/4821—Flat leads, e.g. lead frames with or without insulating supports
- H01L21/4828—Etching
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
Landscapes
- Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Geometry (AREA)
- Manufacturing & Machinery (AREA)
- Lead Frames For Integrated Circuits (AREA)
- ing And Chemical Polishing (AREA)
Abstract
(57)【要約】
【課題】リードフレームの製造方法を提供すること。
【解決手段】この方法は、一対の上下の両主面を有する
電気的導電性層(11)を与えるステップを含む。パターン
は、前記層を通して部分的に広がる層においてエッチさ
れ、前記層の側壁を有するキャビティ(15)を形成する。
パターン化されたマスク(17)が前記側壁のマスキングを
含むエッチされた層上に設けられる。この層は、キャビ
ティ内で再度エッチ(21)される。パターン化されたマス
クは、好ましくは液体のホトレジストであり、電気的導
電性層は、好ましくは銅又は銅ベースの材料、或いはAL
LOY 42の1つを含むのが好ましい。このエッチは、両主
面から生じる。これによりアンダーカットは最小にされ
る。
電気的導電性層(11)を与えるステップを含む。パターン
は、前記層を通して部分的に広がる層においてエッチさ
れ、前記層の側壁を有するキャビティ(15)を形成する。
パターン化されたマスク(17)が前記側壁のマスキングを
含むエッチされた層上に設けられる。この層は、キャビ
ティ内で再度エッチ(21)される。パターン化されたマス
クは、好ましくは液体のホトレジストであり、電気的導
電性層は、好ましくは銅又は銅ベースの材料、或いはAL
LOY 42の1つを含むのが好ましい。このエッチは、両主
面から生じる。これによりアンダーカットは最小にされ
る。
Description
【0001】
【発明の属する技術分野】本発明は、半導体デバイスに
おいて使用するためのリードフレームの製造方法に関す
る。
おいて使用するためのリードフレームの製造方法に関す
る。
【0002】
【従来の技術】リードフレームは、半導体デバイスの製
造に利用される標準的な要素である。一般に、半導体デ
バイスの製造中に、半導体チップは、チップ上のボンド
パッドに接合され、チップ上のボンドパッドからリード
フレーム上のリードフィンガーに延びる細い金のワイヤ
リードを有するリードフレームの中央部分に固定され
る。このリードフレームとチップは、続いて、例えばプ
リントされたワイヤリングボード(PWB)のような外
周部へ接続するため、カプセルの外方へ延びるリードフ
レームのリードフリンガの一部と共に囲われる。比較的
大きな寸法及び/叉は比較的少ないピン数を有するリー
ドフレームは、金型打ち抜きによって金属シートから作
られる。しかし、リード間で利用可能なピッチが減少す
る場合、リードフレームは、米国特許5,221,428号に記
載されているように、電気的に導電性の薄いシート或い
はホイルのマスキングとエッチングの使用によって製造
される。現在の金属打ち抜き技術は、エッチングのそれ
とほぼ等しい能力に達しているけれども、エッチング
は、特に非常にピン数の多いリードフレームの金属の打
ち抜き具はコストが高いために、新しい設計や小さなも
のの製造にまだ向いている。
造に利用される標準的な要素である。一般に、半導体デ
バイスの製造中に、半導体チップは、チップ上のボンド
パッドに接合され、チップ上のボンドパッドからリード
フレーム上のリードフィンガーに延びる細い金のワイヤ
リードを有するリードフレームの中央部分に固定され
る。このリードフレームとチップは、続いて、例えばプ
リントされたワイヤリングボード(PWB)のような外
周部へ接続するため、カプセルの外方へ延びるリードフ
レームのリードフリンガの一部と共に囲われる。比較的
大きな寸法及び/叉は比較的少ないピン数を有するリー
ドフレームは、金型打ち抜きによって金属シートから作
られる。しかし、リード間で利用可能なピッチが減少す
る場合、リードフレームは、米国特許5,221,428号に記
載されているように、電気的に導電性の薄いシート或い
はホイルのマスキングとエッチングの使用によって製造
される。現在の金属打ち抜き技術は、エッチングのそれ
とほぼ等しい能力に達しているけれども、エッチング
は、特に非常にピン数の多いリードフレームの金属の打
ち抜き具はコストが高いために、新しい設計や小さなも
のの製造にまだ向いている。
【0003】エッチングによってリードフレームを作る
ために、製造されるべきリードフレーム形状のホトレジ
ストパターンが例えば、ホイル、一般に銅或いは銅ベー
スの材料、またはALLOY42のような低膨張の鉄−ニッケ
ル合金のような電気的導電性金属の両側に設けられる。
その後、ホイル上にパターン化したホトレジストを有す
るこのホイルは、エッチャーを通過される。そこでホト
レジストによってマスクされない金属は、例えば、塩化
第二鉄叉は塩化第二銅で、エッチングによって除去され
る。エッチングの後、ホトレジストは、取り除かれ、リ
ードフレームは一部或いは全部をメッキするために任意
に用意される。メッキとして、もし、一般にパラジウ
ム、選択的な銀或いは金が利用されるならば、例えば金
属のボンディング及びはんだ特性を改善する。このエッ
チング工程の間、ホイルは、アンダーエッチング或いは
アンダーカッティングされる。ここで金属ホイルがエッ
チングされるにしたがって、エッチング除去されるパタ
ーンは、レジストの下でエッチングされる部分のために
元のレジストパターンの開けられた面積より幾らか大き
い。
ために、製造されるべきリードフレーム形状のホトレジ
ストパターンが例えば、ホイル、一般に銅或いは銅ベー
スの材料、またはALLOY42のような低膨張の鉄−ニッケ
ル合金のような電気的導電性金属の両側に設けられる。
その後、ホイル上にパターン化したホトレジストを有す
るこのホイルは、エッチャーを通過される。そこでホト
レジストによってマスクされない金属は、例えば、塩化
第二鉄叉は塩化第二銅で、エッチングによって除去され
る。エッチングの後、ホトレジストは、取り除かれ、リ
ードフレームは一部或いは全部をメッキするために任意
に用意される。メッキとして、もし、一般にパラジウ
ム、選択的な銀或いは金が利用されるならば、例えば金
属のボンディング及びはんだ特性を改善する。このエッ
チング工程の間、ホイルは、アンダーエッチング或いは
アンダーカッティングされる。ここで金属ホイルがエッ
チングされるにしたがって、エッチング除去されるパタ
ーンは、レジストの下でエッチングされる部分のために
元のレジストパターンの開けられた面積より幾らか大き
い。
【0004】アンダーカットは、ホイルの厚さに関係
し、ホイルの厚さが増加するにつれて増加する。上述の
ように、この効果は、エチャントは、ホイル表面下方或
いは面に垂直にエッチングするばかりでなく、幾らかゆ
っくりした速度で、ホイル面の横側もエッチングすると
言う事実によって起こされる。標準の製造技術において
は、この効果はホトレジストパターンをバイアスするこ
とによって補償される。しかし、もし、半導体の製造に
必要とされる小さな形状と共に用いられるリードフレー
ムに対して必要とされる、非常に細かな孔が比較的厚い
ホイルに作られる場合、それらが理論的に存在しない程
度にレジストの孔の幅を減少する必要がある。これは可
能なシナリオでないので、与えられたホイルの厚さに対
して、エッチングされる最小のスロット幅には制限があ
る。
し、ホイルの厚さが増加するにつれて増加する。上述の
ように、この効果は、エチャントは、ホイル表面下方或
いは面に垂直にエッチングするばかりでなく、幾らかゆ
っくりした速度で、ホイル面の横側もエッチングすると
言う事実によって起こされる。標準の製造技術において
は、この効果はホトレジストパターンをバイアスするこ
とによって補償される。しかし、もし、半導体の製造に
必要とされる小さな形状と共に用いられるリードフレー
ムに対して必要とされる、非常に細かな孔が比較的厚い
ホイルに作られる場合、それらが理論的に存在しない程
度にレジストの孔の幅を減少する必要がある。これは可
能なシナリオでないので、与えられたホイルの厚さに対
して、エッチングされる最小のスロット幅には制限があ
る。
【0005】従って、与えられたホイルの厚さに対して
従来技術で応じることができる孔より狭い孔がエッチン
グされる新しい技術が必要であることは明らかである。
このような新しい技術は、米国特許第5,221,428号に記
載されている。ここで従来技術のアンダーカットは、ホ
イルの選択された部分の厚さを減少し、かつ両主面から
エッチングすることによって減少されることが記載され
ている。アンダーカットが減少される一方で、ホイルの
面に垂直なエッチングを行うにしたがって、横方向のエ
ッチングが半分の速度で起きる。
従来技術で応じることができる孔より狭い孔がエッチン
グされる新しい技術が必要であることは明らかである。
このような新しい技術は、米国特許第5,221,428号に記
載されている。ここで従来技術のアンダーカットは、ホ
イルの選択された部分の厚さを減少し、かつ両主面から
エッチングすることによって減少されることが記載され
ている。アンダーカットが減少される一方で、ホイルの
面に垂直なエッチングを行うにしたがって、横方向のエ
ッチングが半分の速度で起きる。
【0006】
【発明の概要】本発明によると、アンダーカットの上記
問題が最小にされる。要約すれば、リードフレームの外
部のリードフィンガー領域において、集積回路のアッセ
ンブリばかりでなくプリント回路板上の集積回路の最近
のアッセンブリは、既知の最小の材料厚を有することに
よってのみ得られることができる一定の機械的強度を必
要とする。代表的には、プラスチックのカプセル内にあ
る内部のリードのみが非常に狭い孔を有する非常に細か
なパターンを有する。外側の領域において、ギャップは
非常に広い。従来技術の解決手段は、エッチングプロセ
スを通る分離した通路においてエッチングすることによ
って内部リード領域の材料の厚さを減少することであっ
た。
問題が最小にされる。要約すれば、リードフレームの外
部のリードフィンガー領域において、集積回路のアッセ
ンブリばかりでなくプリント回路板上の集積回路の最近
のアッセンブリは、既知の最小の材料厚を有することに
よってのみ得られることができる一定の機械的強度を必
要とする。代表的には、プラスチックのカプセル内にあ
る内部のリードのみが非常に狭い孔を有する非常に細か
なパターンを有する。外側の領域において、ギャップは
非常に広い。従来技術の解決手段は、エッチングプロセ
スを通る分離した通路においてエッチングすることによ
って内部リード領域の材料の厚さを減少することであっ
た。
【0007】エッチングは、ホイルの一方或いは両側、
好ましくはホイルの両側から行われた。最初のエッチン
グステップが完了した後、リードフレームをエッチング
するための標準のエッチングプロセスがエッチキャビテ
ィの垂直側をしっかり覆うために用いられているホトレ
ジストと共に一体にされる。この従来技術の解決手段
は、本発明によって、第1のホトレジストの堆積後、残
される材料の厚さが求められる細かな形状の製造を可能
にするのに十分薄くなったらすぐに、ホイルのエッチン
グを停止することによって変更される。その後、第1の
レジストがはがされ、部分的にエッチされたホイルは、
標準の方法でクリーニングされ、そしてホイルと前のエ
ッチングプロセス中にホイルにエッチングされたキャビ
ティを覆う第2の、好ましくは液体のホトレジストが与
えられる。第2の液体のホトレジストは、ホイルの一方
或いは両方の側から与えられることができる。その後第
2のホトレジストはパターン化され、露光され、第2の
露光されたホトレジストによってマスクされて、形成さ
れたキャビティに沿って側壁を残す。第2のホトレジス
トを感光した後、基板は再び側壁上に第2のホトレジス
トがあるために最小化されたアンダーカットを伴ってエ
ッチングされる。従って、アンダーカットは最小にされ
る。第2のホトレジストは除去され、処理は標準の方法
で続く。
好ましくはホイルの両側から行われた。最初のエッチン
グステップが完了した後、リードフレームをエッチング
するための標準のエッチングプロセスがエッチキャビテ
ィの垂直側をしっかり覆うために用いられているホトレ
ジストと共に一体にされる。この従来技術の解決手段
は、本発明によって、第1のホトレジストの堆積後、残
される材料の厚さが求められる細かな形状の製造を可能
にするのに十分薄くなったらすぐに、ホイルのエッチン
グを停止することによって変更される。その後、第1の
レジストがはがされ、部分的にエッチされたホイルは、
標準の方法でクリーニングされ、そしてホイルと前のエ
ッチングプロセス中にホイルにエッチングされたキャビ
ティを覆う第2の、好ましくは液体のホトレジストが与
えられる。第2の液体のホトレジストは、ホイルの一方
或いは両方の側から与えられることができる。その後第
2のホトレジストはパターン化され、露光され、第2の
露光されたホトレジストによってマスクされて、形成さ
れたキャビティに沿って側壁を残す。第2のホトレジス
トを感光した後、基板は再び側壁上に第2のホトレジス
トがあるために最小化されたアンダーカットを伴ってエ
ッチングされる。従って、アンダーカットは最小にされ
る。第2のホトレジストは除去され、処理は標準の方法
で続く。
【0008】
【発明の実施の形態】まず、第1図を参照すると、リー
ドフレームの製造において標準のエッチング技術を用い
たときに生じるアンダーカットを示す概略図である。図
示されているように、パターン化されたマスク1がホイ
ル3の両側に配置されて、そのマスクの開口5を通し
て、かつマスクの表面に垂直に所望のエッチングが生じ
る。しかし、横側がエッチングされるために、マスク1
の下にアンダーカットが生じ、それによりマスクの下の
ホイル材料7が開口5の直接下にあるホイル材料といっ
しょに除去される。多くの場合、例えばマスクの下に残
っているホイルの形状が小さい場合、アンダーカット
は、ホイルを完全に除去するか、或いは電気的導通が妨
げられる程度までホイルを薄くすることによって、ホイ
ルの電気的特性を著しく損なう。本発明は、このアンダ
ーカットの問題を最小にする。
ドフレームの製造において標準のエッチング技術を用い
たときに生じるアンダーカットを示す概略図である。図
示されているように、パターン化されたマスク1がホイ
ル3の両側に配置されて、そのマスクの開口5を通し
て、かつマスクの表面に垂直に所望のエッチングが生じ
る。しかし、横側がエッチングされるために、マスク1
の下にアンダーカットが生じ、それによりマスクの下の
ホイル材料7が開口5の直接下にあるホイル材料といっ
しょに除去される。多くの場合、例えばマスクの下に残
っているホイルの形状が小さい場合、アンダーカット
は、ホイルを完全に除去するか、或いは電気的導通が妨
げられる程度までホイルを薄くすることによって、ホイ
ルの電気的特性を著しく損なう。本発明は、このアンダ
ーカットの問題を最小にする。
【0009】図2(A)を参照すると、電気的に導電性
のベース金属が示されているが、銅或いは銅ベース化さ
れたホイルの開始材料11に限定されない。金属11は
ホトレジスト13、好ましくはネガティブレジスト及び
好ましくは両主面上のホトレジスト13で覆われ、この
ホトレジストは標準的な方法でマスクされそして露光さ
れ、かつ図2(B)に示される標準的な方法で除去され
る露光されたホトマスクと共に現像される。レジストの
感光後、像は、内部リードの少なくとも狭い部分が露出
した銅を有するように作られる。金属は塩化第二鉄叉は
塩化第二銅でスプレイされ、ベース金属のエッチングを
行い、残っている材料の厚さが十分に薄くなったらすぐ
にそのエッチングを停止し、キャビティ15を形成し、
図2(C)に示される所望の細かな形状の製造を可能に
する。その時エッチャント及びホトレジストは標準的な
方法で、取り去られる。全体のベース金属11及びキャ
ビティ15は、ホトレジスト17、好ましくはポジティ
ブレジスト及び好ましくは液体で覆われ、キャビティ1
5の側壁を覆う。その後、ホトレジスト17は、図2
(D)に示されるように標準的な方法で、パターン化さ
れ、露光され、そして現像される。パターンは、図2
(E)に示されるように再度エッチングされ、その後ホ
トレジスト17は、図2(F)に示されるリードフレー
ムからはがされ、リードフレーム製造のこのフェーズを
完了する。図2(E)から判るように、アンダーカット
19の量は、実質的に減少され、第2のエッチングステ
ップ中にエッチされた領域21の小さな部分に限定され
る。
のベース金属が示されているが、銅或いは銅ベース化さ
れたホイルの開始材料11に限定されない。金属11は
ホトレジスト13、好ましくはネガティブレジスト及び
好ましくは両主面上のホトレジスト13で覆われ、この
ホトレジストは標準的な方法でマスクされそして露光さ
れ、かつ図2(B)に示される標準的な方法で除去され
る露光されたホトマスクと共に現像される。レジストの
感光後、像は、内部リードの少なくとも狭い部分が露出
した銅を有するように作られる。金属は塩化第二鉄叉は
塩化第二銅でスプレイされ、ベース金属のエッチングを
行い、残っている材料の厚さが十分に薄くなったらすぐ
にそのエッチングを停止し、キャビティ15を形成し、
図2(C)に示される所望の細かな形状の製造を可能に
する。その時エッチャント及びホトレジストは標準的な
方法で、取り去られる。全体のベース金属11及びキャ
ビティ15は、ホトレジスト17、好ましくはポジティ
ブレジスト及び好ましくは液体で覆われ、キャビティ1
5の側壁を覆う。その後、ホトレジスト17は、図2
(D)に示されるように標準的な方法で、パターン化さ
れ、露光され、そして現像される。パターンは、図2
(E)に示されるように再度エッチングされ、その後ホ
トレジスト17は、図2(F)に示されるリードフレー
ムからはがされ、リードフレーム製造のこのフェーズを
完了する。図2(E)から判るように、アンダーカット
19の量は、実質的に減少され、第2のエッチングステ
ップ中にエッチされた領域21の小さな部分に限定され
る。
【0010】本発明は、その特定の好適な実施形態に関
して説明されたが、多くの変更及び変形が当業者に直ち
に明らかになるであろう。したがって、特許請求の範囲
は、従来技術に照らして可能な限り広く、これらの全て
の変更や変形を含むように解釈されるべきである。以上
の記載に関連して、以下の各項を開示する。 (1)リードフレームを製造する方法であって、(a)
一対の上下の主面を有する電気的導電層を備えるステッ
プと、(b)前記層を通して部分的に広がる前記層にお
けるパターンをエッチングして、前記層に側壁を有する
キャビティを形成するステップと、(c)前記側壁のマ
スキングを含む、前記層上にパターン化したマスクを与
えるステップと、(d)前記キャビティ内の前記層を再
度エッチングするステップを有することを特徴とする方
法。 (2)前記パターン化されたマスクは、液体のホトレジ
ストであることを特徴とする前記(1)に記載の方法。 (3)前記電気的導電層は、銅或いは銅ベース材料の一
つであることを特徴とする前記(1)に記載の方法。 (4)前記エッチングは、前記主面の双方から生じるこ
とを特徴とする前記(1)に記載の方法。 (5)前記エッチングは、前記主面の双方から生じるこ
とを特徴とする前記(2)に記載の方法。 (6)前記エッチングは、前記主面の双方から生じるこ
とを特徴とする前記(3)に記載の方法。 (7)前記ステップ(d)におけるエッチングは、前記
キャビティの少なくとも1部を通して全体的にエッチン
グするステップを含むことを特徴とする前記(1)に記
載の方法。 (8)前記パターン化されたマスクは、ポジティブ叉は
ネガティブホトレジストの一方から形成され、パターン
をエッチングする前記ステップは、ポジティブ叉はネガ
ティブホトレジストの他方を用いて行われることを特徴
とする前記(1)に記載の方法。 (9)リードフレームの製造方法。この方法は、一対の
上下の両主面を有する電気的導電性層(11)を与えるステ
ップを含む。パターンは、前記層を通して部分的に延び
る層においてエッチングされ、前記層の側壁を有するキ
ャビティ(15)を形成する。パターン化されたマスク(17)
が前記側壁のマスキングを含むエッチされた層上に設け
られる。この層は、キャビティ内で再度エッチング(21)
される。パターン化されたマスクは、好ましくは液体の
ホトレジストであり、電気的導電性層は、好ましくは銅
又は銅ベースの材料、或いはALLOY 42の1つを含むのが
好ましい。このエッチングは、両主面から生じる。
して説明されたが、多くの変更及び変形が当業者に直ち
に明らかになるであろう。したがって、特許請求の範囲
は、従来技術に照らして可能な限り広く、これらの全て
の変更や変形を含むように解釈されるべきである。以上
の記載に関連して、以下の各項を開示する。 (1)リードフレームを製造する方法であって、(a)
一対の上下の主面を有する電気的導電層を備えるステッ
プと、(b)前記層を通して部分的に広がる前記層にお
けるパターンをエッチングして、前記層に側壁を有する
キャビティを形成するステップと、(c)前記側壁のマ
スキングを含む、前記層上にパターン化したマスクを与
えるステップと、(d)前記キャビティ内の前記層を再
度エッチングするステップを有することを特徴とする方
法。 (2)前記パターン化されたマスクは、液体のホトレジ
ストであることを特徴とする前記(1)に記載の方法。 (3)前記電気的導電層は、銅或いは銅ベース材料の一
つであることを特徴とする前記(1)に記載の方法。 (4)前記エッチングは、前記主面の双方から生じるこ
とを特徴とする前記(1)に記載の方法。 (5)前記エッチングは、前記主面の双方から生じるこ
とを特徴とする前記(2)に記載の方法。 (6)前記エッチングは、前記主面の双方から生じるこ
とを特徴とする前記(3)に記載の方法。 (7)前記ステップ(d)におけるエッチングは、前記
キャビティの少なくとも1部を通して全体的にエッチン
グするステップを含むことを特徴とする前記(1)に記
載の方法。 (8)前記パターン化されたマスクは、ポジティブ叉は
ネガティブホトレジストの一方から形成され、パターン
をエッチングする前記ステップは、ポジティブ叉はネガ
ティブホトレジストの他方を用いて行われることを特徴
とする前記(1)に記載の方法。 (9)リードフレームの製造方法。この方法は、一対の
上下の両主面を有する電気的導電性層(11)を与えるステ
ップを含む。パターンは、前記層を通して部分的に延び
る層においてエッチングされ、前記層の側壁を有するキ
ャビティ(15)を形成する。パターン化されたマスク(17)
が前記側壁のマスキングを含むエッチされた層上に設け
られる。この層は、キャビティ内で再度エッチング(21)
される。パターン化されたマスクは、好ましくは液体の
ホトレジストであり、電気的導電性層は、好ましくは銅
又は銅ベースの材料、或いはALLOY 42の1つを含むのが
好ましい。このエッチングは、両主面から生じる。
【図1】従来技術によるリードフレームのエッチング中
のアンダーカットを示す概略図である。
のアンダーカットを示す概略図である。
【図2】(A)−(F)は、本発明によるリードフレー
ムの製造のためのプロセスを示す。
ムの製造のためのプロセスを示す。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ロナルド ビー ウィーロック アメリカ合衆国 マサチューセッツ州 02703アッテルボロ イングリアム スト リート 35
Claims (1)
- 【請求項1】リードフレームを製造する方法であって、
(a)一対の上下の主面を有する電気的導電層を備える
ステップと、(b)前記層を通して部分的に広がる前記
層におけるパターンをエッチングして、前記層に側壁を
有するキャビティを形成するステップと、(c)前記側
壁のマスキングを含む、前記層上にパターン化したマス
クを与えるステップと、(d)前記キャビティ内の前記
層を再度エッチングするステップを有することを特徴と
する方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US6355397P | 1997-10-28 | 1997-10-28 | |
US60/063553 | 1997-10-28 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH11195739A true JPH11195739A (ja) | 1999-07-21 |
Family
ID=22049984
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10307057A Pending JPH11195739A (ja) | 1997-10-28 | 1998-10-28 | リードフレームの製造方法 |
Country Status (3)
Country | Link |
---|---|
US (1) | US6635407B1 (ja) |
EP (1) | EP0921562A3 (ja) |
JP (1) | JPH11195739A (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
TWI264099B (en) | 2001-07-09 | 2006-10-11 | Sumitomo Metal Mining Co | Lead frame and manufacturing method therefor |
US7005241B2 (en) * | 2003-06-09 | 2006-02-28 | Shinko Electric Industries Co., Ltd. | Process for making circuit board or lead frame |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE2113829A1 (de) * | 1971-03-23 | 1972-10-05 | Interelectric Ag | AEtzverfahren zum Herstellen eines Systemtraegers fuer integrierte Schaltkreise |
JPS61170053A (ja) | 1985-01-23 | 1986-07-31 | Nec Corp | 半導体装置用リ−ドフレ−ム |
JP2797542B2 (ja) * | 1989-11-06 | 1998-09-17 | ソニー株式会社 | リードフレームの製造方法 |
JPH0529520A (ja) | 1991-07-24 | 1993-02-05 | Sony Corp | リードフレームとその製造方法 |
JPH05102364A (ja) | 1991-10-11 | 1993-04-23 | Rohm Co Ltd | 電子部品用リードフレームの製造方法 |
JP2632456B2 (ja) | 1991-10-23 | 1997-07-23 | 株式会社三井ハイテック | リードフレームの製造方法 |
JPH07335804A (ja) * | 1994-06-14 | 1995-12-22 | Dainippon Printing Co Ltd | リードフレーム及びリードフレームの製造方法 |
US5454905A (en) * | 1994-08-09 | 1995-10-03 | National Semiconductor Corporation | Method for manufacturing fine pitch lead frame |
US5847460A (en) * | 1995-12-19 | 1998-12-08 | Stmicroelectronics, Inc. | Submicron contacts and vias in an integrated circuit |
-
1998
- 1998-10-26 EP EP98203611A patent/EP0921562A3/en not_active Withdrawn
- 1998-10-26 US US09/178,848 patent/US6635407B1/en not_active Expired - Lifetime
- 1998-10-28 JP JP10307057A patent/JPH11195739A/ja active Pending
Also Published As
Publication number | Publication date |
---|---|
US6635407B1 (en) | 2003-10-21 |
EP0921562A3 (en) | 2002-06-05 |
EP0921562A2 (en) | 1999-06-09 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR100297464B1 (ko) | 수지봉지형반도체장치와그것에사용되는회로부재및수지봉지형반도체장치의제조방법 | |
US7307347B2 (en) | Resin-encapsulated package, lead member for the same and method of fabricating the lead member | |
US7521295B2 (en) | Leadframe and method of manufacturing the same | |
JPH07297149A (ja) | 半導体装置とその製造方法 | |
US6348416B1 (en) | Carrier substrate for producing semiconductor device | |
US6008068A (en) | Process for etching a semiconductor lead frame | |
US6635407B1 (en) | Two pass process for producing a fine pitch lead frame by etching | |
JP2001007274A (ja) | 樹脂封止型半導体装置とそれに用いられる回路部材および回路部材の製造方法 | |
JPH05102364A (ja) | 電子部品用リードフレームの製造方法 | |
JP4457532B2 (ja) | リードフレームの製造方法 | |
JP3699573B2 (ja) | 半導体装置とそれに用いられる回路部材およびそれらの製造方法 | |
JP3884552B2 (ja) | 半導体装置とそれに用いられる回路部材および半導体装置の製造方法 | |
JPH08316392A (ja) | リードフレームの製造方法とリードフレーム | |
JP3569642B2 (ja) | 半導体装置用キャリア基板及びその製造方法及び半導体装置の製造方法 | |
JPH098194A (ja) | リードフレーム製造方法 | |
JPH0582708A (ja) | リードフレームおよびその製造方法 | |
JP2005123363A (ja) | Bcc用リードフレームとその製造方法及びこれを用いた半導体装置 | |
JPH11260988A (ja) | リードフレーム及びその製造方法 | |
JP2005260271A (ja) | 樹脂封止型半導体装置用の回路部材 | |
JPH10144840A (ja) | リードフレームの加工方法およびリードフレーム | |
JP2000332184A (ja) | リードフレーム部材とそれを用いた樹脂封止型半導体装置およびリードフレーム部材の製造方法 | |
JP2003051574A (ja) | リードフレームの製造方法 | |
JP2000156428A (ja) | Bga用リードフレーム | |
JP2005260270A (ja) | 樹脂封止型半導体装置およびその製造方法 | |
JPH10116948A (ja) | リードフレーム部材の製造方法およびリードフレーム部材 |