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JPH0922960A - Multichip module device and manufacturing method thereof - Google Patents

Multichip module device and manufacturing method thereof

Info

Publication number
JPH0922960A
JPH0922960A JP7172323A JP17232395A JPH0922960A JP H0922960 A JPH0922960 A JP H0922960A JP 7172323 A JP7172323 A JP 7172323A JP 17232395 A JP17232395 A JP 17232395A JP H0922960 A JPH0922960 A JP H0922960A
Authority
JP
Japan
Prior art keywords
substrate
laminated
terminal
terminal portion
insulating layer
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP7172323A
Other languages
Japanese (ja)
Inventor
Shigeo Ikeda
重男 池田
Yoshimi Hirata
芳美 平田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sony Corp
Original Assignee
Sony Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sony Corp filed Critical Sony Corp
Priority to JP7172323A priority Critical patent/JPH0922960A/en
Publication of JPH0922960A publication Critical patent/JPH0922960A/en
Pending legal-status Critical Current

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    • H10W90/724

Landscapes

  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)

Abstract

(57)【要約】 【課題】 パッケージの形成を容易に、またこのパッケ
ージからの外部端子導出を、正確に、かつ高い信頼性を
もって廉価に、またこれの製造に伴う初期の投資額を廉
価にすることができるようにする。 【解決手段】 それぞれ導電層による複数の端子素子1
が絶縁層2を介して相互に積層されて一体化された積層
端子部3を構成する。そして、この積層端子部3が基板
4に配置され、この積層端子部を有する基板上に、もし
くはこの基板上に配置された他の基板上に部品チップ7
をマウントする。この積層端子部3を有する基板4上に
部品チップを覆って封止樹脂モールド体9を施して積層
端子部3を有する基板4と封止樹脂モールド体9とによ
ってパッケージを構成し、積層端子部3の端子素子1の
少なくとも一端をパッケージより外部に導出した構成と
する。
(57) 【Abstract】 PROBLEM TO BE SOLVED: To easily form a package, to obtain an external terminal from this package accurately and with high reliability, to reduce the cost, and to reduce the initial investment amount associated with the manufacturing thereof. To be able to. A plurality of terminal elements each having a conductive layer
Constitute a laminated terminal portion 3 which is laminated and integrated with each other via the insulating layer 2. The laminated terminal portion 3 is arranged on the substrate 4, and the component chip 7 is arranged on the substrate having the laminated terminal portion or on another substrate arranged on the substrate.
To mount. A sealing resin mold body 9 is applied to a substrate 4 having the laminated terminal portion 3 to cover a component chip to form a package by the substrate 4 having the laminated terminal portion 3 and the sealing resin molded body 9. At least one end of the terminal element 1 of No. 3 is led out from the package.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の属する技術分野】本発明マルチチップモジュー
ル装置とその製造方法に係わる。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a multichip module device and a manufacturing method thereof.

【0002】[0002]

【従来の技術】複数の半導体チップ、例えばIC(集積
回路)チップ等の部品チップがマウントされて所要の電
子回路部が構成されるマルチチップモジュール装置にお
いては、そのパッケージとこれよりの外部端子の導出
が、装置の信頼性、生産性等において問題となる。
2. Description of the Related Art In a multi-chip module device in which a plurality of semiconductor chips, for example, component chips such as IC (integrated circuit) chips are mounted to construct a required electronic circuit portion, the package and external terminals from the package are connected. Derivation is a problem in terms of device reliability and productivity.

【0003】すなわち、この種マルチチップモジュール
装置は、プリント基板等の他の外部配線部に電気的に接
続するための外部への端子導出がなされ、これら端子
を、対応する所定の外部配線部例えばプリント配線に例
えば半田付け等によって電気的に接続され、例えばプリ
ント基板へのマルチチップモジュール装置のマウントあ
るいは外部端子リードの導出がなされる。
That is, in this type of multi-chip module device, terminals are led to the outside for electrically connecting to other external wiring parts such as a printed circuit board, and these terminals are connected to corresponding predetermined external wiring parts, for example. It is electrically connected to the printed wiring, for example, by soldering or the like, and for example, the multichip module device is mounted on the printed circuit board or the external terminal lead is led out.

【0004】ところで、この場合、外部配線部のプリン
ト基板等への電気的、機械的連結を安定に、したがって
高い信頼性をもって、能率良く行うことができるように
するには、マルチチップモジュール装置の製造におい
て、その複数の外部端子が所定の位置に、所定量突出し
て形成することが望まれる。
By the way, in this case, in order to enable stable electrical and mechanical connection of the external wiring portion to the printed circuit board or the like, and thus with high reliability and efficiency, a multi-chip module device is required. In manufacturing, it is desired that the plurality of external terminals be formed at predetermined positions so as to protrude by a predetermined amount.

【0005】従来、マルチチップモジュール装置におけ
るパッケージおよび外部端子導出の態様として、種々の
方法が提案されているが、一般的方法としては、トラン
スファーモールド構成、セラミックパッケージ等による
ものがあるが、いづれの場合も、多数の外部端子ピンの
導出位置の設定を正確に行うに問題があり、またその製
造装置、例えばその成型の型、これに伴う装置等の初期
の投資額が大きいため、特に少量で多種類のマルチチッ
プモジュール装置を製造する上で、コスト高を来すとい
う問題がある。更に、セラミックパッケージは、これ自
体高価であるという問題がある。
Conventionally, various methods have been proposed as modes of deriving a package and external terminals in a multi-chip module device, but as a general method, there are a transfer mold configuration, a ceramic package, and the like. In this case, there is a problem in accurately setting the lead-out positions of a large number of external terminal pins.Because the initial investment amount of the manufacturing equipment, for example, the molding die and the equipment accompanying it, is large, it is necessary to use a particularly small amount. There is a problem that the cost is increased in manufacturing various kinds of multi-chip module devices. Further, the ceramic package has a problem that it is expensive in itself.

【0006】[0006]

【発明が解決しようとする課題】本発明は、上述した問
題の解決すなわちマルチチップモジュール装置における
パッケージの形成を容易に、またこのパッケージからの
外部端子導出を、正確に、かつ高い信頼性をもって廉価
に、またこれの製造に伴う初期の投資額を廉価にするこ
とができるようにして少量多品種のマルチチップモジュ
ール装置に適用して好適ならしめたマルチチップモジュ
ール装置とその製造方法を提供するものである。
SUMMARY OF THE INVENTION The present invention solves the above-mentioned problems, that is, facilitates the formation of a package in a multi-chip module device, and leads external terminals from this package accurately and with high reliability at a low cost. In addition, the present invention provides a multi-chip module device suitable for use in a small-quantity multi-kind multi-chip module device and a manufacturing method thereof so that the initial investment amount associated with the manufacture thereof can be reduced. Is.

【0007】[0007]

【課題を解決するための手段】本発明によるマルチチッ
プモジュール装置は、それぞれ導電層による複数の端子
素子が絶縁層を介して相互に積層されて一体化された積
層端子部を構成する。そして、この積層端子部が基板に
配置され、この積層端子部を有する基板上に、もしくは
この基板上に配置された他の基板上に部品チップをマウ
ントする。この積層端子部を有する基板上に部品チップ
を覆って封止樹脂モールド体を施して積層端子部を有す
る基板と封止樹脂モールド体とによってパッケージを構
成し、積層端子部の端子素子の少なくとも一端をパッケ
ージより外部に導出した構成とする。
In the multichip module device according to the present invention, a plurality of terminal elements each made of a conductive layer are laminated on each other via an insulating layer to form a laminated terminal portion. Then, this laminated terminal portion is arranged on the substrate, and the component chip is mounted on the substrate having this laminated terminal portion or on another substrate arranged on this substrate. At least one end of the terminal element of the laminated terminal portion is formed by covering the component chip on the substrate having the laminated terminal portion and applying the sealing resin molded body to form a package by the substrate having the laminated terminal portion and the sealing resin molded body. Is derived from the package to the outside.

【0008】また、本発明によるマルチチップモジュー
ル装置の製造方法においては、導電層が絶縁層を介して
積層されてなる積層ブロックを作製する工程と、この積
層ブロックを上記導電層と上記絶縁層とを横切る方向に
所要の厚さに切断する工程と、この切断体の、上記導電
層と上記絶縁層とが交互に配列されて臨む少なくとも一
方の面に対してこの面から所要の深さに各導電層間の絶
縁層を除去して、この面に各導電層よりなる端子素子の
少なくとも一端を突出させる突出処理工程とを採って複
数の端子素子が絶縁層を介して積層されてなる積層端子
部を形成し、この積層端子部を、基板に配置する工程
と、積層端子部を有する基板上に、もしくはこの基板上
に配置される他の基板上に部品チップをマウントする工
程と、積層端子部を有する基板上に部品チップを覆い、
かつ積層端子部の端子層の少なくとも一端を外部に導出
して封止樹脂モールド体のモールド工程とを採って積層
端子を有する基板と封止樹脂モールド体とによってパッ
ケージを構成し、積層端子部の端子素子の少なくとも一
端をパッケージより外部に導出した構成のマルチチップ
モジュール装置を作製する。
Further, in the method of manufacturing a multi-chip module device according to the present invention, a step of producing a laminated block in which conductive layers are laminated with an insulating layer interposed between the conductive layer and the insulating layer is performed. And a step of cutting to a required thickness in a direction crossing, and at least one surface of the cut body facing the conductive layers and the insulating layers alternately arranged to a required depth from this surface. A laminated terminal portion in which a plurality of terminal elements are laminated with an insulating layer between them by removing the insulating layer between the conductive layers and adopting a protrusion treatment step of protruding at least one end of the terminal element made of each conductive layer on this surface. And placing the laminated terminal portion on a substrate, mounting a component chip on a substrate having the laminated terminal portion, or on another substrate arranged on this substrate, and the laminated terminal portion. To Covering the component chips on a substrate to,
In addition, at least one end of the terminal layer of the laminated terminal portion is led to the outside and a molding process of the encapsulating resin molded body is adopted to form a package with the substrate having the laminated terminal and the encapsulating resin molded body. A multi-chip module device having a structure in which at least one end of a terminal element is led out of a package is manufactured.

【0009】本発明装置および本発明方法によれば、積
層端子部を外部導出端子とするものであり、この積層端
子部は、それぞれ導電層よりなる複数の端子素子が絶縁
層を介して積層された構成とするものであることから、
相互の位置関係を正確に設定できる。そして、このよう
に複数の端子が積層されて一体化された状態で、基板に
配置する構成としたことから、基板に対する複数の端子
素子の配列およびパッケージからの突出量の設定が正確
になされる。
According to the device and the method of the present invention, the laminated terminal portion is used as the external lead-out terminal. In this laminated terminal portion, a plurality of terminal elements each made of a conductive layer are laminated with an insulating layer interposed therebetween. Since it has a different configuration,
The mutual positional relationship can be set accurately. Since the plurality of terminals are stacked and integrated on the substrate in this manner, the arrangement of the plurality of terminal elements with respect to the substrate and the amount of protrusion from the package can be set accurately. .

【0010】[0010]

【発明の実施の形態】図面を参照して本発明装置および
その製造方法の実施例を説明する。図1は、本発明によ
るマルチチップモジュール装置の一例の概略斜視図を示
し、図2にその概略断面図を示す。この例では、方形の
基板4が樹脂モールドによって構成され、この基板4の
各側面に沿って、それぞれ複数の端子素子1が絶縁層2
を介して相互に積層されて一体化された積層端子部3
が、基板4のモールド成型時に埋め込まれて一体化され
た端子基板5を構成した場合である。
BEST MODE FOR CARRYING OUT THE INVENTION Embodiments of the device of the present invention and the manufacturing method thereof will be described with reference to the drawings. FIG. 1 shows a schematic perspective view of an example of a multi-chip module device according to the present invention, and FIG. 2 shows a schematic sectional view thereof. In this example, the rectangular substrate 4 is formed by resin molding, and the plurality of terminal elements 1 are respectively provided with the insulating layer 2 along each side surface of the substrate 4.
Laminated terminal portion 3 which is laminated and integrated with each other via
In this case, the terminal board 5 is embedded and integrated when the board 4 is molded.

【0011】端子基板5上、すなわち基板4上には、他
の基板例えば半導体回路素子等の半導体集積回路ICが
形成されたIC基板6が接着される。そして、このIC
基板6上の所定の回路部上に、部品チップ7例えばIC
チップがマウントされる。このチップ7のマウントは、
例えばチップ7の、IC基板6の回路と接続されるべき
電極ないしは配線部に例えば金属バンプが配置され、こ
の金属バンプをIC基板6の所定の回路部の配線層上に
直接接触載置して電気的および機械的接合を行ういわゆ
るフェースダウンボンドすることによって行う。
On the terminal substrate 5, that is, the substrate 4, another substrate, for example, an IC substrate 6 on which a semiconductor integrated circuit IC such as a semiconductor circuit element is formed is bonded. And this IC
On a predetermined circuit portion on the substrate 6, a component chip 7 such as an IC
The chip is mounted. The mount of this tip 7 is
For example, a metal bump, for example, is arranged on an electrode or a wiring portion of the chip 7 to be connected to the circuit of the IC substrate 6, and the metal bump is directly placed on the wiring layer of a predetermined circuit portion of the IC substrate 6 by direct contact. It is performed by so-called face-down bonding, which performs electrical and mechanical joining.

【0012】そして、図示の例では、IC基板6の所定
の配線ないしは端子と対応する積層端子部3の端子素子
1とをリードワイヤ8によって電気的に接続する。
In the illustrated example, a predetermined wire or terminal of the IC substrate 6 and the corresponding terminal element 1 of the laminated terminal portion 3 are electrically connected by a lead wire 8.

【0013】この状態で端子基板5上を覆って、すなわ
ちこの例ではIC基板6とこれの上の部品チップ7を包
み込んでこれを覆って封止樹脂をモールドする。このよ
うにして基板、この例では端子基板5と封止樹脂モール
ド体9によってパッケージを形成する。
In this state, the terminal board 5 is covered, that is, in this example, the IC board 6 and the component chip 7 on the IC board 6 are wrapped and covered with the sealing resin. In this way, a package is formed by the substrate, in this example, the terminal substrate 5 and the sealing resin mold body 9.

【0014】このときその積層端子部5の端子層4の一
端がパッケージより外部に導出する構成とするものであ
る。
At this time, one end of the terminal layer 4 of the laminated terminal portion 5 is led out from the package.

【0015】この構成によるマルチチップモジュール装
置の積層端子部3の一製造方法を、図3〜図6を参照し
て説明する。この場合、図3にその斜視図を示すよう
に、複数枚の導電層例えば厚さ0.3mmの銅Cuの薄板
よりなる導電層31を、例えばガラス繊維にエポキシ樹
脂を含浸させたいわゆるガラスエポキシによる厚さ0.
35mmの絶縁層2を介して積層し、全体として一体化さ
れた積層ブロック21を構成する。導電層よりなる端子
層1は、上述したようにCu等の金属薄板によって構成
することもできるし、絶縁層2に金属のスパッタないし
は蒸着を行うことによって構成することもできる。
A method of manufacturing the laminated terminal portion 3 of the multichip module device having this structure will be described with reference to FIGS. In this case, as shown in the perspective view of FIG. 3, a plurality of conductive layers, for example, a conductive layer 31 made of a thin plate of copper Cu having a thickness of 0.3 mm is used, for example, so-called glass epoxy obtained by impregnating glass fiber with epoxy resin. Thickness of 0.
The laminated blocks 21 are laminated with the insulating layer 2 having a thickness of 35 mm interposed therebetween to form an integrated laminated block 21 as a whole. The terminal layer 1 made of a conductive layer may be formed of a thin metal plate such as Cu as described above, or may be formed by sputtering or vapor depositing a metal on the insulating layer 2.

【0016】この積層ブロック21を、図3に鎖線
1 、a2 、a3 ・・・で示すように、各導電層31お
よび絶縁層2の積層方向に沿って、すなわち各層と例え
ば直交するように横切って切断して図4に示すように、
所要の厚さtを有する切断体22を形成する。
As shown by chain lines a 1 , a 2 , a 3 ... In FIG. 3, the laminated block 21 is arranged along the laminating direction of each conductive layer 31 and the insulating layer 2, that is, orthogonal to each layer. As shown in Figure 4,
A cut body 22 having a required thickness t is formed.

【0017】この切断体22の一側面に臨む絶縁層2に
対して選択的に、例えば水に研磨剤を混合したいわゆる
液体ホーニングにより、あるいはサンドブラストによっ
て、または絶縁層2を導電層31に比して大なる侵蝕量
を示す排除法によって、選択的に所要の深さをもって除
去し、図5に示すように、導電層31一端縁すなわち、
最終的に得る端子素子の少なくとも一端縁を絶縁層2よ
り突出させる突出処理工程を行う。この場合、この導電
層31の突出量は、均一に所定量に設定できる。
Selectively with respect to the insulating layer 2 facing one side surface of the cut body 22, for example, by so-called liquid honing in which water is mixed with an abrasive, or by sandblasting, or the insulating layer 2 is compared with the conductive layer 31. By an exclusion method showing a large amount of erosion, the conductive layer 31 has one edge, that is, as shown in FIG.
A projecting process is carried out to project at least one end edge of the terminal element finally obtained from the insulating layer 2. In this case, the protrusion amount of the conductive layer 31 can be uniformly set to a predetermined amount.

【0018】このようにして、一端縁が突出した導電層
31を各端子素子1として各端子素子1の一端縁が絶縁
層2から所定量突出して配列された積層端子部3を形成
するか、あるいは更に必要に応じて、図6に示すよう
に、図5の切断体22を各導電層31および絶縁層2の
積層方向に沿って各導電層31および絶縁層2と直交す
る方向に所要の幅Wに切断し、それぞれ導電層1からな
る端子素子1が絶縁層2を介して電気的に絶縁されて配
列され、各端子素子1の一端縁が絶縁層2から所定量突
出して配列された積層端子部3を形成する。
In this manner, the conductive layer 31 having one end edge protruding is used as each terminal element 1 to form the laminated terminal portion 3 in which one end edge of each terminal element 1 is arranged so as to protrude from the insulating layer 2 by a predetermined amount. Alternatively, if necessary, as shown in FIG. 6, the cut body 22 of FIG. 5 is required in a direction orthogonal to the conductive layers 31 and the insulating layers 2 along the laminating direction of the conductive layers 31 and the insulating layers 2. The terminal elements 1 each made of the conductive layer 1 are arranged so as to be electrically insulated through the insulating layer 2 after being cut into the width W, and one end edge of each terminal element 1 is arranged so as to protrude from the insulating layer 2 by a predetermined amount. The laminated terminal portion 3 is formed.

【0019】このようにして得た積層端子部3に対して
例えば電気メッキによって端子素子1の露出面にAuメ
ッキ層(図示せず)を施し、端子素子1の耐蝕性の向上
と、これに対する他部との半田付け、リードワイヤのボ
ンディング等を良好に行うことができるようにする。
An Au plating layer (not shown) is applied to the exposed surface of the terminal element 1 by, for example, electroplating the thus obtained laminated terminal portion 3 to improve the corrosion resistance of the terminal element 1 and To be able to favorably perform soldering to other parts, bonding of lead wires, and the like.

【0020】このようにして形成した積層端子部3は、
例えば図1および図2で示した基板4の各側面の凹部4
G内に、例えば基板4の厚さ方向に端子素子1の板面が
基板4の各側面と直交しかつ基板4の厚さ方向に沿うよ
うに配置する。すなわち、端子素子1の軸心方向が基板
4の厚さ方向に沿うに配置する。図示の例では、各端子
素子1の絶縁層2から突出させた端縁部が、基板4のI
C基板6等が載置された側とは反対側から突出するよう
にした場合である
The laminated terminal portion 3 thus formed is
For example, the concave portion 4 on each side surface of the substrate 4 shown in FIGS.
In G, for example, the plate surface of the terminal element 1 is arranged in the thickness direction of the substrate 4 so as to be orthogonal to each side surface of the substrate 4 and along the thickness direction of the substrate 4. That is, the axial direction of the terminal element 1 is arranged along the thickness direction of the substrate 4. In the illustrated example, the edge portion of each terminal element 1 that is projected from the insulating layer 2 is I of the substrate 4.
This is a case where the C substrate 6 and the like are projected from the side opposite to the side on which the C substrate 6 is placed.

【0021】その後、前述したように、例えばIC基板
6の載置、リードワイヤ8のボンディング、部品チップ
7のマウント、封止樹脂モールド体9の被覆等がなさ
れ、目的とするマルチチップモジュール装置10が構成
される。
Thereafter, as described above, for example, the IC substrate 6 is mounted, the lead wires 8 are bonded, the component chips 7 are mounted, the sealing resin mold body 9 is covered, and the like. Is configured.

【0022】このようにして形成されたマルチチップモ
ジュール装置10は、外部配線例えば図1および図2に
示すように、配線層24を有する剛性のもしくはフレキ
シブルのプリント基板23上に、その端子素子1の突出
端を対応する配線層24上に当接させて例えば半田付け
することによって電気的および機械的に連結される。
The multi-chip module device 10 thus formed has external wiring, for example, a terminal element 1 on a rigid or flexible printed circuit board 23 having a wiring layer 24, as shown in FIGS. Are electrically contacted electrically and mechanically by abutting the protruding ends of the corresponding wiring layers on the corresponding wiring layers 24 and soldering.

【0023】図1および図2の例では、他の基板例えば
IC基板6が端子基板4上に載置された構成とした場合
であるが、図7に概略断面図を示すように、基板4の基
板6の載置部に凹部4Hを形成し、この凹部4H内に基
板6を嵌め込む構成とすることもできる。尚、図7にお
いて、図1および図2と対応する部分には同一符号を付
して重複説明を省略する。
In the example shown in FIGS. 1 and 2, the other substrate, for example, the IC substrate 6 is mounted on the terminal substrate 4, but as shown in the schematic sectional view of FIG. It is also possible to form the concave portion 4H in the mounting portion of the substrate 6 and to fit the substrate 6 in the concave portion 4H. In FIG. 7, parts corresponding to those in FIGS. 1 and 2 are designated by the same reference numerals, and duplicate description will be omitted.

【0024】また、上述した例では、端子基板5を構成
する基板4を樹脂モールド体によって構成した場合であ
るが、この基板4をガラスエポキシ基板等の絶縁基板に
よって構成し、その側面例えば四側面に沿って溝を形成
し、この溝内にそれぞれ上述の積層端子部3を嵌め込
み、これを必要に応じて溝内に接着することができる。
Further, in the above-mentioned example, the substrate 4 constituting the terminal substrate 5 is made of a resin molded body, but the substrate 4 is made of an insulating substrate such as a glass epoxy substrate and its side surface, for example, four side surfaces. A groove can be formed along the groove, the above-mentioned laminated terminal portion 3 can be fitted into the groove, and this can be adhered into the groove if necessary.

【0025】また、積層端子部3が配置される基板4と
しては、上述の樹脂等による構成に限られるものではな
く、基板4全体をもしくは基板4の、例えばIC基板6
の載置部を、熱伝導性にすぐれ、これに載置される例え
ばSiによるIC基板6と同程度の熱膨張率を有する4
2合金による基板によって構成することもできる。図8
は、この場合の一例の概略断面図を示し、図9にその基
板4の平面図を示す。この例においては、42合金基板
4の各側面に沿ってそれぞれ上述したと同様の方法、構
成による積層端子部3を配置して樹脂モールド11によ
って各積層端子部3を基板4の4側面に配置して全体を
機械的に一体化する。この場合、基板4の上面に必要に
応じて凹部12等を設けて樹脂モールド時の基準マーク
とすることができる。
Further, the substrate 4 on which the laminated terminal portion 3 is arranged is not limited to the above-mentioned structure made of resin or the like, and the entire substrate 4 or the substrate 4, for example, the IC substrate 6 is used.
4 has excellent thermal conductivity and has a coefficient of thermal expansion similar to that of the IC substrate 6 made of, for example, Si placed on the mounting portion 4.
It is also possible to use a two-alloy substrate. FIG.
Shows a schematic sectional view of an example in this case, and FIG. 9 shows a plan view of the substrate 4. In this example, the laminated terminal portions 3 are arranged along the respective side surfaces of the 42-alloy substrate 4 by the same method and configuration as described above, and the laminated terminal portions 3 are arranged on the four side surfaces of the substrate 4 by the resin mold 11. And mechanically integrate the whole. In this case, a recess 12 or the like may be provided on the upper surface of the substrate 4 as needed to serve as a reference mark for resin molding.

【0026】そして、この基板4上に、IC半導体チッ
プ等の部品チップ7がマウントされた基板6例えばIC
基板例えばシリコン基板が載置され、リードワイヤ8に
よって端子素子1との電気的接続、封止樹脂モールド9
のモールドを行う。このようにして、この封止樹脂モー
ルド体9と基板4とによってパッケージされたマルチチ
ップモジュール装置10が構成される。
A substrate 6, for example, an IC, on which a component chip 7 such as an IC semiconductor chip is mounted, is mounted on the substrate 4.
A substrate, for example, a silicon substrate is placed, electrical connection with the terminal element 1 by the lead wire 8, and a sealing resin mold 9
Mold. In this way, the multichip module device 10 packaged by the sealing resin mold body 9 and the substrate 4 is configured.

【0027】この構成による場合においても、積層端子
部3の各端子素子1はその一端がパッケージから導出さ
れる。すなわち、この例では、各積層端子部3の各端子
素子1の一端が基板4の裏面から外部にそれぞれ一定量
をもって突出するようになされる。
Even in the case of this structure, one end of each terminal element 1 of the laminated terminal portion 3 is led out from the package. That is, in this example, one end of each terminal element 1 of each laminated terminal portion 3 is projected from the back surface of the substrate 4 to the outside with a certain amount.

【0028】尚、図8において、図2と対応する部分に
は同一符号を付して重複説明を省略する。
In FIG. 8, parts corresponding to those in FIG. 2 are designated by the same reference numerals, and duplicated description will be omitted.

【0029】この例では例えば42合金よりなる基板4
の外側に、積層端子部3を配置して樹脂モールド11に
よって、全体の機械的一体化を行った場合であるが、あ
る場合は、基板4の各側縁に、積層端子部3をそれぞれ
収容配置する凹部を設け、これにそれぞれ積層端子部3
を嵌め込み例えば紫外線硬化樹脂によって仮どめを行
い、前述したと同様に、この基板4上に、例えばICチ
ップ等の部品チップがマウントされた他の基板例えばI
C基板6を載置し、リードワイヤ8によって端子素子1
との電気的接続、封止樹脂モールド9のモールドを行
う。このように基板4として42アロイ等の金属基板を
用いることにより、放熱効果の向上と熱歪みの発生を効
果的に回避できる。
In this example, the substrate 4 made of 42 alloy, for example
In the case where the laminated terminal portion 3 is arranged outside the substrate and the whole is mechanically integrated by the resin mold 11, in some cases, the laminated terminal portion 3 is housed on each side edge of the substrate 4. The concave portions to be arranged are provided, and the laminated terminal portions 3 are formed in the concave portions.
Then, temporary fitting is performed by using, for example, an ultraviolet curable resin, and similarly to the above, another substrate, such as IC chip, on which a component chip such as an IC chip is mounted is mounted on the substrate 4.
The C substrate 6 is placed, and the lead wire 8 connects the terminal element 1
And the sealing resin mold 9 is molded. As described above, by using the metal substrate such as 42 alloy as the substrate 4, it is possible to effectively improve the heat radiation effect and effectively avoid the occurrence of thermal strain.

【0030】上述した例では、積層端子部3の作製に当
たって図5および図6に示すように、切断体22の一方
の面に関してのみ絶縁層2を一部の深さに排除する方法
をとり、端子素子1の一方の端縁のみを突出させるよう
にした場合であるが、切断体22の両面に対して端子素
子1の両端縁を絶縁層2から突出させる突出処理工程を
行って図10に示すように、端子素子1の両端が突出し
た積層端子部3を構成するようにすることもできる。
In the above-described example, when manufacturing the laminated terminal portion 3, as shown in FIGS. 5 and 6, the insulating layer 2 is removed to a partial depth only on one surface of the cut body 22, This is a case where only one end edge of the terminal element 1 is made to project, but a projecting process step of projecting both end edges of the terminal element 1 from the insulating layer 2 is performed on both surfaces of the cut body 22 to obtain the structure shown in FIG. As shown, the laminated terminal portion 3 in which both ends of the terminal element 1 project may be configured.

【0031】図11は、このように端子素子1の両端縁
が絶縁層2から導出された積層端子部3を用いてマルチ
チップモジュール装置10を構成した場合の一例の断面
図を示す。この例においては、基板4が例えば単層ない
しは多層の配線層41を有するプリント基板等の配線基
板よりなり、これの上にその外側縁に沿って図10で説
明した端子素子1の両端縁を絶縁層2から突出させた積
層端子部3を、端子素子1の一端縁において基板4の対
応する所定の配線層41上に載置して半田付け等によっ
て電気的接続する。一方基板4上に半導体チップ等の部
品チップ7を例えばフェースダウンボンドによってマウ
ントするか、あるいは図示しないが、半導体チップ等の
部品チップ7を例えばフェースダウンボンドによってマ
ウントした図1で説明したような例えばIC基板を載置
し、これらを覆って封止樹脂モールド体9を施し、例え
ば全体の一体化をはかるとともに、この封止樹脂モール
ド体9と基板4の共働によってパッケージを構成する。
そして、この場合、封止樹脂モールド体9から、各積層
端子部3の各端子素子1の他方の端縁の突出部が外部に
突出するようになされて、この突出端において外部との
接続がなされるようにする。
FIG. 11 is a sectional view showing an example of a case where the multi-chip module device 10 is constructed by using the laminated terminal portion 3 in which both end edges of the terminal element 1 are led out from the insulating layer 2 as described above. In this example, the board 4 is formed of a wiring board such as a printed board having a single-layer or multi-layer wiring layer 41, and the both end edges of the terminal element 1 described with reference to FIG. The laminated terminal portion 3 protruding from the insulating layer 2 is placed on the corresponding predetermined wiring layer 41 of the substrate 4 at one end edge of the terminal element 1 and electrically connected by soldering or the like. On the other hand, a component chip 7 such as a semiconductor chip is mounted on the substrate 4 by, for example, face down bonding, or although not shown, the component chip 7 such as a semiconductor chip is mounted by, for example, face down bonding. An IC substrate is placed, and a sealing resin mold body 9 is provided so as to cover them, for example, the whole is integrated, and a package is formed by the cooperation of the sealing resin mold body 9 and the substrate 4.
In this case, the protruding portion of the other end of each terminal element 1 of each laminated terminal portion 3 is projected from the sealing resin molded body 9 to the outside, and the external connection is made at this protruding end. To be done.

【0032】また、この場合、外部との接続が、封止樹
脂モールド体9側からなされることから、この構成によ
るマルチチップモジュール装置10は、その放熱効果を
上げるための例えば複数の放熱フィン51が形成された
良熱伝導性の金属等よりなる放熱体52を基板4の背面
に熱的に結合して配置する構成とすることもできる。
Further, in this case, since the connection with the outside is made from the side of the sealing resin mold body 9, the multi-chip module device 10 with this configuration has, for example, a plurality of heat radiation fins 51 for improving the heat radiation effect. It is also possible to adopt a configuration in which the radiator 52 made of a metal or the like having good heat conductivity in which the above is formed is thermally coupled to the back surface of the substrate 4.

【0033】また、本発明の他の例としては、図12に
その斜視図を示し、図13にその要部の断面図を示すよ
うに、端子素子1が絶縁層2から両端で突出させて、一
方の突出端を基板4の板面に沿うように配置することも
できる。図12および図13に示す例においては、基板
4が例えば複数の配線層61が層間絶縁層62を介して
積層され、各配線層61が所定部において、層間絶縁層
62に形成したコンタクト孔を通じて連結された多層配
線基板よりなり、この基板4上の各側縁に沿って積層端
子部3がそれぞれ配置された構成とされる。そしてこの
場合、各積層端子部3の各端子素子1の一方の突出端が
基板4の上層配線層の所定部に接触するように配置した
場合である。また、基板4上もしくはこの基板4に配置
された他の基板(図示せず)上に半導体チップ等の部品
チップが例えばフェースダウンボンドによって接続され
てマウントされこれを覆って封止樹脂モールド体9が形
成される。図示の例では、基板4上に封止樹脂モールド
9の外周縁位置を規制する枠体71を、基板4上に突設
してこの枠体71内に封止樹脂モールド体9をモールド
する構成とすることもできる。
As another example of the present invention, FIG. 12 is a perspective view thereof, and FIG. 13 is a cross-sectional view of a main portion thereof, where the terminal element 1 is projected from the insulating layer 2 at both ends. It is also possible to arrange one of the protruding ends along the plate surface of the substrate 4. In the examples shown in FIGS. 12 and 13, for example, a plurality of wiring layers 61 are laminated on the substrate 4 via an interlayer insulating layer 62, and each wiring layer 61 is provided at a predetermined portion through a contact hole formed in the interlayer insulating layer 62. The multilayer wiring boards are connected to each other, and the laminated terminal portions 3 are arranged along the respective side edges of the board 4. In this case, one terminal end of each terminal element 1 of each laminated terminal portion 3 is arranged so as to contact a predetermined portion of the upper wiring layer of the substrate 4. Further, a component chip such as a semiconductor chip is connected and mounted by, for example, face-down bonding on the substrate 4 or another substrate (not shown) arranged on the substrate 4, and the mounting is covered with the sealing resin mold body 9 Is formed. In the illustrated example, a frame body 71 that regulates the outer peripheral edge position of the sealing resin mold 9 is provided on the substrate 4 so as to project on the substrate 4, and the sealing resin mold body 9 is molded in the frame body 71. Can also be

【0034】上述の本発明構成によれば、複数の端子導
出がなされるにもかかわらず、これら端子は、それぞれ
端子となる端子素子1が絶縁層2を介して積層配列され
た積層端子部3によって構成するので、端子相互の位置
関係を正確に設定できる。そして、このように複数の端
子が積層されて一体化された状態で、基板に配置する構
成としたことから、基板に対する複数の端子素子の配列
およびパッケージからの突出量の設定が正確になされ
る。
According to the above-described configuration of the present invention, although a plurality of terminals are led out, these terminals have the laminated terminal portion 3 in which the terminal elements 1 to be terminals are laminated and arranged through the insulating layer 2. Since it is configured by, the positional relationship between terminals can be set accurately. Since the plurality of terminals are stacked and integrated on the substrate in this manner, the arrangement of the plurality of terminal elements with respect to the substrate and the amount of protrusion from the package can be set accurately. .

【0035】尚、積層端子部3の端子素子1は、柱状構
造とする場合に限られるものではなく、図14もしくは
図15に、各一例の概略断面図を示すように、断面L字
状に形成することもできるなど、端子素子1の形状、導
出態様に、種々の変形変更を行うことができる。
The terminal element 1 of the laminated terminal portion 3 is not limited to the columnar structure, and has an L-shaped cross section as shown in FIG. 14 or FIG. The terminal element 1 can be formed in various ways, and various modifications and changes can be made to the shape and derivation mode of the terminal element 1.

【0036】そして、図13〜図15において、図2と
対応する部分には同一符号を付して重複説明を省略す
る。
13 to 15, parts corresponding to those in FIG. 2 are designated by the same reference numerals, and duplicate description will be omitted.

【0037】また、上述した例では、基板4の各側面に
沿って積層端子部3を配置した場合であるが、一部の側
面に沿って形成するとか上述した例に限られるものでは
ないなど種々の構成を採ることができる。
Further, in the above-mentioned example, the laminated terminal portion 3 is arranged along each side surface of the substrate 4, but the invention is not limited to the case where the laminated terminal portion 3 is formed along a part of the side surface, or the like. Various configurations can be adopted.

【0038】[0038]

【発明の効果】上述したように、本発明装置および本発
明方法によれば、積層端子部を外部導出端子とするもの
であり、この積層端子部すなわち外部導出端子は、複数
の端子層が絶縁層を介して積層された構成によるもので
あることから、相互の位置関係を正確に設定できる。そ
して、このように複数の端子が積層されて一体化された
状態で、基板に配置する構成としたことから、基板に対
する複数の端子の配置が、容易に正確に行うことができ
るものである。また、このように基板の所定位置に端子
が配置された状態で樹脂モールドを施すことができるこ
とによって、そのモールドの型は簡易な構成となり、ま
たモールドに際しての取扱も簡単となる。したがって、
量産性の向上をはかることができる。
As described above, according to the device of the present invention and the method of the present invention, the laminated terminal portion is used as the external lead-out terminal. In the laminated terminal portion, that is, the external lead-out terminal, a plurality of terminal layers are insulated. Since the layers are laminated through the layers, the mutual positional relationship can be set accurately. Since the plurality of terminals are stacked and integrated on the substrate as described above, the plurality of terminals can be easily and accurately arranged on the substrate. In addition, since the resin molding can be performed in the state where the terminals are arranged at the predetermined positions on the substrate as described above, the mold has a simple structure and the handling at the time of molding becomes easy. Therefore,
It is possible to improve mass productivity.

【0039】また、本発明方法によれば、端子部の形成
を複数の端子層を絶縁層を介して積層し、これを切断す
ることによって得るものであるので、それぞれ外部端子
となる端子層の相互の位置設定、および各端子層の長さ
の設定は正確になされるものであり、また、樹脂モール
ドからの端子層の端部の突出量の設定は、端子層間の絶
縁層の選択的排除によって設定することから正確になさ
れてその突出端縁を一様の高さ、言い換えれば位置平面
に形成することができるることから、各端子層を外部配
線例えばプリント基板に対する対応するプリント配線層
への接続は、一部に浮き上がりを生じさせることなく、
いわゆるコプラナリティにばらつきのない、したがって
信頼性の高い接続を行うことができる。
Further, according to the method of the present invention, since the formation of the terminal portion is obtained by laminating a plurality of terminal layers with the insulating layer interposed therebetween and cutting the laminated layers, each of the terminal layers serving as external terminals is formed. Mutual position setting and length setting of each terminal layer are accurate, and setting of the protrusion amount of the end of the terminal layer from the resin mold is done by selectively removing the insulating layer between the terminal layers. Since it is possible to form the projecting edge at a uniform height, in other words, on the position plane, by setting it by the setting of each terminal layer to the external wiring, for example, the corresponding printed wiring layer for the printed circuit board. Connection, without causing some floating
A so-called coplanarity does not vary, and therefore a highly reliable connection can be performed.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明によるマルチチップモジュール装置の一
例の概略斜視図である。
FIG. 1 is a schematic perspective view of an example of a multi-chip module device according to the present invention.

【図2】本発明によるマルチチップモジュール装置の一
例の概略断面図である。
FIG. 2 is a schematic sectional view of an example of a multi-chip module device according to the present invention.

【図3】本発明製造方法の一例の積層端子部の一製造工
程における斜視図である。
FIG. 3 is a perspective view in one manufacturing process of the laminated terminal portion of the example of the manufacturing method of the present invention.

【図4】本発明製造方法の一例の積層端子部の一製造工
程における斜視図である。
FIG. 4 is a perspective view in one manufacturing process of the laminated terminal portion of the example of the manufacturing method of the present invention.

【図5】本発明製造方法の一例の積層端子部の一製造工
程における斜視図である。
FIG. 5 is a perspective view in one manufacturing process of the laminated terminal portion in the example of the manufacturing method of the present invention.

【図6】本発明製造方法の一例の積層端子部の一製造工
程における斜視図である。
FIG. 6 is a perspective view in one manufacturing process of the laminated terminal portion of the example of the manufacturing method of the present invention.

【図7】本発明によるマルチチップモジュール装置の他
の例の概略断面図である。
FIG. 7 is a schematic cross-sectional view of another example of the multi-chip module device according to the present invention.

【図8】本発明によるマルチチップモジュール装置の更
に他の例の概略断面図である。
FIG. 8 is a schematic cross-sectional view of still another example of the multi-chip module device according to the present invention.

【図9】図8に示した本発明によるマルチチップモジュ
ール装置の積層端子部が配置された基板の概略平面図で
ある。
9 is a schematic plan view of a substrate on which a laminated terminal portion of the multi-chip module device according to the present invention shown in FIG. 8 is arranged.

【図10】本発明装置の積層端子部の他の例の斜視図で
ある。
FIG. 10 is a perspective view of another example of the laminated terminal portion of the device of the present invention.

【図11】本発明によるマルチチップモジュール装置の
他の例の概略断面図である。
FIG. 11 is a schematic cross-sectional view of another example of the multi-chip module device according to the present invention.

【図12】本発明によるマルチチップモジュール装置の
他の例の概略斜視図である。
FIG. 12 is a schematic perspective view of another example of the multi-chip module device according to the present invention.

【図13】図12に示した本発明によるマルチチップモ
ジュール装置の要部の断面図である。
13 is a cross-sectional view of an essential part of the multi-chip module device according to the present invention shown in FIG.

【図14】本発明によるマルチチップモジュール装置の
概略断面図である。
FIG. 14 is a schematic cross-sectional view of a multi-chip module device according to the present invention.

【図15】本発明によるマルチチップモジュール装置の
概略断面図である。
FIG. 15 is a schematic sectional view of a multi-chip module device according to the present invention.

【符号の説明】[Explanation of symbols]

1 端子素子 2 絶縁層 3 積層端子部 4 基板 7 部品チップ 8 リードワイヤ 9 封止樹脂モールド体 10 マルチチップモジュール装置 DESCRIPTION OF SYMBOLS 1 Terminal element 2 Insulating layer 3 Laminated terminal part 4 Substrate 7 Component chip 8 Lead wire 9 Sealing resin mold body 10 Multi-chip module device

Claims (2)

【特許請求の範囲】[Claims] 【請求項1】 導電層による複数の端子素子が絶縁層を
介して相互に積層されて一体化された積層端子部が、基
板に配置され、 上記積層端子部を有する上記基板上に、もしくは該基板
上に配置された他の基板上に部品チップがマウントさ
れ、 上記積層端子部を有する上記基板上に上記部品チップを
覆って封止樹脂モールド体が施されて上記積層端子を有
する基板と上記封止樹脂モールド体によってパッケージ
が構成され、 上記積層端子部の端子素子の少なくとも一端が上記パッ
ケージより外部に導出されたことを特徴とするマルチチ
ップモジュール装置。
1. A laminated terminal portion, in which a plurality of terminal elements made of a conductive layer are laminated and integrated with each other via an insulating layer, is arranged on a substrate, and the laminated terminal portion is provided on the substrate having the laminated terminal portion, or A component chip is mounted on another substrate arranged on the substrate, and a sealing resin mold body is applied on the substrate having the laminated terminal portion to cover the component chip, and the substrate having the laminated terminal and A multi-chip module device, wherein a package is constituted by a sealing resin mold body, and at least one end of the terminal element of the laminated terminal portion is led out from the package.
【請求項2】 導電層が絶縁層を介して積層されてなる
積層ブロックを作製する工程と、 該積層ブロックを上記導電層と上記絶縁層とを横切る方
向に所要の厚さに切断する工程と、 該切断体の、上記導電層と上記絶縁層とが交互に配列さ
れて臨む少なくとも一方の面に対して該面から所要の深
さに上記絶縁層を除去して、該面に上記各導電層よりな
る端子素子の少なくとも一端を突出させる突出処理工程
とを採って複数の端子素子が絶縁層を介して積層されて
なる積層端子部を形成し、 該積層端子部を、基板に配置する工程と、 上記積層端子部を有する上記基板上に、もしくは該基板
上に配置される他の基板上に部品チップをマウントする
工程と、 上記積層端子部を有する上記基板上に上記部品チップを
覆い、かつ上記積層端子部の端子層の少なくとも一端を
外部に導出して封止樹脂モールド体のモールド工程とを
採ることを特徴とするマルチチップモジュール装置の製
造方法。
2. A step of producing a laminated block in which conductive layers are laminated via an insulating layer, and a step of cutting the laminated block to a required thickness in a direction crossing the conductive layer and the insulating layer. The conductive layer and the insulating layer of the cut body are alternately arranged to face at least one surface of the cut body, and the insulating layer is removed to a required depth from the surface, and the conductive layer is formed on the surface. A step of projecting at least one end of a terminal element composed of layers to form a laminated terminal section in which a plurality of terminal elements are laminated via an insulating layer, and the step of disposing the laminated terminal section on a substrate A step of mounting a component chip on the substrate having the laminated terminal portion, or on another substrate arranged on the substrate, and covering the component chip on the substrate having the laminated terminal portion, And the terminal layer of the laminated terminal section Method of manufacturing a multi-chip module device characterized by taking the molding step of the sealing resin molded body by deriving at least one end to the outside.
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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2008504706A (en) * 2004-06-30 2008-02-14 ローベルト ボツシユ ゲゼルシヤフト ミツト ベシユレンクテル ハフツング Electronic circuit unit
JP2009123869A (en) * 2007-11-14 2009-06-04 Panasonic Corp Module and electronic equipment using it
US7598605B2 (en) 2001-03-08 2009-10-06 Hitachi, Ltd. Semiconductor device having capacitive insulation means and communication terminal using the device
JP2016219785A (en) * 2015-05-25 2016-12-22 パナソニックIpマネジメント株式会社 Electronic component package

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