JP3760997B2 - 半導体基体 - Google Patents
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Description
【発明の属する技術分野】
本発明は、発光ダイオード(LED)、ヘテロ接合トランジスタ等の窒化物系化合物半導体装置に使用される半導体基体に関する。
【0002】
【従来の技術】
【特許文献1】
特開2001−313421号公報
GaN、GaAlN、GaInN、AlGaInN等の窒化物系化合物半導体装置を構成するために、シリコン基板の上にバッファ層を介して窒化物系化合物半導体領域を形成することは前記特許文献1等で公知である。
【0003】
図1は従来技術に従って形成された半導体基体を概略的に示す。この半導体基体は、シリコン基板1と、この基板1上にエピタキシャル成長された例えば窒化アルミニウム(AlN)から成るバッファ層2と、このバッファ層2の上にエピタキシャル成長された例えば窒化ガリウム(GaN)から成る窒化物半導体層3とから成る。発光ダイオードを形成する時には、窒化物半導体層3の上に周知の発光層等が形成される。また、ヘテロ接合トランジスタ等の制御可能な半導体素子を形成する時には窒化物半導体層3の上に制御可能な半導体素子のための半導体領域を形成する。
【0004】
【発明が解決しようとする課題】
ところで、シリコン基板1とバッファ層2とはヘテロ接合されているので、両者間に格子不整合、熱不整合が生じる。このため、バッファ層2に図1で点線で説明的に示すように多数の転位4が生じる。この転位4は基板1の主面に対して垂直方向に延び、窒化物半導体層3にも引き継がれる。窒化物半導体層3の転位密度は5×1010/cm2以上となり、半導体装置の性能を低下させる。例えば、発光ダイオードの場合には、転位が発光層まで引き継がれ、非発光の再結合中心として機能し、発光効率を低下させる。また、HEMT等の制御可能な半導体素子が形成されている半導体領域に含まれている転位は、転位に捕獲された電子によりキャリアが散乱し、キャリアの移動度を低下させる。また、半導体素子が形成されている半導体領域の表面まで転位が延びている場合には、表面に形成される電極の材料の異常拡散が生じ、耐圧低下を招く恐れがある。
【0005】
そこで、本発明の目的は、転位を低減することができる半導体基体を提供することにある。
【0006】
【課題を解決するための手段】
上記課題を解決し、上記目的を達成するための本発明は、窒化物半導体装置のための半導体基体であって、
基板と、
前記基板の表面上にエピタキシャル成長されたアルミニウムを含み且つインジウムを含んでいない窒化物、例えば AlN 、又は Al x Ga 1-x N 、ここでxは0<x<1を満足する数値、から成る第1の層と前記第1の層の上にエピタキシャル成長されたガリウムを含み且つインジウムを含んでいない窒化物、例えば GaN 、又は Al y Ga 1-y N 、ここでyは0<y<1、y<xを満足する数値、から成る第2の層とから成り且つ転位を含んでいるバッファ領域と、
前記バッファ領域と異なり且つインジウムを含む窒化物半導体のエピタキシャル成長で前記バッファ領域の表面上に配置され且つ転位を含み且つ前記バッファ領域の表面よりも平坦性の悪い表面を有し且つその表面に転位の延びる方向を屈折させることができる多数の突出部を有している転位屈折領域と、
前記転位屈折領域と異なり且つインジウムを含まない窒化物半導体のエピタキシャル成長で前記転位屈折領域の表面上に配置され且つ前記転位屈折領域の表面よりも平坦性が良く且つ前記転位屈折領域よりも転位密度が小さい表面部分を有している平坦化領域と
を備えていることを特徴とする半導体基体に係わるものである。
【0007】
なお、前記基板は、例えばシリコン、又はSiC等のシリコン化合物、又はサアフィア等で構成することができる。しかし、低コスト化及び導電性を考慮して請求項3に示すように、前記基板は導電型決定不純物を含み且つ導電性を有しているシリコンであることが望ましい。
また、請求項2に示すように、バッファ領域を、アルミニウムを含む窒化物、例えばAlN、又はAlxGa1-xN、ここでxは0<x<1を満足する数値、から成る複数の第1の層と、ガリウムを含む窒化物、例えばGaN、又はAlyGa1-yN、ここでyは0<y<1、y<xを満足する数値、から成る複数の第2の層とを交互に配置した多層構造に構成することができる。
また、請求項3に示すように、バッファ領域を多層構造の第1のバッファ領域と、この第1のバッファ領域の上に配置された単層構造の第2のバッファ領域とで構成することができる。この場合、前記第1のバッファ領域は、アルミニウムを含む窒化物、例えばAlN、又はAlxGa1-xN、ここでxは0<x<1を満足する数値、から成る複数の第1の層とガリウムを含む窒化物、例えばGaN、又はAlyGa1-yN、ここでyは0<y<1、y<xを満足する数値、から成る複数の第2の層とを交互に配置することによって構成する。また、第2のバッファ領域は、例えばGaN、又はAlyGa1-yN、ここでyは0<y<1、y<xを満足する数値、から成るガリウムを含む窒化物によって構成する。上述のいずれのバッファ領域もインジウムを含まないことが望ましい。
また、インジウムを含む窒化物から成る前記転位屈折領域を、例えばAlxInyGa1-x-yN、ここでx、yは0≦x<1、0<y<1を満足する数値、で構成することが望ましい。
また、請求項4に示すように、前記転位屈折領域を、第1の割合でインジウムを含む窒化物、例えばAlxInyGa1-x-yN、ここでx、yは0≦x<1、0<y<1を満足する数値、から成る複数の第1の層と、前記第1の割合よりも大きい第2の割合でインジウムを含む窒化物、例えばAlaInbGa1-a-bN、ここでa,bは0≦a<1、0<b<1、y<bを満足する数値、から成る複数の第2の層とを交互配置して構成することが望ましい。
また、インジウムを含まない窒化物から成る前記平坦化領域は、例えばAlxGa1-xN、ここでxは0≦x<1を満足する数値、であることが望ましい。
また、請求項5に示すように、前記平坦化領域を、アルミニウムを含む窒化物、AlxGa1-xN、ここでxは0<x<1を満足する数値、から成る複数の第1の層と、ガリウムを含む窒化物、例えばGaN、又はAlyGa1-yN、ここでyは0≦y<1、y<xを満足する数値、から成る複数の第2の層とを交互に配置して構成することが望ましい。上述のいずれの平坦化領域もインジウムを含まないことが望ましい。
また、前記バッファ領域、前記転位屈折領域及び前記平坦化領域は導電型決定不純物を含むものであることが望ましい。
また、転位屈折領域の突出部は30nm〜1000nmの高さを有している六角錐状突出部であることが望ましい。
【0008】
【発明の効果】
本願の請求項1〜5の発明は次の効果を有する。
(イ)転位屈折領域の表面に、転位の延びる方向を屈折することができる多数の突出部が形成されている。転位が突出部で屈折すると、転位屈折領域の上に形成される平坦化領域に引き継がれる転位が減少する。従って、平坦化領域及びこの上に形成される半導体素子用半導体領域における転位密度が大幅に低減し、特性の良い半導体装置を提供することが可能になる。
(ロ)転位屈折領域をインジウム(In)を含む窒化物半導体のエピタキシャル成長で形成すると、下側のバッファ領域に対する格子歪を緩和する作用が生じ、転位屈折領域の表面に転位屈折機能を有する多数の突出部を容易に形成することができる。
(ハ)多数の突出部を有する転位屈折領域にインジウム(In)を含まない窒化物半導体をエピタキシャル成長させると、窒化物半導体は突出部の傾斜側面から横方向即ち基板の主面に平行な方向の成分を有するように成長し、転位屈折領域よりも小さい転位密度を有している平坦化領域を容易に形成することができる。
【0009】
【第1の実施形態】
次に、図2を参照して本発明の第1の実施形態に従う窒化物系化合物半導体装置のための半導体基体及びその製造方法を説明する。
【0010】
図2に示す半導体基体10は、シリコン半導体基板11と、この半導体基板11の上に配置された格子緩和促進領域として機能するバッファ領域12と、このバッファ領域12上に配置された転位屈折領域13と、この転位屈折領域13の上に配置された平坦化領域14とから成る。発光ダイオード又は制御可能な半導体素子は平坦化領域14の上に形成される。なお、バッファ領域12をインジウムを含まない第1の半導体領域と呼び、転位屈折領域13をインジウムを含む第2の半導体領域又は第2バッファ領域又は転位抑制領域と呼び、また平坦化領域14をインジウムを含まない第3の半導体領域と呼ぶことができる。
【0011】
図2の半導体基体10を製造する時には、例えば約350μmの厚みを有するシリコン基板11を用意する。シリコン基板11は、半導体素子の電流通路として使用できるように、例えば5×1018cm−3〜5×1019cm−3程度の濃度で導電型決定不純物を含み、0.0001Ω・cm〜0.01Ω・cm程度の低い抵抗率を有する。また、エピタキシャル成長を良好に達成するために、シリコン基板11の主面11sは、ミラー指数で示す結晶の面方位において(111)面である。
【0012】
次に、シリコン基板11に対してHF系のエッチング液によって水素終端処理を施す。
次に、基板11を周知のOMVPE(Organometallic Vapor Phase Epitaxy)即ち有機金属気相成長装置の反応室に投入し、1150℃まで昇温する。次に、1150℃で10分間のサーマルクリーニグを行って、基板11の表面の酸化膜を取り除いた後、1100℃まで温度を下げて安定させた後に、TMA(トリメチルアルミニウム)を50μmol/min(20cc)とシラン(SiH4)を20nmol/min(200cc)とアンモニア0.14mol/min(3リットル)を流してAlNをエピタキシャル成長させ、例えば300オングストロームの厚みを有し且つシリコンがドープされたバッファ領域12を形成する。このバッファ領域12には、点線で説明的に示すように多数の転位15が含まれている。この転位15は基板11の主面11sに対して垂直方向に延びるように分布している。なお、シランはn型不純物としてのシリコンをドーブするために使用されている。
【0013】
次に、反応室に対するアンモニア(NH3)以外の成長原料の供給を止めた後に、基板11の温度を900℃まで下げ、TMIn(トリメチルインジウム)を95μmol/min(200cc) と、トリメチルガリウム(TMG)を5.3μmol/min(2.1cc)と、アンモニア(NH3 )を0.23mol/min(5リットル)と、シラン(SiH4)を20nmol/min(200cc)とを例えば950秒間流して、その表面に多数の凹凸即ち突出部15を持つ転位屈折領域13を例えば100nmの厚さに形成する。この第1の実施形態に従う転位屈折領域13は、化学式InyGa1-yN、ここでyは0<y<1を満足する数値、におけるyの値を0.15としたものからなる窒化物半導体である。この転位屈折領域13は上記の窒化物半導体に限るものではなく例えば化学式AlxInyGa1-x-yN、ここでx、yは0≦x<1、0<y<1を満足する数値、で示すことができるインジウムを含む窒化物半導体とすることができる。この窒化物半導体において、xを0〜0.5、yを0.01〜0.5とすることができる。図2の転位屈折領域13にはバッファ領域12の転位15を引き継いだ転位15’が含まれている。
【0014】
上述のように転位屈折領域13をインジウム(In)を含む窒化物半導体のエピタキシャル成長で形成すると、下側のバッファ領域12に対する格子歪を緩和する作用が生じ、転位屈折領域13の中にインジウム(In)の不均一分布が生じ、多数の平均の高さが約80nmの多数の六角錐状の突出部16が転位屈折領域13の表面に生じる。従って、転位屈折領域13の表面の平坦性はバッファ領域12の表面の平坦性よりも悪い。六角錐状突出部16の傾斜側面16aは転位15’の屈折部として機能する。即ち、転位屈折領域13において基板11の主面11sに対して垂直方向に延びている転位15’は突出部16の傾斜側面16aで基板11の主面11sに平行な方向に屈折される。
【0015】
次に、反応室に対するTMG、TMI、及びSiH4の供給を止めて1100℃まで昇温する。この後、TMGを50μmol/min(15cc)、シラン(SiH4 )を20nmol/min(200cc)、アンモニアを0.14mol/min(3リットル)の割合で反応室に例えば540秒間流して、0.2μmの厚みのGaNからなる表面平坦化領域14を設ける。シランのシリコンはn型不純物として機能し、n型の平坦化領域14が得られる。多数の突出部16を有する転位屈折領域13にインジウム(In)を含まない例えばGaNから成る窒化物半導体をOMVPE法でエピタキシャル成長させると、窒化物半導体は突出部16の傾斜側面16aから横方向即ち基板11の主面11sに平行な方向の成分を有するように成長する。このため、突出部16の相互間の凹部が窒化物半導体で埋められて平坦化領域14の表面14sの平坦性が転位屈折領域13の表面の平坦性よりも良くなる。また、平坦化領域14において、転位17が突出部16の傾斜側面16aから横方向に延びて隣りの突出部16から延びて来た転位と接触して終端する。この平坦化領域14において、横方向に延びる転位17から垂直方向に延びる転位18が発生するが、この垂直方向に延びる転位18の密度はバッファ領域12及び転位屈折領域13の転位密度よりも大幅に小さい。従って、平坦化領域14の表面14sを含む表面部分の転位密度は転位屈折領域13の転位密度よりも大幅に小さい。
【0016】
平坦化領域14の表面14s上に、発光ダイオード(LED)を形成する時には、周知の活性層、p型クラッド層、コンタクト層等を順次にOMVPE法によって形成する。また、HEMT等の制御可能な半導体素子を形成する時には、例えばAlGaNから成る電子供給層を形成する。LED及び制御可能な半導体素子等のための窒化物半導体領域は、転位密度の小さい平坦化領域14の上に形成されるので、半導体素子のための窒化物半導体領域の転位密度も小さくなり、特性の良いLED及び制御可能な半導体素子を提供することができる。
なお、半導体基体10の平坦化領域14をLEDのn型クラッド層又は制御可能な半導体素子のn型半導体領域として使用することができる。
【0017】
【第2の実施形態】
次に、図3に示す第2の実施形態に従う半導体基体10a及びこれを使用したLEDを説明する。但し、図3において図2と実質的に同一の部分には同一の符号を付してその説明を省略する。
【0018】
図3における半導体基体10aのバッファ領域12aを除く、シリコン基板11、転位屈折領域13及び平坦化領域14は図2のこれ等と同一構成を有し且つ同一の方法で製作されている。バッファ領域12aは、第1及び第2の層21、22から成る。第1の層21は、アルミニウムを含む窒化物,例えばAlNから成り、図2のバッファ領域12と同一構成を有し且つ同一の方法で形成されている。第2の層22は、ガリウムを含む窒化物、例えば第1の層21の上にGaNをエピタキシャル成長させたものである。第2の層22は、平坦化領域14の形成と同様に、反応室にTMGとシラン(SiH4)とアンモニアを供給して周知のOMVPE法でGaNをエピタキシャル成長させることによって得る。第1の層21はAlNに限ることなく、AlxGa1-xN、ここでxは0<x<1を満足する数値、から成る窒化物とすることができる。また、第2の層22は、GaNに限ることなく、例えばAlyGa1-yN、ここでyは0<y<1、y<xを満足する数値、から成る窒化物とすることができる。第2の層22はインジウムを含まないので、インジウムを含む転位屈折領域13よりも平坦性が良い表面を有する。第1及び第2の層21、22から成るバッファ領域12a及びこの上に形成された転位屈折領域13には、図2のバッファ領域12と転位屈折領域13と同様な形態及び密度で転位15、15’が生じる。転位屈折領域13は図2と同様に多数の突出部16を有するので、転位屈折領域13の上の平坦化領域14の転位18の密度は転位屈折領域13のそれよりも小さくなる。
【0019】
LEDのn型クラッド層として機能する平坦化領域14の上に、半導体素子用領域23として周知の多重量子井戸構造の活性層24と周知のp型GaNから成るpクラッド層25とが形成されている。図3では図示を簡略化するために平坦化領域14の上に配置された多重量子井戸構造の活性層24が1つの層で示されているが、実際には、複数の障壁層と複数の井戸層とから成り、障壁層と井戸層とが交互に4回繰返して配置されている。この活性層24を形成する時には、表面平坦化領域14の形成後に、反応室へのガスの供給を停止して基板11の温度を800℃まで下げ、しかる後、TMGとTMIとアンモニアとを反応室に所定の割合で供給し、例えばIn0.02Ga0.98Nから成り且つ厚み13nmを有している障壁層を形成し、次に、TMIの割合を変えて例えばIn0.2Ga0.8Nから成り且つ例えば厚み3nmを有している井戸層を形成する。この障壁層及び井戸層の形成を例えば4回繰返すことによって多重量子井戸構造の活性層24が得られる。活性層24には平坦化領域14の転位18を引き継いだ転位26が発生する。しかし、平坦化領域14の転位密度の低減化が図られているので活性層24の転位26の密度も小さい。
【0020】
活性層24の上に配置されたp型GaNから成るpクラッド層25は、例えば200nmの厚みを有し、活性層24の形成後に基板11の温度を例えば1010℃まで上げ、TMGとビスシクロペンタジェニルマグネシウム(Cp2Mg)とアンモニアとを反応室に供給することによって形成される。なお、Cp2Mgガスで供給されるMgはp型不純物として機能する。pクラッド層25には活性層24の転位26を引き継いだ転位27が生じるが、転位27の密度は活性層24の場合と同様に低い。
【0021】
LEDを構成する半導体素子領域23及び基体10aに電流を流すために、一方の電極28がpクラッド層25に接続され、基板11に他方の電極29が接続されている。なお、一方の電極28を接続するためにpクラッド層25の上にコンタクト用のp型半導体層を追加して設けることができる。
【0022】
上述から明らかなように、図3のLEDのnクラッド層として機能する平坦化領域14、活性層24、pクラッド層25の転位密度が低減するので、非発光再結合中心が少なくなり、発光効率が向上する。
【0023】
【第3の実施形態】
図4に示す第3の実施形態に従うLEDは、図3の第2の実施形態のバッファ領域12aを変形したバッファ領域12bを設け、この他は図3と同一に構成したものである。
【0024】
図4の半導体基体10bに含まれている基板11と転位屈折領域13との間のバッファ領域12bは、第1及び第2のバッファ領域21a,22’の組合せから成る。第1のバッファ領域21aは図3の第2の実施形態の単層構造の第1の層21の代りに設けたものであり、AlNから成る複数の第1の層31とGaNから成る複数の第2の層32から成る。第1及び第2の層31、32は交互に配置されている。図4には、図面を簡単にするために第1及び第2の層31、32がそれぞれ4個のみ示されているが、実際には、第1及び第2の層31、32の組み合せが20回繰返して配置されている。第1及び第2の層31、32にはn型導電型決定不純物としてのシリコン(Si)がドープされている。
【0025】
バッファ領域12bの多層構造の第1のバッファ領域21aを形成する時には、シリコン基板11をOMVPE装置に投入し、第1の実施形態と同様に表面の酸化膜を除去する処理を施した後に、基板11の温度を1100℃とし、反応室にTMA(トリメチルアルミニウム)を50μmol/min(20cc)とシラン(SiH4)を20nmol/min(200cc)とアンモニアを0.14mol/min(3リットル)流して、厚さ5nmのAlNから成る第1の層31をエピタキシャル成長させる。その後、TMAの供給を止め、シランとアンモニアの供給は継続し、これ等と共にTMGを50μmol/min(15cc)の割合で流して厚さ25nmのGaNから成る第2の層32をエピタキシャル成長させる。第1及び第2の層31、32の形成工程を20回繰返して多層構造の第1のバッファ領域21aを得る。
【0026】
図4のバッファ領域12bの第2のバッファ領域22’は、図3の第2の層22と同様に形成される。図4のバッファ層12bにおいても転位15が図3の場合と同様に生じるが、転位屈折領域13の働きによって平坦化領域14及び半導体素子領域23の転位密度が小さくなる。透過型電子顕微鏡によって図4の活性層24を横切る転位の密度を調べたところ、9×109/cm2であった。比較のために、図4から転位屈折領域13を省いたものを作り、この活性層を横切る転位の密度を調べたところ、5×1010/cm2であった。この結果から明らかなように転位屈折領域13を設けると、単位面積当りの転位の数が約1/5になる。
また、図4のLEDの対の電極28、29間に20mAを流した時の発光出力を測定したところ9.5mWであった。比較のために図4から転位屈折領域13を省いたLEDを作り、本発明に従うLEDと同様な方法で発光出力を測定したところ、3.2mWであった。従って、本発明に従うLEDによれば、従来の約3倍の発光出力を得ることができる。
【0027】
図4の多層構造の第1のバッファ21aにおけるAlNから成る第1の層31の格子定数は基板11のシリコンとGaNとの間の値を有するので、AlNから成る第1の層31は、シリコン基板11の結晶方位をGaNよりも良好に引き継ぐことができる。しかし、もし比較的厚いAlNのみでバッファ層を形成すると、バッファ層の抵抗が大きくなる。また、比較的薄いAlNのみでバッファ層を形成すると、十分なバッファ機能が得られない。これに対し、本実施形態では、バッファ領域12bの第1のバッファ領域21aをAlNから成る第1の層31とGaNから成る第2の層32との多層構造とし、AlNから成る第1の層31が量子力学的なトンネル効果の生じる厚さに形成されているので、抵抗の小さいバッファ領域12bを良好に得ることができる。
【0028】
【第4の実施形態】
図5に示す第4の実施形態に従うHEMT構成のヘテロ接合電界効果トランジスタは、図2と実質的に同一構成の半導体基体10の上にヘテロ接合電界効果トランジスタのための半導体素子領域23aを形成したものである。半導体素子領域23aは、例えばn型不純物がドープされたAlGaNから成る電子供給層41と、不純物がドープされていないショットキ形成層42と、ソースコンタクト層43aと、ドレインコンタクト層43bとから成る。
【0029】
電子供給層41は、平坦化領域14の形成後に、反応室にTMGを33μmol/min(10cc)、TMAを12.5μmol/min(5cc)、シラン(SiH4)を20nmol/min(200cc)、アンモニアを0.14mol/min(3リットル)を供給し、例えば厚さ30nmのAl0.3Ga0.7Nをエピタキシャル成長させることによって得る。n型不純物としてのシリコンを含む電子供給層41とこの下の平坦化領域14とはヘテロ接合であるので、両者の界面HJ及びこの近傍に2次元電子ガス層(電流チャネル)が生じる。
【0030】
電子供給層41の上には不純物を含まないショットキ形成層42がエピタキシャル成長法で形成され、このショットキ形成層42の上にはソースコンタクト層43aとドレインコンタクト層43bとがエピタキシャル成長法で形成されている。ソースコンタクト層43aにはソース電極44が接続され、ドレインコンタクト層43bにはドレイン電極45が接続され、ショットキ形成層42にはゲート電極46がショットキ接触している。上述の2次元電子ガス層は、ドレイン電極45とソース電極44との間を流れる電流の通路(チャネル)として機能し、これがゲート電極46で制御される。
【0031】
図5のヘテロ接合電界効果トランジスタにおける半導体素子領域23aにも平坦化領域14の転位18を引き継いだ転位47が生じるが、平坦化領域14の転位18の密度が低いので、半導体素子領域23aの転位47の密度も低くなる。半導体素子領域23aにおいて転位が少ないと、転位に捕獲された電子によるキャリアの散乱を低減することができ、移動度を向上させることができる。
【0032】
【第5の実施形態】
図6は第5の実施形態に従うヘテロ接合電界効果トランジスタを示す。このヘテロ接合電界効果トランジスタは、図5のヘテロ接合電界効果トランジスタを変形したものであるので、図6において図5と共通する部分には同一の符号を付してその説明を省略する。
【0033】
図6のヘテロ接合電界効果トランジスタは、変形された半導体基体10cと半導体素子領域23bとを有する。変形された半導体基体10cは図5の半導体基体10と実質的に同一の機能を有する部分であり、シリコン基板11とバッファ領域12cと転位屈折領域13aと平坦化領域14aとから成る。なお、半導体素子領域23bに含まれているGaN半導体領域50を平坦化領域の一部と呼ぶことも出来る。
【0034】
図6において図2〜図5と同一構成のシリコン基板11の上に配置されたバッファ領域12cはAlNから成る複数の第1の層51とGaNから成る複数の第2の層52とが交互に積層された多層構造のバッファである。図6では図示を簡略化するために第1及び第2の層51、52がそれぞれ4層のみ示されているが、実際にはそれぞれ10層設けられている。図6のバッファ領域12cの第1及び第2の層51、52は、図4のバッファ領域12bの多層構造の第1のバッファ領域21aのAlNから成る第1の層31とGaNから成る第2の層32と同一の方法で形成される。図6の第1及び第2の層51、52と図4の第1及び第2の層31、32との相違点は、層数のみである。図4では第1及び第2の層31、32が20回繰返して形成されているのに対し、図6では、AlNから成る第1の層51とGaNから成る第2の層52とが10回繰り返して形成されている。
図6のバッファ領域12cには、図4の第2の層22に相当するものが含まれていない。
【0035】
図6においてInを含まないバッファ領域12cの上にInを含む窒化物半導体から成る転位屈折領域13aが配置されている。この転位屈折領域13aは、複数の第1及び第2の層61、62を交互に配置した多層構成領域である。転位屈折領域13aの第1の層61は、InxGa1-xN、ここで、xは0<x<1を満足する数値、から成る例えばIn0.01Ga0.99Nであり、第2層の62は、InaGa1-aN、ここで、aは0<a<1、x<aを満足する数値、から成る例えばIn0.2Ga0.8Nである。
【0036】
転位屈折領域13aを形成する時には、OMVPE装置によりバッファ領域12cの形成工程の後に、反応室に対するアンモニア(NH3)以外の成長原料の供給を止め、基板11の温度を800℃まで下げ、しかる後、アンモニアと共に、TMIとTMGとシランとを所望の割合で供給して例えばIn0.01Ga0.99Nを例えば厚さ13nmだけエピタキシャル成長させて第1の層61を得る。次に、TMIの割合を大きくして例えばIn0.2Ga0.8Nを例えば厚さ3nmだけエピタキシャル成長させて第2の層62を得る。第5の実施形態では、第1及び第2の層61、62の形成工程が10回繰返される。
図6の転位屈折領域13aの第1及び第2の層61、62のいずれにもInが含まれているので、第1の実施形態の転位屈折領域13と同様に多数の突出部16が転位屈折領域13aの表面に生じる。なお、図6では図示を簡単にするために転位屈折領域13aの第1及び第2の層61、62の全てが基板11の主面11aに対して平行に示されているが、第1及び第2の層61、62の一部が断面形状において波状に形成され、この波状部分によって突出部16が形成される。
【0037】
転位屈折領域13aの第1の層61は障壁層と呼ぶことができるものであり、第2の層62は井戸層と呼ぶこともできるものである。また、転位屈折領域13aは導電型決定不純物としてシリコンを含んでいるので、導電性を有する。
【0038】
図6の転位屈折領域13aの上に配置された平坦化領域14aは複数の第1の層71と複数の第2の層72との多層構造を有する。図6では、第1及び第2の層71、72がそれぞれ2つ示されているが、実際には第1及び第2の層71、72はそれぞれ10層であり、交互に配置されている。
【0039】
平坦化領域14aの第1の層71は、例えばAlxGa1-xN、ここでxは0<x<1を満足する数値、から成るアルミニウムを含む窒化物で形成され、この実施形態では厚さ5nmのAlNから成る。第2の層72は、例えばAlyGa1-yN、ここでyは0≦y<1、y<xを満足する数値、から成るガリウムを含む窒化物で形成され、この実施形態では厚さ25nmのGaNから成る。図6では転位屈折領域13aと平均化領域14aとの区別を明確にするために平坦化領域14aの第1及び第2の層71、72がほぼ同じ厚みに示されているが、図6のバッファ領域12cの第1、第2の層51、52と同様に互いに異なる厚さを有する。平坦化領域14aの第1及び第2の層71、72はバッファ領域12cの第1及び第2の層51、52と同一物質から成るので、これ等と同一の方法で形成される。平坦化領域14aはInを含まない窒化物から成るので、この表面は転位屈折領域13aのような突出部16を有さず、転位屈折領域13aよりもよい平坦性を有する。平坦化領域14aを形成すると、転位屈折領域13aの転位の延びる方向が突出部16の傾斜側面16aで屈折し、図2の場合と同様に平坦化領域14aによって垂直方向に延びる転位18は少なくなる。
【0040】
図6の半導体素子領域23bはGaN半導体領域50と電子供給層41とショットキ形成層42とソ−スコンタクト層43aとドレインコンタクト層43bとから成り、GaN半導体領域50以外は図5と同一に構成されている。既に説明したように、GaN半導体領域50を平坦化領域14aの1部と呼ぶことができる。この場合には、半導体素子領域23bからGaN半導体領域50が除外される。
【0041】
図6のInを含まない窒化物から成る平坦化領域14aの上に配置されているGaN半導体層50は、図2の平坦化領域14のGaN層と同一の方法で形成される。図6の実施形態のGaN半導体領域50は約300nmの厚さを有する。図6において2次元電子ガスによるチャネルは電子供給層41とGaN半導体層50とのヘテロ界面HJ及びこの近傍に生じる。
【0042】
図6においても転位屈折領域13aの働きによって平坦化領域14a及び半導体素子領域23bの転位密度がバッファ領域12cの転移密度よりも大幅に小さくなり、図5の第4の実施形態と同様な効果を得ることができる。即ち、図6の構成のヘテロ接合電界効果トランジスタのキャリアの移動度は約1200cm2/V・sであり、図6から転位屈折領域13aを省いた構造のヘテロ接合電界効果トランジスタの移動度は800cm2/V・sである。従って、この実施形態により移動度が約1.5倍上昇した。
また、図6の第5の実施形態のバッファ領域12cは図4の第3の実施形態のバッファ領域12bと同様な多層構造を有するので、図4の第3の実施形態と同様に良好なバッファ機能を提供できる。
また、図6においては、転位屈折領域13aがInの比率が異なる複数の第1及び第2の層61、62の多層構造となっているので、突出部16の分布密度を高めることができ、図5の単一層の場合よりも半導体素子領域23aにおける転移密度の低減効果が大きくなる。
また、平坦化領域14aがAlNから成る第1の層71とGaNから成る第2の層72との多層構造を有するので、平坦化作用が図5の単一層構造よりも大きくなる。
【0043】
【変形例】
本発明は上述の実施形態に限定されるものではなく、例えば、次の変形が可能なものである。
(1) 図3のLEDの半導体基体10aの代りに、図6の半導体基体10cを使用することができる。
(2) 図5のヘテロ接合電界効果トランジスタの半導体基体10の代りに図4の半導体基体10bを使用することができる。
(3) LED及びヘテロ接合トランジスタ等の半導体装置のための半導体基体として、図2、図3、図4及び図5の半導体基体10、10a、10bの転位屈折領域13を図6の転位屈折領域13aと同様な多層構造に形成することができる。
(4) 図2、図3、図4及び図5の半導体基体10、10a、10bにおいて、平坦化領域14を図6の平坦化領域14aと同様に多層構造に形成することができる。
(5) 図4のバッファ領域12bの多層構造の第1のバッファ領域21a、図6の多層構造のバッファ領域12c、多層構造の転位屈折領域13a、多層構造の平坦化領域14aに更に別の層を介在させて3層又は3層以上の繰返し構成にすることができる。
(6) 半導体基体10、10a、10b、10cのそれぞれの領域に導電型決定不純物をド−プして半導体基体10、10a、10b、10cに導電性を与えることが望ましいが、導電性が要求されていない時には導電型決定不純物をド−プしなくてもよい。
(7) 図3及び図4には半導体素子としてLEDが形成され、図5及び図6には半導体素子としてHEMT構造のヘテロ接合電界効果トランジスタが形成されているが、これに限ることなく、周知のメタル・セミコンダクタ電界効果トランジスタ(MESFET)等のヘテロ接合電界効果トランジスタ、又はヘテロ接合バイポ−ラトランジスタ、絶縁ゲ−ト電界効果トランジスタ等の半導体素子を形成することができる。
【図面の簡単な説明】
【図1】従来の半導体基板を示す断面図である。
【図2】本発明の第1の実施形態に従う半導体基体を概略的に示す断面図である。
【図3】本発明の第2の実施形態に従うLEDを概略的に示す断面図である。
【図4】本発明の第3の実施形態に従うLEDを概略的に示す断面図である。
【図5】本発明の第4の実施形態に従うヘテロ接合電界効果トランジスタを概略的に示す断面図である。
【図6】本発明の第5の実施形態に従うヘテロ接合電界効果トランジスタを概略的に示す断面図である。
【符号の説明】
11 シリコン基板
12、12a,12b,12c バッファ領域
13,13a 転位屈折領域
14,14a 平坦化領域
23,23a,23b 半導体素子領域
Claims (5)
- 窒化物半導体装置のための半導体基体であって、
基板と、
前記基板の表面上にエピタキシャル成長されたアルミニウムを含み且つインジウムを含んでいない窒化物から成る第1の層と前記第1の層の上にエピタキシャル成長されたガリウムを含み且つインジウムを含んでいない窒化物から成る第2の層とから成り且つ転位を含んでいるバッファ領域と、
前記バッファ領域と異なり且つインジウムを含む窒化物半導体のエピタキシャル成長で前記バッファ領域の表面上に配置され且つ転位を含み且つ前記バッファ領域の表面よりも平坦性の悪い表面を有し且つその表面に転位の延びる方向を屈折させることができる多数の突出部を有している転位屈折領域と、
前記転位屈折領域と異なり且つインジウムを含まない窒化物半導体のエピタキシャル成長で前記転位屈折領域の表面上に配置され且つ前記転位屈折領域の表面よりも平坦性が良く且つ前記転位屈折領域よりも転位密度が小さい表面部分を有している平坦化領域と
を備えていることを特徴とする半導体基体。 - 窒化物半導体装置のための半導体基体であって、
基板と、
前記基板の表面上にエピタキシャル成長されたものであって、アルミニウムを含み且つインジウムを含んでいない窒化物から成る複数の第1の層とガリウムを含み且つインジウムを含んでいない窒化物から成る複数の第2の層とを有し、前記第1の層と前記第2の層とが交互に配置され且つ転位を含んでいるバッファ領域と、
前記バッファ領域と異なり且つインジウムを含む窒化物半導体のエピタキシャル成長で前記バッファ領域の表面上に配置され且つ転位を含み且つ前記バッファ領域の表面よりも平坦性の悪い表面を有し且つその表面に転位の延びる方向を屈折させることができる多数の突出部を有している転位屈折領域と、
前記転位屈折領域と異なり且つインジウムを含まない窒化物半導体のエピタキシャル成長で前記転位屈折領域の表面上に配置され且つ前記転位屈折領域の表面よりも平坦性が良く且つ前記転位屈折領域よりも転位密度が小さい表面部分を有している平坦化領域と
を備えていることを特徴とする半導体基体。 - 窒化物半導体装置のための半導体基体であって、
基板と、
前記基板の表面上にエピタキシャル成長されたものであって、アルミニウムを含み且つインジウムを含んでいない窒化物から成る複数の第1の層とガリウムを含み且つインジウムを含んでいない窒化物から成る複数の第2の層とを有し、前記第1の層と前記第2の層とが交互に配置され且つ転位を含んでいる第1のバッファ領域と、
前記第1のバッファ領域の上にエピタキシャル成長されたものであって、ガリウムを含み且つインジウムを含んでいない窒化物から成り且つ転位を含んでいる第2のバッファ領域と、
前記第2のバッファ領域と異なり且つインジウムを含む窒化物半導体のエピタキシャル成長で前記第2のバッファ領域の表面上に配置され且つ転位を含み且つ前記第2のバッファ領域の表面よりも平坦性の悪い表面を有し且つその表面に転位の延びる方向を屈折させることができる多数の突出部を有している転位屈折領域と、
前記転位屈折領域と異なり且つインジウムを含まない窒化物半導体のエピタキシャル成長で前記転位屈折領域の表面上に配置され且つ前記転位屈折領域の表面よりも平坦性が良く且つ前記転位屈折領域よりも転位密度が小さい表面部分を有している平坦化領域と
を備えていることを特徴とする半導体基体。 - 前記転位屈折領域は、
第1の割合でインジウムを含む窒化物から成る複数の第1の層と、
前記第1の割合よりも大きい第2の割合でインジウムを含む窒化物から成る複数の第2の層と
から成り、前記第1及び第2の層は交互配置されていることを特徴とする請求項1乃至3のいずれかに記載の半導体基体。 - 平坦化領域は、
アルミニウムを含む窒化物から成る複数の第1の層と、
ガリウムを含む窒化物から成る複数の第2の層と
から成り、前記第1及び第2の層は交互に配置され且つインジウムを含まないことを特徴とする請求項1乃至4のいずれかに記載の半導体基体。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003143328A JP3760997B2 (ja) | 2003-05-21 | 2003-05-21 | 半導体基体 |
US10/813,488 US6890791B2 (en) | 2003-05-21 | 2004-03-30 | Compound semiconductor substrates and method of fabrication |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2003143328A JP3760997B2 (ja) | 2003-05-21 | 2003-05-21 | 半導体基体 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2004349387A JP2004349387A (ja) | 2004-12-09 |
JP3760997B2 true JP3760997B2 (ja) | 2006-03-29 |
Family
ID=33447505
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2003143328A Expired - Fee Related JP3760997B2 (ja) | 2003-05-21 | 2003-05-21 | 半導体基体 |
Country Status (2)
Country | Link |
---|---|
US (1) | US6890791B2 (ja) |
JP (1) | JP3760997B2 (ja) |
Families Citing this family (39)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4883931B2 (ja) * | 2005-04-26 | 2012-02-22 | 京セラ株式会社 | 半導体積層基板の製造方法 |
FI20045482A0 (fi) * | 2004-12-14 | 2004-12-14 | Optogan Oy | Matalamman dislokaatiotiheyden omaava puolijohdesubstraatti, ja menetelmä sen valmistamiseksi |
US20070018192A1 (en) * | 2004-12-21 | 2007-01-25 | Yale University | Devices incorporating heavily defected semiconductor layers |
US20060267007A1 (en) * | 2004-12-31 | 2006-11-30 | Yale University | Devices incorporating heavily defected semiconductor layers |
KR101165258B1 (ko) | 2005-08-31 | 2012-07-19 | 서울옵토디바이스주식회사 | 발광 소자 및 이의 제조 방법 |
US7338826B2 (en) * | 2005-12-09 | 2008-03-04 | The United States Of America As Represented By The Secretary Of The Navy | Silicon nitride passivation with ammonia plasma pretreatment for improving reliability of AlGaN/GaN HEMTs |
KR100726971B1 (ko) | 2006-02-13 | 2007-06-14 | 한국광기술원 | 질화물 반도체 발광소자 |
MY149325A (en) * | 2006-02-23 | 2013-08-30 | Azzurro Semiconductors Ag | Nitride semiconductor component and method for the production thereof |
JP4670055B2 (ja) * | 2006-03-20 | 2011-04-13 | Dowaエレクトロニクス株式会社 | 半導体基板及び半導体装置 |
JP2007324363A (ja) * | 2006-05-31 | 2007-12-13 | Ritsumeikan | 半導体装置 |
ITMI20070056A1 (it) * | 2007-01-17 | 2008-07-18 | Consiglio Nazionale Ricerche | Substrato semiconduttore adatto alla realizzazione di dispositivi elettronici e-o optoelettronici e relativo processo di fabbricazione |
US8890103B2 (en) | 2007-01-17 | 2014-11-18 | Consiglio Nazionale Delle Ricerche | Semiconductor substrate suitable for the realisation of electronic and/or optoelectronic devices and relative manufacturing process |
JP5095253B2 (ja) * | 2007-03-30 | 2012-12-12 | 富士通株式会社 | 半導体エピタキシャル基板、化合物半導体装置、およびそれらの製造方法 |
KR101283261B1 (ko) * | 2007-05-21 | 2013-07-11 | 엘지이노텍 주식회사 | 발광 소자 및 그 제조방법 |
JP5053220B2 (ja) | 2008-09-30 | 2012-10-17 | 古河電気工業株式会社 | 半導体電子デバイスおよび半導体電子デバイスの製造方法 |
JP2010199441A (ja) * | 2009-02-26 | 2010-09-09 | Furukawa Electric Co Ltd:The | 半導体電子デバイスおよび半導体電子デバイスの製造方法 |
JP5165626B2 (ja) * | 2009-03-26 | 2013-03-21 | コバレントマテリアル株式会社 | GaN系化合物半導体基板とその製造方法 |
WO2011016304A1 (ja) | 2009-08-07 | 2011-02-10 | 日本碍子株式会社 | 半導体素子用エピタキシャル基板、半導体素子用エピタキシャル基板の製造方法、および半導体素子 |
JP5334057B2 (ja) * | 2009-11-04 | 2013-11-06 | Dowaエレクトロニクス株式会社 | Iii族窒化物積層基板 |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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JP2001313421A (ja) | 2000-02-21 | 2001-11-09 | Sanken Electric Co Ltd | 半導体発光素子及びその製造方法 |
-
2003
- 2003-05-21 JP JP2003143328A patent/JP3760997B2/ja not_active Expired - Fee Related
-
2004
- 2004-03-30 US US10/813,488 patent/US6890791B2/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP2004349387A (ja) | 2004-12-09 |
US20040232440A1 (en) | 2004-11-25 |
US6890791B2 (en) | 2005-05-10 |
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A621 | Written request for application examination |
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A131 | Notification of reasons for refusal |
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A521 | Request for written amendment filed |
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A01 | Written decision to grant a patent or to grant a registration (utility model) |
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A61 | First payment of annual fees (during grant procedure) |
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|
R150 | Certificate of patent or registration of utility model |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100120 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110120 Year of fee payment: 5 |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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