JP3309738B2 - 画像表示装置 - Google Patents
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- G—PHYSICS
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Description
【０００１】
【発明の属する技術分野】本発明は、画像表示装置に関
するものであり、とりわけ表示画面上での均一性不良を
補正する回路装置を有する画像表示装置に関するもので
ある。
するものであり、とりわけ表示画面上での均一性不良を
補正する回路装置を有する画像表示装置に関するもので
ある。
【０００２】
【従来の技術】近年、画像表示装置の一つとして投写画
像表示装置があげられるが、その表示領域の大型化に伴
い、装置を構成する光源および画像表示素子（ＬＩＧＨ
Ｔ ＶＵＬＶＥ）のバラツキや、プロジェクションレン
ズの周辺減光により発生するスクリーン上の位置による
赤色、緑色、青色の各単色の輝度ムラや、これらの重ね
合わせによる色ムラを補正する回路を投写型画像表示装
置に組み込むことが必要となってきており、例えば特開
昭61-243495号公報がその一例としてあげられる。
像表示装置があげられるが、その表示領域の大型化に伴
い、装置を構成する光源および画像表示素子（ＬＩＧＨ
Ｔ ＶＵＬＶＥ）のバラツキや、プロジェクションレン
ズの周辺減光により発生するスクリーン上の位置による
赤色、緑色、青色の各単色の輝度ムラや、これらの重ね
合わせによる色ムラを補正する回路を投写型画像表示装
置に組み込むことが必要となってきており、例えば特開
昭61-243495号公報がその一例としてあげられる。
【０００３】以下にその従来例を説明する。従来例の構
成を図４に示す。まず投写型画像表示装置に一定輝度レ
ベルの映像信号を入力し、スクリーンにこの映像を投写
する。次にスクリーンの投写領域を適当に分割した領域
毎にその輝度レベルを撮像カメラで測定し、目標として
いる輝度レベルとの直流差分データを輝度補正デ−タと
してメモリー５に記録する。補正デ−タが記録されたメ
モリー５は投写型画像表示装置の輝度補正回路に組み込
まれる。この補正デ−タの読み出しは、入力映像信号の
水平、垂直同期信号から輝度測定時に分割されたスクリ
ーン領域に対応するメモリーのアドレスを算出すること
により行われ、この補正データをＤ／Ａ変換回路７でア
ナログ値に変換し、このアナログ補正値を加算回路１３
を使って入力映像信号に加算した映像信号で投写型画像
表示装置の例えば液晶表示素子のような画像表示素子
（ＬＩＧＨＴ ＶＵＬＶＥ）をドライブすることにより
スクリーン上の均一性不良を補正している。
成を図４に示す。まず投写型画像表示装置に一定輝度レ
ベルの映像信号を入力し、スクリーンにこの映像を投写
する。次にスクリーンの投写領域を適当に分割した領域
毎にその輝度レベルを撮像カメラで測定し、目標として
いる輝度レベルとの直流差分データを輝度補正デ−タと
してメモリー５に記録する。補正デ−タが記録されたメ
モリー５は投写型画像表示装置の輝度補正回路に組み込
まれる。この補正デ−タの読み出しは、入力映像信号の
水平、垂直同期信号から輝度測定時に分割されたスクリ
ーン領域に対応するメモリーのアドレスを算出すること
により行われ、この補正データをＤ／Ａ変換回路７でア
ナログ値に変換し、このアナログ補正値を加算回路１３
を使って入力映像信号に加算した映像信号で投写型画像
表示装置の例えば液晶表示素子のような画像表示素子
（ＬＩＧＨＴ ＶＵＬＶＥ）をドライブすることにより
スクリーン上の均一性不良を補正している。
【０００４】
【発明が解決しようとする課題】しかしながら、均一性
不良の補正は一定の領域毎に行われており、領域間での
補正データの差による補正の段差の影響は無視できな
い。水平方向はローパスフィルター等で比較的容易に平
滑化できるが、垂直方向で同様の平滑化を行うためには
フィールドメモリー等の高価な回路が必要となり、必ず
しも容易な方法で平滑化できているとは言えない。
不良の補正は一定の領域毎に行われており、領域間での
補正データの差による補正の段差の影響は無視できな
い。水平方向はローパスフィルター等で比較的容易に平
滑化できるが、垂直方向で同様の平滑化を行うためには
フィールドメモリー等の高価な回路が必要となり、必ず
しも容易な方法で平滑化できているとは言えない。
【０００５】
【課題を解決するための手段】上記の問題を解決するた
めに本発明の画像表示装置は、赤色、緑色、青色（以下
Ｒ、Ｇ、Ｂと略す。）の少なくとも一色の映像信号につ
いて画像の均一性不良を補正するためのデジタルデータ
を発生するデータ発生部と、前記データ発生部から補正
データを読み出すタイミングを制御するタイミング発生
回路と、前記タイミング発生回路によりタイミング制御
されデータ発生部から発生させた補正データにより映像
信号を補正演算する演算処理回路を備え、映像信号の補
正を領域毎に行いかつ補正ブロック間の境界部をタイミ
ング制御により平滑化するように構成したものである。
めに本発明の画像表示装置は、赤色、緑色、青色（以下
Ｒ、Ｇ、Ｂと略す。）の少なくとも一色の映像信号につ
いて画像の均一性不良を補正するためのデジタルデータ
を発生するデータ発生部と、前記データ発生部から補正
データを読み出すタイミングを制御するタイミング発生
回路と、前記タイミング発生回路によりタイミング制御
されデータ発生部から発生させた補正データにより映像
信号を補正演算する演算処理回路を備え、映像信号の補
正を領域毎に行いかつ補正ブロック間の境界部をタイミ
ング制御により平滑化するように構成したものである。
【０００６】本発明は、上述の背景を考慮してなされた
ものであり、その目的は画像表示領域上での均一性不良
の補正を領域毎に行う際、領域間の平滑化を水平方向、
垂直方向の両方において高精度、かつ安価に行うことで
あり、高画質低価格の画像表示装置を提供することをで
ある。
ものであり、その目的は画像表示領域上での均一性不良
の補正を領域毎に行う際、領域間の平滑化を水平方向、
垂直方向の両方において高精度、かつ安価に行うことで
あり、高画質低価格の画像表示装置を提供することをで
ある。
【０００７】
【発明の実施の形態】本発明は、Ｒ、Ｇ、Ｂの少なくと
も一色の映像信号について画像の均一性不良を補正する
ためのデジタルデータを発生するデータ発生部と、前記
データ発生部から補正データを読み出すタイミングを制
御するタイミング発生回路と、前記タイミング発生回路
によりタイミング制御されデータ発生部から発生させた
補正データにより映像信号を補正演算する演算処理回路
を備え、映像信号の補正を領域毎に行いかつ補正ブロッ
ク間の境界部をタイミング制御により平滑化することを
特徴とする画像表示装置であり、本発明は上記の構成に
よって、均一性不良の補正を領域毎に行う際、補正デー
タの発生のタイミングを補正の水平同期信号や垂直同期
信号をフィールド等で位相をずらす等により制御するこ
とにより高精度かつ安価に補正領域間の平滑化が可能と
なるという作用を有する。
も一色の映像信号について画像の均一性不良を補正する
ためのデジタルデータを発生するデータ発生部と、前記
データ発生部から補正データを読み出すタイミングを制
御するタイミング発生回路と、前記タイミング発生回路
によりタイミング制御されデータ発生部から発生させた
補正データにより映像信号を補正演算する演算処理回路
を備え、映像信号の補正を領域毎に行いかつ補正ブロッ
ク間の境界部をタイミング制御により平滑化することを
特徴とする画像表示装置であり、本発明は上記の構成に
よって、均一性不良の補正を領域毎に行う際、補正デー
タの発生のタイミングを補正の水平同期信号や垂直同期
信号をフィールド等で位相をずらす等により制御するこ
とにより高精度かつ安価に補正領域間の平滑化が可能と
なるという作用を有する。
【０００８】（実施の形態１）以下本発明の実施の形態
について、図面を参照しながら説明する。
について、図面を参照しながら説明する。
【０００９】図１は本発明の画像表示装置の均一性改善
の実施の形態の構成を示すブロック図である。Ｒ、Ｇ、
Ｂの少なくとも一色の映像信号について画像の均一性不
良を補正するためのデジタルデータを発生するデータ発
生部と、前記データ発生部から補正データを読み出すタ
イミングを制御するタイミング発生回路と、前記タイミ
ング発生回路によりタイミング制御されデータ発生部か
ら発生させた補正データにより映像信号を補正演算する
演算処理回路を備え、映像信号の補正を領域毎に行いか
つ補正ブロック間の境界部を、補正の水平同期信号、垂
直同期信号の位相をずらす等のタイミング制御により平
滑化することを特徴とする画像表示装置。
の実施の形態の構成を示すブロック図である。Ｒ、Ｇ、
Ｂの少なくとも一色の映像信号について画像の均一性不
良を補正するためのデジタルデータを発生するデータ発
生部と、前記データ発生部から補正データを読み出すタ
イミングを制御するタイミング発生回路と、前記タイミ
ング発生回路によりタイミング制御されデータ発生部か
ら発生させた補正データにより映像信号を補正演算する
演算処理回路を備え、映像信号の補正を領域毎に行いか
つ補正ブロック間の境界部を、補正の水平同期信号、垂
直同期信号の位相をずらす等のタイミング制御により平
滑化することを特徴とする画像表示装置。
【００１０】図１において、映像入力端子１より入力さ
れた映像信号は信号処理回路８によってＲ、Ｇ、Ｂの原
色映像信号に変換される。一方入力映像信号は同期分離
回路２に入力され、水平同期信号と垂直同期信号に分離
して出力される。水平同期信号は更に位相同期回路３に
入力され、入力映像信号の水平同期に位相同期した水平
同期クロックを発生させる。
れた映像信号は信号処理回路８によってＲ、Ｇ、Ｂの原
色映像信号に変換される。一方入力映像信号は同期分離
回路２に入力され、水平同期信号と垂直同期信号に分離
して出力される。水平同期信号は更に位相同期回路３に
入力され、入力映像信号の水平同期に位相同期した水平
同期クロックを発生させる。
【００１１】この水平同期クロック、上記垂直同期信
号、水平同期信号を位相調整回路４に入力し、フィール
ド毎に水平同期信号、垂直同期信号の位相を制御し、こ
の出力信号をアドレスカウンター５に入力することによ
り表示領域を碁盤目状に分割したブロックに対応したア
ドレスを発生させまたこのブロック間の補正データの段
差を平滑化する。メモリー６には表示領域上を碁盤目状
に分割した各々の領域に対応するＲ、Ｇ、Ｂの補正デ−
タが予め格納されている。
号、水平同期信号を位相調整回路４に入力し、フィール
ド毎に水平同期信号、垂直同期信号の位相を制御し、こ
の出力信号をアドレスカウンター５に入力することによ
り表示領域を碁盤目状に分割したブロックに対応したア
ドレスを発生させまたこのブロック間の補正データの段
差を平滑化する。メモリー６には表示領域上を碁盤目状
に分割した各々の領域に対応するＲ、Ｇ、Ｂの補正デ−
タが予め格納されている。
【００１２】従って前記位相調整回路４とアドレスカウ
ンター５からなるタイミング発生回路１２からこの分割
領域に対応するアドレスをメモリー６に入力することに
より上記の各分割領域に対応するＲ、Ｇ、Ｂの補正デ−
タがそれぞれ読み出される。読み出されたデ−タはＤ／
Ａ変換器７に入力され、Ｒ、Ｇ、Ｂそれぞれアナログデ
ータに変換された後アナログ演算処理回路９に入力さ
れ、この信号により前述の信号処理回路８から出力され
たＲ、Ｇ、Ｂの原色映像信号の少なくとも一色について
演算処理することにより均一性の改善を行い、この出力
信号は駆動回路１０に入力され映像出力端子１１から出
力される。
ンター５からなるタイミング発生回路１２からこの分割
領域に対応するアドレスをメモリー６に入力することに
より上記の各分割領域に対応するＲ、Ｇ、Ｂの補正デ−
タがそれぞれ読み出される。読み出されたデ−タはＤ／
Ａ変換器７に入力され、Ｒ、Ｇ、Ｂそれぞれアナログデ
ータに変換された後アナログ演算処理回路９に入力さ
れ、この信号により前述の信号処理回路８から出力され
たＲ、Ｇ、Ｂの原色映像信号の少なくとも一色について
演算処理することにより均一性の改善を行い、この出力
信号は駆動回路１０に入力され映像出力端子１１から出
力される。
【００１３】図２、図３は垂直同期信号、水平同期信号
の位相を制御することにより補正ブロック間のデータの
段差の平滑化を行う位相調整回路の動作を説明する概略
図とタイミング図である。
の位相を制御することにより補正ブロック間のデータの
段差の平滑化を行う位相調整回路の動作を説明する概略
図とタイミング図である。
【００１４】図２において、表示領域を垂直１２０領域
に分割しこのブロック毎に補正を行うことを考える。
（水平も適当な数に分割している。）図２（ａ）に示す
ようにこの１ブロックの垂直方向のライン数を４Ｈと考
えた場合、偶数フィールドでは表示領域と補正ブロック
を一致させるのに対し、奇数フィールドでは補正ブロッ
クの垂直同期信号を映像信号に比べて２ライン早めるこ
とにより表示領域と補正ブロックを２ラインずらす。こ
れにより偶数フィールドと奇数フィールドで補正ブロッ
クの境界の位置が異なり、データの段差により補正ブロ
ックの境界が目立つことを防ぐことが可能となる。
に分割しこのブロック毎に補正を行うことを考える。
（水平も適当な数に分割している。）図２（ａ）に示す
ようにこの１ブロックの垂直方向のライン数を４Ｈと考
えた場合、偶数フィールドでは表示領域と補正ブロック
を一致させるのに対し、奇数フィールドでは補正ブロッ
クの垂直同期信号を映像信号に比べて２ライン早めるこ
とにより表示領域と補正ブロックを２ラインずらす。こ
れにより偶数フィールドと奇数フィールドで補正ブロッ
クの境界の位置が異なり、データの段差により補正ブロ
ックの境界が目立つことを防ぐことが可能となる。
【００１５】図３（ａ）において、上記の映像信号、補
正データ各々の垂直同期信号と水平同期信号のタイミン
グを示す。
正データ各々の垂直同期信号と水平同期信号のタイミン
グを示す。
【００１６】図２（ｂ）に示すように４フィールドにわ
たり１ラインずつずらすことにより、映像信号にさらに
重いフィルターをかけることと等価になり境界が一層目
立たなくなる。図３（ｂ）において、上記の映像信号、
補正データ各々の垂直同期信号と水平同期信号のタイミ
ングを示す。
たり１ラインずつずらすことにより、映像信号にさらに
重いフィルターをかけることと等価になり境界が一層目
立たなくなる。図３（ｂ）において、上記の映像信号、
補正データ各々の垂直同期信号と水平同期信号のタイミ
ングを示す。
【００１７】水平方向においても同様の制御により補正
ブロックの境界部の平滑化が可能となる。本実施の形態
では補正データ発生部にアドレスカウンターとメモリー
装置を用いたがこの部分を他のデータ発生回路に置き換
えても同様の効果が得られる。
ブロックの境界部の平滑化が可能となる。本実施の形態
では補正データ発生部にアドレスカウンターとメモリー
装置を用いたがこの部分を他のデータ発生回路に置き換
えても同様の効果が得られる。
【００１８】以上のように本実施の形態によれば、均一
性不良の補正を領域毎に行う際、補正データの発生のタ
イミングを補正の水平同期信号や垂直同期信号をフィー
ルド等で位相をずらす等により制御することにより、高
精度かつ安価に補正領域間の平滑化を行うことを可能と
する。
性不良の補正を領域毎に行う際、補正データの発生のタ
イミングを補正の水平同期信号や垂直同期信号をフィー
ルド等で位相をずらす等により制御することにより、高
精度かつ安価に補正領域間の平滑化を行うことを可能と
する。
【００１９】
【発明の効果】以上のように本発明の画像表示装置によ
れば、Ｒ、Ｇ、Ｂの少なくとも一色の映像信号について
画像の均一性不良を補正するためのデジタルデータを発
生するデータ発生部と、前記データ発生部から補正デー
タを読み出すタイミングを制御するタイミング発生回路
と、前記タイミング発生回路によりタイミング制御され
データ発生部から発生させた補正データにより映像信号
を補正演算する演算処理回路を備えることにより、映像
信号の補正を領域毎に行いかつ補正ブロック間の境界部
を、補正の水平同期信号や垂直同期信号をフィールド等
で位相をずらす等によるタイミング制御により平滑化す
ることが可能となり、高性能でかる安価なフィルターリ
ングが実現できる。
れば、Ｒ、Ｇ、Ｂの少なくとも一色の映像信号について
画像の均一性不良を補正するためのデジタルデータを発
生するデータ発生部と、前記データ発生部から補正デー
タを読み出すタイミングを制御するタイミング発生回路
と、前記タイミング発生回路によりタイミング制御され
データ発生部から発生させた補正データにより映像信号
を補正演算する演算処理回路を備えることにより、映像
信号の補正を領域毎に行いかつ補正ブロック間の境界部
を、補正の水平同期信号や垂直同期信号をフィールド等
で位相をずらす等によるタイミング制御により平滑化す
ることが可能となり、高性能でかる安価なフィルターリ
ングが実現できる。
【図１】本発明の実施の形態における画像表示装置の構
成を示すブロック図
成を示すブロック図
【図２】同期信号の位相調整を説明する概念図
【図３】同期信号の位相調整を説明するタイミング図
【図４】従来技術の構成を示すブロック図
１ 映像信号入力端子 ２ 同期分離回路 ３ 位相同期回路 ４ 位相調整回路 ５ アドレスカウンター ６ メモリー ７ Ｄ／Ａ変換回路器 ８ 信号処理回路 ９ アナログ演算処理回路 １０ 駆動回路 １１ 映像出力端子 １２ タイミング発生回路
フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) G09G 3/36 H04N 9/12 - 9/31 G02F 1/133
Claims (2)
- 【請求項１】 赤色、緑色、青色の少なくとも一色の映
像信号について画像の均一性不良を補正するためのデジ
タルデータを発生するデータ発生部と、前記データ発生
部から補正データを読み出すタイミングを制御するタイ
ミング発生回路と、前記タイミング発生回路によりタイ
ミング制御されデータ発生部から発生させた補正データ
により映像信号を補正演算する演算処理回路を備え、映
像信号の補正を領域毎に行いかつ補正ブロック間の境界
部をタイミング制御により平滑化することを特徴とする
画像表示装置。 - 【請求項２】 データ発生部から補正データを発生させ
るタイミングに関して、補正の垂直同期信号、水平同期
信号の一つの位相をフィールド信号毎にずらすことを特
徴とする請求項１記載の画像表示装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29141296A JP3309738B2 (ja) | 1996-11-01 | 1996-11-01 | 画像表示装置 |
| CN97121327.5A CN1128433C (zh) | 1996-11-01 | 1997-10-23 | 亮度修正电路及其图像显示装置 |
| EP97118655A EP0840275B1 (en) | 1996-11-01 | 1997-10-27 | Luminance correction circuit and video display monitor thereof |
| DE69706390T DE69706390T2 (de) | 1996-11-01 | 1997-10-27 | Schaltung zur Korrektur der Helligkeit und ein Video-Anzeigemonitor, der eine solche Schaltung verwendet |
| US08/960,324 US6288756B1 (en) | 1996-11-01 | 1997-10-29 | Luminance correction circuit and video display monitor thereof |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29141296A JP3309738B2 (ja) | 1996-11-01 | 1996-11-01 | 画像表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10133633A JPH10133633A (ja) | 1998-05-22 |
| JP3309738B2 true JP3309738B2 (ja) | 2002-07-29 |
Family
ID=17768562
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29141296A Expired - Fee Related JP3309738B2 (ja) | 1996-11-01 | 1996-11-01 | 画像表示装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US6288756B1 (ja) |
| EP (1) | EP0840275B1 (ja) |
| JP (1) | JP3309738B2 (ja) |
| CN (1) | CN1128433C (ja) |
| DE (1) | DE69706390T2 (ja) |
Cited By (1)
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| KR101255311B1 (ko) * | 2006-06-29 | 2013-04-15 | 엘지디스플레이 주식회사 | 평판표시장치와 그 화질제어 방법 |
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| TWI249630B (en) * | 1999-05-10 | 2006-02-21 | Matsushita Electric Ind Co Ltd | Image display device and method for displaying image |
| JP2002223454A (ja) * | 2001-01-26 | 2002-08-09 | Canon Inc | 投射型画像表示装置 |
| TW569016B (en) * | 2001-01-29 | 2004-01-01 | Semiconductor Energy Lab | Light emitting device |
| JP3476787B2 (ja) * | 2001-04-20 | 2003-12-10 | 松下電器産業株式会社 | 表示装置及び表示方法 |
| JP2005535010A (ja) * | 2002-06-12 | 2005-11-17 | シリコン オプティックス インコーポレイテッド | 光学異常の電子補正のためのシステムおよび方法 |
| JP3991011B2 (ja) | 2003-06-20 | 2007-10-17 | キヤノン株式会社 | 画像信号処理装置 |
| JP4047306B2 (ja) * | 2003-07-15 | 2008-02-13 | キヤノン株式会社 | 補正値の決定方法、表示装置の製造方法 |
| JP2006014016A (ja) * | 2004-06-28 | 2006-01-12 | Seiko Epson Corp | 自動画像補正回路 |
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