JP2971594B2 - 半導体集積回路装置 - Google Patents
半導体集積回路装置Info
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Description
関し、特にLOC(Lead On Chip)構造を備えた樹脂封止
形LSIパッケージに適用して有効な技術に関するもの
である。
M(Dynamic Random Access Memory)や、16メガビッ
トDRAMなどの大規模集積回路を形成した半導体チッ
プを収容する樹脂封止形LSIパッケージは、チップサ
イズが従来よりも増大する一方でパッケージ寸法の増大
には規格上の制約があるという理由から、パッケージ本
体を構成する樹脂の肉厚が極めて薄くなっている。その
ため、パッケージ本体内のインナーリード長が極めて短
くなり、リードがパッケージから抜け易くなったり、リ
ードを折り曲げる際にパッケージにクラックが発生した
りするという問題が生じている。
のうち、SOJ(Small Outline J-lead package)などの
表面実装形LSIパッケージでは、上記した問題に加え
て、パッケージ中に含まれる水分が半田リフロー時の熱
で膨張することに起因する、いわゆるリフロークラック
が深刻な問題になっている。
載するタブ(ダイパッド)を廃止し、チップの主面に接
着した絶縁テープ上にリードを配置してリードとチップ
のボンディングパッドとをボンディングワイヤにより結
線する、いわゆるLOC(リード・オン・チップ) 構造
や、リード上に接着した絶縁テープの上にチップを搭載
し、リードとボンディングパッドとをワイヤで結線す
る、いわゆるCOL(Chip On Lead)構造などのタブレス
リードフレーム方式が提案されている。
LSIパッケージは、インナーリード長を長くするこ
とができるため、パッケージの耐熱性や耐湿性が向上す
る。チップ周辺でインナーリードをひき回す必要がな
いので、サイズの大きいチップでも従来寸法のパッケー
ジに収容することが可能となる。チップ内の配線長を
短くすることができるため、信号の配線遅延が低減され
る。水分がたまってリフロークラックの原因となるタ
ブの廃止により、リフロークラック耐性が向上する、な
どの特徴がある。
においては、チップに電源(電源電圧〔VCC〕、基準電
圧〔VSS〕)を供給するそれぞれのインナーリードをチ
ップの長辺に平行して引き伸ばし、それらをチップの主
面上の中央部に配置する方式が採用されている(以下、
本願においては、チップ中央部に引き伸ばされた上記電
源供給用インナーリードをバスバーリードと称する)。
このバスバーリードを有するLOC構造のLSIパッケ
ージは、チップの主面のどの箇所にも短距離で電源を供
給することができるので、電源ノイズが低減され、回路
の高速動作を実現することができるという利点がある。
構造のLSIパッケージについては、日経BP社、19
91年2月1日発行の「日経マイクロデバイス、2月1
日号」P89〜P97、特願平2−234193号公報
などに記載がある。
ーリードを有するLOC構造のLSIパッケージは、温
度サイクル試験時にクラックが生じ易いという欠点があ
った。
ケージクラック発生のメカニズムは、以下のようなもの
であると考えられる。
に使用されている絶縁テープは、その熱膨張率が他の部
材(チップ、リード、樹脂)に比べて大きいため、温度
サイクル試験の低温側でこの絶縁テープが収縮した際、
その収縮応力によって絶縁テープの側面と樹脂との界面
に剥離が生じると共に、バスバーリードに撓みが発生す
る。
界面に生じた剥離がバスバーリードの側面、次いで上面
へと進展し、バスバーリードのコーナー部に応力が集中
してパッケージクラックが発生する。
生のメカニズムに着目してなされたものであり、その目
的は、バスバーリードを有するLOC構造のLSIパッ
ケージのクラックを防止することのできる技術を提供す
ることにある。
な特徴は、本明細書の記述および添付図面から明らかに
なるであろう。
発明のうち、代表的なものの概要を簡単に説明すれば、
次のとおりである。
造の半導体集積回路装置(LSIパッケージ)は、下記
の構成(1)〜(8)のうち、少なくとも一つを備えてい
る。
ドの延在方向と交差する部分に選択的にメッキを施し、
このメッキ部をボンディングエリアとする。
る。
る。
平行する面内でジグザグ状に折り曲げる。
の下面に配置される絶縁テープの面積をそれらの面積と
略等しくすることによって、絶縁テープの面積を必要最
小限まで縮小する。
℃以下の絶縁材料で構成する。
リードおよびバスバーリード)と樹脂との接着性が向上
する。すなわち、表面にAgなどのメッキを施したリー
ドは、メッキ処理をしないリードに比べて樹脂との接着
力が弱いので、バスバーリードの複数のインナーリード
の延在方向と交差する部分にメッキを施し、このメッキ
部をボンディングエリアとすることにより、リードの全
面にメッキを施している従来技術に比べてリードと樹脂
との接着性が向上する。
ドの上面に凹凸を設けることにより、バスバーリードの
上面が平坦な場合に比べてバスバーリードと樹脂との接
着力が向上する。
ドの側面に凹凸を設けることにより、バスバーリードの
撓みが抑制されると共に、応力が集中するコーナー位置
が分散されるため、バスバーリードのコーナー部への応
力集中が緩和される。
ドを絶縁テープの上面に平行な面内でジグザグ状に折り
曲げることにより、前記手段(3) と同様の効果が得ら
れ、そのコーナー部への応力集中が緩和される。
面積を必要最小限にすることにより、その収縮応力が低
減される。また、テープ接着剤の濡れにくい部分を除去
することもできる。
熱膨張率1.4×10-5/℃以下の絶縁材料で構成するこ
とにより、その収縮応力が低減される。
お、実施例を説明するための全図において、同一の機能
を有するものは同一の符号を付け、その繰り返しの説明
は省略する。
より説明する。図1は、このLSIパッケージのインナ
ーリードおよびバスバーリードを示す要部平面図、図2
は、このLSIパッケージの要部破断斜視図、図3は、
このLSIパッケージの短辺方向に沿った断面図であ
る。
LSIパッケージ1は、樹脂封止形LSIパッケージの
一種のSOJである。このLSIパッケージ1は、例え
ば400(mil)のパッケージサイズを有している。
パッケージ本体2は、例えばシリコーンフィラーを添加
したエポキシ系樹脂からなり、その内部にはシリコン単
結晶からなる長方形の半導体チップ3が封止されてい
る。このチップ3の主面には、例えば16メガビット
(Mbit)の大容量を有するDRAMが形成されている。
絶縁テープ4が接着されている。この絶縁テープ4の基
材は、例えば熱膨張率(α)が1.4×10-5/℃以下
で、厚さが0.1mm以下のポリイミド系樹脂テープからな
り、エポキシ系またはポリイミド系の接着剤によってチ
ップ3の主面上に接着されている。
3の主面の中央部には、チップ3の長辺方向に沿って複
数のボンディングパッド5が形成されている。また、上
記絶縁テープ4上には、チップ3の長辺方向に沿って複
数のインナーリード6Aが配置されている。すなわち、
本実施例のLSIパッケージ1は、チップ3の主面上に
絶縁テープ4を介してインナーリード6Aを配置したL
OC(リード・オン・チップ)構造を採用している。
体2の長辺の側面から外方に延在するアウターリード6
Bと一体に構成されている。アウターリード6Bのそれ
ぞれには、規格に基づき所定の番号が付されている。本
実施例のLSIパッケージ1は、例えば24本のアウタ
ーリード6Bを有し、図2に示すように、パッケージ本
体2の手前の左端から右端に沿って1番端子〜6番端
子、9番端子〜14番端子が配置され、パッケージ本体
2の向こう側の右端から左端に沿って15番端子〜20
番端子、23番端子〜28番端子が配置されている。
2の手前の1番端子および14番端子は電源電圧
〔VCC〕端子である。電源電圧〔VCC〕は、例えば回路
の動作電圧5〔V〕である。また、パッケージ本体2の
向こう側の15番端子および28番端子は基準電圧〔V
SS〕端子である。基準電圧〔VSS〕は、例えば回路の基
準電圧0〔V〕(GND)である。
は空き端子、4番端子はライトイネーブル信号端子、5
番端子はロウアドレスストローブ信号端子、6番端子、
9〜13番端子、16〜20番端子および23番端子は
アドレス信号端子、24番端子は空き端子、25番端子
はカラムアドレスストローブ信号端子、26番端子は空
き端子、27番端子はデータ出力端子である。なお、チ
ップ3の短辺には、チップ支持用リード6Cが設けられ
ている。
6Aおよびチップ支持用リード6Cのそれぞれは、リー
ドフレームから切断され、かつ成形されている。リード
フレームは、例えば42アロイなどのFe−Ni合金、
またはCuで構成されており、その板厚は150〜25
0μm程度である。
電源電圧〔VCC〕端子である1番端子および14番端子
は、図2の手前の絶縁テープ4上のバスバーリード7と
一体に形成されている。また、基準電圧〔VSS〕端子で
ある15番端子および28番端子は、図2の向こう側の
絶縁テープ4上のバスバーリード7と一体に形成されて
いる。上記一対のバスバーリード7,7のそれぞれは、
コの字状のパターンを有しており、例えばエポキシ系ま
たはポリイミド系接着剤によって絶縁テープ4上に接着
されている。
れたインナーリード6A(2番端子〜6番端子、9番端
子〜13番端子、16番端子〜20番端子、23番端子
〜27番端子)のそれぞれは、エポキシ系またはポリイ
ミド系接着剤によって絶縁テープ4上に接着されてい
る。
ンディングワイヤ8を通じてチップ3のボンディングパ
ッド5と電気的に接続されている。電源電圧〔VCC〕端
子を構成するインナーリード6Aに接続されるボンディ
ングワイヤ8、および基準電圧〔VSS〕端子を構成する
インナーリード6Aに接続されるワイヤ8のそれぞれの
一端は、バスバーリード7上にボンディングされてい
る。また、信号端子を構成するインナーリード6Aに接
続されるボンディングワイヤ8のそれぞれの一端は、バ
スバーリード7の上を跨ぐようにしてインナーリード6
A上にボンディングされている。
u、Alあるいはこれらの金属の表面に絶縁性樹脂を被
覆した被覆ワイヤからなる。また、ボンディングワイヤ
8は、例えば熱圧着に超音波振動を併用したボンディン
グ法を用いてボンディングされている。
Aおよびバスバーリード7の上面において、ボンディン
グワイヤ8の一端が接続される領域(ボンディングエリ
ア))には、Ag、AuまたはPdからなるメッキパタ
ーン9が形成されている。すなわち、本実施例のLSI
パッケージ1は、インナーリード6aおよびバスバーリ
ード7のボンディングエリアだけにメッキを施し、その
他のエリアにはメッキを施していない。具体的には、図
1に示されるように、インナーリード6Aの先端部の上
面、およびバスバーリード7のインナーリード6Aの延
在方向と交差する部分の選択された領域の上面のみにメ
ッキが施され、それらのメッキ領域はボンディングエリ
アであり、そのメッキ領域にワイヤボンディングがなさ
れる。
バスバーリード7は、絶縁テープ4の外縁よりも内側に
配置されている。すなわち、本実施例のLSIパッケー
ジ1は、バスバーリード7の側面を絶縁テープ4の側面
から遠ざけている。
ば、下記のような作用、効果を得ることができる。
ード7のボンディングエリアだけにメッキを施し、その
他のエリアにはメッキを施さないことにより、インナー
リード6Aおよびバスバーリード7の全面にメッキを施
す場合に比べて、インナーリード6Aおよびバスバーリ
ード7とパッケージ本体2を構成する樹脂との接着性が
向上する。
4の側面から遠ざけることにより、万一絶縁テープ4の
側面と樹脂との界面に剥離が生じた場合でも、この剥離
がバスバーリード7の側面へと進展するのを防止するこ
とができる。
/℃以下の絶縁材料で構成することにより、その収縮応
力を低減することができる。
ることにより、その体積が小さくなるので、その収縮応
力を低減することができる。
ラックの発生率を低減することができるので、DRAM
の動作信頼性、寿命が向上する。
パッケージ1のインナーリード6Aおよびバスバーリー
ド7を示す要部平面図である。
よびバスバーリード7のそれぞれの下面に配置された絶
縁テープ4は、その面積がインナーリード6Aおよびバ
スバーリード7の面積と略等しくなっている。このよう
に、本実施例のLSIパッケージ1は、絶縁テープ4の
面積を必要最小限まで縮小し、その収縮応力を低減した
ので、パッケージクラックの発生率を低減することがで
きる。
パッケージ1のインナーリード6Aおよびバスバーリー
ド7を示す要部平面図である。
その側面の一部に凹凸パターン10が設けられている。
これにより、絶縁テープ4の収縮応力に起因するバスバ
ーリード7の撓みが抑制されるので、パッケージクラッ
クの発生率を低減することができる。
パッケージ1の短辺方向に沿った断面図である。
その厚さがインナーリード6Aよりも薄くなっている。
これにより、バスバーリード7のコーナー部に集中する
応力が低減されるので、パッケージクラックの発生率を
低減することができる。
6Aよりも薄く加工するには、例えばプレスで圧潰した
り、エッチングしたりすればよい。
パッケージ1のインナーリード6Aおよびバスバーリー
ド7を示す要部平面図である。
その上面に多数のディンプル(窪み)11が設けられて
いる。これにより、上面が平坦な場合に比べてバスバー
リード7とパッケージ本体2を構成する樹脂との接着力
が向上するので、パッケージクラックの発生率を低減す
ることができる。
パッケージ1のインナーリード6Aおよびバスバーリー
ド7を示す要部平面図である。
絶縁フィルム4の上面に平行な面内でジクザグ状に折り
曲げられている。これにより、絶縁テープ4の収縮応力
に起因するバスバーリード7の撓みが抑制されるので、
そのコーナー部への応力集中が緩和され、パッケージク
ラックの発生率を低減することができる。
施例に基づき具体的に説明したが、本発明は前記実施例
に限定されるものではなく、その要旨を逸脱しない範囲
で種々変更可能であることはいうまでもない。
合について説明したが、これに限定されるものではな
く、少なくともバスバーリードを有するLOC構造の樹
脂封止形LSIパッケージ全般に適用することができ
る。
表的なものによって得られる効果を簡単に説明すれば、
以下の通りである。
LOC構造の樹脂封止形LSIパッケージのクラック発
生率を低減することができるので、樹脂封止形LSIパ
ッケージの信頼性、寿命が向上する。
要部平面図である。
る。
の要部平面図である。
の要部平面図である。
の断面図である。
の要部平面図である。
の要部平面図である。
Claims (6)
- 【請求項1】 半導体チップの主面上に絶縁テープを介
してバスバーリードおよび複数のインナーリードを配置
し、前記バスバーリードおよび複数のインナーリードと
前記半導体チップのボンディングパッドとをボンディン
グワイヤにより結線し、前記複数のインナーリード、バ
スバーリード、ボンディングワイヤおよび半導体チップ
を樹脂で封止するリード・オン・チップ構造を有する半
導体集積回路装置であって、前記バスバーリードの前記
インナーリードの延在方向と交差する部分に選択的にメ
ッキを施し、このメッキ部をボンディングエリアとした
ことを特徴とする半導体集積回路装置。 - 【請求項2】 半導体チップの主面上に絶縁テープを介
してバスバーリードおよび複数のインナーリードを配置
し、前記バスバーリードおよび複数のインナーリードと
前記半導体チップのボンディングパッドとをボンディン
グワイヤにより結線し、前記複数のインナーリード、バ
スバーリード、ボンディングワイヤおよび半導体チッブ
を樹脂で封止するリード・オン・チップ構造を有する半
導体集積回路装置であって、前記バスバーリードの上面
に凹凸を設けたことを特徴とする半導体集積回路装置。 - 【請求項3】 半導体チップの主面上に絶縁テープを介
してバスバーリードおよび複数のインナーリードを配置
し、前記バスバーリードおよび複数のインナーリードと
前記半導体チップのボンディングパッドとをボンディン
グワイヤにより結線し、前記複数のインナーリード、バ
スバーリード、ボンディングワイヤおよび半導体チッブ
を樹脂で封止するリード・オン・チップ構造を有する半
導体集積回路装置であって、前記バスバーリードの側面
に凹凸を設けたことを特徴とする半導体集積回路装置。 - 【請求項4】 半導体チップの主面上に絶縁テープを介
してバスバーリードおよび複数のインナーリードを配置
し、前記バスバーリードおよび複数のインナーリードと
前記半導体チップのボンディングパッドとをボンディン
グワイヤにより結線し、前記複数のインナーリード、バ
スバーリード、ボンディングワイヤおよび半導体チッブ
を樹脂で封止するリード・オン・チップ構造を有する半
導体集積回路装置であって、前記バスバーリードを前記
絶縁テープの上面に平行な面内でジグザグ状に折り曲げ
たことを特徴とする半導体集積回路装置。 - 【請求項5】 半導体チップの主面上に絶縁テープを介
してバスバーリードおよび複数のインナーリードを配置
し、前記バスバーリードおよび複数のインナーリードと
前記半導体チップのボンディングパッドとをボンディン
グワイヤにより結線し、前記複数のインナーリード、バ
スバーリード、ボンディングワイヤおよび半導体チッブ
を樹脂で封止するリード・オン・チップ構造を有する半
導体集積回路装置であって、前記インナーリードおよび
前記バスバーリードの下面に配置された前記絶縁テープ
の面積を前記インナーリードおよび前記バスバーリード
の面積と略等しくしたことを特徴とする半導体集積回路
装置。 - 【請求項6】 半導体チップの主面上に絶縁テープを介
してバスバーリードおよび複数のインナーリードを配置
し、前記バスバーリードおよび複数のインナーリードと
前記半導体チップのボンディングパッドとをボンディン
グワイヤにより結線し、前記複数のインナーリード、バ
スバーリード、ボンディングワイヤおよび半導体チッブ
を樹脂で封止するリード・オン・チップ構造を有する半
導体集積回路装置であって、前記絶縁テープが熱膨張率
1.4×10-5/℃以下の絶縁材料からなることを特徴と
する半導体集積回路装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3052416A JP2971594B2 (ja) | 1991-03-18 | 1991-03-18 | 半導体集積回路装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3052416A JP2971594B2 (ja) | 1991-03-18 | 1991-03-18 | 半導体集積回路装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH04287356A JPH04287356A (ja) | 1992-10-12 |
JP2971594B2 true JP2971594B2 (ja) | 1999-11-08 |
Family
ID=12914190
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3052416A Expired - Lifetime JP2971594B2 (ja) | 1991-03-18 | 1991-03-18 | 半導体集積回路装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2971594B2 (ja) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3109707B2 (ja) * | 1993-03-29 | 2000-11-20 | 日立化成工業株式会社 | 耐熱性接着剤及びそれを含む半導体パッケージ |
JP3169072B2 (ja) | 1998-05-15 | 2001-05-21 | 日本電気株式会社 | 半導体装置 |
-
1991
- 1991-03-18 JP JP3052416A patent/JP2971594B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH04287356A (ja) | 1992-10-12 |
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