JP2756053B2 - 交流駆動型プラズマディスプレイパネル駆動方法 - Google Patents
交流駆動型プラズマディスプレイパネル駆動方法Info
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- JP2756053B2 JP2756053B2 JP11738792A JP11738792A JP2756053B2 JP 2756053 B2 JP2756053 B2 JP 2756053B2 JP 11738792 A JP11738792 A JP 11738792A JP 11738792 A JP11738792 A JP 11738792A JP 2756053 B2 JP2756053 B2 JP 2756053B2
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- 238000000034 method Methods 0.000 title claims description 15
- FFBHFFJDDLITSX-UHFFFAOYSA-N benzyl N-[2-hydroxy-4-(3-oxomorpholin-4-yl)phenyl]carbamate Chemical compound OC1=C(NC(=O)OCC2=CC=CC=C2)C=CC(=C1)N1CCOCC1=O FFBHFFJDDLITSX-UHFFFAOYSA-N 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 7
- 239000011521 glass Substances 0.000 description 4
- 239000000758 substrate Substances 0.000 description 4
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 2
- 230000001681 protective effect Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of Gas Discharge Display Tubes (AREA)
Description
【０００１】
【産業上の利用分野】本発明は、交流駆動型プラズマデ
ィスプレイパネル駆動方法に関する。
ィスプレイパネル駆動方法に関する。
【０００２】
【従来の技術】図３は、交流駆動型プラズマディスプレ
イ装置の全体構成を示す。
イ装置の全体構成を示す。
【０００３】交流駆動型プラズマディスプレイパネル１
０は、その一方の面に、互いに平行な走査電極Ｙ１〜Ｙ
ｎ及び共通電極Ｘが設けられ、対向面にこれら電極と直
角な方向にアドレス電極Ａ１〜Ａｎが設けられている。
共通電極Ｘは、各走査電極Ｙ１〜Ｙｎに対応してこれに
接近して設けられ、一端が互いに共通に接続されてい
る。
０は、その一方の面に、互いに平行な走査電極Ｙ１〜Ｙ
ｎ及び共通電極Ｘが設けられ、対向面にこれら電極と直
角な方向にアドレス電極Ａ１〜Ａｎが設けられている。
共通電極Ｘは、各走査電極Ｙ１〜Ｙｎに対応してこれに
接近して設けられ、一端が互いに共通に接続されてい
る。
【０００４】図４は、１画素である、第ｉ行第ｊ列のセ
ルＣｉｊの断面構成を示す。共通電極Ｘ及び走査電極Ｙ
ｉはガラス基板１１上に形成され、その上に、放電空間
１７に対し絶縁するための誘電体層１２が被着され、さ
らにその上にＭｇＯ保護膜１３が被着されている。一
方、アドレス電極Ａｉは、ガラス基板１１と対向配置さ
れたガラス基板１４上に形成され、その上に蛍光体１５
が被着されている。また、ガラス基板１４及びアドレス
電極Ａｉ上には、画素境界に、セル間混色防止用及び放
電ギャップ維持用のセパレータ１６が形成されている。
ＭｇＯ保護膜１３と蛍光体１５との間の放電空間１７に
は、Ｎｅ＋Ｘｅペニングガスが封入されている。
ルＣｉｊの断面構成を示す。共通電極Ｘ及び走査電極Ｙ
ｉはガラス基板１１上に形成され、その上に、放電空間
１７に対し絶縁するための誘電体層１２が被着され、さ
らにその上にＭｇＯ保護膜１３が被着されている。一
方、アドレス電極Ａｉは、ガラス基板１１と対向配置さ
れたガラス基板１４上に形成され、その上に蛍光体１５
が被着されている。また、ガラス基板１４及びアドレス
電極Ａｉ上には、画素境界に、セル間混色防止用及び放
電ギャップ維持用のセパレータ１６が形成されている。
ＭｇＯ保護膜１３と蛍光体１５との間の放電空間１７に
は、Ｎｅ＋Ｘｅペニングガスが封入されている。
【０００５】図３において、共通電極ＸはＸドライバ２
０の出力端に接続され、走査電極Ｙ１〜ＹｎはＹドライ
バ３０の出力端に接続され、アドレス電極Ａ１〜Ａｍは
アドレスドライバ４０の出力端に接続されている。これ
らＸドライバ２０、Ｙドライバ３０及びアドレスドライ
バ４０は制御回路５０からの制御信号により制御され、
制御回路５０は、外部からの表示データＤ、表示データ
Ｄの読込みタイミングを示すクロックＣＬＫ、水平同期
信号ＨＳ及び垂直同期信号ＶＳに基づいてこの制御信号
を生成する。
０の出力端に接続され、走査電極Ｙ１〜ＹｎはＹドライ
バ３０の出力端に接続され、アドレス電極Ａ１〜Ａｍは
アドレスドライバ４０の出力端に接続されている。これ
らＸドライバ２０、Ｙドライバ３０及びアドレスドライ
バ４０は制御回路５０からの制御信号により制御され、
制御回路５０は、外部からの表示データＤ、表示データ
Ｄの読込みタイミングを示すクロックＣＬＫ、水平同期
信号ＨＳ及び垂直同期信号ＶＳに基づいてこの制御信号
を生成する。
【０００６】図５は、交流駆動型プラズマディスプレイ
パネルの駆動方法の一例を示す電圧波形図であり、１サ
ブフィールド分を示している。この１サブフィールド
は、全面書込み期間と、全面消去期間と、アドレス期間
と、維持放電期間とに区分される。
パネルの駆動方法の一例を示す電圧波形図であり、１サ
ブフィールド分を示している。この１サブフィールド
は、全面書込み期間と、全面消去期間と、アドレス期間
と、維持放電期間とに区分される。
【０００７】２N 階調表示を行う場合、１フレームをＮ
個のサブフィールドで構成し、各サブフィールドを前記
４つの期間で構成し、第１〜Ｎサブフィールドでの維持
放電期間の比を２0 ：２1 ：・・・：２N-2：２N-1とす
る（特願平２−３３１５８９号）。図６は、Ｎ＝８の場
合の１フレームの各サブフィールドの構成を示す。
個のサブフィールドで構成し、各サブフィールドを前記
４つの期間で構成し、第１〜Ｎサブフィールドでの維持
放電期間の比を２0 ：２1 ：・・・：２N-2：２N-1とす
る（特願平２−３３１５８９号）。図６は、Ｎ＝８の場
合の１フレームの各サブフィールドの構成を示す。
【０００８】
【発明が解決しようとする課題】しかし、１フレーム内
の各サブフィールドで全面書込み及び全面消去を行うの
で、全面消去状態の表示を行う場合でも各サブフィール
ドにおいて本駆動波形では４回放電発光し、例えばＮ＝
８の場合には１フレームで３２回も放電発光する為、全
面消去、すなわち全面黒の表示のときでも、灰色にな
り、高品位表示を阻害する原因となっていた。
の各サブフィールドで全面書込み及び全面消去を行うの
で、全面消去状態の表示を行う場合でも各サブフィール
ドにおいて本駆動波形では４回放電発光し、例えばＮ＝
８の場合には１フレームで３２回も放電発光する為、全
面消去、すなわち全面黒の表示のときでも、灰色にな
り、高品位表示を阻害する原因となっていた。
【０００９】本発明の目的は、このような問題点に鑑
み、表示品質を向上させることができる交流駆動型プラ
ズマディスプレイパネル駆動方法を提供することにあ
る。
み、表示品質を向上させることができる交流駆動型プラ
ズマディスプレイパネル駆動方法を提供することにあ
る。
【００１０】
【課題を解決するための手段及びその作用】請求項１の
発明では、１フレームを複数のサブフィールドにて構成
し、各々のサブフィールドが、点灯させようとする画素
に壁電荷を生成させるアドレス期間と、該アドレス期間
で選択的に書込みした画素を放電発光させる維持放電期
間とを備えたプラズマディスプレイパネルを駆動する交
流駆動型プラズマディスプレイパネル駆動方法におい
て、該１フレームが、 該アドレス期間の前に、全画素に
て壁電荷を生成させる書き込み放電と画素内に蓄積され
た壁電荷を消去させる消去放電とを共に実施するサブフ
ィールドと、 該アドレス期間の前に、該全画素にて壁電
荷を生成させる書込み放電を実施することなく、画素内
に蓄積された壁電荷を消去させる消去放電を実施するサ
ブフィールドとを含むことを特徴とする。 本発明では、
１フレーム内の１つのサブフィールドにおいてのみ全面
書込みを行っているので、全面消去の表示を行う場合、
例えばＮ＝８では１フレームで４＋３×７＝２５回放電
発光し、全面消去時の放電発光回数が従来の３２回より
も少なくなって、表示品質が向上する。
発明では、１フレームを複数のサブフィールドにて構成
し、各々のサブフィールドが、点灯させようとする画素
に壁電荷を生成させるアドレス期間と、該アドレス期間
で選択的に書込みした画素を放電発光させる維持放電期
間とを備えたプラズマディスプレイパネルを駆動する交
流駆動型プラズマディスプレイパネル駆動方法におい
て、該１フレームが、 該アドレス期間の前に、全画素に
て壁電荷を生成させる書き込み放電と画素内に蓄積され
た壁電荷を消去させる消去放電とを共に実施するサブフ
ィールドと、 該アドレス期間の前に、該全画素にて壁電
荷を生成させる書込み放電を実施することなく、画素内
に蓄積された壁電荷を消去させる消去放電を実施するサ
ブフィールドとを含むことを特徴とする。 本発明では、
１フレーム内の１つのサブフィールドにおいてのみ全面
書込みを行っているので、全面消去の表示を行う場合、
例えばＮ＝８では１フレームで４＋３×７＝２５回放電
発光し、全面消去時の放電発光回数が従来の３２回より
も少なくなって、表示品質が向上する。
【００１１】請求項２の発明では、請求項１において、
前記消去放電は、放電の進行段階でパルスを中断させる
細幅消去であることを特徴とする。
前記消去放電は、放電の進行段階でパルスを中断させる
細幅消去であることを特徴とする。
【００１２】請求項３の発明では、請求項１において、
前記消去放電は、維持電圧より低い電圧で微小な放電を
生じさせる大幅消去であることを特徴とする。
前記消去放電は、維持電圧より低い電圧で微小な放電を
生じさせる大幅消去であることを特徴とする。
【００１３】請求項４の発明では、請求項１乃至３のい
ずれか１つにおいて、前記全画素にて壁電荷を生成させ
る書き込み放電を実施するサブフィールドは、前記１フ
レームの最初のサブフィールドであり、他のサブフィー
ルドは、前記書込み放電を実施することなく消去放電を
実施するサブフィールドであることを特徴とする。
ずれか１つにおいて、前記全画素にて壁電荷を生成させ
る書き込み放電を実施するサブフィールドは、前記１フ
レームの最初のサブフィールドであり、他のサブフィー
ルドは、前記書込み放電を実施することなく消去放電を
実施するサブフィールドであることを特徴とする。
【００１４】
【００１５】
【００１６】
【実施例】以下、図面に基づいて本発明の一実施例を説
明する。
明する。
【００１７】例えば２５６階調表示を行う場合、図６に
対応して図１に示す如く、１フレームを第１〜８サブフ
ィールドで構成する。第１サブフィールドは、全面書込
み期間と、全面消去期間と、アドレス期間と、維持放電
期間とからなる。第２〜８サブフィールドはいずれも、
第１サブフィールドの全面書込み期間を除いたもの、す
なわち、全面消去期間と、アドレス期間と、維持放電期
間とからなる。
対応して図１に示す如く、１フレームを第１〜８サブフ
ィールドで構成する。第１サブフィールドは、全面書込
み期間と、全面消去期間と、アドレス期間と、維持放電
期間とからなる。第２〜８サブフィールドはいずれも、
第１サブフィールドの全面書込み期間を除いたもの、す
なわち、全面消去期間と、アドレス期間と、維持放電期
間とからなる。
【００１８】第１〜８サブフィールドの各維持放電期間
ｔ１〜ｔ８の比は図６と同様に、 ｔ１：ｔ２：ｔ３：・・・：ｔ７：ｔ８ ＝１：２：４：８：１６：３２：６４：１２８ となっている。
ｔ１〜ｔ８の比は図６と同様に、 ｔ１：ｔ２：ｔ３：・・・：ｔ７：ｔ８ ＝１：２：４：８：１６：３２：６４：１２８ となっている。
【００１９】１フレーム時間は図６の場合と等しく、１
／６０秒である。したがって、本実施例では図６の場合
よりも（全面書込み期間）×７の時間だけ他の期間で使
用でき、パルス幅を図６の場合よりも広くすることがで
きる。
／６０秒である。したがって、本実施例では図６の場合
よりも（全面書込み期間）×７の時間だけ他の期間で使
用でき、パルス幅を図６の場合よりも広くすることがで
きる。
【００２０】図２は、第１及び第２のサブフィールドに
おいて、アドレス電極Ａ１〜Ａ４８０、共通電極Ｘ及び
走査電極Ｙ１〜Ｙ４８０に印加される電圧の波形を示
す。第１サブフィールドの電圧波形は図５と同一であ
り、以下にこれを説明する。なお、図中のサブフィール
ド区分信号は、図３の制御回路５０で生成される。
おいて、アドレス電極Ａ１〜Ａ４８０、共通電極Ｘ及び
走査電極Ｙ１〜Ｙ４８０に印加される電圧の波形を示
す。第１サブフィールドの電圧波形は図５と同一であ
り、以下にこれを説明する。なお、図中のサブフィール
ド区分信号は、図３の制御回路５０で生成される。
【００２１】（１）全面書込み期間 最初の全面書込み期間では、走査電極Ｙ１〜Ｙｎがグラ
ンドレベルＧＮＤにされ、この状態で共通電極Ｘが、放
電開始電圧Ｖf よりも高い書込み電圧ＶWにされて（全
面書き込みパルス）、共通電極Ｘと走査電極Ｙ１〜Ｙｎ
との間で、すなわち全セルで、書込み放電が行われる。
放電が進むにつれ、共通電極Ｘ電極上の誘電体層１２に
は負の壁電荷が蓄積され、走査電極Ｙ１〜Ｙｎ上の誘電
体層１２には正の壁電荷が蓄積される。この壁電荷は放
電空間の電圧を低減させるため、１μｓ程度で放電が終
結する。
ンドレベルＧＮＤにされ、この状態で共通電極Ｘが、放
電開始電圧Ｖf よりも高い書込み電圧ＶWにされて（全
面書き込みパルス）、共通電極Ｘと走査電極Ｙ１〜Ｙｎ
との間で、すなわち全セルで、書込み放電が行われる。
放電が進むにつれ、共通電極Ｘ電極上の誘電体層１２に
は負の壁電荷が蓄積され、走査電極Ｙ１〜Ｙｎ上の誘電
体層１２には正の壁電荷が蓄積される。この壁電荷は放
電空間の電圧を低減させるため、１μｓ程度で放電が終
結する。
【００２２】次に、走査電極Ｙ１〜Ｙｎが、放電開始電
圧Ｖf よりも低い維持電圧ＶSにされ、共通電極Ｘがグ
ランドレベルＧＮＤにされ（維持パルス）、これに前記
壁電荷による電圧が加算されて、共通電極Ｘと走査電極
Ｙ１〜Ｙｎとの間で維持放電が行われる。これにより、
共通電極Ｘ電極上の誘電体層１２には正の壁電荷が蓄積
され、走査電極Ｙ１〜Ｙｎ上の誘電体層１２には負の壁
電荷が蓄積されて、放電が終了する。この維持パルスに
より、壁電荷が安定化される。
圧Ｖf よりも低い維持電圧ＶSにされ、共通電極Ｘがグ
ランドレベルＧＮＤにされ（維持パルス）、これに前記
壁電荷による電圧が加算されて、共通電極Ｘと走査電極
Ｙ１〜Ｙｎとの間で維持放電が行われる。これにより、
共通電極Ｘ電極上の誘電体層１２には正の壁電荷が蓄積
され、走査電極Ｙ１〜Ｙｎ上の誘電体層１２には負の壁
電荷が蓄積されて、放電が終了する。この維持パルスに
より、壁電荷が安定化される。
【００２３】（２）全面消去期間 次に、共通電極Ｘが維持電圧ＶSにされ、走査電極Ｙ１
〜ＹｎがグランドレベルＧＮＤにされて（全面消去パル
ス）、消去放電が生じ、壁電荷が中和されて消去され
る。この消去方法には、放電の進行段階でパルスを中断
させる細幅消去方法と、維持電圧ＶSより低い電圧で微
小な放電を生じさせる太幅消去方法とがある。
〜ＹｎがグランドレベルＧＮＤにされて（全面消去パル
ス）、消去放電が生じ、壁電荷が中和されて消去され
る。この消去方法には、放電の進行段階でパルスを中断
させる細幅消去方法と、維持電圧ＶSより低い電圧で微
小な放電を生じさせる太幅消去方法とがある。
【００２４】（３）アドレス期間 次に、表示データの書込みが線順次に行われる。すなわ
ち、まず走査電極Ｙ１がグランドレベルＧＮＤにされて
選択され、第１表示行の点灯しようとするセルに対応し
たアドレス電極に電圧Ｖａが印加されて（書込みパル
ス）、両電極間で書込み放電が行われ、壁電荷が生成さ
れる。以下、第２〜ｎ表示行についてこの順に、上記同
様の動作が行われる。
ち、まず走査電極Ｙ１がグランドレベルＧＮＤにされて
選択され、第１表示行の点灯しようとするセルに対応し
たアドレス電極に電圧Ｖａが印加されて（書込みパル
ス）、両電極間で書込み放電が行われ、壁電荷が生成さ
れる。以下、第２〜ｎ表示行についてこの順に、上記同
様の動作が行われる。
【００２５】（４）維持放電期間 次に、走査電極Ｙ１〜Ｙｎが共に維持電圧ＶSの状態で
共通電極ＸがグランドレベルＧＮＤにされ（維持パル
ス）、アドレス期間で書込み放電を行なったセルにおい
て壁電荷が加算され、維持放電が行われる。次に、共通
電極Ｘを維持電圧ＶSに戻した状態で走査電極Ｙ１〜Ｙ
ｎが共にグランドレベルＧＮＤにされ（維持パルス）、
アドレス期間で書込み放電を行なったセルにおいて壁電
荷が加算され、維持放電が行われる。以下、このような
動作が交互に繰り返される。すなわち、共通電極Ｘと走
査電極Ｙ１〜Ｙｎとの間に交流維持パルスが供給され
て、画像が表示される。
共通電極ＸがグランドレベルＧＮＤにされ（維持パル
ス）、アドレス期間で書込み放電を行なったセルにおい
て壁電荷が加算され、維持放電が行われる。次に、共通
電極Ｘを維持電圧ＶSに戻した状態で走査電極Ｙ１〜Ｙ
ｎが共にグランドレベルＧＮＤにされ（維持パルス）、
アドレス期間で書込み放電を行なったセルにおいて壁電
荷が加算され、維持放電が行われる。以下、このような
動作が交互に繰り返される。すなわち、共通電極Ｘと走
査電極Ｙ１〜Ｙｎとの間に交流維持パルスが供給され
て、画像が表示される。
【００２６】第２サブフィールドは、第１サブフィール
ドでの全面書込み期間を省略し、維持放電期間を第１サ
ブフィールドのそれの２倍にしている。他は第１サブフ
ィールドと同一である。
ドでの全面書込み期間を省略し、維持放電期間を第１サ
ブフィールドのそれの２倍にしている。他は第１サブフ
ィールドと同一である。
【００２７】第２サブフィールドの全面消去期間におい
ては、直前の維持放電で生成された壁電荷が、全面消去
放電により消失する。第３サブフィールド以下の全面消
去期間についても第２サブフィールドと同様である。
ては、直前の維持放電で生成された壁電荷が、全面消去
放電により消失する。第３サブフィールド以下の全面消
去期間についても第２サブフィールドと同様である。
【００２８】本実施例では、１フレーム内の最初のサブ
フィールドにおいてのみ全面書込みを行っているので、
全面消去の表示を行う場合、１フレームで４＋３×７＝
２５回放電発光し、放電発光回数が従来の３２回よりも
少なくなって、表示品質が向上する。なお、上記実施例
において、共通電極は、複数組に分割されていてもよ
い。
フィールドにおいてのみ全面書込みを行っているので、
全面消去の表示を行う場合、１フレームで４＋３×７＝
２５回放電発光し、放電発光回数が従来の３２回よりも
少なくなって、表示品質が向上する。なお、上記実施例
において、共通電極は、複数組に分割されていてもよ
い。
【００２９】
【発明の効果】以上説明した如く、本発明に係る交流駆
動型プラズマディスプレイパネル駆動方法では、１フレ
ーム内の１個のサブフィールドにおいてのみ全面書込み
を行っているので、全面消去の表示を行う場合に放電発
光回数が従来よりも少なくなって、表示品質が向上する
という効果を奏する。
動型プラズマディスプレイパネル駆動方法では、１フレ
ーム内の１個のサブフィールドにおいてのみ全面書込み
を行っているので、全面消去の表示を行う場合に放電発
光回数が従来よりも少なくなって、表示品質が向上する
という効果を奏する。
【図１】本発明の１実施例に係り、２５６諧調表示する
場合の１フレームの各サブフィールド構成図である。
場合の１フレームの各サブフィールド構成図である。
【図２】第１及び第２のサブフィールドでの各電極に印
加される電圧波形図である。
加される電圧波形図である。
【図３】交流駆動型プラズマディスプレイ装置の概略構
成図である。
成図である。
【図４】図３のセルの断面構成図である。
【図５】従来例に係り、１サブフィールドでの各電極に
印加される電圧波形図である。
印加される電圧波形図である。
【図６】従来例に係り、２５６諧調表示する場合の１フ
レームの各サブフィールド構成図である。
レームの各サブフィールド構成図である。
【符号の説明】 Ａ１〜Ａｍ アドレス電極 Ｘ 共通電極 Ｙ１〜Ｙｎ 走査電極
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平５−241528（ＪＰ，Ａ) (58)調査した分野(Int.Cl.6，ＤＢ名) G09G 3/28
Claims (4)
- 【請求項１】 １フレームを複数のサブフィールドにて
構成し、各々のサブフィールドが、点灯させようとする
画素に壁電荷を生成させるアドレス期間と、該アドレス
期間で選択的に書込みした画素を放電発光させる維持放
電期間とを備えたプラズマディスプレイパネルを駆動す
る交流駆動型プラズマディスプレイパネル駆動方法にお
いて、該１フレームが、 該アドレス期間の前に、全画素にて壁電荷を生成させる
書き込み放電と画素内に蓄積された壁電荷を消去させる
消去放電とを共に実施するサブフィールドと、 該アドレス期間の前に、該全画素にて壁電荷を生成させ
る書込み放電を実施することなく、画素内に蓄積された
壁電荷を消去させる消去放電を実施するサブフィールド
と、 を含む ことを特徴とする交流駆動型プラズマディスプレ
イパネル駆動方法。 - 【請求項２】 前記消去放電は、放電の進行段階でパル
スを中断させる細幅消去であることを特徴とする請求項
１記載の交流駆動型プラズマディスプレイパネル駆動方
法。 - 【請求項３】 前記消去放電は、維持電圧より低い電圧
で微小な放電を生じさせる大幅消去であることを特徴と
する請求項１記載の交流駆動型プラズマディスプレイパ
ネル駆動方法。 - 【請求項４】 前記全画素にて壁電荷を生成させる書き
込み放電を実施するサブフィールドは、前記１フレーム
の最初のサブフィールドであり、他のサブフィールド
は、前記書込み放電を実施することなく消去放電を実施
するサブフィールドであることを特徴とする請求項１乃
至３のいずれか１つに記載の交流駆動型プラズマディス
プレイパネル駆動方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11738792A JP2756053B2 (ja) | 1992-05-11 | 1992-05-11 | 交流駆動型プラズマディスプレイパネル駆動方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11738792A JP2756053B2 (ja) | 1992-05-11 | 1992-05-11 | 交流駆動型プラズマディスプレイパネル駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05313598A JPH05313598A (ja) | 1993-11-26 |
| JP2756053B2 true JP2756053B2 (ja) | 1998-05-25 |
Family
ID=14710393
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11738792A Expired - Fee Related JP2756053B2 (ja) | 1992-05-11 | 1992-05-11 | 交流駆動型プラズマディスプレイパネル駆動方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2756053B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7733305B2 (en) | 2004-05-17 | 2010-06-08 | Panasonic Corporation | Plasma display device and method for driving a plasma display panel |
Families Citing this family (20)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3231569B2 (ja) * | 1995-02-13 | 2001-11-26 | 日本電気株式会社 | プラズマディスプレイパネルの駆動方法および駆動装置 |
| JP3704813B2 (ja) * | 1996-06-18 | 2005-10-12 | 三菱電機株式会社 | プラズマディスプレイパネルの駆動方法及びプラズマディスプレイ |
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