JP2007206712A - アクティブマトリクス方式液晶表示装置 - Google Patents
アクティブマトリクス方式液晶表示装置 Download PDFInfo
- Publication number
- JP2007206712A JP2007206712A JP2007059644A JP2007059644A JP2007206712A JP 2007206712 A JP2007206712 A JP 2007206712A JP 2007059644 A JP2007059644 A JP 2007059644A JP 2007059644 A JP2007059644 A JP 2007059644A JP 2007206712 A JP2007206712 A JP 2007206712A
- Authority
- JP
- Japan
- Prior art keywords
- layer
- semiconductor layer
- insulating layer
- semiconductor
- liquid crystal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D30/00—Field-effect transistors [FET]
- H10D30/01—Manufacture or treatment
- H10D30/021—Manufacture or treatment of FETs having insulated gates [IGFET]
- H10D30/031—Manufacture or treatment of FETs having insulated gates [IGFET] of thin-film transistors [TFT]
- H10D30/0312—Manufacture or treatment of FETs having insulated gates [IGFET] of thin-film transistors [TFT] characterised by the gate electrodes
- H10D30/0316—Manufacture or treatment of FETs having insulated gates [IGFET] of thin-film transistors [TFT] characterised by the gate electrodes of lateral bottom-gate TFTs comprising only a single gate
-
- G—PHYSICS
- G02—OPTICS
- G02F—OPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
- G02F1/00—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
- G02F1/01—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour
- G02F1/13—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour based on liquid crystals, e.g. single liquid crystal display cells
- G02F1/133—Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
- G02F1/136—Liquid crystal cells structurally associated with a semi-conducting layer or substrate, e.g. cells forming part of an integrated circuit
- G02F1/1362—Active matrix addressed cells
- G02F1/1368—Active matrix addressed cells in which the switching element is a three-electrode device
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D30/00—Field-effect transistors [FET]
- H10D30/01—Manufacture or treatment
- H10D30/021—Manufacture or treatment of FETs having insulated gates [IGFET]
- H10D30/031—Manufacture or treatment of FETs having insulated gates [IGFET] of thin-film transistors [TFT]
- H10D30/0321—Manufacture or treatment of FETs having insulated gates [IGFET] of thin-film transistors [TFT] comprising silicon, e.g. amorphous silicon or polysilicon
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D30/00—Field-effect transistors [FET]
- H10D30/60—Insulated-gate field-effect transistors [IGFET]
- H10D30/67—Thin-film transistors [TFT]
- H10D30/6729—Thin-film transistors [TFT] characterised by the electrodes
- H10D30/673—Thin-film transistors [TFT] characterised by the electrodes characterised by the shapes, relative sizes or dispositions of the gate electrodes
- H10D30/6732—Bottom-gate only TFTs
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D30/00—Field-effect transistors [FET]
- H10D30/60—Insulated-gate field-effect transistors [IGFET]
- H10D30/67—Thin-film transistors [TFT]
- H10D30/674—Thin-film transistors [TFT] characterised by the active materials
- H10D30/6741—Group IV materials, e.g. germanium or silicon carbide
- H10D30/6743—Silicon
- H10D30/6746—Amorphous silicon
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Engineering & Computer Science (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Mathematical Physics (AREA)
- Chemical & Material Sciences (AREA)
- Crystallography & Structural Chemistry (AREA)
- General Physics & Mathematics (AREA)
- Optics & Photonics (AREA)
- Liquid Crystal (AREA)
- Thin Film Transistor (AREA)
Abstract
【解決手段】特に、ソース、ドレイン電極143a,143b、不純物がドープされた半導体層139、及び不純物がドープされない半導体層137を同時にパターニングする。又、ソース、ドレイン電極143a,143bを形成するために、保護絶縁層145をマスクとして用いて、前記ソース、ドレイン電極及び不純物ドープ半導体層を単一の工程(a single step)でエッチングする。従って、コストが低減し、歩留まりが向上する。
【選択図】 図16
Description
図1のようにTFTアレイを具備した一般の液晶表示装置は、透明ガラス基板上に大略長方形の画素電極47が行、列で近接して配列されている。ゲートバス配線(アトレスライン)13は画素電極47の各行配列に沿って近接して形成されており、ソースバス配線(データライン)14は画素電極47の各列配列に沿って近接して形成されている。
基板の全面にSiNxから成る第1絶縁層(ゲート絶縁層)35と、a−Siから成る半導体層37及びSiNxから成る第2絶縁層とを順次被着する。
図4に示すように、前記第2絶縁層のパターニングを行ってエッチストッパ40を形成し、n+型a−Siから成る不純物がドープされた半導体39層を基板の全面に被着した後、該不純物半導体層39と半導体層37とを同時にパターニングする(図5)。
まず、透明ガラス基板131の一面にAl、又は、Al系合金のAl−Pd、Al−Si、Al−Si−Ti、Al−Si−Cu等から成る第1金属層をスパッタリング法で被着する。写真食刻法で第1金属層を選択的にエッチングしてゲート電極133を形成する(図8)。
もし必要であれば、耐化学性、耐熱性、特に、続いて形成するゲート絶縁層との接着性等の向上のため、ゲート電極133を陽極酸化させ、陽極酸化層を形成するようにしてもよい。該陽極酸化層は続いて形成されるゲート絶縁層の窒化シリコンと共に絶縁層として機能してゲート電極133と近接の信号線間の電気的絶縁性を向上させる役割を果たす。
そして、エッチストッパ140上の開口と、第2金属層143の一部分が露出するコンタクトホールを形成するように保護絶縁層145をパターニングする(図14)。
そして、図16に示されるように、保護絶縁層145をマスクとして用いて、露出された第2金属層の部分143とN+半導体層139とをエッチングして、ソース電極143aとドレイン電極143bを形成する。
前記第2金属層143とN+半導体層139のエッチングの前に、保護絶縁層145にコンタクトホールを形成して、その後に前記画素電極147を形成する理由は、前記画素電極147は、コンタクトホールを介して露出された第2金属層143をエッチングされることを防ぐ役割をするためである。従って、製造工程の順序が重要である。それで、第2金属層143及びN+半導体層139は単一の工程でエッチングされる。これに対して、前記の従来の工程によると、エッチングストッパ140上に形成される各層は各々別々の工程でエッチングされる。
14 ソース配線
31、131 透明ガラス基板
33、133 ゲート電極
35、135 第1絶縁層
37、137 半導体層
39、139 不純物半導体層
40、140 エッチストッパ
43、143 第2金属層
43a、143a ソース電極
43b、143b ドレイン電極
45、145 保護絶縁層
47、147 画素電極
Claims (7)
- 基板と、
前記基板上にエッジ部を有する第1半導体層と、
前記第1半導体層上に、前記第1半導体層のエッジ部と大略一致するエッジ部を有する不純物を含む第2半導体層と、
前記第2半導体層上に、前記第2半導体層のエッジ部と大略一致するエッジ部を有する金属層と、
前記第1半導体層と前記第2半導体層と前記金属層とを被覆する保護絶縁層と、
前記保護絶縁層に形成された第1開口と第2開口と、
前記保護絶縁層上に、前記第1開口を通じて前記金属層と接触するように形成された透明導電層と、
前記保護絶縁層を貫通する前記第2開口を通じて前記金属層と前記第2半導体層をエッチングすることで形成した半導体装置のソースおよびドレイン領域と、
から構成されることを特徴とする半導体装置。 - 前記第1半導体層は実質的に不純物がドープされていない半導体層であることを特徴とする、請求項1記載の半導体装置。
- 前記基板上に形成されたゲート電極と、
前記ゲート電極上に形成されたゲート絶縁層と、が形成されたことを特徴とする、請求項1記載の半導体装置。 - エッチストッパが前記第1半導体層と第2半導体層との間に、形成されていることを特徴とする、請求項1記載の半導体装置。
- 前記絶縁保護層の前記第1開口は前記エッチストッパと実質的に位置合わせされたことを特徴とする、請求項4記載の半導体装置。
- 前記透明導電層は透明電極であり、前記絶縁保護層の前記第2開口を通じて前記金属層と電気的に接触することを特徴とする、請求項1記載の半導体装置。
- 前記透明電極は透明導電物質を含むことを特徴とする、請求項6記載の半導体装置。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019960010637A KR100202236B1 (ko) | 1996-04-09 | 1996-04-09 | 액티브 매트릭스 기판의 제조방법 및 그 방법에 의해 제조되는 액티브 매트릭스 기판 |
Related Parent Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10525597A Division JP4034376B2 (ja) | 1996-04-09 | 1997-04-08 | アクティブマトリクス方式液晶表示装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2007206712A true JP2007206712A (ja) | 2007-08-16 |
JP4117369B2 JP4117369B2 (ja) | 2008-07-16 |
Family
ID=19455336
Family Applications (2)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10525597A Expired - Lifetime JP4034376B2 (ja) | 1996-04-09 | 1997-04-08 | アクティブマトリクス方式液晶表示装置の製造方法 |
JP2007059644A Expired - Lifetime JP4117369B2 (ja) | 1996-04-09 | 2007-03-09 | アクティブマトリクス方式液晶表示装置 |
Family Applications Before (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10525597A Expired - Lifetime JP4034376B2 (ja) | 1996-04-09 | 1997-04-08 | アクティブマトリクス方式液晶表示装置の製造方法 |
Country Status (5)
Country | Link |
---|---|
JP (2) | JP4034376B2 (ja) |
KR (1) | KR100202236B1 (ja) |
DE (1) | DE19714690C2 (ja) |
FR (1) | FR2747237B1 (ja) |
GB (1) | GB2312092B (ja) |
Families Citing this family (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100538293B1 (ko) * | 1998-04-03 | 2006-03-17 | 삼성전자주식회사 | 평면 구동 방식 액정 표시 장치의 제조 방법 |
TW525216B (en) | 2000-12-11 | 2003-03-21 | Semiconductor Energy Lab | Semiconductor device, and manufacturing method thereof |
SG111923A1 (en) | 2000-12-21 | 2005-06-29 | Semiconductor Energy Lab | Light emitting device and method of manufacturing the same |
KR100980015B1 (ko) * | 2003-08-19 | 2010-09-03 | 삼성전자주식회사 | 박막 트랜지스터 표시판 및 그 제조 방법 |
KR102183920B1 (ko) | 2013-12-16 | 2020-11-30 | 삼성디스플레이 주식회사 | 박막 트랜지스터 표시판 및 그 제조 방법 |
CN104022126B (zh) * | 2014-05-28 | 2017-04-12 | 京东方科技集团股份有限公司 | 一种阵列基板、其制作方法及显示装置 |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2629743B2 (ja) * | 1987-10-08 | 1997-07-16 | カシオ計算機株式会社 | 薄膜トランジスタの製造方法 |
US5173753A (en) * | 1989-08-10 | 1992-12-22 | Industrial Technology Research Institute | Inverted coplanar amorphous silicon thin film transistor which provides small contact capacitance and resistance |
US5130263A (en) * | 1990-04-17 | 1992-07-14 | General Electric Company | Method for photolithographically forming a selfaligned mask using back-side exposure and a non-specular reflecting layer |
DE69115405T2 (de) * | 1990-09-21 | 1996-06-13 | Casio Computer Co Ltd | Dünnfilmtransistor und eine Dünnfilmtransistorpanele, die solche Transistoren verwendet |
WO1992006505A1 (en) * | 1990-10-05 | 1992-04-16 | General Electric Company | Thin film transistor stucture with improved source/drain contacts |
KR920010885A (ko) * | 1990-11-30 | 1992-06-27 | 카나이 쯔또무 | 박막반도체와 그 제조방법 및 제조장치 및 화상처리장치 |
EP0545327A1 (en) * | 1991-12-02 | 1993-06-09 | Matsushita Electric Industrial Co., Ltd. | Thin-film transistor array for use in a liquid crystal display |
EP0566838A3 (en) * | 1992-02-21 | 1996-07-31 | Matsushita Electric Ind Co Ltd | Manufacturing method of thin film transistor |
US5539219A (en) * | 1995-05-19 | 1996-07-23 | Ois Optical Imaging Systems, Inc. | Thin film transistor with reduced channel length for liquid crystal displays |
-
1996
- 1996-04-09 KR KR1019960010637A patent/KR100202236B1/ko not_active Expired - Lifetime
-
1997
- 1997-03-11 FR FR9702841A patent/FR2747237B1/fr not_active Expired - Lifetime
- 1997-04-04 GB GB9706824A patent/GB2312092B/en not_active Expired - Lifetime
- 1997-04-08 JP JP10525597A patent/JP4034376B2/ja not_active Expired - Lifetime
- 1997-04-09 DE DE19714690A patent/DE19714690C2/de not_active Expired - Lifetime
-
2007
- 2007-03-09 JP JP2007059644A patent/JP4117369B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
KR100202236B1 (ko) | 1999-07-01 |
FR2747237A1 (fr) | 1997-10-10 |
KR970072497A (ko) | 1997-11-07 |
DE19714690C2 (de) | 2003-12-11 |
GB9706824D0 (en) | 1997-05-21 |
JPH1039331A (ja) | 1998-02-13 |
JP4034376B2 (ja) | 2008-01-16 |
JP4117369B2 (ja) | 2008-07-16 |
GB2312092A (en) | 1997-10-15 |
FR2747237B1 (fr) | 1999-04-16 |
GB2312092B (en) | 1998-06-03 |
DE19714690A1 (de) | 1997-10-30 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4169811B2 (ja) | 薄膜トランジスタの製造方法 | |
KR100270467B1 (ko) | 액정 디스플레이 장치의 액티브 매트릭스 기판 및 그의 제조 방법 | |
US6562645B2 (en) | Method of fabricating fringe field switching mode liquid crystal display | |
US20020093021A1 (en) | Thin-film transistor display devices | |
US6111619A (en) | Method of forming polycrystalline silicon TFTs with TiN/Cu/TiN interconnections for a liquid crystal display pixel array | |
JP4117369B2 (ja) | アクティブマトリクス方式液晶表示装置 | |
JP4646420B2 (ja) | 薄膜トランジスタアレイ基板およびそれを用いた表示装置 | |
US6043000A (en) | Method for manufacturing a semiconductor device | |
US6746959B2 (en) | Liquid crystal display and method | |
JPH1195256A (ja) | アクティブマトリクス基板 | |
US6025605A (en) | Aligned semiconductor structure | |
KR100275932B1 (ko) | 액정표시장치 및 그 제조방법 | |
JP2570255B2 (ja) | 薄膜トランジスタマトリツクスアレ−パネル及びその製造方法 | |
US7561223B2 (en) | Device and method for protecting gate terminal and lead | |
JPH10173195A (ja) | 薄膜トランジスタ及びその製造方法 | |
JPH10209452A (ja) | 薄膜トランジスタ及びその製造方法 | |
JP3458519B2 (ja) | 液晶表示装置の製造方法 | |
KR100205867B1 (ko) | 액티브매트릭스기판의 제조방법 및 그 방법에 의해제조되는액티브매트릭스기판 | |
JP2000035592A (ja) | 液晶表示装置 | |
KR100205868B1 (ko) | 이중 게이트 박막 트랜지스터 및 그 제조방법 | |
JPH01227127A (ja) | 薄膜トランジスタアレイ | |
KR20020043860A (ko) | 액정 표시 장치용 어레이 기판 및 그 제조 방법 | |
JP2001159764A (ja) | 液晶表示素子 | |
JPH063698A (ja) | 薄膜トランジスタ装置 | |
JP2000040827A (ja) | 半導体装置並びに半導体装置の製造方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20071120 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20080218 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20080311 |
|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20080326 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110502 Year of fee payment: 3 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110502 Year of fee payment: 3 |
|
S633 | Written request for registration of reclamation of name |
Free format text: JAPANESE INTERMEDIATE CODE: R313633 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110502 Year of fee payment: 3 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120502 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130502 Year of fee payment: 5 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
EXPY | Cancellation because of completion of term |