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JP2005129826A - パワー半導体装置 - Google Patents

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gate
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泰 中島
Takanobu Yoshida
貴信 吉田
Hiroaki Maeda
浩明 前田
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Abstract

【課題】 ゲート発振を防止し、かつ小型化を可能とした自己消弧型パワー半導体装置を提供する。
【解決手段】 複数のパワー半導体素子2を有する自己消弧型パワー半導体装置が、放熱板1と、放熱板1上に配置された複数のパワー半導体素子2と、複数のパワー半導体素子2のゲート電極Gが並列に接続されたリードフレーム3と、放熱板1上に、パワー半導体素子2を覆うように設けられた封止樹脂とを含む。ゲート電極Gとリードフレーム3とは、金属抵抗体5を介して接続される。
【選択図】図1

Description

本発明は、パワー半導体装置に関し、特に、自己消弧(ターンオフ)型パワー半導体装置に関する。
自己消弧型パワー半導体装置では、複数の半導体素子(例えばIGBT)を並列動作させる場合、2つのパワー半導体素子のゲート間にC成分及びL成分が形成され、ゲート発振が発生するという問題があった。これに対して、パワー半導体素子が載置される絶縁基板上にチップ状の抵抗体を載置し、抵抗体をゲート配線中に接続することにより、ゲート発振を防止していた(例えば、特許文献1)。
特開平8−191239号公報
しかしながら、かかる構造では、複数のチップ状の抵抗体が絶縁基板上にはんだ付け等で載置されるため、絶縁基板の面積が大きくなり、自己消弧型パワー半導体装置の小型化、低コスト化が困難であった。
そこで、本発明は、ゲート発振が防止できかつ小型化の可能な自己消弧型パワー半導体装置の提供を目的とする。
本発明は、複数のパワー半導体素子を有する自己消弧型パワー半導体装置であって、放熱板と、放熱板上に配置された複数のパワー半導体素子と、複数のパワー半導体素子のゲート電極が並列に接続されたリードフレームと、放熱板上に、パワー半導体素子を覆うように設けられた封止樹脂とを含み、ゲート電極とリードフレームとが、金属抵抗体を介して接続されたことを特徴とするパワー半導体装置である。
本発明にかかるパワー半導体装置では、素子サイズを大きくすることなくパワー半導体素子のゲート間で発生するゲート発振を防止できる。
実施の形態1.
図1は、全体が100で表される、本実施の形態にかかる自己消弧型パワー半導体装置の内部構造の斜視図であり、図2は、図1をI−I方向に見た場合の断面図である。
パワー半導体装置100は、例えば銅からなる放熱板1を含む。放熱板1の上には、例えばIGBTやFETのようなパワー半導体素子2が、半田等により固着されている。また、放熱板1の上には、例えば銅からなるリードフレーム3のコレクタ端子(C)が、超音波溶接により接合されている。図1に示すように、リードフレーム3は、ゲート端子(G)、エミッタ端子(E)、およびコレクタ端子(C)に分かれている。ゲート端子(G)、エミッタ端子(E)は放熱板1に接触せず、中空に浮いた構造となっている。
リードフレーム3のエミッタ端子(E)は、パワー半導体素子2の表面に設けられたエミッタ電極に、アルミニウム等のボンディングワイヤで接続されている。また、コレクタ端子(C)は、パワー半導体素子2の裏面に設けられたコレクタ電極と電気的に接続されている。
一方、ゲート端子(G)に該当するリードフレーム3の先端には金属板5が、例えば超音波溶接により固着されている。金属板5は、抵抗値が略0.1Ω〜略100Ωであり、例えば、コンスタンタン、クロメル、マンガニンから選択された金属の、矩形形状の板からなる。ゲート端子(G)は、金属板5を介して、アルミニウム等のボンディングワイヤ4で、パワー半導体素子2の表面に設けられたゲート電極に接続されている。
放熱板1の上には、パワー半導体素子2、ボンディングワイヤ4等を埋め込むように、例えばエポキシ樹脂からなるモールド樹脂6が設けられている。更に、放熱板1の裏面には、絶縁樹脂層7が設けられている。絶縁樹脂層7は、例えば酸化物や窒化物のフィラーを混入したシリコーン樹脂やエポキシ樹脂からなる。ただし、図1では、モールド樹脂6、絶縁樹脂層7を省略してある。
図3は、パワー半導体装置100の回路図である。図3からわかるように、ゲート端子(G)であるリードフレーム3は2つに分岐し、その先端で抵抗体である金属板5を介してそれぞれのパワー半導体素子2のゲート電極に接続されている。上述のように、金属板5は、略0.1Ω〜略10Ωの抵抗値を備えた抵抗体であり、ゲート抵抗として機能する。従って、金属板5を配置することにより、複数(ここでは2つ)のパワー半導体素子2を並列動作させる場合に、パワー半導体素子2のゲート間で発生するゲート発振を防止できる。
即ち、ゲート回路は、容量(C)成分及びコイル(L)成分を持つため、共振周波数に近い電流が流れたときに発振現象が生じるおそれがある。これに対して、パワー半導体装置100では、抵抗成分を有する金属板5を設けることにより、発振のエネルギを熱に変換して消費し、ゲート発振を防止する。
また、例えばリードフレームの二つの電極の間にチップ抵抗体を半田付け等で配置し、リードフレームの各電極とチップ抵抗体とをボンディングワイヤで接合する構造に比べて、リードフレームの形状が簡単になり、製造工程も簡略化できる。また、素子サイズの小型化も可能となる。
図4は、本実施の形態にかかるパワー半導体装置の一部を詳細に示した上面図であり、図4中、図1と同一符号は、同一又は相当箇所を示す。ただし、図1のパワー半導体装置100とは異なり、L字型のリードフレーム3が2つの電極板5を有し、ボンディングワイヤ4を介してそれぞれのパワー半導体素子2のゲート電極12に接続されている。
なお、各パワー半導体素子2には、合計5つの電極が設けられており、かかる5つの電極は、ゲート電極12、電流センサ用電極、電圧センサ用電極、温度センサのアノード電極とカソード電極からなる。
また、L字型のリードフレーム3を用いた場合は、2つの電極板5の抵抗値を調整して、リードフレーム3の先端からそれぞれのゲート電極12までの抵抗値が略等しくなるようにしてある。
一方、図5は、図4の比較例であり、図5中、図4と同一符号は、同一又は相当箇所を示す。図5の構造では、ゲート端子(G)のリードフレーム3は、金属板5を介して、一旦他のリードフレーム(吊りリード)に接続され、更にボンディングワイヤ4を介してそれぞれのパワー半導体素子2のゲート電極12に接続されている。
図4と図5とを比較するとわかるように、本実施の形態にかかるパワー半導体装置では、比較例に比べてリードフレーム3の数を2本少なくできる。このため、パワー半導体装置の小型化や製造コストの削減が可能となる。
実施の形態2.
図6は、本実施の形態にかかる自己消弧型パワー半導体装置に含まれる金属抵抗体15の拡大図である。金属抵抗体15は、導体部15aと、その両側に設けられた電極部15bからなる。導体部15aの断面積は、電極部15bの断面積より小さくなっている。
一方の電極部15bは、ゲート端子(G)のリードフレーム3に固着されている。また、他方の電極部15bは、ボンディングワイヤ4を介してパワー半導体素子のゲート電極(図示せず)に接続されている。
このように、導体部15aに比べて、電極部15bの断面積を大きくし、広い電極部15bを設けることにより、金属抵抗体15とリードフレーム3との相対的な位置が多少変動しても、ボンディングワイヤ4の長さを変えずに両者を接続でき、ゲート電極とリードフレーム3との間の抵抗値の変動を防止できる。
また、画像認識を用いて金属抵抗体15の位置の検出を行なう場合も、角が多い形状の方が、検出が容易となり生産性が高まる。
また、図6に示すように、リードフレーム3と接合する電極部15bには、超音波接合を行なう際に、ツールにより圧痕15cが形成される。このため、電極部15bを覆うモールド樹脂との密着性が高まる。
従来のようにチップ状の抵抗体を半田付けした構造では、半田表面とモールド樹脂との接着性が低いため、剥離の起点となり、信頼性に問題が生じていた。これに対して、本実施の形態にかかる構造では、金属抵抗体15をリードフレーム3に超音波接合するため、半田接合した場合のようにモールド樹脂との密着性が損なわれることなく抵抗体を内蔵できる。更に、ツールの圧痕15cでモールド樹脂との密着性が向上するため、信頼性を高くできる。
実施の形態3.
図7は、本実施の形態にかかるパワー半導体装置の一部を詳細に示した上面図であり、図7中、図1と同一符号は、同一又は相当箇所を示す。
図7に示すように、本実施の形態にかかるパワー半導体装置では、パワー半導体素子2を制御するためのIC10がリードフレーム3に搭載されている。IC10は複数の電極を有し、それぞれがリードフレーム3にボンディングワイヤで接続されている。
パワー半導体素子2では、パワー半導体素子2に含まれる複数のゲート電極に対して、ゲート電圧を与えるための電荷を瞬時に移動させる必要がある。具体的には、数マイクロ秒の間に1A程度の電流を流す必要がある。
この時、ゲート発振を防止するためのゲート抵抗をIC10に内蔵される構成では、IC10の発熱が大きく、IC10の温度が上昇して誤動作が発生する。このため、IC10を放熱板に搭載して、放熱を確保する必要がある。
これに対して、本実施の形態にかかるパワー半導体装置では、ゲート抵抗をIC10から分離し、IC10の外部に金属板5として設けている。かかる構造では、大きなゲート電流が金属板5に流れて金属板5の温度が上昇しても、IC10の制御性には影響しない。このため、IC10を冷却するための放熱板が不要となり、パワー半導体装置の小型化が可能となる。
図8は、図7の比較例であり、図7中、図8と同一符号は、同一又は相当箇所を示す。図8の構造ではリードフレーム3に載置された金属板5が、更に他のリードフレーム(吊りリード)を介してボンディングワイヤ4で電極12に接続されている。これに対して、本実施の形態にかかるパワー半導体装置では、リードフレーム3に載置された金属板5が、直接、ボンディングワイヤ4で電極12に接続されているため、リードフレームの本数が、それぞれ1本ずつ少なくなり、パワー半導体装置の小型化が可能となる。
実施の形態4.
図9は、本実施の形態にかかるパワー半導体装置の一部を詳細に示した上面図であり、図9中、図1と同一符号は、同一又は相当箇所を示す。
図9に示すように、本実施の形態にかかるパワー半導体装置では、パワー半導体素子2を制御するためのIC10がリードフレーム3に搭載されており、かつ1つのIC10で、2つのパワー半導体素子2を制御する構造となっている。
本実施の形態にかかるパワー半導体装置においても、ゲート抵抗をIC10から分離して外部に金属板5として設けることにより、パワー半導体装置の小型化が可能となる。
図10は、図9の比較例であり、図10中、図9と同一符号は、同一又は相当箇所を示す。図10の構造ではリードフレーム3に載置された金属板5が、更に他のリードフレーム(吊りリード)を介してボンディングワイヤ4で電極12に接続されている。これに対して、本実施の形態にかかるパワー半導体装置では、金属板5が、直接、ボンディングワイヤ4で電極12に接続されているため、リードフレームの本数が2本少なくなり、パワー半導体装置の小型化が可能となる。
実施の形態5.
図11は、本実施の形態にかかるパワー半導体装置の一部の拡大図である。図11は、パワー半導体素子2とリードフレーム3の接続部分であり、図11中、図1と同一符号は同一又は相当箇所を示す。
かかるパワー半導体装置では、実施の形態1等のように金属抵抗体として金属板5を用いる代りに、ボンディングワイヤを金属抵抗体として用いるものである。図11に示すように、本実施の形態では、ボンディングワイヤ14が、パワー半導体素子2の電極とリードフレーム3との間を直接、接続する。ボンディングワイヤ14には、例えば、クロメル、コンスタンタン、マンガニンのような、電気抵抗率の変化が100度あたり5%以下の材料が用いられる。また、ボンディングワイヤ14は、例えば、抵抗値が略0.1Ω〜略100Ωとなるように、その直径と長さが調整される。
このように、ボンディングワイヤ14をゲート抵抗とすることにより、金属板が不要となるとともに、金属板をフレームに接合する工程も省略でき、製造コストの低減が可能となる。
また、リードフレーム3の先端の電極サイズは、好適には、パワー半導体素子2の表面の電極パッドサイズの3倍以上である。かかる構造とすることにより、パワー半導体素子2とリードフレーム3との位置関係が、例えば半田付けの位置精度などにより多少変動しても、ワイヤボンディング14の長さを変えることなく両者の間を接続できる。即ち、ワイヤボンディング14の有する抵抗値を常に一定とすることができる。
本発明の実施の形態1にかかるパワー半導体装置の内部構造の斜視図である。 図1をI−I方向に見た場合の断面図である。 本発明の実施の形態1にかかるパワー半導体装置の回路図である。 本発明の実施の形態1にかかるパワー半導体装置の一部を詳細に示す上面図である。 比較例の上面図である。 本発明の実施の形態2にかかるパワー半導体装置に含まれる金属抵抗体の拡大図である。 本発明の実施の形態3にかかるパワー半導体装置の一部を詳細に示す上面図である。 比較例の上面図である。 本発明の実施の形態4にかかるパワー半導体装置の一部を詳細に示す上面図である。 比較例の上面図である。 本発明の実施の形態5にかかるパワー半導体装置の一部の拡大図である。
符号の説明
1 放熱板、2 パワー半導体素子、3 リードフレーム、4 ボンディングワイヤ、5 金属板、6 モールド樹脂、7 絶縁樹脂層、10 IC、12 電極、15金属抵抗体、100 パワー半導体装置。

Claims (6)

  1. 複数のパワー半導体素子を有する自己消弧型パワー半導体装置であって、
    放熱板と、
    該放熱板上に配置された複数のパワー半導体素子と、
    複数の該パワー半導体素子のゲート電極が並列に接続されたリードフレームと、
    該放熱板上に、該パワー半導体素子を覆うように設けられた封止樹脂とを含み、
    該ゲート電極と該リードフレームとが、金属抵抗体を介して接続されたことを特徴とするパワー半導体装置。
  2. 上記金属抵抗体が、導体部と該導体部の両側に設けられた電極部からなる金属板であり、
    一方の電極部が、上記リードフレームに固着され、他方の電極部が、ボンディングワイヤを介して上記ゲート電極に接続されたことを特徴とする請求項1に記載のパワー半導体装置。
  3. 上記導体部の断面積が、上記電極部の断面積より小さいことを特徴とする請求項2に記載のパワー半導体装置。
  4. 上記金属抵抗体が、ボンディングワイヤからなることを特徴とする請求項1に記載のパワー半導体装置。
  5. 上記金属抵抗体が、コンスタンタン、クロメル、マンガニンからなる群から選択される材料からなることを特徴とする請求項1〜4のいずれかに記載のパワー半導体装置。
  6. 上記金属抵抗体が、略0.1Ω〜略100Ωの抵抗値を有することを特徴とする請求項1〜4のいずれかに記載のパワー半導体装置。

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Cited By (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2012015203A (ja) * 2010-06-29 2012-01-19 On Semiconductor Trading Ltd 半導体装置およびその製造方法
US8432015B2 (en) 2007-09-13 2013-04-30 Toyota Jidosha Kabushiki Kaisha Semiconductor device and wire bonding method
JP2014130909A (ja) * 2012-12-28 2014-07-10 Mitsubishi Electric Corp 電力用半導体装置
WO2015001648A1 (ja) * 2013-07-04 2015-01-08 三菱電機株式会社 半導体装置の製造方法、半導体装置
JP2015149508A (ja) * 2015-05-11 2015-08-20 三菱電機株式会社 電力用半導体装置
CN106098684A (zh) * 2016-08-16 2016-11-09 武汉华星光电技术有限公司 一种静电防护电路
DE112017004776T5 (de) 2016-09-23 2019-06-19 Mitsubishi Electric Corporation Leistungshalbleitermodul und leistungshalbleiteranordnung
DE112018004893T5 (de) 2017-09-04 2020-06-10 Mitsubishi Electric Corporation Halbleitermodul und Leistungswandlervorrichtung
DE112019006894T5 (de) 2019-02-22 2021-11-04 Mitsubishi Electric Corporation Halbleitereinheit und leistungswandler
EP4102558A1 (en) * 2021-06-10 2022-12-14 Hitachi Energy Switzerland AG Power semiconductor module
WO2022122224A3 (de) * 2020-12-07 2022-12-15 Siemens Aktiengesellschaft Bondverbindungsmittel aufweisend einen kern und umhüllenden mantel
EP4261878A1 (en) * 2022-04-13 2023-10-18 Infineon Technologies Austria AG Multi-chip device with gate redistribution structure

Cited By (21)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8432015B2 (en) 2007-09-13 2013-04-30 Toyota Jidosha Kabushiki Kaisha Semiconductor device and wire bonding method
JP2012015203A (ja) * 2010-06-29 2012-01-19 On Semiconductor Trading Ltd 半導体装置およびその製造方法
JP2014130909A (ja) * 2012-12-28 2014-07-10 Mitsubishi Electric Corp 電力用半導体装置
US9041456B2 (en) 2012-12-28 2015-05-26 Mitsubishi Electric Corporation Power semiconductor device
WO2015001648A1 (ja) * 2013-07-04 2015-01-08 三菱電機株式会社 半導体装置の製造方法、半導体装置
US9472538B2 (en) 2013-07-04 2016-10-18 Mitsubishi Electric Corporation Semiconductor device manufacturing method and semiconductor device
JP6065978B2 (ja) * 2013-07-04 2017-01-25 三菱電機株式会社 半導体装置の製造方法、半導体装置
JP2015149508A (ja) * 2015-05-11 2015-08-20 三菱電機株式会社 電力用半導体装置
CN106098684A (zh) * 2016-08-16 2016-11-09 武汉华星光电技术有限公司 一种静电防护电路
CN106098684B (zh) * 2016-08-16 2019-04-26 武汉华星光电技术有限公司 一种静电防护电路
DE112017004776T5 (de) 2016-09-23 2019-06-19 Mitsubishi Electric Corporation Leistungshalbleitermodul und leistungshalbleiteranordnung
US10727213B2 (en) 2016-09-23 2020-07-28 Mitsubishi Electric Corporation Power semiconductor module and power semiconductor device
DE112017004776B4 (de) 2016-09-23 2022-10-13 Mitsubishi Electric Corporation Leistungshalbleitermodul und leistungshalbleiteranordnung
DE112018004893T5 (de) 2017-09-04 2020-06-10 Mitsubishi Electric Corporation Halbleitermodul und Leistungswandlervorrichtung
US11063025B2 (en) 2017-09-04 2021-07-13 Mitsubishi Electric Corporation Semiconductor module and power conversion device
DE112019006894T5 (de) 2019-02-22 2021-11-04 Mitsubishi Electric Corporation Halbleitereinheit und leistungswandler
US12183774B2 (en) 2019-02-22 2024-12-31 Mitsubishi Electric Corporation Power converter
WO2022122224A3 (de) * 2020-12-07 2022-12-15 Siemens Aktiengesellschaft Bondverbindungsmittel aufweisend einen kern und umhüllenden mantel
EP4102558A1 (en) * 2021-06-10 2022-12-14 Hitachi Energy Switzerland AG Power semiconductor module
WO2022258297A1 (en) 2021-06-10 2022-12-15 Hitachi Energy Switzerland Ag Power semiconductor module
EP4261878A1 (en) * 2022-04-13 2023-10-18 Infineon Technologies Austria AG Multi-chip device with gate redistribution structure

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