CN109856876A - 阵列基板、显示面板、显示装置及驱动方法 - Google Patents
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Abstract
本申请公开了一种阵列基板、显示面板、显示装置及驱动方法，其中，阵列基板包括N行M列像素单元，各像素单元包括串联设置的第一晶体管和第二晶体管，所述第一晶体管的源极用于连接源极驱动电路，所述第一晶体管的栅极用于连接栅极驱动电路，所述第一晶体管的漏极与所述第二晶体管的源极连接，所述第二晶体管的漏极连接像素电容；奇数行的所述第二晶体管的栅极与同一第一控制信号线连接；偶数行的所述第二晶体管的栅极与同一第二控制信号线连接，所述第一控制信号线与所述第二控制信号线均用于与显示驱动IC连接。上述方案可以解决串扰的问题。
Description
技术领域
本发明一般涉及显示技术领域，具体涉及一种阵列基板、显示面板、显示装置及驱动方法。
背景技术
目前科技的发展越来越迅速，伴随着科技的发展飞速发展，手机行业也有了突飞猛进的发展，传统的功能性手机仅有的通讯功能已经无法满足现在人们对手机的要求，人们对手机的要求增加了音视频播放等功能，所以消费者对手机显示内容的细节越来越注重。
目前的手机显示屏设计方案中，控制每行GOA(Gate Driver On Array；栅极驱动电路)开启的TFT(Thin Film Transistor；薄膜场效应晶体管)在一个帧(Frame)里只会导通一次对液晶的像素电容(也可称为储存电容)进行充电，其余的时间TFT均处于关断状态。TFT长时间保持关闭状态会存在TFT被Stress(也即TFT特性发生变化)的问题，被Stress后的TFT单元就无法进行完全的关断，这样就会出现其他行的数据资料充进该行像素的像素电容里的问题，这也就会形成串扰(Crosstalk)现象。
发明内容
鉴于现有技术中的上述缺陷或不足，期望提供一种阵列基板、显示面板、显示装置及驱动方法，用以解决现有技术中存在串扰的问题。
第一方面，本发明提供一种阵列基板，包括N行M列像素单元，各像素单元包括串联设置的第一晶体管和第二晶体管，所述第一晶体管的源极用于连接源极驱动电路，所述第一晶体管的栅极用于连接栅极驱动电路，所述第一晶体管的漏极与所述第二晶体管的源极连接，所述第二晶体管的漏极连接像素电容；
奇数行的所述第二晶体管的栅极与同一第一控制信号线连接；偶数行的所述第二晶体管的栅极与同一第二控制信号线连接，所述第一控制信号线与所述第二控制信号线均用于与显示驱动IC连接。
进一步地，第一晶体管和第二晶体管均为TFT。
第二方面，本发明提供一种显示面板，包括上述的阵列基板。
第三方面，本发明提供一种显示装置，包括上述的阵列基板；或，上述的显示面板。
第四方面，本发明提供一种上述的阵列基板的驱动方法，包括：
通过栅极驱动电路依次向各行的第一晶体管输入第一扫描电压信号；
在向奇数行的第一晶体管输入第一扫描电压信号时，通过显示驱动IC向所述第一控制信号线输入第一控制电压信号，以使当前行的第一晶体管与第二晶体管开启时间至少部分重合；
在向偶数行的第一晶体管输入第一扫描电压信号时，通过显示驱动IC向所述第二控制信号线输入第二控制电压信号，以使当前行的第一晶体管与第二晶体管开启时间至少部分重合。
进一步地，所述第一扫描电压信号、所述第一控制电压信号及所述第二控制电压信号均为方波信号。
进一步地，所述第一控制电压信号及所述第二控制电压信号的脉宽均大于所述第一扫描电压信号的脉宽。
上述方案，每个像素单元均串联设置了第一晶体管和第二晶体管，只有在第一晶体管和第二晶体管均导通的情况下，通过源极驱动电路对相应的像素电容进行充电。此外，由于奇数行的第二晶体管的栅极与同一第一控制信号线连接；偶数行的第二晶体管的栅极与同一第二控制信号线连接，在某一奇数行或偶数行的第一晶体管和第二晶体管均导通的情况下，其余奇数行或偶数行的第二晶体管亦导通，由于阵列基板在一帧中是逐行扫描的，则每扫描一行，对应的奇数行或偶数行的第二晶体管进行一次开关动作，避免了晶体管因长时间处于关断状态而存在的被Stress的问题，使得至少第二晶体管可以完全关断，即在当前行进行的像素电容进行充电时，其他行的第二晶体管完全关断，解决了因晶体管被Stress后不能完全关断，而出现的串扰的问题。还有，由于第一控制信号线与第二控制信号线均用于与显示驱动IC连接，由显示驱动IC输出控制第二晶体管通断的电压信号，而不是通过栅极驱动电路来生成控制第二晶体管通断的电压信号，使其可以适用于现有的栅极驱动电路，在栅极驱动电路不需要修改的情况下，降低了设计复杂度及难度，且不需要修改后续栅极驱动电路的形成工艺，利用快速的进行量产。
附图说明
通过阅读参照以下附图所作的对非限制性实施例所作的详细描述，本申请的其它特征、目的和优点将会变得更明显：
图1为本发明实施例提供的整列基板的电路原理示意图；
图2为本发明实施例提供的驱动第一晶体管和第二晶体管开断的时序图。
具体实施方式
下面结合附图和实施例对本申请作进一步的详细说明。可以理解的是，此处所描述的具体实施例仅仅用于解释相关发明，而非对该发明的限定。另外还需要说明的是，为了便于描述，附图中仅示出了与发明相关的部分。
需要说明的是，在不冲突的情况下，本申请中的实施例及实施例中的特征可以相互组合。下面将参考附图并结合实施例来详细说明本申请。
如图1所示，本发明提供的阵列基板，包括N行M列像素单元1，各像素单元1包括串联设置的第一晶体管2和第二晶体管3，第一晶体管2的源极用于连接源极驱动电路，第一晶体管2的栅极用于连接栅极驱动电路，第一晶体管2的漏极与第二晶体管3的源极连接，第二晶体管3的漏极连接像素电容4；奇数行的第二晶体管3的栅极与同一第一控制信号线Control_奇连接；偶数行的第二晶体管3的栅极与同一第二控制信号线Control_偶连接，第一控制信号线Control_奇与第二控制信号线Control_偶均用于与显示驱动IC连接。
其中，N与M均为自然数，其可以根据分辨率来设定，例如，图1中显示了1920行，1080列。1920行栅极线及1080列源极线交叉限定出呈矩阵排布的1920行，1080列像素单元。其中，1920行栅极线依次标记为Gate1、Gate2、Gate3……Gate1918、Gate1919、Gate1920；1080列源极线依次标记为Source line1、Source line2、Source line3……Sourceline1078、Source line1079、Source line1080，需要说明的是，下文中各条线中的信号与其所在线采用同样的项目编号，例如，第一行栅极线标记为Gate1，则该栅极线上的第一扫描电压信号也标记为Gate1；第二行栅极线标记为Gate2，则该栅极线上的第一扫描电压信号也标记为Gate2，以此类推。各列的第一晶体管2的源极通过对应的源极线与源极驱动电路连接。各行的第一晶体管2的栅极通过对应的栅极线与栅极驱动电路连接。
栅极驱动电路用于通过各条栅线向对应的第一晶体管2输入第一扫描电压信号，以控制第一晶体管1的通断，源极驱动电路用于通过各条源极线，在当前行第一晶体管2与第二晶体管3均导通的情况下，向当前行的像素电容4内写入数据，即向当前行的像素电容4进行充电。在当前行的第一晶体管2导通的情况下，显示驱动IC(Integrated Circuit；集成电路)通过对应的第一控制信号线或第二控制信号线连接，来向对应的奇数行或偶数行的第二晶体管3输入控制电压信号，使对应的奇数行或偶数行的第二晶体管3导通。若当前行为奇数行，则通过第一控制信号线Control_奇向所有奇数行的第二晶体管3输入控制电压信号，若当前行为偶数行，则通过第二控制信号线Control_偶向所有偶数行的第二晶体管3输入控制电压信号。
上述方案，每个像素单元1均串联设置了第一晶体管2和第二晶体管3，只有在第一晶体管2和第二晶体管3均导通的情况下，通过源极驱动电路对相应的像素电容4进行充电。此外，由于奇数行的第二晶体管3的栅极与同一第一控制信号线连接；偶数行的第二晶体管3的栅极与同一第二控制信号线连接，在某一奇数行或偶数行的第一晶体管和第二晶体管3均导通的情况下，其余奇数行或偶数行的第二晶体管3亦导通，由于阵列基板在一帧中是逐行扫描的，则每扫描一行，对应的奇数行或偶数行的第二晶体管3进行一次开关动作，避免了晶体管因长时间处于关断状态而存在的被Stress的问题，使得至少第二晶体管3可以完全关断，即在当前行进行的像素电容进行充电时，其他行的第二晶体管3完全关断，解决了因晶体管被Stress后不能完全关断，而出现的串扰的问题。还有，由于第一控制信号线Control_奇与第二控制信号线Control_偶均用于与显示驱动IC连接，由显示驱动IC输出控制第二晶体管3通断的控制电压信号，而不是通过栅极驱动电路来生成控制第二晶体管3通断的控制电压信号，使其可以适用于现有的栅极驱动电路，在栅极驱动电路不需要修改的情况下，降低了设计复杂度及难度，且不需要修改后续栅极驱动电路的形成工艺，利用快速的进行量产。
进一步地，第一晶体管2和第二晶体管3均为TFT。
第二方面，本发明实施例还提供一种显示面板，包括上述的阵列基板，该阵列基板的具体结构参见上述实施例，这里不再赘述。
第三方面，本发明实施例还提供一种显示装置，包括上述的阵列基板；或上述的显示面板。显示装置例如但不限于为显示器、手机、平板电脑等。
第四方面，本发明实施例还提供一种阵列基板的驱动方法，包括通过栅极驱动电路依次向各行的第一晶体管2输入第一扫描电压信号；
在向奇数行的第一晶体管2输入第一扫描电压信号时，通过显示驱动IC向所述第一控制信号线输入第一控制电压信号Control_奇，以使当前行的第一晶体管2与第二晶体管3开启时间至少部分重合；
在向偶数行的第一晶体管2输入第一扫描电压信号时，通过显示驱动IC向所述第二控制信号线输入第二控制电压信号Control_偶，以使当前行的第一晶体管2与第二晶体管3开启时间至少部分重合。
具体地，如图2所示，第一扫描电压信号、第一控制电压信号及第二控制电压信号均为方波信号。第一扫描电压信号是由栅极驱动电路生成的，栅极驱动电路类似于移位寄存器，其生成一个方波信号控制一行的第一晶体管通断，再生成另一方波信号时，控制下一行第一晶体管的通断，依次类推对第一晶体管进行逐行的通断控制，也即进行逐行扫描。这样，在第一控制电压信号Control_奇与第一扫描电压信号Gate1、Gate3……或Gate1919上升沿起效，打开对应奇数行的第一晶体管2及第二晶体管3时，偶数行的第一扫描电压信号完成一次拉低动作，同理，在第一控制电压信号Control_偶与第一扫描电压信号Gate2、Gate4……或Gate1920上升沿开启，打开对应偶数行的第一晶体管2及第二晶体管3时，奇数行的第一扫描电压信号完成一次拉低动作。
例如，在栅极驱动电路向第一行的第一晶体管2输入第一扫描电压信号Gate1时，显示驱动IC向第一控制信号线输入第一控制电压信号Control_奇，第一扫描电压信号Gate1与第一控制电压信号Control_奇至少部分时间重合，在重合的部分，第一晶体管2与第二晶体管3均导通，此时通过源极驱动电路向对应像素的像素电容进行充电，此时，其余奇数行行的第二晶体管3进行一次通断动作。
在栅极驱动电路向第二行的第一晶体2管输入第一扫描电压信号Gate2时，显示驱动IC向第一控制信号线输入第一控制电压信号Control_偶，第一扫描电压信号Gate2与第一控制电压信号Control_偶至少部分时间重合，在重合的部分，第一晶体管2与第二晶体管3均导通，此时通过源极驱动电路向对应像素的像素电容进行充电，此时，其余偶数行行的第二晶体管3进行一次通断动作。
在栅极驱动电路向第三行的第一晶体管2输入第一扫描电压信号Gate3时，显示驱动IC向第一控制信号线输入第一控制电压信号Control_奇，第一扫描电压信号Gate3与第一控制电压信号Control_奇至少部分时间重合，在重合的部分，第一晶体管2与第二晶体管3均导通，此时通过源极驱动电路向对应像素的像素电容进行充电，此时，其余奇数行行的第二晶体管3进行一次通断动作。
在栅极驱动电路向第四行的第一晶体管2输入第一扫描电压信号Gate4时，显示驱动IC向第一控制信号线输入第一控制电压信号Control_偶，第一扫描电压信号Gate4与第一控制电压信号Control_偶至少部分时间重合，在重合的部分，第一晶体管2与第二晶体管3均导通，此时通过源极驱动电路向对应像素的像素电容进行充电，此时，其余偶数行行的第二晶体管3进行一次通断动作。
以此类推完成一帧中所有行的扫描，在一帧中所有行的扫描中，第二晶体管3进行多次的通断动作，避免了晶体管因长时间处于关断状态而存在的被Stress的问题，使得至少第二晶体管3可以完全关断，即在当前行进行的像素电容4进行充电时，其他行的第二晶体管3完全关断，解决了因晶体管被Stress后不能完全关断，而出现的串扰的问题。
进一步地，第一控制电压信号Control_奇及第二控制电压信号Control_偶的脉宽均大于第一扫描电压信号的脉宽。作为一种优选方式，第一控制电压信号Control_奇及第二控制电压信号Control_偶的脉宽相等均为Width2，第一扫描电压信号的脉宽为Width1，Width2>Width1，即第一控制电压信号Control_奇、第二控制电压信号Control_偶的占空比大于第一扫描电压信号的占空比。Width2>Width1可以保证第一晶体管2与第二晶体管3具有足够长时间的共同开启时间，使像素电容4具有足够的充电时长。为了保证充电时长，一种较佳的实现方式是，第一扫描电压信号的高电平时间段完全包含于第一控制电压信号/第二控制电压信号的高电平时间段内。
以上描述仅为本申请的较佳实施例以及对所运用技术原理的说明。本领域技术人员应当理解，本申请中所涉及的发明范围，并不限于上述技术特征的特定组合而成的技术方案，同时也应涵盖在不脱离发明构思的情况下，由上述技术特征或其等同特征进行任意组合而形成的其它技术方案。例如上述特征与本申请中公开的(但不限于)具有类似功能的技术特征进行互相替换而形成的技术方案。
Claims (7)
1.一种阵列基板，包括N行M列像素单元，其特征在于，各像素单元包括串联设置的第一晶体管和第二晶体管，所述第一晶体管的源极用于连接源极驱动电路，所述第一晶体管的栅极用于连接栅极驱动电路，所述第一晶体管的漏极与所述第二晶体管的源极连接，所述第二晶体管的漏极连接像素电容；
奇数行的所述第二晶体管的栅极与同一第一控制信号线连接；偶数行的所述第二晶体管的栅极与同一第二控制信号线连接，所述第一控制信号线与所述第二控制信号线均用于与显示驱动IC连接。
2.根据权利要求1所述的阵列基板，其特征在于，第一晶体管和第二晶体管均为TFT。
3.一种显示面板，其特征在于，包括权利要求1或2所述的阵列基板。
4.一种显示装置，其特征在于，包括权利要求1或2所述的阵列基板；或，权利要求3所述的显示面板。
5.一种权利要求1或2所述的阵列基板的驱动方法，其特征在于，包括：
通过栅极驱动电路依次向各行的第一晶体管输入第一扫描电压信号；
在向奇数行的第一晶体管输入第一扫描电压信号时，通过显示驱动IC向所述第一控制信号线输入第一控制电压信号，以使当前行的第一晶体管与第二晶体管开启时间至少部分重合；
在向偶数行的第一晶体管输入第一扫描电压信号时，通过显示驱动IC向所述第二控制信号线输入第二控制电压信号，以使当前行的第一晶体管与第二晶体管开启时间至少部分重合。
6.根据权利要求5所述的驱动方法，其特征在于，所述第一扫描电压信号、所述第一控制电压信号及所述第二控制电压信号均为方波信号。
7.根据权利要求6所述的驱动方法，其特征在于，所述第一控制电压信号及所述第二控制电压信号的脉宽均大于所述第一扫描电压信号的脉宽。
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| PB01 | Publication | ||
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| SE01 | Entry into force of request for substantive examination | ||
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| GR01 | Patent grant | ||
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