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CN102781304B - 内窥镜图像处理装置和内窥镜系统 - Google Patents

内窥镜图像处理装置和内窥镜系统 Download PDF

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CN102781304B
CN102781304B CN201180011615.9A CN201180011615A CN102781304B CN 102781304 B CN102781304 B CN 102781304B CN 201180011615 A CN201180011615 A CN 201180011615A CN 102781304 B CN102781304 B CN 102781304B
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Abstract

内窥镜图像处理装置具有:内窥镜信息读出部,其从内窥镜中读出与该内窥镜有关的信息即内窥镜信息;同步信号检测部,其被所述内窥镜提供由设于该内窥镜中的摄像元件输出的包含同步信号的摄像信号,进行所述同步信号的检测处理,在能够检测到所述同步信号的情况下,输出所检测到的所述同步信号,在无法检测到所述同步信号的情况下,根据所述内窥镜信息读出部读出的所述内窥镜信息,生成同步信号并输出;以及图像信号生成部,其根据从所述同步信号检测部输出的所述同步信号和从所述内窥镜的所述摄像元件输出的所述摄像信号,生成图像信号。

Description

内窥镜图像处理装置和内窥镜系统
技术领域
本发明涉及对来自摄像元件的内窥镜图像进行处理的内窥镜图像处理装置和内窥镜系统。
背景技术
近年来,内窥镜广泛应用于医疗领域中的诊断和使用处置器械的治疗等。如下的电子内窥镜装置正在普及:在内窥镜插入部的前端设置电荷耦合元件(CCD)等摄像元件,通过视频处理器在电视监视器中映出使用CCD拍摄的观察像。
在视频处理器中设置有驱动电路,将来自该驱动电路的驱动信号传送到内窥镜前端的CCD,对CCD进行驱动。在这种驱动电路中,在驱动信号上重叠同步信号(VD)并供给到CCD。CCD与该同步信号同步地输出各像素的视频信号。
在来自CCD的视频信号上重叠有同步信号(VD)。视频处理器提取来自CCD的视频信号中包含的同步信号,用于以后的视频处理。另外,在日本特开平4-156072号公报中公开了如下的头分离型照相机:与从CCD到视频处理器的传送路径延迟无关,对相位偏移进行补偿。
在视频处理器中,能够连接用于连接CCD和视频处理器的传送路径或CCD的类别等不同的各种内窥镜。在这些各种内窥镜中,传送路径特性等不同,信号衰减量较大。并且,CCD的输出特性或传送路径中的经时变化的程度也不同,有时无法从内窥镜得到足够电平的视频信号。进而,还考虑连接内窥镜和视频处理器的连接部的不良等。由于这些各种要因所导致的信号劣化,存在如下问题:在视频处理器中有时无法检测在来自CCD的视频信号上重叠的同步信号。在视频处理器中无法检测同步信号的情况下,无法进行以后的视频处理,产生无法显示内窥镜的观察图像等的不良情况。
本发明是鉴于该问题点而完成的,其目的在于,提供如下的内窥镜图像处理装置和内窥镜系统:与输入到视频处理器中的信号的劣化无关,能够可靠地再现同步信号。
发明内容
用于解决课题的手段
本发明的内窥镜图像处理装置具有:内窥镜信息读出部,其从内窥镜中读出与该内窥镜有关的信息即内窥镜信息;同步信号检测部,其被所述内窥镜提供由设于该内窥镜中的摄像元件输出的包含同步信号的摄像信号,进行所述同步信号的检测处理,在能够检测到所述同步信号的情况下,输出所检测到的所述同步信号,在无法检测到所述同步信号的情况下,根据所述内窥镜信息读出部读出的所述内窥镜信息,生成同步信号并输出;以及图像信号生成部,其根据从所述同步信号检测部输出的所述同步信号和从所述内窥镜的所述摄像元件输出的所述摄像信号,生成图像信号。
并且,本发明的内窥镜系统具有内窥镜和与内窥镜连接的视频处理器,所述内窥镜具有:摄像元件,其对被摄体进行摄像,输出包含同步信号的摄像信号;以及存储部,其存储与所述内窥镜有关的信息即内窥镜信息,所述视频处理器具有:内窥镜信息读出部,其从所述内窥镜中读出所述内窥镜信息;同步信号检测部,其被所述内窥镜提供由所述摄像元件输出的包含同步信号的摄像信号,进行所述同步信号的检测处理,在能够检测到所述同步信号的情况下,输出所检测到的所述同步信号,在无法检测到所述同步信号的情况下,根据所述内窥镜信息读出部读出的所述内窥镜信息,生成同步信号并输出;以及图像信号生成部,其根据从所述同步信号检测部输出的所述同步信号和从所述内窥镜的所述摄像元件输出的所述摄像信号,生成图像信号。
附图说明
图1是示出本发明的一个实施方式的内窥镜图像处理装置的框图。
图2是示出组入了内窥镜图像处理装置的内窥镜系统的说明图。
图3是示出图1中的同步信号处理部14的具体结构的框图。
图4是示出各传送路径50的具体结构的电路图。
图5是用于说明实施方式的动作的流程图。
图6是用于说明实施方式的动作的流程图。
具体实施方式
下面,参照附图对本发明的实施方式进行详细说明。
图1是示出本发明的一个实施方式的内窥镜图像处理装置的框图。并且,图2是示出组入了内窥镜图像处理装置的内窥镜系统的说明图。
图2所示的内窥镜系统构成为通过镜体线缆5连接镜体1和视频处理器10。作为内窥镜的镜体1具备具有挠性的细长的插入部8,在插入部8的前端侧内置有作为固体摄像元件的CCD 2。并且,在镜体1中设有记述了与镜体1有关的信息、例如与镜体线缆长度有关的信息等镜体信息的ROM 3。另外,存储在ROM 3中的镜体信息包括镜体1和镜体线缆5的线缆长度的信息。
镜体1和镜体线缆5通过连接器4连接成装卸自如,镜体线缆5和视频处理器10通过连接器6、12连接成装卸自如。
如图1所示,视频处理器10由相互绝缘的患者电路11和二次电路21构成。在患者电路11中设有驱动部13,驱动部13根据来自后述的FPGA(现场可编程门阵列)17的定时信号等,产生用于驱动CCD 2的驱动信号。并且,还通过驱动部13进行镜体1的电源供给。
驱动部13需要产生与内置于镜体1中的CCD 2的种类对应的驱动信号,需要在视频处理器10侧掌握CCD 2的种类。在镜体1中设有用于检测这种CCD的种类的检测电阻7。通过连接镜体线缆5的连接器6和视频处理器10的连接器12,基于检测电阻7的电阻值的CCD检测信号被供给到FPGA 17。FPGA 17将CCD检测信号供给到二次电路21的CPU部22。
CPU部22控制时钟生成部23,使其生成与CCD检测信号对应的频率的基准时钟(基准CLK)。并且,时钟生成部23产生用于使FPGA 17进行CCD检测的控制时钟(以下简称为CTLCLK)和用于产生同步信号的同步时钟(以下简称为VDCLK),并供给到FPGA 17。
FPGA 17使用来自时钟生成部23的基准CLK,生成包含CCD 2的驱动所需要的各种时钟的定时信号,并提供给驱动部13。并且,FPGA 17将来自时钟生成部23的VDCLK提供给驱动部13。驱动部13使用来自FPGA 17的定时信号生成CCD 2的驱动信号,并且,在该驱动信号上重叠同步信号(VD)并输出。
另外,在通过CCD检测信号检测到连接有无法驱动的CCD的情况下,FPGA 17停止向驱动部13供给定时信号,并且,停止从驱动部13向镜体1供给电源。进而,FPGA 17将表示连接有无法驱动的CCD的判定信息输出到CPU部22。CPU部22能够将判定信息存储在错误存储部27中。
为了驱动CCD 2,例如需要5、7、10、13、15V等多个电压,驱动部13的电源部13a能够使用来自电源装置45的电源电压,产生基于来自FPGA 17的电源控制信号的多个电压。
该情况下,FPGA 17能够产生与所连接的CCD的种类对应的电源控制信号。在本实施方式中,信息存储部18存储与CCD的种类对应的电源控制信息。FPGA 17根据CCD检测信号从信息存储部18中读出对应的电源控制信息,产生基于所读出的电源控制信息的电源控制信号,按照与CCD的种类对应的顺序产生与CCD的种类对应的电压。
并且,电源部13a将所产生的电压供给到CCD 2,并且提供给电源监视部19。电源监视部19将电源部13a产生的电压转换成数字信号,反馈给FPGA 17。并且,电源监视部19检测从电源部13a向镜体1供给的电流,将检测结果的数字值输出到FPGA 17。FPGA 17通过电源监视部19的输出,判定是否按照指定顺序正确地从电源部13a产生由电源控制信号指定的电压。在没有按照指定顺序正确地产生由电源控制信号指定的电压的情况下,FPGA 17能够控制电源部13a,使其停止产生电压。
并且,FPGA 17能够通过电源监视部19的输出检测来自电源部13a的电源电流的过电流,在检测到过电流的情况下,停止从电源部13a供给电源。在过电流的检测时,FPGA 17不检测突入电流,而仅检测过电流。
来自驱动部13的驱动信号经由镜体线缆5被供给到镜体1的CCD 2。CCD 2根据该驱动信号对来自被摄体的光学像进行光电转换,将摄像信号经由镜体线缆5送出到视频处理器10。即,CCD 2使来自被摄体的光入射到各像素,在各像素中蓄积与入射光量对应的电荷,通过来自驱动部13的驱动信号,输出所蓄积的电荷作为摄像信号。
在来自CCD 2的摄像信号上重叠有同步信号。CCD 2例如将同步信号重叠在与CCD 2的未图示的OB(光学黑体)部对应的定时的摄像信号上。来自CCD 2的摄像信号被供给到视频处理器10内的同步信号处理部14和前置放大器部15。
图3是示出图1中的同步信号处理部14的具体结构的框图。来自CCD 2的摄像信号被供给到同步信号处理部14的CDS电路(相关双重采样电路)31。CDS电路31去除摄像信号中包含的噪声,将其输出到放大部32。放大部32对摄像信号进行放大,将其输出到比较器33。也向比较器33供给规定基准电位,比较器33将表示比基准电位高的电平的摄像信号的期间的定时信号输出到门电路34。
与OB部对应地重叠同步信号,同步信号的电平被设定为比OB部内的其他像素位置的摄像信号高的电平。并且,在驱动部13中,由于使用来自FPGA 17的定时信号在驱动信号上重叠同步信号,所以FPGA 17能够预想到在摄像信号上重叠的同步信号的位置、即与OB部对应的摄像信号的期间。FPGA 17预想到重叠有同步信号的期间,针对该期间附近的摄像信号产生用于分离同步信号的门信号,提供给同步信号处理部14的门电路34。门电路34输出由门信号规定的期间中的定时信号。在由门信号规定的期间内,摄像信号的电平足够低,通过将基准电位设定为同步信号的电平以下,能够通过比较器33和门电路34分离同步信号。
锁存电路35在来自PLL电路36的时钟定时输出来自比较器33的定时信号作为同步信号。在同步信号处理部14中分离出的同步信号被供给到FPGA 17。
另一方面,来自CCD 2的摄像信号也被供给到前置放大器部15。前置放大器部15对所输入的摄像信号进行放大,将其供给到模拟处理部16。模拟处理部16具有未图示的CDS电路和A/D转换器等,去除所输入的摄像信号的噪声后,将其转换成数字信号并输出到FPGA 17。
FPGA 17将从模拟处理部16输入的摄像信号转换成R、G、B视频信号,并且,在R、G、B视频信号中复用同步信号,采用LVDS(low voltage differential signaling:低压差分信号),经由多个传送路径50发送到二次电路21的R、G、B信号处理部24R、24G、24B。
图4是示出各传送路径50的具体结构的电路图。FPGA 17具有R、G、B视频信号用的3个系统的LVDS驱动器51,R、G、B信号处理部24R、24G、24B分别具有LVDS接收器。
LVDS接口中的各传送路径50将分别传送相位相互相反的数据信号的2根线构成为1对。在这些信号线上设有脉冲变压器部53和末端电路54。
在本实施方式中,在与LVDS驱动器51连接的一个信号线和患者电路11的基准电位点61之间连接有变阻器56,在另一个信号线和基准电位点61之间连接有变阻器57。并且,在与LVDS接收器55连接的一个信号线和二次电路21的基准电位点62之间连接有变阻器59,在另一个信号线和基准电位点62之间连接有变阻器58。
患者电路11的各电路相对于基准电位点61绝缘,患者电路11成为电浮动状态。因此,蓄积在患者电路11中的静电在患者电路11内经由阻抗最低的部分对基准电位点61放电。在该放电路径上存在器件的情况下,该器件可能由于放电而被破坏。
但是,在本实施方式中,在各传送路径50中,在1对信号线与基准电位点61之间设有变阻器56、57,在1对信号线与基准电位点62之间设有变阻器58、59。因此,蓄积在患者电路11中的静电经由变阻器56~59流过二次电路的基准电位点62。
即,在本实施方式中,在静电的放电路径上,器件仅存在脉冲变压器部53,能够防止由于静电的放电而破坏器件。
在本实施方式中,FPGA 17判断是否在同步信号处理部14中正常分离了同步信号,在正常分离了同步信号的情况下,在视频信号上重叠来自同步信号处理部14的同步信号,在没有正常分离的情况下,在视频信号上重叠根据存储在信息存储部18中的数据而生成的同步信号并输出。
在来自CCD 2的摄像信号上重叠的同步信号基于驱动部13输出的同步信号,可以估计为在与基于CCD的种类和镜体线缆长度的延迟时间对应的定时重叠在摄像信号上的同步信号。FPGA 17根据该估计生成同步信号。
在本实施方式中,信息存储部18存储基于CCD的种类和镜体线缆长度的信息的延迟时间的信息、即应该产生同步信号的位置的信息,作为计数数量的信息。
通过经由镜体线缆5将镜体1连接在视频处理器10上,CPU部22能够读出存储在镜体1的ROM 3中的镜体信息。CPU部22将从ROM 3读出的镜体信息输出到FPGA 17。并且,还对FPGA 17输入CCD检测信号,FPGA 17根据镜体信息和CCD检测信号,从信息存储部18中读出与CCD的种类和镜体线缆长度对应的延迟时间的信息。FPGA 17将根据VDCLK而产生的定时信号作为基准,以基于从信息存储部18中读出的信息的计数数量对基准CLK进行计数,由此,能够产生同步信号。
二次电路21的R、G、B信号处理部24R、24G、24B分别从FPGA 17接收重叠有同步信号的R、G、B视频信号。R、G、B信号处理部24R、24G、24B由CPU部22控制,对接收到的R、G、B视频信号实施了规定颜色信号处理后,将其输出到矩阵部25。矩阵部25由CPU部22控制,对所输入的R、G、B视频信号实施规定矩阵运算,生成R、G、B视频信号并输出到图像处理部26。图像处理部26由CPU部22控制,对所输入的R、G、B视频信号分别实施了γ校正处理和白平衡调整处理后,将其输出到监视器41。并且,图像处理部26具有OSD处理部26a,OSD处理部26a能够叠印与来自CPU部22的指示对应的字符。
这样,能够在监视器41上显示通过CCD 2拍摄而得到的内窥镜像。
另外,在判定为在同步信号处理部14中无法正常分离同步信号的情况下,FPGA17将表示该情况的判定信息供给到CPU部22。当判定信息表示在同步信号处理部14中无法正常分离同步信号时,CPU部22控制OSD处理部26a,使其显示表示该情况的消息。例如,CPU部22使其显示“请进行镜体线缆接点的清扫并再次连接。”等消息。
接着,参照图5和图6的流程图对这样构成的实施方式的动作进行说明。图5示出图1中的FPGA 17中的同步信号生成处理。并且,图6示出基于FPGA 17的电源控制。
将镜体线缆5的连接器4与镜体1连接,将连接器6与视频处理器10的连接器12连接。由此,CPU部22读出存储在镜体1的ROM 3中的镜体信息。镜体信息还提供给FPGA 17。并且,基于检测电阻7的电阻值的CCD检测信号被供给到FPGA 17。FPGA 17将CCD检测信号输出到CPU部22。
CPU部22控制时钟生成部23,使其产生CTLCLK。FPGA 17能够使用该CTLCLK进行CCD检测信号的接收。在通过CCD检测信号检测到连接有无法检测、无法驱动、非对应的CCD的情况下,FPGA 17向CPU部22输出表示连接有这种CCD的判定信息,并且,使驱动部13停止向镜体1供给电源。另外,通过CPU部22将该判定信息存储在错误存储部27中。并且,CPU部22控制OSD处理部26a,在监视器41的画面上显示表示连接有无法检测、无法驱动、非对应的CCD的消息。
由此,能够可靠地向用户告知连接有非对应的CCD或镜体故障等。并且,通过停止向镜体供给电源,还能够防止镜体的破坏。并且,通过将判定信息存储在错误存储部27中,还能够进行迅速的修理等。
在连接有能够驱动的CCD的情况下,CPU部22通过CCD检测信号掌握CCD的种类,控制时钟生成部23,以使其生成适合于CCD 2的时钟。由此,时钟生成部23产生基准CLK并将其供给到FPGA 17。并且,时钟生成部23产生VDCLK并将其输出到FPGA 17。
FPGA 17根据基准时钟产生包含各种时钟的定时信号并供给到驱动部13,并且,将VDCLK供给到驱动部13。驱动部13使用所输入的定时信号生成驱动信号,并且,在驱动信号上重叠基于VDCLK的同步信号。来自驱动部13的驱动信号经由镜体线缆5被供给到镜体1的CCD 2。
并且,FPGA 17从信息存储部18中读出与CCD的种类对应的电源控制信息,产生基于该电源控制信息的电源控制信号,控制电源部13a。例如,设当前能够在视频处理器10上连接CCD A或CCD B,关于CCD A,按照电压A、B、C的顺序进行电源供给,关于CCD B,按照电压A、C、B的顺序进行电源供给,由此正常进行动作。
在图6的步骤S11中,FPGA 17从信息存储部18中读出基于CCD检测信号的电源控制信息。例如,设CCD检测信号表示连接有CCD A作为CCD 2。该情况下,FPGA 17使处理从步骤S12转移到步骤S13,通过电源控制信号使电源部13a产生电压A。电源部13a产生电压A,并且,通过电源监视部19将该电压A转换成数字信号并反馈给FPGA 17。FPGA 17判定基于信息存储部18的输出的电压是否在电压A的下限阈值电压的范围内(阈值以内)(步骤S14)。例如,作为下限阈值,设定额定电压的80%的电压。
FPGA 17在判断为电压A达到下限阈值时,在接下来的步骤S15中,产生用于产生电压B的电源控制信号。以后,同样由于电压B达到电压B的下限阈值而产生电压C(步骤S16、S17),由于电压C达到下限阈值(步骤S18)而转移到步骤S19。在步骤S19中,判定全部电压是否在上限阈值电压的范围内(阈值以内)。例如,作为上限阈值,设定额定电压的120%的电压。
同样,在CCD检测信号表示连接有CCD B作为CCD 2的情况下,FPGA 17通过步骤S23~S28的处理而依次产生电压A、C、B。在步骤S19、29中,在表示应该供给到各CCD的全部电压不是下限阈值与上限阈值之间的电压的情况下,使处理转移到步骤S30,停止供给电源。
另外,在图6中,在产生各电压时,在即使经过规定时间以上也没有达到下限阈值的情况下,也可以使处理转移到步骤S30,停止供给电源。
这样,在本实施方式中,在FPGA 17中,能够按照与CCD的种类对应的顺序依次产生与CCD的种类对应的电压。并且,FPGA 17通过监视所产生的电压,能够在异常时停止供给电压。
并且,FPGA 17还检测来自电源部13a的电源电流的过电流。电源监视部19对电源电流进行采样并转换成数字值。FPGA 17根据通过电源监视部19的2次以上的采样而得到的电流值的平均值,判定是否产生了过电流。
例如,电源监视部19以200Hz的采样周期对从电源部13a向CCD 2供给的电源电流进行A/D转换。然后,FPGA 17按照电源监视部19的每次采样,求出所采样的最近4个电流值的移动平均。在所采样的电流值为150mA以上的情况下,作为电流上限值150mA,计算移动平均。在计算出的移动平均值连续3次超过作为检测阈值的130mA的情况下,判定为流过过电流。在判定为流过过电流的情况下,FPGA 17例如停止电源部13a的电源供给。
另外,采样周期、移动平均中使用的采样数、电流上限值、检测阈值不限于这里所示的数值。
当正常供给电源时,CCD 2对被摄体光学像进行光电转换,按照来自驱动部13的驱动信号,输出各像素所蓄积的电荷作为摄像信号。该情况下,CCD 2在与OB部对应的定时输出重叠了同步信号的摄像信号。来自CCD 2的摄像信号经由镜体线缆5被供给到视频处理器10的同步信号处理部14和前置放大器部15。
前置放大器部15对所输入的摄像信号进行放大,模拟处理部16对放大后的摄像信号实施CDS处理和A/D转换处理,将数字摄像信号输出到FPGA 17。
另一方面,FPGA 17根据CCD检测信号和镜体信息,从信息存储部18中读出延迟时间的信息。FPGA 17根据所读出的信息生成门信号,并输出到同步信号处理部14。
同步信号处理部14将所输入的摄像信号与基准电位进行比较,产生定时信号,输出由门信号规定的门期间内的定时信号作为同步信号。该同步信号被供给到FPGA17。
在本实施方式中,FPGA 17判定来自同步信号处理部14的同步信号是否正常。例如,FPGA 17设定规定判定期间,根据同步信号处理部14在该判定期间内能够分离几次同步信号,判定同步信号是否正常。在图5的步骤S1中,FPGA 17判定表示能够在同步信号处理部14中分离同步信号的切出判定是否为OK。仅在切出判定为OK的情况下,增加变量OKCNT(步骤S2)。
在步骤S3中,FPGA 17判定判定期间是否结束。反复进行步骤S1~S3,检测在判定期间中切出判定几次成为OK。在接下来的步骤S4中,FPGA 17判定变量OKCNT是否为设计值以上(步骤S4)。在变量OKCNT为设计值以上的情况下,在接下来的步骤S5中,FPGA 17判断为同步信号的分离成功,在步骤S6中,采用分离出的同步信号,进行以后的处理。
另一方面,在变量OKCNT小于设计值的情况下,在接下来的步骤S7中,FPGA17判断为同步信号的分离失败,在步骤S8中,从信息存储部18中读出延迟时间的信息。FPGA 17以VDCLK为基准,根据延迟时间的信息对基准CLK进行计数,由此生成同步信号(步骤S9)。以后,FPGA 17采用所生成的同步信号,进行以后的处理。
这样,不是通过1次判定,而是通过在规定判定期间中同步分离成功的次数是否达到设计值,判断来自同步信号处理部14的同步信号是否正常,能够防止误检测。
FPGA 17将摄像信号转换成R、G、B视频信号,并且,在R、G、B视频信号中复用所分离或生成的同步信号,使用LVDS发送到R、G、B信号处理部24R、24G、24B。R、G、B信号处理部24R、24G、24B对R、G、B视频信号进行信号处理,矩阵部25对R、G、B信号处理部24R、24G、24B的输出进行矩阵处理。通过图像处理部26对来自矩阵部25的R、G、B视频信号实施γ校正处理和白平衡调整处理等后,将其供给到监视器41。这样,在监视器41的显示画面上进行基于CCD 2的摄像图像的图像显示。
另一方面,在同步信号处理部14中没有正常分离同步信号的情况下,FPGA 17将表示该情况的判定信息输出到CPU部22。CPU部22控制OSD处理部26a,在内窥镜像上叠印显示表示该情况的显示。例如,能够在监视器41的画面上显示表示没有正常分离同步信号的显示、或指出线缆接触不良的显示等。
另外,在本实施方式中,在电源接通之后的规定期间内进行图5的处理,但是,也可以在电源接通之后的定时以外的规定定时实施图5的处理。
这样,在本实施方式中,在判定为无法正常分离同步信号的情况下,通过从信息存储部中读出延迟时间的信息,生成同步信号并在以后的处理中加以利用。由此,即使在产生镜体的传送路径特性的不良、经时变化、接触不良等而无法分离同步信号的情况下,也能够生成同步信号并进行视频处理,能够映出摄像图像。
并且,在本实施方式中,在信息存储部中保持与CCD的种类和镜体线缆的种类对应的数据,在视频处理器连接了任意种类的镜体和CCD的情况下,也能够可靠地生成同步信号。
另外,在上述实施方式中说明了如下例子:CCD输出重叠了同步信号的摄像信号,在同步信号处理部中分离重叠在摄像信号上的同步信号,但是,同样能够应用于如下例子:CCD输出包含同步信号的摄像信号,在同步信号处理部中检测摄像信号中包含的同步信号。
本申请以2010年7月12日在日本申请的日本特愿2010-158302号为优先权主张的基础进行申请,上述公开内容被引用到本申请说明书、权利要求书和附图中。

Claims (12)

1.一种内窥镜图像处理装置,其特征在于,其具有:
内窥镜信息读出部,其从内窥镜中读出与该内窥镜有关的信息即内窥镜信息;
同步信号处理部,其进行用于从摄像信号检测第1同步信号的处理,其中,所述摄像信号与该第1同步信号重叠,并经由镜体线缆被输入,所述第1同步信号从设于所述内窥镜中的摄像元件被输出;
同步信号输出部,其判定所述同步信号处理部能否检测到所述第1同步信号,在判定为检测到所述第1同步信号的情况下,输出在所述同步信号处理部中检测到的所述第1同步信号;在无法检测到所述第1同步信号的情况下,根据所述内窥镜信息,生成第2同步信号并输出;以及,
图像信号生成部,其根据从所述同步信号输出部输出的所述第1或第2同步信号中的任意一个同步信号和从所述内窥镜的所述摄像元件输出的所述摄像信号,生成图像信号。
2.根据权利要求1所述的内窥镜图像处理装置,其特征在于,
所述内窥镜图像处理装置还具备信息存储部,其存储关于对应于所述内窥镜信息的延迟时间的信息;
所述同步信号输出部,在所述同步信号处理部中无法检测到所述第1同步信号的情况下,根据所述信息存储部所存储的关于所述延迟时间的信息,生成所述第2同步信号。
3.根据权利要求1所述的内窥镜图像处理装置,其特征在于,
所述内窥镜图像处理装置具有图像处理部,该图像处理部对所述图像信号生成部所生成的图像信号进行图像处理,
所述图像处理部在所述同步信号处理部无法检测到所述第1同步信号的情况下,将表示该情况的信息重叠在所述图像信号上。
4.根据权利要求1所述的内窥镜图像处理装置,其特征在于,
所述同步信号输出部根据在规定判定期间内能够检测到所述第1同步信号的次数,判定所述第1同步信号的检测是否成功。
5.根据权利要求1所述的内窥镜图像处理装置,其特征在于,
所述内窥镜图像处理装置具有:
摄像元件驱动部,其输出用于驱动所述摄像元件的电源和驱动信号;
摄像元件信息读出部,其从所述内窥镜中读出与所述摄像元件有关的信息即摄像元件信息;以及
控制部,其在所述摄像元件信息读出部无法读出与所述摄像元件驱动部能够驱动的摄像元件有关的摄像元件信息的情况下,控制所述摄像元件驱动部,停止对所述摄像元件输出电源和驱动信号。
6.根据权利要求5所述的内窥镜图像处理装置,其特征在于,
所述内窥镜图像处理装置具有图像处理部,该图像处理部对所述图像信号生成部所生成的图像信号进行图像处理,
所述图像处理部在所述摄像元件信息读出部无法读出与所述摄像元件驱动部能够驱动的摄像元件有关的摄像元件信息的情况下,将表示该情况的信息重叠在所述图像信号上。
7.一种内窥镜系统,其具有内窥镜和与内窥镜连接的视频处理器,其特征在于,
所述内窥镜具有:
摄像元件,其对被摄体进行摄像,输出包含同步信号的摄像信号;以及
存储部,其存储与所述内窥镜有关的信息即内窥镜信息,
所述视频处理器具有:
内窥镜信息读出部,其从所述内窥镜中读出所述内窥镜信息;
同步信号处理部,其进行用于从摄像信号检测第1同步信号的处理,其中,所述摄像信号与该第1同步信号重叠,并经由镜体线缆被输入,所述第1同步信号从设于所述内窥镜中的摄像元件被输出;
同步信号输出部,其判定所述同步信号处理部是否检测到所述第1同步信号,在判定为检测到所述第1同步信号的情况下,输出在所述同步信号处理部中检测到的所述第1同步信号;在无法检测到所述第1同步信号的情况下,根据所述内窥镜信息,生成第2同步信号并输出;以及,
图像信号生成部,其根据从所述同步信号输出部输出的所述第1或第2同步信号中的任意一个同步信号和从所述内窥镜的所述摄像元件输出的所述摄像信号,生成图像信号。
8.根据权利要求7所述的内窥镜系统,其特征在于,
所述内窥镜图像处理装置还具备信息存储部,其存储关于对应于所述内窥镜信息的延迟时间的信息;
所述同步信号输出部,在所述同步信号处理部中无法检测到所述第1同步信号的情况下,根据所述信息存储部所存储的关于所述延迟时间的信息,生成所述第2同步信号。
9.根据权利要求7所述的内窥镜系统,其特征在于,
所述视频处理器具有图像处理部,该图像处理部对所述图像信号生成部所生成的图像信号进行图像处理,
所述图像处理部在所述同步信号处理部无法检测到所述第1同步信号的情况下,将表示该情况的信息重叠在所述图像信号上。
10.根据权利要求7所述的内窥镜系统,其特征在于,
所述同步信号输出部根据在规定判定期间内能够检测到所述第1同步信号的次数,判定所述第1同步信号的检测是否成功。
11.根据权利要求7所述的内窥镜系统,其特征在于,
所述内窥镜具有摄像元件存储部,该摄像元件存储部存储与所述摄像元件有关的信息即摄像元件信息,
所述视频处理器具有:
摄像元件驱动部,其输出用于驱动所述摄像元件的电源和驱动信号;
摄像元件信息读出部,其从所述内窥镜中读出所述摄像元件信息;以及
控制部,其在所述摄像元件信息读出部无法读出与所述摄像元件驱动部能够驱动的摄像元件有关的摄像元件信息的情况下,控制所述摄像元件驱动部,停止对所述摄像元件输出电源和驱动信号。
12.根据权利要求11所述的内窥镜系统,其特征在于,
所述视频处理器具有图像处理部,该图像处理部对所述图像信号生成部所生成的图像信号进行图像处理,
所述图像处理部在所述摄像元件信息读出部无法读出与所述摄像元件驱动部能够驱动的摄像元件有关的摄像元件信息的情况下,将表示该情况的信息重叠在所述图像信号上。
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