RU2469470C1 - Paraphase signal generator with control input high active level - Google Patents
Paraphase signal generator with control input high active level Download PDFInfo
- Publication number
- RU2469470C1 RU2469470C1 RU2011129014/08A RU2011129014A RU2469470C1 RU 2469470 C1 RU2469470 C1 RU 2469470C1 RU 2011129014/08 A RU2011129014/08 A RU 2011129014/08A RU 2011129014 A RU2011129014 A RU 2011129014A RU 2469470 C1 RU2469470 C1 RU 2469470C1
- Authority
- RU
- Russia
- Prior art keywords
- input
- inverter
- inputs
- output
- elements
- Prior art date
Links
Landscapes
- Logic Circuits (AREA)
Abstract
Description
Формирователь парафазного сигнала с высоким активным уровнем входа управления относится к импульсной и вычислительной технике и может использоваться при построении самосинхронных комбинационных, триггерных, регистровых и вычислительных устройств, систем цифровой обработки информации.A paraphase signal generator with a high active level of control input refers to pulse and computer technology and can be used to build self-synchronous combination, trigger, register and computing devices, and digital information processing systems.
Известна многоразрядная схема преобразования унарного информационного сигнала в парафазный [1] (Автоматное управление асинхронными процессами в ЭВМ и дискретных системах. Под ред. В.И.Варшавского. - М.: Наука, 1986. - 400 с. (рис.11.19)), содержащая элементы И-ИЛИ-НЕ, И-НЕ, инверторы и гистерезисный триггер.Known multi-bit scheme for converting a unary information signal to a paraphase [1] (Automatic control of asynchronous processes in computers and discrete systems. Edited by V.I. Varshavsky. - M .: Nauka, 1986. - 400 p. (Fig. 11.19)) containing the elements AND-OR-NOT, AND-NOT, inverters and a hysteresis trigger.
Недостаток известного устройства - большая сложность схемы и связанное с этим низкое быстродействие.A disadvantage of the known device is the large complexity of the circuit and the associated low speed.
Наиболее близким к предлагаемому решению по технической сущности и принятым в качестве прототипа является самосинхронный однотактный D-триггер с высоким активным уровнем сигнала управления [2] (Патент №2362266 RU. Опубликовано: 20.07.2009 г. Бюл. №20. МПК H03K 3/00), содержащий инвертор, элемент ИЛИ-И-НЕ, бистабильную ячейку на элементах ИЛИ-И-НЕ и индикаторный элемент ИЛИ-И-НЕ.The closest to the proposed solution in technical essence and adopted as a prototype is a self-synchronous single-cycle D-flip-flop with a high active level of the control signal [2] (Patent No. 2362266 RU. Published: July 20, 2009 Bull. No. 20. IPC H03K 3 / 00), containing the inverter, the element OR-AND-NOT, a bistable cell on the elements OR-AND-NOT and the indicator element OR-AND-NOT.
Недостаток прототипа - формирование бифазного кода на информационном выходе, являющемся выходом бистабильной ячейки, что не позволяет использовать прототип в качестве приемника унарного информационного сигнала на входе комбинационной самосинхронной схемы.The disadvantage of the prototype is the formation of a biphasic code at the information output, which is the output of a bistable cell, which does not allow using the prototype as a receiver of a unary information signal at the input of a combinational self-synchronous circuit.
Целью настоящего изобретения является обеспечение самосинхронной реализации формирователя парафазного сигнала с высоким активным уровнем входа управления, гарантирующей работоспособность формирователя при любых задержках составляющих его элементов.The aim of the present invention is to provide a self-synchronous implementation of a paraphase signal shaper with a high active control input level, guaranteeing the shaper operability at any delays of its constituent elements.
Поставленная цель достигается за счет того, что в формирователе, содержащем инвертор, элемент ИЛИ-И-НЕ, информационный унарный вход, подключенный к входу инвертора, управляющий вход, подключенный к входу второй группы входов ИЛИ элемента ИЛИ-И-НЕ, и две составляющие информационного выхода, вход инвертора соединен со вторым входом первой группы входов ИЛИ элемента ИЛИ-И-НЕ, выход инвертора подключен к первому входу первой группы входов ИЛИ элемента ИЛИ-И-НЕ, введены два элемента ИЛИ-НЕ, первые входы первого и второго элементов ИЛИ-НЕ соединены с выходом и входом инвертора соответственно, вторые входы первого и второго элементов ИЛИ-НЕ подключены к выходу элемента ИЛИ-И-НЕ, а выходы первого и второго элементов ИЛИ-НЕ формируют парафазный сигнал и подключены к первой и второй составляющим информационного выхода формирователя соответственно.This goal is achieved due to the fact that in the shaper containing the inverter, the OR-AND-NOT element, the information unary input connected to the inverter input, the control input connected to the input of the second group of inputs OR of the OR-AND-AND element, and two components information output, the inverter input is connected to the second input of the first group of inputs OR of the OR-AND-NOT element, the inverter output is connected to the first input of the first group of inputs OR of the OR-AND-NOT element, two OR-NOT elements are introduced, the first inputs of the first and second elements OR NOT connected s with the output and input of the inverter, respectively, the second inputs of the first and second elements OR-NOT connected to the output of the element OR-AND-NOT, and the outputs of the first and second elements OR-NOT form a phase signal and connected to the first and second components of the information output of the shaper, respectively .
Предлагаемое устройство удовлетворяет критерию "существенные отличия". Использование элемента ИЛИ-И-НЕ и инвертора в качестве входного блока при реализации самосинхронного однотактного D-триггера с унарным информационным входом известно. Однако использование их в данном случае позволило достичь эффекта, выраженного целью изобретения.The proposed device meets the criterion of "significant differences". The use of an OR-AND-NOT element and an inverter as an input unit when implementing a self-synchronous single-cycle D-trigger with a unary information input is known. However, their use in this case allowed to achieve the effect expressed by the purpose of the invention.
Поскольку введенные конструктивные связи в аналогичных технических решениях неизвестны, устройство может считаться имеющим существенные отличия.Since the introduced structural connections in similar technical solutions are unknown, the device can be considered to have significant differences.
Понятие "парафазный", используемое в тексте данной заявки, определяется следующим образом. Парафазным считается сигнал, представленный двумя составляющими - парой переменных {X, ХВ}, которые в активной фазе имеют взаимоинверсные значения: {Х=0, ХВ=1} или {Х=1, ХВ=0}. Переход парафазного сигнала из одного статического рабочего состояния в противоположное рабочее состояние может осуществляться двумя способами.The concept of "paraphase" used in the text of this application is defined as follows. A signal is considered to be paraphase, represented by two components - a pair of variables {X, XB}, which in the active phase have mutually inverse values: {X = 0, XB = 1} or {X = 1, XB = 0}. The transition of a paraphase signal from one static operating state to the opposite operating state can be carried out in two ways.
Первый способ предлагает использование парафазного сигнала со спейсером: когда переходу в следующее рабочее состояние обязательно предшествует переход в третье статическое состояние - спейсерное (нерабочее состояние или состояние гашения). Если используется состояние {1,1}, то говорят, что используется парафазный сигнал с единичным спейсером, а если состояние {0,0}, то - парафазный сигнал с нулевым спейсером. Спейсерное состояние - статическое состояние, установка которого в самосинхронной схемотехнике должна фиксироваться индикатором окончания переходного процесса, в данном случае - окончания установки спейсерного состояния.The first method suggests the use of a paraphase signal with a spacer: when the transition to the next operating state is necessarily preceded by the transition to the third static state - the spacer (non-operational state or blanking state). If the state {1,1} is used, then they say that a paraphase signal with a single spacer is used, and if the state is {0,0}, then a paraphase signal with a zero spacer is used. The spacer state is a static state, the installation of which in self-synchronous circuitry should be fixed by the indicator of the end of the transition process, in this case, the end of the installation of the spacer state.
Второй способ предлагает использование парафазного сигнала без спейсера. При этом переход из одного рабочего статического состояния в другое осуществляется через динамическое (кратковременное) состояние: {1,1} или {0,0}, - называемое транзитным состоянием.The second method suggests the use of a paraphase signal without a spacer. In this case, the transition from one working static state to another is carried out through a dynamic (short-term) state: {1,1} or {0,0}, - called a transit state.
В материалах данной заявки речь идет о формировании на выходе преобразователя парафазного сигнала с нулевым спейсером, в дальнейшем - просто парафазного сигнала.In the materials of this application, we are talking about the formation of a paraphase signal with a zero spacer at the output of the converter, in the future - just a paraphase signal.
Унарный сигнал - обычный одиночный информационный сигнал, имеющий два возможных значения: 0 или 1. Вход управления переключением в состояние "1" отражает факт появления на информационном унарном входе нового значения, которое может и совпадать с предшествующим значением.A unary signal is an ordinary single information signal having two possible values: 0 or 1. The input for controlling the switching to the state "1" reflects the fact that a new value appears on the information unary input, which may also coincide with the previous value.
На фиг.1 изображена схема формирователя парафазного сигнала с высоким активным уровнем входа управления.Figure 1 shows a diagram of a paraphase signal driver with a high active control input level.
Схема формирователя содержит инвертор 1, элемент ИЛИ-И-НЕ 2, элементы ИЛИ-НЕ 3-4, информационный унарный вход 5, вход управления 6, первую 7 и вторую 8 составляющие парафазного выхода, информационный унарный вход 5 подключен к входу инвертора 1, второму входу первой группы входов ИЛИ элемента ИЛИ-И-НЕ 2 и первому входу второго элемента ИЛИ-НЕ 4, выход инвертора 1 соединен с первым входом первого элемента ИЛИ-НЕ 3 и первым входом первой группы входов ИЛИ элемента ИЛИ-И-НЕ 2, вход управления 6 соединен с входом второй группы входов ИЛИ элемента ИЛИ-И-НЕ 2, выход которого подключен ко вторым входам первого 3 и второго 4 элементов ИЛИ-НЕ, выходы первого 3 и второго 4 элементов ИЛИ-НЕ подключены к первой 7 и второй 8 составляющим парафазного выхода формирователя соответственно.The driver circuit contains an inverter 1, an OR-AND-NOT 2 element, OR-NOT 3-4 elements, an information unary input 5, a control input 6, the first 7 and second 8 components of the paraphase output, the information unary input 5 is connected to the input of the inverter 1, to the second input of the first group of inputs OR element OR-AND-NOT 2 and the first input of the second element OR-NOT 4, the output of the inverter 1 is connected to the first input of the first element OR-NOT 3 and the first input of the first group of inputs OR , the control input 6 is connected to the input of the second group of inputs OR element OR-AND-NOT 2, in the output of which is connected to the second inputs of the first 3 and second 4 OR-NOT elements, the outputs of the first 3 and second 4 OR-NOT elements are connected to the first 7 and second 8 components of the paraphase output of the shaper, respectively.
Схема работает следующим образом. В исходном состоянии при неактивном состоянии входа управления 6 (низкий логический уровень) выход элемента 2 находится в состоянии логической "1" и обе составляющие парафазного выхода 7 и 8 находятся в состоянии "0" (в спейсере). Появление на информационном унарном входе 5 нового значения подтверждается подачей на управляющий вход 6 активного высокого уровня. Выход элемента 2 переключается в состояние логического "0", разрешая тем самым трансляцию значения унарного информационного входа и его инверсии на выходы элементов 3 и 4. Если при этом на информационном входе 5 низкий уровень, элемент 3 останется в состоянии "0", а элемент 4 переключится в состояние "1". Если на информационном входе 5 высокий уровень, элемент 3 переключится в состояние "1", a элемент 4 останется в состоянии "0".The scheme works as follows. In the initial state, when the control input 6 is inactive (low logic level), the output of element 2 is in the logical state “1” and both components of the paraphase output 7 and 8 are in the state “0” (in the spacer). The appearance at the information unary input 5 of a new value is confirmed by applying to the control input 6 active high level. The output of element 2 switches to the logical “0” state, thereby allowing the translation of the value of the unary information input and its inversion to the outputs of elements 3 and 4. If at the same time the information input 5 is low, element 3 will remain in the state “0”, and the element 4 will switch to state "1". If the information input 5 is high, element 3 will switch to state "1", and element 4 will remain in state "0".
На первый взгляд использование элемента ИЛИ-И-НЕ является избыточным, так как, с точки зрения булевой алгебры, выполняемая им функция упрощается до инверсии входа управления из-за того, что входами первой группы входов ИЛИ являются взаимоинверсные сигналы. Однако именно такое использование элемента ИЛИ-И-НЕ обеспечивает самосинхронность предлагаемой схемы формирователя.At first glance, the use of the OR-AND-NOT element is redundant, since, from the point of view of Boolean algebra, the function it performs is simplified to invert the control input due to the fact that the inputs of the first group of OR inputs are mutually inverse signals. However, it is precisely this use of the OR-AND-NOT element that ensures the self-synchronization of the proposed shaper circuit.
Особенности данной схемы по сравнению с прототипом следующие.The features of this scheme compared with the prototype are as follows.
Информационный выход является парафазным с нулевым спейсером, что позволяет использовать формирователь в качестве элемента интерфейса между синхронной схемой и самосинхронной комбинационной схемой. Парафазный выход формирователя своим состоянием индицирует окончание переходных процессов в схеме формирователя в любой фазе его работы, обеспечивая его самосинхронность.The information output is paraphase with a zero spacer, which allows the driver to be used as an interface element between a synchronous circuit and a self-synchronous combinational circuit. The para-phase output of the shaper by its state indicates the end of transient processes in the shaper circuit at any phase of its operation, ensuring its self-synchronization.
Таким образом, предлагаемое устройство обеспечивает самосинхронную работу формирователя парафазного сигнала с высоким активным уровнем входа управления. Цель изобретения достигнута.Thus, the proposed device provides self-synchronous operation of the paraphase signal driver with a high active level of control input. The objective of the invention is achieved.
Источники информацииInformation sources
[1] Автоматное управление асинхронными процессами в ЭВМ и дискретных системах. Под ред. В.И.Варшавского. - М.: Наука, 1986. - 400 с. (рис.11.19).[1] Automatic control of asynchronous processes in computers and discrete systems. Ed. V.I. Warsaw. - M .: Nauka, 1986 .-- 400 p. (Fig. 11.19).
[2] Патент №2362266 RU. Опубликовано: 20.07.2009 г. Бюл. №20. МПК H03K 3/00 (фиг.1).[2] Patent No. 2362266 RU. Published: July 20, 2009 Byul. No. 20. IPC H03K 3/00 (Fig. 1).
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
RU2011129014/08A RU2469470C1 (en) | 2011-07-13 | 2011-07-13 | Paraphase signal generator with control input high active level |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
RU2011129014/08A RU2469470C1 (en) | 2011-07-13 | 2011-07-13 | Paraphase signal generator with control input high active level |
Publications (1)
Publication Number | Publication Date |
---|---|
RU2469470C1 true RU2469470C1 (en) | 2012-12-10 |
Family
ID=49255909
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
RU2011129014/08A RU2469470C1 (en) | 2011-07-13 | 2011-07-13 | Paraphase signal generator with control input high active level |
Country Status (1)
Country | Link |
---|---|
RU (1) | RU2469470C1 (en) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2664013C1 (en) * | 2017-02-21 | 2018-08-14 | Федеральное государственное учреждение "Федеральный исследовательский центр "Информатика и управление" Российской академии наук (ФИЦ ИУ РАН) | Converter of unary signal into paraphase signal with single spacer |
RU2664004C1 (en) * | 2017-02-21 | 2018-08-14 | Федеральное государственное учреждение "Федеральный исследовательский центр "Информатика и управление" Российской академии наук (ФИЦ ИУ РАН) | Converter of unary signal into paraphase signal with zero spacer |
RU2718220C1 (en) * | 2019-12-11 | 2020-03-31 | Федеральное государственное учреждение "Федеральный исследовательский центр "Информатика и управление" Российской академии наук" (ФИЦ ИУ РАН) | Paraphrase signal former with single spacer |
RU2718221C1 (en) * | 2019-12-11 | 2020-03-31 | Федеральное государственное учреждение "Федеральный исследовательский центр "Информатика и управление" Российской академии наук" (ФИЦ ИУ РАН) | Paraphrase signal former with zero spacer |
Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2085027C1 (en) * | 1993-05-17 | 1997-07-20 | Научно-исследовательский и проектно-конструкторский институт средств автоматизации на железнодорожном транспорте | Device for checking phase shift of two sequences of paraphase signals |
EP0999642B1 (en) * | 1998-11-06 | 2003-09-03 | CSEM Centre Suisse d'Electronique et de Microtechnique SA Recherche et Développement | D-type master-slave flip-flop |
US6762637B2 (en) * | 2000-09-04 | 2004-07-13 | Infineon Technologies Ag | Edge-triggered d-flip-flop circuit |
RU2319297C1 (en) * | 2006-08-09 | 2008-03-10 | Институт проблем информатики Российской академии наук (ИПИ РАН) | D-trigger with self-synchronous preset |
RU2362266C1 (en) * | 2007-11-12 | 2009-07-20 | Институт проблем информатики Российской академии наук (ИПИ РАН) | Self-synchronising single-stage d flip-flop with high active level of control signal |
US7564282B2 (en) * | 2004-10-26 | 2009-07-21 | Stmicroelectronics Sa | Bistable flip-flop having retention circuit for storing state in inactive mode |
-
2011
- 2011-07-13 RU RU2011129014/08A patent/RU2469470C1/en active
Patent Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2085027C1 (en) * | 1993-05-17 | 1997-07-20 | Научно-исследовательский и проектно-конструкторский институт средств автоматизации на железнодорожном транспорте | Device for checking phase shift of two sequences of paraphase signals |
EP0999642B1 (en) * | 1998-11-06 | 2003-09-03 | CSEM Centre Suisse d'Electronique et de Microtechnique SA Recherche et Développement | D-type master-slave flip-flop |
US6762637B2 (en) * | 2000-09-04 | 2004-07-13 | Infineon Technologies Ag | Edge-triggered d-flip-flop circuit |
US7564282B2 (en) * | 2004-10-26 | 2009-07-21 | Stmicroelectronics Sa | Bistable flip-flop having retention circuit for storing state in inactive mode |
RU2319297C1 (en) * | 2006-08-09 | 2008-03-10 | Институт проблем информатики Российской академии наук (ИПИ РАН) | D-trigger with self-synchronous preset |
RU2362266C1 (en) * | 2007-11-12 | 2009-07-20 | Институт проблем информатики Российской академии наук (ИПИ РАН) | Self-synchronising single-stage d flip-flop with high active level of control signal |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2664013C1 (en) * | 2017-02-21 | 2018-08-14 | Федеральное государственное учреждение "Федеральный исследовательский центр "Информатика и управление" Российской академии наук (ФИЦ ИУ РАН) | Converter of unary signal into paraphase signal with single spacer |
RU2664004C1 (en) * | 2017-02-21 | 2018-08-14 | Федеральное государственное учреждение "Федеральный исследовательский центр "Информатика и управление" Российской академии наук (ФИЦ ИУ РАН) | Converter of unary signal into paraphase signal with zero spacer |
RU2718220C1 (en) * | 2019-12-11 | 2020-03-31 | Федеральное государственное учреждение "Федеральный исследовательский центр "Информатика и управление" Российской академии наук" (ФИЦ ИУ РАН) | Paraphrase signal former with single spacer |
RU2718221C1 (en) * | 2019-12-11 | 2020-03-31 | Федеральное государственное учреждение "Федеральный исследовательский центр "Информатика и управление" Российской академии наук" (ФИЦ ИУ РАН) | Paraphrase signal former with zero spacer |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US9018995B2 (en) | Integrated clock gating cell for circuits with double edge triggered flip-flops | |
RU2469470C1 (en) | Paraphase signal generator with control input high active level | |
RU2427955C2 (en) | Autosynchronous rs-trigger with increased interference immunity (versions) | |
KR20090131010A (en) | Dual Mode Edge Trigger Flip-Flops | |
EP3197054A1 (en) | Dynamic clock switching method and apparatus as well as computer readable medium | |
US8860468B1 (en) | Clock multiplexer | |
US11558055B2 (en) | Clock-gating synchronization circuit and method of clock-gating synchronization | |
CN101593221B (en) | Method and circuit for preventing different zone clocks from burr during dynamic switching | |
RU2475952C1 (en) | Shaper of paraphase signal with low active level of control input | |
RU2362266C1 (en) | Self-synchronising single-stage d flip-flop with high active level of control signal | |
RU2517295C1 (en) | Pulse selector | |
US20100060321A1 (en) | Clock control of state storage circuitry | |
RU2319297C1 (en) | D-trigger with self-synchronous preset | |
RU2664004C1 (en) | Converter of unary signal into paraphase signal with zero spacer | |
RU2362267C1 (en) | Self-synchronising single-stage d flip-flop with low active level of control signal | |
RU2366080C2 (en) | Self-synchronising two-cycle d flip-flop with low active control signal level | |
RU2365031C1 (en) | Self-synchronous duple d flip-flop with high active level of control signal | |
RU2718220C1 (en) | Paraphrase signal former with single spacer | |
RU2718221C1 (en) | Paraphrase signal former with zero spacer | |
RU2626345C1 (en) | Logical calculator | |
RU2664013C1 (en) | Converter of unary signal into paraphase signal with single spacer | |
CN107592099B (en) | D flip-flop | |
RU2434318C1 (en) | Combined g-trigger with single spacer | |
RU2693321C1 (en) | Self-synchronizing dynamic two-stroke d-flip-flop with zero spacer | |
US20120223756A1 (en) | Method and System for High Speed, Low Power and Small Flip-Flops |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
PD4A | Correction of name of patent owner |