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KR960027792A - 중심국 동기신호를 이용한 버스트 데이타 전송장치 및 그 방법 - Google Patents

중심국 동기신호를 이용한 버스트 데이타 전송장치 및 그 방법 Download PDF

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KR960027792A
KR960027792A KR1019940040408A KR19940040408A KR960027792A KR 960027792 A KR960027792 A KR 960027792A KR 1019940040408 A KR1019940040408 A KR 1019940040408A KR 19940040408 A KR19940040408 A KR 19940040408A KR 960027792 A KR960027792 A KR 960027792A
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Abstract

본 발명은 중심국에서 송신된 FIT 신호를 이용하여 다수개의 단말국들이 상기 신호를 기준으로 삼아 할당받은 슬롯을 이용하여 중심국으로 버스트 데이타를 송신하는 것이며, 위성을 이용한 데이타 송신시 중심국으로부터 슬롯을 할당받아 송신하는 모든 단말국에 적용되는 FIT 동기신호를 이용한 버스트 데이타 전송장치 및 그 방법에 관한 것으로, 기존의 위성을 이용하여 데이타를 송/수신 하는 통신 시스템으로는 초소형 단말 지구국 시스템인 "VSAT" 시스템 등 다수개의 시스템이 있으나, 이들은 데이타 송/수신 시 에러가 발생하면 에러복구 시간이 많이 소요되고, 그 이용분야도 단순한 데이타 전송 기능 정도인 바, 본 발명은 상기와 같은 기능을 더욱 강화시켜 에러발생 빈도 수를 줄이고 만약 에러가 발생하였다 하더라도 그 복구 시간을 단축시킬 수 있는 중앙제어방식인 스타(Star) 방식을 구축하여 중심국으로부터 할당받은 슬롯에 데이타를 전송하는 버스트 데이타 전송 장치 및 방법을 제공하므로써, 중심국으로부터 단말국으로 전송된 데이타 중 동기신호를 간단하게 추출, 이용하여 데이타를 전송하기 때문에 별도의 동기 채널이 필요없게 되어 경제적인 효과를 얻는다.

Description

중심국 동기신호를 이용한 버스트 데이타 전송장치 및 그 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명 버스트 데이타 전송장치 블럭도.

Claims (12)

  1. 단말국에서 중심국으로 버스트 데이타를 전송하는 장치에 있어서, 중심국으로부터 송신된 FIT 신호를 수신하여 분석하는 FIT 검출기(1)와; 상기 FIT 검출기(1 )로부터 분석된 데이타를 입력받아 디코딩 하고, 이어 제어부(3)에서 출력되는 타임 슬롯의 넘버를 저장하는 버스트 프로세서(2)와; 상기 버스트 프레서서(2)에 의해 디코딩된 캐리어 ID 신호의 입력에 따라 단말국의 전체 시스템을 제어하는 제어부(3)와; 중심국과 단말국 시스템 구축시 중심국과 단말국 상호간에 단말국의 캐리어 ID를 셋팅할 때 사용하는 캐리어 ID 스위치(4)와; 전송할 타임 슬롯 번호를 입력받으면 데이타를 전송할 수 있도록 프리앰블 패턴을 발생시키는 프리앰블 패턴발생부(5)와; 중심국으로 전송할 순수 데이타를 출력하고, 동시에 송신요구신호( RTS)를 출력하는 사용자 컴퓨터(6)와; 상기 컴퓨터(6)와 단말국 사이를 접속하는 데이타 접속 장비(Data Interface Equipment : DIE)(7)와; 상기 데이타 접속 장비( 7)를 거쳐 출력된 순수 데이타를 인코딩 하고, 이 인코딩 된 데이타를 상기 버스트 프로세서(2)에서 출력된 송신준비완료(CTS)신호의 입력에 따라 출력하는 데이타 전송부(8) 및 상기 데이타 전송부(8)와 프리앰블 패턴발생기(5)에서 입력되는 프리앰블 데이타 및 사용자 순수 데이타를 출력하는 오아-게이트(9)로 구성되는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송장치.
  2. 제1항에 있어서, 상기 제어부(3)는 버스트 프로세서(2)에서 출력된 캐리어 ID를 저장하는 제1디-플립플롭(3-1)과; 상기 제1디-플립플롭(3-1)에서 출력된 캐리어 ID 신호를 캐리어 ID 스위치(4)에 저장되어 있는 단말국의 ID와 비교하여 동일하면 자신의 ID로 간주하고 다수개의 타임 슬롯에서 중심국으로부터 할당받은 타임 슬롯의 넘버를 출력하는 컨트롤 프로세서(3-2)와; 상기 컨트롤 프로세서(3-2)에서 출력되는 캐리어 ID를 일시적으로 저장하는 버퍼(3-3) 및 상기 컨트롤 프로세서(3-2)에서 출력되는 타임 슬롯 넘버를 입력받아 버스트 프로세서(2)로 출력하는 제2디-플립플롭(3-4)으로 구성되는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송장치.
  3. 제1항에 있어서, 상기 프리앰블 패턴발생부(5)는 128K의 클럭(CLK)을 입력받아 상기 128K 클럭의 매 8번째 카운터 마다 1펄스를 출력하는 8진 카운터(5-1)와; RC회로로 구성되어 상기 128K 클럭을 입력받아 버스트 프로세서(2)로 출력되는 타이머 클럭(S2)의 글리치 펄스를 피하기 위하여 128K 클럭을 200ns로 딜레이시키는 딜레이(5-2)와; 상기 8진 카운터(5-1) 및 딜레이(5-2)로부터 입력되는 두 신호를 앤드시켜 버스트 프로세서(2)로 타이머 클럭(S2)신호를 출력하는 앤드 게이트(5-3)와; 데이타 전송부(8)로부터 출력된 클리어 신호(S1)와 상기 앤드 게이트(5-3)로부터 출력된 타이머 클럭(S2)신호를 입력받아 오아시켜 쉬프트 로드 클럭(S3)신호를 출력하는 오아 게이트(5-4); 128K 클럭 신호와 상기 오아 게이트(5-4)에서 입력되는 쉬프트 로드 클럭(S3)신호를 받아 버스트 전송의 캐리어와 클럭 프리앰블 패턴을 생성하는 8비트 병렬입력-직렬출력 쉬프트 레지스터(5-5) 및 8비트 버스트 프로세서 데이타 버스(B1)를 통해 버스트 프로세서(2)에서 입력되는 데이타 중 프리앰블 데이타를 출력하라는 신호가 입력되면 이를 래치(5-6)를 통해 입력받은 후, 저장되어 있는 프리앰블 데이타를 상기 8비트 병렬입력-직렬출력 쉬프트 레지스터(5-5)로 출력하는 EP 롬(5-7)으로 구성되는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송장치.
  4. 제1항에 있어서, 상기 데이타 전송부(8)는 상기 버스트 프로세서(2)에서 출력되는 송신 준비완료 신호(CTS)와, 뮤트 신호(MUTE)의 출력값에 따라 사용자 순수 데이타를 송신할 수 있도록 8진 카운터를 클리어시키는 클리어 신호(S1)를 출력하는 제1오아 게이트(8-1)와; 상기 제1오아 게이트(5-1)로 입력되는 송신준비완료 신호(CTS)를 동시에 입력받아, 64kbps로 입력되는 사용자 데이타를 1/2 인코딩 하는 1/2 인코더(8-2)로 구성되는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송장치.
  5. 단말국에서 중심국으로 버스트 데이타를 전송하는 방법에 있어서, 중심국으로부터 데이타와 함께 전송되는 동기신호인 에프아이티(FIT)신호를 단말국에서 수신하여 이를 추출한 후, 상기 FIT 신호를 분석하여 캐리어 ID와 타임 슬롯 번호를 얻어낸 다음, 이 할당된 타임 슬롯에 버스트 데이타를 전송하므로써, 상기 FIT 신호를 이용하여 별도의 동기 채널을 사용하지 않고 버스트 데이타를 전송하는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송방법.
  6. 제5항에 있어서, 상기 FIT 신호는 데이타 송신시 동기신호로서 9비트로 구성되는 'F' 신호와, 단말국의 캐리어 ID를 나타내는 신호로서 9비트로 구성되는 'I' 신호와, 중심국으로부터 할당받은 타임 슬롯 번호를 나타내는 신호로서 9트로 구성되는 'T' 신호인, 총 27비트의 1슬롯으로 구성되는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송방법.
  7. 제6항에 있어서, 상기 'I' 신호인 캐리어 ID는 단말국의 고유번호를 나타내는 신호로, 시스템 구축 시 중심국가 단말국 사이에 딥(DIP) 스위치로 미리 셋팅하여 두는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송방법.
  8. 제5항에 있어서, 상기 버스트 데이타는 중심국 복조기에서 단말국으로부터 송신된 버스트 데이타를 수신하여 클럭 및 캐리어를 복원할 수 있도록 하는 프리엠블(preamble) 데이타와 사용자 순수 데이타로 구성되는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송방법.
  9. 제8항에 있어서, 상기 프리앰블 데이타는 그 값이 모두 '0'인 캐리어 신호 27바이트와, 버스트 데이타를 수신한 중심국에서 동기를 맞추기 위해 사용하는 '55H'(HEX) 값으로 주어진 5바이트의 총 32바이트로 구성되는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송방법.
  10. 제5항에 있어서, 프리앰블 데이타를 송신하는 과정은 사용자 컴퓨터(6)으로부터 입력된 순수 데이타가 1/2 인코더(8-2)를 통해 128kbps로 처리되면 이와 동시에 데이타 접속 장비(7)에서는 버스트 프로세서(2)로 송신요구신호(RTS)를 출력하고, 상기 송신요구신호가 입력됨을 인지한 버스트 프로세서(2)는 현재 타임 슬롯을 내부 메모리에서 검색하여 다음 타임 슬롯에서 슬롯을 할당하여 전송을 시작하도록 한 후, 적당한 타임 슬롯의 FIT 데이타(S6)가 검출될 때 뮤트(MUTE)신호를 '로우'값로 출력함과 동시에 송신준비완료(CTS)신호를 출력하여, EP 롬(5-7)에 저장되어 있던 프리앰블 데이타를 송신하는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송방법.
  11. 제10항에 있어서, 상기 프리앰블 데이타 송신과 더불어 출력되는 128kbps 사용자 데이타를 송신하는 과정은 프리앰블 데이타가 송신되는 동안 송신준비완료(CTS)신호는 '로우'값으로 되어 있다가 프리앰블 데이타 송신이 완료되기 2클럭 전부터 '하이'로 되고, 이 신호 값은 오아 게이트(8-1)로 입력되어 8진 카운터(5-1)로 클리어 신호(S1)를 입력토록 하며, 상기 클리어 신호(S1)를 입력받은 8진 카운터(5-1)는 클리어 되면서 '하이'로 유지되고, 이와 동시에 버스트 프로세서(2)의 타이머 클럭은 128K 클럭으로 바뀌어 홀딩되어 있던 128kbps 사용자 데이타를 오아 게이트(9)를 통해 버스트 데이타로 출력하는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송방법.
  12. 제11항에 있어서, 상기 과정을 거쳐 모든 데이타 전송이 완료되면 버스트 프로세서(2)는 리셋신호(RESET)를 '로우'로 만들어 8비트 병렬입력 직렬출력 쉬프트 레지스터(5-5)의 출력을 '로우'로 홀딩하고, 사용자 컴퓨터(6)에서는 송신요구신호 (RTS)를 '하이'로 변환 출력하며, 이에 따라 버스트 프로세서(2)는 38카운트 후에 뮤트신호를 '하이'로 바꾸고, 송신준비완료신호(CTS)를 '로우'로 바꿔 출력하여, 다음 버스트 프리앰블을 위해 8진 카운터(5-1)를 초기화시키는 것을 특징으로 하는 중심국 동기신호를 이용한 버스트 데이타 전송방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940040408A 1994-12-31 1994-12-31 중심국 동기신호를 이용한 버스트 데이타 전송장치 및 그 방법 KR0148408B1 (ko)

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