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KR870011748A - 푸시풀 증폭기 출력단의 각부하 방지회로 - Google Patents

푸시풀 증폭기 출력단의 각부하 방지회로 Download PDF

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KR870011748A
KR870011748A KR870005069A KR870005069A KR870011748A KR 870011748 A KR870011748 A KR 870011748A KR 870005069 A KR870005069 A KR 870005069A KR 870005069 A KR870005069 A KR 870005069A KR 870011748 A KR870011748 A KR 870011748A
Authority
KR
South Korea
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output
push
comparator
pull amplifier
input
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Application number
KR870005069A
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English (en)
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KR900007032B1 (ko
Inventor
쉬미쵸 프리드리히
Original Assignee
톨프-디이터 베르거
도이체 톰손-브란트 게엠베하
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 톨프-디이터 베르거, 도이체 톰손-브란트 게엠베하 filed Critical 톨프-디이터 베르거
Publication of KR870011748A publication Critical patent/KR870011748A/ko
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    • H03—ELECTRONIC CIRCUITRY
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    • H03F3/00—Amplifiers with only discharge tubes or only semiconductor devices as amplifying elements
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    • H—ELECTRICITY
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Abstract

내용 없음

Description

푸시풀 증폭기 출력단의 각부하 방지회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
도면의 상보형 출력트랜지스터를 가진 푸시풀 증폭기 출력단의 구성도이다.

Claims (6)

  1. 출력에는 부하임피던스가 기준전위로 접속되어 있고, 푸시풀 증폭기의 출력단내에 흐르는 출력전류를 검출하기 위해 최소한 하나의 감지소자를 가진, 트랜지스터로된 푸시풀 증폭기의 출력단의 과부하를 방지하기 위한 희로베열에 있어서, 푸시풀 증폭기의 출력단(1,2)의 각분기에 감지소자(4,5)가 각각 설치되어 있고, 이 감지소자에서 기준전위에 대해 특정된 전압이 발생되며, 이 전압은 차동증폭기(10)의 각 입력(+,-)에 각각 접속되어 있고, 차동증폭기의 출력은 비교기(20)의 한입력과 연결되어 있고, 비교기의 다른 입력은 기준전위(Uref)에 놓이며, 비교기(20)에 공급된 입력전압이 기준전위(Uref)를 초과했을 때 비교기(20)의 출력에서 푸시풀 증폭기에 출력단(1,2)을 차단하기 위한 신호가 나오게 되는 것을 특징으로 하는 푸시풀 증폭기 출력단의 과부하 방지회로.
  2. 제1항에 있어서, 차단을 위한 신호가 푸시풀 증폭기 출력단의 입력에 직접 놓이는 것을 특징으로 하는 회로.
  3. 제1항에 있어서, 차단을 위한 신호가 구동단(9)에 공급되는 것을 특징으로 하는 회로.
  4. 제1,2항 또는 3항에 있어서, 푸시풀 증폭기의 출력단이 과부하될 때 비교기(20)의 출력신호가 타임유니트(23,24,27) 및 이 타임유니트에 의해 제어되는 전자스위치(25)를 거쳐 비교기(20)의 기준전압입력을 기준전위로 접속시키는 것을 특징으로 하는 회로.
  5. 제4항에 있어서, 타임유니트는, 비교기(20)의 출력과 전자스위치(25)의 제어전극사이에 직렬 접속된 저항(23) 및 콘덴서(24)와 전자스위치(25)의 제어전극 및 기준전위사이에 접속된 저항(27)로 이루어지는 것을 특징으로 하는 회로.
  6. 제5항에 있어서, 다이오드(26)는 그 캐소드가 비교기(20)의 출력과 연결되도록 저항(23)과 병렬접속되어 있는 것을 특징으로 하는 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019870005069A 1986-05-23 1987-05-22 푸시풀 증폭기 출력단의 과부하 방지회로 KR900007032B1 (ko)

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Application Number Priority Date Filing Date Title
DE3617477 1986-05-23
DE3632077.3 1986-05-23
DEP3632077.3 1986-05-23
DE19863632076 DE3632076A1 (de) 1986-05-23 1986-09-20 Schaltungsanordnung zur automatischen einstellung des ruhestromes in einer gegentaktendstufe

Publications (2)

Publication Number Publication Date
KR870011748A true KR870011748A (ko) 1987-12-26
KR900007032B1 KR900007032B1 (ko) 1990-09-27

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Family Applications (2)

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KR1019870005069A KR900007032B1 (ko) 1986-05-23 1987-05-22 푸시풀 증폭기 출력단의 과부하 방지회로
KR1019870005068A KR900007031B1 (ko) 1986-05-23 1987-05-22 푸시풀 증폭기 출력단에서 폐로전류를 자동으로 조절하기위한 회로

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Application Number Title Priority Date Filing Date
KR1019870005068A KR900007031B1 (ko) 1986-05-23 1987-05-22 푸시풀 증폭기 출력단에서 폐로전류를 자동으로 조절하기위한 회로

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KR (2) KR900007032B1 (ko)
AT (1) ATE67352T1 (ko)
DE (2) DE3632076A1 (ko)
ES (1) ES2025575T3 (ko)

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KR900007031B1 (ko) 1990-09-27
EP0249729B1 (de) 1991-09-11
KR900007032B1 (ko) 1990-09-27
ATE67352T1 (de) 1991-09-15

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