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KR20060082753A - 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법 - Google Patents

플라즈마 디스플레이 패널의 구동 장치 및 구동 방법 Download PDF

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KR20060082753A
KR20060082753A KR1020050003474A KR20050003474A KR20060082753A KR 20060082753 A KR20060082753 A KR 20060082753A KR 1020050003474 A KR1020050003474 A KR 1020050003474A KR 20050003474 A KR20050003474 A KR 20050003474A KR 20060082753 A KR20060082753 A KR 20060082753A
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South Korea
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sustain
power
plasma display
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pulse
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KR1020050003474A
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Inventor
지용석
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엘지전자 주식회사
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Abstract

본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 더욱 상세하게는 플라즈마 디스플레이 패널의 전원 오프(off)시 발생하는 화질 저하와 구동 장치의 소손을 방지할 수 있는 플라즈마 디스플레이 패널의 구동 장치 및 그 방법에 관한 것이다.
본 발명에 따른, 리셋 기간, 어드레스 기간 및 서스테인 기간에 어드레스 전극(X1~Xn)(n은 양의 정수), 스캔 전극 및 서스테인 전극에 소정의 펄스를 인가하는 데이터 구동부, 스캔 구동부 및 서스테인 구동부가 포함되는 플라즈마 디스플레이 패널의 구동 장치에 있어서, 상기 플라즈마 디스플레이 패널의 전원 오프(OFF)시, 상기 전원 오프를 검출하고, 전원 오프 후 상기 스캔 전극과 서스테인 전극에 지속되는 서스테인 펄스를 소거시키는 것을 특징으로 한다.

Description

플라즈마 디스플레이 패널의 구동 장치 및 구동 방법{Driving Device and Method for Plasma Display Panel}
도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 나타낸 도이다.
도 2는 종래의 플라즈마 디스플레이 패널의 구동 장치를 설명하기 위한 도이다.
도 3은 종래 플라즈마 디스플레이 패널의 화상 계조를 구현하는 방법을 나타낸 도이다.
도 4는 종래 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 나타낸 도이다.
도 5는 종래의 플라즈마 디스플레이 패널의 전원 오프 후, 유지되는 구동 펄스를 설명하기 위한 파형도이다.
도 6은 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 전원 오프시 동작 특성을 설명하기 위한 블럭도이다.
도 7은 본 발명의 일실시예에 따른 전원 오프 검출부의 동작 특성을 설명하기 위한 도이다.
도 8은 본 발명의 변형된 실시예에 따른 전원 오프 검출부의 동작 특성을 설명하기 위한 도이다.
도 9는 본 발명의 일실시예에 따른 전원 오프시 서스테인 펄스를 소거시키기 위해 구동부에서 인가되는 서스테인 소거 펄스를 설명하기 위한 파형도이다.
***** 도면의 주요부분에 대한 부호의 설명*****
610; 전원 오프 검출부 620; 제어부
630; 로직 신호부 640; 구동부
710; 포토 커플러
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 더욱 상세하게는 플라즈마 디스플레이 패널의 전원 오프(off)시 발생하는 화질 저하와 구동 장치의 소손을 방지할 수 있는 플라즈마 디스플레이 패널의 구동 장치 및 그 방법에 관한 것이다.
일반적으로 플라즈마 디스플레이 패널은 전면기판과 후면기판 사이에 형성된 격벽이 하나의 단위 셀을 이루는 것으로, 각 셀 내에는 네온(Ne), 헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 같은 주 방전 기체와 소량의 크세논을 함유하는 불활성 가스가 충진되어 있다. 고주파 전압에 의해 방전이 될 때, 불활성 가스는 진공자외선(Vacuum Ultraviolet rays)을 발생하고 격벽 사이에 형성된 형광체를 발광시켜 화상이 구현된다. 이와 같은 플라즈마 디스플레이 패널은 얇고 가벼운 구성 이 가능하므로 차세대 표시장치로서 각광받고 있다.
도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 나타낸 도이다.
도 1에 도시된 바와 같이, 플라즈마 디스플레이 패널은 화상이 디스플레이 되는 표시면인 전면 글라스(101)에 스캔 전극(102)과 서스테인 전극(103)이 쌍을 이뤄 형성된 복수의 유지전극쌍이 배열된 전면기판(100) 및 배면을 이루는 후면 글라스(111) 상에 상술한 복수의 유지전극쌍과 교차되도록 복수의 어드레스 전극(113)이 배열된 후면기판(110)이 일정거리를 사이에 두고 평행하게 결합된다.
전면기판(100)은 하나의 방전셀에서 상호 방전시키고 셀의 발광을 유지하기 위한 스캔 전극(102) 및 서스테인 전극(103), 즉 투명한 ITO 물질로 형성된 투명 전극(a)과 금속재질로 제작된 버스 전극(b)으로 구비된 스캔 전극(102) 및 서스테인 전극(103)이 쌍을 이뤄 포함된다. 스캔 전극(102) 및 서스테인 전극(103)은 방전 전류를 제한하며 전극 쌍 간을 절연시켜주는 하나 이상의 상부 유전체층(104)에 의해 덮혀지고, 상부 유전체층(104) 상면에는 방전 조건을 용이하게 하기 위하여 산화마그네슘(MgO)을 증착한 보호층(105)이 형성된다.
후면기판(110)은 복수개의 방전 공간 즉, 방전셀을 형성시키기 위한 스트라이프 타입(또는 웰 타입)의 격벽(112)이 평행을 유지하여 배열된다. 또한, 어드레스 방전을 수행하여 진공자외선을 발생시키는 다수의 어드레스 전극(113)이 격벽(112)에 대해 평행하게 배치된다. 후면기판(110)의 상측면에는 어드레스 방전시 화상표시를 위한 가시광선을 방출하는 R, G, B 형광체(114)가 도포된다. 어드레스 전극(113)과 형광체(114) 사이에는 어드레스 전극(113)을 보호하기 위한 하부 유전체 층(115)이 형성된다.
이러한 구조의 플라즈마 디스플레이 패널은 방전셀이 매트릭스(Matrix) 구조로 복수개가 형성되고, 방전셀에 소정의 펄스를 공급하기 위한 구동회로를 포함하는 구동모듈이 부착되어 구동장치를 이룬다. 이와 같은 플라즈마 디스플레이 패널과 구동모듈의 결합관계를 살펴보면 도 2와 같다.
도 2는 종래의 플라즈마 디스플레이 패널의 구동 장치를 설명하기 위한 도이다. 도 2에 도시된 바와 같이, 종래의 플라즈마 디스플레이 패널의 구동 장치는 방전셀이 매트릭스(Matrix) 구조로 복수개가 형성된 플라즈마 디스플레이 패널에 부착되어 상술한 방전셀에 소정의 펄스를 공급한다.
이때, 플라즈마 디스플레이 패널의 구동장치는 도 2와 같이, 데이터 정렬부(200), 타이밍 콘트롤러(201), 데이터 구동부(202), 스캔 구동부(203) 및 서스테인 구동부(204)를 포함하여 구성된다.
이러한 종래의 구동장치의 데이터 정렬부(200)는 외부로부터 입력되는 영상 데이터를 정렬하여 각각의 어드레스 전극(X1~Xm)에 인가되도록 하고, 이렇게 정렬된 데이터는 데이터 구동부(202)를 통해 플라즈마 디스플레이 패널(205)의 어드레스 전극(X1~Xm)으로 인가된다.
또한, 타이밍 콘트롤러(201)의 제어에 따라 스캔 구동부(203)가 스캔 신호와 서스테인 신호를 각각의 스캔 전극(Y1~Yn)으로 인가하고, 서스테인 구동부(204)는 서스테인 신호를 각각의 서스테인 전극(Z)으로 인가한다. 이러한 과정을 통해 플라즈마 디스플레이 패널(205)이 구동된다. 이와 같은 플라즈마 디스플레이 패널에서 화상 계조를 구현하는 방법은 다음 도 3과 같다.
도 3은 종래 플라즈마 디스플레이 패널의 화상 계조를 구현하는 방법을 나타낸 도이다.
도 3에 도시된 바와 같이, 종래 플라즈마 디스플레이 패널의 화상 계조(Gray Level) 표현 방법은 한 프레임을 발광횟수가 다른 여러 서브필드로 나누고, 각 서브필드는 다시 모든 셀들을 초기화시키기 위한 리셋 기간(RPD), 방전될 셀을 선택하기 위한 어드레스 기간(APD) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(SPD)으로 나뉘어진다.
예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 도 3과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어지게 된다.
각 서브필드의 리셋 기간 및 어드레스 기간은 각 서브필드마다 동일하다. 방전될 셀을 선택하기 위한 어드레스방전은 어드레스 전극과 스캔 전극인 투명전극 사이의 전압차에 의해 일어난다. 서스테인 기간은 각 서브필드에서 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가된다.
이와 같이 각 서브필드에서 서스테인 기간이 달라지게 되므로 각 서브필드의 서스테인 기간 즉, 서스테인 방전 횟수를 조절하여 화상의 계조를 표현하게 된다. 이러한 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 살펴보면 다음 도 4와 같다.
도 4는 종래 플라즈마 디스플레이 패널의 구동 방법에 따른 구동파형을 나타낸 도이다.
도 4에 도시된 바와 같이, 플라즈마 디스플레이 패널은 모든 셀들을 초기화시키기 위한 리셋 기간, 방전할 셀을 선택하기 위한 어드레스 기간, 선택된 셀의 방전을 유지시키기 위한 서스테인 기간 및 방전된 셀 내의 벽전하를 소거하기 위한 소거 기간으로 나뉘어 구동된다.
리셋 기간은 셋업 기간과 셋다운 기간으로 구분된다.
셋업 기간에는 모든 스캔 전극들에 상승 램프파형(Ramp-up)이 동시에 인가된다. 이 상승 램프파형에 의해 전화면의 방전셀들 내에는 약한 암방전(Dark Discharge)이 일어난다. 이 셋업 방전에 의해 어드레스 전극과 서스테인 전극 상에는 정극성 벽전하가 쌓이게 되며, 스캔 전극 상에는 부극성의 벽전하가 쌓이게 된다.
셋다운 기간에는 상승 램프파형이 공급된 후, 상승 램프파형의 피크전압보다 낮은 정극성 전압에서 떨어지기 시작하여 그라운드(GND)레벨 전압 이하의 특정 전압레벨까지 떨어지는 하강 램프파형(Ramp-down)이 셀들 내에 미약한 소거방전을 일으킴으로써 스캔 전극에 과도하게 형성된 벽 전하를 충분히 소거시키게 된다. 이 셋다운 방전에 의해 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 셀들 내에 균일하게 잔류된다.
어드레스 기간에는 부극성 스캔 펄스(-Vy)가 스캔 전극들에 순차적으로 인가 됨과 동시에 스캔 펄스에 동기되어 어드레스 전극에 정극성 전압(Va)의 어드레스 펄스가 인가된다. 이 스캔 펄스와 어드레스 펄스의 전압 차와 리셋 기간에 생성된 벽 전압이 더해지면서 어드레스 펄스가 인가되는 방전셀 내에는 어드레스 방전이 발생된다. 어드레스 방전에 의해 선택된 셀들 내에는 서스테인 전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. 서스테인 전극에는 셋다운 기간과 어드레스 기간 동안에 스캔 전극과의 전압차를 줄여 스캔 전극과의 오방전이 일어나지 않도록 정극성 전압(Vz)이 공급된다.
서스테인 기간에는 스캔 전극과 서스테인 전극들에 교번적으로 서스테인 펄스(Sus)가 인가된다. 어드레스 방전에 의해 선택된 셀은 셀 내의 벽 전압과 서스테인 펄스가 더해지면서 매 서스테인 펄스가 인가될 때 마다 스캔 전극과 서스테인 전극 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다.
서스테인 방전이 완료된 후, 소거 기간에서는 펄스폭과 전압레벨이 작은 소거 램프파형(Ramp-ers)의 전압이 서스테인 전극에 공급되어 전화면의 셀들 내에 잔류하는 벽 전하를 소거시키게 된다.
한편, 종래의 플라즈마 디스플레이 패널은 구동 중 전원 오프(off)시, 다음 도 5와 같이, 오프 후, 유지되는 구동 펄스가 인가된다.
도 5는 종래의 플라즈마 디스플레이 패널의 전원 오프 후, 유지되는 구동 펄스를 설명하기 위한 파형도이다. 도 5에 도시된 바와 같이, 스캔 전극에 인가되는 구동 펄스는 AC 전원 오프 후에도 불안정하게 지속적으로 인가된다. 여기서, 도 5에는 스캔 전극에 인가되는 구동 펄스만을 도시하였으나, 서스테인 전극 및 어드레 스 전극에 인가되는 구동 펄스 또한 불안정하게 지속적으로 인가된다.
이러한, 불안정적인 영역, 특히 전원 오프 후 유지되는 서스테인 펄스 및 잔류 벽전하는 전원 오프시 화질의 과도 상태를 유발하는 문제점이 있다.
즉, 충분한 서스테인 전압(Vs)을 공급받지 못한 상태에서 로직 신호의 출력으로 인하여 화질 품위가 저하되는 문제점이 있다.
또한, 전원 온(on)시 구동 회로를 오작동시켜 구동 장치 및 전원 회로를 소손시키는 문제점이 있다.
본 발명은 상기와 같은 문제점들을 해결하기 위한 것으로, 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법을 개선하여, 전원 오프시 화질의 과도 상태를 방지할 수 있는 플라즈마 디스플레이 패널의 구동 장치 및 그 방법을 제공하는데 그 목적이 있다.
또한, 본 발명의 다른 목적은 전원 오프시 구동 회로의 소손을 방지할 수 있는 플라즈마 디스플레이 패널의 구동 장치 및 그 방법을 제공하는데 그 목적이 있다.
또한, 본 발명의 또 다른 목적은 안정적인 플라즈마 디스플레이 패널의 구동 파형 출력으로 플라즈마 디스플레이 패널의 안정화를 구현하는 것이다.
상기의 목적을 달성하기 위하여, 본 발명의 리셋 기간, 어드레스 기간 및 서 스테인 기간에 어드레스 전극(X1~Xn)(n은 양의 정수), 스캔 전극 및 서스테인 전극에 소정의 펄스를 인가하는 데이터 구동부, 스캔 구동부 및 서스테인 구동부가 포함되는 플라즈마 디스플레이 패널의 구동 장치에 있어서, 상기 플라즈마 디스플레이 패널의 전원 오프(OFF)시, 상기 전원 오프를 검출하고, 전원 오프 후 상기 스캔 전극과 서스테인 전극에 지속되는 서스테인 펄스를 소거시키는 것을 특징으로 한다.
본 발명은 플라즈마 디스플레이 패널의 전원 오프를 검출하는 전원 오프 검출부; 상기 전원 오프 검출부에서 인가되는 검출 신호에 따라 전원 오프를 판단하고, 플라즈마 디스플레이 패널에 인가되는 로직 신호를 제어하는 제어부; 상기 제어부에서 인가되는 제어 신호에 따라 출력되는 로직 신호를 차단하는 로직 신호부; 및 상기 로직 신호부의 차단된 로직 신호에 따라 서스테인 펄스를 소거시키는 서스테인 소거 펄스를 인가하는 구동부를 포함하는 것을 특징으로 한다.
본 발명의 전원 오프시 외부에서 인가되는 교류 전압으로 전원 오프를 검출하는 것을 특징으로 한다.
본 발명의 교류 전압은 포토 커플러(Photo Coupler)를 이용하여 검출하는 것을 특징으로 한다.
본 발명의 전원 오프시 직류 전압으로 인가되는 서스테인 전압으로 전원 오프를 검출하는 것을 특징으로 한다.
본 발명의 서스테인 전압은 ADC(Analog to Digital Converter)를 이용하여 검출하는 것을 특징으로 한다.
본 발명의 전원 오프시 40 ms 내로 전원 오프를 검출하는 것을 특징으로 한다.
본 발명의 전원 오프 검출 후 서스테인 펄스를 소거시키는 서스테인 소거 펄스의 인가는 150 ms 내로 이루어지는 것을 특징으로 한다.
본 발명의 서스테인 펄스를 소거시키는 서스테인 소거 펄스는 상기 스캔 전극에 지속적으로 인가되는 소정의 부극성 전압 레벨을 갖는 것을 특징으로 한다.
본 발명의 소정의 부극성 전압 레벨은 상기 어드레스 기간에 상기 스캔 전극에 인가되는 스캔 전압(-Vy) 레벨과 동일한 것을 특징으로 한다.
본 발명의 리셋 기간, 어드레스 기간 및 서스테인 기간에 어드레스 전극(X1~Xn)(n은 양의 정수), 스캔 전극 및 서스테인 전극에 리셋 펄스, 어드레스 펄스 및 서스테인 펄스를 인가하는 플라즈마 디스플레이 패널의 구동 방법에 있어서, 상기 플라즈마 디스플레이 패널의 전원 오프(OFF)시, 상기 전원 오프를 검출하고, 전원 오프 후 상기 스캔 전극과 서스테인 전극에 지속되는 서스테인 펄스를 소거시키는 것을 특징으로 한다.
본 발명은 플라즈마 디스플레이 패널의 전원 오프를 검출하는 전원 오프 검출 단계; 상기 전원 오프 검출 단계에서 인가되는 검출 신호에 따라 전원 오프를 판단하고, 플라즈마 디스플레이 패널에 인가되는 로직 신호를 제어하는 제어 단계; 상기 제어 단계에서 인가되는 제어 신호에 따라 출력되는 로직 신호를 차단하는 로 직 신호 차단 단계; 및 상기 로직 신호 차단 단계의 차단된 로직 신호에 따라 서스테인 펄스를 소거시키는 서스테인 소거 펄스를 인가하는 스캔 구동 단계를 포함하는 것을 특징으로 한다.
본 발명의 특징에 따르면, 플라즈마 디스플레이 패널의 전원 오프시 AC 전압 또는 서스테인 전압을 검출하여 전원 오프를 판단한다. 이때, 부극성의 전압을 스캔 전극에 인가하여, 불안정적으로 인가되는 구동 펄스를 소거하도록 한다. 이로써, 전원 오프시 발생하는 화질 저하와 전원 온시 구동 회로의 소손을 방지할 수 있다.
이하에서는 본 발명에 따른 구체적인 실시예를 첨부된 도면을 참조하여 설명한다.
도 6은 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 전원 오프시 동작 특성을 설명하기 위한 블럭도이다. 도 6에 도시된 바와 같이, 본 발명의 일실시예에서는 플라즈마 디스플레이 패널의 전원 오프(OFF)시, 전원 오프를 검출하고, 전원 오프 후 스캔 전극과 서스테인 전극에 지속되는 서스테인 펄스를 소거시키도록 한다.
이와 같은 본 발명의 플라즈마 디스플레이 패널의 구동 장치를 구현하기 위해, 본 발명의 일실시예에 따른 플라즈마 디스플레이 패널의 구동 장치는 전원 오프 검출부(610), 제어부(620), 로직 신호부(630) 및 구동부(640)을 포함한다.
전원 오프 검출부(610)는 플라즈마 디스플레이 패널의 전원 오프시, 이를 검출한다.
이때, 전원 오프 검출부는 외부에서 인가되는 교류(AC) 전압 또는 직류 전압으로 인가되는 서스테인 전압으로 전원 오프를 검출할 수 있다. 이에 관한 보다 상세한 설명은 이후에 기술하기로 한다.
제어부(620)는 전원 오프 검출부(610)에서 인가되는 검출 신호에 따라 전원 오프를 판단하고, 플라즈마 디스플레이 패널에 인가되는 로직 신호를 제어한다.
로직 신호부(630)는 제어부에서 인가되는 제어 신호에 따라 출력되는 로직 신호를 차단한다.
구동부(640)는 상기 로직 신호부(630)의 차단된 로직 신호에 따라 서스테인 펄스를 소거시키는 서스테인 소거 펄스를 인가한다. 서스테인 소거 펄스는 소정의 부극성 전압 레벨을 가지며, 지속적으로 인가되어 서스테인 펄스를 소거시켜 잔류 벽전하를 제거한다. 즉, 서스테인 전압을 영전위(0V)로 만들고, 벽전하를 제거하여 플라즈마 디스플레이 패널의 시스템을 안정화시켜, 오프시킨다.
도 7a 및 도 7b는 본 발명의 일실시예에 따른 전원 오프 검출부의 동작 특성을 설명하기 위한 도이다. 도 7a는 전원 오프시 각각의 전압의 변화를 나타낸 것이고, 도 7b는 본 발명의 일실시예에 따른, 교류 전압을 검출하는 포토 커플러를 나타낸 것이다.
도 7a에 도시된 바와 같이, 플라즈마 디스플레이 패널의 전원 오프시 교류 전압은 즉시 오프되지만, 서스테인 전압, 대기 전압 및 구동 출력 전압을 제어하는 로직 신호(5V)는 계속적으로 인가된다.
따라서, 본 발명의 일실시예에서는 도 7b에 도시된 바와 같이, 외부에서 인 가되는 교류 전압으로 전원 오프를 검출한다. 이때, 교류 전압은 포토 커플러(Photo Coupler; 710)를 이용하여 검출할 수 있다.
또한, 본 발명의 변형된 실시예에서는 다음 도 8과 같이, 서스테인 전압의 변화를 검출하여 전원 오프를 검출한다.
도 8a 및 도 8b는 본 발명의 변형된 실시예에 따른 전원 오프 검출부의 동작 특성을 설명하기 위한 도이다. 도 8a는 전원 오프시 서스테인 펄스의 변화를 나타낸 것이고, 도 8b는 본 발명의 변형된 실시예에 따른, 서스테인 전압을 검출하는 ADC(Analog to Digital Converter)를 나타낸 것이다.
도 8a에서, (a)는 정상적인 서스테인 펄스가 하강할 때를 나타낸 것이다. 정상적이 서스테인 펄스의 하강은 도시된 것과 같이, 완만하게 하강한다.
반면, (b)의 서스테인 펄스는 플라즈마 디스플레이 패널의 전원 오프시, 인가되는 교류 전압이 차단됨에 따라, 순간적으로 하강하는 부분을 포함하는 파형을 그린다.
이때, 도 8b와 같이, 서스테인 전압 공급단과 그라운드단에 저항을 구비하여, 서스테인 전압을 3.1V 정도의 전압으로 낮춘 후, 순간적으로 변화된 전압에 따라 ADC를 이용하여 검출할 수 있다. ADC는 10ms 또는 그 이하의 시간 단위로 서스테인 전압의 변화를 체크한다.
이와 같이, 본 발명에서 교류 전압 또는 서스테인 전압 중 어느 하나의 전압으로 전원 오프를 검출할 때, 전원 오프시 40 ms 내로 전원 오프를 검출하는 것이 바람직하다.
도 9는 본 발명의 일실시예에 따른 전원 오프시 서스테인 펄스를 소거시키기 위해 구동부에서 인가되는 서스테인 소거 펄스를 설명하기 위한 파형도이다.
(a)는 서스테인 기간 중, 전원 오프가 발생하여 이를 검출한 후 인가되는 서스테인 펄스를 나타낸 것이고, (b)는 리셋 기간 또는 어드레스 기간 중, 전원 오프가 발생하여 이를 검출한 후 인가되는 서스테인 펄스를 나타낸 것이다.
(a)에 도시된 바와 같이, 서스테인 기간 중 전원 오프가 발생할 때, 스캔 전극에서는 서스테인 펄스에서 점진적으로 감소하여 소정의 부극성의 전압 레벨을 갔는 전압을 지속적으로 인가한다. 이때, 소정의 부극성의 전압 레벨은 어드레스 기간에 스캔 전극에 인가되는 스캔 전압(-Vy) 레벨과 같게 인가하여, 회로 구성을 간단히 할 수 있다. 이로써, 서스테인 전압을 영전위(0V)로 만들고, 잔류 벽전하를 소거할 수 있다.
(b)에 도시된 바와 같이, 리셋 기간 또는 어드레스 기간 중 전원 오프가 발생할 때, 스캔 전극에서는 인가되는 소정의 부극성의 전압, 즉 스캔 전압(-Vy)을 지소적으로 인가한다. 이로써, 서스테인 전압을 영전위(0V)로 만들고, 잔류 벽전하를 소거할 수 있다.
본 발명의 일실예에서는 전원 오프 검출 후 서스테인 펄스를 소거시키는 서스테인 소거 펄스의 인가는 플라즈마 디스플레이 패널의 구동시 에너지를 공급하고 회수하는 에너지 회수 회로의 에너지 저장부(미도시)에 저장된 에너지가 감쇄하여 소멸하기 전에 이루어지도록 한다. 바람직하게는, 150 ms 내로 이루어지도록 한다.
본 발명의 플라즈마 디스플레이 패널의 구동 방법과 방법에 따른 각각의 단 계 및 특성들은 상술한 플라즈마 디스플레이 패널의 구동 장치의 동작 특성 및 파형도를 통해 충분히 설명하였으므로 생략하기로 한다.
이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
이상에서와 같이 본 발명은 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법을 개선함으로써, 전원 오프시 화질의 과도 상태를 방지할 수 있는 효과가 있다.
또한, 본 발명은 전원 오프시 구동 회로의 소손을 방지할 수 있는 효과가 있다.
또한, 본 발명은 안정적인 플라즈마 디스플레이 패널의 구동 파형 출력으로 플라즈마 디스플레이 패널의 안정화를 구현할 수 있다.

Claims (18)

  1. 리셋 기간, 어드레스 기간 및 서스테인 기간에 어드레스 전극(X1~Xn)(n은 양의 정수), 스캔 전극 및 서스테인 전극에 소정의 펄스를 인가하는 데이터 구동부, 스캔 구동부 및 서스테인 구동부가 포함되는 플라즈마 디스플레이 패널의 구동 장치에 있어서,
    상기 플라즈마 디스플레이 패널의 전원 오프(OFF)시, 상기 전원 오프를 검출하고, 전원 오프 후 상기 스캔 전극과 서스테인 전극에 지속되는 서스테인 펄스를 소거시키는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  2. 제1항에 있어서,
    상기 플라즈마 디스플레이 패널의 전원 오프를 검출하는 전원 오프 검출부;
    상기 전원 오프 검출부에서 인가되는 검출 신호에 따라 전원 오프를 판단하고, 플라즈마 디스플레이 패널에 인가되는 로직 신호를 제어하는 제어부;
    상기 제어부에서 인가되는 제어 신호에 따라 출력되는 로직 신호를 차단하는 로직 신호부; 및
    상기 로직 신호부의 차단된 로직 신호에 따라 서스테인 펄스를 소거시키는 서스테인 소거 펄스를 인가하는 구동부를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  3. 제1항 또는 제2항 중 어느 한 항에 있어서,
    상기 전원 오프시 외부에서 인가되는 교류 전압으로 전원 오프를 검출하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  4. 제3항에 있어서,
    상기 교류 전압은 포토 커플러(Photo Coupler)를 이용하여 검출하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  5. 제1항 또는 제2항 중 어느 한 항에 있어서,
    상기 전원 오프시 직류 전압으로 인가되는 서스테인 전압으로 전원 오프를 검출하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  6. 제5항에 있어서,
    상기 서스테인 전압은 ADC(Analog to Digital Converter)를 이용하여 검출하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  7. 제1항 또는 제2항 중 어느 한 항에 있어서,
    상기 전원 오프시 40 ms 내로 전원 오프를 검출하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  8. 제1항 또는 제2항 중 어느 한 항에 있어서,
    상기 전원 오프 검출 후 서스테인 펄스를 소거시키는 서스테인 소거 펄스의 인가는 150 ms 내로 이루어지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  9. 제1항 또는 제2항 중 어느 한 항에 있어서,
    상기 서스테인 펄스를 소거시키는 서스테인 소거 펄스는
    상기 스캔 전극에 지속적으로 인가되는 소정의 부극성 전압 레벨을 갖는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  10. 제9항에 있어서,
    상기 소정의 부극성 전압 레벨은 상기 어드레스 기간에 상기 스캔 전극에 인가되는 스캔 전압(-Vy) 레벨과 동일한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  11. 리셋 기간, 어드레스 기간 및 서스테인 기간에 어드레스 전극(X1~Xn)(n은 양의 정수), 스캔 전극 및 서스테인 전극에 리셋 펄스, 어드레스 펄스 및 서스테인 펄스를 인가하는 플라즈마 디스플레이 패널의 구동 방법에 있어서,
    상기 플라즈마 디스플레이 패널의 전원 오프(OFF)시, 상기 전원 오프를 검출하고, 전원 오프 후 상기 스캔 전극과 서스테인 전극에 지속되는 서스테인 펄스를 소거시키는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  12. 제11항에 있어서,
    상기 플라즈마 디스플레이 패널의 전원 오프를 검출하는 전원 오프 검출 단계;
    상기 전원 오프 검출 단계에서 인가되는 검출 신호에 따라 전원 오프를 판단하고, 플라즈마 디스플레이 패널에 인가되는 로직 신호를 제어하는 제어 단계;
    상기 제어 단계에서 인가되는 제어 신호에 따라 출력되는 로직 신호를 차단하는 로직 신호 차단 단계; 및
    상기 로직 신호 차단 단계의 차단된 로직 신호에 따라 서스테인 펄스를 소거시키는 서스테인 소거 펄스를 인가하는 스캔 구동 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  13. 제11항 또는 제12항 중 어느 한 항에 있어서,
    상기 전원 오프시 외부에서 인가되는 교류 전압으로 전원 오프를 검출하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  14. 제11항 또는 제12항 중 어느 한 항에 있어서,
    상기 전원 오프시 직류 전압으로 인가되는 서스테인 전압으로 전원 오프를 검출하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  15. 제11항 또는 제12항 중 어느 한 항에 있어서,
    상기 전원 오프시 40 ms 내로 전원 오프를 검출하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  16. 제11항 또는 제12항 중 어느 한 항에 있어서,
    상기 전원 오프 검출 후 서스테인 펄스를 소거시키는 서스테인 소거 펄스의 인가는 150 ms 내로 이루어지는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  17. 제11항 또는 제12항 중 어느 한 항에 있어서,
    상기 서스테인 펄스를 소거시키는 서스테인 소거 펄스는
    상기 스캔 전극에 지속적으로 인가되는 소정의 부극성 전압 레벨을 갖는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  18. 제17항에 있어서,
    상기 소정의 부극성 전압 레벨은 상기 어드레스 기간에 상기 스캔 전극에 인가되는 스캔 전압(-Vy) 레벨과 동일한 것을 특징으로 하는 플라즈마 디스플레이 패 널의 구동 방법.
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