KR101987688B1 - 어레이 기판의 제조방법 - Google Patents
어레이 기판의 제조방법 Download PDFInfo
- Publication number
- KR101987688B1 KR101987688B1 KR1020110133760A KR20110133760A KR101987688B1 KR 101987688 B1 KR101987688 B1 KR 101987688B1 KR 1020110133760 A KR1020110133760 A KR 1020110133760A KR 20110133760 A KR20110133760 A KR 20110133760A KR 101987688 B1 KR101987688 B1 KR 101987688B1
- Authority
- KR
- South Korea
- Prior art keywords
- electrode
- mixed gas
- oxygen
- nitrogen trifluoride
- dry etching
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Active
Links
Images
Classifications
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D86/00—Integrated devices formed in or on insulating or conducting substrates, e.g. formed in silicon-on-insulator [SOI] substrates or on stainless steel or glass substrates
- H10D86/40—Integrated devices formed in or on insulating or conducting substrates, e.g. formed in silicon-on-insulator [SOI] substrates or on stainless steel or glass substrates characterised by multiple TFTs
- H10D86/451—Integrated devices formed in or on insulating or conducting substrates, e.g. formed in silicon-on-insulator [SOI] substrates or on stainless steel or glass substrates characterised by multiple TFTs characterised by the compositions or shapes of the interlayer dielectrics
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76801—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing
- H01L21/76802—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the dielectrics, e.g. smoothing by forming openings in dielectrics
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D30/00—Field-effect transistors [FET]
- H10D30/01—Manufacture or treatment
- H10D30/021—Manufacture or treatment of FETs having insulated gates [IGFET]
- H10D30/031—Manufacture or treatment of FETs having insulated gates [IGFET] of thin-film transistors [TFT]
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D86/00—Integrated devices formed in or on insulating or conducting substrates, e.g. formed in silicon-on-insulator [SOI] substrates or on stainless steel or glass substrates
- H10D86/01—Manufacture or treatment
- H10D86/021—Manufacture or treatment of multiple TFTs
- H10D86/0231—Manufacture or treatment of multiple TFTs using masks, e.g. half-tone masks
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
- H10D86/00—Integrated devices formed in or on insulating or conducting substrates, e.g. formed in silicon-on-insulator [SOI] substrates or on stainless steel or glass substrates
- H10D86/40—Integrated devices formed in or on insulating or conducting substrates, e.g. formed in silicon-on-insulator [SOI] substrates or on stainless steel or glass substrates characterised by multiple TFTs
- H10D86/60—Integrated devices formed in or on insulating or conducting substrates, e.g. formed in silicon-on-insulator [SOI] substrates or on stainless steel or glass substrates characterised by multiple TFTs wherein the TFTs are in active matrices
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02C—CAPTURE, STORAGE, SEQUESTRATION OR DISPOSAL OF GREENHOUSE GASES [GHG]
- Y02C20/00—Capture or disposal of greenhouse gases
- Y02C20/30—Capture or disposal of greenhouse gases of perfluorocarbons [PFC], hydrofluorocarbons [HFC] or sulfur hexafluoride [SF6]
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Thin Film Transistor (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Liquid Crystal (AREA)
- Drying Of Semiconductors (AREA)
Abstract
Description
도 2a 내지 2o는 본 발명의 제 1 실시예에 따른 어레이 기판의 하나의 화소영역에 대한 제조 단계별 공정 단면도.
도 3은 본 발명의 제 2 실시예에 따른 어레이 기판의 제조 단계에 있어 보호층 내에 콘택홀을 형성하는 단계를 도시한 도면.
도 4는 도 3의 A영역을 확대 도시한 도면.
도 5는 본 발명의 제 3 실시예에 따른 어레이 기판의 제조 단계에 있어 보호층 내에 콘택홀을 형성하는 단계를 도시한 도면.
구분 | 식각전 보호층 두께 | 식각 후 남아있는 보호층 두께 | 식각량 | 식각시간 | 단위시간당 식각율 |
실시예 | 5710Å | 없음 | 5710Å | 115초 | 49Å/초 |
비교예1 | 5530Å | 3730Å | 1800Å | 95초 | 19Å/초 |
비교예2 | 5670Å | 2860Å | 2810Å | 105초 | 27Å/초 |
105 : 게이트 전극
109 : 게이트 절연막
120 : 반도체층
122 : 액티브층
124 : 오믹콘택층
125 : 더미패턴
130 : 데이터 배선
135 : 소스 전극
137 : 드레인 전극
150 : 보호층
155 : 드레인 콘택홀
193 : 제 3 포토레지스트 패턴
195 : 챔버
P : 화소영역
Tr : 박막트랜지스터
TrA : 스위칭 영역
Claims (17)
- 화소영역이 정의된 기판 상에 배선 또는 전극을 형성하는 단계와;
상기 배선 또는 전극 위로 전면에 질화실리콘(SiNx)으로 이루어진 보호층을 형성하는 단계와;
상기 보호층 위로 포토레지스트 패턴을 형성하는 단계와;
상기 포토레지스트 패턴이 형성된 기판을 건식식각 장치의 챔버내에 위치시키고, 헬륨(He)과 삼불화질소(NF3) 및 산소(O2)를 포함하는 제 1 혼합가스를 이용하여 상기 포토레지스트 패턴 사이로 노출된 상기 보호층을 제1시간 동안 1차 건식식각하는 단계와;
삼불화질소(NF3)와 산소(O2)를 포함하는 제 2 혼합가스에 의해 1차 건식식각된 보호층을 제 2 시간 동안 2차 건식식각하여 상기 배선 또는 전극을 노출시키는 콘택홀을 형성하는 단계를 포함하는 어레이 기판의 제조 방법.
- 삭제
- 제 1 항에 있어서,
상기 배선 또는 전극은 단일층의 구리 또는 구리합금으로 이루어지거나, 또는 다중층 구조를 이루며 그 최상층이 구리 또는 구리합금으로 이루어진 것이 특징인 어레이 기판의 제조 방법.
- 제 3 항에 있어서,
상기 제 1 혼합가스의 헬륨(He):삼불화질소(NF3):산소(O2)의 단위시간당 유입량 비는 1:1.15:2.875 내지 1:1.2:3.6인 것이 특징인 어레이 기판의 제조 방법.
- 제 1 항에 있어서,
상기 제 1 혼합가스의 헬륨(He):삼불화질소(NF3):산소(O2)의 단위시간당 유입량 비는 1:1.15:3.6 내지 1:1.2:4.5인 것이 특징인 어레이 기판의 제조 방법.
- 제 4 항 또는 제 5 항에 있어서,
상기 헬륨(He)의 단위 시간당 유입량은 145sccm 내지 155sccm인 것이 특징인 어레이 기판의 제조 방법.
- 제 1 항에 있어서,
상기 2차 건식식각된 보호층에 상기 제 1 혼합가스에 의해 제 3 시간 동안 3차 건식식각하는 단계를 더 포함하는 어레이 기판의 제조 방법.
- 제 7 항에 있어서,
상기 제 1 시간과 제 3 시간은 상기 제 2 시간의 2배 내지 3배가 되며, 상기 제 2 시간은 15초 내지 20초 인 것이 특징인 어레이 기판의 제조 방법.
- 제 7 항에 있어서,
상기 2차 건식식각 진행 시 상기 챔버 내부로 유입되는 상기 제 2 혼합가스에 있어, 상기 삼불화질소(NF3)의 유입량을 1이라 할 때, 상기 산소(O2)의 유입량은 10 내지 11인 것이 특징인 어레이 기판의 제조 방법.
- 제 9 항에 있어서,
상기 산소(O2)의 챔버 내부로 유입되는 유입량은 상기 1차 건식식각 시의 산소(O2)의 유입량과 동일하며, 상기 삼불화질소(NF3)의 유입량은 47sccm 내지 59sccm 인 것이 특징인 어레이 기판의 제조 방법.
- 제 4 항 또는 제 5 항에 있어서,
상기 콘택홀의 내측면은 상기 배선 또는 전극의 표면에 대해 테이퍼 구조를 이루며, 상기 내측면과 상기 배선 또는 상기 전극 표면이 이루는 각도는 45도 내지 75인 것이 특징인 어레이 기판의 제조 방법.
- 제 1 항에 있어서,
상기 제 1 혼합가스는 육불화황(SF6)을 포함하여 제 1 혼합가스가 삼불화질소(NF3)와 육불화황(SF6)의 혼합가스, 산소(O2), 헬륨(He)으로 이루어진 것이 특징인 어레이 기판의 제조 방법.
- 제 12 항에 있어서,
상기 제 1 혼합가스의 헬륨(He): 삼불화질소(NF3)와 육불화황(SF6)의 혼합가스:산소(O2)의 단위시간당 유입량 비는 1:1.15:3.6 내지 1:1.2:4.5이며, 상기 삼불화질소(NF3) 대 육불화황(SF6)의 유입량 비는 0.95:1 내지 1:0.95 인 것이 특징인 어레이 기판의 제조 방법.
- 제 1 항에 있어서,
화소영역이 정의된 기판 상에 배선 또는 전극을 형성하는 단계는,
상기 기판 상에 제 1 금속물질을 증착하고 패터닝하여 일방향으로 연장하는 게이트 배선과 상기 화소영역에 게이트 전극을 형성하는 단계와;
상기 게이트 배선과 게이트 전극 상부에 게이트 절연막을 형성하는 단계와;
상기 게이트 절연막 위로 상기 게이트 배선과 교차하여 상기 화소영역을 정의하는 데이터 배선을 형성하고, 동시에 상기 게이트 전극에 대응하여 반도체층과 상기 반도체층 상부에서 서로 이격하는 소스 전극 및 드레인 전극을 형성하는 단계를 포함하는 어레이 기판의 제조 방법.
- 제 14 항에 있어서,
상기 콘택홀은 상기 드레인 전극을 노출시키는 드레인 콘택홀이며, 상기 보호층 위로 각 화소영역에 상기 드레인 콘택홀을 통해 상기 드레인 전극과 접촉하는 화소전극을 형성하는 단계를 포함하는 어레이 기판의 제조 방법. - 제4항 또는 제5항에 있어서, 상기 제2혼합가스의 전체에 대한 삼불화질소(NF3)은 비율은 상기 제1혼합가스의 전체에 대한 삼불화질소(NF3)의 비율에 비해 적은 것이 특징인 어레이 기판의 제조 방법.
- 제16항에 있어서, 상기 제2혼합가스의 삼불화질소(NF3)와 산소(O2)의 단위시간당 유입량 비는 1:10 내지 1:11인 것이 특징인 어레이 기판의 제조 방법.
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020110133760A KR101987688B1 (ko) | 2011-12-13 | 2011-12-13 | 어레이 기판의 제조방법 |
US13/692,078 US9236451B2 (en) | 2011-12-13 | 2012-12-03 | Method of fabricating array substrate using dry etching process of silicon nitride |
CN201210539707.0A CN103165528B (zh) | 2011-12-13 | 2012-12-13 | 制造阵列基板的方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020110133760A KR101987688B1 (ko) | 2011-12-13 | 2011-12-13 | 어레이 기판의 제조방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20130066967A KR20130066967A (ko) | 2013-06-21 |
KR101987688B1 true KR101987688B1 (ko) | 2019-06-12 |
Family
ID=48572341
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020110133760A Active KR101987688B1 (ko) | 2011-12-13 | 2011-12-13 | 어레이 기판의 제조방법 |
Country Status (3)
Country | Link |
---|---|
US (1) | US9236451B2 (ko) |
KR (1) | KR101987688B1 (ko) |
CN (1) | CN103165528B (ko) |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR102523717B1 (ko) | 2016-05-29 | 2023-04-19 | 도쿄엘렉트론가부시키가이샤 | 선택적 실리콘 질화물 에칭 방법 |
CN106898578B (zh) * | 2017-03-30 | 2019-08-06 | 合肥鑫晟光电科技有限公司 | 一种显示基板的制备方法、阵列基板及显示装置 |
CN108803910B (zh) | 2017-04-28 | 2021-08-06 | 京东方科技集团股份有限公司 | 触控基板及其制作方法、触控显示装置 |
US11444255B2 (en) * | 2017-05-18 | 2022-09-13 | Semiconductor Energy Laboratory Co., Ltd. | Method of manufacturing display device, display device, display module, and electronic device |
CN113066802B (zh) * | 2021-03-19 | 2023-04-18 | 合肥京东方显示技术有限公司 | 一种显示基板的制备方法、显示基板和显示装置 |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR20010109610A (ko) * | 2000-05-31 | 2001-12-12 | 박종섭 | 반도체 소자의 강유전체 캐패시터 형성방법 |
US7361607B2 (en) * | 2003-06-27 | 2008-04-22 | Lam Research Corporation | Method for multi-layer resist plasma etch |
KR100583311B1 (ko) * | 2003-10-14 | 2006-05-25 | 엘지.필립스 엘시디 주식회사 | 액정표시패널 및 그 제조 방법 |
US7307025B1 (en) * | 2005-04-12 | 2007-12-11 | Lam Research Corporation | Lag control |
US7632689B2 (en) * | 2006-10-03 | 2009-12-15 | Spansion Llc | Methods for controlling the profile of a trench of a semiconductor structure |
KR101320651B1 (ko) * | 2006-11-28 | 2013-10-22 | 엘지디스플레이 주식회사 | 수평 전계 인가형 액정표시패널의 제조방법 |
KR101609727B1 (ko) * | 2008-12-17 | 2016-04-07 | 삼성디스플레이 주식회사 | 박막 트랜지스터 표시판 및 이의 제조 방법 |
US8999856B2 (en) * | 2011-03-14 | 2015-04-07 | Applied Materials, Inc. | Methods for etch of sin films |
US20130045605A1 (en) * | 2011-08-18 | 2013-02-21 | Applied Materials, Inc. | Dry-etch for silicon-and-nitrogen-containing films |
-
2011
- 2011-12-13 KR KR1020110133760A patent/KR101987688B1/ko active Active
-
2012
- 2012-12-03 US US13/692,078 patent/US9236451B2/en active Active
- 2012-12-13 CN CN201210539707.0A patent/CN103165528B/zh active Active
Also Published As
Publication number | Publication date |
---|---|
CN103165528A (zh) | 2013-06-19 |
CN103165528B (zh) | 2015-07-08 |
US9236451B2 (en) | 2016-01-12 |
KR20130066967A (ko) | 2013-06-21 |
US20130149818A1 (en) | 2013-06-13 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR101425635B1 (ko) | 산화물 박막 트랜지스터 기판의 제조 방법 및 산화물 박막트랜지스터 기판 | |
JP5129228B2 (ja) | アレイ基板及びこれの製造方法 | |
US8796680B2 (en) | Thin-film transistor substrate and method of manufacturing the same | |
KR101741732B1 (ko) | 박막 트랜지스터 표시판 및 그 제조 방법 | |
JP2016225661A (ja) | 薄膜トランジスタパネルの製造方法 | |
KR20090041322A (ko) | 반도체장치 제조방법 | |
JP2012089814A (ja) | 表示装置及びその製造方法 | |
JP2007157916A (ja) | Tft基板及びtft基板の製造方法 | |
KR101987688B1 (ko) | 어레이 기판의 제조방법 | |
TWI416736B (zh) | 薄膜電晶體及其製造方法 | |
US20160315201A1 (en) | Display device | |
KR20140147590A (ko) | 평판표시장치용 백플레인 및 그의 제조방법 | |
JPH08236775A (ja) | 薄膜トランジスタおよびその製造方法 | |
KR101246790B1 (ko) | 어레이 기판 및 이의 제조방법 | |
US7554207B2 (en) | Method of forming a lamination film pattern and improved lamination film pattern | |
KR20160129160A (ko) | 박막 트랜지스터 표시판 및 그 제조 방법 | |
JP2006191013A (ja) | 薄膜トランジスタ基板、その製造方法及び液晶表示装置 | |
JP2006351844A (ja) | 電気光学表示装置およびその製造方法 | |
TW201351659A (zh) | 薄膜電晶體及其製造方法 | |
KR101998124B1 (ko) | 어레이 기판 및 그 제조방법 | |
KR20160014833A (ko) | 금속 배선의 제조 방법 및 박막트랜지스터 기판 제조 방법 | |
KR100848102B1 (ko) | 박막 트랜지스터 기판 및 그의 제조 방법 | |
JPWO2018189943A1 (ja) | 薄膜トランジスタ基板及びその製造方法 | |
KR101471149B1 (ko) | 박막 트랜지스터 기판 및 이의 제조 방법 | |
CN115360141A (zh) | 金属氧化物薄膜晶体管阵列基板及其制作方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
PA0109 | Patent application |
Patent event code: PA01091R01D Comment text: Patent Application Patent event date: 20111213 |
|
PG1501 | Laying open of application | ||
A201 | Request for examination | ||
PA0201 | Request for examination |
Patent event code: PA02012R01D Patent event date: 20161129 Comment text: Request for Examination of Application Patent event code: PA02011R01I Patent event date: 20111213 Comment text: Patent Application |
|
E902 | Notification of reason for refusal | ||
PE0902 | Notice of grounds for rejection |
Comment text: Notification of reason for refusal Patent event date: 20180712 Patent event code: PE09021S01D |
|
E90F | Notification of reason for final refusal | ||
PE0902 | Notice of grounds for rejection |
Comment text: Final Notice of Reason for Refusal Patent event date: 20181227 Patent event code: PE09021S02D |
|
E701 | Decision to grant or registration of patent right | ||
PE0701 | Decision of registration |
Patent event code: PE07011S01D Comment text: Decision to Grant Registration Patent event date: 20190529 |
|
GRNT | Written decision to grant | ||
PR0701 | Registration of establishment |
Comment text: Registration of Establishment Patent event date: 20190604 Patent event code: PR07011E01D |
|
PR1002 | Payment of registration fee |
Payment date: 20190604 End annual number: 3 Start annual number: 1 |
|
PG1601 | Publication of registration | ||
PR1001 | Payment of annual fee |
Payment date: 20220516 Start annual number: 4 End annual number: 4 |
|
PR1001 | Payment of annual fee |
Payment date: 20230515 Start annual number: 5 End annual number: 5 |
|
PR1001 | Payment of annual fee |
Payment date: 20240516 Start annual number: 6 End annual number: 6 |