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KR101450216B1 - 반도체 소자 구조물을 제조하는 방법 - Google Patents

반도체 소자 구조물을 제조하는 방법 Download PDF

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KR101450216B1
KR101450216B1 KR1020120093214A KR20120093214A KR101450216B1 KR 101450216 B1 KR101450216 B1 KR 101450216B1 KR 1020120093214 A KR1020120093214 A KR 1020120093214A KR 20120093214 A KR20120093214 A KR 20120093214A KR 101450216 B1 KR101450216 B1 KR 101450216B1
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Abstract

본 개시는 반도체 소자 구조물을 제조하는 방법에 있어서, 플레이트 위에 두 개의 반도체 소자를 위치 고정하는 단계;로서, 두 개의 반도체 소자 각각의 전극이 플레이트를 향하도록 위치 고정하는 단계; 두 개의 반도체 소자를 봉지제로 덮는 단계; 봉지제가 덮힌 두 개의 반도체 소자를 플레이트로부터 분리하는 단계; 봉지제 제거액을 통해 두 개의 반도체 소자 사이의 봉지제에 홈을 형성하는 단계; 그리고, 홈이 형성된 봉지제를 절단하여 두 개의 반도체 소자를 분리하는 단계;를 포함하는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법에 관한 것이다.

Description

반도체 소자 구조물을 제조하는 방법{METHOD OF MANUFACUTRUING SEMICONDUCTOR DEVICE STRUCTURE}
본 개시(Disclosure)는 전체적으로 반도체 소자 구조물을 제조하는 방법에 관한 것으로, 특히 제조가 간단한 반도체 소자 구조물을 제조하는 방법에 관한 것이다.
여기기, 반도체 소자라 함은 반도체 발광소자(예: 레이저 다이오드), 반도체 수광소자(예: 포토 다이오드), p-n접합 다이오드 전기 소자, 반도체 트랜지스터 등을 포함하며, 대표적으로 3족 질화물 반도체 발광소자를 예로 들 수 있다. 3족 질화물 반도체 발광소자는 Al(x)Ga(y)In(1-x-y)N (0≤x≤1, 0≤y≤1, 0≤x+y≤1)로 된 화합물 반도체층을 포함하는 발광다이오드와 같은 발광소자를 의미하며, 추가적으로 SiC, SiN, SiCN, CN와 같은 다른 족(group)의 원소들로 물질이나 이들 물질로 된 반도체층을 포함하는 것을 배제하는 것은 아니다.
여기서는, 본 개시에 관한 배경기술이 제공되며, 이들이 반드시 공지기술을 의미하는 것은 아니다(This section provides background information related to the present disclosure which is not necessarily prior art).
도 1은 종래의 반도체 발광소자의 일 예(Lateral Chip)를 나타내는 도면으로서, 반도체 발광소자는 기판(100), 기판(100) 위에, 버퍼층(200), 제1 도전성을 가지는 제1 반도체층(300), 전자와 정공의 재결합을 통해 빛을 생성하는 활성층(400), 제1 도전성과 다른 제2 도전성을 가지는 제2 반도체층(500)이 순차로 증착되어 있으며, 그 위에 전류 확산을 위한 투광성 전도막(600)과, 본딩 패드로 역할하는 전극(700)이 형성되어 있고, 식각되어 노출된 제1 반도체층(300) 위에 본딩 패드로 역할하는 전극(800)이 형성되어 있다. 여기서, 기판(100) 측이 패키지에 놓일 때, 장착면으로 기능한다.
도 2는 종래의 반도체 발광소자의 다른 예(Flip Chip)를 나타내는 도면으로서, 반도체 발광소자는 기판(100; 예: 사파이어 기판), 기판(100) 위에, 제1 도전성을 가지는 제1 반도체층(300; 예: n형 GaN층), 전자와 정공의 재결합을 통해 빛을 생성하는 활성층(400; 예: InGaN/(In)GaN MQWs), 제1 도전성과 다른 제2 도전성을 가지는 제2 반도체층(500; 예: p형 GaN층)이 순차로 증착되어 있으며, 그 위에 기판(100) 측으로 빛을 반사시키기 위한 3층으로 된 전극막(901; 예: Ag 반사막), 전극막(902; 예: Ni 확산 방지막) 및 전극막(903; 예: Au 본딩층)이 형성되어 있고, 식각되어 노출된 제1 반도체층(300) 위에 본딩 패드로 기능하는 전극(800; 예: Cr/Ni/Au 적층 금속 패드)이 형성되어 있다. 여기서, 전극막(903) 측이 패키지에 놓일 때, 장착면으로 기능한다. 열방출 효율의 관점에서, 도 1에 도시된 래터럴 칩(Lateral Chip)보다 도 2에 도시된 플립 칩(Flip Chip) 또는 정션 다운형(Junction Down Type) 칩이 열방출 효율이 우수하다. 래터럴 칩이 80~180㎛의 두께를 가지는 사파이어 기판(100)을 통해 열을 외부로 방출해야 하는 반면에, 플립 칩은 활성층(400)에 가깝게 위치하는 금속으로 된 전극(901,902,903)을 통해 열을 방출할 수 있기 때문이다.
도 15는 종래의 반도체 발광소자 패키지 또는 반도체 발광소자 구조물의 일 예를 나타내는 도면으로서, 반도체 발광소자 패키지는 리드 프레임(110,120), 몰드(130), 그리고 캐비티(140) 내에 수직형 반도체 발광소자(150; Vertical Type Light-emitting Chip)가 구비되어 있고, 캐비티(140)는 형광체(160)를 함유하는 봉지제(170)로 채워져 있다. 수직형 반도체 발광소자(150)의 하면이 리드 프레임(110)에 전기적으로 연결되고, 상면이 와이어(180)에 의해 리드 프레임(120)에 전기적으로 연결되어 있다. 수직형 반도체 발광소자(150)에서 나온 광(예: 청색광)의 일부가 형광체(160)를 여기시켜 형광체(160)가 광(예: 황색광)을 만들고, 이 광들(청색광+황색광)이 백색광을 만든다. 여기서, 몰드(130)-봉지제(170) 또는 리드 프레임(110,120)-몰드(130)-봉지제(170)가 수직형 반도체 발광소자를 담지한 채로, 반도체 발광소자 패키지의 지지체 즉, 캐리어(Carrier)로 역할한다.
이에 대하여 '발명의 실시를 위한 구체적인 내용'의 후단에 기술한다.
여기서는, 본 개시의 전체적인 요약(Summary)이 제공되며, 이것이 본 개시의 외연을 제한하는 것으로 이해되어서는 아니된다(This section provides a general summary of the disclosure and is not a comprehensive disclosure of its full scope or all of its features).
본 개시에 따른 일 태양에 의하면(According to one aspect of the present disclosure), 반도체 소자 구조물을 제조하는 방법에 있어서, 플레이트 위에 두 개의 반도체 소자를 위치 고정하는 단계;로서, 두 개의 반도체 소자 각각의 전극이 플레이트를 향하도록 위치 고정하는 단계; 두 개의 반도체 소자를 봉지제로 덮는 단계; 봉지제가 덮힌 두 개의 반도체 소자를 플레이트로부터 분리하는 단계; 봉지제 제거액을 통해 두 개의 반도체 소자 사이의 봉지제에 홈을 형성하는 단계; 그리고, 홈이 형성된 봉지제를 절단하여 두 개의 반도체 소자를 분리하는 단계;를 포함하는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법이 제공된다.
이에 대하여 '발명의 실시를 위한 구체적인 내용'의 후단에 기술한다.
도 1은 종래의 반도체 발광소자의 일 예(Lateral Chip)를 나타내는 도면,
도 2는 종래의 반도체 발광소자의 다른 예(Flip Chip)를 나타내는 도면,
도 3은 본 개시에 따라 반도체 소자 구조물을 제조하는 방법의 일 예를 나타내는 도면,
도 4는 본 개시에 따라 플립 칩 패키지를 제조하는 방법의 일 예를 나타내는 도면,
도 5는 본 개시에 따라 반도체 소자 구조물을 제조하는 방법의 다른 예를 나타내는 도면,
도 6은 본 개시에 따른 반도체 소자 구조물의 일 예를 나타내는 도면,
도 7은 본 개시에 따라 반도체 소자 구조물을 제조하는 방법의 또 다른 예를 나타내는 도면,
도 8은 본 개시에 따른 반도체 소자 구조물의 다른 예를 나타내는 도면,
도 9는 본 개시에 따른 반도체 소자 구조물 사용의 일 예를 나타내는 도면,
도 10은 본 개시에 따라 반도체 소자 구조물을 제조하는 방법의 또 다른 예를 나타내는 도면,
도 11은 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면,
도 12은 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면,
도 13은 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면,
도 14는 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면,
도 15는 종래의 반도체 발광소자 패키지 또는 반도체 발광소자 구조물의 일 예를 나타내는 도면,
도 16은 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면,
도 17은 도 16에 도시된 반도체 소자 구조물을 제조하는 방법의 일 예를 나타내는 도면,
도 18 및 도 19는 본 개시에 따른 반사면의 예들을 나타내는 도면,
도 20 및 도 21은 본 개시에 따른 반사면 형성의 원리를 설명하는 도면,
도 22는 본 개시에 따른 봉지제 전체 형상의 일 예를 나타내는 도면,
도 23은 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면,
도 24는 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면,
도 25는 도 24에 도시된 반도체 소자 구조물을 제조하는 방법의 일 예를 나타내는 도면,
도 26은 도 24에 도시된 반도체 소자 구조물을 제조하는 방법의 다른 예를 나타내는 도면,
도 27 및 도 28은 도 24에 도시된 반도체 소자 구조물의 변형 예들을 나타내는 도면,
도 29 내지 도 32는 본 개시에 따라 광 반사면을 제조하는 방법의 또 다른 예를 나타내는 도면,
도 33은 본 개시에 따라 광 반사막을 제조하는 방법의 또 다른 예를 나타내는 도면.
도 34는 본 개시에 따라 광 반사막을 제조하는 방법의 또 다른 예를 나타내는 도면으로서, 전극(80,90)에 전기적으로 연결되는 외부 전극(81,91)을 먼저 형성한 다음, 식각액이 투입된다.
이하, 본 개시를 첨부된 도면을 참고로 하여 자세하게 설명한다(The present disclosure will now be described in detail with reference to the accompanying drawing(s)).
도 3은 본 개시에 따라 반도체 소자 구조물을 제조하는 방법의 일 예를 나타내는 도면으로서, 플레이트(1)를 준비한 다음, 두 개의 전극(80,90)이 구비된 반도체 소자(2)를 접착제(3)를 이용하여 플레이트(1)에 위치 고정한다. 다음으로, 봉지제(4; encapsulating material)를 이용하여, 반도체 소자(2)를 감싼다. 다음으로, 플레이트(1)와 반도체 소자(2)를 분리한다. 플레이트(1)를 이루는 물질에는 특별한 제한이 없으며, 사파이어와 같은 물질을 사용하여도 좋고, 금속이나 유리 등의 평평평한 구조물을 사용하여도 좋다. 접착제(3)를 이루는 물질에도 특별한 제한이 없으며, 반도체 소자(2)를 플레이트(1)에 위치 고정만 할 수 있다면 어떠한 접착제여도 좋다. 봉지제(3)를 이루는 물질로는 종래에 LED 패키지에 사용되는 실리콘 에폭시가 사용될 수 있다. 봉지제(4)가 형성된 후, 반도체 소자(2)와 플레이트(1)의 분리는 접착제(3)를 녹일 수 있는 열을 가하거나, 접착제(3)를 녹일 수 있는 용제를 이용함으로써 가능하다. 열과 용제를 함께 사용하는 것도 가능하다. 또한 접착 테이프를 이용하는 것도 가능하다. 봉지제(4)는 종래에 사용되는 디스펜싱, 스크린 프린팅, 몰딩, 스핀 코팅 등의 방법으로 형성할 수 있으며, 광경화성 수지(UV경화성 수지)를 도포한 후, 광을 조사함으로써 형성하는 것도 가능하다. 플레이트(1)로 사파이어와 같이 투광성 플레이트가 사용되는 경우에, 플레이트(1) 측으로부터 광을 조사하는 것도 가능하다. 설명을 위해, 플레이트(1) 위에 하나의 반도체 소자(2)를 도시하였지만, 복수의 반도체 소자(2)를 플레이트(1) 위에 두고 공정을 행할 수 있다. 여기서 반도체 소자(2)는 두 개의 전극(80,90)을 가지는 것으로 설명되었지만, 그 수에 특별히 제한이 있는 것은 아니다. 예를 들어, 트랜지스터의 경우에 세 개의 전극을 가질 수 있다.
도 4는 본 개시에 따라 플립 칩 패키지를 제조하는 방법의 일 예를 나타내는 도면으로서, 반도체 소자(2)로서, 정션 다운 형 칩이 제시되어 있다. 정션 다운 형 칩으로서, 도 2에 도시된 것과 같은 플립 칩형 반도체 발광소자를 예로 들 수 있다. 따라서 반도체 발광소자는 도 2에서와 같이, 기판(100; 예: 사파이어 기판), 기판(100) 위에, 제1 도전성을 가지는 제1 반도체층(300; 예: n형 GaN층), 전자와 정공의 재결합을 통해 빛을 생성하는 활성층(400; 예: InGaN/(In)GaN MQWs), 제1 도전성과 다른 제2 도전성을 가지는 제2 반도체층(500; 예: p형 GaN층)이 순차로 증착되어 있으며, 그 위에 기판(100) 측으로 빛을 반사시키기 위한 3층으로 된 전극막(901; 예: Ag 반사막), 전극막(902; 예: Ni 확산 방지막) 및 전극막(903; 예: Au 본딩층)이 형성되어 있고, 식각되어 노출된 제1 반도체층(300) 위에 본딩 패드로 기능하는 전극(800; 예: Cr/Ni/Au 적층 금속 패드)이 형성된 구조를 가질 수 있다. 반도체 소자(2)는 두 개의 전극(80,90)을 가지며, 전극(90)은 도 2의 전극(901,902,903)과 같은 구성을 가져도 좋고, DBR(Distributed Bragg Reflector)과 금속 반사막의 조합으로 이루어져도 좋다. 전극(80)과 전극(90)은 SiO2와 같은 절연막(5)에 의해 전기적으로 절연되어 있다. 이후의 과정은 동일하며, 봉지제(4; encapsulating material)를 이용하여, 반도체 소자(2)를 감싼다. 다음으로, 플레이트(1)와 접착제(3)로부터 반도체 소자(2)를 분리한다.
도 5는 본 개시에 따라 반도체 소자 구조물을 제조하는 방법의 다른 예를 나타내는 도면으로서, 플레이트(1) 위에 복수의 반도체 소자(2,2)가 일체로 봉지제(4)에 의해 덮혀 있다. 플레이트(1)를 제거한 후, 반도체 소자(2,2)를 일체로서 하나의 패키지화하는 것이 용이해진다. 반도체 소자(2)와 반도체 소자(2)의 전기적 연결 방법에 대해서는 후술한다. 또한 이들을 도 3에서와 같이 개별적인 반도체 소자(2)로 분리하는 것도 가능하다. 이는 복수의 반도체 소자(2,2)를 플레이트(1)로부터 분리한 후, 쏘잉(sawing) 등의 공정을 통해 개별화함으로써 가능하다. 경화후 연성을 가지는 봉지제(4)를 사용함으로써, 연성 회로기판과의 결합을 한층 높일 수 있게 된다.
도 6은 본 개시에 따른 반도체 소자 구조물의 일 예를 나타내는 도면으로서, 봉지제(4)의 측면(4a)이 경사지도록 형성되어 있다. 반도체 소자(2)가 발광소자인 경우에, 봉지제(4)가 다양한 각의 외면을 갖게 되어, 패키지 외부로의 광 추출 효율이 높아지게 된다. 스크린 프린팅시, 스크린 격벽을 경사지게 형성하여 측면(4a)의 형성이 가능하며, 쏘잉시, 끝이 뾰족한 커터를 이용함으로써 측면(4a)의 형성이 가능하다.
도 7은 본 개시에 따라 반도체 소자 구조물을 제조하는 방법의 또 다른 예를 나타내는 도면으로서, 플레이트(1)가 제거된 후, SiO2와 같은 절연막(6)을 전극(80)과 전극(90)을 노출한 상태로 구비하고 있다. 이후, 전극(80)에 외부 전극(81)을 연결하고, 전극(90)에 외부 전극(91)을 형성하여, 종래의 패키지와 같은 구조로 만들 수 있게 된다. 외부 전극(81,91)은 종래 패키지의 리드 프레임에 대응할 수 있다. 또한 외부 전극(81,91)을 반사막으로 기능하도록 넓게 펼쳐 증착하는 것도 가능하다. 절연막(6)은 단순히 절연 기능만을 하여도 좋고, 외부 전극(81,91)에 의한 광 흡수를 줄이도록 SiO2/TiO2의 교대 적층구조를 형성하거나 DBR을 이루어도 좋다. 도 4에서와 같이 반도체 소자(2)가 절연막(5)을 구비하는 경우에는 절연막(6)이 생략될 수도 있다. 절연막(6)과 외부 전극(81,91)의 형성에 사용되는 증착 공정과 포토리쏘그라피 공정 등은 반도체 칩 공정에서 일반적인 것으로 당업자에 매우 익숙한 것이다. 외부 전극(81,91)을 구비함으로써, PCB, COB 등에의 장착이 보다 용이해질 수 있다. 필요한 경우에, 외부 전극(81,91) 없이 절연막(6)만을 구비하는 것도 가능하다. 절연막(6) 반도체 소자(2)와 봉지제(4) 사이를 보호하는 기능을 할 뿐만 아니라, 봉지제(4)를 외부 전극(81,91) 형성 공정으로부터 보호하는 기능도 할 수 있다. 또한 절연막(6)을 백색 물질로 형성하여, 절연막(6)을 반사막으로 기능하게 할 수 있다. 예를 들어, 백색의 PSR(Photo Sloder Regist)을 절연막(6)으로 이용하거나, 코팅하여 사용할 수 있다. 예를 들어, 백색의 PSR을 스크린 프린팅 또는 스핀 코팅한 다음, 일반적인 포토리소그라피 공정을 통해 패터닝할 수 있다.
도 8은 본 개시에 따른 반도체 소자 구조물의 다른 예를 나타내는 도면으로서, 전기적으로 직렬 연결된 반도체 소자(2A)와 반도체 소자(2B)가 구비되어 있다. 반도체 소자(2A)의 음(-) 전극(80A)과 반도체 소자(2B)의 양(+) 전극(90B)을 외부 전극(89)을 통해 연결함으로써 이러한 구성이 가능해진다. 미설명 부호 4는 봉지제이며, 6은 절연막이고, 90A은 반도체 소자(2A)의 양(+) 전극이며, 80B는 반도체 소자(2B)의 음(-) 전극이다. 이러한 구성을 통해, 모노리식 기판의 사용 없이, 봉지제(4)를 통해 일체화된 반도체 소자(2A,2B) 간의 전기적 연결을 형성할 수 있게 된다. 모노리식 기판의 경우에, 그 위의 반도체 소자의 구조가 동일하지만, 본 개시의 방법에 의하면, 반도체 소자(2A)와 반도체 소자(2B)가 같은 기능의 소자일 필요가 없다. 반도체 소자(2A,2B)를 병렬연결할 수 있음은 물론이다. 또한 봉지제(4)의 측면(4a)을 도 6에서와 같이 경사지게 형성할 수 있으며, 이러한 구성은 기존에 상상할 수 없었던 고전압(High-Voltage) 반도체 발광소자 패키지 내지는 반도체 발광소자 구조물을 가능하게 한다.
도 9는 본 개시에 따른 반도체 소자 구조물 사용의 일 예를 나타내는 도면으로서, 반도체 소자(2C)는 인쇄회로기판(7)의 도선(7a)과 전극(80,90)이 직접 연결되어 있으며, 반도체 소자(2D)는 도선(7b)과 외부 전극(81,91)을 통해 연결되어 있다. 인쇄회로기판(7)은 연성 회로기판이어도 좋다.
도 10은 본 개시에 따라 반도체 소자 구조물을 제조하는 방법의 또 다른 예를 나타내는 도면으로서, 도 2에 도시된 것과 같은 반도체 소자(2)가 구비되어 있으며, 반도체 소자(2)는 기판(100), 기판(100) 위에, 제1 도전성을 가지는 제1 반도체층(300), 전자와 정공의 재결합을 통해 빛을 생성하는 활성층(400), 제1 도전성과 다른 제2 도전성을 가지는 제2 반도체층(500)이 성장되며, 전극(80,90)이 형성되어 있다. 반도체 소자(2)를 접착제(3)를 이용해 플레이트(1)에 붙인 다음, 봉지제(4)로 덮기에 앞서, 기판(100)을 제거하고, 바람직하게는 광 취출 효율을 높이기 위해 거친 표면(301)을 형성한다. 이후의 과정은 동일하다. 기판(100)의 제거는 레이저 리프트 오프(Laser Lift-off)와 같은 공정에 의해 가능하며, 거친 표면(301)은 ICP(Inductively Coupled Plasma)와 같은 건식 식각을 통해 가능하다. 이것은 칩 레벨 레이저 리프트 오프를 가능하게 한다.
도 11은 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면으로서, 봉지제(4)에 형광체가 포함되어 있다. YAG, Silicate, Nitride 형광체 등을 이용하여 원하는 색의 광을 발광할 수 있게 된다.
도 12은 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면으로서, 봉지제(4) 내에 또는 봉지제(4) 하부에 형광체층(8)이 형성되어 있다. 이는 봉지제(4) 내에서 형광체를 침전시키거나, 별도로 스핀 코팅하거나, 휘발성 액체에 담긴 형광체를 도포한 후 휘발시켜 형광체만 남긴 후 봉지제(4)로 덮음으로써 형성할 수 있다. 필요에 따라 복수의 형광체층(8)의 형성도 가능하다.
도 13은 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면으로서, 봉지제(4)에 광 취출 효율을 높이기 위한 거친 표면(4g)이 형성되어 있다. 거친 표면(4g)은 pressing, 나노임프린트(nanoimprint) 등의 성형을 통해 형성이 가능하다. 또한 bead 물질을 도포한 후, 에칭, 샌드블라스팅 등의 방법을 통해 형성하는 것도 가능하다. 거친 표면(4g)은 플레이트(1)의 분리 이전 또는 분리 이후에 형성될 수 있다.
도 14는 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면으로서, 봉지제(4)에 렌즈(4c)가 형성되어 있다. 바람직하게는 렌즈(4c)는 봉지제와 일체로 형성된다. 이러한 일체형 렌즈(4c)는 압축성형 등으로 방법으로 형성하는 것이 가능하다.
도 16은 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면으로서, 반도체 소자(2)가 도 4에 도시된 것과 같은 플립 칩형 반도체 발광소자인 경우이며, 봉지제(4)의 측면(4a)이 활성층(400; 도 2 참조)에서 생성된 빛을 상측으로 반사시키는 광 반사면(4b)을 구비한다. 광 반사면(4b)은 측면(4a)의 전체에 형성되어도 좋고, 일부에 형성되어 좋다. 바람직하게는 반도체 소자(2)가 위치하는 측면(4a)의 하부에 형성된다. 도 16에서 광 반사면(4b)이 형성되지 않은 측면(4a)의 상부(4e)는 일정 이상의 높이를 가지는 것이 바람직하다. 상부(4e)는 평탄한 상면(4d)에 대한 수직한 방향을 가질 수 있으며, 그 전체를 형상의 일 예를 도 22에 나타내었다. 상부(4e)를 일정 높이 이상으로 구비하여, 반도체 소자 구조물을 별도의 렌즈 없이 빔 프로젝터의 광원으로도 이용할 수 있다. 도 16에서 광 반사면(4b)은 곡면으로 되어 있으며, 도 18 및 도 19에 광 반사면(4b)의 다른 예가 도시되어 있다. 도 18에서는 두 개의 경사를 달리하는 직선 경사면(4b1,4b2)이 반사면을 형성한다. 도 19에서는 경사면(4b1) 위에 계단(4b3)이 형성된 측면(4a)이 구비되어 있다. 경사면(4b1)과 계단(4b3)을 복수 회 도입하는 것도 가능하다. 광 반사면(4b)의 원리에 대해서는 도 20 및 도 21에서 설명한다. 도 6에 도시된 측면(4a)도 반사면의 하나로 볼 수 있다. 미설명 동일부호에 대한 설명은 생략한다. 형광체(8)는 반드시 구비되어야 하는 것은 아니며, 도 16에서와 같이 컨포멀(conformal) 코팅되어도 좋고, 도 11에서와 같이 봉지제(4) 전체에 함유되어도 좋고, 봉지제(4)의 일부에만 구비되어도 좋다. 절연막(6)과 외부 전극(81,91)이 구비되는 경우에, 이들은 전극(80,90) 측의 봉지제(4) 전면에 형성된 다음, 후술하는 블레이드(41)에 의한 쏘잉 공정에서 제거되는 형태일 수 있으며, 미리 광 반사면(4b)이 형성되는 영역에는 형성되지 않는 형태일 수도 있다.
도 17은 도 16에 도시된 반도체 소자 구조물을 제조하는 방법의 일 예를 나타내는 도면으로서, 기본적으로 도 4 내지 도 6에 설명된 과정과 동일하지만, 반도체 소자(2c,2d)를 분리 내지는 측면(4a)을 형성하는 과정에서, 광 반사면(4b)과 상부(4e)의 형상을 가지는 블레이드(41; Saw Blade)를 이용하여, 반도체 소자(2)를 분리하는 것과 동시에 측면(4a)을 형성하는 것이 가능해진다. 도 18에 도시된 경사면(4b1,4b2)은 두 개의 각도를 달리하는 블레이드를 이용함으로써 형성이 가능하며, 도 19에 도시된 경사면(4b1)과 계단(4b3)은 계단(4b3)에 대응하는 형상의 블레이드와 경사면(4b1)에 대응하는 블레이드를 이용함으로써 형성이 가능하다. 쏘잉과 같은 기계 가공을 이용함으로써, 측면(4a) 내지는 광 반사면(4b)을 원하는 형태로 정확하게 형성할 수 있는 이점을 가진다. 이는 도 15에서와 같이, 봉지제(170)를 디스펜싱하는 경우에, 그 외곽 형상의 제어가 um 이상의 수준(예를 들어, COB에 봉지제를 디스펜싱하는 경우)에서는 거의 불가능하지만, 본 개시에 따른 방법에 의하면, 이것이 용이해진다. 또한 종래의 패키지에서, 도 14에서와 같은 렌즈(4c) 형상을 가지기 위해서는 금형이 필요하지만, 본 개시에 따른 방법에 의하면, 이러한 금형의 도움없이도 광 반사면(4b)을 형성할 수 있게 된다.
도 20 및 도 21은 본 개시에 따른 반사면 형성의 원리를 설명하는 도면으로서, 광원(S)으로부터 빛(L1)이 수직한 측면(4a)으로 입사하는 경우에, 빛(L1)은 임계각을 표시하는 삼각형(C1) 내로 진입하는 경우에, 굴절률이 높이 매질(예: 봉지제(4))과 굴절률이 낮은 매질(예: 공기)의 경계인 수직한 측면(4a)을 지나 굴절률이 낮은 매질로 진행한다. 그러나, 빛(L1)의 입사각이 큰 경우에는 수직한 측면(4a)에서 반사되어 상면(4d)을 향하게 되며, 마찬가지로 상면(4d)에서 동일한 원리의 적용을 받게 된다. 반면, 수직한 측면(4a)에 대해서 우측으로 경사진 광 반사면(4b)의 경우에, 수직한 측면(4a)에 대해서는 입사각이 더 작아서 삼각형(C1) 내로 진입하는 빛(L2)에 대해서도 삼각형(C2) 내로 진입하지 않게 되어, 빛(L2)을 상면(4d) 측으로 반사시킬 수 있게 된다. 광 반사면(4b)이 곡면인 경우에, 광 반사면(4b) 내의 각각의 점에 대한 접선에서 동일한 원리가 적용된다. 이러한 적용을 받아, 광 반사면(4b)을 직선, 포물선, 원호 등으로 구성할 수 있으며, 제조가 가능하다면 이들의 조합으로 구성할 수도 있다. 바람직하게는, 광 반사면(4b)에 입사하는 모든 빛을 상면(4d)으로 반사하도록 광 반사면(4b)을 구성할 수 있지만, 반드시 그러해야 하는 것은 아니다. 더욱 바람직하게는, 광 반사면(4b)은 광 반사면(4b)에서 반사된 빛(L2)이 상면(4d)의 삼각형(C3) 내로 입사될 수 있도록 설계된다. 이러한 설계는 광학 분야에서 당업자에게 주지의 기술이다. 도 21에 도시된 바와 같이, 하나의 빛(L)에 대해서, 빛(L)이 수직한 측면(4a)에 반사되어 상면(4d)을 향하는 경우의 입사각(θ1)보다 광 반사면(4b)에 반사되어 상면(4d)을 향하는 경우의 입사각(θ2)이 작아지는 것을 알 수 있다. 입사각을 작게 해양 상면(4d)을 통해 방출될 확률이 높아지게 된다.
반도체 소자(2)가 발광소자인 경우에, 광 반사면(4b) 및/또는 백색 절연막(6)을 구비함으로써, 상면(4d) 내지는 반도체 소자(2) 상방으로의 광 취출 효율을 크게 높일 수 있게 된다. 종래에, 도 15에서와 같은 구조에서도, 백색의 몰드(130)가 사용되며, 몰드(130)는 패키지 전체의 형상을 구현하고, 캐비티(140)를 제공하는 한편, 캐비티(140) 내의 빛을 반사시키는 기능을 제공한다. 본 개시에 있어서, 백색의 몰드(130)에 의한 빛의 반사 기능은 광 반사면(4b)에 의해 대체되며(봉지제(4b)와 외부와의 굴절률의 차이를 이용함), 백색 절연막(6)은 그 위치와 기능에 있어서, 백색의 몰드(13)와 차별된다. 그리고 이러한 광 반사면(4b)의 구비와 백색 절연막(6)의 구비는 본 개시에 따른 제조 방법의 특유한 방식에 기인한다.
도 23은 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면으로서, 반도체 소자(2a)와 제2 반도체 소자(2b)가 봉지제(4)에 의해 일체로 형성되어 있다. 반도체 소자(2a)와 제2 반도체 소자(2b) 사이에는 홈(4f)이 형성되어 있으며, 홈(4f)은 슬릿 등 다양한 형태를 가질 수 있다. 홈(4f)은 반도체 소자(2a)와 제2 반도체 소자(2b)를 구분하면서 일체화하는데 역할하며, 반도체 소자(2a)의 기능과 제2 반도체 소자(2b)의 기능이 불필요하게 간섭되는 것을 방지하는 데도 이용될 수 있다. 반도체 소자(2a)와 제2 반도체 소자(2b)가 동일한 기능의 소자일 필요는 없다. 예를 들어, 하나는 기능성 소자이고, 하나는 정전기 방지를 위한 제너 다이오드일 수 있다. 반도체 소자(2a)와 제2 반도체 소자(2b)가 발광소자인 경우에, 반도체 소자(2a)와 제2 반도체 소자(2b)는 각각 다른 색의 빛을 발광할 수 있음은 물론이다. 반도체 소자(2a)와 제2 반도체 소자(2b)가 발광소자인 경우에, 홈(4f)은 광 반사면(4b)을 형성하는데 역할한다. 홈(4f)을 광 반사면(4b)으로 형성함으로써, 반도체 소자(2a)와 제2 반도체 소자(2b)는 서로 간섭 없이 각각의 상면(4d)으로 빛을 방출할 수 있게 된다. 홈(4f)의 형성은 봉지제(4) 전체를 절단하지 않는 깊이를 가지는 블레이드를 이용하여 가능하다. 광 반사면(4b)은 일측의 반도체 소자(2a)에만 형성될 수도 있다.
도 24는 본 개시에 따른 반도체 소자 구조물의 또 다른 예를 나타내는 도면으로서, 광 반사면(4b)이 절연막(6)에 의해 덮혀 있다. 절연막(6)은 백색 PSR과 같은 광 반사막으로 기능하게 할 수 있다. 이러한 의미에서 본 실시예에서 절연막(6)은 광 반사막이라 할 수 있다. 또한 봉지제(4)를 절연막(6)에 비해 상대적으로 높은 굴절률의 물질로 구성함으로써, 양자 사이에 반사 성능을 높이면서, 광 반사면(4b)을 절연막(6)에 의해 보호하는 것도 가능하다. 절연막(6)을 봉지제(4)에 비해 낮은 굴절률의 물질로 구성하는 것도 가능하며, 본 개시에 속하지만, 본 실시예에는 벗어난다. 광 반사막(6)을 절연 물질이 아니라, 금속(예: Al, Ag, Au) 증착을 통해 금속 막으로 구성하는 것도 가능하다.
도 25는 도 24에 도시된 반도체 소자 구조물을 제조하는 방법의 일 예를 나타내는 도면으로서, 봉지제(4)로 반도체 발광소자인 반도체 소자(2)를 덮은 후, 플레이트(1; 도 3 참조)를 제거한다. 다음으로, 블레이드(도시 생략)를 이용하여, 홈(4m)을 형성하여(일반화하면, 봉지제(4)를 제거함으로써 홈(4m)을 형성하여), 봉지제(4)에 광 반사면(4b)을 형성한 다음, 절연막(6)으로 광 반사면(4b)을 덮은 다음, 포토리소그라피 공정을 통해 절연막(6)을 통해 전극(80,90)을 노출시키고, 외부 전극(81,91)을 전극(80,90)에 각각 연결한다. 다음으로, 절단선(C)을 기준으로 반도체 소자(2,2)를 분리한다.
도 26은 도 24에 도시된 반도체 소자 구조물을 제조하는 방법의 다른 예를 나타내는 도면으로서, 전극(80,90)에 외부 전극(81,90) 증착 또는 도금과 같은 방법으로 먼저 형성한 다음, 광 반사면(4b)에 절연막(6)이 형성된다. 이후 포토리소그라피 공정을 거쳐 외부 전극(81,91)을 절연막(6) 밖으로 노출시키고, 반도체 소자(2,2)를 절단선(C)을 기준으로 절단한다.
도 27 및 도 28은 도 24에 도시된 반도체 소자 구조물의 변형 예들을 나타내는 도면으로서, 도 27에는 광 반사면이 하나의 경사면(4b1)을 이루고 있으며, 도 28에는 광 반사면이 두 개의 경사면면(4b1,4b2)을 이루고 있다. 반도체 소자(2,2)를 개별적으로 분리될 수 있지만, 복수의 반도체 소자(2,2)가 함께 분리될 수도 있다.
도 29 내지 도 32는 본 개시에 따라 광 반사면을 제조하는 방법의 또 다른 예를 나타내는 도면으로서, 도 29에 도시된 바와 같이, 먼저 플레이트(1; 도 3 참조)를 제거한 다음, 도 30에 도시된 바와 같이, 전극(80,80)이 위치하는 측에서 식각액 또는 봉지제 제거액을 관(WE)을 통해 제공한다. 식각액은 1차적으로, 반도체 소자(2)를 플레이트(1)에 위치 고정하는 공정, 봉지제(4)를 반도체 소자(2)에 덮는 공정 등에서 반도체 소자(2) 및 봉지제(4)에 남을 수 있는 이물질을 제거하는 역할을 한다. 또한 반도체 소자(2)가 반도체 발광소자인 경우에, 식각액은 이물질을 제거하는 한편, 광 반사면 또는 광 산란면을 형성하는 역할을 한다. 이러한 식각을 통해(봉지제 제거를 통해), 도 31에 도시된 바와 같이, 홈(4p)이 형성되고, 봉지제(4)에 광 반사면(4b)이 형성된다. 식각액 또는 봉지제 제거액으로는 EKC(일반적인 포토레지스트 제거용 습식 세정제의 제품명으로서, EKC830 (Aminoethoxy ethanol + N-methyl pyrrolidine)이다.), 아세톤, 실리콘 리무버(Si Remover) 등과 같은 유기(Organic) 세정제를 사용할 수 있다. 예를 들어, EKC830 용액을 100℃ 정도의 온도로 가열후, 용액을 Cleaning하려는 물체에 분사하여, 약 1분간 Puddle 시간을 가진 후에, 도구(T)를 사용하여 누르는 힘이 강하면 홈(4p)이 깊어지고, 누르는 힘이 낮으면 홈(4p)이 낮아진다. 여기서 도구(T)의 누르는 힘이 같은 조건이면 EKC830용액의 Heating 온도 및 Puddle 시간에 따라 홈(4p)의 높낮이가 달라진다. 바람직하게는 스폰지, 와이퍼, 부드러운 재질의 극세사 폼과 같은 도구(T)를 이용하여, 세정의 과정을 도울 수 있다. 필요에 따라 절연막(6)을 더 형성할 수 있다. 바람직하게는 백색 PSR로 절연막(6)을 형성한다. 반도체 소자가 반드시 반도체 발광소자일 필요는 없다.
도 33은 본 개시에 따라 광 반사막을 제조하는 방법의 또 다른 예를 나타내는 도면으로서, 식각액을 투입하기에 앞서, 절연막(6)이 반도체 소자(2)에 먼저 형성되어 있으며, 반도체 소자(2)와 봉지제(4) 사이의 경계면(2a)을 식각액으로부터 보호하는 기능을 추가할 수 있다.
도 34는 본 개시에 따라 광 반사막을 제조하는 방법의 또 다른 예를 나타내는 도면으로서, 전극(80,90)에 전기적으로 연결되는 외부 전극(81,91)을 먼저 형성한 다음, 식각액이 투입된다.
이하 본 개시의 다양한 실시 형태에 대하여 설명한다.
(1) 봉지제가 캐리어로 역할하는 반도체 소자 구조물.
(2) 플레이트로부터 분리된 봉지제 하면을 가지는 반도체 소자 구조물.
(3) 반도체 소자의 전극이 위치하는 면을 제외한 봉지제의 외면들이 구조물 또는 패키지의 외면을 이루는 반도체 소자 구조물.
(4) 반도체 소자들을 봉지제를 이용하여 결합한 반도체 소자 구조물.
(5) 반도체 소자 구조물을 제조하는 방법에 있어서, 플레이트 위에 반도체 소자를 위치 고정하는 단계;로서, 반도체 소자의 전극이 플레이트를 향하도록 위치 고정하는 단계; 반도체 소자를 봉지제로 덮는 단계; 그리고, 봉지제가 덮힌 반도체 소자를 플레이트로부터 분리하는 단계;를 포함하는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
(6) 반도체 소자 구조물을 제조하는 방법에 있어서, 플레이트 위에 두 개의 반도체 소자를 위치 고정하는 단계;로서, 두 개의 반도체 소자 각각의 전극이 플레이트를 향하도록 위치 고정하는 단계; 두 개의 반도체 소자를 봉지제로 덮는 단계; 봉지제가 덮힌 두 개의 반도체 소자를 플레이트로부터 분리하는 단계; 봉지제 제거액을 통해 두 개의 반도체 소자 사이의 봉지제에 홈을 형성하는 단계; 그리고, 홈이 형성된 봉지제를 절단하여 두 개의 반도체 소자를 분리하는 단계;를 포함하는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
(7) 두 개의 반도체 소자를 분리하는 단계에 앞서, 홈과 두 개의 반도체 소자 측에 절연막을 형성하는 단계;를 더 포함하는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
(8) 절연막은 백색 절연막인 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
(9) 홈을 형성하는 단계에 앞서, 두 개의 반도체 소자와 봉지제의 경계면에 절연막을 형성하는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
(10) 홈을 형성하는 단계에 앞서, 두 개의 반도체 소자 각각의 전극에 전기적으로 연결되는 외부 전극을 형성하는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
(11) 홈을 형성하는 단계에서, 홈이 형성되는 봉지제에 물리적 수단에 의해 힘이 추가로 가해지는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
(12) 두 개의 반도체 소자는 반도체 발광소자이며, 두 개의 반도체 소자에서 생성된 빛을 홈에 의해 봉지제에 생성되는 면에 의해 반사되는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
본 개시에 따른 하나의 반도체 소자 구조물을 제조하는 방법에 의하면, 반도체 소자 구조물 또는 패키지를 쉽게 제조할 수 있게 된다.
또한 본 개시에 따른 다른 반도체 소자 구조물을 제조하는 방법에 의하면, 봉지제가 캐리어로 역할하는 구조물 또는 패키지를 만들 수 있게 된다.
또한 본 개시에 따른 또 다른 반도체 소자 구조물을 제조하는 방법에 의하면, 투광성 봉지제가 캐리어로 역할하는 발광소자 구조물 또는 패키지를 만들 수 있게 된다.
또한 본 개시에 따른 또 다른 반도체 소자 구조물을 제조하는 방법에 의하면, 복수의 반도체 소자를 쉽게 전기적으로 연결할 수 있게 된다.
또한 본 개시에 따른 또 다른 반도체 소자 구조물을 제조하는 방법에 의하면, 다른 구조의 반도체 소자들을 쉽게 전기적으로 연결할 수 있게 된다.
또한 본 개시에 따른 또 다른 반도체 소자 구조물을 제조하는 방법에 의하면, 블레이드를 이용하는 쏘잉과 같은 물리적인 방법에 의하지 않고, 봉지제에 홈을 형성할 수 있게 된다.
또한 본 개시에 따른 또 다른 반도체 소자 구조물을 제조하는 방법에 의하면, 공정 상에서 봉지제에 묻은 이물질을 제거하는 한편, 홈을 형성할 수 있게 된다. 홈은 광 반사면 또는 광 산란면으로 기능할 수 있다.
100: 기판 200: 버퍼층 300,400,500: 반도체층

Claims (7)

  1. 반도체 소자 구조물을 제조하는 방법에 있어서,
    플레이트 위에 반도체 발광소자인 두 개의 반도체 소자를 위치 고정하는 단계;로서, 두 개의 반도체 소자 각각의 전극이 플레이트를 향하도록 위치 고정하는 단계;
    두 개의 반도체 소자를 봉지제로 덮는 단계;
    봉지제가 덮힌 두 개의 반도체 소자를 플레이트로부터 분리하는 단계;
    봉지제 제거액을 통해 두 개의 반도체 소자 사이의 봉지제에 홈을 형성하는 단계; 그리고,
    홈이 형성된 봉지제를 절단하여 두 개의 반도체 소자를 분리하는 단계;를 포함하며,
    홈에 의해 분리된 각각의 반도체 소자의 봉지제에 광 반사면이 형성되는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
  2. 청구항 1에 있어서,
    두 개의 반도체 소자를 분리하는 단계에 앞서, 홈과 두 개의 반도체 소자 측에 절연막을 형성하는 단계;를 더 포함하는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
  3. 청구항 2에 있어서,
    절연막은 백색 절연막인 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
  4. 청구항 1에 있어서,
    홈을 형성하는 단계에 앞서, 플레이트가 제거된 측에서 두 개의 반도체 소자와 봉지제가 만나는 경계면에 절연막을 형성하는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
  5. 청구항 1에 있어서,
    홈을 형성하는 단계에 앞서, 두 개의 반도체 소자 각각의 전극에 전기적으로 연결되는 외부 전극을 형성하는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
  6. 청구항 1에 있어서,
    홈을 형성하는 단계에서, 홈이 형성되는 봉지제에 물리적 수단에 의해 힘이 추가로 가해지는 것을 특징으로 하는 반도체 소자 구조물을 제조하는 방법.
  7. 삭제
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Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002270715A (ja) * 2001-03-09 2002-09-20 Sumitomo Bakelite Co Ltd 半導体装置の製造方法および半導体装置
KR20070079956A (ko) * 2007-07-03 2007-08-08 한국광기술원 칩스케일 패키징 발광소자 및 그의 제조방법
JP2008218469A (ja) * 2007-02-28 2008-09-18 Rohm Co Ltd 半導体装置の製造方法
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Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2002270715A (ja) * 2001-03-09 2002-09-20 Sumitomo Bakelite Co Ltd 半導体装置の製造方法および半導体装置
JP2008218469A (ja) * 2007-02-28 2008-09-18 Rohm Co Ltd 半導体装置の製造方法
KR20070079956A (ko) * 2007-07-03 2007-08-08 한국광기술원 칩스케일 패키징 발광소자 및 그의 제조방법
KR20100060867A (ko) * 2008-11-28 2010-06-07 삼성전기주식회사 웨이퍼 레벨 패키지의 제조방법

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