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KR100458572B1 - 플라즈마 디스플레이 패널 및 그 구동 방법 - Google Patents

플라즈마 디스플레이 패널 및 그 구동 방법 Download PDF

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KR100458572B1
KR100458572B1 KR10-2002-0039713A KR20020039713A KR100458572B1 KR 100458572 B1 KR100458572 B1 KR 100458572B1 KR 20020039713 A KR20020039713 A KR 20020039713A KR 100458572 B1 KR100458572 B1 KR 100458572B1
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Abstract

플라즈마 디스플레이 패널에서, 제1 및 제2 스위칭 소자가 전원(Vs/2)과 패널 캐패시터의 일단 사이에 직렬로 연결되어 있으며, 제3 및 제4 스위칭 소자가 패널 캐패시터의 일단과 전원(-Vs/2) 사이에 직렬로 연결되어 있다. 그리고 제1 및 제2 스위칭 소자의 접점과 제3 및 제4 스위칭 소자의 접점 사이에는 Vs/2 전압을 충전하고 있는 캐패시터가 연결되어 있다. 이와 같이 하면, 패널 캐패시터의 일단에 -Vs/2 전압이 인가되는 동안 제1 및 제2 스위칭 소자의 내압을 Vs/2로 클램핑할 수 있으며, 마찬가지로 패널 캐패시터의 일단에 Vs/2 전압이 인가되는 동안 제3 및 제4 스위칭 소자의 내압을 Vs/2로 클램핑할 수 있다.

Description

플라즈마 디스플레이 패널 및 그 구동 방법{PLASM DISPLAY PANEL AND DRIVING METHOD THEREOF}
본 발명은 플라즈마 디스플레이 패널(plasma display panel, PDP) 및 그 구동 방법에 관한 것이다.
최근 액정 표시 장치(liquid crystal display, LCD), 전계 방출 표시 장치(field emission display, FED), 플라즈마 디스플레이 패널 등의 평면 표시 장치가 활발히 개발되고 있다. 이들 평면 표시 장치 중에서 플라즈마 디스플레이 패널은 다른 평면 표시 장치에 비해 휘도 및 발광효율이 높으며 시야각이 넓다는 장점이 있다. 따라서, 플라즈마 디스플레이 패널이 40인치 이상의 대형 표시 장치에서 종래의 음극선관(cathode ray tube, CRT)을 대체할 표시 장치로서 각광받고 있다.
플라즈마 디스플레이 패널은 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백 만개 이상의 화소가 매트릭스 형태로 배열되어 있다. 이러한 플라즈마 디스플레이 패널은 인가되는 구동 전압 파형의 형태와 방전 셀의 구조에 따라 직류형(DC형)과 교류형(AC형)으로 구분된다.
직류형 플라즈마 디스플레이 패널은 전극이 방전 공간에 그대로 노출되어 있어서 전압이 인가되는 동안 전류가 방전 공간에 그대로 흐르게 되며, 이를 위해 전류 제한을 위한 저항을 만들어 주어야 하는 단점이 있다. 반면 교류형 플라즈마 디스플레이 패널에서는 전극을 유전체층이 덮고 있어 자연스러운 캐패시턴스 성분의 형성으로 전류가 제한되며 방전시 이온의 충격으로부터 전극이 보호되므로 직류형에 비해 수명이 길다는 장점이 있다.
일반적으로 교류형 플라즈마 디스플레이 패널의 구동 방법은 리셋(초기화)기간, 기록(어드레싱) 기간, 유지 방전 기간, 소거 기간으로 구성된다.
리셋 기간은 셀에 어드레싱 동작이 원활히 수행되도록 하기 위해 각 셀의 상태를 초기화시키는 기간이며, 기록 기간은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽전하를 쌓아두는 동작을 수행하는 기간이다. 유지 방전 기간은 어드레싱된 셀에 실제로 화상을 표시하기 위한 방전을 수행하는 기간으로, 유지 방전 기간이 되면 주사 전극(이하 "Y 전극"이라 함)과 유지 전극(이하 "X 전극"이라 함)에 서스테인 펄스가 교대로 인가되어 유지 방전이 행하여져 영상이 표시된다. 소거 기간은 셀의 벽전하를 감소시켜 유지 방전을 종료시키는 기간이다.
교류형 플라즈마 디스플레이 패널은 그 유지 방전을 위한 Y 전극 및 X 전극이 용량성 부하로 작용하기 때문에 주사 전극 및 유지 전극에 대한 캐패시턴스가 존재하는 데, 아래에서는 이를 패널 캐패시터(Cp)라 한다.
이하, 종래의 교류형 플라즈마 디스플레이 패널의 구동 회로와 그 구동 방법에 대하여 설명한다.
도 1 및 도 2는 종래의 구동 회로와 그 동작 파형을 나타내는 도면이다.
도 1에 도시한 바와 같이, Kishi 등에 의해 제안된 서스테인 펄스를 생성하는 구동 회로(일본특허 제3201603호)는 Y 전극 구동부(11), X 전극 구동부(12), Y 전극 전원부(13) 및 X 전극 전원부(14)를 포함한다. X 전극 구동부 및 전원부(12, 14)는 Y 전극 구동부(11) 및 전원부(13)와 동일한 구성으로 되어 있으므로, X 전극 구동부 및 전원부(12, 14)의 구조와 동작에 대해서는 설명을 생략하고, 아래에서는Y 전극 구동부 및 전원부(11, 13)에 대해서만 설명한다.
Y 전극 전원부(13)는 캐패시터(C1)와 3개의 스위칭 소자(SW1, SW2, SW3)를 포함하며, Y 전극 구동부(11)는 2개의 스위칭 소자(SW4, SW5)를 포함한다. Y 전극 전원부(13) 내의 스위칭 소자(SW1, SW2)는 전원(Vs/2)과 접지 전압(GND) 사이에 직렬로 연결된다. 스위칭 소자(SW1, SW2)의 접점에는 캐패시터(C1)의 일단이 연결되며, 이 캐패시터(C1)의 타단과 접지 전압 사이에는 스위칭 소자(SW3)가 연결되어 있다.
Y 전극 구동부(11)의 스위칭 소자(SW4, SW5)는 Y 전극 전원부(13)의 캐패시터(C1)의 양단에 직렬로 연결되며, 그 접점에는 패널 캐패시터(Cp)가 연결되어 있다.
이때, 도 2에 도시한 바와 같이 스위칭 소자(SW1, SW3, SW2')가 켜지고 스위칭 소자(SW2, SW4, SW5)가 꺼진 후 스위칭 소자(SW4, SW4')가 켜지면, Y 전극 전압(Vy)은 Vs/2로 상승하고 캐패시터(C1)에는 Vs/2의 전압이 충전된다.
다음에, 스위칭 소자(SW4)가 꺼지고 스위칭 소자(SW5)가 켜지면 Y 전극 전압(Vy)은 접지 전압까지 하강한다. 이후, 스위칭 소자(SW1, SW3, SW4)가 꺼지고 스위칭 소자(SW2, SW5)가 켜지면, 캐패시터(C1)에 충전되어 있는 Vs/2 전압에 의해 Y 전극 전압(Vy)은 -Vs/2로 하강한다. 그리고 다음의 타이밍에서 스위칭 소자(SW5)가 꺼지고 스위칭 소자(SW4)가 켜지면, Y 전극 전압(Vy)은 접지 전압(0V)까지 상승한다.
이와 같이 구동함으로써 Y 전극에 양의 전압(+Vs/2)과 음의 전압(-Vs/2)을교대로 인가할 수 있으며, 마찬가지로 X 전극에도 양의 전압(+Vs/2)과 음의 전압(-Vs/2)을 교대로 인가할 수 있다. 이 때, X 전극 및 Y 전극의 각각에 인가하는 전압(±Vs/2)은 서로 위상이 반전되도록 인가한다. 이와 같이 -Vs/2와 Vs/2 사이를 스윙하는 서스테인 펄스를 생성함으로써, X 전극과 Y 전극간의 전위차를 유지 방전 전압(Vs)으로 할 수 있다.
종래의 회로에서 사용되는 각 소자의 내압은 Vs/2로 하면 되므로 내압이 작은 소자를 사용할 수 있다. 그러나, 이러한 구동 회로는 -Vs/2에서 Vs/2로 스윙하는 펄스를 사용하는 플라즈마 디스플레이 패널에서만 사용할 수 있다는 문제점이 있다.
그리고 종래의 회로에서는 음의 전압에 이용되는 전압을 저장하기 위한 캐패시터의 용량이 커야 하므로, 이러한 캐패시터에 의해 초기 기동시 상당한 양의 돌입 전류가 흐른다는 문제점이 있다.
본 발명이 이루고자 하는 기술적 과제는 저내압 스위칭 소자를 사용하는 플라즈마 디스플레이 패널을 제공하는 것이다.
도 1은 종래 기술에 따른 구동 회로를 나타내는 도면이다.
도 2는 종래 기술에 따른 구동 회로의 동작 타이밍을 나타내는 도면이다.
도 3은 본 발명에 따른 플라즈마 디스플레이 패널을 나타내는 도면이다.
도 4, 도 7 및 도 10은 각각 본 발명의 제1 내지 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동 회로를 나타내는 도면이다.
도 5a 및 도 5b는 본 발명의 제1 실시예에 따른 구동 회로에서 각 모드의 전류 경로를 나타내는 도면이다.
도 6 및 9는 각각 본 발명의 제1 및 제2 실시예에 따른 구동 회로의 동작 타이밍을 나타내는 도면이다.
도 8a 내지 도 8h는 본 발명의 제2 실시예에 따른 구동 회로에서 각 모드의 전류 경로를 나타내는 도면이다.
이러한 과제를 해결하기 위해서 본 발명은 직렬로 연결된 스위칭 소자의 접점에 스위칭 소자의 양단 전압을 클램핑하기 위한 전압을 인가한다.
본 발명의 첫 번째 특징에 따른 플라즈마 디스플레이 패널에는, 제1 전압을 공급하는 제1 전원과 패널 캐패시터의 일단 사이에 직렬로 연결되는 제1 및 제2 스위칭 소자와 패널 캐패시터의 일단과 제2 전압을 공급하는 제2 전원 사이에 직렬로 연결되는 제3 및 제4 스위칭 소자가 형성되어 있다. 제1 캐패시터가 제1 및 제2 스위칭 소자의 접점과 제3 및 제4 스위칭 소자의 접점 사이에 연결되어 있으며, 제5 스위칭 소자가 제1 캐패시터의 일단과 제3 전압을 공급하는 제3 전원 사이에 연결되어 있다.
제5 스위칭 소자가 켜질 때 제1 캐패시터에는 제3 및 제2 전압의 차에 해당하는 전압이 충전되며, 제3 전압은 제1 및 제2 전압의 중간 전압인 것이 바람직하다.
본 발명의 첫 번째 특징에 따른 플라즈마 디스플레이 패널은, 패널 캐패시터의 일단에 연결되는 적어도 하나의 인덕터 및 인덕터와 제3 전원 사이에 병렬로 연결되는 두 개의 스위칭 소자를 더 포함할 수 있다.
또한 본 발명의 첫 번째 특징에 따른 플라즈마 디스플레이 패널에서, 패널 캐패시터의 타단에는 제1 전원과 연결된 제6 및 제7 스위칭 소자가 직렬로 연결되고 제2 전원과 연결된 제8 및 제9 스위칭 소자가 직렬로 연결되어 있다. 그리고 제2 캐패시터가 제6 및 제7 스위칭 소자의 접점과 제8 및 제9 스위칭 소자의 접점 사이에 연결되어 있으며, 제10 스위칭 소자가 제2 캐패시터의 일단과 제3 전원 사이에 연결되어 있다.
본 발명의 두 번째 특징에 따른 플라즈마 디스플레이 패널에는, 제1 전압을 공급하는 제1 전원과 패널 캐패시터의 일단 사이에 직렬로 연결되는 제1 및 제2 스위칭 소자, 그리고 패널 캐패시터의 일단과 제2 전압을 공급하는 제2 전원 사이에 직렬로 연결되는 제3 및 제4 스위칭 소자가 형성되어 있다. 캐패시터가 제1 전압과 제2 전압의 차보다 작은 제3 전압으로 충전되며, 제1단이 제1 및 제2 스위칭 소자의 접점에 연결되고 제2단이 제3 및 제4 스위칭 소자의 접점에 연결되어 있다. 이때, 제1 및 제2 스위칭 소자와 제3 및 제4 스위칭 소자가 교대로 켜져서, 패널 캐패시터의 일단에 제1 및 제2 전압이 교대로 인가된다.
이때, 제3 전압은 제1 및 제2 전압의 차의 절반에 해당하는 전압인 것이 바람직하다.
본 발명의 두 번째 특징에 따른 플라즈마 디스플레이 패널은 제1 및 제2 전압의 중간 전압을 공급하는 제3 전원과 캐패시터의 제1단 사이에 연결되는 제5 스위칭 소자를 더 포함하는 것이 바람직하다. 이때, 제5 스위칭 소자는 제3 및 제4 스위칭 소자가 켜질 때 켜진다.
또한, 이 플라즈마 디스플레이 패널은 전력 회수부를 더 포함하는 것이 바람직하다. 전력 회수부는 패널 캐패시터의 일단에 전기적으로 연결되는 적어도 하나의 인덕터를 포함하며, 인덕터와 패널 캐패시터 사이에서 발생하는 공진을 이용하여 패널 캐패시터의 단자 전압을 바꾼다.
또한, 본 발명은 패널 캐패시터의 일단에 연결된 제1 및 제2 경로를 통하여 각각 제1 및 제2 전압을 번갈아 인가하면서 플라즈마 디스플레이 패널을 구동하는 방법을 제공한다. 제1 경로는 패널 캐패시터의 일단과 제1 전압을 공급하는 제1 전원 사이에 직렬로 전기적으로 연결되는 복수의 제1 스위칭 소자를 포함하고, 기 제2 경로는 패널 캐패시터의 일단과 제2 전압을 공급하는 제2 전원 사이에 직렬로 전기적으로 연결되는 복수의 제2 스위칭 소자를 포함한다. 이 방법에 의하면, 소정 전압으로 충전된 캐패시터의 제1단과 제2단을 각각 직렬로 연결된 복수의 제1 스위칭 소자 사이의 접점 중 어느 하나의 제1 접점과 직렬로 연결된 복수의 제2 스위칭 소자의 접점 중 어느 하나의 제2 접점에 연결한 상태에서, 제1 경로를 통하여 패널 캐패시터의 일단에 제1 전압을 인가한다. 다음, 캐패시터의 제1단과 제2단을 각각 제1 접점과 제2 접점에 연결하고 캐패시터의 제1단을 제1 전압과 제2 전압 사이의 전압인 제3 전압을 공급하는 전원에 연결한 상태에서, 제2 경로를 통하여 기 패널 캐패시터의 일단에 제2 전압을 인가한다.
플라즈마 디스플레이 패널의 일단에 제2 전압을 인가할 때, 캐패시터는 소정 전압으로 충전되는 것이 바람직하다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다.
도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다. 어떤 부분이 다른 부분과 연결되어 있다고 할 때, 이는 직접적으로 연결되어 있는 경우뿐 아니라 그 중간에 다른 소자를 사이에 두고 전기적으로 연결되어(coupling) 있는 경우도 포함한다.
이제 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법에 대하여 도면을 참고로 하여 상세하게 설명한다.
먼저, 도 3을 참조하여 본 발명의 실시예에 따른 플라즈마 디스플레이 패널에 대하여 설명한다.
도 3은 본 발명의 실시예에 따른 플라즈마 디스플레이 패널을 나타내는 도면이다.
도 3에 도시한 바와 같이, 본 발명의 실시예에 따른 플라즈마 디스플레이 패널은 플라즈마 패널(100), 어드레스 구동부(200), 주사·유지 구동부(300) 및 제어부(400)를 포함한다.
플라즈마 패널(100)은 열 방향으로 배열되어 있는 복수의 어드레스 전극(A1∼Am), 행 방향으로 지그재그로 배열되어 있는 복수의 주사전극(Y1∼Yn) 및 유지전극(X1∼Xn)을 포함한다. 어드레스 구동부(200)는 제어부(400)로부터 어드레스 구동 제어 신호를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스 전극에 인가한다. 주사·유지 구동부(300)는 제어부(400)로부터 유지 방전 신호를 수신하여 주사 전극과 유지 전극에 서스테인 펄스 전압을 번갈아 입력함으로써 선택된 방전 셀에 대하여 유지 방전을 수행한다. 제어부(400)는 외부로부터 영상 신호를 수신하여 어드레스 구동 제어 신호와 유지 방전 신호를 생성하여 각각 어드레스 구동부(200)와 주사·유지 구동부(300)에 인가한다.
이하, 도 4 내지 도 6을 참조하여 본 발명의 제1 실시예에 따른 주사·유지 구동부(300)의 구동 회로를 설명한다.
도 4는 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동 회로를 나타내는 도면이다. 도 5a 및 도 5b는 본 발명의 제1 실시예에 따른 구동 회로에서 각 모드의 전류 경로를 나타내는 도면이며, 도 6은 본 발명의 제1 실시예에 따른 구동 회로의 동작 타이밍을 나타내는 도면이다.
도 4에 나타낸 바와 같이, 본 발명의 제1 실시예에 따른 구동 회로(300)는 Y 전극 구동부(310), X 전극 구동부(320), Y 전극 클램핑부(330) 및 X 전극 클램핑부(340)를 포함한다.
Y 전극 구동부(310) 및 X 전극 구동부(320)는 패널 캐패시터(Cp)를 사이에 두고 연결되어 있다. Y 전극 구동부(310)는 전원(Vs/2)과 패널 캐패시터(Cp)의 Y 전극 사이에 직렬로 연결되어 있는 스위칭 소자(Ys, Yh) 및 패널 캐패시터(Cp)의 Y 전극과 전원(-Vs/2) 사이에 직렬로 연결되어 있는 스위칭 소자(YL, Yg)를 포함한다. 마찬가지로 X 전극 구동부(320)는 전원(Vs/2)과 패널 캐패시터(Cp)의 X 전극 사이에 직렬로 연결되어 있는 스위칭 소자(Xs, Xh) 및 패널 캐패시터(Cp)의 X 전극과 전원(Vs/2) 사이에 직렬로 연결되어 있는 스위칭 소자(XL, Xg)를 포함한다.
Y 전극 클램핑부(330)는 스위칭 소자(Yu) 및 캐패시터(C1)를 포함한다. 스위칭 소자(Yu)는 스위칭 소자(Ys, Yh)의 접점과 접지단 사이에 연결되어 있으며, 캐패시터(C1)는 스위칭 소자(Ys, Yh)의 접점과 스위칭 소자(YL, Yg)의 접점 사이에 연결되어 있다. 마찬가지로 X 전극 클램핑부(340)는 스위칭 소자(Xu) 및 캐패시터(C2)를 포함한다. 스위칭 소자(Xu)는 스위칭 소자(Xs, Xh)의 접점과 접지단 사이에 연결되어 있으며, 캐패시터(C2)는 스위칭 소자(Xs, Xh)의 접점과 스위칭 소자(XL, Xg)의 접점 사이에 연결되어 있다.
도 4에서는 Y 및 X 전극 구동부(310, 320)와 Y 및 X 전극 클램핑부(330,340)에 포함되는 스위칭 소자(Ys, Yh, YL, Yg, Yu, Xs, Xh, XL, Xg, Xu)를 MOSFET으로 표시하였지만 이에 한정되지 않고 동일 또는 유사한 기능을 수행한다면 어떠한 스위칭 소자를 사용하여도 관계없다. 그리고 이러한 스위칭 소자는 바디 다이오드를 가지는 것이 바람직하다.
다음에 도 5a, 도 5b 및 도 6을 참조하여 본 발명의 제1 실시예에 따른 구동 회로의 구동 방법을 설명한다.
본 발명의 제1 실시예에서는 전원(Vs/2, -Vs/2)이 공급하는 전압을 각각 Vs/2 및 -Vs/2로 가정하고, 캐패시터(C1, C2)에는 Vs/2의 전압이 충전되어 있는 것으로 한다. 그리고 전압(Vs/2)은 패널의 유지방전에 필요한 전압인 유지방전 전압(Vs)의 절반에 해당하는 전압으로 가정한다.
먼저, 도 6에 나타낸 바와 같이 모드 1에서(M1)는 스위칭 소자(Xs, Xh, Yg, YL, Yu)가 꺼진 상태에서 스위칭 소자(Ys, Yh, Xg, XL, Xu)가 켜진다.
그러면, 도 5a에 나타낸 바와 같이 켜진 스위칭 소자(Ys, Yh)에 의해 패널 캐패시터(Cp)의 Y 전극에는 전원(Vs/2)의 Vs/2 전압이 인가되고, 켜진 스위칭 소자(XL, Xg)에 의해 패널 캐패시터(Cp)의 X 전극에는 전원(-Vs/2)의 -Vs/2 전압이 인가된다. 따라서 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)은 각각 Vs/2 및 -Vs/2로 되어, 패널 캐패시터(Cp)의 양단에 유지 방전 전압(Vs)이 인가된다. 그리고 스위칭 소자(Xu)가 켜지면 전원(-Vs/2)과 접지단에 의해 캐패시터(C2)는 Vs/2의 전압으로 충전되며 또한 Vs/2 이상으로 충전되지 않도록 클램핑된다.
이때, 스위칭 소자(Yh)가 켜져 있으므로 스위칭 소자(YL) 양단 전압은 캐패시터(C1)에 충전된 전압(Vs/2)으로 클램핑된다. 그리고 스위칭 소자(Ys, Yh)가 켜져 있으므로 스위칭 소자(YL, Yg)에는 전원(Vs/2)과 전원(-Vs/2)의 전압차가 인가되는데, 스위칭 소자(YL)의 양단 전압이 Vs/2 전압으로 클램핑되어 있으므로 스위칭 소자(Yg)의 양단 전압도 Vs/2 전압으로 클램핑된다.
마찬가지로, 스위칭 소자(XL)가 켜져 있으므로 스위칭 소자(Xh) 양단 전압은 캐패시터(C2)에 충전된 전압(Vs/2)으로 클램핑된다. 그리고 스위칭 소자(XL, Xg)가 켜져 있으므로 스위칭 소자(Xs, Xh)에는 전원(Vs/2)과 전원(-Vs/2)의 전압차가 인가되며, 패널 캐패시터(Cp)의 양단에 유지방전에 필요한 전압(Vs)스위칭 소자(Xh)의 양단 전압이 Vs/2 전압으로 클램핑되고 있으므로 스위칭 소자(Xs)의 양단 전압도 Vs/2 전압으로 클램핑된다.
다음, 도 6에 나타낸 바와 같이 모드 2(M2)에서는 스위칭 소자(Ys, Yh, Xg, XL, Xu)가 꺼지고 스위칭 소자(Xs, Xh, Yg, YL, Yu)가 켜진다.
그러면 도 5b에 나타낸 바와 같이 켜진 스위칭 소자(Yg, YL)에 의해 패널 캐패시터(Cp)의 Y 전극에는 전원(-Vs/2)의 전압(-Vs/2)이 인가되고, 켜진 스위칭 소자(Xs, Xh)에 의해 패널 캐패시터(Cp)의 X 전극에서는 전원(Vs/2)의 전압(Vs/2)이 인가된다. 따라서 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)은 각각 -Vs/2 및 Vs/2로 되어, 패널 캐패시터(Cp)의 양단에 유지방전 전압(Vs)이 인가된다. 그리고 스위칭 소자(Yu)가 켜져서 캐패시터(C1)는 Vs/2 전압으로 계속 충전된다.
이때, 모드 1(M1)에서 설명한 것처럼 스위칭 소자(YL)가 켜져 있으므로 스위칭 소자(Yh)의 양단 전압은 캐패시터(C1)에 충전된 전압(Vs/2)으로 클램핑된다.그리고 스위칭 소자(Yh)의 양단 전압이 Vs/2 전압으로 클램핑되어 있고 스위칭 소자(YL, Yg)가 켜져 있으므로, 스위칭 소자(Ys)의 양단 전압도 전원(Vs/2, -Vs/2)에 의해 Vs/2 전압으로 클램핑된다. 마찬가지로, 스위칭 소자(XL)는 캐패시터(C2)에 충전된 전압(Vs/2)으로 클램핑되고, 스위칭 소자(Xg)는 전원(Vs/2, -Vs/2)에 의해 Vs/2 전압으로 클램핑된다.
이와 같이 본 발명의 제1 실시예에 의하면, 패널 캐패시터(Cp)의 양단에 유지방전 전압(Vs)이 인가되는 동안에, 캐패시터(C1, C2)에 충전된 전압(Vs/2)에 의해 스위칭 소자(Ys, Yh, XL, Xg) 및 스위칭 소자(YL, Yg, Xs, Xh)의 양단 전압을 각각 Vs/2로 클램핑할 수 있다. 따라서 스위칭 소자(Ys, Yh, YL, Yg, Xs, Xh, XL, Xg)로서 낮은 내압의 스위칭 소자를 사용할 수 있다. 또한 캐패시터(C1, C2)는 패널 캐패시터(Cp)의 Y 또는 X 전극에 음의 전압을 인가하는 데 사용되지 않으므로, 종래 기술과 같이 초기 기동시 큰 돌입 전류가 발생하지 않는다.
이때, 유지방전을 위한 파형을 패널 캐패시터(Cp)에 인가하기 위해서는, 패널 캐패시터(Cp)의 캐패시턴스 성분 때문에 방전을 위한 전력 이외에 무효 전력이 필요하다. 이러한 무효 전력을 회수하여 재사용하는 회로를 전력 회수 회로라고 한다. 아래에서는 본 발명의 제1 실시예에 따른 구동 회로에 전력 회수 회로를 추가한 실시예에 대하여 도 7 내지 도 9를 참조하여 자세하게 설명한다.
도 7은 본 발명의 제2 실시예에 따른 구동 회로를 나타내는 도면이다.
도 7에 나타낸 바와 같이, 본 발명의 제2 실시예에 따른 구동 회로는 제1 실시예에 따른 구동 회로에 Y 및 X 전극 전력 회수부(350, 360)가 추가되어 형성된다.
Y 전극 전력 회수부(350)는 인덕터(L1) 및 스위칭 소자(Yr, Yf)를 포함한다. 인덕터(L1)는 일단이 Y 전극 구동부(310)의 스위칭 소자(Yh, YL)의 접점, 즉 패널 캐패시터(Cp)의 Y 전극에 연결되며, 스위칭 소자(Yr, Yf)는 인덕터(L1)의 타단과 접지단 사이에 병렬로 연결되어 있다. 이러한 Y 전극 전력 회수부(350)는 스위칭 소자(Yr, Yf)와 인덕터(L1) 사이에 각각 연결되는 다이오드(D1, D2)를 더 포함할 수 있다. 이러한 다이오드(D1, D2)는 각각 스위칭 소자(Yr, Yf)의 바디 다이오드로 인해 생길 수 있는 전류 경로를 차단한다.
X 전극 전력 회수부(360)는 인덕터(L2) 및 스위칭 소자(Xr, Xf)를 포함하며, 또한 다이오드(D3, D4)를 더 포함할 수 있다. X 전극 전력 회수부(360)의 구조에 대해서는 Y 전극 전력 회수부(350)의 구조와 동일하므로 설명을 생략한다. 그리고 Y 및 X 전극 전력 회수부(350, 360)의 스위칭 소자(Yr, Yf, Xr, Xf)는 MOSFET 등으로 이루어질 수 있다.
아래에서는 도 8a 내지 도 8h, 도 9를 참조하여, 본 발명의 제2 실시예에 따른 구동 회로의 구동 방법에 대하여 설명한다.
도 8a 내지 도 8h는 본 발명의 제2 실시예에 따른 구동 회로에서 각 모드의 전류 경로를 나타내는 도면이며, 도 9는 본 발명의 제2 실시예에 따른 구동 회로의 동작 타이밍을 나타내는 도면이다.
본 발명의 제2 실시예에서는 모드 1(M1)이 시작되기 전에 스위칭 소자(Ys, Yh, Xg, XL, Xu)가 켜져 있으며, 스위칭 소자(Xs, Xh, Yg, YL, Yu, Xr, Yf, Xf,Yr)는 껴져 있는 것으로 가정한다. 또한 캐패시터(C1, C2)에는 Vs/2의 전압이 충전되어 있으며, 인덕터(L1, L2)의 인덕턴스는 L로 가정한다.
도 8a 및 도 9에 나타낸 바와 같이, 모드 1(M1)에서는 모드 1(M1) 이전부터 전원(Vs/2), 스위칭 소자(Ys, Yh), 패널 캐패시터(Cp), 스위칭 소자(XL, Xg) 및 전원(-Vs/2)으로 형성된 전류 경로(81)에 의해, 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)은 각각 Vs/2 및 -Vs/2로 계속 유지되어 있다. 그리고 접지단, 스위칭 소자(Xu), 캐패시터(C2) 및 전원(-Vs/2)으로 형성된 전류 경로(82)에 의해 캐패시터(C2)는 Vs/2 전압으로 클램핑되어 있다. 또한 제1 실시예의 모드 1(M1)에서 설명한 것처럼, 캐패시터(C1)에 충전된 전압(Vs/2)에 의해 두 스위칭 소자(YL, Yg)는 그 양단 전압이 각각 Vs/2로 클램핑되며, 캐패시터(C2)에 충전된 전압(Vs/2)에 의해 두 스위칭 소자(Xs, Xh)의 양단 전압은 각각 Vs/2로 클램핑된다.
이때, 모드 1(M1)에서는 스위칭 소자(Yf, Xr)가 켜져서 전원(Vs/2), 스위칭 소자(Ys, Yh), 인덕터(L1), 다이오드(D2), 스위칭 소자(Yf) 및 접지단으로의 전류 경로(83) 및 접지단, 스위칭 소자(Xr), 다이오드(D3), 인덕터(L2), 스위칭 소자(XL, Xg) 및 전원(-Vs/2)으로의 전류 경로(84)가 형성된다. 이 전류 경로(83, 84)에 의해 인덕터(L1, L2)에 흐르는 전류(IL1, IL2)의 크기는 각각 Vs/2L의 기울기를 가지고 선형적으로 증가하며, 이 전류(IL1, IL2)에 의해 인덕터(L1, L2)에는 에너지가 축적된다.
다음, 모드 2(M2)에서는 스위칭 소자(Yf, Xr)가 켜진 상태에서 스위칭소자(Ys, Yh, Xg, XL, Xu)가 꺼진다. 그러면 도 8b에 나타낸 바와 같이 스위칭 소자(Xr), 다이오드(D3), 인덕터(L2), 패널 캐패시터(Cp), 인덕터(L1), 다이오드(D2) 및 스위칭 소자(Yf)로 전류 경로(85)가 형성되어, 인덕터(L1, L2)와 패널 캐패시터(Cp)에 의한 공진 전류가 흐른다. 이 공진 전류에 의해 패널 캐패시터(Cp)의 Y 전극 전압(Vy)은 -Vs/2로 하강하고 X 전극 전압(Vx)은 Vs/2로 증가하게 되며, 이들 전압은 각각 스위칭 소자(YL, Yg) 및 스위칭 소자(Xs, Xh)의 바디 다이오드에 의해 -Vs/2 및 Vs/2를 넘지 않는다.
이와 같이 모드 2(M2)에서는 모드 1(M1)에서 인덕터(L1, L2)에 축적한 에너지와 공진 전류를 이용하여 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)을 바꾸므로, 회로에 기생 성분이 있는 경우에도 Y 및 X 전극 전압(Vy, Vx)을 각각 -Vs/2 및 Vs/2까지 바꿀 수 있다.
모드 3(M3)에서는, 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)이 각각 -Vs/2 및 Vs/2로 되었을 때 이 전압을 유지하기 위해서 스위칭 소자(Xs, Xh, Yg, YL)가 켜진다. 그러면 도 8c에 나타낸 바와 같이 전원(Vs/2), 스위칭 소자(Xs, Xh), 패널 캐패시터(Cp), 스위칭 소자(YL, Yg) 및 전원(-Vs/2)으로의 경로(86)를 통하여 패널 캐패시터(Cp)의 X 및 Y 전극 전압(Vy, Vx)은 각각 Vs/2 및 -Vs/2로 유지된다.
또한 인덕터(L1)에 흐르던 전류(IL1)는 스위칭 소자(Yg, YL)의 바디 다이오드, 인덕터(L1), 다이오드(D2) 및 스위칭 소자(Yf)로 형성되는 경로(87)를 통하여접지단으로 회수되고, 인덕터(L2)에 흐르던 전류(IL2)는 스위칭 소자(Xr), 다이오드(D3), 인덕터(L2) 및 스위칭 소자(Xh, Xs)의 바디 다이오드로 형성되는 경로(88)를 통하여 전원(Vs/2)으로 회수된다. 따라서, 인덕터(L1, L2)에 각각 흐르는 전류(IL1, IL2)의 크기는 Vs/2/L의 기울기를 가지고 선형적으로 0A까지 감소한다.
또한 스위칭 소자(Yu)가 켜져서 접지단, 스위칭 소자(Yu), 캐패시터(C1), 스위칭 소자(Yg) 및 전원(-Vs/2)의 루프(89)를 통하여, 캐패시터(C1)에 Vs/2의 전압을 충전시키면서 캐패시터(C1)가 Vs/2 이상으로 충전되지 않도록 클램핑한다. 그리고 제1 실시예의 모드 2에서 설명한 것처럼 캐패시터(C1)에 충전된 전압(Vs/2)에 의해 두 스위칭 소자(Ys, Yh)는 그 양단 전압이 각각 Vs/2로 클램핑되며, 캐패시터(C2)에 충전된 전압(Vs/2)에 의해 두 스위칭 소자(XL, Xg)의 양단 전압은 각각 Vs/2로 클램핑된다.
이때, 인덕터(L1, L2)에 흐르는 전류(IL1, IL2)가 0A로 되면 스위칭 소자(Yf, Xr)를 꺼서 전류 경로(87, 88)를 차단한다[모드 4(M4)]. 그리고 도 8d에 나타낸 바와 같이 스위칭 소자(YL, Yg, Xs, Xh)는 계속 켜져 있으므로 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)은 각각 -Vs/2 및 Vs/2로 계속 유지된다. 또한 모드 3(M3)에서와 마찬가지로 스위칭 소자(Ys, Yh, XL, Xg)의 양단 전압은 Vs/2로 클램핑되어 있다.
다음, 모드 5(M5)에서는 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)을 각각 -Vs/2 및 Vs/2로 유지하면서 인덕터(L1, L2)에 에너지를 축적한다. 자세하게설명하면, 스위칭 소자(Yr, Xf)가 켜져서, 도 8e에 나타낸 바와 같이 접지단, 스위칭 소자(Yr), 다이오드(D1), 인덕터(L1), 스위칭 소자(YL, Yg) 및 전원(-Vs/2)으로의 전류 경로(90)와 전원(Vs/2), 스위칭 소자(Xs, Xh), 인덕터(L2), 다이오드(D4), 스위칭 소자(Xf) 및 접지단으로의 전류 경로(91)가 형성된다. 이 전류 경로(90, 91)에 의해 인덕터(L1, L2)에 흐르는 전류(IL1, IL2)는 Vs/2L의 기울기를 가지고 선형적으로 증가하며, 이 전류(IL1, IL2)에 의해 인덕터(L1, L2)에는 에너지가 축적된다.
이와 같이 인덕터(L1, L2)에 에너지를 축적한 후, 모드 6(M6)에서는 스위칭 소자(Xs, Xh, YL, Yg, Xu)를 끈다. 그러면 스위칭 소자(Yr), 다이오드(D1), 인덕터(L1), 패널 캐패시터(Cp), 인덕터(L2), 다이오드(D4) 및 스위칭 소자(Xf)로 전류 경로(92)가 형성되어, 인덕터(L1, L2)와 패널 캐패시터(Cp)에 의한 공진 전류가 흐른다. 이 공진 전류에 의해 패널 캐패시터(Cp)의 Y 전극 전압(Vy)은 Vs/2로 상승하고 X 전극 전압(Vx)은 -Vs/2로 하강하게 되며, 이들 전압은 각각 스위칭 소자(Ys, Yh) 및 스위칭 소자(XL, Xg)의 바디 다이오드에 의해 Vs/2 및 -Vs/2를 넘지 않는다.
모드 6(M6)에서도 모드 2(M2)와 같이 인덕터(L1, L2)에 에너지를 축적하고 이 에너지와 공진 전류를 이용하여 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)을 변화시키기 때문에, 회로의 기생 성분 등이 있는 실제의 경우에도 Y 및 X 전극 전압(Vy, Vx)을 각각 Vs/2 및 -Vs/2까지 변화시킬 수 있다.
모드 7(M7)에서는, 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)이 각각 Vs/2 및 -Vs/2로 되었을 때 이 전압을 유지하기 위해서 스위칭 소자(Ys, Yh, XL, Xg)가 켜진다. 그러면 전원(Vs/2), 스위칭 소자(Ys, Yh), 패널 캐패시터(Cp), 스위칭 소자(XL, Xg) 및 전원(-Vs/2)으로의 경로(81)에 의해 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)은 각각 Vs/2 및 -Vs/2로 유지된다.
이때, 인덕터(L1)에 흐르던 전류(IL1)는 스위칭 소자(Yr), 다이오드(D1), 인덕터(L1) 및 스위칭 소자(Yh, Ys)의 바디 다이오드로 형성되는 경로(93)를 통하여 전원(Vs/2)으로 회수되고, 인덕터(L2)에 흐르던 전류(IL2)는 스위칭 소자(Xg, XL)의 바디 다이오드, 인덕터(L2), 다이오드(D4) 및 스위칭 소자(Xf)로 형성되는 경로(94)를 통하여 접지단으로 회수된다.
또한 스위칭 소자(Xu)가 켜져서 접지단, 스위칭 소자(Xu), 캐패시터(C2), 스위칭 소자(Xg) 및 전원(-Vs/2)의 경로(82)를 통하여, 캐패시터(C2)에는 Vs/2의 전압이 충전되면서 Vs/2 이상으로 충전되지 않도록 클램핑된다. 그리고 본 발명의 제1 실시예의 모드 1에서 설명한 바와 같이 캐패시터(C1)에 충전된 전압(Vs/2)에 의해 스위칭 소자(YL, Yg)의 양단 전압은 Vs/2로 클램핑되고, 캐패시터(C2)에 충전된 전압(Vs/2)에 의해 스위칭 소자(Xs, Xh)의 양단 전압은 Vs/2로 클램핑된다.
다음, 모드 8(M8)에서는 인덕터(L1, L2)에 흐르는 전류(IL1, IL2)가 0A로 되었을 때, 스위칭 소자(Yr, Xf)가 꺼져서 경로(93, 94)가 차단된다. 그리고 스위칭 소자(Ys, Yh, XL, Xg)는 켜져 있으므로 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy,Vx)은 각각 Vs/2 및 -Vs/2로 계속 유지된다. 또한 모드 7(M7)에서와 마찬가지로 스위칭 소자(Xs, Xh, YL, Yg)의 양단 전압은 Vs/2로 계속 클램핑되어 있다.
이후, 모드 1 내지 모드 8의 사이클을 계속 반복하여 Vs/2 및 -Vs/2 사이를 스윙하는 Y 및 X 전극 전압(Vy, Vx)을 생성함으로써, X 전극과 Y 전극간의 전위차를 유지방전 전압(Vs)으로 할 수 있다.
본 발명의 제2 실시예에서는 Y 전극 및 X 전극 전력 회수부(350, 360)에 각각 인덕터를 하나씩 사용하였지만, 이에 한정되지 않고 다른 변형된 모든 전력 회수부를 사용할 수 있다. 예를 들면, Y 전극 전력 회수부(350)에 서로 다른 경로를 형성하는 인덕터(L11, L12)를 사용할 수 있다. 자세하게 설명하면, Y 전극 전압이 Vs/2를 유지하고 있는 동안에는 인덕터(L11)에 에너지를 축적하고 이 에너지를 이용하여 Y 전극 전압을 -Vs/2로 바꾼다. 다음에 Y 전극 전압이 -Vs/2를 유지하고 있는 동안에는 인덕터(L11)의 에너지를 회수하면서 인덕터(L12)에는 에너지를 축적하고, 이 에너지를 이용하여 Y 전극 전압을 Vs/2로 바꾼다.
그리고 본 발명의 제1 및 제2 실시예에서는 전원(Vs/2) 및 전원(-Vs/2)이 공급하는 전압을 각각 Vs/2 및 -Vs/2로 하였지만, 두 전원의 전압 차이가 유지방전에 필요한 전압인 Vs로 된다면 다른 전압을 사용하여도 된다. 즉, 전원이 공급하는 전압을 각각 Vh 및 (Vh-Vs)로 해서, Y 및 X 전극 전압(Vy, Vx)이 Vh 및 (Vh-Vs) 사이를 스윙하도록 할 수 있다.
예를 들어 본 발명의 제1 실시예에서 전원으로 각각 Vs 전압을 공급하는 전원(Vs)과 접지단을 사용한 실시예에 대해서 도 10을 참조하여 설명한다.
도 10은 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동 회로를 나타내는 도면이다.
도 10에 나타낸 바와 같이, 본 발명의 제3 실시예에 따른 구동 회로는 각각 Vs/2 전압을 공급하는 두 개의 전원(Vs/21, Vs/22)을 사용한다. 자세하게 설명하면, Y 및 X 전극 구동부(310, 320)의 스위칭 소자(Ys, Xs)는 직렬로 연결된 두 개의 전원(Vs/21, Vs/22)에 연결되어 있으며, 스위칭 소자(Yg, Xg)는 접지단에 연결되어 있다. 그리고 Y 및 X 전극 클램핑부(330, 340)의 스위칭 소자(Yu, Xu)는 두 개의 전원(Vs/21, Vs/22)의 접점에 연결되어 있다.
본 발명의 제3 실시예에 따른 구동 회로의 동작은 제1 실시예와 패널 캐패시터(Cp)의 Y 및 X 전극 전압(Vy, Vx)에 인가되는 전압을 제외하면 동일하다. 그리고 캐패시터(C1)에는 스위칭 소자(Yu)가 켜질 때 Vs/2의 전압이 충전되고 마찬가지로 캐패시터(C2)에는 스위칭 소자(Xu)가 켜질 때 Vs/2의 전압이 충전된다.
자세하게 설명하면, 모드 1에서는 패널 캐패시터(Cp)의 Y 및 X 전극에는 각각 Vs 및 0V의 전압이 인가된다. 그리고 캐패시터(C1)에 충전된 전압(Vs/2)에 의해 스위칭 소자(YL)의 양단 전압은 Vs/2로 클램핑되고, 스위칭 소자(YL)의 양단 전압(Vs/2)과 직렬로 연결된 전원(Vs/21, Vs/22)의 전압(Vs)에 의해 스위칭 소자(Yg)의 양단 전압도 Vs/2로 클램핑된다. 마찬가지로 캐패시터(C2)에 충전된 전압(Vs/2)에 의해 스위칭 소자(Xh)의 양단 전압은 Vs/2로 클램핑되고, 스위칭 소자(Xh)의 양단 전압(Vs/2)과 직렬로 연결된 전원(Vs/21, Vs/2)의 전압(Vs)에 의해스위칭 소자(Xs)의 양단 전압도 Vs/2로 클램핑된다.
모드 2에서는 패널 캐패시터(Cp)의 Y 및 X 전극에는 각각 0V 및 Vs의 전압이 인가된다. 앞에서 설명한 것처럼 캐패시터(C1, C2)에 각각 충전된 전압(Vs/2)과 직렬로 연결된 전원(Vs/21, Vs/22)의 전압(Vs)에 의해 스위칭 소자(Ys, Yh, XL, Xg)의 양단 전압은 각각 Vs/2로 클램핑된다.
또한 본 발명의 제1 내지 제3 실시예에서는 전원과 패널 캐패시터(Cp)의 X 또는 Y 전극 사이에 스위칭 소자가 두 개 형성되는 경우에 대하여 설명하였지만, 이에 한정되지 않고 스위칭 소자가 여러 개 형성되는 경우에도 적용 가능하다. 예를 들어 본 발명의 제1 실시예에서 전원(Vs/2)과 패널 캐패시터(Cp)의 Y 전극 사이에 네 개의 스위칭 소자(S1, S2, S3, S4)가 직렬로 연결되고 패널 캐패시터(Cp)의 Y 전극과 전원(-Vs/2) 사이에 네 개의 스위칭 소자(S5, S6, S7, S8)가 직렬로 연결된다고 가정하자. 이때, 스위칭 소자(S2, S3)의 접점과 스위칭 소자(S6, S7)의 접점 사이에 캐패시터(C1)를 연결하면, 인접한 두 개의 스위칭 소자[S1, S2), (S3, S4), (S5, S6), (S7, S8)]에 각각 Vs/2의 전압이 걸린다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
이와 같이 본 발명에 의하면, 스위칭 소자의 내압을 유지방전에 필요한전압(Vs)의 절반으로 할 수 있으므로 낮은 내압의 스위칭 소자를 사용할 수 있으며, 이에 따라 생산 단가를 줄일 수 있다. 그리고 외부 캐패시터에 충전된 전압을 사용하여 패널 캐패시터의 단자 전압을 바꾸는 경우에 발생할 수 있는 돌입 전류를 제거할 수 있다. 또한 구동 회로에 인가되는 전원을 바꿈으로써 유지방전 전압 펄스의 파형에 관계없이 본 발명에 따른 구동 회로를 적용할 수 있다.

Claims (20)

  1. 패널 캐패시터가 형성되는 플라즈마 디스플레이 패널에 있어서,
    제1 전압을 공급하는 제1 전원과 상기 패널 캐패시터의 일단 사이에 직렬로 연결되는 제1 및 제2 스위칭 소자,
    상기 패널 캐패시터의 일단과 제2 전압을 공급하는 제2 전원 사이에 직렬로 연결되는 제3 및 제4 스위칭 소자,
    상기 제1 및 제2 스위칭 소자의 접점과 상기 제3 및 제4 스위칭 소자의 접점 사이에 연결되는 제1 캐패시터, 그리고
    상기 제1 캐패시터의 일단과 제3 전압을 공급하는 제3 전원 사이에 연결되는 제5 스위칭 소자
    를 포함하는 플라즈마 디스플레이 패널.
  2. 제1항에 있어서,
    상기 제5 스위칭 소자가 켜져서 상기 제1 캐패시터에는 상기 제3 및 제2 전압의 차에 해당하는 전압이 충전되는 플라즈마 디스플레이 패널.
  3. 제1항에 있어서,
    상기 제3 전압은 상기 제1 및 제2 전압의 중간 전압인 플라즈마 디스플레이 패널.
  4. 제1항에 있어서,
    상기 패널 캐패시터의 일단에 일단이 연결되는 적어도 하나의 인덕터, 그리고
    상기 인덕터의 타단과 상기 제3 전원 사이에 병렬로 전기적으로 연결되는 제6 및 제7 스위칭 소자
    를 더 포함하는 플라즈마 디스플레이 패널.
  5. 제1항 내지 제4항 중 어느 한 항에 있어서,
    상기 제1 및 제2 스위칭 소자와 상기 제3 및 제4 스위칭 소자가 교대로 켜져서 상기 패널 캐패시터의 일단에 상기 제1 전압과 제2 전압이 교대로 인가되며,
    상기 패널 캐패시터의 타단에는 제4 전압과 제5 전압이 교대로 인가되는 플라즈마 디스플레이 패널.
  6. 제1항 내지 제4항 중 어느 한 항에 있어서,
    상기 제1 전원과 상기 패널 캐패시터의 타단 사이에 직렬로 연결되는 제6 및 제7 스위칭 소자,
    상기 패널 캐패시터의 타단과 상기 제2 전원 사이에 직렬로 연결되는 제8 및 제9 스위칭 소자,
    상기 제6 및 제7 스위칭 소자의 접점과 상기 제8 및 제9 스위칭 소자의 접점 사이에 연결되는 제2 캐패시터, 그리고
    상기 제2 캐패시터의 일단과 상기 제3 전원에 연결되는 제10 스위칭 소자
    를 더 포함하는 플라즈마 디스플레이 패널.
  7. 패널 캐패시터가 형성되는 플라즈마 디스플레이 패널에 있어서,
    제1 전압을 공급하는 제1 전원과 상기 패널 캐패시터의 일단 사이에 직렬로 연결되는 제1 및 제2 스위칭 소자,
    상기 패널 캐패시터의 일단과 제2 전압을 공급하는 제2 전원 사이에 직렬로 연결되는 제3 및 제4 스위칭 소자, 그리고
    상기 제1 전압과 제2 전압의 차보다 작은 제3 전압으로 충전되며, 제1 단이 상기 제1 및 제2 스위칭 소자의 접점에 연결되고 제2단이 상기 제3 및 제4 스위칭 소자의 접점에 연결되는 제1 캐패시터
    를 포함하며,
    상기 제1 및 제2 스위칭 소자와 상기 제3 및 제4 스위칭 소자가 교대로 켜져서, 상기 패널 캐패시터의 일단에 상기 제1 및 제2 전압을 교대로 인가하는 플라즈마 디스플레이 패널.
  8. 제7항에 있어서,
    상기 제3 전압은 상기 제1 및 제2 전압의 차의 절반에 해당하는 전압인 플라즈마 디스플레이 패널.
  9. 제8항에 있어서,
    상기 제1 및 제2 전압의 중간 전압을 공급하는 제3 전웝과 상기 제1 캐패시터의 제1단 사이에 연결되며, 상기 제3 및 제4 스위칭 소자가 켜질 때 켜지는 제5 스위칭 소자를 더 포함하는 플라즈마 디스플레이 패널.
  10. 제7항에 있어서,
    상기 제1 및 제2 전압 사이의 전압을 공급하는 제3 전원과 상기 제1 캐패시터의 제1단 사이에 연결되며, 상기 제3 및 제4 스위칭 소자가 켜질 때 켜지는 제5 스위칭 소자를 더 포함하는 플라즈마 디스플레이 패널.
  11. 제7항에 있어서,
    상기 패널 캐패시터의 일단에 전기적으로 연결되는 적어도 하나의 인덕터를 포함하며, 상기 인덕터와 상기 패널 캐패시터 사이에서 발생하는 공진을 이용하여 상기 패널 캐패시터의 단자 전압을 바꾸는 전력 회수부
    를 더 포함하는 플라즈마 디스플레이 패널.
  12. 제11항에 있어서,
    상기 전력 회수부는, 상기 인덕터의 타단과 상기 제3 전원 사이에 병렬로 연결되는 제7 및 제8 스위칭 소자를 더 포함하는 플라즈마 디스플레이 패널.
  13. 제7항 내지 제12항 중 어느 한 항에 있어서,
    상기 패널 캐패시터의 일단에 상기 제1 전압과 제2 전압이 교대로 인가될 때 상기 패널 캐패시터의 타단에 제5 전압과 제6 전압이 교대로 인가되는 플라즈마 디스플레이 패널.
  14. 제7항 내지 제12항 중 어느 한 항에 있어서,
    상기 제1 전원과 상기 패널 캐패시터의 타단 사이에 직렬로 연결되는 제5 및 제6 스위칭 소자,
    상기 패널 캐패시터의 타단과 상기 제2 전원 사이에 직렬로 연결되는 제7 및 제8 스위칭 소자, 그리고
    상기 제3 전압으로 충전되며, 제1단이 상기 제5 및 제6 스위칭 소자의 접점에 연결되고 제2단이 상기 제7 및 제8 스위칭 소자의 접점에 연결되는 제2 캐패시터
    를 더 포함하며,
    상기 패널 캐패시터의 일단에 상기 제1 전압이 인가될 때 상기 제7 및 제8 스위칭 소자가 켜져서 상기 패널 캐패시터의 타단에 상기 제2 전압이 인가되며, 상기 패널 캐패시터의 일단에 상기 제2 전압이 인가될 때 상기 제5 및 제6 스위칭 소자가 켜져서 상기 패널 캐패시터의 타단에 상기 제1 전압이 인가되는
    플라즈마 디스플레이 패널.
  15. 패널 캐패시터의 일단에 연결된 제1 및 제2 경로를 통하여 각각 제1 및 제2 전압을 번갈아 인가하면서 플라즈마 디스플레이 패널을 구동하는 방법에 있어서,
    상기 제1 경로는 상기 패널 캐패시터의 일단과 상기 제1 전압을 공급하는 제1 전원 사이에 직렬로 전기적으로 연결되는 복수의 제1 스위칭 소자를 포함하고, 상기 제2 경로는 상기 패널 캐패시터의 일단과 상기 제2 전압을 공급하는 제2 전원 사이에 직렬로 전기적으로 연결되는 복수의 제2 스위칭 소자를 포함하며,
    상기 구동 방법은,
    소정 전압으로 충전된 캐패시터의 제1단과 제2단을 각각 상기 직렬로 연결된 복수의 제1 스위칭 소자 사이의 접점 중 어느 하나의 제1 접점과 상기 직렬로 연결된 복수의 제2 스위칭 소자의 접점 중 어느 하나의 제2 접점에 연결한 상태에서, 상기 제1 경로를 통하여 상기 패널 캐패시터의 일단에 상기 제1 전압을 인가하는 제1 단계, 그리고
    상기 캐패시터의 제1단과 제2단을 각각 상기 제1 접점과 제2 접점에 연결하고 상기 캐패시터의 제1단을 상기 제1 전압과 제2 전압 사이의 전압인 제3 전압을 공급하는 전원에 연결한 상태에서, 상기 제2 경로를 통하여 상기 패널 캐패시터의 일단에 상기 제2 전압을 인가하는 제2 단계
    를 포함하는 플라즈마 디스플레이 패널의 구동 방법.
  16. 제15항에 있어서,
    상기 제2 단계에서 상기 캐패시터는 상기 소정 전압으로 충전되는 플라즈마 디스플레이 패널의 구동 방법.
  17. 제15항에 있어서,
    상기 패널 캐패시터의 일단에 상기 제1 전압을 인가하기 전에, 상기 패널 캐패시터의 일단에 전기적으로 연결되는 인덕터와 상기 패널 캐패시터 사이의 공진을 이용하여 상기 패널 캐패시터의 일단 전압을 증가시키는 제1 공진 단계, 그리고
    상기 패널 캐패시터의 일단에 상기 제2 전압을 인가하기 전에, 상기 인덕터와 상기 패널 캐패시터 사이의 공진을 이용하여 상기 패널 캐패시터의 일단 전압을 감소시키는 제2 공진 단계
    를 더 포함하는 플라즈마 디스플레이 패널의 구동 방법.
  18. 제17항에 있어서,
    상기 제1 공진 단계 전에, 상기 제3 전압을 공급하는 전원, 상기 인덕터 및 상기 제2 경로로 형성되는 경로를 통하여 상기 인덕터에 에너지를 저장하는 단계, 그리고
    상기 제2 공진 단계 전에, 상기 제1 경로, 상기 인덕터 및 상기 전원으로 형성되는 경로를 통하여 상기 인덕터에 에너지를 저장하는 단계
    를 더 포함하는 플라즈마 디스플레이 패널의 구동 방법.
  19. 제15항 내지 제18항 중 어느 한 항에 있어서,
    상기 제3 전압은 상기 제1 전압과 상기 제2 전압의 중간 전압인 플라즈마 디스플레이 패널의 구동 방법
  20. 제15항 내지 제18항 중 어느 한 항에 있어서,
    상기 패널 캐패시터의 일단에 상기 제1 전압과 제2 전압이 번갈아 인가되는 동안 상기 패널 ㅋ패시터의 타단에는 제4 전압과 제5 전압이 번갈아 인가되는 플라즈마 디스플레이 패널의 구동 방법.
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