JPS63185656A - サ−マルプリンタの印字制御装置 - Google Patents
サ−マルプリンタの印字制御装置Info
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- JPS63185656A JPS63185656A JP1755187A JP1755187A JPS63185656A JP S63185656 A JPS63185656 A JP S63185656A JP 1755187 A JP1755187 A JP 1755187A JP 1755187 A JP1755187 A JP 1755187A JP S63185656 A JPS63185656 A JP S63185656A
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- head
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- 230000003247 decreasing effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 10
- 230000020169 heat generation Effects 0.000 description 8
- 238000000034 method Methods 0.000 description 8
- 238000010438 heat treatment Methods 0.000 description 5
- 238000009825 accumulation Methods 0.000 description 1
- 210000004899 c-terminal region Anatomy 0.000 description 1
- 230000002596 correlated effect Effects 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
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- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
- B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
- B41J2/35—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads providing current or voltage to the thermal head
-
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- B41J2/355—Control circuits for heating-element selection
- B41J2/36—Print density control
- B41J2/365—Print density control by compensation for variation in temperature
Landscapes
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はサーマルプリンタに関し、特にその発熱要素の
駆動方法に閃するものである。
駆動方法に閃するものである。
従来からサーマルプリンタでは、サーマルへ・ラドの連
続使用時の熱蓄積による印字品位の低下を防止するため
、様々な方法が用いられてきている。その中には特公昭
５５−４８０３１のように、ドツトごとに前のデータを
記憶して通電時間を決定する方法や、特公昭５７−１８
５０７のように駆動周期によって通電時間を変える方式
等が用いられている。これらを一般に履歴制御方式と言
う。
続使用時の熱蓄積による印字品位の低下を防止するため
、様々な方法が用いられてきている。その中には特公昭
５５−４８０３１のように、ドツトごとに前のデータを
記憶して通電時間を決定する方法や、特公昭５７−１８
５０７のように駆動周期によって通電時間を変える方式
等が用いられている。これらを一般に履歴制御方式と言
う。
これら従来例では一般にＣＩ’Ｕによってデータ処理を
しながら、サーマルヘッドのドライブ１ｃへ順次データ
を送出する方式が一般的であった。
しながら、サーマルヘッドのドライブ１ｃへ順次データ
を送出する方式が一般的であった。
このような方式では、サーマルプリンタを高速に動作さ
せようとしても処理が追い付かずサーマルプリンタの高
速化の障害となっていた。
せようとしても処理が追い付かずサーマルプリンタの高
速化の障害となっていた。
本発明のに１的は、このような従来の問題点を除去し、
高速でかつ、印字品位のすぐれたシリアル型サーマルプ
リンタの印字制御装置を提供することにある。
高速でかつ、印字品位のすぐれたシリアル型サーマルプ
リンタの印字制御装置を提供することにある。
本発明によるサーマルプリンタの印字＋ｌｒ＋制御装置
は、前記サーマルヘッドの温度もしくはその周囲温度を
検ｌｉｔする感熱素子と、該感熱素子を包含し、前記温
度に応じて発振周波数の変化する発振回路と、前記サー
マルヘッドのそれぞれの発熱要素の駆動履歴を少くとも
過去２回以上記憶する記憶手段とを有し、前記発熱要素
の基本となる全通電時間と、駆動履歴に応じて減する通
電区間を前記発振回路にて決定することを特徴とするサ
ーマルプリンタの印字制御ｋ ’Ｉｔである。
は、前記サーマルヘッドの温度もしくはその周囲温度を
検ｌｉｔする感熱素子と、該感熱素子を包含し、前記温
度に応じて発振周波数の変化する発振回路と、前記サー
マルヘッドのそれぞれの発熱要素の駆動履歴を少くとも
過去２回以上記憶する記憶手段とを有し、前記発熱要素
の基本となる全通電時間と、駆動履歴に応じて減する通
電区間を前記発振回路にて決定することを特徴とするサ
ーマルプリンタの印字制御ｋ ’Ｉｔである。
第１図は本発明によるサーマルプリンタの印字制御装置
のＨｉ成を示す略図である。
のＨｉ成を示す略図である。
１は複数の発熱要素１ａを存するサーマルヘッド、２は
このサーマルヘッドをドライブするヘッドドライブ回路
、３はＣＰＵ４とサーマルヘッド１の間に挿入されサー
マルヘッドへの発熱量をコントロールするヘッド発熱制
御回路ユニット、ＣＰＵ４はサーマルプリンタ全体をも
総括制御している。１８はヘッド発熱制御回路ユニット
３へ二種類以上のパルス幅ををするパルスを供給するパ
ルス発生回路で、サーマルヘッドｌの温度、もしくはそ
の周囲温度を検出する感熱素子の一種のサーミスタ１４
を育している。
このサーマルヘッドをドライブするヘッドドライブ回路
、３はＣＰＵ４とサーマルヘッド１の間に挿入されサー
マルヘッドへの発熱量をコントロールするヘッド発熱制
御回路ユニット、ＣＰＵ４はサーマルプリンタ全体をも
総括制御している。１８はヘッド発熱制御回路ユニット
３へ二種類以上のパルス幅ををするパルスを供給するパ
ルス発生回路で、サーマルヘッドｌの温度、もしくはそ
の周囲温度を検出する感熱素子の一種のサーミスタ１４
を育している。
ＣＰＵ４は、−例として８ビツトのＣＰＵでデータバス
１６、アドレスバス１７、ＷＲ信号などを有している。
１６、アドレスバス１７、ＷＲ信号などを有している。
ヘッド発熱制御回路ユニット３は一例としてゲートアレ
イで構成され、ＣＰＵ４と同様ワンチップ化されている
。以下ヘッド発熱制御回路ユニットはＩ−Ｉ ＣＵと略
して説明する。
イで構成され、ＣＰＵ４と同様ワンチップ化されている
。以下ヘッド発熱制御回路ユニットはＩ−Ｉ ＣＵと略
して説明する。
ＨＣＵ ３は記憶手段の一種であるデータラッチ回路を
内蔵しデータバス１６に接続されたデータ入力端子５．
アドレスバス１７の下位２ビツトヲ入力するアドレス入
力端子８、ＣＰＵ４からの所定のアドレス情報に応じ、
そのユニットの指定を知るユニットセレクト端子の一種
であるチップセレクト端子（Ｃ端子）７、ＣＰＵ４の口
信号にＩＮされたデータラッチタイミング入力端子、発
熱要素への通電時間を決定する複数の通電パルス入力端
子の、サーマルヘッドｌのそれぞれの発熱要素への駆動
信号を出力するヘッド駆動出力端子ｌＯを少くとも有し
ている。
内蔵しデータバス１６に接続されたデータ入力端子５．
アドレスバス１７の下位２ビツトヲ入力するアドレス入
力端子８、ＣＰＵ４からの所定のアドレス情報に応じ、
そのユニットの指定を知るユニットセレクト端子の一種
であるチップセレクト端子（Ｃ端子）７、ＣＰＵ４の口
信号にＩＮされたデータラッチタイミング入力端子、発
熱要素への通電時間を決定する複数の通電パルス入力端
子の、サーマルヘッドｌのそれぞれの発熱要素への駆動
信号を出力するヘッド駆動出力端子ｌＯを少くとも有し
ている。
１１はＣＩ’ Ｕ ４のアドレス情報からＩＩ ＣＵ
３に当てられた所定のアドレスコードを作るデコーダで
ある。
３に当てられた所定のアドレスコードを作るデコーダで
ある。
１２はＣＩ’ Ｕ ４の制御プログラムやキャラクタジ
ェネレータ等を格納するＲＯＭ、１３はＲＡＭｌ １５
は電源を示している。
ェネレータ等を格納するＲＯＭ、１３はＲＡＭｌ １５
は電源を示している。
第２図はＩＩ ＣＵ ３の一実施例を示す詳細回路図で
あり、第１図と同一物は同一番号で示している。
あり、第１図と同一物は同一番号で示している。
データ入力端子５はＤ０〜Ｄ７の８ビツトデータがパラ
レルに入力可能である。
レルに入力可能である。
２１から２９は８ビツトのデータを保存するデータラッ
チ回路をそれぞれ示し、２１〜２３はヘッド駆動信号の
１１．〜Ｉ４□のデータを保持し、２４〜２６はＩ−１
、〜Ｈ，，のデータを、２７〜２９はＨｌ、〜Ｉ１．．
のデータをそれぞれラッチしている。
チ回路をそれぞれ示し、２１〜２３はヘッド駆動信号の
１１．〜Ｉ４□のデータを保持し、２４〜２６はＩ−１
、〜Ｈ，，のデータを、２７〜２９はＨｌ、〜Ｉ１．．
のデータをそれぞれラッチしている。
ヘッド駆動出力は一例として２４ドツトのサーマルヘッ
ドを駆動するものとして２４コの出力端子ｌｉｅ〜Ｉ１
．．を有している。
ドを駆動するものとして２４コの出力端子ｌｉｅ〜Ｉ１
．．を有している。
３１は現在のへラドデータの１ビツト列分を保持するラ
ッチ回路群であり、３２は１回前の過去のデータの１ビ
ツト列分を、３３は２回前の過去のデータの１ビツト列
分をそれぞれ保「するラッチ回路群を示している。
ッチ回路群であり、３２は１回前の過去のデータの１ビ
ツト列分を、３３は２回前の過去のデータの１ビツト列
分をそれぞれ保「するラッチ回路群を示している。
３０はＣＰＵのデータ出力のアドレス情報によってヘッ
ドデータを８ビツトごとにふり分けて格納するためのア
ドレスデコーダであり、−例としてアドレスデータの下
位２ビツト八〇％Ａ＋のビット情報によってデータラッ
チ回路２１．２４．２７を選択可能である。３４は通電
パルス入力端子から人力されたパルスを通電区間信号に
変換ずるゲート回路である。これはパルス発生回路１８
の出力信号がもともと通電区間信号として出力されてい
る場合は不要である。
ドデータを８ビツトごとにふり分けて格納するためのア
ドレスデコーダであり、−例としてアドレスデータの下
位２ビツト八〇％Ａ＋のビット情報によってデータラッ
チ回路２１．２４．２７を選択可能である。３４は通電
パルス入力端子から人力されたパルスを通電区間信号に
変換ずるゲート回路である。これはパルス発生回路１８
の出力信号がもともと通電区間信号として出力されてい
る場合は不要である。
ＣＩ） Ｕ ４からデータバスにヘッド駆動データが出
力されると同時に、ＷＲ倍信号出力され、あらかじめＣ
ＰＵ４のメモリマツプ上に定めたアドレス情報によって
３端子がアクセスされ、アドレスバスの下位２ビツトの
情報によってデークラッチ回路２１．２４．２７のそれ
ぞれにデータが転送される。すると既に格納されていた
データは、第２図の右方向、例えばデークラッチ回路２
１のデータはデータラッチ回路２２へと言うようにシフ
トされ過去のデータとして順次保存される。
力されると同時に、ＷＲ倍信号出力され、あらかじめＣ
ＰＵ４のメモリマツプ上に定めたアドレス情報によって
３端子がアクセスされ、アドレスバスの下位２ビツトの
情報によってデークラッチ回路２１．２４．２７のそれ
ぞれにデータが転送される。すると既に格納されていた
データは、第２図の右方向、例えばデークラッチ回路２
１のデータはデータラッチ回路２２へと言うようにシフ
トされ過去のデータとして順次保存される。
下位２ビツトの情報では４つのデ−クラッチ回路までア
クセス可能であるが、発熱要素の数に応じてアドレス入
力端子数と、データラッチ回路を増加すれば良い。
クセス可能であるが、発熱要素の数に応じてアドレス入
力端子数と、データラッチ回路を増加すれば良い。
データがセットされた後、通電パルス入力端子９に所定
のパルスを人力すると、発熱要素への通電がなされる。
のパルスを人力すると、発熱要素への通電がなされる。
３５．３０はラッチされたデータと通電区間信号とを組
み合ｉつせ、過去の履歴に応じて発熱量を制御する発熱
鍵制御信号を作製するゲート回路Ｇ０、Ｇ、であり、Ｇ
、は両端の発熱要素への信号■。、■１．を（年限する
もの、Ｇ、はＩｌ、〜■。
み合ｉつせ、過去の履歴に応じて発熱量を制御する発熱
鍵制御信号を作製するゲート回路Ｇ０、Ｇ、であり、Ｇ
、は両端の発熱要素への信号■。、■１．を（年限する
もの、Ｇ、はＩｌ、〜■。
、の出力信号を作製するものをそれぞれ示している。
第３図は通電パルス入力端子９の入力信号と、通電区間
信号の関係を示すものである。
信号の関係を示すものである。
Ｔ、〜Ｔ、は通電パルス入力端子９の入力波形であり、
ＴＷ、〜ＴＷ、は通電区間信号をそれぞれ示している。
ＴＷ、〜ＴＷ、は通電区間信号をそれぞれ示している。
ｔ、〜（、は通電区間信号のパルス幅をそれぞれ示して
いる。
いる。
第４図は本発明による印字制御装置のサーマルヘッドへ
の通電文法を示す説明図である。
の通電文法を示す説明図である。
４１．４２．４３はラッチ回路２１，２２．２３内のデ
ータをそれぞれ示していて、４１は現在の、４２は１つ
前の、４３は２つ前のデータを示している。５１５２．
５３はヘッド駆動信号の出力波形を示していて、５１は
ｔｌ。ｔ＞ｊ 子’） 、５２はＩＩ ｘ 端子の、５
３はＩｌ、端子をそれぞれ示している。
ータをそれぞれ示していて、４１は現在の、４２は１つ
前の、４３は２つ前のデータを示している。５１５２．
５３はヘッド駆動信号の出力波形を示していて、５１は
ｔｌ。ｔ＞ｊ 子’） 、５２はＩＩ ｘ 端子の、５
３はＩｌ、端子をそれぞれ示している。
４３が印刷１ｔｌ始時のデータとして示している。
通電初回は、全ての通電区間が発熱要素に加えられこれ
を全通電時間と言う。１つ前のタイミングでそのドツト
に通電がされていると斜線部で示したり３区間が減じら
れ、２つ前のタイミングでそのドツトに通電がされてい
ると出力波形５２で示ずようにｔ８区間が減じられ、連
続０ドツト通電の時は、１．＋１．区間が減じられるこ
とになる。更に、一つ前のタイミングで縦方向に双方の
ドツトが通電されているり！ｉは出力波形５３に示ずよ
うに【１区間が減じられる。又、上記それぞれの場合の
組み合わせで通電時間が決定される。この方法では、２
Ｘ２Ｘ２＝８の８通り過去の場合に対して４つの通電区
間信号をイｆしているだけでよいという構成となってい
る。
を全通電時間と言う。１つ前のタイミングでそのドツト
に通電がされていると斜線部で示したり３区間が減じら
れ、２つ前のタイミングでそのドツトに通電がされてい
ると出力波形５２で示ずようにｔ８区間が減じられ、連
続０ドツト通電の時は、１．＋１．区間が減じられるこ
とになる。更に、一つ前のタイミングで縦方向に双方の
ドツトが通電されているり！ｉは出力波形５３に示ずよ
うに【１区間が減じられる。又、上記それぞれの場合の
組み合わせで通電時間が決定される。この方法では、２
Ｘ２Ｘ２＝８の８通り過去の場合に対して４つの通電区
間信号をイｆしているだけでよいという構成となってい
る。
第２図のゲート回路Ｇ０、Ｇ、はこの出力信号を作製し
ている。
ている。
サーマルヘッドの発熱要素への通電々流が５０ｍＡ以下
のような小さな電流で良い場合は、ゲートアレイでＩＩ
ＣＵ ３を形成する時にヘッドドライブ回路を同一パ
ブケージ内に形成することも可１１１ｇである。
のような小さな電流で良い場合は、ゲートアレイでＩＩ
ＣＵ ３を形成する時にヘッドドライブ回路を同一パ
ブケージ内に形成することも可１１１ｇである。
第５図はパルス発生回路の一実施例を示す略図であり、
発熱要素への全通電ｌ！ｉ間と駆動履歴によって減する
通電区間を決定するものである。
発熱要素への全通電ｌ！ｉ間と駆動履歴によって減する
通電区間を決定するものである。
６０は前述のサーミスタ１４を包含する発振回路であり
、抵抗器０１，０２．６６、：Ｉノデン・す・６３、ト
ラ／ジスタロ４、インバータロ８、ツェナーダイオード
０５．電圧コンパレータ６７より形成されｍ ＨＶ ｃ
に接続されている。この出力波形６９の周期Ｓ、はサー
マルヘッドの温度を＋ｔ＋Ｊｕし、温度が高い時は小さ
く、低い時は大きくなる特性を有している。７０は分周
回路、７１はゲート回路を示している。ゲート回路７１
からは、Ｔ・〜Ｔ、のそれぞれのパルスが出力される。
、抵抗器０１，０２．６６、：Ｉノデン・す・６３、ト
ラ／ジスタロ４、インバータロ８、ツェナーダイオード
０５．電圧コンパレータ６７より形成されｍ ＨＶ ｃ
に接続されている。この出力波形６９の周期Ｓ、はサー
マルヘッドの温度を＋ｔ＋Ｊｕし、温度が高い時は小さ
く、低い時は大きくなる特性を有している。７０は分周
回路、７１はゲート回路を示している。ゲート回路７１
からは、Ｔ・〜Ｔ、のそれぞれのパルスが出力される。
−例としてＴ３ ＝Ｓｅ ｘｏ、Ｔ＊ ＝Ｓｅ Ｘ Ｉ
ＯｌＴ。
ＯｌＴ。
＝＝３＠Ｘ１２、Ｔ’ｅ＝Ｓｅｘ２２の時間が形成され
る。このようなパルス発生回路を用いてサーマルヘッド
への通電時間を決定することによって；八にサーマルヘ
ッドに最適な印加エネルギを与え、かつ過去の駆動！に
１歴によって減する印加エネルギも常にその時の全通電
時間に相関したものとなり印字品質を向上させることが
可能となる。
る。このようなパルス発生回路を用いてサーマルヘッド
への通電時間を決定することによって；八にサーマルヘ
ッドに最適な印加エネルギを与え、かつ過去の駆動！に
１歴によって減する印加エネルギも常にその時の全通電
時間に相関したものとなり印字品質を向上させることが
可能となる。
パルス発生回路内の分周回路７０、ゲート回路７１はゲ
ートアレイに一体化することが可能であり、かつプログ
ラマブルタイマーにすることによって更に簡略化するこ
とができる。
ートアレイに一体化することが可能であり、かつプログ
ラマブルタイマーにすることによって更に簡略化するこ
とができる。
本発明によれば、過去の駆動脂層によるデータ処理をＣ
ＰＵで行う必要がないため、ＣＩ）Ｕの高速処理が可能
となり、サーマルプリンタの印字スピードを上昇するこ
とが可能となる。
ＰＵで行う必要がないため、ＣＩ）Ｕの高速処理が可能
となり、サーマルプリンタの印字スピードを上昇するこ
とが可能となる。
又、ゲートアレイ等によってヘッド発熱制御回路ユニッ
トを形成しｌチップ化したことにより、これをＣＩ）
Ｕのメモリマツプ上に割り当てデータバス、アドレスバ
スと直結しＣＩ） Ｕから直接データを古き込むだげで
良いためきわめて簡単な構成で、復雑な処理を可１１シ
とした。
トを形成しｌチップ化したことにより、これをＣＩ）
Ｕのメモリマツプ上に割り当てデータバス、アドレスバ
スと直結しＣＩ） Ｕから直接データを古き込むだげで
良いためきわめて簡単な構成で、復雑な処理を可１１シ
とした。
第１図は本発明のサーマルプリンタの印字制御装置の構
成を示す略図。 第２図は本発明のヘッド発熱制御回路ユニットの一実施
例を示す回路図。 第３図は本１発明のヘッド発熱制御回路ユニットの通電
パルス入力信号と通電区間信号の関係を示す説明図。 第４図は本発明による印字制御装置のサーマルヘプトへ
の通電方法を示す説明図。 第５図は本発明の印字制９ＩＩ装置のパルス発生回路の
一実施例の回路図。 １・・・サーマルヘッド ３・・・ヘッド発熱制御回路ユニット ４・・べＰＵ １８・・・パルス発生回路 １４・・・サーミスタ ６０・・・発振回路 以 上 ｆ／’７届Ｊテ゛−タ 第１図 Ｔ。 第３ｖ！Ｊ ４３４２４１ 第４図
成を示す略図。 第２図は本発明のヘッド発熱制御回路ユニットの一実施
例を示す回路図。 第３図は本１発明のヘッド発熱制御回路ユニットの通電
パルス入力信号と通電区間信号の関係を示す説明図。 第４図は本発明による印字制御装置のサーマルヘプトへ
の通電方法を示す説明図。 第５図は本発明の印字制９ＩＩ装置のパルス発生回路の
一実施例の回路図。 １・・・サーマルヘッド ３・・・ヘッド発熱制御回路ユニット ４・・べＰＵ １８・・・パルス発生回路 １４・・・サーミスタ ６０・・・発振回路 以 上 ｆ／’７届Ｊテ゛−タ 第１図 Ｔ。 第３ｖ！Ｊ ４３４２４１ 第４図
Claims (1)
- 複数の発熱要素を有するサーマルヘッドを相対的に移動
させながら印刷する如きサーマルプリンタに於いて、前
記サーマルヘッドの温度もしくはその周囲温度を検出す
る感熱素子と、該感熱素子を包含し、前記温度に応じて
発振周波数の変化する発振回路と、前記サーマルヘッド
のそれぞれの発熱要素の駆動履歴を少くとも過去２回以
上記憶する記憶手段とを有し、前記発熱要素の基本とな
る全通電時間と、駆動履歴に応じて減ずる前全通電時間
内の通電区間を前記発振回路にて決定することを特徴と
するサーマルプリンタの印字制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62017551A JP2570715B2 (ja) | 1987-01-28 | 1987-01-28 | サ−マルプリンタの印字制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62017551A JP2570715B2 (ja) | 1987-01-28 | 1987-01-28 | サ−マルプリンタの印字制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63185656A true JPS63185656A (ja) | 1988-08-01 |
| JP2570715B2 JP2570715B2 (ja) | 1997-01-16 |
Family
ID=11947051
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62017551A Expired - Fee Related JP2570715B2 (ja) | 1987-01-28 | 1987-01-28 | サ−マルプリンタの印字制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2570715B2 (ja) |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0622217A1 (en) * | 1993-04-27 | 1994-11-02 | Agfa-Gevaert N.V. | Method for making an image using a direct thermal imaging element |
| JPH08174892A (ja) * | 1994-12-26 | 1996-07-09 | Nec Data Terminal Ltd | サーマルヘッド制御回路 |
| US6067100A (en) * | 1989-09-18 | 2000-05-23 | Canon Kabushiki Kaisha | Ink-jet recording apparatus and temperature control method therefor |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003311941A (ja) | 2002-04-18 | 2003-11-06 | Canon Inc | インクジェット記録装置 |
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-
1987
- 1987-01-28 JP JP62017551A patent/JP2570715B2/ja not_active Expired - Fee Related
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Also Published As
| Publication number | Publication date |
|---|---|
| JP2570715B2 (ja) | 1997-01-16 |
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