JPS62150388A - Plasma display unit - Google Patents
Plasma display unitInfo
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- JPS62150388A JPS62150388A JP60294335A JP29433585A JPS62150388A JP S62150388 A JPS62150388 A JP S62150388A JP 60294335 A JP60294335 A JP 60294335A JP 29433585 A JP29433585 A JP 29433585A JP S62150388 A JPS62150388 A JP S62150388A
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- Control Of Gas Discharge Display Tubes (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はコンピュータ・グラフィックス・ディスプレイ
等に用いられるプラズマ表示装置に関する。DETAILED DESCRIPTION OF THE INVENTION [Field of Industrial Application] The present invention relates to a plasma display device used for computer graphics displays and the like.
情報処理装置の表示装置は水平同期信号と垂直同期信号
と表示データから成るCRTインターフェースコネクタ
に接続するCRTディスプレイ装置が標準となっている
が、設置面積が大きく手軽に持ち運びができるほど軽く
ないことから小型で軽量な表示装置が開発されている。The standard display device for information processing equipment is a CRT display device, which connects to a CRT interface connector that consists of horizontal synchronization signals, vertical synchronization signals, and display data, but this requires a large footprint and is not light enough to be easily carried. Small and lightweight display devices have been developed.
プラズマ表示器を使用したプラズマ表示装置もその1つ
である。One such example is a plasma display device using a plasma display.
従来、プラズマ表示装置は、クロックとクロックに同期
した複数ビットの表示データとこの表示データをクロ・
ツクでサンプルしシフl〜するか否かを制御しかつ、水
平方向走査の制御を行う第1の同期信号と垂直方向の走
査の制御を行う第2の同期信号とにより制御され情報を
表示した。従って情報処理装置本体はクロックと表示デ
ータと第1の同期信号と第2の同期信号を陰むインター
フェース信号を出力し、専用のコネクタでプラズマ表示
装置と接続していた。Conventionally, plasma display devices have clocks, multiple bits of display data synchronized with the clock, and this display data.
The information was displayed under the control of a first synchronization signal that controls whether or not to sample and shift the image by clicking, and a first synchronization signal that controls horizontal scanning and a second synchronization signal that controls vertical scanning. . Therefore, the main body of the information processing apparatus outputs a clock, display data, and an interface signal containing a first synchronization signal and a second synchronization signal, and is connected to a plasma display device through a dedicated connector.
上述した従来のプラズマ表示装置は、インターフェース
信号がCRT制御用のインターフェース信号と異なるた
め情報処理装置本体にプラズマ表示装置専用の制御回路
を必要とし、プラズマ表示装置を使用する場合はCRT
表示装置を使用する時と違った操作が必要であった。こ
のためCRT表示装置を使用する場合とプラズマ表示装
置を使用する場合ではソフトウェアの互換が完全にとれ
ないという欠点がある。The conventional plasma display device described above requires a control circuit dedicated to the plasma display device in the information processing device main body because the interface signal is different from the interface signal for CRT control.
A different operation was required than when using a display device. For this reason, there is a drawback that software is not completely compatible when using a CRT display device and when using a plasma display device.
本発明の目的は、CRT表示装置用の信号をプラズマ表
示器用に変換する回路を設けることにより、CRT表示
装置と互換性のあるソフ■・ウェアによって表示可能な
プラズマ表示装置を提供することにある。An object of the present invention is to provide a plasma display device that can be displayed using software compatible with a CRT display device by providing a circuit that converts signals for a CRT display device into signals for a plasma display device. .
〔問題点を解決するだめの手段〕
本発明のプラズマ表示装置は情報処理装置からのCRT
ii+I t’n用水平同期信号と表示データの有効
を示す表示位置信号とから水平走査の制御を行う第1の
同期信号を発生し、CRT制御用の垂直同期信号と前記
表示位置信号とから垂直走査の制御を行う第2の同期信
号を発生する表示制御回路と、前記情報処理装置からの
CRT制御用表示データと前記表示位置信号とCRT
itl制御用基本クロックとから表示用クロックとこの
表示用クロックに同期した複数ビットの表示データとを
作成するデータ制御回路と、前記表示用クロックとこの
表示用クロックに同期した複数ビットの表示データを入
力し、この表示データを前記クロックでサンプルしシフ
トするか否かを制御して表示し、かつ前記第1の同期信
号と前記第2の同期信号とにより画面同期が制御される
プラズマ表示器とを含んで構成される。[Means for solving the problem] The plasma display device of the present invention is a CRT from an information processing device.
ii+I A first synchronizing signal for controlling horizontal scanning is generated from a horizontal synchronizing signal for t'n and a display position signal indicating validity of display data, and a first synchronizing signal for controlling horizontal scanning is generated from a vertical synchronizing signal for CRT control and a display position signal indicating the validity of display data. a display control circuit that generates a second synchronization signal for controlling scanning, display data for CRT control from the information processing device, the display position signal, and the CRT;
a data control circuit that creates a display clock and multiple bits of display data synchronized with the display clock from the itl control basic clock; a plasma display device that displays input data, samples this display data using the clock, controls whether or not to shift it, and controls screen synchronization by the first synchronization signal and the second synchronization signal; It consists of:
次に、本発明について図面を参照して説明する。 Next, the present invention will be explained with reference to the drawings.
第1図は本発明の一実施例を含むシステムのブロック図
である。このシステムは、情報処理装置1とデータ制御
回路2と表示制御回路3とプラズマ表示器4とから構成
され、制御回路2.3とプラズマ表示器4が本実施例に
相当する。情報処理装置1は、CRT制御用の表示デー
タaと水平同期信号dと垂直同期信号eとCRTiil
JN用基本クロックbと表りデータaが有効となる位置
を示す表示位置信号Cを出力する。データ制御回路2は
、情報処理装置1から出力された表示データaとCR′
「制御基本クロックbと表示位置信号Cとからプラズマ
表示器制御用クロ・ツクgとクロックに同期した複数ビ
・ソトの表示データfを作成し出力する。表示制御回路
3は、情報処理装置1がら出力される表示位置信号Cと
水平同期信号dと垂直同期信号eとから前記プラズマ表
示器4の第1の同期信号l〕と第2の同期信号iを発生
させる。プラズマ表示器4は、データ制御回路2がらの
複数ビット表示信号fとプラズマ表示器制御用クロック
gと、表示制御回路3からの第1の同期信号l〕と第2
の同期信号iを入力し、複数ビット表示信号fをクロッ
クgでサンプルしシフトするか否かを制御し、水平走査
を第1の同期信号りで制御し、垂直方向の走査を第2の
同期信号iで制御して情報を画面に表示する。FIG. 1 is a block diagram of a system including one embodiment of the present invention. This system is composed of an information processing device 1, a data control circuit 2, a display control circuit 3, and a plasma display 4, and the control circuit 2.3 and the plasma display 4 correspond to this embodiment. The information processing device 1 outputs display data a for CRT control, a horizontal synchronization signal d, a vertical synchronization signal e, and CRTiil.
A display position signal C indicating the position where the JN basic clock b and display data a are valid is output. The data control circuit 2 controls display data a and CR' output from the information processing device 1.
The display control circuit 3 creates and outputs a plasma display control clock g and multiple display data f synchronized with the clock from the control basic clock b and the display position signal C. A first synchronization signal l] and a second synchronization signal i of the plasma display 4 are generated from the display position signal C, horizontal synchronization signal d, and vertical synchronization signal e that are output from the plasma display 4.The plasma display 4 The multi-bit display signal f from the data control circuit 2, the plasma display control clock g, the first synchronization signal l from the display control circuit 3] and the second
A synchronization signal i is input, a multi-bit display signal f is sampled and shifted using a clock g, and horizontal scanning is controlled by the first synchronization signal, and vertical scanning is controlled by the second synchronization signal. Controlled by signal i, information is displayed on the screen.
第2図は第1図のデータ制御回路2の詳細ブロック図で
ある。このデータ制御回路2は、CRT制御用基本70
ツクbからプラズマ表示器用クロックgを発生し、CR
T ii制御制御用表示データ表示位置信号すからクロ
ックgに同期したnビットの表示データf、%f、を作
成する。FIG. 2 is a detailed block diagram of the data control circuit 2 shown in FIG. This data control circuit 2 includes a basic 70 for CRT control.
Generate the clock g for the plasma display from the clock b, and
T ii Control Display data for control Create n-bit display data f, %f, synchronized with clock g from the display position signal.
第3図は情報処理装置1から出力されるC RTインタ
ーフェース信号のタイムチャートであり、垂直同期信号
e、水平同期信号dは表示位置信号Cおよびシリアルな
表示データaのタイミングを示している。表示データa
の斜線部は表示画面以外のデータであり、表示位置信号
Cによって無視される部分である。L1〜L、は水平方
向のライン数である。FIG. 3 is a time chart of CRT interface signals output from the information processing device 1, in which the vertical synchronization signal e and the horizontal synchronization signal d indicate the timing of the display position signal C and the serial display data a. Display data a
The shaded area is data other than the display screen, and is ignored by the display position signal C. L1 to L are the numbers of lines in the horizontal direction.
第4図は本実施例のプラズマ表示装置のタイム−チャー
トである。水平方向の第1画素情報d1は表示位置信号
Cにより検出され、複数ビット(この例では2ビツト)
の表示データf、、f2が作成される。表示データf、
、f2と同期を取るプラズマ表示器用クロックgは、C
R,T制御用基本クロック1〕と表示位置信号Cとによ
って作成され、複数ビット表示データfl、f2のサン
プリングに使用される。第1の同期信号りは表示位置信
号Cと水平同期信号dとから作成され、複数ビット表示
データf、、f2のサンプリングと水平走査の制御を行
う、第2の同期信号iは表示位置信号Cと垂直同期信号
eとから作成され、垂直走査の制御を行う。FIG. 4 is a time chart of the plasma display device of this embodiment. The first pixel information d1 in the horizontal direction is detected by the display position signal C, and consists of multiple bits (2 bits in this example).
Display data f, , f2 are created. Display data f,
, f2 and the plasma display clock g synchronized with C
R, T control basic clock 1] and display position signal C, and is used for sampling multi-bit display data fl, f2. The first synchronization signal i is created from the display position signal C and the horizontal synchronization signal d, and controls the sampling and horizontal scanning of the multi-bit display data f, , f2, and the second synchronization signal i is the display position signal C. and a vertical synchronizing signal e to control vertical scanning.
以上説明したように本発明は、従来のCRTインターフ
ェース信号の水平同期信号、垂直同期信号、基本クロッ
クと新たに付加した表示データの有効な位置を示す表示
位置信号とからプラズマ表示器に必要な制御信号を作成
することにより、情報処理装置本体の構成やソフトウェ
アに関係なく情報処理装置本体のCRTインターフェー
スコネクタにプラズマ表示装置を接続することができる
効果がある。As explained above, the present invention provides control necessary for a plasma display based on the horizontal synchronization signal, vertical synchronization signal, basic clock of the conventional CRT interface signal, and the display position signal indicating the effective position of the newly added display data. By creating the signal, it is possible to connect the plasma display device to the CRT interface connector of the information processing apparatus main body, regardless of the configuration or software of the information processing apparatus main body.
第1図は本発明の一実施例のプラズマ表示装置を含むブ
ロック図、第2図は第1図のデータ制御回路の詳細ブロ
ック図、第3図は第1図のCRTインターフェース信号
のタイムチャー1・、第4図は本実施例のプラズマ表示
装置のタイムチャートである。
1・・・情報処理装置、2・・・データ制御回路、3・
・・表示制御回路、4・・・プラズマ表示器、a・・・
・表示データ、b・・・CRT制御用基本クロック、C
・・・表示位置信号、d・・・水平同期信号、e・・・
垂直同期信号、f、f、〜fn・・・複数ビット(nビ
ット)表示データ、g・・・プラズマ表示器用クロック
、11・・・プラズマ表示器用第1の同期信号、i・・
・プラズマ表示器 lr5!J
第 2 面FIG. 1 is a block diagram including a plasma display device according to an embodiment of the present invention, FIG. 2 is a detailed block diagram of the data control circuit of FIG. 1, and FIG. 3 is a time chart 1 of the CRT interface signal of FIG.・, FIG. 4 is a time chart of the plasma display device of this embodiment. 1... Information processing device, 2... Data control circuit, 3.
...Display control circuit, 4...Plasma display, a...
・Display data, b...Basic clock for CRT control, C
...Display position signal, d...Horizontal synchronization signal, e...
Vertical synchronization signal, f, f, ~fn...Multi-bit (n bit) display data, g...Clock for plasma display, 11...First synchronization signal for plasma display, i...
・Plasma display lr5! J 2nd page
Claims (1)
データの有効を示す表示位置信号とから水平走査の制御
を行う第1の同期信号を発生し、CRT制御用垂直同期
信号と前記表示位置信号とから垂直走査の制御を行う第
2の同期信号を発生する表示制御回路と、前記情報処理
装置からのCRT制御用表示データと前記表示位置信号
とCRT制御用基本クロックとから表示用クロックとこ
の表示用クロックに同期した複数ビットの表示データと
を作成するデータ制御回路と、前記表示用クロックとク
ロックに同期した前記複数ビットの表示データとを入力
しこの表示データを前記クロックでサンプルしシフトす
るか否かを制御して表示し、前記第1の同期信号と前記
第2の同期信号とにより画面同期が制御されるプラズマ
表示器とを含むことを特徴とするプラズマ表示装置。A first synchronization signal for controlling horizontal scanning is generated from a horizontal synchronization signal for CRT control from the information processing device and a display position signal indicating validity of display data, and a first synchronization signal for controlling horizontal scanning is generated from a vertical synchronization signal for CRT control and the display position signal. a display control circuit that generates a second synchronization signal for vertical scanning control; and a display control circuit that generates a display clock from the CRT control display data from the information processing device, the display position signal, and the CRT control basic clock. a data control circuit that creates a plurality of bits of display data synchronized with a clock, and inputs the display clock and the plurality of bits of display data synchronized with the clock, and samples and shifts this display data with the clock. What is claimed is: 1. A plasma display device comprising: a plasma display device that controls and displays whether or not a synchronization occurs, and whose screen synchronization is controlled by the first synchronization signal and the second synchronization signal.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60294335A JPS62150388A (en) | 1985-12-25 | 1985-12-25 | Plasma display unit |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60294335A JPS62150388A (en) | 1985-12-25 | 1985-12-25 | Plasma display unit |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62150388A true JPS62150388A (en) | 1987-07-04 |
Family
ID=17806368
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60294335A Pending JPS62150388A (en) | 1985-12-25 | 1985-12-25 | Plasma display unit |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62150388A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01300295A (en) * | 1988-05-28 | 1989-12-04 | Toshiba Corp | Display control system for plasma display |
-
1985
- 1985-12-25 JP JP60294335A patent/JPS62150388A/en active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01300295A (en) * | 1988-05-28 | 1989-12-04 | Toshiba Corp | Display control system for plasma display |
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