JPS61116665A - 低電力消費形電圧比較回路 - Google Patents
低電力消費形電圧比較回路Info
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- JPS61116665A JPS61116665A JP59236643A JP23664384A JPS61116665A JP S61116665 A JPS61116665 A JP S61116665A JP 59236643 A JP59236643 A JP 59236643A JP 23664384 A JP23664384 A JP 23664384A JP S61116665 A JPS61116665 A JP S61116665A
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- 230000003321 amplification Effects 0.000 claims abstract description 7
- 238000003199 nucleic acid amplification method Methods 0.000 claims abstract description 7
- 238000010586 diagram Methods 0.000 description 9
- 230000000694 effects Effects 0.000 description 2
- 230000002093 peripheral effect Effects 0.000 description 2
- 241000282376 Panthera tigris Species 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R19/00—Arrangements for measuring currents or voltages or for indicating presence or sign thereof
- G01R19/165—Indicating that current or voltage is either above or below a predetermined value or within or outside a predetermined range of values
- G01R19/16566—Circuits and arrangements for comparing voltage or current with one or several thresholds and for indicating the result not covered by subgroups G01R19/16504, G01R19/16528, G01R19/16533
- G01R19/16576—Circuits and arrangements for comparing voltage or current with one or several thresholds and for indicating the result not covered by subgroups G01R19/16504, G01R19/16528, G01R19/16533 comparing DC or AC voltage with one threshold
- G01R19/1658—AC voltage or recurrent signals
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/22—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral
- H03K5/24—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral the characteristic being amplitude
- H03K5/2409—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral the characteristic being amplitude using bipolar transistors
- H03K5/2418—Circuits having more than one input and one output for comparing pulses or pulse trains with each other according to input signal characteristics, e.g. slope, integral the characteristic being amplitude using bipolar transistors with at least one differential stage
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- Amplifiers (AREA)
- Measurement Of Current Or Voltage (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は電子回路に用いられる低電力消費形電圧比較回
路に関し、特に差動増幅回路に電源を間欠的に供給する
ことＫよって間欠動作をさせる低電力消費形電圧比較回
路に関する。
路に関し、特に差動増幅回路に電源を間欠的に供給する
ことＫよって間欠動作をさせる低電力消費形電圧比較回
路に関する。
差動増幅回路を用いた従来形の電圧比較回路は第５図、
第６図、および第７図に図示される。第５図は電圧比較
回路としての演算増幅器５０が示され、演算増幅器５０
は、電源（＋Ｖ）２１から電源供給線５１を介して電力
が供給され、電源帰線５２を通って電源の負側端子２２
（通常接地）へ戻される。また人力は非反転入力端子５
３および反転入力端子５４に供給され、出力端子５５に
出力が得られる。このような通常ＩＣ（集積回路）化さ
れた演算増幅器としての電圧比較回路は、差動増幅回路
を具備するため電力消費量が比較的大きいという問題点
を有する。特に上記回路に電池等により電力供給する場
合に問題が顕著になる。
第６図、および第７図に図示される。第５図は電圧比較
回路としての演算増幅器５０が示され、演算増幅器５０
は、電源（＋Ｖ）２１から電源供給線５１を介して電力
が供給され、電源帰線５２を通って電源の負側端子２２
（通常接地）へ戻される。また人力は非反転入力端子５
３および反転入力端子５４に供給され、出力端子５５に
出力が得られる。このような通常ＩＣ（集積回路）化さ
れた演算増幅器としての電圧比較回路は、差動増幅回路
を具備するため電力消費量が比較的大きいという問題点
を有する。特に上記回路に電池等により電力供給する場
合に問題が顕著になる。
このため第６図のように電力を・臂ルス（５８）的に、
電圧比較を行う時にのみ供給するようにした回路も知ら
れている。この例では人力として非反転入力端子５３お
よび反転入力端子５４０間に人力信号１５が加えられ、
反転入力端子５３にバイアス電圧（Ｖａ）２６が印加さ
れている。この回路の差動増幅回路部分の回路図が第７
図に示される。この回路例では、エミ、りが互いに接続
された２つのトランジスタ５６および５７とトランジス
タ５６および５７のコレクタにそれぞれ接続された抵抗
６２および６３とトランジスタ５６および５７のエミ、
りに接続された抵抗６１とによって差動増幅回路を構成
し、電力供給回路に挿入されたスイッチ６０によシミ源
２１の電圧をオン・オフして、この電圧比較回路を間欠
的に動作させ出力を端子６５に得ている。第６図および
第７図のような回路を用いれば電力の消費は小さい値に
抑えることができる。
電圧比較を行う時にのみ供給するようにした回路も知ら
れている。この例では人力として非反転入力端子５３お
よび反転入力端子５４０間に人力信号１５が加えられ、
反転入力端子５３にバイアス電圧（Ｖａ）２６が印加さ
れている。この回路の差動増幅回路部分の回路図が第７
図に示される。この回路例では、エミ、りが互いに接続
された２つのトランジスタ５６および５７とトランジス
タ５６および５７のコレクタにそれぞれ接続された抵抗
６２および６３とトランジスタ５６および５７のエミ、
りに接続された抵抗６１とによって差動増幅回路を構成
し、電力供給回路に挿入されたスイッチ６０によシミ源
２１の電圧をオン・オフして、この電圧比較回路を間欠
的に動作させ出力を端子６５に得ている。第６図および
第７図のような回路を用いれば電力の消費は小さい値に
抑えることができる。
しかしながら、前述の回路においては、電源を間欠供給
するためのスイッチをオフにすると、殆壇どの回路が電
源帰線側の電位（通常接地電位〕になってしまい、次に
スイッチをオンにして電圧比較動作を行う際、所要の電
位に迄迅速に立上ることができず或時間を必要とし、そ
のため高速な間欠動作が困難となる。本発明はこの問題
点を解決しようとするものである。
するためのスイッチをオフにすると、殆壇どの回路が電
源帰線側の電位（通常接地電位〕になってしまい、次に
スイッチをオンにして電圧比較動作を行う際、所要の電
位に迄迅速に立上ることができず或時間を必要とし、そ
のため高速な間欠動作が困難となる。本発明はこの問題
点を解決しようとするものである。
従って、本発明の目的は、電圧比較回路における差動増
幅手段の電源供給側および電源帰線側に電流スイッチ回
路を設け、該スイッチ回路を間欠的にオン・オフすると
いう着想に基づき、消費電力が少なく、かつ高速間欠動
作が可能な電圧比較回路を得ることにある。
幅手段の電源供給側および電源帰線側に電流スイッチ回
路を設け、該スイッチ回路を間欠的にオン・オフすると
いう着想に基づき、消費電力が少なく、かつ高速間欠動
作が可能な電圧比較回路を得ることにある。
本発明は上記問題点を改善した回路を提供するもので、
その手段は、電圧比較回路における差動増幅手段の電源
供給側および電源帰線側に電流スイッチ回路を設け、該
電流スイッチ回路を必要に応じてオン−オフすることに
よってなされる。
その手段は、電圧比較回路における差動増幅手段の電源
供給側および電源帰線側に電流スイッチ回路を設け、該
電流スイッチ回路を必要に応じてオン−オフすることに
よってなされる。
上述のように電圧比較回路の差動増幅手段の電源供給廻
および電源帰線側に電流スイッチ回路を設け、必要な時
のみ間欠的に電流スイッチを導通させて電力を供給する
ようにすれば、電力消費量を低減できる。また２つの電
流スイッチによりオフされ非接続とされた差動増幅回路
は７０−ティング状態となっておシ、電流スイッチがオ
ンされて動作状態に切換えられた時、迅速に対応でき、
高速な間欠動作に即応できる。
および電源帰線側に電流スイッチ回路を設け、必要な時
のみ間欠的に電流スイッチを導通させて電力を供給する
ようにすれば、電力消費量を低減できる。また２つの電
流スイッチによりオフされ非接続とされた差動増幅回路
は７０−ティング状態となっておシ、電流スイッチがオ
ンされて動作状態に切換えられた時、迅速に対応でき、
高速な間欠動作に即応できる。
本発明の一実施例としての低電力消費形電圧比較回路の
構成が第２図および第３図に示される。
構成が第２図および第３図に示される。
本回路においては電圧比較回路を構成する演算増幅器１
０の中に電流スイッチを設けて、新たに設けた切換用端
子（ＯＮｌｏＦＦ）３０に外部から信号を加えることに
よジオン・オフできるようにしである。この電流スイッ
チは演算増幅器１０における差動増幅回路の電源供給側
と電源帰線側に挿入゛され、差動増幅回路の電源を必要
に応じて接続したシ、非接続としたりすることができる
。第２図の回路においては、非反転入力端子１２および
反転入力端子１３に人力が加えられ、出力が出力端子２
０に得られる。電源（−４４）２１は電源供給線３１を
通って供給され、電源帰線３２を介して接地２２される
。
０の中に電流スイッチを設けて、新たに設けた切換用端
子（ＯＮｌｏＦＦ）３０に外部から信号を加えることに
よジオン・オフできるようにしである。この電流スイッ
チは演算増幅器１０における差動増幅回路の電源供給側
と電源帰線側に挿入゛され、差動増幅回路の電源を必要
に応じて接続したシ、非接続としたりすることができる
。第２図の回路においては、非反転入力端子１２および
反転入力端子１３に人力が加えられ、出力が出力端子２
０に得られる。電源（−４４）２１は電源供給線３１を
通って供給され、電源帰線３２を介して接地２２される
。
第３図は前述の第６図に対応する図であって、第２図の
回路の入力端子間に被演算人力信号１５が印加され、反
転入力端子１３にバイアス用電圧（Ｖｌ）の電源２６が
接続されている。切換用端子３０にはパルス信号３３が
加えられている。演算増幅器１０に関しては第２図のも
のと同一である。
回路の入力端子間に被演算人力信号１５が印加され、反
転入力端子１３にバイアス用電圧（Ｖｌ）の電源２６が
接続されている。切換用端子３０にはパルス信号３３が
加えられている。演算増幅器１０に関しては第２図のも
のと同一である。
第１図には、本実施例における差動増幅回路とその周辺
部分の回路図が示される。この差動増幅回路１１はトラ
ンジスタ１６および１７、およびトランジスタ１６およ
び１７のコレクタにそれぞれ接続された抵抗１８および
１９を具備する。トランジスタ１６と１７のエミッタは
互いに接続されている。トランジスタ１６のペースは非
反転入力端子１２に、トランジスタ１７０ベースは反転
入力端子１３に接続される。電源（＋ｖ）２１からの電
力は、電流スイッチ２３を介して抵抗１８および１９の
、トランジスタ１６および１７と接続されない側の端子
へ接続される。トランジスタ１６および１７のエミッタ
は、他の１つの電流スイッチ２４を介して接地される。
部分の回路図が示される。この差動増幅回路１１はトラ
ンジスタ１６および１７、およびトランジスタ１６およ
び１７のコレクタにそれぞれ接続された抵抗１８および
１９を具備する。トランジスタ１６と１７のエミッタは
互いに接続されている。トランジスタ１６のペースは非
反転入力端子１２に、トランジスタ１７０ベースは反転
入力端子１３に接続される。電源（＋ｖ）２１からの電
力は、電流スイッチ２３を介して抵抗１８および１９の
、トランジスタ１６および１７と接続されない側の端子
へ接続される。トランジスタ１６および１７のエミッタ
は、他の１つの電流スイッチ２４を介して接地される。
電流スイッチ２３および２４のオン・オフを制御する制
御端子は切換用端子３０に接続される。トランジスタ１
７のコレクタからは出力端子１４へ接続される。
御端子は切換用端子３０に接続される。トランジスタ１
７のコレクタからは出力端子１４へ接続される。
人力信号１５およびバイアス用電源２６の接続について
は第３図の回路とほぼ同様である。電流スイッチ２３お
よび２４は例えば定電流回路を構成するトランジスタ回
路を用いることができる。
は第３図の回路とほぼ同様である。電流スイッチ２３お
よび２４は例えば定電流回路を構成するトランジスタ回
路を用いることができる。
上述のような差動増幅回路１１を用いれば、電流スイッ
チがオフ状態からオン状態に切換えられても、差動増幅
回路１１がオフ状態でフローティング状態になっている
から、回路の各部電圧が動作状態の正常な条件に迅速に
到達する。従って高速な間欠動作に耐えられる。
チがオフ状態からオン状態に切換えられても、差動増幅
回路１１がオフ状態でフローティング状態になっている
から、回路の各部電圧が動作状態の正常な条件に迅速に
到達する。従って高速な間欠動作に耐えられる。
本発明の他の実施例としての低電力消費形電圧比較回路
の回路図が第４図に示される。この回路はトランジスタ
Ｑ１からＱ１７を具備する。トラ７ノスタＱ１からＱ７
、Ｑ１５およびＱ１６は電流スイッチ用として用いられ
る。
の回路図が第４図に示される。この回路はトランジスタ
Ｑ１からＱ１７を具備する。トラ７ノスタＱ１からＱ７
、Ｑ１５およびＱ１６は電流スイッチ用として用いられ
る。
電源２１は通常＋５ビルトを供給し、一方は接地２２さ
れている。トランジスタＱ１は外部からの切換用オン・
オフ信号を受けて導通または非導通状態をとる。トラン
ジスタＱ１がペースに＋５デルトを受けると導通し、ト
ランジスタＱ２を導通状態とし、それによシ、トランジ
スタＱ５を導通状態とし、次いでトランジスタＱ３．Ｑ
４゜Ｑ６．Ｑ７、およびＱ１５のペースが接続されてい
る接続点４２は＋５ボルトから約０．６メルト低い約＋
４．４？ルトに設定される。同時にトランジスタＱ５の
ペースおよびトランジスタＱ３のコレクタに接続された
接続点４３は＋５ビルトかも約１．２ケルト低い約＋３
．８？ルトに設定される。またトランゾスタＱ１６０ペ
ースも杓子０．６ビルトに設定される。このようにして
電流スイッチ用トランジスタがすべて導通状態となるほ
かトランジスタＱ１０．Ｑｌｌ、およびＱ１４が導通状
態となる。
れている。トランジスタＱ１は外部からの切換用オン・
オフ信号を受けて導通または非導通状態をとる。トラン
ジスタＱ１がペースに＋５デルトを受けると導通し、ト
ランジスタＱ２を導通状態とし、それによシ、トランジ
スタＱ５を導通状態とし、次いでトランジスタＱ３．Ｑ
４゜Ｑ６．Ｑ７、およびＱ１５のペースが接続されてい
る接続点４２は＋５ボルトから約０．６メルト低い約＋
４．４？ルトに設定される。同時にトランジスタＱ５の
ペースおよびトランジスタＱ３のコレクタに接続された
接続点４３は＋５ビルトかも約１．２ケルト低い約＋３
．８？ルトに設定される。またトランゾスタＱ１６０ペ
ースも杓子０．６ビルトに設定される。このようにして
電流スイッチ用トランジスタがすべて導通状態となるほ
かトランジスタＱ１０．Ｑｌｌ、およびＱ１４が導通状
態となる。
以上述べたように、トランジスタＱ１が導通状態となる
と電流スイッチ用トランジスタが導通状態となシ、トラ
ンジスタＱ８およびＱ９の差動増幅回路、および差動増
幅回路から出力を取り出す回路を構成するトランジスタ
ＱＩＯ，Ｑ１１．およびＱ１７、に電源の供給が行われ
る。電源の供給を受けた差動増幅回路は入力端子１２お
よび１３＆ＣＡ力を受け、出力をトランジスタＱ１７の
Ｊる・ 上述のような回路を用いれば、切換用端子３０にオン信
号が人力しない時は殆ど電力の消費がなされず、かつオ
ン信号が人力した時は迅速に動作状態時の電位に各部が
設定され、高速な間欠動作を行うことが可能となる。な
おトランジスタＱ１？とそのペースに接続されたダイオ
ードはカレントミラー回路を構成している。
と電流スイッチ用トランジスタが導通状態となシ、トラ
ンジスタＱ８およびＱ９の差動増幅回路、および差動増
幅回路から出力を取り出す回路を構成するトランジスタ
ＱＩＯ，Ｑ１１．およびＱ１７、に電源の供給が行われ
る。電源の供給を受けた差動増幅回路は入力端子１２お
よび１３＆ＣＡ力を受け、出力をトランジスタＱ１７の
Ｊる・ 上述のような回路を用いれば、切換用端子３０にオン信
号が人力しない時は殆ど電力の消費がなされず、かつオ
ン信号が人力した時は迅速に動作状態時の電位に各部が
設定され、高速な間欠動作を行うことが可能となる。な
おトランジスタＱ１？とそのペースに接続されたダイオ
ードはカレントミラー回路を構成している。
本発明によれば、高速な間欠動作を行う電圧比較回路が
得られ、それによシ消費電力の低減が実現可能となる。
得られ、それによシ消費電力の低減が実現可能となる。
第１図は本発明の一実施例としての低電力消費形電圧比
較回路の差動増幅回路とその周辺部分の回路図、第２図
および第３図はｉ１図の低電力消費形電圧比較回路の回
路図、第４図は本発明の他の実施例の低電力消費形電圧
比較回路の回路図、第５図お；び第６図は従来形の電圧
比較回路の回路図、および第７図は従来形の間欠動作を
行う電圧比較回路におゆる差動増幅部の回路図である。 １０・・・演算増幅器、１１・・・差動増幅回路、１２
・・・非反転入力端子、１３・・・反転入力端子、１４
・・・出力端子、１５・・・人力信号、１６．１７・・
・トランジスタ、１８．１９・・・抵抗、２ｏ・・・出
力端子、２１・・・電源（＋Ｖ）、２２・・・電源（接
地）、２３゜２４・・・電流スイッチ、２６・・・バイ
アス用電源、３０・・・切換用端子、３１・・・電源供
給線、３２・・・電源帰線。 第１図 第２図 ′＄３図 第５図 第６図 第７図
較回路の差動増幅回路とその周辺部分の回路図、第２図
および第３図はｉ１図の低電力消費形電圧比較回路の回
路図、第４図は本発明の他の実施例の低電力消費形電圧
比較回路の回路図、第５図お；び第６図は従来形の電圧
比較回路の回路図、および第７図は従来形の間欠動作を
行う電圧比較回路におゆる差動増幅部の回路図である。 １０・・・演算増幅器、１１・・・差動増幅回路、１２
・・・非反転入力端子、１３・・・反転入力端子、１４
・・・出力端子、１５・・・人力信号、１６．１７・・
・トランジスタ、１８．１９・・・抵抗、２ｏ・・・出
力端子、２１・・・電源（＋Ｖ）、２２・・・電源（接
地）、２３゜２４・・・電流スイッチ、２６・・・バイ
アス用電源、３０・・・切換用端子、３１・・・電源供
給線、３２・・・電源帰線。 第１図 第２図 ′＄３図 第５図 第６図 第７図
Claims (1)
- 【特許請求の範囲】 １、差動増幅手段を備えた低電力消費形電圧比較回路に
おいて、該差動増幅手段の電源供給側および電源帰線側
にそれぞれ電流スイッチ回路を設け、該電流スイッチ回
路を必要に応じてオン・オフすることを特徴とする低電
力消費形電圧比較回路。 ２、該電流スイッチ回路は、トランジスタを用いた定電
流源回路をオン・オフ制御するようにした特許請求の範
囲第１項に記載の低電力消費形電圧比較回路。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59236643A JPS61116665A (ja) | 1984-11-12 | 1984-11-12 | 低電力消費形電圧比較回路 |
| EP85905676A EP0207159B1 (en) | 1984-11-12 | 1985-11-12 | Voltage comparator of a type of low power comsumption |
| DE8585905676T DE3584447D1 (de) | 1984-11-12 | 1985-11-12 | Spannungskomparator mit geringem leistungsverbrauch. |
| US06/887,403 US4724339A (en) | 1984-11-12 | 1985-11-12 | Low electric power consumption voltage comparison device |
| PCT/JP1985/000631 WO1986003012A1 (en) | 1984-11-12 | 1985-11-12 | Voltage comparator of a type of low power comsumption |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59236643A JPS61116665A (ja) | 1984-11-12 | 1984-11-12 | 低電力消費形電圧比較回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61116665A true JPS61116665A (ja) | 1986-06-04 |
| JPH0548429B2 JPH0548429B2 (ja) | 1993-07-21 |
Family
ID=17003659
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59236643A Granted JPS61116665A (ja) | 1984-11-12 | 1984-11-12 | 低電力消費形電圧比較回路 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US4724339A (ja) |
| EP (1) | EP0207159B1 (ja) |
| JP (1) | JPS61116665A (ja) |
| DE (1) | DE3584447D1 (ja) |
| WO (1) | WO1986003012A1 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2004055536A1 (ja) * | 2002-12-17 | 2004-07-01 | Sanyo Electric Co., Ltd. | 電池の残量検出システム、残量演算装置及び電流検出装置 |
Families Citing this family (14)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2611330B1 (fr) * | 1987-02-24 | 1989-05-05 | Thomson Semiconducteurs | Amplificateur de lecture pour memoire |
| FR2617976B1 (fr) * | 1987-07-10 | 1989-11-10 | Thomson Semiconducteurs | Detecteur electrique de niveau logique binaire |
| ES2077594T3 (es) * | 1990-02-13 | 1995-12-01 | Siemens Ag | Circuito comparador. |
| JPH0447591A (ja) * | 1990-06-14 | 1992-02-17 | Mitsubishi Electric Corp | 半導体集積回路装置 |
| US5198701A (en) * | 1990-12-24 | 1993-03-30 | Davies Robert B | Current source with adjustable temperature variation |
| US5367412A (en) * | 1992-09-10 | 1994-11-22 | Rohm Co., Ltd. | Recording/reproducing circuit and recording/reproducing apparatus having the same circuit |
| US6002268A (en) * | 1993-01-08 | 1999-12-14 | Dynachip Corporation | FPGA with conductors segmented by active repeaters |
| US5355035A (en) * | 1993-01-08 | 1994-10-11 | Vora Madhukar B | High speed BICMOS switches and multiplexers |
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| DE4430049C1 (de) | 1994-08-24 | 1996-03-21 | Siemens Ag | Schaltungsanordnung zur Unterspannungs-Erkennung |
| JP2681001B2 (ja) * | 1994-08-31 | 1997-11-19 | 日本電気アイシーマイコンシステム株式会社 | コンパレータ回路 |
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